CN113949466A - 实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其存储介质 - Google Patents
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Abstract
本发明涉及一种实现自动化超宽带无线信号采集传输处理的系统，包括：射频变频单元；宽带滤波器单元滤除镜像频率；高速ADC单元对中频宽带信号进行数字量化；FPGA信号处理单元提供DSP处理逻辑；主控单元；网络传输接口；中心服务器实现同步节拍信号发起及控制；同步信号接口；参考时钟单元产生高精度的精准时钟；本振单元产生不同的混频本振信号。本发明还涉及一种实现自动化超宽带无线信号采集传输处理的方法、装置、处理器及其计算机可读存储介质。采用了本发明的实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质，充分利用网络带宽，减少网络传输冲突，提高了无线信号采集效率。
Description
技术领域
本发明涉及宽带无线信号自动化领域，尤其涉及宽带无线信号自动化采集及传输领域，具体是指一种实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质。
背景技术
通用信号分析仪均具备宽带信号采集并网络传输的能力，操作场景为信号分析仪通过射频缆线连接待测设备，通过千兆网卡连接至局域网络，网络中存在远程控制主机，主机通过发送SCPI指令设置分析仪的频点、参考电平或采样时长等参数，每次设置需要一个单独的SCPI指令操作，耗时较长，待参数配置完毕后再发送SCPI数据请求指令，完成IQ数据的网络传输。上述操作流程均由远程控制主机发起，通过编写脚本逐条运行，交互频繁，操作时间长，如果应用于流水线等产线场景，效率极低。本发明将参数设置脚本放置于FPGA中执行，配备有网络中心服务器，该服务器提供数据缓存池及节拍信号，保证信号采集端在统一的步调下执行，具有操作时刻可控、运行效率高、系统带宽使用率高的特点，完全满足产线测试效率要求高，测试范例固定的特定需求。另外，本发明采用硬件功率校准技术，将海量校准数据预先缓存至FPGA的DDR外设，实现功率实时补偿。为进一步提高频谱分析速度，FFT等数据分析操作也作为选件在FPGA中实现。
发明内容
本发明的目的是克服了上述现有技术的缺点，提供了一种满足效率高、采样率高、适用范围较为广泛的实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质。
为了实现上述目的，本发明的实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质如下：
该实现自动化超宽带无线信号采集传输处理的系统，其主要特点是，所述的系统包括：
射频变频单元，用于实现不同频点的射频信号变频转换至固定中频输出；
宽带滤波器单元，与所述的射频变频单元相连接，用于对中频信号进行滤波，滤除镜像频率，并实现高速ADC单元前端抗混叠；
高速ADC单元，与所述的宽带滤波器单元相连接，用于对中频宽带信号进行数字量化，将量化信号传输至FPGA信号处理单元进行后续DSP处理；
FPGA信号处理单元，与所述的高速ADC单元相连接，用于提供DSP处理逻辑；
主控单元，与所述的FPGA信号处理单元相连接，用于进行硬件初始化及控制，传输网络数据，采集并上传数据；
网络传输接口，与所述的主控单元相连接，用于通过网络传输指令及数据；
中心服务器，接收端与所述的网络传输接口相连接，输出端与FPGA信号处理单元相连接，用于上传和存储采集设备数据，实现同步节拍信号发起及控制；
同步信号接口，与所述的中心服务器相连接，用于实现系统的定时同步信号的传递；
参考时钟单元，接收端与所述的同步信号接口相连接，输出端与高速ADC单元和FPGA信号处理单元相连接，用于对高精度时钟进行锁相，产生高精度的精准时钟，为本振单元及FPGA信号处理单元提供参考时钟；
本振单元，接收端与所述的参考时钟单元相连接，输出端与射频变频单元相连接，用于通过小数分频，产生不同的混频本振信号。
较佳地，所述的FPGA信号处理单元包括：
逻辑控制状态机，用于根据参数配合外部触发激励信号执行状态跳转；
控制寄存器，与所述的逻辑控制状态机相连接，用于配置当前工作参数和操作流程；
脚本存储器，与所述的逻辑控制状态机相连接，包括正本和副本，用于支持选择并执行其中一个脚本；
外设控制接口，与所述的逻辑控制状态机相连接，用于按照脚本语义进行外设的配置和操作；
数据通道，与所述的逻辑控制状态机相连接，用于根据外部触发信号指引，执行数据缓存或回传操作；
外部触发激励信号接口，与所述的逻辑控制状态机相连接，用于对数据波形进行整形及计数，并产生特定事件。
较佳地，所述的射频变频单元的前端通过开关形成两路预处理通道，其中一路预处理通道采用数控衰减器，处理大功率信号，对大信号进行功率衰减；另外一路预处理通道采用固定增益低噪放，处理小信号通路。
较佳地，所述的射频变频单元采用有源混频器，频率范围覆盖10MHz至8GHz，中频频点为307.2MHz。
较佳地，所述的高速ADC单元包含DDC及半带滤波数字信号处理链路，具有不同的信号处理模式。
该利用上述系统实现自动化超宽带无线信号采集传输处理的方法，其主要特点是，所述的方法包括以下步骤：
(1)射频变频单元对射频信号进行变频处理，通过宽带滤波器单元进行抗混叠处理；
(2)高速ADC单元进行高速采样；
(3)FPGA信号处理单元与高速ADC单元进行通信，将并行数据传递至后端DSP单元进行处理；
(4)对采集到的高速并行数据进行滤波，将滤波后的数据传递至响应滤波器，进行宽带内均衡，补偿幅频响应；
(5)FPGA信号处理单元接收外部节拍信号，在触发时刻缓存处理完毕的数据；
(6)上位机根据硬件中断信号请求IQ数据，通过网络传输将连续IQ的数据传输至服务端；
(7)服务端响应IQ数据网络传输请求，并将数据缓存至资源池。
较佳地，所述的步骤(5)还包括以下步骤：
FPGA信号处理单元产生中断信号，根据全局节拍信号定时进行网络数据传输。
该用于实现自动化超宽带无线信号采集传输处理的装置，其主要特点是，所述的装置包括：
处理器，被配置成执行计算机可执行指令；
存储器，存储一个或多个计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
该用于实现自动化超宽带无线信号采集传输处理的处理器，其主要特点是，所述的处理器被配置成执行计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
该计算机可读存储介质，其主要特点是，其上存储有计算机程序，所述的计算机程序可被处理器执行以实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
采用了本发明的实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质，采用网络架构，采集和测量分离。具体为数据集中缓存、数据采集节点分布式部署，同时保证采集节点设置的灵活性和中央调度的统一性。采用中心服务器产生时序节拍的方法，统一调度采集节点的任务时序，充分利用网络带宽，减少网络传输冲突，提高了无线信号采集效率，适用于产线流水线测试。系统架构较为合理，数据流清晰，采用多项技术，实时处理宽带信号，使用硬件均衡技术，补偿通带内频响，降低带内波动，提高功率及EVM测量精确度。
附图说明
图1为本发明的实现自动化超宽带无线信号采集传输处理的系统的方案框图。
图2为本发明的实现自动化超宽带无线信号采集传输处理的系统的控制逻辑FPGA实现框图。
图3为本发明的实现自动化超宽带无线信号采集传输处理的方法的控制流程图。
图4为本发明的实现自动化超宽带无线信号采集传输处理的方法的数据流程框图。
具体实施方式
为了能够更清楚地描述本发明的技术内容，下面结合具体实施例来进行进一步的描述。
本发明的该实现自动化超宽带无线信号采集传输处理的系统，其中包括：
射频变频单元，用于实现不同频点的射频信号变频转换至固定中频输出；
宽带滤波器单元，与所述的射频变频单元相连接，用于对中频信号进行滤波，滤除镜像频率，并实现高速ADC单元前端抗混叠；
高速ADC单元，与所述的宽带滤波器单元相连接，用于对中频宽带信号进行数字量化，将量化信号传输至FPGA信号处理单元进行后续DSP处理；
FPGA信号处理单元，与所述的高速ADC单元相连接，用于提供DSP处理逻辑；
主控单元，与所述的FPGA信号处理单元相连接，用于进行硬件初始化及控制，传输网络数据，采集并上传数据；
网络传输接口，与所述的主控单元相连接，用于通过网络传输指令及数据；
中心服务器，接收端与所述的网络传输接口相连接，输出端与FPGA信号处理单元相连接，用于上传和存储采集设备数据，实现同步节拍信号发起及控制；
同步信号接口，与所述的中心服务器相连接，用于实现系统的定时同步信号的传递；
参考时钟单元，接收端与所述的同步信号接口相连接，输出端与高速ADC单元和FPGA信号处理单元相连接，用于对高精度时钟进行锁相，产生高精度的精准时钟，为本振单元及FPGA信号处理单元提供参考时钟；
本振单元，接收端与所述的参考时钟单元相连接，输出端与射频变频单元相连接，用于通过小数分频，产生不同的混频本振信号。
作为本发明的优选实施方式，所述的FPGA信号处理单元包括：
逻辑控制状态机，用于根据参数配合外部触发激励信号执行状态跳转；
控制寄存器，与所述的逻辑控制状态机相连接，用于配置当前工作参数和操作流程；
脚本存储器，与所述的逻辑控制状态机相连接，包括正本和副本，用于支持选择并执行其中一个脚本；
外设控制接口，与所述的逻辑控制状态机相连接，用于按照脚本语义进行外设的配置和操作；
数据通道，与所述的逻辑控制状态机相连接，用于根据外部触发信号指引，执行数据缓存或回传操作；
外部触发激励信号接口，与所述的逻辑控制状态机相连接，用于对数据波形进行整形及计数，并产生特定事件。
作为本发明的优选实施方式，所述的射频变频单元的前端通过开关形成两路预处理通道，其中一路预处理通道采用数控衰减器，处理大功率信号，对大信号进行功率衰减；另外一路预处理通道采用固定增益低噪放，处理小信号通路。
作为本发明的优选实施方式，所述的射频变频单元采用有源混频器，频率范围覆盖10MHz至8GHz，中频频点为307.2MHz。
作为本发明的优选实施方式，所述的高速ADC单元包含DDC及半带滤波数字信号处理链路，具有不同的信号处理模式。
本发明的该利用上述系统实现自动化超宽带无线信号采集传输处理的方法，其中包括以下步骤：
(1)射频变频单元对射频信号进行变频处理，通过宽带滤波器单元进行抗混叠处理；
(2)高速ADC单元进行高速采样；
(3)FPGA信号处理单元与高速ADC单元进行通信，将并行数据传递至后端DSP单元进行处理；
(4)对采集到的高速并行数据进行滤波，将滤波后的数据传递至响应滤波器，进行宽带内均衡，补偿幅频响应；
(5)FPGA信号处理单元接收外部节拍信号，在触发时刻缓存处理完毕的数据；
(6)上位机根据硬件中断信号请求IQ数据，通过网络传输将连续IQ的数据传输至服务端；
(7)服务端响应IQ数据网络传输请求，并将数据缓存至资源池。
作为本发明的优选实施方式，所述的步骤(5)还包括以下步骤：
FPGA信号处理单元产生中断信号，根据全局节拍信号定时进行网络数据传输。
本发明的该用于实现自动化超宽带无线信号采集传输处理的装置，其中所述的装置包括：
处理器，被配置成执行计算机可执行指令；
存储器，存储一个或多个计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
本发明的该用于实现自动化超宽带无线信号采集传输处理的处理器，其中所述的处理器被配置成执行计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
本发明的该计算机可读存储介质，其上存储有计算机程序，所述的计算机程序可被处理器执行以实现上述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
本发明的具体实施方式中，提供了一种利用中心服务器提供数据缓存池并提供同步节拍信号，控制网络中无线信号采集设备实现流水线测试自动化的方案。该方案功能结构如图2所示，主要由十部分组成，分别是一次射频变频单元、宽带滤波器单元、高速ADC单元、参考时钟单元、本振单元、FPGA信号处理单元、主控单元、网络传输接口、同步信号接口及中心服务器。
如图1所示为发明方案框图，罗列了系统组成构建及逻辑关系，主体分为两部分，虚线圈住部分为分布式采集单元实现框图，另外一部分为基于网络的中心服务器，上述两者分别承担不同的工作任务，采集单元通过变频采样，实现无线信号的采集、存储及回传；中心服务器运行缓存池，并响应回传请求，同时发起节拍事件，引导采集单元按照特定的时序执行。
一次射频变频单元覆盖10MHz至8GHz频率范围，将待测高频射频信号变频至中频频率，中频频点设置为307.2MHz；
宽带滤波器单元对中频信号进行滤波，滤除镜像频率，并实现ADC前端抗混叠滤波器功能；
高速ADC单元采用1.2288GHz采样时钟对中频宽带信号进行数字量化，保证500MHz分析带宽，通过JESD204B接口与FPGA通信，将量化信号传输给FPGA进行后续DSP处理；
参考单元对10MHz高稳高精度时钟进行锁定，控制122.88MHz的VCXO产生相噪优良的稳定信号，并以122.88MHz信号为基础频率，10倍频产生采样时钟。参考时钟单元通过功分器将122.88MHz参考时钟提供给FPGA单元和本振单元，实现所需的时钟树设计；
本振单元对122.88MHz参考信号进行锁定，采用小数分频，控制宽带VCO，产生混频器所需的本振信号；
FPGA信号处理单元提供DSP处理逻辑，采用JESD204B与高速ADC通信，采用DDR4作为外部缓存器，采用PCIe与上位机通信，提供了匹配的接口带宽，保证500Mhz带宽信号的接收、多项滤波器、数字下变频、数据缓存及数据上传。
下面对不同的功能单元作进一步描述：
1、一次射频变频单元：采用有源混频器，频率范围覆盖10MHz至8GHz，其主要功能是实现不同频点的射频信号变频转换至固定中频输出，中频频点设定为307.2MHz；射频前端通过开关形成两路预处理通道，一路为处理大功率信号，采用数控衰减器，可对大信号做可编程功率衰减，另外一路为处理小信号通路，采用固定增益低噪放，降低链路噪声系数，增强信号灵敏度。
2、宽带滤波器单元：低通设计，使用腔体滤波器，改善过渡带矩形系数，通带带宽为500MHz，主要作用为混频后镜像抑制及ADC前端抗混叠。
3、高速ADC单元：使用采样率为1.2288GHz的高速ADC，数据接口为JESD204B，链路采用4X接口，单根Lane速率为12.288GHz；该ADC内部包括DDC及半带滤波数字信号处理链路，可编程实现不同的信号处理模式。
4、参考时钟单元：具有内外参考切换功能，板载高精度10MHz OCXO，通过锁相环路与122.88MHz VCXO时钟进行锁相，从而产生高精度122.88MHz的基准时钟，该时钟分别提供给本振单元及FPGA单元作为参考，同时10倍频后产生1.2288GHz时钟作为ADC的采样时钟。
5、本振单元：使用集成套片电路结构，具有小数分频能力，以122.88MHz参考作为基准锁相时钟，通过软件控制，产生不同的混频本振信号，本振信号功率可调，实现混频器3阶等性能最优化。
6、FPGA信号处理单元：采用Kintex Ultrascale低功耗FPGA，实现量化信号的数字处理功能，具体功能模块包括与ADC的JESD204B高速数据接口、多相FIR低通滤波器、多相FIR任意响应滤波器、数字下变频单元、DDR4数据缓冲接口单元、PCIe上位机通信接口单元。
7、主控单元：采用X86架构CPU，通过PCIe与FPGA进行通信，实现硬件初始化及控制，实现数据采集上传，实现网络数据传输，支持SCPI指令解析。
8、网络传输接口：实现指令及数据的网络传输。
9、同步信号接口：实现系统的定时同步信号的传递。
10、中心服务器：在本地网络中承载数据池服务，支持采集设备数据的上传和存储，实现同步节拍信号发起及控制功能，是网络系统中的控制中枢。
如图2所示为本发明控制逻辑FPGA实现框图，主要内容是1控制寄存器，软件可访问，配置当前工作参数和操作流程；2是脚本存储器，分为正本和副本，可选择某一脚本执行；3是射频等外设控制接口，按照脚本语义进行外设的配置和操作；4是数据通道，根据外部触发信号指引，执行数据缓存或回传操作；5是逻辑控制状态机，按照软件参数配合外部触发激励信号执行状态跳转，实现不同的时序流程；6是外部触发激励信号接口，可以整形，计数，并产生特定事件。
按照处理流程进一步描述：
1、无线信号采集前端电路对射频信号进行变频处理，变频至固定频点307.2MHz；该通带信号通过通带500MHz带通滤波器进行抗混叠处理，馈入ADC进行量化；ADC采样频率为1.2288GHz；
2、高速ADC实现了1.2288GHz的高速采样；使用了高速JESD204B链路与FPGA通信，单根Lane速率可达12.288Gbps，将500MHz带宽量化信号准确传输至FPGA。
3、FPGA内部采用Xilinx提供的JESD204B IP核与ADC进行通信，用户接口时钟为307.2Mhz，1个时钟具有4个采样点，并行数据传递至后端DSP单元进行进一步处理。
4、采集到的高速并行数据通过多项FIR数字滤波器进行滤波，实现较高矩形系数的滤波器，提高过渡带陡峭度，低通滤波后的数据传递至任意响应滤波器，进行宽带内均衡，补偿系统的幅频响应，降低带内波动，为较高质量的功率测量提供硬件补偿。
5、FPGA接收外部节拍信号，在触发时刻将处理完毕的数据缓存至DDR4外部存储空间，缓存数据长度可调，时长参数软件可设，满足后续上位机对IQ数据的请求以及后续流控。FPGA可产生中断信号，在全局节拍信号的激励下定时进行网络数据传输。
6、上位机根据硬件中断信号请求IQ数据并通过PCIe缓存至上位机，然后通过网络传输，将连续IQ的数据传输至服务端；
7、服务端响应IQ数据网络传输请求，并将数据缓存至资源池。服务端产生全局节拍信号，控制数据采集、传输的节奏。
如图3所示为控制流程图，第一步，系统上电并完成初始化(包括服务器和采集设备)；第二步，服务器发起第一个触发节拍；第三步，采集设备按照初始化参数响应触发节拍，开始执行当前激活的脚本，内部计数器开始计数；第四步，采集设备频点、参考电平等参数设置完毕，进入稳态，数据链路稳定；第五步，计数器在规定的计数值产生内部触发，开始数据采集并缓存；第六步，计数器在规定的计数值产生软件中断(保证第五步数据采集并缓存可靠执行)，上位机响应中断信号，将缓存数据回传并通过网络发送至服务端。上述流程为服务器发起一次采集事件。循环执行，则可实现特定脚本条件下的无线信号自动采集。
如图4所示为数据流程框图，首先ADC的量化数据通过JESD204B接口传送至FPGA，FPGA内部实现了采用多相技术的低通滤波器、均衡滤波器、功率补偿乘法器、DDC、采样率变换和PCIe通道。上位机通过PCIe通道传送数据并通过网络发送至服务器端。
表格1是操作边界条件列表，是本发明的具体实施事实和方法的实施例。
表格1边界条件列表
无线信号采集前端电路对射频信号进行变频处理，变频至固定频点307.2MHz；该通带信号通过通带500MHz带通滤波器进行抗混叠处理，馈入ADC进行量化；ADC采样频率为1.2288GHz；
高速ADC实现了1.2288GHz的高速采样；使用了高速JESD204B链路与FPGA通信，单根Lane速率可达12.288Gbps，将500MHz带宽量化信号准确传输至FPGA。FPGA内部采用Xilinx提供的JESD204B IP核与ADC进行通信，用户接口时钟为307.2Mhz，1个时钟具有4个采样点，并行数据传递至后端DSP单元进行进一步处理。采集到的高速并行数据通过多项FIR数字滤波器进行滤波，实现较高矩形系数的滤波器，提高过渡带陡峭度，低通滤波后的数据传递至任意响应滤波器，进行宽带带内均衡，补偿系统的幅频响应，降低带内波动，为较高质量的功率测量提供硬件补偿。FPGA接收外部节拍信号，在触发时刻将处理完毕的数据缓存至DDR4外部存储空间，缓存数据长度可调，时长参数软件可设，满足后续上位机对IQ数据的请求以及后续流控。FPGA可产生中断信号，在全局节拍信号的激励下定时进行网络数据传输。上位机根据硬件中断信号请求IQ数据并通过PCIe缓存至上位机，然后通过网络传输，将连续IQ的数据传输至服务端；服务端响应IQ数据网络传输请求，并将数据缓存至资源池。服务端产生全局节拍信号，控制数据采集、传输的节奏。
本实施例的具体实现方案可以参见上述实施例中的相关说明，此处不再赘述。
可以理解的是，上述各实施例中相同或相似部分可以相互参考，在一些实施例中未详细说明的内容可以参见其他实施例中相同或相似的内容。
需要说明的是，在本发明的描述中，术语“第一”、“第二”等仅用于描述目的，而不能理解为指示或暗示相对重要性。此外，在本发明的描述中，除非另有说明，“多个”的含义是指至少两个。
流程图中或在此以其他方式描述的任何过程或方法描述可以被理解为，表示包括一个或更多个用于实现特定逻辑功能或过程的步骤的可执行指令的代码的模块、片段或部分，并且本发明的优选实施方式的范围包括另外的实现，其中可以不按所示出或讨论的顺序，包括根据所涉及的功能按基本同时的方式或按相反的顺序，来执行功能，这应被本发明的实施例所属技术领域的技术人员所理解。
应当理解，本发明的各部分可以用硬件、软件、固件或它们的组合来实现。在上述实施方式中，多个步骤或方法可以用存储在存储器中且由合适的指令执行装置执行的软件或固件来实现。例如，如果用硬件来实现，和在另一实施方式中一样，可用本领域公知的下列技术中的任一项或他们的组合来实现：具有用于对数据信号实现逻辑功能的逻辑门电路的离散逻辑电路，具有合适的组合逻辑门电路的专用集成电路，可编程门阵列(PGA)，现场可编程门阵列(FPGA)等。
本技术领域的普通技术人员可以理解实现上述实施例方法携带的全部或部分步骤是可以通过程序来指令相关的硬件完成，相应的程序可以存储于一种计算机可读存储介质中，该程序在执行时，包括方法实施例的步骤之一或其组合。
此外，在本发明各个实施例中的各功能单元可以集成在一个处理模块中，也可以是各个单元单独物理存在，也可以两个或两个以上单元集成在一个模块中。上述集成的模块既可以采用硬件的形式实现，也可以采用软件功能模块的形式实现。集成的模块如果以软件功能模块的形式实现并作为独立的产品销售或使用时，也可以存储在一个计算机可读取存储介质中。
上述提到的存储介质可以是只读存储器，磁盘或光盘等。
在本说明书的描述中，参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中，对上述术语的示意性表述不一定指的是相同的实施例或示例。而且，描述的具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
采用了本发明的实现自动化超宽带无线信号采集传输处理的系统、方法、装置、处理器及其计算机可读存储介质，采用网络架构，采集和测量分离。具体为数据集中缓存、数据采集节点分布式部署，同时保证采集节点设置的灵活性和中央调度的统一性。采用中心服务器产生时序节拍的方法，统一调度采集节点的任务时序，充分利用网络带宽，减少网络传输冲突，提高了无线信号采集效率，适用于产线流水线测试。系统架构较为合理，数据流清晰，采用多项技术，实时处理宽带信号，使用硬件均衡技术，补偿通带内频响，降低带内波动，提高功率及EVM测量精确度。
在此说明书中，本发明已参照其特定的实施例作了描述。但是，很显然仍可以作出各种修改和变换而不背离本发明的精神和范围。因此，说明书和附图应被认为是说明性的而非限制性的。
Claims (10)
1.一种实现自动化超宽带无线信号采集传输处理的系统，其特征在于，所述的系统包括：
射频变频单元，用于实现不同频点的射频信号变频转换至固定中频输出；
宽带滤波器单元，与所述的射频变频单元相连接，用于对中频信号进行滤波，滤除镜像频率，并实现高速ADC单元前端抗混叠；
高速ADC单元，与所述的宽带滤波器单元相连接，用于对中频宽带信号进行数字量化，将量化信号传输至FPGA信号处理单元进行后续DSP处理；
FPGA信号处理单元，与所述的高速ADC单元相连接，用于提供DSP处理逻辑；
主控单元，与所述的FPGA信号处理单元相连接，用于进行硬件初始化及控制，传输网络数据，采集并上传数据；
网络传输接口，与所述的主控单元相连接，用于通过网络传输指令及数据；
中心服务器，接收端与所述的网络传输接口相连接，输出端与FPGA信号处理单元相连接，用于上传和存储采集设备数据，实现同步节拍信号发起及控制；
同步信号接口，与所述的中心服务器相连接，用于实现系统的定时同步信号的传递；
参考时钟单元，接收端与所述的同步信号接口相连接，输出端与高速ADC单元和FPGA信号处理单元相连接，用于对高精度时钟进行锁相，产生高精度的精准时钟，为本振单元及FPGA信号处理单元提供参考时钟；
本振单元，接收端与所述的参考时钟单元相连接，输出端与射频变频单元相连接，用于通过小数分频，产生不同的混频本振信号。
2.根据权利要求1所述的实现自动化超宽带无线信号采集传输处理的系统，其特征在于，所述的FPGA信号处理单元包括：
逻辑控制状态机，用于根据参数配合外部触发激励信号执行状态跳转；
控制寄存器，与所述的逻辑控制状态机相连接，用于配置当前工作参数和操作流程；
脚本存储器，与所述的逻辑控制状态机相连接，包括正本和副本，用于支持选择并执行其中一个脚本；
外设控制接口，与所述的逻辑控制状态机相连接，用于按照脚本语义进行外设的配置和操作；
数据通道，与所述的逻辑控制状态机相连接，用于根据外部触发信号指引，执行数据缓存或回传操作；
外部触发激励信号接口，与所述的逻辑控制状态机相连接，用于对数据波形进行整形及计数，并产生特定事件。
3.根据权利要求1所述的实现自动化超宽带无线信号采集传输处理的系统，其特征在于，所述的射频变频单元的前端通过开关形成两路预处理通道，其中一路预处理通道采用数控衰减器，处理大功率信号，对大信号进行功率衰减；另外一路预处理通道采用固定增益低噪放，处理小信号通路。
4.根据权利要求1所述的实现自动化超宽带无线信号采集传输处理的系统，其特征在于，所述的射频变频单元采用有源混频器，频率范围覆盖10MHz至8GHz，中频频点为307.2MHz。
5.根据权利要求1所述的实现自动化超宽带无线信号采集传输处理的系统，其特征在于，所述的高速ADC单元包含DDC及半带滤波数字信号处理链路，具有不同的信号处理模式。
6.一种基于权利要求1所述的系统实现自动化超宽带无线信号采集传输处理的方法，其特征在于，所述的方法包括以下步骤：
(1)射频变频单元对射频信号进行变频处理，通过宽带滤波器单元进行抗混叠处理；
(2)高速ADC单元进行高速采样；
(3)FPGA信号处理单元与高速ADC单元进行通信，将并行数据传递至后端DSP单元进行处理；
(4)对采集到的高速并行数据进行滤波，将滤波后的数据传递至响应滤波器，进行宽带内均衡，补偿幅频响应；
(5)FPGA信号处理单元接收外部节拍信号，在触发时刻缓存处理完毕的数据；
(6)上位机根据硬件中断信号请求IQ数据，通过网络传输将连续IQ的数据传输至服务端；
(7)服务端响应IQ数据网络传输请求，并将数据缓存至资源池。
7.根据权利要求6所述的实现自动化超宽带无线信号采集传输处理的方法，其特征在于，所述的步骤(5)还包括以下步骤：
FPGA信号处理单元产生中断信号，根据全局节拍信号定时进行网络数据传输。
8.一种用于实现自动化超宽带无线信号采集传输处理的装置，其特征在于，所述的装置包括：
处理器，被配置成执行计算机可执行指令；
存储器，存储一个或多个计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现权利要求6至7中任一项所述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
9.一种用于实现自动化超宽带无线信号采集传输处理的处理器，其特征在于，所述的处理器被配置成执行计算机可执行指令，所述的计算机可执行指令被所述的处理器执行时，实现权利要求6至7中任一项所述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
10.一种计算机可读存储介质，其特征在于，其上存储有计算机程序，所述的计算机程序可被处理器执行以实现权利要求6至7中任一项所述的实现自动化超宽带无线信号采集传输处理的方法的各个步骤。
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