CN113948031A - 驱动电路及相关驱动方法 - Google Patents

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Abstract

一种驱动电路及相关驱动方法,驱动电路用于一显示面板,包括一接收接口、一时序控制器、一脉冲宽度调制控制器以及一线闩锁器。该接收接口用来接收一第一输入信号、一第二输入信号和一链接信号,据以产生多个显示数据,其中该第一输入信号和该第二输入信号是一对差分信号。该时序控制器用来解读该第一输入信号、该第二输入信号和该链接信号,以产生一触发信号。该脉冲宽度调制控制器用来进行脉冲宽度调制,以产生一第一输出信号以及一第二输出信号。该线闩锁器用来暂存该第一输出信号和该第二输出信号,以及根据该触发信号来输出该第一输出信号和该第二输出信号以驱动该显示面板。

Description

驱动电路及相关驱动方法
技术领域
本公开涉及一种驱动电路及相关驱动方法,特别涉及一种根据一对差分输入信号来驱动显示面板的驱动电路及相关驱动方法。
背景技术
现有的大型显示面板(例如电视、广告看板等)通常是由数个灯箱组合而成,每个灯箱内设置有一主机板和数个驱动电路板。主机板用来传送数据;驱动电路板的一面设置有发光元件,另一面则设置有驱动芯片和扫描开关电路。
在实际应用中,以分辨率为768*432平方像素的五十五英寸显示面板为例,其可由四个灯箱组成,每个灯箱包含一主机板和八个驱动电路板。每个驱动电路板设置有三十六颗驱动芯片,用来驱动分辨率为96*108平方像素的子面板。
在显示面板的尺寸不变的情况下,若欲将分辨率提高到3840*2160平方像素,以支援超高画质(ultrahigh definition,UHD)显示规格,则每个驱动电路板上的驱动芯片和信号走线的数量需增加到五倍之多,也就是每个驱动电路板上的驱动芯片数量需增加到一百八十颗(36*5=180)。在此情况下,由于单位面积上的驱动芯片和信号走线的数量增加,将会导致电路设计的难度大幅地提升。
此外,当输入影像信号是晶体管对晶体管逻辑(Transistor-Transistor Logic,TTL)信号且与时钟信号并行传送时,输入影像信号容易受噪声影响或是因为传播衰减而导致信号失真。
因此,如何提供一种显示驱动电路及相关显示驱动方法,以节省电路面积、简化电路设计并避免信号失真,实乃本领域的课题之一。
发明内容
为了解决上述问题,本公开提供一种驱动电路,用于一显示面板。该驱动电路包括一接收接口、一时序控制器、一脉冲宽度调制控制器以及一线闩锁器。该接收接口用来接收一第一输入信号、一第二输入信号和一链接信号,据以产生多个显示数据,其中该第一输入信号和该第二输入信号是一对差分信号。该时序控制器用来通过该接收接口接收该第一输入信号、该第二输入信号和该链接信号,并解读该第一输入信号、该第二输入信号和该链接信号,以产生一触发信号。该脉冲宽度调制控制器,耦接于该时序控制器,用来根据该触发信号和该多个显示数据,进行脉冲宽度调制,以产生一第一输出信号以及一第二输出信号。该线闩锁器耦接于该脉冲宽度调制控制器,用来暂存该第一输出信号和该第二输出信号,以及根据该触发信号来输出该第一输出信号和该第二输出信号以驱动该显示面板。
本公开另提供一种驱动方法,用于一显示面板。该驱动方法包括:通过一接收接口,接收一第一输入信号、一第二输入信号和一链接信号,据以产生多个显示数据,其中该第一输入信号和该第二输入信号是一对差分信号;通过一时序控制器,解读该第一输入信号、该第二输入信号和该链接信号,以产生一触发信号;通过一脉冲宽度调制控制器,根据该触发信号和该多个显示数据,进行脉冲宽度调制,以产生一第一输出信号以及一第二输出信号;以及通过一线闩锁器,暂存该第一输出信号和该第二输出信号,以及根据该触发信号来输出该第一输出信号和该第二输出信号以驱动该显示面板。
本公开的驱动电路及相关驱动方法使用差分信号的情况下,数据传送速度可有效地提升,故驱动电路可支援更高分辨率和帧率的显示面板;驱动电路内不需设置随机存取存储器来预存大量数据,使得驱动电路的面积可有效地减少。由于差分信号具有抗干扰能力强和时序定位准确的特征,故可避免信号失真,也不需参考额外的时钟信号,故可简化电路设计。
附图说明
为使本公开的上述和其他目的、特征、优点与实施例能更明显易懂,说明书附图的说明如下:
图1为一显示装置的功能方框图。
图2为另一显示装置的功能方框图。
图3为图1和图2的扫描开关电路的多个扫描信号和驱动电路的一输出信号的时序图。
图4为用于图1和图2的驱动电路的功能方框图。
图5为多个扫描信号和用于图4的驱动电路的控制信号、输入信号、数据时钟信号、灰阶时钟信号、触发信号和输出信号的时序图。
图6为根据本公开实施例一驱动电路的功能方框图。
图7为根据本公开实施例多个扫描信号和用于图6的驱动电路的第一输入信号、第二输入信号、链接信号、触发信号、第一输出信号和第二输出信号的时序图。
图8为根据本公开实施例一驱动模块和多对输入信号的示意图。
图9为根据本公开实施例另一驱动模块和多对输入信号的示意图。
图10为根据本公开实施例一驱动流程的流程图。
附图标记说明:
1,2:显示装置
10,20,40,60:驱动电路
12,22:扫描开关电路
41,61:接收接口
42,62:时序控制器
43,63:配置暂存器
44:随机存取存储器
64:线闩锁器
45:整流器
46:脉冲宽度调制控制器
CH1~CHN:通道
CS1~CSN:电流源
DCLK:数据时钟信号
GCLK:灰阶时钟信号
GND:接地电压
Iout:输出电流
LE:控制信号
LK:链接信号
P[11]~P[1N],…,P[M1]~P[MN]:像素单元
REXT:电阻值
RINT:输出电流参数
ROW,STB:触发信号
SC[1]~SC[N]:扫描信号
SDI:输入信号
SDI_P,D_P,D1_P~D8_P:第一输入信号
SDI_N,D_N,D1_N~D8_N:第二输入信号
SDO:输出信号
SDO_P:第一输出信号
SDO_N:第二输出信号
VLED,VLED_R,VLED_GB:驱动电压
W1~WN:导通时间
具体实施方式
于本文中,当一元件被称为“连结”或“耦接”时,可指“电性连接”或“电性耦接”。“连结”或“耦接”亦可用以表示二或多个元件间相互搭配操作或互动。此外,虽然本文中使用“第一”、“第二”、…等用语描述不同元件,该用语仅是用以区别以相同技术用语描述的元件或操作。除非上下文清楚指明,否则该用语并非特别指称或暗示次序或顺位,亦非用以限定本公开文件。
图1为一显示装置1的功能方框图。显示装置1包含一驱动电路10、一扫描开关电路12以及一显示面板14。显示面板14包含M*N个像素单元(pixel)P[11]~P[1N]、…、P[M1]~P[MN],M、N是大于1的整数。显示面板14例如是一共阳极(common-anode)被动矩阵发光二极管(passive matrix light-emitting diode,PMLED)面板。在结构上,每个像素单元是以一发光二极管来实现,每一列(row)的N个二极管的阳极电性连接一扫描线(scan line),每一行(column)的M个二极管的阴极电性连接一数据线(data line)或一通道。显示面板14通过M条扫描线耦接于扫描开关电路12,以及通过N条数据线(或通道)耦接于驱动电路10。
在操作上,扫描开关电路12包含M个开关,用来根据M个扫描信号SC[1]~SC[M],提供一驱动电压VLED到显示面板14。驱动电路10用来根据一输入信号SDI、一控制信号LE(绘于图4)和一数据时钟信号DCLK(绘于图4),提供一输出信号SDO(绘于图3)到显示面板14。于一实施例中,扫描开关电路12的每个开关是以一P型晶体管来实现,P型晶体管包含耦接于一扫描信号的一控制端,耦接于驱动电压VLED的一第一端和耦接于一扫描线的一第二端。
图2为另一显示装置2的功能方框图。显示装置1包含一驱动电路20、一扫描开关电路22以及一显示面板24。显示面板14例如是一共阴极(common-cathode)被动矩阵发光二极管面板。在结构上,每个像素单元是以一发光二极管来实现,每一列(row)的N个二极管的阴极电性连接一扫描线,每一行(column)的M个二极管的阳极电性连接一数据线。显示面板24通过M条扫描线电性连接扫描开关电路22,以及通过N条数据线电性连接驱动电路20。
在操作上,扫描开关电路22包含M个开关,用来根据M个扫描信号SC[1]~SC[M],将显示面板24耦接于一接地电压GND。驱动电路20用来根据多个驱动电压VLED_R和VLED_GB、控制信号LE、输入信号SDI和时钟信号DCLK(其中信号LE、SDI和DCLK绘于图4),提供输出信号SDO(绘于图3)到显示面板24。于一实施例中,扫描开关电路22的每个开关是以一N型晶体管来实现,N型晶体管包含耦接于一扫描信号的一控制端,耦接于接地电压GND的一第一端和耦接于一扫描线的一第二端。
图3为图1和图2的扫描开关电路12和22的多个扫描信号SC[1]~SC[M]和驱动电路10和20的输出信号SDO的时序图。当扫描信号SC[1]为一第一逻辑状态(例如逻辑“1”)时,耦接于第一条扫描线的N个像素单元P[11]~P[1N]被导通,而像素单元P[11]~P[1N]的灰阶值(grayscale)所对应的亮度(brightness)由一导通时间W1的长度来决定。若像素单元被导通的时间越长则对应的亮度越高(代表灰阶值越高)。以此类推,当扫描信号SC[2]为第一逻辑状态时,耦接于第二条扫描线的N个像素单元P[21]~P[2N]被导通,而像素单元P[21]~P[2N]的灰阶值所对应的亮度由一导通时间W2的长度来决定。另一方面,当扫描信号SC[1]~SC[M]为一第二逻辑状态(逻辑“0”)时,则像素单元被关闭。简单来说,扫描开关电路12和22根据多个扫描信号SC[1]~SC[M]来分别导通耦接于第1~M条扫描线的N个像素单元,驱动电路10和20的输出信号SDO分别在多个导通时间W1~WN内控制N个像素单元的亮度。如此一来,扫描开关电路12和22以及驱动电路10和20可分别驱动显示面板14和24来显示影像。
图4为一驱动电路40的功能方框图。驱动电路40可取代图1和图2的驱动电路10和20。驱动电路40包含一接收接口41、一时序控制器42、一配置(configuration)暂存器43、一随机存取存储器(random access memory,RAM)44、一整流器45、一脉冲宽度调制(pulsewidth modulation)控制器46以及多个电流源CS1~CSN。
驱动电路10的架构如图4所示。接收接口41用来接收输入信号SDI和数据时钟信号DCLK,据以产生多个显示数据D[1]~D[N]。时序控制器42用来接收并解读控制信号LE。配置暂存器43用来存储至少一配置参数,例如但不限于灰阶模式、扫描模式、输出电流的增益以及颜色参数等。整流器45耦接于一外接电阻(未绘于图4),外接电阻的一电阻值REXT决定整流器45产生的一输出电流Iout。多个电流源CS1~CSN用来根据输出电流Iout,产生用于多个通道CH1~CHN的多个驱动电流。脉冲宽度调制控制器46用来根据一灰阶时钟信号GCLK、一触发信号ROW和对应多个通道CH1~CHN的多个显示数据D[1]~D[N],进行脉冲宽度调制。随机存取存储器44用来存储对应(2*m)列的(2*m*N)个像素单元的显示数据,m是驱动电路10可支援的扫描数。举例来说,假设驱动电路10一次扫描一列像素单元(意即m=1),则随机存取存储器44一次存储对应两列的(2*1*N)个像素单元的显示数据。当驱动电路10在驱动第Y条扫描线的N个像素单元时,随机存取存储器44存储对应第Y条扫描线的N个像素单元的显示数据DY[1]~DY[N],以及存储对应第(Y+1)条的N个像素单元的显示数据DY+1[1]~DY+1[N],Y是大于零的整数。接着,当驱动电路10在驱动对应第(Y+1)条扫描线的多个像素单元时,于随机存取存储器44中,对应第Y条的N个像素单元的显示数据DY[1]~DY[N]被复写为对应第(Y+2)条的N个像素单元的显示数据DY+2[1]~DY+2[N]。也就是说,当驱动电路10在驱动第Y条扫描线的N个像素单元时,随机存取存储器44产生的输出信号SDO包含对应第Y条的N个像素单元的显示数据DY[1]~DY[N];接着,当驱动电路10在驱动第(Y+1)条扫描线的N个像素单元时,随机存取存储器44产生的输出信号SDO包含对应第(Y+1)条的N个像素单元的显示数据DY+1[1]~DY+1[N]。如此一来,驱动电路10产生的输出信号SDO包含对应不同扫描线的N个显示数据D[1]~D[N],用来分别驱动连接到不同扫描线的N个像素单元。
图5为多个扫描信号SC[1]~SC[M]和用于图4的驱动电路10的控制信号LE、输入信号SDI、数据时钟信号DCLK、灰阶时钟信号GCLK、触发信号ROW和输出信号SDO的时序图。控制信号LE和时钟信号DCLK用来指示驱动电路10需进行的操作,例如将输入数据写入存储器、设定显示参数、垂直空白起始(vertical blanking start)和显示数据等。灰阶时钟信号GCLK或驱动信号ROW用来指示驱动电路10控制输出信号SDO的输出时机。例如,触发信号ROW的上升边缘用来指示一条扫描线的开启时间,而灰阶时钟信号GCLK的上升边缘用来指示多个数据线(或通道)的开启时间。
值得注意的是,图4的驱动电路40存有以下特征:(1)随机存取存储器44占了相当比例的电路面积(依照支援扫数,随机存取存储器44约略占了30%~40%的电路面积);(2)输入信号SDI和数据时钟信号DCLK都是晶体管对晶体管逻辑(Transistor-TransistorLogic,TTL)信号,故仅适合低速传送;以及(3)驱动芯片的输入引脚数多(例如,至少需要六个引脚来连接电阻值REXT、灰阶时钟信号GCLK、触发信号ROW、控制信号LE、输入信号SDI和数据时钟信号DCLK)。为了解决上述问题,申请人提出了一种驱动电路及相关驱动方法,可节省电路面积、简化电路设计并避免信号失真。
图6为根据本公开实施例一驱动电路60的功能方框图。驱动电路60可取代图4的驱动电路40。驱动电路60包含一接收接口61、一时序控制器62、一配置暂存器63、一线闩锁器64、一整流器65、一脉冲宽度调制控制器66以及多个电流源CS1~CSN。
接收接口61耦接于时序控制器62、配置暂存器63和线闩锁器64,用来接收一第一输入信号SDI_P、一第二输入信号SDI_N和一链接(link)信号LK,据以产生多个显示数据D[1]~D[N]。链接信号LK是驱动电路60与一输入信号源(例如一处理器)进行沟通的信号,其可为双向或单向控制信号。时序控制器62耦接于接收接口61和脉冲宽度调制控制器66,用来通过接收接口61接收第一输入信号SDI_P、第二输入信号SDI_N和链接信号LK,并解读第一输入信号SDI_P、第二输入信号SDI_N和链接信号LK,以产生一触发信号STB到脉冲宽度调制控制器66。配置暂存器63耦接于接收接口61,用来存储至少一配置参数,例如但不限于一输出电流参数RINT、灰阶模式、扫描模式以及颜色参数等。整流器65耦接于配置暂存器63和多个电流源CS1~CSN,用来根据输出电流参数RINT,产生一输出电流Iout到多个电流源CS1~CSN。多个电流源CS1~CSN耦接于整流器65和脉冲宽度调制控制器66,用来根据输出电流Iout,产生用于多个通道CH1~CHN的多个驱动电流到脉冲宽度调制控制器66。脉冲宽度调制控制器66耦接于时序控制器62和线闩锁器64,用来根据触发信号STB和对应多个通道CH1~CHN的多个显示数据D[1]~D[N],进行脉冲宽度调制,以产生一第一输出信号SDO_P以及一第二输出信号SDO_N。线闩锁器64耦接于接收接口61、和脉冲宽度调制控制器66,用来暂存(hold)第一输出信号SDO_P以及第二输出信号SDO_N,以及根据触发信号STB来输出第一输出信号SDO_P和第二输出信号SDO_N。
值得注意的是,于本公开实施例中,第一输入信号SDI_P和第二输入信号SDI_N是一对差分信号(differential pair),用来取代图4的单线(single-wired)输入信号SDI。单线信号可支援的数据率为每秒兆位(Megabit per second),而差分信号可支援的数据率可达每秒千兆位(Gigabit per second)。在使用差分信号的情况下,数据传送速度可有效地提升,故驱动电路60可支援更高分辨率和帧率(frame rate)的显示面板;驱动电路60内不需设置随机存取存储器44来预存大量数据,使得驱动电路60的面积(相对于驱动电路40而言)可有效地减少。在实际应用中,相较于驱动电路40,当原始支援扫数为16时,驱动电路60的晶粒(die)尺寸可减少8%到15%;当原始支援扫数为32时,驱动电路60的晶粒尺寸可减少16%到30%;以及当原始支援扫数为64时,驱动电路60的晶粒尺寸可减少30%到60%。于一实施例中,图1的扫描开关电路12或图2的扫描开关电路22可以和驱动电路60整合在同一个集成电路芯片。
进一步地,由于差分信号具有抗干扰能力强和时序定位准确的特征,故可避免信号失真,也不需参考额外的时钟信号(例如数据时钟信号DCLK)。时序控制器62可根据第一输入信号SDI_P和第二输入信号SDI_N来重建(或产生)相关的时序信号(例如触发信号STB),故驱动电路60不需接收额外的灰阶时钟信号GCLK和触发信号ROW。此外,在已知显示面板的应用范围的前提下,用于控制输出电流Iout的电阻(其电阻值为REXT)可整合在驱动电路60内部,并通过输出电流参数RINT来设定输出电流Iout的大小。如此一来,由图6可看出,驱动电路60的输入引脚数可简化为三个(例如,至少需要三个引脚来连接第一输入信号SDI_P、第二输入信号SDI_N和链接信号LK)。
图7为根据本公开实施例多个扫描信号SC[1]~SC[N]和用于图6的驱动电路的第一输入信号SDI_P、第二输入信号SDI_N、链接信号LK、触发信号STB、第一输出信号SDO_P和第二输出信号SDO_N的时序图。第一输入信号SDI_P、第二输入信号SDI_N用来指示驱动电路60需进行的操作,例如设定显示参数、垂直空白起始、显示数据和重建触发信号STB等。在扫描信号SC[1]~SC[N]的上升边缘,驱动电路60同步产生触发信号STB的上升边缘(用来指示数据线或通道的开启时间)以及输出第一输出信号SDO_P和第二输出信号SDO_N来显示数据。
图8为根据本公开实施例一驱动模块80、多个第一输入信号D1_P~D8_P和多个第二输入信号D1_N~D8_N的时序的示意图。在结构上,驱动模块80包括一电路板800、多个驱动电路81~88以及一输入输出接口89。多个驱动电路81~88和输入输出接口89设置在电路板800上,输入输出接口89与多个驱动电路81~88并联,用来并行传输链接信号LK、多个第一输入信号D1_P~D8_P和多个第二输入信号D1_N~D8_N到多个驱动电路81~88。于一实施例中,输入输出接口89可以设置在不同于电路板800的另一块电路板上。
在操作上,输入输出接口89可从一信号输入源同时接收多个第一输入信号D1_P~D8_P、多个第二输入信号D1_N~D8_N和传输链接信号LK,传输链接信号LK来和驱动电路81~88进行沟通,以及同时将多个第一输入信号D1_P~D8_P和多个第二输入信号D1_N~D8_N并行传输到多个驱动电路81~88。如此一来,本公开可实现并行(parallel)传输,其优势在于单位时间内的数据率可为单点传输的数据率的多倍数(例如,八倍)。
图9为根据本公开实施例另一驱动模块90、一第一输入信号D_P和一第二输入信号D_N的时序的示意图。第一输入信号D_P包括多个第一输入信号D1_P~D8_P,第二输入信号D_N包括多个第二输入信号D1_N~D8_N。在结构上,驱动模块90包括一电路板900、多个驱动电路91~98以及一输入输出接口99。多个驱动电路91~98和输入输出接口99设置在电路板900上,输入输出接口99与多个驱动电路91~98相互串联。输入输出接口99按序传输链接信号LK、第一输入信号D1_P~D8_P和第二输入信号D1_N~D8_N到多个驱动电路91~98。
在操作上,输入输出接口99可从一信号输入源接收链接信号LK、第一输入信号D_P和第二输入信号D_N。输入输出接口99和驱动电路91~98通过链接信号LK来进行沟通,例如上游信号源通过链接信号LK来告知下游接收端需接收显示数据,使得驱动电路91~98按序接收第一输入信号D1_P~D8_P和第二输入信号D1_N~D8_N。如此一来,本公开可实现串接(cascade)传输,其优势在于驱动模块90中的信号传输路径最短,以简化电路设计并避免信号失真。本领域具通常知识者可依实际的应用,选择串接驱动电路的数量,以达到数据率与电路板布局的最佳化。
在图8和图9的实施例中,并行传输与串接传输可混和使用。也就是说,在单一电路板上可设置和输入输出接口并联的一些驱动电路以及和输入输出接口串接的一些驱动电路,以达到数据率与电路板布局的最佳化。
图10为根据本公开实施例一驱动流程100的流程图。关于驱动电路60、81~88、91~98的操作方式可归纳为驱动流程100,用来驱动显示面板,驱动流程100包含以下步骤。
步骤101:接收第一输入信号、第二输入信号以及一链接信号,其中第一输入信号和第二输入信号是一对差分信号。
步骤102:根据第一输入信号、第二输入信号和链接信号,产生触发信号。
步骤103:根据第一输入信号、第二输入信号和触发信号,进行脉冲宽度调制,以产生第一输出信号以及第二输出信号,其中第一输出信号和第二输出信号是一对差分信号。
步骤104:通过线闩锁器暂存第一输出信号和第二输出信号,以及根据触发信号来输出第一输出信号和第二输出信号。
于驱动流程100中,步骤101可由接收接口61来执行,步骤102可由时序控制器62来执行,步骤103可由脉冲宽度调制控制器66来执行,步骤104可由线闩锁器64来执行。于一实施例中,驱动流程100还包括通过一配置暂存器产生一输出电流参数到一整流器。通过驱动流程100,本公开可在不使用随机存取存储器的前提下来驱动显示面板,可节省电路面积、简化电路设计并避免信号失真。
综上所述,本公开的驱动电路及相关驱动方法使用差分信号的情况下,数据传送速度可有效地提升,故驱动电路可支援更高分辨率和帧率的显示面板;驱动电路内不需设置随机存取存储器来预存大量数据,使得驱动电路的面积可有效地减少。由于差分信号具有抗干扰能力强和时序定位准确的特征,故可避免信号失真,也不需参考额外的时钟信号,故可简化电路设计。
虽然本公开已以实施方式公开如上,然其并非限定本公开,任何本领域技术人员,在不脱离本公开的构思和范围内,当可作各种的变动与润饰,因此本公开的保护范围当视权利要求所界定者为准。

Claims (10)

1.一种驱动电路,用于一显示面板,包括:
一接收接口,用来接收一第一输入信号、一第二输入信号和一链接信号,据以产生多个显示数据,其中该第一输入信号和该第二输入信号是一对差分信号;
一时序控制器,用来通过该接收接口接收该第一输入信号、该第二输入信号和该链接信号,并解读该第一输入信号、该第二输入信号和该链接信号,以产生一触发信号;
一脉冲宽度调制控制器,耦接于该时序控制器,用来根据该触发信号和该多个显示数据,进行脉冲宽度调制,以产生一第一输出信号以及一第二输出信号;以及
一线闩锁器,耦接于该脉冲宽度调制控制器,用来暂存该第一输出信号和该第二输出信号,以及根据该触发信号来输出该第一输出信号和该第二输出信号以驱动该显示面板。
2.如权利要求1所述的驱动电路,进一步包括:
一配置暂存器,耦接于该接收接口,用来存储一输出电流参数;
一整流器,耦接于该配置暂存器,用来根据该输出电流参数,产生一输出电流;以及
多个电流源,耦接于该整流器和该脉冲宽度调制控制器,用来根据该输出电流,产生多个驱动电流到该脉冲宽度调制控制器。
3.如权利要求1所述的驱动电路,其用于一驱动模块,该驱动模块包括:
一输入输出接口,用来从一信号输入源同时接收多个第一输入信号、多个第二输入信号和该传输链接信号;以及
多个驱动电路,与该输入输出接口并联;
其中该输入输出接口并行传输该链接信号、该多个第一输入信号和该多个第二输入信号到该多个驱动电路。
4.如权利要求1所述的驱动电路,其用于一驱动模块,该驱动模块包括:
一输入输出接口,用来从一信号输入源接收该第一输入信号、该第二输入信号和该传输链接信号,其中该第一输入信号包括多个第一输入信号,该第二输入信号包括多个第二输入信号;以及
多个驱动电路,该多个驱动电路与该输入输出接口相互串联;
其中该输入输出接口按序传输该链接信号、该多个第一输入信号和该多个第二输入信号到该多个驱动电路。
5.如权利要求3、4所述的驱动电路,其中该驱动模块还包括一电路板,该输入输出接口及该多个驱动电路设置在该电路板上,或者该多个驱动电路设置在该电路板上且该输入输出接口设置在另一块电路板上。
6.如权利要求1所述的驱动电路,其用于一驱动模块,该驱动模块包括一扫描开关电路,该扫描开关电路与该驱动电路整合在同一个集成电路芯片;当该显示面板是一共阳极被动矩阵发光二极管面板时,该扫描开关电路包括多个P型晶体管开关;当该显示面板是一共阴极被动矩阵发光二极管面板,该扫描开关电路包括多个N型晶体管开关。
7.一种驱动方法,用于一显示装置,包括:
通过一接收接口,接收一第一输入信号、一第二输入信号和一链接信号,据以产生多个显示数据,其中该第一输入信号和该第二输入信号是一对差分信号;
通过一时序控制器,解读该第一输入信号、该第二输入信号和该链接信号,以产生一触发信号;
通过一脉冲宽度调制控制器,根据该触发信号和该多个显示数据,进行脉冲宽度调制,以产生一第一输出信号以及一第二输出信号;以及
通过一线闩锁器,暂存该第一输出信号和该第二输出信号,以及根据该触发信号来输出该第一输出信号和该第二输出信号以驱动该显示面板。
8.如权利要求7所述的驱动方法,其还包括:
通过一配置暂存器,存储一输出电流参数;
通过一整流器,根据该输出电流参数,产生一输出电流;以及
通过多个电流源,根据该输出电流,产生多个驱动电流到该脉冲宽度调制控制器。
9.如权利要求7所述的驱动方法,其还包括:
通过一输入输出接口,从一信号输入源同时接收多个第一输入信号、多个第二输入信号和该传输链接信号;以及
通过该输入输出接口并行传输该链接信号、该多个第一输入信号和该多个第二输入信号到多个驱动电路,其中该多个驱动电路与该输入输出接口并联。
10.如权利要求7所述的驱动方法,其还包括:
通过一输入输出接口,从一信号输入源接收该第一输入信号、该第二输入信号和该传输链接信号,其中该第一输入信号包括多个第一输入信号,该第二输入信号包括多个第二输入信号;以及
通过该输入输出接口按序传输该链接信号、该多个第一输入信号和该多个第二输入信号到多个驱动电路多个驱动电路,其中该多个驱动电路与该输入输出接口相互串联。
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