CN113920956B - 驱动电路、驱动方法和显示设备 - Google Patents

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Abstract

本申请实施例提供了一种驱动电路、驱动方法和显示设备。驱动电路包括N个源极驱动芯片和至少两个时序控制芯片。每个时序控制芯片与N个源极驱动芯片中的部分源极驱动芯片电连接，用于向其电连接的源极驱动芯片输入显示信号和源极时序控制信号。本申请实施例提供的驱动电路，无需设计具有更多的高速讯号对的时序控制芯片，就能够实现对多个源极驱动芯片的驱动，缩短了显示驱动的开发周期，提高了显示驱动的开发效率，降低了成本。

Description

驱动电路、驱动方法和显示设备
技术领域
本申请涉及显示驱动领域，具体而言，本申请涉及一种驱动电路、驱动方法和显示设备。
背景技术
随着显示技术的进步，消费者体验的需求也日渐升高，增加显示设备的解析度(又称分辨率、解像度)和降低响应时间可以为用户提供更好的体验。
在高解析度和高帧率的显示设备中，通常由多个源极驱动芯片作为源极驱动器。例如，在解析度为8K(例如，7680×4320像素单元)、帧率为120Hz(赫兹)的显示设备中，TCON(时序控制芯片，Timer Controller IC)需要48个高速讯号对，来驱动24个源极驱动芯片。
因此，对于高解析度和高帧率的显示设备，TCON需要更多的高速讯号对来驱动多个源极驱动芯片，这给研发更高性能的TCON带来了挑战。
如何克服逐渐随着高解析度和高帧率所带来的困难点成为现今显示驱动设计领域的难点。
发明内容
本申请针对现有方式的缺点，提出一种驱动电路、驱动方法和显示设备，用以解决现有技术存在的针对高解析度和高帧率的显示设备，需要研发具有更多的高速讯号对的时序控制芯片来驱动源极驱动芯片带来的设计难点的技术问题。
第一方面，本申请实施例提供了一种驱动电路，包括：
N个源极驱动芯片；
至少两个时序控制芯片，每个时序控制芯片与N个源极驱动芯片中的部分源极驱动芯片电连接，用于向其电连接的源极驱动芯片输入显示信号和源极时序控制信号。
在一个可能的实现方式中，驱动电路还包括：
栅极驱动模块，与至少两个时序控制芯片电连接，用于接收至少两个时序控制芯片输出的栅极时序控制信号。
在一个可能的实现方式中，N个源极驱动芯片包括两个源极驱动模块；两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；
至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接。
在一个可能的实现方式中，两个时序控制芯片包括第一时序控制芯片和第二时序控制芯片；第一时序控制芯片和第二时序控制芯片分别包括两路通道；
两个源极驱动模块包括第一源极驱动模块和第二源极驱动模块；第一源极驱动模块包括第一源极子模块和第二源极子模块；第二源极驱动模块包括第三源极子模块和第四源极子模块；
第一时序控制芯片的一路通道与第一源极子模块电连接，另一路通道与第二源极子模块电连接；
第二时序控制芯片的一路通道与第三源极子模块电连接，另一路通道与第四源极子模块电连接。
在一个可能的实现方式中，每个时序控制芯片的帧率为60赫兹；和/或，每个时序控制芯片的带宽为1.5千兆比特每秒。
第二方面，本申请实施例提供了一种驱动方法，应用于如第一方面的驱动电路，驱动方法包括：
通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号。
在一个可能的实现方式中，N个源极驱动芯片包括两个源极驱动模块，两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接；
以及，通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号，包括：
每个时序控制芯片向对应的源极驱动模块输送显示信号和源极时序控制信号；每个源极驱动模块基于显示信号和源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组；
每个时序控制芯片向电连接的栅极驱动模块输送栅极时序控制信号；栅极驱动模块基于栅极时序控制信号输出扫描信号至显示面板的像素单元行组。
在一个可能的实现方式中，每个时序控制芯片向对应的源极驱动模块输送显示信号和源极时序控制信号；每个源极驱动模块基于显示信号和源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组，包括：
每个时序控制芯片，在实时数据周期中的增大后的时间宽度内，向对应的源极驱动模块输送每个像素单元行所需的显示信号和源极时序控制信号；
每个源极驱动模块，在实时数据周期的除了增大后的时间宽度之外的剩余时段中，基于显示信号和源极时序控制信号，相应生成数据传输控制信号；
在下一个数据周期中，在数据传输控制信号的控制下，将像素单元行所需的显示信号转换成相应的数据电压，施加至显示面板中对应的显示区域的像素单元行。
在一个可能的实现方式中，显示面板的全部像素单元包括两个像素单元行组，两个像素单元行组与栅极驱动模块电连接；
以及，栅极驱动模块基于栅极时序控制信号输出扫描信号至显示面板的像素单元行组，包括：
栅极驱动模块基于栅极时序控制信号生成两组扫描信号，根据两组扫描信号对显示面板的两个像素单元行组进行扫描。
在一个可能的实现方式中，两个像素单元行组包括奇数像素单元行组和偶数像素单元行组；两组扫描信号包括第一水平扫描信号组和第二水平扫描信号组；
根据两组扫描信号对显示面板的两个像素单元行组进行扫描，包括：
栅极驱动模块基于栅极时序控制信号生成帧控制信号；帧控制信号包括奇数帧信号和偶数帧信号；
当帧控制信号为奇数帧信号时，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描；当帧控制信号为偶数帧信号时，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；或者，
当帧控制信号为奇数帧信号时，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；当帧控制信号为偶数帧信号时，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描。
在一个可能的实现方式中，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描，包括：
在数据电压每次达到最大幅值时，栅极驱动模块对应输出第一水平扫描信号组中的一个水平扫描信号，至奇数像素单元行组中的一个像素单元行；最大幅值为幅值的绝对值的最大值；
以及，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描，包括：
在数据电压每次达到最大幅值时，栅极驱动模块对应输出第二水平扫描信号组中的一个水平扫描信号，至偶数像素单元行组中的一个像素单元行；所述最大幅值为幅值的绝对值的最大值。
第三方面，本申请实施例提供了一种显示设备，包括第一方面的驱动电路。
第四方面，本申请实施例提供了一种计算机可读存储介质，计算机可读存储介质中存储有计算机程序，计算机程序由计算机执行以实现第二方面的驱动方法。
本申请实施例提供的技术方案，至少具有如下有益效果：
本申请实施例提供的驱动电路，针对高解析度和高帧率的显示设备，通过设置至少两个时序控制芯片，每个时序控制芯片与N个源极驱动芯片中的部分源极驱动芯片电连接，无需设计具有更多的高速讯号对的时序控制芯片，就能够实现对多个源极驱动芯片的驱动，缩短了显示驱动的开发周期，提高了显示驱动的开发效率，降低了成本。
本申请附加的方面和优点将在下面的描述中部分给出，这些将从下面的描述中变得明显，或通过本申请的实践了解到。
附图说明
本申请上述的和/或附加的方面和优点从下面结合附图对实施例的描述中将变得明显和容易理解，其中：
图1为本申请实施例提供的一种驱动电路的结构示意图；
图2为本申请实施例提供的另一种驱动电路的结构示意图；
图3为本申请实施例提供的两个时序控制芯片与24个源极驱动芯片的电连接示意图；
图4为本申请实施例提供的驱动方法的工作时序图。
附图标记：
11-时序控制芯片，111-第一时序控制芯片，112-第二时序控制芯片，21-SDIC(源极驱动芯片)，22-第一源极驱动模块，23-第二源极驱动模块，221-第一源极子模块，222-第二源极子模块，231-第三源极子模块，232-第四源极子模块，30-栅极驱动模块，40-显示面板，41-第一显示区域，42第二显示区域。
具体实施方式
下面详细描述本申请，本申请实施例的示例在附图中示出，其中自始至终相同或类似的标号表示相同或类似的部件或具有相同或类似功能的部件。此外，如果已知技术的详细描述对于示出的本申请的特征是不必要的，则将其省略。下面通过参考附图描述的实施例是示例性的，仅用于解释本申请，而不能解释为对本申请的限制。
本技术领域技术人员可以理解，除非另外定义，这里使用的所有术语(包括技术术语和科学术语)，具有与本申请所属领域中的普通技术人员的一般理解相同的意义。还应该理解的是，诸如通用字典中定义的那些术语，应该被理解为具有与现有技术的上下文中的意义一致的意义，并且除非像这里一样被特定定义，否则不会用理想化或过于正式的含义来解释。
本技术领域技术人员可以理解，除非特意声明，这里使用的单数形式“一”、“一个”、“所述”和“该”也可包括复数形式。应该进一步理解的是，本申请的说明书中使用的措辞“包括”是指存在所述特征、整数、步骤、操作、元件和/或组件，但是并不排除存在或添加一个或多个其他特征、整数、步骤、操作、元件、组件和/或它们的组。应该理解，当我们称元件被“连接”或“耦接”到另一元件时，它可以直接连接或耦接到其他元件，或者也可以存在中间元件。此外，这里使用的“连接”或“耦接”可以包括无线连接或无线耦接。这里使用的措辞“和/或”包括一个或更多个相关联的列出项的全部或任一单元和全部组合。
本申请的发明人进行研究发现，在高解析度和高帧率的显示设备中，通常由多个源极驱动芯片作为源极驱动器。例如，在解析度为8K(例如，7680×4320像素单元)、帧率为120Hz(赫兹)的显示设备中，TCON(时序控制芯片，Timer Controller IC)需要通过24个源极驱动芯片分别输出320个像素单元的数据量(即960ch的数据量)的灰度电压信号，将7680个像素单元的数据量的灰度电压信号供给显示设备中的显示面板。其中，每个像素单元包括红(R)、绿(G)、蓝(B)三个子像素，每个子像素需要1ch的数据量。
对于解析度为8K、帧率为120Hz的TCON需要48个高速讯号对来驱动24个源极驱动芯片，相比解析度较低的TCON，需要更多的高速讯号对来驱动24个源极驱动芯片，这给研发更高性能的TCON带来了挑战。
本申请的发明人还发现，越高的解析度和帧率意味着，显示设备中的显示面板的电容负载会上升，但同时因为帧率的增加，每条水平线给驱动集成电路(即像素单元中的存储电容)充电的时间则会减少。例如，相比解析度为4K、帧率为120Hz和解析度为8K、帧率为120Hz的显示设备中，平均每条水平线的充电时间由3.7μs(微秒)降低至1.85μs(微秒)。
由于平均每条水平线的充电时间减少，导致供给显示面板中像素单元的灰阶电压不足，造成应该正确显示的灰阶无法正确显示，进而导致画面产生亮暗闪烁的问题，影响显示效果。
如何克服逐渐随着高解析度和高帧率所带来的困难点成为现今显示驱动设计领域的难点。
本申请提供的一种驱动电路、驱动方法和显示设备，旨在解决现有技术的如上技术问题。
下面以具体地实施例对本申请的技术方案以及本申请的技术方案如何解决上述技术问题进行详细说明。下面这几个具体的实施例可以相互结合，对于相同或相似的概念或过程可能在某些实施例中不再赘述。下面将结合附图，对本申请的实施例进行描述。
首先对本申请涉及的几个名词进行介绍和解释：
SDIC，源极驱动芯片。
TCON，时序控制芯片。
本申请实施例提供的驱动电路、驱动方法和显示设备，可以应用于电视、视屏播放器、个人计算机、家庭影院等。
本申请实施例提供了一种驱动电路，如图1所示，驱动电路包括：N个源极驱动芯片(即图1中SDIC 21)和至少两个时序控制芯片11，N为正整数。具体的，每个时序控制芯片11与N个源极驱动芯片中的部分源极驱动芯片电连接，用于向其电连接的源极驱动芯片输入显示信号和源极时序控制信号。N个源极驱动芯片被配置为与显示面板40电连接。
也就是说，每个时序控制芯片11与N个源极驱动芯片中的部分源极驱动芯片电连接，用于向与时序控制芯片11电连接的源极驱动芯片输入显示信号和源极时序控制信号。
本申请实施例提供的驱动电路，针对高解析度和高帧率的显示设备，通过设置至少两个时序控制芯片11，每个时序控制芯片11与N个源极驱动芯片中的部分源极驱动芯片电连接，无需设计具有更多的高速讯号对的时序控制芯片，就能够实现对多个源极驱动芯片的驱动，缩短了显示驱动的开发周期，提高了显示驱动的开发效率，降低了成本。
在一些实施例中，如图1所示，驱动电路还包括栅极驱动模块30。具体的，栅极驱动模块30与至少两个时序控制芯片11电连接，用于接收至少两个时序控制芯片11输出的栅极时序控制信号。栅极驱动模块30被配置为与显示面板40电连接。
N个源极驱动芯片和栅极驱动模块30都被配置为与显示面板40电连接；假设显示面板40的水平方向有m条扫描线，垂直方向有k条数据线，组合k×m像素单元的显示面板40，例如图1中示出的两个3840*RGB和4320行，即7680×4320像素单元，每个像素单元包括红(R)、绿(G)、蓝(B)三个像素。当然，也可以7680×4800像素单元、或者7680×5760像素单元等。N个源极驱动芯片通过k条数据线与显示面板40中的像素单元电连接，栅极驱动模块30通过m条扫描线与显示面板40中的像素单元电连接，使得多个像素单元呈矩阵式排列。每个像素单元包括若干晶体管和存储电容。
图1中的3840*RGB表示在显示面板40中的部分区域每行包括3840×3＝11520个水平像素，其中，RGB表示每个像素单元包括红(R)、绿(G)、蓝(B)三个像素。如图2和图3中的第一显示区域41和第二显示区域42中的每行都包括3840×3＝11520个水平像素。图1至图3中的4320行表示在显示面板40中的每列包括4320个垂直像素。
可选地，如图1所示，至少两个时序控制芯片11根据接收的输入信号为LVDS(Low-Voltage Differential Signaling，低电压差分信号)，输出显示信号和源极时序控制信号给N个源极驱动芯片，以及输出栅极时序控制信号给栅极驱动模块30。其中，输入信号还可以为其他信号，本申请不做特别的限定。
在一些实施例中，N个源极驱动芯片包括两个源极驱动模块；两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接。
可选地，N个源极驱动芯片中的M个源极驱动芯片形成两个源极驱动模块。M小于等于N，M为正整数。
可选地，每个源极驱动模块包括N/2个源极驱动芯片。
在一些实施例中，如图2和图3所示，两个时序控制芯片包括第一时序控制芯片111和第二时序控制芯片112；第一时序控制芯片111和第二时序控制芯片112分别包括两路通道；
两个源极驱动模块包括第一源极驱动模块22和第二源极驱动模块23；第一源极驱动模块22包括第一源极子模块221和第二源极子模块222；第二源极驱动模块23包括第三源极子模块231和第四源极子模块232；
第一时序控制芯片111的一路通道与第一源极子模块221电连接，另一路通道与第二源极子模块222电连接；第二时序控制芯片112的一路通道与第三源极子模块231电连接，另一路通道与第四源极子模块232电连接。
可选地，如图2和图3所示，第一源极驱动模块22被配置为与显示面板40中的第一显示区域41电连接，第二源极驱动模块23被配置为与显示面板40中的第二显示区域42电连接。
需要说明的是，第一时序控制芯片111和第二时序控制芯片112的电路结构和功能相同，第一源极驱动模块22和第二源极驱动模块23的电路和功能相同，第一源极子模块221、第二源极子模块222、第三源极子模块231和第四源极子模块232的电路结构和功能相同，第一显示区域41和第二显示区域42的结构相同。具体的连接关系参见图3所示。
在一个可能的实现方式中，每个时序控制芯片的帧率为60Hz(赫兹)；和/或，每个时序控制芯片的带宽为1.5Gbps(千兆比特每秒)。
可选地，如图3所示，N为24。即针对解析度为8K(例如，7680×4320像素单元)、帧率为120Hz(赫兹)的显示面板，采用24个源极驱动芯片对其进行驱动。
本申请实施例提供的驱动电路，针对高解析度和高帧率的显示设备，相比解析度为8K、帧率为120Hz的TCON，TCON的带宽需要3Gbps(千兆比特每秒)，而本申请实施例采用两个解析度为8K、帧率为60Hz的TCON，TCON的带宽仅需1.5Gbps(千兆比特每秒)，而且无需设计具有更多的高速讯号对的时序控制芯片，就能够实现对多个源极驱动芯片的驱动，缩短了显示驱动的开发周期，提高了显示驱动的开发效率，降低了成本。
而且，相比解析度为8K、帧率为120Hz的TCON，本申请实施例通过采用两个解析度为8K、帧率为60Hz的TCON，将平均每条水平线的充电时间由1.85μs(微秒)升至3.7μs(微秒)。由于平均每条水平线的充电时间增多，使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
基于同一发明构思，本申请实施例提供了一种驱动方法，该驱动方法应用于如上述任一实施例提供的驱动电路，驱动方法包括：
通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号；N为正整数。
本申请实施例通过采用至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号(例如，采用两个解析度为8K、帧率为60Hz的TCON)，每个时序控制芯片向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号。将平均每条水平线的充电时间由1.85μs(微秒)升至3.7μs(微秒)，由于平均每条水平线的充电时间增多，使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
在一些实施例中，N个源极驱动芯片包括两个源极驱动模块，两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接；
以及，通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号，包括：
每个时序控制芯片向对应的源极驱动模块输送显示信号和源极时序控制信号；每个源极驱动模块基于显示信号和源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组；
每个时序控制芯片向电连接的栅极驱动模块输送栅极时序控制信号；栅极驱动模块基于栅极时序控制信号输出扫描信号至显示面板的像素单元行组。
其中，像素单元行组，是指显示面板中在同一帧中扫描显示的所有像素单元行。同一帧可以是同一奇数帧或同一偶数帧。
在一些实施例中，每个时序控制芯片向对应的源极驱动模块输送显示信号和源极时序控制信号；每个源极驱动模块基于显示信号和源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组，包括：
每个时序控制芯片，在实时数据周期中的增大后的时间宽度内，向对应的源极驱动模块输送每个像素单元行所需的显示信号和源极时序控制信号；
每个源极驱动模块，在实时数据周期的除了增大后的时间宽度之外的剩余时段中，基于显示信号和源极时序控制信号，相应生成数据传输控制信号；
在下一个数据周期中，在数据传输控制信号的控制下，将像素单元行所需的显示信号转换成相应的数据电压，施加至显示面板中对应的显示区域的像素单元行。
可选地，数据电压包括灰阶电压信号，灰阶电压信号包括正极性灰阶电压信号和负极性灰阶电压信号。
其中，实时数据周期为数据传输控制信号所占的周期，例如，图4中T1为一个实时数据周期。
其中，时间宽度为有效时间宽度，即时序控制芯片输出显示信号和源极时序控制信号的时间宽度，例如，图4中Input Signal(1.5G-2lane)中标识1、2、3、4的宽度均为增加后的时间宽度。
其中，下一个数据周期为实时数据周期的下一个数据周期，例如，图4中，如果T1为实时数据周期，则T2为T1的下一个数据周期。
如图4所示，以两个解析度为8K、帧率为60Hz的TCON为例对上述驱动方法进行说明。图4中，各信号说明如下：
Input Signal(1.5G-2lane)表示两个时序控制芯片向对应的源极驱动模块输入的显示信号和源极时序控制信号；1.5G表示每个时序控制芯片的带宽为1.5Gbps、且2lane表示每个时序控制芯片具有两路通道。
SOE表示源极驱动模块的数据传输控制信号。
SDOUT表示源极驱动模块输出的灰阶电压信号(包括正极性灰阶电压信号和负极性灰阶电压信号)。
GSP表示栅极驱动模块的帧控制信号。
G1～G4表示栅极驱动模块输出的第1行水平扫描信号至第4行的水平扫描信号。
T1和T2均为3.7μs(微秒)。
从图4中可以看出，从两个时序控制芯片输出的实时数据周期中，通过增大输出有效信号的时间宽度(如图4中Input Signal(1.5G-2lane)中标识1、2、3、4的宽度)，即从而调整数据传输控制信号SOE的输出时间，在数据传输控制信号SOE的控制下，从而调整了源极驱动模块输出的灰阶电压信号SDOUT的时间(如图4中T1和T2均为3.7μs)。从而将平均每条水平线的充电时间由1.85μs(微秒)升至3.7μs(微秒)，平均每条水平线的充电时间增多，使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
在一些实施例中，显示面板的全部像素单元包括两个像素单元行组，两个像素单元行组与栅极驱动模块电连接；
以及，栅极驱动模块基于栅极时序控制信号输出扫描信号至显示面板的像素单元行组，包括：
栅极驱动模块基于栅极时序控制信号生成两组扫描信号，根据两组扫描信号对显示面板的两个像素单元行组进行扫描。
在一些实施例中，两个像素单元行组包括奇数像素单元行组和偶数像素单元行组；两组扫描信号包括第一水平扫描信号组和第二水平扫描信号组；
根据两组扫描信号对显示面板的两个像素单元行组进行扫描，包括：
栅极驱动模块基于栅极时序控制信号生成帧控制信号；帧控制信号包括奇数帧信号和偶数帧信号；
当帧控制信号为奇数帧信号时，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描；当帧控制信号为偶数帧信号时，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；或者，
当帧控制信号为奇数帧信号时，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；当帧控制信号为偶数帧信号时，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描。
其中，奇数像素单元行组为显示面板的所有像素单元行中的奇数像素单元行；偶数像素单元行组为显示面板的所有像素单元行中的偶数像素单元行。
示例性地，如图4所示，G1和G3为第一水平扫描信号组，G2和G4为第二水平扫描信号组。
当帧控制信号为奇数帧信号时，通过G1和G3对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描。当帧控制信号为偶数帧信号时，通过G2和G4对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描。
或者，当帧控制信号为奇数帧信号时，通过G2和G4对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描。当帧控制信号为偶数帧信号时，通过G1和G3对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描。
也就是说，当帧控制信号为第一帧时，可以先扫描奇数行的各像素单元，或者，也可以先扫描偶数行的各像素单元。
在一些实施例中，栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描，包括：
在数据电压每次达到最大幅值时，栅极驱动模块对应输出第一水平扫描信号组中的一个水平扫描信号，至奇数像素单元行组中的一个像素单元行；最大幅值为幅值的绝对值的最大值；
以及，栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描，包括：
在数据电压每次达到最大幅值时，栅极驱动模块对应输出第二水平扫描信号组中的一个水平扫描信号，至偶数像素单元行组中的一个像素单元行；最大幅值为幅值的绝对值的最大值。
如图4所示，在灰阶电压信号SDOUT的幅值的绝对值为最大值时输出扫描信号(G1～G4)至显示面板的各像素单元，能够使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
由于将平均每条水平线的充电时间由1.85μs(微秒)升至3.7μs(微秒)，平均每条水平线的充电时间增多，使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
基于同一发明构思，本申请实施例提供了一种显示设备，该显示设备包括上述任一实施例提供的驱动电路。
基于同一发明构思，本申请实施例提供了一种计算机可读存储介质，计算机可读存储介质中存储有计算机程序，计算机程序由计算机执行以实现上述任一实施例提供的驱动方法。
本申请的计算机可读介质可以是计算机可读信号介质或者计算机可读存储介质或者是上述两者的任意组合。计算机可读存储介质例如可以是但不限于电、磁、光、电磁、红外线、或半导体的系统、装置或器件，或者任意以上的组合。计算机可读存储介质的更具体的例子可以包括但不限于：具有一个或多个导线的电连接、便携式计算机磁盘、硬盘、随机访问存储器(RAM)、只读存储器(ROM)、可擦式可编程只读存储器(EPROM或闪存)、光纤、便携式紧凑磁盘只读存储器(CD-ROM)、光存储器件、磁存储器件、或者上述的任意合适的组合。
在本申请中，计算机可读存储介质可以是任何包含或存储计算机程序的有形介质，该计算机程序可以被指令执行系统、装置或者器件使用或者与其结合使用。而在本申请中，计算机可读信号介质可以包括在基带中或者作为载波一部分传播的数据信号，其中承载了计算机可读的计算机程序代码。这种传播的数据信号可以采用多种形式，包括但不限于电磁信号、光信号或上述的任意合适的组合。计算机可读信号介质还可以是计算机可读存储介质以外的任何计算机可读介质，该计算机可读信号介质可以发送、传播或者传输用于由指令执行系统、装置或者器件使用或者与其结合使用的计算机程序。计算机可读介质上包含的计算机程序代码可以用任何适当的介质传输，包括但不限于：电线、光缆、RF(射频)等等，或者上述的任意合适的组合。
应用本申请实施例，至少能够实现如下有益效果：
(1)本申请实施例提供的驱动电路，针对高解析度和高帧率的显示设备，通过设置至少两个时序控制芯片，每个时序控制芯片与N个源极驱动芯片中的部分源极驱动芯片电连接，无需设计具有更多的高速讯号对的时序控制芯片，就能够实现对多个源极驱动芯片的驱动，缩短了显示驱动的开发周期，提高了显示驱动的开发效率，降低了成本。
(2)通过采用两个解析度为8K、帧率为60Hz的TCON，TCON的带宽仅需1.5Gbps(千兆比特每秒)。
(3)本申请实施例通过采用至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号(例如，采用两个解析度为8K、帧率为60Hz的TCON)，每个时序控制芯向N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号。将平均每条水平线的充电时间由1.85μs(微秒)升至3.7μs(微秒)，由于平均每条水平线的充电时间增多，使得供给显示面板中像素单元的灰阶电压充足，使得正确显示的灰阶能够正确显示，避免了画面产生亮暗闪烁的问题，保证显示效果。
本技术领域技术人员可以理解，本申请中已经讨论过的各种操作、方法、流程中的步骤、措施、方案可以被交替、更改、组合或删除。进一步地，具有本申请中已经讨论过的各种操作、方法、流程中的其他步骤、措施、方案也可以被交替、更改、重排、分解、组合或删除。进一步地，现有技术中的具有与本申请中公开的各种操作、方法、流程中的步骤、措施、方案也可以被交替、更改、重排、分解、组合或删除。
术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本发明的描述中，除非另有说明，“多个”的含义是两个或两个以上。
应该理解的是，虽然附图的流程图中的各个步骤按照箭头的指示依次显示，但是这些步骤并不是必然按照箭头指示的顺序依次执行。除非本文中有明确的说明，这些步骤的执行并没有严格的顺序限制，其可以以其他的顺序执行。而且，附图的流程图中的至少一部分步骤可以包括多个子步骤或者多个阶段，这些子步骤或者阶段并不必然是在同一时刻执行完成，而是可以在不同的时刻执行，其执行顺序也不必然是依次进行，而是可以与其他步骤或者其他步骤的子步骤或者阶段的至少一部分轮流或者交替地执行。
以上所述仅是本申请的部分实施方式，应当指出，对于本技术领域的普通技术人员来说，在不脱离本申请原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本申请的保护范围。

Claims (9)

1.一种驱动电路，其特征在于，包括：
N个源极驱动芯片；
至少两个时序控制芯片，每个时序控制芯片与N个源极驱动芯片中的部分源极驱动芯片电连接，用于向其电连接的源极驱动芯片输入显示信号和源极时序控制信号；
栅极驱动模块，与所述至少两个时序控制芯片电连接，用于接收所述至少两个时序控制芯片输出的栅极时序控制信号；
其中：通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号；
所述N个源极驱动芯片包括两个源极驱动模块，所述两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；所述至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接；
所述通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，包括：
每个所述时序控制芯片向对应的源极驱动模块输送所述显示信号和所述源极时序控制信号；每个所述源极驱动模块基于所述显示信号和所述源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组；
每个时序控制芯片向电连接的栅极驱动模块输送栅极时序控制信号；所述栅极驱动模块基于所述栅极时序控制信号输出扫描信号至所述显示面板的像素单元行组；
所述每个所述时序控制芯片向对应的源极驱动模块输送所述显示信号和所述源极时序控制信号；每个所述源极驱动模块基于所述显示信号和所述源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组，包括：
每个所述时序控制芯片，在实时数据周期中的增大后的时间宽度内，向对应的源极驱动模块输送每个像素单元行所需的所述显示信号和所述源极时序控制信号；
每个所述源极驱动模块，在所述实时数据周期的除了所述增大后的时间宽度之外的剩余时段中，基于所述显示信号和所述源极时序控制信号，相应生成数据传输控制信号；
在下一个数据周期中，在所述数据传输控制信号的控制下，将所述像素单元行所需的所述显示信号转换成相应的数据电压，施加至显示面板中对应的显示区域的所述像素单元行。
2.根据权利要求1所述的驱动电路，其特征在于，
所述两个时序控制芯片包括第一时序控制芯片和第二时序控制芯片；所述第一时序控制芯片和所述第二时序控制芯片分别包括两路通道；
所述两个源极驱动模块包括第一源极驱动模块和第二源极驱动模块；所述第一源极驱动模块包括第一源极子模块和第二源极子模块；所述第二源极驱动模块包括第三源极子模块和第四源极子模块；
所述第一时序控制芯片的一路通道与所述第一源极子模块电连接，另一路通道与所述第二源极子模块电连接；
所述第二时序控制芯片的一路通道与所述第三源极子模块电连接，另一路通道与所述第四源极子模块电连接。
3.根据权利要求1所述的驱动电路，其特征在于：
每个时序控制芯片的帧率为60赫兹；和/或，
每个时序控制芯片的带宽为1.5千兆比特每秒。
4.一种驱动方法，其特征在于，应用于如上述权利要求1-3中任一项所述的驱动电路，所述驱动方法包括：
通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向所述N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号；
所述N个源极驱动芯片包括两个源极驱动模块，所述两个源极驱动模块被配置成与显示面板中对应的两个显示区域的各像素单元电连接；所述至少两个时序控制芯片包括两个时序控制芯片，每个时序控制芯片与对应的源极驱动模块电连接；
以及，所述通过至少两个时序控制芯片向N个源极驱动芯片输入显示信号和源极时序控制信号，其中，每个时序控制芯片向所述N个源极驱动芯片中的部分源极驱动芯片输入显示信号和源极时序控制信号，包括：
每个所述时序控制芯片向对应的源极驱动模块输送所述显示信号和所述源极时序控制信号；每个所述源极驱动模块基于所述显示信号和所述源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组；
每个时序控制芯片向电连接的栅极驱动模块输送栅极时序控制信号；所述栅极驱动模块基于所述栅极时序控制信号输出扫描信号至所述显示面板的像素单元行组；
所述每个所述时序控制芯片向对应的源极驱动模块输送所述显示信号和所述源极时序控制信号；每个所述源极驱动模块基于所述显示信号和所述源极时序控制信号产生数据电压，施加至显示面板中对应的显示区域的像素单元行组，包括：
每个所述时序控制芯片，在实时数据周期中的增大后的时间宽度内，向对应的源极驱动模块输送每个像素单元行所需的所述显示信号和所述源极时序控制信号；
每个所述源极驱动模块，在所述实时数据周期的除了所述增大后的时间宽度之外的剩余时段中，基于所述显示信号和所述源极时序控制信号，相应生成数据传输控制信号；
在下一个数据周期中，在所述数据传输控制信号的控制下，将所述像素单元行所需的所述显示信号转换成相应的数据电压，施加至显示面板中对应的显示区域的所述像素单元行。
5.根据权利要求4所述的驱动方法，其特征在于，所述显示面板的全部像素单元包括两个像素单元行组，所述两个像素单元行组与所述栅极驱动模块电连接；
以及，所述栅极驱动模块基于所述栅极时序控制信号输出扫描信号至所述显示面板的像素单元行组，包括：
所述栅极驱动模块基于所述栅极时序控制信号生成两组扫描信号，根据所述两组扫描信号对显示面板的两个像素单元行组进行扫描。
6.根据权利要求5所述的驱动方法，其特征在于，所述两个像素单元行组包括奇数像素单元行组和偶数像素单元行组；所述两组扫描信号包括第一水平扫描信号组和第二水平扫描信号组；
所述根据所述两组扫描信号对显示面板的两个像素单元行组进行扫描，包括：
所述栅极驱动模块基于所述栅极时序控制信号生成帧控制信号；所述帧控制信号包括奇数帧信号和偶数帧信号；
当所述帧控制信号为奇数帧信号时，所述栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描；当所述帧控制信号为偶数帧信号时，所述栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；或者，
当所述帧控制信号为奇数帧信号时，所述栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描；当所述帧控制信号为偶数帧信号时，所述栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描。
7.根据权利要求6所述的驱动方法，其特征在于，所述栅极驱动模块输出第一水平扫描信号组对显示面板的奇数像素单元行组中的各像素单元行进行逐行扫描，包括：
在所述数据电压每次达到最大幅值时，所述栅极驱动模块对应输出所述第一水平扫描信号组中的一个水平扫描信号，至所述奇数像素单元行组中的一个像素单元行；所述最大幅值为幅值的绝对值的最大值；
以及，所述栅极驱动模块输出第二水平扫描信号组对显示面板的偶数像素单元行组中的各像素单元行进行逐行扫描，包括：
在所述数据电压每次达到最大幅值时，所述栅极驱动模块对应输出所述第二水平扫描信号组中的一个水平扫描信号，至所述偶数像素单元行组中的一个像素单元行；所述最大幅值为幅值的绝对值的最大值。
8.一种显示设备，其特征在于，包括权利要求1-3任一项所述的驱动电路。
9.一种计算机可读存储介质，其特征在于，所述计算机可读存储介质中存储有计算机程序，所述计算机程序由计算机执行以实现权利要求4至7中任一项所述的驱动方法。
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