CN113763872A - 一种像素电路及其驱动方法、显示装置 - Google Patents

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Abstract

本公开实施例提供一种像素电路及其驱动方法、显示装置。像素电路，包括：数据写入模块，被配置为在第一扫描信号端的控制下，向第一节点提供数据信号端的数据信号；开关模块，被配置为在第一扫描信号端的控制下，向第二节点提供第一节点的数据信号；第一存储模块，被配置为存储第二节点的数据信号；第二存储模块，被配置为存储第一节点的数据信号；驱动模块，被配置为在第二节点的控制下，基于第一电源端的电信号向发光模块提供驱动电信号以驱动发光模块发光。本公开的像素电路，减小了开关模块的漏电流，降低了开关模块的漏电流对驱动模块的影响，提高了显示效果。

Description

一种像素电路及其驱动方法、显示装置
技术领域
本公开涉及显示技术领域，尤其涉及一种像素电路及其驱动方法、显示装置。
背景技术
现有技术中的像素电路，显示装置在高亮度发光时，像素电路中的驱动晶体管电阻变小，因此，像素的行数越大，像素受到线电阻的影响越大，电压降越大，影响了显示效果。显示装置在低亮度发光时，驱动晶体管电阻较大，像素受线电阻的影响较小，但存储电容的数据电压在显示一帧画面的过程中会发生变化，影响显示效果。
发明内容
本公开实施例提供一种像素电路及其驱动方法、显示装置，以解决或缓解现有技术中的一项或更多项技术问题。
作为本公开实施例的第一个方面，本公开实施例提供一种像素电路，包括：
数据写入模块，分别与数据信号端、第一扫描信号端、第一节点连接，被配置为在第一扫描信号端的控制下，向第一节点提供数据信号端的数据信号；
开关模块，分别与第一扫描信号端、第一节点和第二节点连接，被配置为在第一扫描信号端的控制下，向第二节点提供第一节点的数据信号；
第一存储模块，分别与第二节点和第一电源端连接，被配置为存储第二节点的数据信号；
第二存储模块，分别与第一节点和第二电源端连接，被配置为存储第一节点的数据信号；
驱动模块，分别与第一电源端、第二节点和发光模块连接，被配置为在第二节点的控制下，基于第一电源端的电信号向发光模块提供驱动电信号以驱动发光模块发光。
在一些可能的实现方式中，像素电路还包括发光控制模块，驱动模块与第三节点连接，发光控制模块分别与第三节点、控制信号端和发光模块连接，驱动模块被配置为在第二节点的控制下，基于第一电源端的电信号向第三节点提供驱动电信号，发光控制模块被配置为在控制信号端的控制下，向发光模块提供第三节点的驱动电信号，以驱动发光模块发光。
在一些可能的实现方式中，像素电路包括以下至少之一：
数据写入模块包括第一晶体管，第一晶体管的控制端与第一扫描信号端连接，第一晶体管的第一极与数据信号端连接，第一晶体管的第二极与第一节点连接；
开关模块包括第二晶体管，第二晶体管的控制端与第一扫描信号端连接，第二晶体管的第一极与第一节点连接，第二晶体管的第二极与第二节点连接；
第一存储模块包括第一存储电容，第一存储电容的第一极板和第二极板分别与第二节点和第一电源端连接；
第二存储模块包括第二存储电容，第二存储电容的第一极板和第二极板分别与第一节点和第二电源端连接；
驱动模块包括第五晶体管，第五晶体管的控制端与第二节点连接，第五晶体管的第一极与第一电源端连接，第五晶体管的第二极与发光模块连接。
在一些可能的实现方式中，发光控制模块包括第六晶体管，第六晶体管的控制端与控制信号端连接，第六晶体管的第一极与第三节点连接，第六晶体管的第二极与发光模块连接。
在一些可能的实现方式中，像素电路还包括补偿模块，补偿模块分别与第一节点、第二节点、第一电源端和第二扫描信号端连接，补偿模块被配置为在第二扫描信号端和第二节点的控制下，使得流经补偿模块的电流为数据信号端的数据信号，以对驱动模块进行补偿，使得存储至第二节点的电压在发光阶段驱动驱动模块导通，且流经驱动模块的源漏极电流为数据信号，数据信号为电流数据信号。
在一些可能的实现方式中，补偿模块包括开关子模块和镜像子模块，开关子模块分别与第一节点、第二扫描信号端和第四节点连接，开关子模块被配置为在第二扫描信号端的控制下，使得第一节点的电流数据信号流经开关子模块；
镜像子模块分别与第四节点、第二节点和第一电源端连接，镜像子模块的结构与驱动模块的结构镜像对称，镜像子模块被配置为在第二节点的控制下，使得流经镜像子模块的电流为电流数据信号，以对驱动模块进行补偿，使得存储至第二节点的电压在发光阶段驱动驱动模块导通，且流经驱动模块的源漏极电流为电流数据信号。
在一些可能的实现方式中，像素电路包括以下至少之一：
开关子模块包括第三晶体管，第三晶体管的控制端与第二扫描信号端连接，第三晶体管的第一极与第一节点连接，第三晶体管的第二极与第四节点连接；
镜像子模块包括第四晶体管，第四晶体管的控制端与第二节点连接，第四晶体管的第一极与第四节点连接，第四晶体管的第二极与第一电源端连接。
作为本公开实施例的第二方面，本公开实施例提供一种像素电路的驱动方法，适用于本公开实施例中的像素电路，方法包括：
在第一写数据阶段，向第一节点和第二节点提供数据信号端的电流数据信号，直至补偿模块在第二节点和第二扫描信号端的控制下，使得流经补偿模块的电流为电流数据信号；
在第一发光阶段，在第二节点的控制下，流经驱动模块的电流为电流数据信号，以驱动发光模块发光。
在一些可能的实现方式中，方法还包括：
在第二写数据阶段，向第一节点和第二节点提供数据信号端的电压数据信号；
在第二发光阶段，驱动模块在第二节点的控制下，基于第一电源端的电信号向发光模块提供驱动电信号以驱动发光模块发光。
在一些可能的实现方式中，在第一写数据阶段，向第一节点和第二节点提供电流数据信号，向第四节点提供电流数据信号，直至镜像子模块在第二节点的控制下，使得流经镜像子模块的电流为电流数据信号。
在一些可能的实现方式中，第一写数据阶段和第一发光阶段适用于显示装置的高亮度显示，第二写数据阶段和第二发光阶段适用于显示装置的低亮度显示；低亮度为小于或等于100尼特的亮度，高亮度为大于100尼特的亮度。
作为本公开实施例的第三方面，本公开实施例提供一种显示装置，包括本公开实施例中的像素电路。
本公开实施例的技术方案，灰阶显示过程中，在扫描下一行像素时，第一节点的电信号可以保持，使得第一节点的电位等同于第二节点的电位，从而减小了开关模块两端的电位差，减小了开关模块的漏电流，避免了第二节点存储的数据信号受开关模块的漏电流的影响而发生变化，使得第二节点存储的数据信号可以在显示一帧画面的过程中保持稳定，降低了开关模块的漏电流对驱动模块的影响，提高了显示效果。
上述概述仅仅是为了说明书的目的，并不意图以任何方式进行限制。除上述描述的示意性的方面、实施方式和特征之外，通过参考附图和以下的详细描述，本公开进一步的方面、实施方式和特征将会是容易明白的。
附图说明
在附图中，除非另外规定，否则贯穿多个附图相同的附图标记表示相同或相似的部件或元素。这些附图不一定是按照比例绘制的。应该理解，这些附图仅描绘了根据本公开的一些实施方式，而不应将其视为是对本公开范围的限制。
图1为一种像素电路的示意图；
图2为本公开一实施例中像素电路的结构示意图；
图3为本公开另一实施例中像素电路的结构示意图；
图4为本公开另一实施例中像素电路的结构示意图；
图5为本公开另一实施例中像素电路的结构示意图；
图6为本公开另一实施例中像素电路的结构示意图；
图7为本公开另一实施例中像素电路的结构示意图；
图8为本公开另一实施例中像素电路的结构示意图；
图9为本公开一实施例中像素电路的电流驱动方式的工作时序图；
图10为本公开实施例中像素电路在第一写数据阶段的工作状态示意图；
图11为本公开实施例中像素电路在第一发光阶段的工作状态示意图。
图12为本公开一实施例中像素电路的电压驱动方式的工作时序图；
图13为本公开实施例中像素电路在第二写数据阶段的工作状态示意图；
图14为本公开实施例中像素电路在第二发光阶段的工作状态示意图；
附图标记说明：
10、数据写入模块；20、开关模块；30、第一存储模块；40、第二存储模块；50、驱动模块；60、发光模块；70、发光驱动模块；80、补偿模块；81、开关子模块；82、镜像子模块。
具体实施方式
在下文中，仅简单地描述了某些示例性实施例。正如本领域技术人员可认识到的那样，在不脱离本公开的精神或范围的情况下，可通过各种不同方式修改所描述的实施例。因此，附图和描述被认为本质上是示例性的而非限制性的。
本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，根据在电路中的作用本发明的实施例所采用的晶体管主要为开关晶体管。由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，将其中源极(源电极)称为第一极，漏极(漏电极)称为第二极，或者，可以将漏极称为第一极，源极称为第二极。按附图中的形态规定晶体管的中间端为栅极(也可以叫做栅电极)、信号输入端为源极、信号输出端为漏极。本发明实施例所采用的开关晶体管可以为P型开关晶体管或N型晶体管，P型开关晶体管在栅极为低电平时导通，在栅极为高电平时截止；N型晶体管在栅极为高电平时导通，在栅极为低电平时截止。此外，本发明各个实施例中的多个信号都对应有第一电位和第二电位。第一电位和第二电位仅代表该信号的电位有2个状态量，不代表全文中第一电位或第二电位具有特定的数值。本发明实施例中以第一电位为有效电位为例进行说明。
其中，耦接可以包括：两端之间电连接或者两端之间直接连接(如两端之间通过信号线建立连接)。本发明实施例对两端之间的耦接方式不做限定。
图1为一种像素电路的示意图。在高分辨率(PPI)显示中，类似于硅基LED或硅基OLED用于AR、VR显示时，分辨率有时需要达到2000PPI及以上。在高分辨率显示中，如图1所示，Vdd带来的线电阻Rs无法避免，显示亮度越高，最后一行像素受到电压降(IR drop)的影响越大，最终影响显示装置的显示效果。并且，由于开关晶体管T1源极和漏极之间存在漏电流，存储电容Cst会受到开关晶体管T1的漏电流的影响，导致存储电容Cst的存储的数据电压在显示一帧画面的过程中发生变化，影响显示效果。
图2为本公开一实施例中像素电路的结构示意图。如图2所示，像素电路可以包括数据写入模块10、开关模块20、第一存储模块30、第二存储模块40和驱动模块50。
数据写入模块10分别与数据信号端Data、第一扫描信号端Scan1、第一节点N1连接，被配置为在第一扫描信号端Scan1的控制下，向第一节点N1提供数据信号端Data的数据信号。
开关模块20分别与第一扫描信号端Scan1、第一节点N1和第二节点N2连接，被配置为在第一扫描信号端Scan1的控制下，向第二节点N2提供第一节点N1的数据信号。
第一存储模块30分别与第二节点N2和第一电源端Vdd连接，被配置为存储第二节点N2的数据信号。
第二存储模块40分别与第一节点N1和第二电源端Vss连接，被配置为存储第一节点N1的数据信号。
驱动模块50分别与第一电源端Vdd、第二节点N2和发光模块60连接，被配置为在第二节点N2的控制下，基于第一电源端Vdd的电信号向发光模块60提供驱动电信号以驱动发光模块60发光。其中，发光模块60的另一端与第二电源端Vss连接。
相关技术中，如图1所示，存储电容Cst与晶体管T1的漏极连接，数据信号端Data与晶体管T1的源极连接。灰阶显示过程中，在扫描下一行像素时，数据信号端Data的电信号产生变化，使得晶体管T1的Vds较大，导致晶体管T1产生较大漏电流。存储电容Cst受较大漏电流的影响，存储电容Cst存储的数据信号在显示一帧画面的过程中发生变化，导致晶体管T2提供给发光模块60的电信号变化，影响显示效果。
本公开实施例中的像素电路，第二存储模块40被配置为存储第一节点N1的数据信号，开关模块20被配置为在第一扫描信号端Scan1的控制下，向第二节点N2提供第一节点N1的数据信号，从而，灰阶显示过程中，在扫描下一行像素时，第一节点N1的电信号可以保持，使得第一节点N1的电位等同于第二节点N2的电位，从而减小了开关模块20两端的电位差，减小了开关模块20的漏电流，避免了第二节点N2存储的数据信号受开关模块20的漏电流的影响而发生变化，使得第二节点N2存储的数据信号可以在显示一帧画面的过程中保持稳定，降低了开关模块20的漏电流对驱动模块50的影响，提高了显示效果。
在一种实施方式中，发光模块60可以为有机发光二极管(Organic Light-Emitting Diode，OLED)，或者，发光模块60可以为发光二极管(LED)芯片。
图3为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图3所示，数据写入模块10可以包括第一晶体管T1，第一晶体管T1的控制端与第一扫描信号端Scan1连接，第一晶体管T1的第一极与数据信号端Data连接，第一晶体管T1的第二极与第一节点N1连接。
在一种实施方式中，如图3所示，开关模块20可以包括第二晶体管T2，第二晶体管T2的控制端与第一扫描信号端Scan1连接，第二晶体管T2的第一极与第一节点连接，第二晶体管T2的第二极与第二节点N2连接。
在一种实施方式中，如图3所示，第一存储模块30可以包括第一存储电容Cst1，第一存储电容Cst1的第一极板和第二极板分别与第二节点N2和第一电源端Vdd连接。
在一种实施方式中，如图3所示，第二存储模块40可以包括第二存储电容Cst2，第二存储电容Cst2的第一极板和第二极板分别与第一节点N1和第二电源端Vss连接。
在一种实施方式中，如图3所示，驱动模块50可以包括第五晶体管T5，第五晶体管T5的控制端与第二节点N2连接，第五晶体管T5的第一极与第一电源端Vdd连接，第五晶体管T5的第二极与发光模块60连接。
需要说明的是，图3中示出了数据写入模块、开关模块、第一存储模块、第二存储模块和驱动模块的示例性结构，本领域技术人员可以理解，数据写入模块、开关模块、第一存储模块、第二存储模块和驱动模块并不限于图3所示的结构，只要可以实现其功能即可。
如图3所示，在灰阶显示过程中，在扫描下一行像素时，第二存储电容Cst2可以使得第一节点N1的电信号保持，进而使得第一节点N1的电位等同于第二节点N2的电位，从而减小了第二晶体管T2的Vds，使得第二晶体管T2的Vds约为0，这样就可以减小第二晶体管T2的漏电流，避免了第二节点N2存储的数据信号受第二晶体管T2的漏电流的影响而发生变化，使得第二节点N2存储的数据信号可以在显示一帧画面的过程中保持稳定，降低了第二晶体管T2的漏电流对第五晶体管T5的影响，提高了显示效果。
图4为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图4所示，像素电路还可以包括发光控制模块70，驱动模块50通过发光控制模块70与发光模块60连接。示例性地，驱动模块50与第三节点N3连接，发光控制模块70分别与第三节点N3、控制信号端EM和发光模块60连接。驱动模块50被配置为在第二节点N2的控制下，基于第一电源端Vdd的电信号向第三节点N3提供驱动电信号。发光控制模块70被配置为在控制信号端EM的控制下，向发光模块60提供第三节点N3的驱动电信号，以驱动发光模块60发光。
本公开实施例中的像素电路，在驱动模块50与发光模块60之间设置发光控制模块70，在低灰阶显示时，采用控制信号端EM结合电压驱动方式，可以实现对第一存储模块30快速充放电，并可以实现精确的低灰阶显示控制。
图5为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图5所示，发光控制模块70可以包括第六晶体管T6，第六晶体管T6的控制端与控制信号端EM连接，第六晶体管T6的第一极与第三节点N3连接，第六晶体管T6的第二极与发光模块60连接。
需要说明的是，图5中示出了发光控制模块的示例性结构，本领域技术人员可以理解，发光控制模块并不限于图3所示的结构，只要可以实现其功能即可。
图6为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图6所示，像素电路还包括补偿模块80，补偿模块80分别与第一节点N1、第二节点N2、第一电源端Vdd和第二扫描信号端Scan2连接，补偿模块80被配置为在第二扫描信号端Scan2和第二节点N2的控制下，使得流经补偿模块80的电流为数据信号端Data的数据信号，以对驱动模块50进行补偿，使得存储至第二节点N2的电压在发光阶段驱动驱动模块50导通，且流经驱动模块50的源漏极电流为数据信号。示例性地，数据信号端Data的数据信号为电流数据信号。也就是说，补偿模块80在第二扫描信号端Scan2和第二节点N2的控制下，使得流经补偿模块80的电流为数据信号端Data的电流数据信号，以对驱动模块50进行补偿，补偿后存储至第二节点N2的电压在发光阶段不仅驱动驱动模块50导通，而且使得流经驱动模块50的源漏极电流为数据信号端Data的电流数据信号Idata。
相关实施例中的像素电路，如图1所示，在高分辨率显示或高亮度显示时，数据信号端Data输出电压数据信号，第一电源端Vdd带来的线电阻Rs无法避免，显示亮度越高，最后一行像素受到电压降(IR drop)的影响越大，最终影响显示装置的显示效果。
本公开实施例中的像素电路可以适用于高亮度显示，在高亮度显示时，数据信号端Data输出的数据信号为电流数据信号。补偿模块80在第二扫描信号端Scan2和第二节点N2的控制下，使得流经补偿模块80的电流为数据信号端Data的电流数据信号Idata，以对驱动模块50进行补偿，使得存储至第二节点N2的电压在发光阶段驱动驱动模块50导通，且流经驱动模块50的源漏极电流为电流数据信号Idata。在发光阶段，第二节点N2的电压驱动驱动模块50导通，且流经驱动模块50的源漏极电流为电流数据信号Idata，电流不会受到线电阻Rs的影响，这样就可以保证显示面板中各像素行对应的像素电路的驱动能力相同，避免像素由于行数靠后而受到电压降的影响，提高了显示效果。
图7为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图7所示，补偿模块80可以包括开关子模块81和镜像子模块82。开关子模块81分别与第一节点N1、第二扫描信号端Scan2和第四节点N4连接，开关子模块81被配置为在第二扫描信号端Scan2的控制下，使得第一节点N1的电流数据信号Idata流经开关子模块81。
在一种示例性实施例中，镜像子模块82分别与第四节点N4、第二节点N2和第一电源端Vdd连接，镜像子模块82的结构与驱动模块50的结构镜像对称，镜像子模块82被配置为在第二节点N2的控制下，使得流经镜像子模块82的电流为电流数据信号Idata，以对驱动模块50进行补偿，使得存储至第二节点N2的电压在发光阶段驱动驱动模块50导通，且流经驱动模块50的源漏极电流为电流数据信号Idata。示例性地，镜像子模块82在第二节点N2的控制下，使得流经镜像子模块82的电流为电流数据信号Idata，以对驱动模块50进行补偿，补偿后存储至第二节点N2的电压在发光阶段不仅驱动驱动模块50导通，而且使得流经驱动模块50的源漏极电流为数据信号端Data的电流数据信号Idata，停止对第一存储模块30和第二存储模块40进行充电。
本公开实施例中的像素电路，将补偿模块80设置为包括开关子模块81和镜像子模块82，在电流数据信号Idata流经镜像子模块82时，由于镜像子模块82的结构与驱动模块50的结构镜像对称，便可以实现发光阶段流经驱动模块50的电流为电流数据信号Idata。通过在第一节点N1与镜像子模块82之间设置开关子模块81，在发光阶段，可以通过关断开关子模块81来切断镜像子模块82与第一节点N1的连接，使得开关模块20的两端即第一节点N1和第二节点N2的电位保持等同，使得开关模块的Vds保持为0，避免开关模块20产生漏电流，进一步提高高亮度显示时的显示效果。
图8为本公开另一实施例中像素电路的结构示意图。在一种实施方式中，如图8所示，开关子模块81可以包括第三晶体管T3，第三晶体管T3的控制端与第二扫描信号Scan2端连接，第三晶体管T3的第一极与第一节点N1连接，第三晶体管T3的第二极与第四节点N4连接。
示例性地，镜像子模块82可以包括第四晶体管T4，第四晶体管T4的控制端与第二节点N2连接，第四晶体管T4的第一极与第四节点N4连接，第四晶体管T4的第二极与第一电源端Vdd连接。
需要说明的是，图8中示出了开关子模块和镜像子模块的示例性结构，本领域技术人员可以理解，开关子模块和镜像子模块并不限于图8所示的结构，只要可以实现其功能即可。
在一种实施方式中，如图8所示，数据写入模块10可以包括第一晶体管T1，第一晶体管T1的控制端与第一扫描信号端Scan1连接，第一晶体管T1的第一极与数据信号端Data连接，第一晶体管T1的第二极与第一节点N1连接。
开关模块20可以包括第二晶体管T2，第二晶体管T2的控制端与第一扫描信号端Scan1连接，第二晶体管T2的第一极与第一节点连接，第二晶体管T2的第二极与第二节点N2连接。
第一存储模块30可以包括第一存储电容Cst1，第一存储电容Cst1的第一极板和第二极板分别与第二节点N2和第一电源端Vdd连接。
第二存储模块40可以包括第二存储电容Cst2，第二存储电容Cst2的第一极板和第二极板分别与第一节点N1和第二电源端Vss连接。
驱动模块50可以包括第五晶体管T5，第五晶体管T5的控制端与第二节点N2连接，第五晶体管T5的第一极与第一电源端Vdd连接，第五晶体管T5的第二极与第三节点N3连接。
发光控制模块70可以包括第六晶体管T6，第六晶体管T6的控制端与控制信号端EM连接，第六晶体管T6的第一极与第三节点N3连接，第六晶体管T6的第二极与发光模块60连接。发光模块60可以为OLED或者LED芯片，发光模块60的一端与第六晶体管T6的第二极连接，发光模块60的另一端与第二电源端Vss连接。
在一种示例性实施例中，第一晶体管T1到第六晶体管T6的类型可以相同，或者，第一晶体管T1到第六晶体管T6的类型可以不相同。例如，第一晶体管T1到第六晶体管T6可以均为P型晶体管，或者，第一晶体管T1到第六晶体管T6可以均为N型晶体管。像素电路中采用相同类型的晶体管可以简化工艺流程，减少工艺难度，提高产品的良率。例如，P型晶体管可以由低温多晶硅薄膜晶体管或非晶硅薄膜晶体管实现，N型晶体管可以由氧化物薄膜晶体管或非晶硅薄膜晶体管实现。下文中，以第一晶体管T1到第六晶体管T6均为P型晶体管为例，说明本公开实施例中像素电路的工作原理。以“×”表示晶体管关断，以“○”表示晶体管导通。
在一种实施方式中，本公开如图6至图8实施例中的像素电路，在显示装置的低亮度显示情况下，可以采用电压驱动方式，即数据信号端Data向像素电路提供电压数据信号Vdata；在显示装置的高亮度显示情况下，可以采用电流驱动方式，即数据信号端Data向像素电路提供电流数据信号Idata。示例性地，低亮度为小于或等于100尼特的亮度，高亮度为大于100尼特的亮度。从而，在显示装置的显示亮度小于或等于100尼特的情况下，本公开实施例中的像素电路采用电压驱动方式，数据信号端Data向像素电路提供电压数据信号Vdata；在显示装置的显示亮度大于100尼特的情况下，本公开实施例中的像素电路采用电流驱动方式，数据信号端Data向像素电路提供电流数据信号Idata。
图9为本公开一实施例中像素电路的电流驱动方式的工作时序图。参考图9，电流驱动方式可以包括第一写数据阶段M1和第一发光阶段M2。
图10为本公开实施例中像素电路在第一写数据阶段的工作状态示意图。如图9和图10，在第一写数据阶段M1，第一扫描信号端Scan1、第二扫描信号端Scan2均为低电平信号，控制信号端EM为高电平信号，第一晶体管T1、第二晶体管T2、第三晶体管T3均导通，第六晶体管T6关断，数据信号端Data的电流数据信号Idata对第一节点N1和第二节点N2进行充电。在写数据阶段M3，由于第二节点N2的电信号未达到第五晶体管T5和第四晶体管T4的开启电压，第四晶体管T4和第五晶体管T5可以均处于关断状态。
图11为本公开实施例中像素电路在第一发光阶段的工作状态示意图。在数据信号端Data的电流数据信号对第二节点N2进行充电至使得第二节点N2的电信号达到第五晶体管T5的开启电压，使得第四晶体管T4和第五晶体管T5导通，由于此时数据信号端Data输出为电流数据信号Idata，因此，在第三晶体管T3和第四晶体管T4均导通情况下，流经第四晶体管T4的电流为电流数据信号Idata，充电结束，即第一写数据阶段M3结束，进入第一发光阶段M2。由于第四晶体管T4与第五晶体管T5为镜像对称设计，因此，在流经第四晶体管T4的电流为电流数据信号Idata时，存储至第二节点N2的电压可以在第一发光阶段驱动驱动模块50导通，并且使得流经驱动模块50的源漏极电流为电流数据信号Idata。参考如图9和图11，在第一发光阶段M2，第一扫描信号端Scan1和第二扫描信号端Scan2均为高电平信号，第一晶体管T1、第二晶体管T2和第三晶体管T3均关断，控制信号端EM为低电平，第六晶体管T6导通，第二节点N2的电压驱动第五晶体管T5，流经第五晶体管T5的电流为电流数据信号Idata，第五晶体管T5的驱动能力不会受到线电阻Rs的影响，可以保证显示面板中各像素行对应的像素电路的驱动能力相同，避免像素由于行数靠后而受到电压降的影响，提高了显示效果。
在第一发光阶段M2，第一节点N1的电位等同于第二节点N2的电位，使得第二晶体管T2的Vds约为0，减小了第二晶体管T2的漏电流，避免了第二节点N2存储的数据信号受第二晶体管T2的漏电流的影响而发生变化，使得第二节点N2存储的数据信号可以在显示一帧画面的过程中保持稳定，降低了第二晶体管T2的漏电流对第五晶体管T5的影响，提高了高亮度显示时的显示效果。
图12为本公开一实施例中像素电路的电压驱动方式的工作时序图。参考图12，电压驱动方式可以包括第二写数据阶段M3和第二发光阶段M4。
图13为本公开实施例中像素电路在第二写数据阶段的工作状态示意图。如图12和图13，在第二写数据阶段M3，第一扫描信号端Scan1为低电平信号，第二扫描信号端Scan2和控制信号端EM均为高电平信号，第三晶体管T3关断，第六晶体管T6关断，第一晶体管T1、第二晶体管T2均导通，数据信号端Data的电压数据信号被写入第一节点N1和第二节点N2。在第二写数据阶段M3，由于第六晶体管T6关断，避免发光模块60在写数据阶段出现发光，可以实现对第二节点N2的快速充电。
图14为本公开实施例中像素电路在第二发光阶段的工作状态示意图。如图12和图14，在第二发光阶段M4，第一扫描信号端Scan1为高电平信号，第二扫描信号端Scan2为高电平信号，控制信号端EM为低电平信号，第一晶体管T1、第二晶体管T2和第三晶体管T3均关断，第六晶体管T6导通，第二节点N2的充电完成，第二节点N2的电压数据信号使得第五晶体管T5导通，从而，第一电源端Vdd、第五晶体管T5、第六晶体管T6、发光模块60和第二电源端Vss的回路导通，驱动发光模块60发光。
在第二发光阶段，第一节点N1的电位等同于第二节点N2的电位，使得第二晶体管T2的Vds约为0，减小了第二晶体管T2的漏电流，避免了第二节点N2存储的电压数据信号受第二晶体管T2的漏电流的影响而发生变化，使得第二节点N2存储的电压数据信号可以在显示一帧画面的过程中保持稳定，降低了第二晶体管T2的漏电流对第五晶体管T5的影响，提高了显示效果。
示例性地，数据信号端Data输出电压数据信号或电流数据信号，可以由源驱动芯片(Source IC)控制。
本公开实施例还提供一种像素电路的驱动方法，适用于本公开以上实施例中的像素电路。像素电路的驱动方法可以包括：
在第一写数据阶段，向第一节点和第二节点提供数据信号端的电流数据信号，直至补偿模块在第二节点和第二扫描信号端的控制下，使得流经补偿模块的电流为电流数据信号；在第一发光阶段，在第二节点的控制下，流经驱动模块的电流为电流数据信号，以驱动发光模块发光。
在一种实施方式中，驱动方法还可以包括：在第二写数据阶段，向第一节点和第二节点提供数据信号端的电压数据信号；在第二发光阶段，驱动模块在第二节点的控制下，基于第一电源端的电信号向发光模块提供驱动电信号以驱动发光模块发光。
在一种实施方式中，在第一写数据阶段，驱动方法包括：向第一节点和第二节点提供电流数据信号，向第四节点提供电流数据信号，直至镜像子模块在第二节点的控制下，使得流经镜像子模块的电流为电流数据信号。
在一种实施方式中，第二写数据阶段和第二发光阶段适用于显示装置的低亮度显示；第一写数据阶段和第一发光阶段适用于显示装置的高亮度显示，低亮度为小于或等于100尼特的亮度，高亮度为大于100尼特的亮度。
下面结合图7所示实施例，详细说明本公开实施例中像素电路的驱动方法。
在第一写数据阶段M3，数据信号端Data的电流数据信号Idata通过数据写入模块10向第一节点N1提供电流数据信号Idata，第一节点N1通过开关模块20向第二节点N2提供电流数据信号Idata，第一节点N1通过开关子模块81向第四节点N4提供电流数据信号Idata，实现对第一节点N1和第二节点N2的充电，直至镜像子模块82在第二节点N2的控制下，使得流经镜像子模块82的电流为电流数据信号Idata，充电结束；在第一发光阶段，在第二节点N2的控制下，流经驱动模块50的电流为电流数据信号Idata，流经发光控制模块70的电流为电流数据信号Idata，以驱动发光模块60发光。
在第二写数据阶段M1，数据信号端Data通过数据写入模块10向第一节点提供电压数据信号Vdata，第一节点N1通过开关模块20向第二节点N2提供电压数据信号Vdata。在第二发光阶段M2，驱动模块50在第二节点N2的控制下，基于第一电源端的电信号，通过发光控制模块70向发光模块60提供驱动电信号以驱动发光模块60发光。
需要说明的是，本公开实施例中的像素电路采用的薄膜晶体管的类型不限于上述所给出的实现方式，可由本领域技术人员根据实际情况更换，对应地，像素电路的外部信号的时序可由本领域技术人员根据实际情况做相应的调整。这里，本公开实施例对此不做限定。
基于前述实施例的发明构思，本公开实施例还提供了一种显示装置，该显示装置包括采用前述实施例的像素电路。示例性地，显示装置可以为硅基LED显示装置，或者，显示装置可以为硅基OLED显示装置。显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
需要说明的是，本公开实施例中，发光二极管(LED)芯片可以为次毫米发光二极管(Mini Light Emitting Diode，简称Mini LED)芯片，或者，可以为微型发光二极管(MicroLight Emitting Diode，简称Micro LED)芯片。
在本说明书的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”、“顺时针”、“逆时针”、“轴向”、“径向”、“周向”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本公开和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本公开的限制。
此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者多个该特征。在本公开的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
在本公开中，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”、“固定”等术语应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或成一体；可以是机械连接，也可以是电连接，还可以是通信；可以是直接相连，也可以通过中间媒介间接相连，可以是两个元件内部的连通或两个元件的相互作用关系。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本公开中的具体含义。
在本公开中，除非另有明确的规定和限定，第一特征在第二特征之“上”或之“下”可以包括第一和第二特征直接接触，也可以包括第一和第二特征不是直接接触而是通过它们之间的另外的特征接触。而且，第一特征在第二特征“之上”、“上方”和“上面”包括第一特征在第二特征正上方和斜上方，或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”包括第一特征在第二特征正上方和斜上方，或仅仅表示第一特征水平高度小于第二特征。
上文的公开提供了许多不同的实施方式或例子用来实现本公开的不同结构。为了简化本公开，上文中对特定例子的部件和设置进行描述。当然，它们仅仅为示例，并且目的不在于限制本公开。此外，本公开可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。
以上，仅为本公开的具体实施方式，但本公开的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本公开揭露的技术范围内，可轻易想到其各种变化或替换，这些都应涵盖在本公开的保护范围之内。因此，本公开的保护范围应以权利要求的保护范围为准。

Claims (12)

1.一种像素电路，其特征在于，包括：
数据写入模块，分别与数据信号端、第一扫描信号端、第一节点连接，被配置为在所述第一扫描信号端的控制下，向所述第一节点提供所述数据信号端的数据信号；
开关模块，分别与所述第一扫描信号端、所述第一节点和第二节点连接，被配置为在所述第一扫描信号端的控制下，向所述第二节点提供所述第一节点的数据信号；
第一存储模块，分别与所述第二节点和第一电源端连接，被配置为存储所述第二节点的数据信号；
第二存储模块，分别与所述第一节点和第二电源端连接，被配置为存储所述第一节点的数据信号；
驱动模块，分别与所述第一电源端、所述第二节点和发光模块连接，被配置为在所述第二节点的控制下，基于所述第一电源端的电信号向所述发光模块提供驱动电信号以驱动所述发光模块发光。
2.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括发光控制模块，所述驱动模块与第三节点连接，所述发光控制模块分别与所述第三节点、控制信号端和所述发光模块连接，所述驱动模块被配置为在所述第二节点的控制下，基于所述第一电源端的电信号向所述第三节点提供驱动电信号，所述发光控制模块被配置为在所述控制信号端的控制下，向所述发光模块提供所述第三节点的驱动电信号，以驱动所述发光模块发光。
3.根据权利要求1所述的像素电路，其特征在于，所述像素电路包括以下至少之一：
所述数据写入模块包括第一晶体管，所述第一晶体管的控制端与所述第一扫描信号端连接，所述第一晶体管的第一极与所述数据信号端连接，所述第一晶体管的第二极与所述第一节点连接；
所述开关模块包括第二晶体管，所述第二晶体管的控制端与所述第一扫描信号端连接，所述第二晶体管的第一极与所述第一节点连接，所述第二晶体管的第二极与所述第二节点连接；
所述第一存储模块包括第一存储电容，所述第一存储电容的第一极板和第二极板分别与所述第二节点和所述第一电源端连接；
所述第二存储模块包括第二存储电容，所述第二存储电容的第一极板和第二极板分别与所述第一节点和所述第二电源端连接；
所述驱动模块包括第五晶体管，所述第五晶体管的控制端与所述第二节点连接，所述第五晶体管的第一极与所述第一电源端连接，所述第五晶体管的第二极与所述发光模块连接。
4.根据权利要求2所述的像素电路，其特征在于，所述发光控制模块包括第六晶体管，所述第六晶体管的控制端与所述控制信号端连接，所述第六晶体管的第一极与所述第三节点连接，所述第六晶体管的第二极与所述发光模块连接。
5.根据权利要求1至4中任一项所述的像素电路，其特征在于，所述像素电路还包括补偿模块，所述补偿模块分别与所述第一节点、所述第二节点、所述第一电源端和第二扫描信号端连接，所述补偿模块被配置为在所述第二扫描信号端和所述第二节点的控制下，使得流经所述补偿模块的电流为所述数据信号端的数据信号，以对所述驱动模块进行补偿，使得存储至所述第二节点的电压在发光阶段驱动所述驱动模块导通，且流经所述驱动模块的源漏极电流为所述数据信号，所述数据信号为电流数据信号。
6.根据权利要求5所述的像素电路，其特征在于，所述补偿模块包括开关子模块和镜像子模块，所述开关子模块分别与所述第一节点、所述第二扫描信号端和第四节点连接，所述开关子模块被配置为在所述第二扫描信号端的控制下，使得所述第一节点的电流数据信号流经所述开关子模块；
所述镜像子模块分别与所述第四节点、所述第二节点和所述第一电源端连接，所述镜像子模块的结构与所述驱动模块的结构镜像对称，所述镜像子模块被配置为在所述第二节点的控制下，使得流经所述镜像子模块的电流为所述电流数据信号，以对所述驱动模块进行补偿，使得存储至所述第二节点的电压在发光阶段驱动所述驱动模块导通，且流经所述驱动模块的源漏极电流为所述电流数据信号。
7.根据权利要求6所述的像素电路，其特征在于，所述像素电路包括以下至少之一：
所述开关子模块包括第三晶体管，所述第三晶体管的控制端与所述第二扫描信号端连接，所述第三晶体管的第一极与所述第一节点连接，所述第三晶体管的第二极与所述第四节点连接；
所述镜像子模块包括第四晶体管，所述第四晶体管的控制端与所述第二节点连接，所述第四晶体管的第一极与所述第四节点连接，所述第四晶体管的第二极与所述第一电源端连接。
8.一种像素电路的驱动方法，其特征在于，适用于权利要求5至7中任一项所述的像素电路，所述方法包括：
在第一写数据阶段，向第一节点和第二节点提供数据信号端的电流数据信号，直至补偿模块在所述第二节点和第二扫描信号端的控制下，使得流经所述补偿模块的电流为所述电流数据信号；
在第一发光阶段，在所述第二节点的控制下，流经所述驱动模块的电流为所述电流数据信号，以驱动发光模块发光。
9.根据权利要求8所述的驱动方法，其特征在于，所述方法还包括：
在第二写数据阶段，向所述第一节点和所述第二节点提供所述数据信号端的电压数据信号；
在第二发光阶段，所述驱动模块在所述第二节点的控制下，基于第一电源端的电信号向所述发光模块提供驱动电信号以驱动所述发光模块发光。
10.根据权利要求8或9所述的驱动方法，其特征在于，在所述第一写数据阶段，所述方法包括：
向所述第一节点和所述第二节点提供所述电流数据信号，向第四节点提供所述电流数据信号，直至镜像子模块在所述第二节点的控制下，使得流经所述镜像子模块的电流为所述电流数据信号。
11.根据权利要求9所述的驱动方法，其特征在于，所述第一写数据阶段和所述第一发光阶段适用于显示装置的高亮度显示，所述第二写数据阶段和所述第二发光阶段适用于显示装置的低亮度显示；所述低亮度为小于或等于100尼特的亮度，所述高亮度为大于100尼特的亮度。
12.一种显示装置，其特征在于，包括权利要求1至7中任一项所述的像素电路。
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