CN113450734A - 栅极驱动电路及液晶显示面板 - Google Patents

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CN113450734A CN202110664311.8A CN202110664311A CN113450734A CN 113450734 A CN113450734 A CN 113450734A CN 202110664311 A CN202110664311 A CN 202110664311A CN 113450734 A CN113450734 A CN 113450734A
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Abstract

本发明涉及一种栅极驱动电路及具备该栅极驱动电路的液晶显示面板，所述栅极驱动电路通过增设信号反馈线，信号反馈线一端与覆晶薄膜芯片连接，另一端与栅极总线的中段和/或末段连接，从而改善栅极总线中段和/或末段时钟信号的稳定性，减小栅极总线首端、中段和末段时钟信号的差异，提升面板的充电均一性。

Description

栅极驱动电路及液晶显示面板
技术领域
本发明涉及显示技术领域，特别涉及一种栅极驱动电路及具有该栅极驱动电路的液晶显示面板。
背景技术
超窄边框液晶面板显示器中使用栅极驱动电路作为像素扫描线驱动信号，现有栅极驱动电路结构如图1所示，时钟信号(CK信号)从覆晶薄膜芯片(COF)110内输出经过阵列走线(WOA)121以及栅极总线(gate busline)122进入栅极驱动单元(GOA单元)130，为栅极驱动单元130提供级传驱动信号，但是，由于阵列走线以及栅极总线内均存在有电阻电容，导致CK信号在传输过程中会减弱，进而导致CK信号的强度在栅极总线的首段和末段的信号强度不一致，CK信号由栅极总线的首段向末段逐渐减弱，即，栅极总线首段的CK信号强度大于栅极总线末段的CK信号强度，从而产生阻容延迟(RC delay)，阻容延迟的存在，会使得栅极总线末段的CK信号的升起时间和下降时间增加，继而导致驱动信号的级传能力下降，产生错充或充电不足等问题。
发明内容
本发明目的在于，解决现有栅极驱动电路中时钟信号传输存在阻容延迟的问题。
为实现上述目的，本发明提供一种栅极驱动电路，所述栅极驱动电路包括：覆晶薄膜芯片，用以产生时钟信号；两根以上用以传输所述时钟信号的信号传输线，一端分别与所述覆晶薄膜芯片电性连接，另一端连接分别连接一栅极驱动单元，所述信号传输线包括依次连接的阵列走线和栅极总线，所述时钟信号经由阵列走线和栅极总线传输至所述栅极驱动单元；所述栅极驱动电路还包括：两根以上信号反馈线，一根所述信号传输线对应至少一根信号反馈线，所述信号反馈线的一端与所述覆晶薄膜芯片电性连接，所述信号反馈线的另一端与所述栅极总线电性连接，所述时钟信号经由所述信号反馈线传输至栅极总线，以增强与所述信号反馈线连接处所对应的栅极总线的区段的时钟信号。
可选的，所述栅极总线的区段包括依次连接的首段、中段和末段，靠近所述阵列走线的所述栅极总线的区段为首段，远离所述阵列走线的所述栅极总线的区段为末段，位于所述首段与所述末段之间的所述栅极总线的区段为中段；一根所述信号反馈线与所述栅极总线的中段和/或末段电性连接。
可选的，一根所述信号反馈线与所述栅极总线的末段电性连接。
可选的，一根信号传输线对应两根所述信号反馈线，两根所述信号反馈线中，一根所述信号反馈线与所述栅极总线的中段电性连接，另一根所述信号反馈线与所述栅极总线的末段电性连接。
可选的，两根所述信号反馈线平行间隔排布。
可选的，与所述栅极总线的中段电性连接的信号反馈线的长度小于与所述栅极总线的末段电性连接的信号反馈线的长度。
可选的，所述信号反馈线包括依次连接的第一线段和至少一个第二线段，所述第一线段与所述信号传输线平行间隔排布，所述信号反馈线通过所述第二线段与所述栅极总线电性连接。
可选的，所述第二线段的数量为2段，一段所述第二线段与所述栅极总线的中段电性连接，另一段所述第二线段与所述栅极总线的末段电性连接。
可选的，所述第二线段与所述栅极总线垂直。
为实现上述目的，本发明还提供一种液晶显示面板，所述液晶显示面板具有如前所述的栅极驱动电路。
本发明的有益效果在于，本发明提供一种栅极驱动电路，通过在每根信号传输线的一侧新增信号反馈线，信号反馈线通过检测栅极总线中段和/或末段的时钟信号，并传输覆晶薄膜芯片产生的时钟信号至栅极总线的中段和/或末段，从而改善栅极总线中段和/或末段时钟信号的稳定性，减小栅极总线首端、中段和末段时钟信号的差异，提升面板的充电均一性，有效提升时钟信号的响应效率，减小时钟信号因阻容延迟产生的信号差异。
附图说明
下面结合附图，通过对本发明的具体实施方式详细描述，将使本发明的技术方案及其它有益效果显而易见。
图1是现有栅极驱动电路的结构示意图；
图2是现有栅极驱动电路中栅极总线内的时钟信号波形图；
图3是本发明一示例性实施例中的栅极驱动电路的结构示意图；
图4是本发明一示例性实施例中的栅极驱动电路中栅极总线内的时钟信号波形图；
图5是本发明另一示例性实施例中的栅极驱动电路的结构示意图；
图6是本发明另一示例性实施例中的栅极驱动电路的结构示意图。
图中部件编号如下：
100、栅极驱动电路，110、覆晶薄膜芯片，120、信号传输线，121、阵列走线，122、栅极总线，1221、首段，1222、中段，1223、末段，130、栅极驱动单元，140、信号反馈线，141、第一线段，142、第二线段。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
所述栅极驱动电路通过增设信号反馈线，信号反馈线一端与覆晶薄膜芯片连接，另一端与栅极总线的中段和/或末段连接，从而改善栅极总线中段和/或末段时钟信号的稳定性，减小栅极总线首端、中段和末段时钟信号的差异。作为典型应用，所述栅极驱动电路可被应用于液晶显示面板内。
参照图3，在本发明的一个实施例中，栅极驱动电路100包括覆晶薄膜芯片110、信号传输线120、栅极驱动单元130和信号反馈线140。其中，覆晶薄膜芯片110用以产生时钟信号(CK信号)，信号传输线120用以传输时钟信号，一根信号传输线120传输一路时钟信号，若干信号传输线120传输的时钟信号由CK1至CKn依次编号，n为正整数，在本实施例中，列出5根信号传输线，时钟信号依次为CK1～CK5。信号传输线120包括依次连接的阵列走线121和栅极总线122，参照图1和图3，栅极总线122依次划分为首段1221、中段1222和末段1223，一根信号传输线120对应一根信号反馈线140，信号反馈线140一端连接覆晶薄膜芯片110，另一端连接至栅极总线122的末段1223。
在本实施例中，由于栅极总线122内电阻电容的存在，导致栅极总线122内的时钟信号(例如CK1)的强度有首段1221向末段1223逐渐减小，由于信号反馈线140与末段1223连接，检测到末段1223的信号减弱，覆晶薄膜芯片110产生的时钟信号经由信号反馈线140传输反馈信号(CK_FB)至栅极总线122的末段1223，从而增强末段1223内的CK1信号的强度，减小首段1221与末段1223的CK1信号强度的差异，提升液晶显示面板的充电均一性。
其中，信号反馈线140包括依次连接的第一线段141和第二线段142，第一线段141与信号传输线120平行间隔排布，第二线段142与栅极总线122的末段1223电性连接以增强末段1223内的CK1信号。
采用现有栅极驱动电路时栅极总线内CK信号的波形图参照图2，波形图包括上升时段、水平保持段和下降时段，图2中，A为栅极总线122的首段1221的波形图，由于在于首段1221内电阻电容低，几乎没有阻容延迟(RC delay)，首段1221内的CK信号强度较高，因此首段1221对应的波形图A在上升时段和下降时段与水平保持段分别呈现直角(接近90°)；B为栅极总线122的中段1222的波形图，由于在中段1222内电阻电容升高，出现阻容延迟(RCdelay)，中段1222内CK信号变弱，因此中段1222对应的波形图B在上升时段和下降时段会出现弧度变化，上升时段内弯，下降时段外弯；C为栅极总线122的末段1223的波形图，由于末段1223内的阻容阻抗最大，阻容延迟也最大，末段1223内CK信号最弱，因此末段1223对应的波形图C在上升时段内弯弧度最大，外弯幅度亦最大，图2中，CK信号在末段1223的上升时段耗时t1为3.11μs，在下降时段耗时t2为2.967μs。
采用本发明栅极驱动电路时栅极总线内CK信号的波形图参照图4，以CK1为例(其余CK信号波形图与CK1相同)，A1为栅极总线122的首段1221的波形图，由于在于首段1221内电阻电容低，几乎没有阻容延迟(RC delay)，首段1221内的CK信号强度较高，因此首段1221对应的波形图A在上升时段和下降时段与水平保持段分别呈现直角(接近90°)；B1为栅极总线122的中段1222的波形图，由于在中段1222内电阻电容升高，出现阻容延迟(RC delay)，中段1222内CK信号变弱，因此中段1222对应的波形图B在上升时段和下降时段会出现弧度变化，上升时段内弯，下降时段外弯；C1为栅极总线122的末段1223的波形图，由于在末段1223接入了信号反馈线140并接受反馈信号(CK_FB)，增强了末段1223内的CK信号，使得CK信号在末段1223的上升时段耗时t1’下降至2.64μs，在下降时段耗时t2’下降至2.62μs。
在本发明的另一个实施例中，参照图5，一根信号传输线120对应两根信号反馈线140，两根信号反馈线140平行间隔排布，一根信号反馈线140与栅极总线122的中段1222电性连接以增强中段1222内的CK信号，另一根信号反馈线140与栅极总线122的末段1223电性连接以增强末段1223内的CK信号。在本实施例中，与栅极总线122的中段1222电性连接的信号反馈线140的长度小于与所述栅极总线122的末段1223电性连接的信号反馈线140的长度。
在本发明的另一个实施例中，参见图6，一根信号反馈线140包括第一线段141以及两根第二线段142，两根第二线段142与第一线段141并联连接，一根第二线段142与栅极总线122的中段1222电性连接以增强中段1222内的CK信号，另一根第二线段142与栅极总线122的末段1223电性连接以增强末段1223内的CK信号。其中，第二线段142与栅极总线122垂直。
以上所述仅是本发明的优选实施方式，应当指出，对于本技术领域的普通技术人员，在不脱离本发明原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (10)

1.一种栅极驱动电路，所述栅极驱动电路包括：
覆晶薄膜芯片，用以产生时钟信号；
两根以上用以传输所述时钟信号的信号传输线，一端分别与所述覆晶薄膜芯片电性连接，另一端连接分别连接一栅极驱动单元，所述信号传输线包括依次连接的阵列走线和栅极总线，所述时钟信号经由阵列走线和栅极总线传输至所述栅极驱动单元；
其特征在于，所述栅极驱动电路还包括：
两根以上信号反馈线，一根所述信号传输线对应至少一根信号反馈线，所述信号反馈线的一端与所述覆晶薄膜芯片电性连接，所述信号反馈线的另一端与所述栅极总线电性连接，所述时钟信号经由所述信号反馈线传输至栅极总线，以增强与所述信号反馈线连接处所对应的栅极总线的区段的时钟信号。
2.如权利要求1所述的栅极驱动电路，其特征在于，所述栅极总线的区段包括依次连接的首段、中段和末段，靠近所述阵列走线的所述栅极总线的区段为首段，远离所述阵列走线的所述栅极总线的区段为末段，位于所述首段与所述末段之间的所述栅极总线的区段为中段；一根所述信号反馈线与所述栅极总线的中段和/或末段电性连接。
3.如权利要求2所述的栅极驱动电路，其特征在于，一根所述信号反馈线与所述栅极总线的末段电性连接。
4.如权利要求2所述的栅极驱动电路，其特征在于，一根信号传输线对应两根所述信号反馈线，两根所述信号反馈线中，一根所述信号反馈线与所述栅极总线的中段电性连接，另一根所述信号反馈线与所述栅极总线的末段电性连接。
5.如权利要求4所述的栅极驱动电路，其特征在于，两根所述信号反馈线平行间隔排布。
6.如权利要求4所述的栅极驱动电路，其特征在于，与所述栅极总线的中段电性连接的信号反馈线的长度小于与所述栅极总线的末段电性连接的信号反馈线的长度。
7.如权利要求4所述的栅极驱动电路，其特征在于，所述信号反馈线包括依次连接的第一线段和至少一个第二线段，所述第一线段与所述信号传输线平行间隔排布，所述信号反馈线通过所述第二线段与所述栅极总线电性连接。
8.如权利要求7所述的栅极驱动电路，其特征在于，所述第二线段的数量为2段，一段所述第二线段与所述栅极总线的中段电性连接，另一段所述第二线段与所述栅极总线的末段电性连接。
9.如权利要求8所述的栅极驱动电路，其特征在于，所述第二线段与所述栅极总线垂直。
10.一种液晶显示面板，其特征在于，所述液晶显示面板具有如权利要求1～9中任一项所述的栅极驱动电路。
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