CN113192461A - 像素驱动电路、像素驱动电路的驱动方法和显示面板 - Google Patents

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Abstract

本发明公开了一种像素驱动电路、像素驱动电路的驱动方法和显示面板。像素驱动电路包括初始化模块、数据写入模块、第一驱动模块、第一存储模块、第二驱动模块、第二存储模块、发光控制模块和发光模块；初始化模块用于对第一驱动模块的控制端进行初始化，数据写入模块用于向第一驱动模块的控制端写入数据电压，第一存储模块用于维持第一驱动模块的控制端电位；发光控制模块用于将第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二存储模块用于维持第二驱动模块的控制端电位，第二驱动模块用于根据控制端的电位驱动发光模块发光。可以使发光模块一直处于发光状态，改善了显示面板的闪屏现象，提高了显示面板的显示效果。

Description

像素驱动电路、像素驱动电路的驱动方法和显示面板
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素驱动电路、像素驱动电路的驱动方法和显示面板。
背景技术
在显示面板显示的过程中，像素驱动电路驱动发光二极管发光进行显示。像素驱动电路的工作过程可以包括编程阶段和发光阶段，在编程阶段，数据电压写入像素驱动电路，此时像素驱动电路无法驱动发光二极管发光。在发光阶段，像素驱动电路根据数据电压形成的驱动电流驱动发光二极管发光。在编程阶段到发光阶段的过程中，发光二极管由不发光的状态转换为根据当前帧数据电压形成的驱动电流发光的状态。在显示面板的刷新频率比较低时，发光二极管的突然发光会使得显示面板出现闪屏现象，降低了显示面板的显示效果。
发明内容
本发明提供一种像素驱动电路、像素驱动电路的驱动方法和显示面板，以改善显示面板的闪屏现象，提高了显示面板的显示效果。
第一方面，本发明实施例提供了一种像素驱动电路，包括初始化模块、数据写入模块、第一驱动模块、第一存储模块、第二驱动模块、第二存储模块、发光控制模块和发光模块；
所述初始化模块用于对所述第一驱动模块的控制端进行初始化，所述数据写入模块用于向所述第一驱动模块的控制端写入数据电压，所述第一存储模块用于维持所述第一驱动模块的控制端电位；所述发光控制模块用于将所述第一驱动模块的控制端电位传输至所述第二驱动模块的控制端，所述第二存储模块用于维持所述第二驱动模块的控制端电位，所述第二驱动模块用于根据所述控制端的电位驱动发光模块发光。
可选地，所述发光控制模块包括第一晶体管，所述第一晶体管的栅极与发光控制信号输入端连接，所述第一晶体管的第一极与所述第一驱动模块的控制端连接，所述第二晶体管的第二极与所述第二驱动模块的控制端连接。
可选地，像素驱动电路还包括补偿模块，所述补偿模块用于对所述第一驱动模块的阈值电压进行补偿。
可选地，所述第一驱动模块包括第二晶体管，所述第二驱动模块包括第三晶体管，所述第二晶体管和所述第三晶体管的沟道宽长比相等。
可选地，所述补偿模块包括第四晶体管，所述数据写入模块包括第五晶体管；所述发光控制模块还包括第六晶体管；所述第一存储模块包括第一存储电容，所述第二存储模块包括第二存储电容；所述发光模块包括发光器件；
所述第四晶体管的栅极和所述第五晶体管的栅极与第一扫描信号输入端连接，所述第四晶体管的第一极与所述第二晶体管的第二极连接，所述第四晶体管的第二极与所述第二晶体管的栅极连接，所述第五晶体管的第一极与数据电压输入端连接，所述第五晶体管的第二极与所述第二晶体管的第一极和所述第六晶体管的第二极连接，所述第六晶体管的栅极与发光控制信号输入端连接，所述第六晶体管的第一极、所述第一存储电容的第一极、所述第二存储电容的第一极和所述第三晶体管的第一极与第一电源信号输入端连接，所述第一存储电容的第二极与所述第二晶体管的栅极和所述第一晶体管的第一极连接，所述第二存储电容的第二极与所述第三晶体管的栅极和所述第一晶体管的第二极连接，所述第三晶体管的第二极与所述发光器件的阳极连接，所述发光器件的阴极与第二电源信号输入端连接。
可选地，所述初始化模块包括第七晶体管；所述第七晶体管的栅极与第零扫描信号输入端连接，所述第七晶体管的第一极与参考信号输入端连接，所述第七晶体管的第二极与所述第二晶体管的栅极连接。
可选地，像素驱动电路还包括第八晶体管；所述第八晶体管的栅极与第二扫描信号输入端连接，所述第四晶体管的第二极和所述第七晶体管的第二极通过所述第八晶体管与所述第二晶体管的栅极连接。
可选地，所述第八晶体管为铟镓锌氧化物晶体管。
第二方面，本发明实施例还提供了一种像素驱动电路的驱动方法，用于驱动第一方面任意实施例提供的像素驱动电路；包括：
初始化阶段，初始化模块对第一驱动模块的控制端进行初始化；
数据写入阶段，数据写入模块向所述第一驱动模块的控制端写入数据电压，第一存储模块维持所述第一驱动模块的控制端电位；
发光阶段，发光控制模块将所述第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二存储模块维持所述第二驱动模块的控制端电位，所述第二驱动模块根据所述控制端的电位驱动发光模块发光。
第三方面，本发明实施例还提供了一种显示面板，包括第一方面任意实施例提供的像素驱动电路。
本发明实施例的技术方案，通过在数据写入阶段数据写入模块向第一驱动模块的控制端写入数据电压，在发光阶段发光控制模块将第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二驱动模块根据控制端的电位驱动发光模块发光。且在下一帧的发光阶段之前，第二驱动模块的控制端电位一直维持为当前电位，使得发光模块保持发光状态。因此在下一帧的数据写入阶段，发光模块一直处于发光状态，改善了发光模块由不发光状态转换为发光状态时出现的闪屏现象，提高了显示面板的显示效果。
附图说明
图1为现有技术提供的一种像素驱动电路的结构示意图；
图2为本发明实施例提供的一种像素驱动电路的结构示意图；
图3为本发明实施例提供的另一种像素驱动电路的结构示意图；
图4为本发明实施例提供的另一种像素驱动电路的结构示意图；
图5为本发明实施例提供的另一种像素驱动电路的结构示意图；
图6为本发明实施例提供的另一种像素驱动电路的结构示意图；
图7为本发明实施例提供的另一种像素驱动电路的结构示意图；
图8为图7提供的像素驱动电路对应的一种时序图；
图9为本发明实施例提供的另一种像素驱动电路的结构示意图；
图10为图9提供的像素驱动电路对应的一种时序图；
图11为本发明实施例提供的一种像素驱动电路的驱动方法的流程示意图；
图12为本发明实施例提供的一种显示面板的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1为现有技术提供的一种像素驱动电路的结构示意图。如图1所示，该像素驱动电路包括驱动晶体管N0、数据写入晶体管M0、补偿晶体管M1、第一发光控制晶体管M2、第二发光控制晶体管M3和存储电容Cs。数据写入晶体管M0的栅极和补偿晶体管M1的栅极连接第一扫描线Scan1以接收第一扫描信号，源极连接到数据线以接收数据电压Vdata，漏极连接到驱动晶体管N0的源极和第一发光控制晶体管M2的漏极。驱动晶体管N0的栅极与存储电容Cs的一端和补偿晶体管M1的源极电连接，漏极与第二发光控制晶体管M3的源极和补偿晶体管M1的漏极连接，第一发光控制晶体管M2和第二发光控制晶体管M3的栅极连接至发光控制信号线以接收发光控制信号Em，第一发光控制晶体管M2的源极接收第一电源信号Vdd，第二发光控制晶体管M3的漏极连接到发光二极管OLED的正极端，发光二极管OLED的负极端接收第二电源信号Vss。当第一扫描信号控制数据写入晶体管M0和补偿晶体管M1导通，发光控制信号Em控制第一发光控制晶体管M2和第二发光控制晶体管M3截止时，数据电压Vdata通过数据写入晶体管M0、驱动晶体管N0和补偿晶体管M1对存储电容Cs充电，由此将数据电压Vdata与驱动晶体管N0的阈值电压的之和存储在存储电容Cs中，实现驱动晶体管N0的阈值补偿。此时发光二极管OLED不发光。在发光阶段，发光控制信号Em控制第一发光控制晶体管M2和第二发光控制晶体管M3导通，驱动晶体管N0的源极电位由数据电压Vdata变为第一电源信号Vdd，驱动晶体管N0导通，驱动晶体管N0根据数据电压Vdata和第一电源信号Vdd形成驱动电流，该驱动电流通过第二发光控制晶体管M3传输至发光二极管OLED，使发光二极管OLED根据驱动电流发光。在像素驱动电路工作过程中，由数据写入阶段到发光阶段，发光二极管由不发光的状态转换为根据当前帧数据电压形成的驱动电流发光的状态，容易使显示面板出现闪屏现象，降低了显示面板的显示效果。当显示面板的刷新频率比较低时，发光二极管OLED由不发光状态转换为发光状态更加明显，显示面板的闪屏现象比较严重，进一步地降低了显示面板的显示效果。
针对上述技术问题，本发明实施例提供了一种像素驱动电路。图2为本发明实施例提供的一种像素驱动电路的结构示意图。如图2所示，该像素驱动电路包括初始化模块00、数据写入模块10、第一驱动模块20、第一存储模块30、第二驱动模块40、第二存储模块50、发光控制模块60和发光模块70；初始化模块00用于对第一驱动模块20的控制端进行初始化，数据写入模块10用于向第一驱动模块20的控制端写入数据电压，第一存储模块30用于维持第一驱动模块20的控制端电位；发光控制模块60用于将第一驱动模块20的控制端电位传输至第二驱动模块40的控制端，第二存储模块50用于维持第二驱动模块40的控制端电位，第二驱动模块40用于根据控制端的电位驱动发光模块70发光。
具体地，如图2所示，初始化模块00与第一驱动模块20的控制端连接，用于在数据写入阶段之前的初始化阶段将参考信号输入端VREF提供的参考信号传输至第一驱动模块20的控制端，对第一驱动模块20的控制端进行初始化，使得第一驱动模块20处于导通状态。第二驱动模块40的第一端与第一电源信号输入端VDD连接，第二驱动模块40的第二端与发光模块70连接，第二驱动模块40的控制端通过发光控制模块60与第一驱动模块20的控制端连接，第二存储模块50与第二驱动模块40的控制端连接，第一存储模块30与第一驱动模块20的控制端连接，数据写入模块10与第一驱动模块20连接，数据写入模块10用于在数据写入阶段为第一驱动模块20提供数据电压。在像素驱动电路的工作过程中，在当前帧的数据写入阶段，数据写入模块10提供的数据电压通过第一驱动模块20写入至第一驱动模块20的控制端，第一存储模块30存储并维持第一驱动模块20的控制端电位。在当前帧的发光阶段，发光控制模块60连通第一驱动模块20的控制端和第二驱动模块40的控制端，使第一驱动模块20的控制端电位传输至第二驱动模块40的控制端，第二存储模块50存储并维持第二驱动模块40的控制端电位。且第二驱动模块40的第一端为第一电源信号输入端VDD提供的第一电源信号，则第二驱动模块40可以根据当前帧的数据写入阶段第一驱动模块20的控制端写入的数据电压以及第一电源信号形成驱动电流，并输出至发光模块70，驱动发光模块70发光。由于第二存储模块50存储并维持第二驱动模块40的控制端电位，在下一帧的发光阶段之前，第二驱动模块40的控制端电位一直维持为当前电位，使得发光模块70保持发光状态。在下一帧的数据写入阶段，第一驱动模块20的控制端写入下一帧的数据电压，在下一帧的发光阶段，发光控制模块60连通第一驱动模块20的控制端和第二驱动模块40的控制端，使第一驱动模块20的控制端电位传输至第二驱动模块40的控制端，第二驱动模块40的控制端电位发生变化，第二驱动模块40根据下一帧的数据电压以及第一电源信号形成新的驱动电流，并输出至发光模块70，驱动发光模块70发光。由此可知，在下一帧的数据写入阶段，发光模块70一直处于发光状态，改善了发光模块70由不发光状态转换为发光状态时出现的闪屏现象，提高了显示面板的显示效果。
图3为本发明实施例提供的另一种像素驱动电路的结构示意图。如图3所示，发光控制模块60包括第一晶体管T1，第一晶体管T1的栅极与发光控制信号输入端EM连接，第一晶体管T1的第一极与第一驱动模块20的控制端连接，第二晶体管T1的第二极与第二驱动模块40的控制端连接。
具体地，图3中示例性地示出了第一晶体管T1为P型晶体管。在发光阶段，发光控制信号输入端EM提供的发光控制信号为低电平，控制第一晶体管T1导通，第一驱动模块20的控制端电位可以通过第一晶体管T1传输至第二驱动模块40的控制端，第二驱动模块40根据控制端电位和第一电源信号形成驱动电流，驱动发光模块70发光。
图4为本发明实施例提供的另一种像素驱动电路的结构示意图。如图4所示，像素驱动电路还包括补偿模块80，补偿模块80用于对第一驱动模块20的阈值电压进行补偿。
具体地，数据写入模块10的控制端和补偿模块80的控制端与第一扫描信号输入端S1连接，数据写入模块10的第一端与数据电压输入端VDATA连接，数据写入模块10的第二端与第一驱动模块20的第一端连接，补偿模块80的第一端与第一驱动模块20的第二端连接，补偿模块80的第二端与第一驱动模块20的控制端连接。在数据写入阶段之前的初始化阶段，初始化模块00将参考信号输入端VREF提供的参考信号传输至第一驱动模块20的控制端，对第一驱动模块20的控制端进行初始化，使得第一驱动模块20处于导通状态。在数据写入阶段，第一扫描信号输入端S1提供的第一扫描信号控制数据写入模块10和补偿模块80导通，数据电压输入端VDATA提供的数据电压通过数据写入模块10、第一驱动模块20和补偿模块80写入第一驱动模块20的控制端，实现了第一驱动模块20的阈值电压补偿以及数据电压的写入，从而避免了第一驱动模块20的阈值电压对驱动电流的影响，提高了不同像素驱动电路中发光模块70的发光均一性。
图5为本发明实施例提供的另一种像素驱动电路的结构示意图。如图5所示，第一驱动模块20包括第二晶体管T2，第二驱动模块40包括第三晶体管T3，第二晶体管T2和第三晶体管T3的沟道宽长比相等。
具体地，图5中示例性地示出了第二晶体管T2和第三晶体管T3为P型晶体管。第二晶体管T2的栅极作为第一驱动模块20的控制端，第二晶体管T2的第一极作为第一驱动模块20的第一端，第二晶体管T2的第二极作为第一驱动模块20的第二端。第三晶体管T3的栅极作为第二驱动模块40的控制端，第三晶体管T3的第一极作为第二驱动模块40的第一端，第三晶体管T3的第二极作为第二驱动模块40的第二端。在数据写入阶段，补偿模块80对第二晶体管T2的阈值电压进行补偿，第二晶体管T2的栅极电位为数据电压与第二晶体管T2的阈值电压之和。在发光阶段，第二晶体管T2的栅极电位通过第一晶体管T1传输至第三晶体管T3，此时第三晶体管T3的栅极电位仍为数据电压与第二晶体管T2的阈值电压之和。通过设置第二晶体管T2和第三晶体管T3的沟道宽长比相等，使得第二晶体管T2的阈值电压与第三晶体管T3的阈值电压相等，在第三晶体管T3根据栅极电位和第一极的第一电源信号形成驱动电流时，可以使得第三晶体管T3的阈值电压与第二晶体管T2的阈值电压抵消，从而实现数据写入阶段对第三晶体管T3的阈值电压进行补偿，提高了不同像素驱动电路中发光模块70的发光均一性。
图6为本发明实施例提供的另一种像素驱动电路的结构示意图。如图6所示，补偿模块80包括第四晶体管T4，数据写入模块10包括第五晶体管T5；发光控制模块60还包括第六晶体管T6；第一存储模块30包括第一存储电容C1，第二存储模块50包括第二存储电容C2；发光模块70包括发光器件D1；第四晶体管T4的栅极和第五晶体管T5的栅极与第一扫描信号输入端S1连接，第四晶体管T4的第一极与第二晶体管T2的第二极连接，第四晶体管T4的第二极与第二晶体管T2的栅极连接，第五晶体管T5的第一极与数据电压输入端VDATA连接，第五晶体管T5的第二极与第二晶体管T2的第一极和第六晶体管T6的第二极连接，第六晶体管T6的栅极与发光控制信号输入端EM连接，第六晶体管T6的第一极、第一存储电容C1的第一极、第二存储电容C2的第一极和第三晶体管T3的第一极与第一电源信号输入端VDD连接，第一存储电容C1的第二极与第二晶体管T2的栅极和第一晶体管T1的第一极连接，第二存储电容C2的第二极与第三晶体管T3的栅极和第一晶体管T1的第二极连接，第三晶体管T3的第二极与发光器件D1的阳极连接，发光器件D1的阴极与第二电源信号输入端VSS连接。
具体地，图6中示例性地示出了第四晶体管T4、第五晶体管T5和第六晶体管T6为P型晶体管。在数据写入阶段之前，可以对第二晶体管T2进行初始化，使得第二晶体管T2处于导通状态。第四晶体管T4的栅极和第五晶体管T5的栅极与第一扫描信号输入端S1连接，在初始化阶段，初始化模块00将参考信号输入端VREF提供的参考信号传输至第一驱动模块20的控制端，对第一驱动模块20的控制端进行初始化，使得第一驱动模块20处于导通状态。在数据写入阶段，第一扫描信号输入端S1提供的第一扫描信号控制第四晶体管T4和第五晶体管T5导通，数据电压输入端VDATA提供的数据电压通过第五晶体管T5、第二晶体管T2和第四晶体管T4写至第二晶体管T2的栅极，第一存储电容C1存储并维持该电位，实现了数据电压写入和第二晶体管T2的阈值补偿。此时第二晶体管T2的栅极电位为数据电压vdata和第二晶体管T2的阈值电压vth1之和。在发光阶段，发光控制信号输入端EM提供的发光控制信号控制第一晶体管T1和第六晶体管T6导通，第二晶体管T2的栅极电位通过第一晶体管T1传输至第三晶体管T3的栅极，第二存储电容C2存储并维持该电位，第三晶体管T3根据栅极电位和第一极的电位形成驱动电流，驱动电流与(Vg-Vs-vth2)2＝(vdata+vth1-vdd-vth2)2成正比，其中，Vg为第三晶体管T3的栅极电位，Vs为第三晶体管T3的第一极电位，vth2为第三晶体管T3的阈值电压。当第二晶体管T2的沟道宽长比与第三晶体管T3的沟道宽长比相等时，第二晶体管T2的阈值电压vth1与第三晶体管T3的阈值电压vth2相等，此时驱动电流与(vdata-vdd)2成正比，从而可以使得驱动电流与第三晶体管T3的阈值电压无关，实现像素驱动电路的阈值补偿。另外，第三晶体管T3的第一极与第一电源信号输入端VDD连接，第三晶体管T3在第一电源信号的作用下长期偏置。在发光阶段，第六晶体管T6导通，使得第一电源信号通过第六晶体管T6传输至第二晶体管T2的第一极，使得第一电源信号对第二晶体管T2进行偏置，提高了第二晶体管T2和第三晶体管T3的偏置一致性，进而可以提高第二晶体管T2和第三晶体管T3的阈值电压的一致性，保证了不同的像素驱动电路的阈值补偿效果的一致性，提高了不同像素驱动电路中发光器件D1的发光均一性。
图7为本发明实施例提供的另一种像素驱动电路的结构示意图。如图7所示，初始化模块00包括第七晶体管T7；第七晶体管T7的栅极与第零扫描信号输入端S0连接，第七晶体管T7的第一极与参考信号输入端VREF连接，第七晶体管T7的第二极与第二晶体管T2的栅极连接。
具体地，图7中示例性地示出了第七晶体管T7为P型晶体管。像素驱动电路的工作过程还可以包括初始化阶段。在初始化阶段，第零扫描信号输入端S0提供的第零扫描信号控制第七晶体管T7导通，参考信号输入端VREF提供的参考信号通过第七晶体管T7传输至第二晶体管T2的栅极，对第二晶体管T2的栅极进行初始化，使第二晶体管T2处于导通状态。
图8为图7提供的像素驱动电路对应的一种时序图。其中，s0为第零扫描信号的时序，s1为第一扫描信号的时序，em为发光控制信号的时序。结合图7和图8说明像素驱动电路的工作原理。
在初始化阶段t11，s0为低电平，s1为高电平，em为高电平，第零扫描信号控制第七晶体管T7导通，第一扫描信号控制第四晶体管T4和第五晶体管T5截止，发光控制信号控制第一晶体管T1和第六晶体管T6截止，参考电压信号通过第七晶体管T7传输至第二晶体管T2的栅极，对第二晶体管T2的栅极进行初始化，使第二晶体管T2处于导通状态。同时第三晶体管T3的栅极维持上一帧发光阶段写入的数据电压与第二晶体管T2的阈值电压之和，第三晶体管T3根据栅极电位和第一电源信号形成驱动电流，驱动发光器件D1发光。此时发光器件D1的发光亮度与上一帧的数据电压相关。
在数据写入阶段t12，s0为高电平，s1为低电平，em为高电平，第零扫描信号控制第七晶体管T7截止，第一扫描信号控制第四晶体管T4和第五晶体管T5导通，发光控制信号控制第一晶体管T1和第六晶体管T6截止，数据电压输入端VDATA提供的数据电压通过第五晶体管T5、第二晶体管T2和第四晶体管T4传输至第二晶体管T2的栅极，实现了第二晶体管T2的阈值电压补偿以及数据电压写入。此时第二晶体管T2的栅极电位为数据电压vdata和第二晶体管T2的阈值电压vth1之和。
在发光阶段t13，s0为高电平，s1为高电平，em为低电平，第零扫描信号控制第七晶体管T7截止，第一扫描信号控制第四晶体管T4和第五晶体管T5截止，发光控制信号控制第一晶体管T1和第六晶体管T6导通，第二晶体管T2的栅极电位通过第一晶体管T1传输至第三晶体管T3的栅极，第二存储电容C2存储并维持该电位，第三晶体管T3根据栅极电位和第一极的电位形成驱动电流，驱动电流与(Vg-Vs-vth2)2＝(vdata+vth1-vdd-vth2)2成正比，其中，Vg为第三晶体管T3的栅极电位，Vs为第三晶体管T3的第一极电位，vth2为第三晶体管T3的阈值电压，vdata为数据电压，vdd为第一电源信号的电压，vth1为第二晶体管T2的阈值电压。当第二晶体管T2的沟道宽长比与第三晶体管T3的沟道宽长比相等时，第二晶体管T2的阈值电压vth1与第三晶体管T3的阈值电压vth2相等，此时驱动电流与(vdata–vdd)2成正比，从而可以使得驱动电流与第三晶体管T3的阈值电压无关，实现像素驱动电路的阈值补偿，发光器件D1根据驱动电流发光。由于第二存储电容C2维持第三晶体管T3的栅极电位，在发光控制信号控制第一晶体管T1截止后，第三晶体管T3仍然能够根据栅极电位和第一电源信号形成驱动电流，驱动发光器件D1发光，直至在下一帧的发光阶段，发光控制信号再次控制第一晶体管T1导通后，第三晶体管T3的栅极再次写入第二晶体管T2的栅极电位，第三晶体管T3根据栅极更新后的电位和第一电源信号形成驱动电流，驱动发光器件D1发光。由此可知，在数据写入阶段和发光阶段，发光器件D1一直处于发光状态，改善了发光器件D1由不发光状态转换为发光状态时出现的闪屏现象，提高了显示面板的显示效果。
同时，第六晶体管T6导通，使得第一电源信号通过第六晶体管T6传输至第二晶体管T2的第一极，使得第一电源信号对第二晶体管T2进行偏置，提高了第二晶体管T2和第三晶体管T3的偏置一致性，进而可以提高第二晶体管T2和第三晶体管T3的阈值电压的一致性，保证了不同的像素驱动电路的阈值补偿效果的一致性，提高了不同像素驱动电路中发光器件D1的发光均一性。
图9为本发明实施例提供的另一种像素驱动电路的结构示意图。如图9所示，像素驱动电路还包括第八晶体管T8；第八晶体管T8的栅极与第二扫描信号输入端S2连接，第四晶体管T4的第二极和第七晶体管T7的第二极通过第八晶体管T8与第二晶体管T2的栅极连接。
具体地，图9中示例性地示出了第八晶体管T8为P型晶体管。当第二扫描信号输入端S2提供的第二扫描信号为低电平时，控制第八晶体管T8导通，使第四晶体管T4的第二极和第二晶体管T2的栅极之间以及第七晶体管T7的第二极和第二晶体管T2的栅极之间短路。在发光阶段，第二扫描信号为高电平，控制第八晶体管T8截止，可以使第四晶体管T4的第二极和第二晶体管T2的栅极之间以及第七晶体管T7的第二极和第二晶体管T2的栅极之间断路，从而隔断第二晶体管T2的栅极电位和第三晶体管T3的栅极电位由第四晶体管T4和第七晶体管T7漏流的通路，改善了第二晶体管T2的栅极电位和第三晶体管T3的栅极电位的维持效果，有利于提高显示面板的显示均一性。
可选地，第八晶体管T8为铟镓锌氧化物晶体管。铟镓锌氧化物晶体管的漏流很小，可以进一步地隔断第二晶体管T2的栅极电位和第三晶体管T3的栅极电位由第四晶体管T4和第七晶体管T7漏流的通路，进一步地改善显示面板在低刷新频率下的闪屏现象。
图10为图9提供的像素驱动电路对应的一种时序图。其中，s0为第零扫描信号的时序，s1为第一扫描信号的时序，s2为第二扫描信号的时序，em为发光控制信号的时序。结合图9和图10说明像素驱动电路的工作原理。
在初始化阶段t21，s0为低电平，s1为高电平，s2为低电平，em为高电平，第零扫描信号控制第七晶体管T7导通，第一扫描信号控制第四晶体管T4和第五晶体管T5截止，第二扫描信号控制第八晶体管T8导通，发光控制信号控制第一晶体管T1和第六晶体管T6截止，参考电压信号通过第七晶体管T7和第八晶体管T8传输至第二晶体管T2的栅极，对第二晶体管T2的栅极进行初始化，使第二晶体管T2处于导通状态。同时第三晶体管T3的栅极维持上一帧发光阶段写入的数据电压与第二晶体管T2的阈值电压之和，第三晶体管T3根据栅极电位和第一电源信号形成驱动电流，驱动发光器件D1发光。此时发光器件D1的发光亮度与上一帧的数据电压相关。
在数据写入阶段t22，s0为高电平，s1为低电平，s2为低电平，em为高电平，第零扫描信号控制第七晶体管T7截止，第一扫描信号控制第四晶体管T4和第五晶体管T5导通，第二扫描信号控制第八晶体管T8导通，发光控制信号控制第一晶体管T1和第六晶体管T6截止，数据电压输入端VDATA提供的数据电压通过第五晶体管T5、第二晶体管T2、第四晶体管T4和第八晶体管T8传输至第二晶体管T2的栅极，实现了第二晶体管T2的阈值电压补偿以及数据电压写入。此时第二晶体管T2的栅极电位为数据电压vdata和第二晶体管T2的阈值电压vth1之和。
在发光阶段t23，s0为高电平，s1为高电平，s2为高电平，em为低电平，第零扫描信号控制第七晶体管T7截止，第一扫描信号控制第四晶体管T4和第五晶体管T5截止，第二扫描信号控制第八晶体管T8截止，发光控制信号控制第一晶体管T1和第六晶体管T6导通，第二晶体管T2的栅极电位通过第一晶体管T1传输至第三晶体管T3的栅极，第二存储电容C2存储并维持该电位，第三晶体管T3根据栅极电位和第一极的电位形成驱动电流，驱动电流与(Vg-Vs-vth2)2＝(vdata+vth1-vdd-vth2)2成正比，其中，Vg为第三晶体管T3的栅极电位，Vs为第三晶体管T3的第一极电位，vth2为第三晶体管T3的阈值电压，vdata为数据电压，vdd为第一电源信号的电压，vth1为第二晶体管T2的阈值电压。当第二晶体管T2的沟道宽长比与第三晶体管T3的沟道宽长比相等时，第二晶体管T2的阈值电压vth1与第三晶体管T3的阈值电压vth2相等，此时驱动电流与(vdata–vdd)2成正比，从而可以使得驱动电流与第三晶体管T3的阈值电压无关，实现像素驱动电路的阈值补偿，发光器件D1根据驱动电流发光。由于第二存储电容C2维持第三晶体管T3的栅极电位，在发光控制信号控制第一晶体管T1截止后，第三晶体管T3仍然能够根据栅极电位和第一电源信号形成驱动电流，驱动发光器件D1发光，直至在下一帧的发光阶段，发光控制信号再次控制第一晶体管T1导通后，第三晶体管T3的栅极再次写入第二晶体管T2的栅极电位，第三晶体管T3根据栅极更新后的电位和第一电源信号形成驱动电流，驱动发光器件D1发光。由此可知，在数据写入阶段和发光阶段，发光器件D1一直处于发光状态，改善了发光器件D1由不发光状态转换为发光状态时出现的闪屏现象，提高了显示面板的显示效果。而且，第八晶体管T8可以使第四晶体管T4的第二极和第二晶体管T2的栅极之间以及第七晶体管T7的第二极和第二晶体管T2的栅极之间断路，从而隔断第二晶体管T2的栅极电位和第三晶体管T3的栅极电位由第四晶体管T4和第七晶体管T7漏流的通路，改善了第二晶体管T2的栅极电位和第三晶体管T3的栅极电位的维持效果，有利于提高显示面板的显示均一性。
同时，第六晶体管T6导通，使得第一电源信号通过第六晶体管T6传输至第二晶体管T2的第一极，使得第一电源信号对第二晶体管T2进行偏置，提高了第二晶体管T2和第三晶体管T3的偏置一致性，进而可以提高第二晶体管T2和第三晶体管T3的阈值电压的一致性，保证了不同的像素驱动电路的阈值补偿效果的一致性，提高了不同像素驱动电路中发光器件D1的发光均一性。
本发明实施例还提供一种像素驱动电路的驱动方法，用于驱动本发明任意实施例提供的像素驱动电路。图11为本发明实施例提供的一种像素驱动电路的驱动方法的流程示意图。如图11所示，该像素驱动电路的驱动方法包括：
S110、初始化阶段，初始化模块对第一驱动模块的控制端进行初始化；
S120、数据写入阶段，数据写入模块向第一驱动模块的控制端写入数据电压，第一存储模块维持第一驱动模块的控制端电位；
S130、发光阶段，发光控制模块将第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二存储模块维持第二驱动模块的控制端电位，第二驱动模块根据控制端的电位驱动发光模块发光。
本发明实施例的技术方案，通过在数据写入阶段数据写入模块向第一驱动模块的控制端写入数据电压，在发光阶段发光控制模块将第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二驱动模块根据控制端的电位驱动发光模块发光。且在下一帧的发光阶段之前，第二驱动模块的控制端电位一直维持为当前电位，使得发光模块保持发光状态。由此可知，在数据写入阶段进入发光阶段时，发光模块一直处于发光状态，改善了发光模块由不发光状态转换为发光状态时出现的闪屏现象，提高了显示面板的显示效果。
本发明实施例还提供一种显示面板。图12为本发明实施例提供的一种显示面板的结构示意图。如图12所示，该显示面板100包括本发明任意实施例提供的像素驱动电路101。
具体地，像素驱动电路101为本发明任意实施例提供的像素驱动电路，因此具备本发明任意实施例提供像素驱动电路相同的有益效果，此处不再赘述。显示面板可以是手机、平板电脑、电视机、显示器、笔记本电脑、数码相框等任何具有显示功能的产品或部件。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素驱动电路，其特征在于，包括初始化模块、数据写入模块、第一驱动模块、第一存储模块、第二驱动模块、第二存储模块、发光控制模块和发光模块；
所述初始化模块用于对所述第一驱动模块的控制端进行初始化，所述数据写入模块用于向所述第一驱动模块的控制端写入数据电压，所述第一存储模块用于维持所述第一驱动模块的控制端电位；所述发光控制模块用于将所述第一驱动模块的控制端电位传输至所述第二驱动模块的控制端，所述第二存储模块用于维持所述第二驱动模块的控制端电位，所述第二驱动模块用于根据所述控制端的电位驱动发光模块发光。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述发光控制模块包括第一晶体管，所述第一晶体管的栅极与发光控制信号输入端连接，所述第一晶体管的第一极与所述第一驱动模块的控制端连接，所述第二晶体管的第二极与所述第二驱动模块的控制端连接。
3.根据权利要求1或2所述的像素驱动电路，其特征在于，还包括补偿模块，所述补偿模块用于对所述第一驱动模块的阈值电压进行补偿。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述第一驱动模块包括第二晶体管，所述第二驱动模块包括第三晶体管，所述第二晶体管和所述第三晶体管的沟道宽长比相等。
5.根据权利要求4所述的像素驱动电路，其特征在于，所述补偿模块包括第四晶体管，所述数据写入模块包括第五晶体管；所述发光控制模块还包括第六晶体管；所述第一存储模块包括第一存储电容，所述第二存储模块包括第二存储电容；所述发光模块包括发光器件；
所述第四晶体管的栅极和所述第五晶体管的栅极与第一扫描信号输入端连接，所述第四晶体管的第一极与所述第二晶体管的第二极连接，所述第四晶体管的第二极与所述第二晶体管的栅极连接，所述第五晶体管的第一极与数据电压输入端连接，所述第五晶体管的第二极与所述第二晶体管的第一极和所述第六晶体管的第二极连接，所述第六晶体管的栅极与发光控制信号输入端连接，所述第六晶体管的第一极、所述第一存储电容的第一极、所述第二存储电容的第一极和所述第三晶体管的第一极与第一电源信号输入端连接，所述第一存储电容的第二极与所述第二晶体管的栅极和所述第一晶体管的第一极连接，所述第二存储电容的第二极与所述第三晶体管的栅极和所述第一晶体管的第二极连接，所述第三晶体管的第二极与所述发光器件的阳极连接，所述发光器件的阴极与第二电源信号输入端连接。
6.根据权利要求5所述的像素驱动电路，其特征在于，所述初始化模块包括第七晶体管；所述第七晶体管的栅极与第零扫描信号输入端连接，所述第七晶体管的第一极与参考信号输入端连接，所述第七晶体管的第二极与所述第二晶体管的栅极连接。
7.根据权利要求6所述的像素驱动电路，其特征在于，还包括第八晶体管；所述第八晶体管的栅极与第二扫描信号输入端连接，所述第四晶体管的第二极和所述第七晶体管的第二极通过所述第八晶体管与所述第二晶体管的栅极连接。
8.根据权利要求7所述的像素驱动电路，其特征在于，所述第八晶体管为铟镓锌氧化物晶体管。
9.一种像素驱动电路的驱动方法，用于驱动权利要求1-8任一项所述的像素驱动电路；其特征在于，包括：
初始化阶段，初始化模块对第一驱动模块的控制端进行初始化；
数据写入阶段，数据写入模块向所述第一驱动模块的控制端写入数据电压，第一存储模块维持所述第一驱动模块的控制端电位；
发光阶段，发光控制模块将所述第一驱动模块的控制端电位传输至第二驱动模块的控制端，第二存储模块维持所述第二驱动模块的控制端电位，所述第二驱动模块根据所述控制端的电位驱动发光模块发光。
10.一种显示面板，其特征在于，包括权利要求1-8任一项所述的像素驱动电路。
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