CN113162418B - 一种自适应的准谐振检测电路及方法 - Google Patents

一种自适应的准谐振检测电路及方法 Download PDF

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Abstract

本发明提供一种自适应准谐振检测电路和方法，通过检测开关节点电压的谐振周期，自适应地判断出理论上的波峰位置；通过对主控芯片钳位管驱动信号下降沿到开关节点电压膝点的时间差检测，自适应地采样出半桥驱动芯片的驱动延时；通过在理论上的波峰位置提前一个驱动延时的时间实现钳位管的准确波峰开通。从而，使得非互补有源钳位反激变换器的开关损耗大大降低，变压器反向励磁的电流一致性大大提高。

Description

一种自适应的准谐振检测电路及方法
技术领域
本发明涉及有源钳位反激变换器设计领域，特别涉及非互补有源钳位反激变换器中钳位管的波谷开通控制方法及自适应的准谐振检测电路。
背景技术
反激变换器拓扑因其结构简单、成本较低，被广泛地应用于隔离型功率变换器中。然而，随着市场对变换器小型化、高功率密度的要求，传统的反激变换器拓扑已经难以满足需求。有源钳位反激变换器上世纪80年代被提出，但由于工艺成本的考虑，一直未进入真正的产品化阶段。现在，随着第三代半导体功率器件及小型变压器的工艺成熟，有源钳位反激变换器迅速走向市场。
如图1，为典型的有源钳位反激变换器拓扑。增加钳位管Q2、钳位电容CA，替换常规RCD吸收网络，既可消除变压器T在消磁阶段由漏感LK产生的高频、高幅值谐振尖峰，优化EMI；又可以将漏感的能量储存在钳位电容中，于钳位管导通的后半段将此能量泄放，通过变压器原边绕组电感LM回收到输入端母线电容中，消除RCD吸收网络的损耗；同时，通过主控芯片10控制主功率管Q1在钳位管Q2关断后隔一个死区时间再开通，实现主功率管Q1的软开关(ZVS，Zero Voltage Switch)，减小了主功率管Q1的开关损耗及开关节点电容放电的损耗。
以上，为常规的工作于互补模式的有源钳位反激变换器工作原理，所谓互补模式是指主功率管Q1的驱动信号GL和钳位管Q2的驱动信号GH互补输出，只间隔很小的死区时间。相比于互补模式，非互补的工作模式在小功率等级更有优势，也更好控制。如图2，为非互补模式典型的关键信号波形图。VDS为开关节点(即主功率管Q1的漏极)电压波形，VC-VDS为钳位管Q2漏源极电压差波形，ILM为变压器原边电感LM的电流波形，DH为主控芯片输出至半桥驱动芯片(见图1中20模块)输入端的钳位管Q2的驱动信号波形，GH为DH经过半桥驱动芯片输出到钳位管Q2栅极的实际驱动信号波形，GL为主控芯片10输出到主功率管Q1栅极的驱动信号波形。由于钳位管Q2的源极电压为浮动电平，且电压很高，所以一般需要专用的半桥驱动芯片20将驱动电平上举至浮动电平实现钳位管Q2的有效驱动。从图2波形上可以看出，经过半桥驱动芯片20，主控芯片10输出的钳位管驱动信号DH和实际的驱动信号GH之间发生延时，如图中TDR和TDF所示。其中，TDR表示上升沿延时，TDF表示下降沿延时。图中示出三个开关周期，每个周期的钳位管Q2开通时刻都不同；第二个周期中，钳位管Q2在其漏源极电压差谐振至谷底的时刻开通，开关损耗最小，电应力也最小。
为了使得变换器的整体效率最优化，应该检测出主功率管Q1的开关节点电压谐振至波峰的时刻(对应钳位管Q2漏源极电压差的波谷)，输出钳位管实际驱动信号GH。关于钳位管Q2漏源极谐振电压的波谷检测的技术，业内公开的专利较多，主要分为三种：①直接或间接检测VDS电压，设置阈值，在VDS电压经过阈值之后延时一小段固定时间，作为波谷时刻；②直接或间接检测VDS电压的变化斜率，在斜率由正转负时判断为波谷时刻；③检测出谐振电压的周期特性，在此基础上自适应地计算出波谷时刻。其中，第二、第三种方案检测精度高，不受变换器谐振参数变化的影响。但是，不管上述哪种方案，应用在非互补有源钳位反激变换器中，都无法将上述半桥驱动芯片造成的延时消除掉。即便主控芯片10检测VDS的波峰位置十分准确，经过驱动延时之后，钳位管Q2的开通位置都滞后于波峰位置。市面上常见的半桥驱动芯片延时达到150nS左右，对于高频化的非互补有源钳位反激变换器而言，典型VDS谐振周期为600nS左右，所以钳位管Q2实际的开通时刻都在VDS的1/4个谐振周期左右。
发明内容
鉴于现有技术中，尚没有实现非互补有源钳位反激变换器中，钳位管准确地波峰(针对VDS而言)开通的合适方案，本发明的目的是，提供一种自适应的准谐振检测电路和方法，以适应不同的应用环境，排除半桥驱动芯片延时造成的影响。
本发明提供一种用于有源钳位反激变换器中的钳位管的开通控制方法，其包括：
检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻；
采样主控芯片输出的钳位管驱动信号，并根据钳位管驱动信号，获取半桥驱动芯片驱动延时的时间；
通过在所述理论上的波峰出现时刻提前一个驱动延时的时间开通钳位管，以实现钳位管恰好在开关节点电压波峰出现时开通。
优选的，检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻，包括：
检测所述开关节点电压达到与输入电压相同的两个连续时间点之间间隔的时长，来获得1/2个谐振周期时长；
根据所述1/2个谐振周期时长判断出3/4个谐振周期的时长；
以每个谐振周期的1/4处为起点时刻，延后所述3/4个谐振周期时长对应的时刻确定为所述开关节点电压理论上的波峰出现时刻。
优选的，根据主控芯片输出的钳位管驱动信号，获取所述半桥驱动芯片驱动延时的时间，包括：
通过检测主控芯片输出的钳位管驱动信号的下降沿产生时刻与所述开关节点的电压膝点产生时刻的时间差，来获取相对于所述主控芯片输出的钳位管驱动信号到所述半桥驱动芯片输出的驱动信号的延时时间，其中，电压膝点产生时刻对应所述半桥驱动芯片输出的驱动信号的下降沿产生时刻。
优选的，检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻，具体包括如下步骤：
检测所述开关节点电压达到与输入电压相同的两个连续时间点，以输出反映1/2谐振周期时长的所述谐振周期信号；
根据所述谐振周期信号，通过电流源I1给电容C2充电并将所述电容C2上的峰值电压采样保存下来；
每个谐振周期的起点，通过电流源I2给电容C3充电，当所述电容C3的充电电压达到保存下来的所述峰值电压时，确定为所述开关节点电压理论上的波峰出现时刻。
优选的，选择所述电容C2的容值与所述电容C3的容值相同，所述电流源I2的电流为所述电流源I1电流的2/3。
优选的，所述主功率管为MOS管时，所述开关节点电压为MOS管的漏极电压。
本发明还提供一种自适应的准谐振检测电路，其包括：
过零检测单元，用于检测主功率管的开关节点电压经过输入电压的时刻以及钳位管关断时对应的所述开关节点电压下掉的时刻，对应输出谐振周期信号和膝点信号，其中，所述开关节点电压下掉的时刻为所述半桥驱动芯片输出的驱动信号的下降沿产生时刻；
比例调节单元，根据所述谐振周期信号获取所述开关节点电压理论的波峰出现时刻；
驱动延时补偿单元，接收所述膝点信号以及由主控芯片输出的本周期的钳位管驱动信号，并根据所述膝点信号和所述钳位管驱动信号下降沿的时间差判断出所述半桥驱动芯片驱动延时的时间；以及根据所述驱动延时的时间在所述理论的波峰出现时刻提前一个驱动延时的时间产生开通信号；以及控制逻辑单元，接收所述开通信号，并根据所述开通信号产生下一周期的所述钳位管的驱动信号。
优选的，过零检测单元包括辅助绕组NA、分压电阻R1、分压电阻R2、基准电压源V1、比较器COM1、与门AND1、比较器COM2、滤波电阻R3以及滤波电容C1；
辅助绕组NA与变压器绕组耦合，辅助绕组NA的同名端与变压器的副边绕组的同名端一致，辅助绕组的一端接分压电阻R1的一端，另一端接分压电阻R2的一端到地；
分压电阻R1的另一端与分压电阻R2的另一端连接，且分压电阻R1和分压电阻R2的连接点连接到比较器COM1的正向输入端和比较器COM2的正向输入端以及滤波电阻R3的一端；
比较器COM1的负向输入端接基准电压源V1的正极，输出端接与门AND1的一个输入端；基准电压源V1的负极接地；与门AND1的另一输入端接屏蔽信号，输出端输出所述谐振周期信号；比较器COM2的负向输入端分别接滤波电阻R2的另一端和滤波电容C1的上极板，比较器COM2的输出端输出膝点信号；滤波电容C1的下极板接地；
当所述主功率管关断之后，所述主功率管的开关节点电压以输入电压为中点进行正弦波振荡；在每个周期中，所述开关节点电压第一次经过输入电压时产生所述谐振周期信号的下降沿；所述开关节点电压第二次经过输入电压时产生所述谐振周期信号的上升沿。
优选的，所述比例调节单元包括电流源I1、电流源I2、电容C2、电容C3、电容C4、开关K1、开关K2、开关K3、缓冲器BUF1、采样信号产生器U1、D触发器D1以及比较器COM3；
所述电流源I1的电流流入端接芯片电源，电流流出端接电容C2的上极板和开关K1的一端以及缓冲器BUF的正向输入端；所述电容C2的下极板接开关K1的另一端到地；所述开关K1的控制端连接采样信号产生器U1的第一输出端；所述缓冲器BUF1的负向输入端接自身的输出端到开关K3的一端；所述开关K3的另一端接电容C4的上极板以及第三比较器COM3的正向输入端，所述电容C4的下极板接地；所述电流源I2的电流流入端接芯片电源，电流流出端接电容C3的上极板和开关K2的一端以及比较器COM3的负向输入端；所述电容C3的下极板接开关K2的另一端到地；所述开关K2的控制端接D触发器D1的反向输出端；所述比较器COM3的输出端接D触发器D1的复位端，并输出所述开通信号；所述D触发器D1的输入端接芯片电源，触发端接采样信号产生器U1的第二输出端；所述采样信号产生器U1的输入端接所述谐振周期信号，所述采样信号产生器U1的第三输出端接开关K3的控制端；
驱动延时补偿单元包括：电流源I3、开关K4、D触发器D2以及所述比较器COM3；
所述电流源I3的电流流入连接电容C4的上极板；所述电流源I3的电流流出端接开关K4的一端，开关K4的另一端接地，开关K4的控制端接D触发器D2的输出端；所述D触发器D2的输入端接芯片电源，触发端连接所述钳位管驱动信号，复位端连接所述膝点信号。
本发明再提供一种用于有源钳位反激变换器中的钳位管的开通控制方法，其包括：
检测主功率管的开关节点电压的谐振周期，来确定所述钳位管的理论开通点；
根据主控芯片输出的钳位管驱动信号，获取半桥驱动芯片驱动延时的时间；
在所述理论开通点的基础上提前一个驱动延时的时间开通所述钳位管。
术语解释：
上极板为电容接信号的极板，下极板为电容接地的极板。
本发明的有益效果在于：
(1)逐周期采样半桥驱动芯片或其他驱动器的延时，自适应地补偿到产生波峰开通信号的电路中，使得波峰开通信号更加准确；
(2)基于波峰开通信号的准确性，非互补有源钳位反激变换器的开关损耗大大降低，变压器反向励磁的电流一致性大大提高。
附图说明
图1为典型有源钳位反激变换器的拓扑图；
图2为典型非互补模式有源钳位反激变换器的关键信号波形图；
图3为本发明自适应准谐振检测电路的框图；
图4为本发明自适应准谐振检测电路中过零检测电路的原理图；
图5为本发明自适应准谐振检测电路中比例调节电路及驱动延时补偿电路的原理图；
图6为本发明自适应准谐振检测电路的关键信号波形图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白，以下结合附图3至附图6对本发明进一步详细说明。应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。
如图3，为本发明自适应准谐振检测电路在典型有源钳位反激变换器中的应用框图。主功率管Q1、钳位电容CA、绕组NP(电感量为LM，漏感为LK)、钳位管Q2、主控芯片10、半桥驱动芯片20以及电流采样电阻RS共同组成有源钳位变换器(以下简称为变换器)的原边电路。变换器工作于非互补有源钳位模式时，钳位管Q2在变压器消磁结束后，主功率管Q1在其开关节点电压VDS的谐振波峰出现时开始导通一小段时间，使得绕组NP反向励磁。钳位管Q2关闭后，由于电感电流不能突变，绕组NP继续向母线VIN输出电流，从而将开关节点的寄生电容的电荷泄放掉。主功率管Q1在开关节点电压VDS接近0V时开通，实现零电压开通，使得开关损耗大大降低。
若钳位管Q2的开通时刻不加限制，则钳位管Q2自身难以实现在其漏源极电压谐振至谷底的时刻开通，且使得绕组NP反向励磁的电流起点不一致。为了准确地实现钳位管Q2在自身漏源极电压为谷底时开通，不仅需要自适应地判断出主功率管Q1的开关节点电压VDS的理论波峰位置(对应钳位管Q2漏源极电压的波谷位置)，以避免系统的电感和开关节点寄生电容的变化造成谐振周期变化带来的影响；还需要自适应地补偿主控芯片输出的钳位管驱动信号DH和半桥驱动芯片输出的实际驱动信号GH存在的延时。
为了实现上述功能，本发明提供一种主控芯片10，主控芯片10包括过零检测单元101、比例调节单元102、驱动延时补偿单元103和控制逻辑单元104组成的准谐振检测电路，准谐振检测电路能够根据主功率管Q1的谐振周期，自适应地控制钳位管Q2开通的时刻。
过零检测电路101用于直接或间接地检测主功率管Q1开关节点电压VDS的谐振周期以及钳位管Q2的关断时刻，具体地：过零检测电路101通过检测开关节点的电压VDS达到与输入电压VIN相同的两个连续时间点之间间隔的时长，从而获得1/2个谐振周期时长。本实施例中，主功率管Q1为NMOS管，开关节点电压VDS为NMOS管的漏极电压。
如图4，为过零检测电路101的示意图，过零检测单元101用于检测主功率管Q1的开关节点电压VDS经过输入电压VIN的时刻(即开关节点电压VDS与输入电压VIN相同的时刻)以及钳位管Q2关断时对应的开关节点电压VDS下掉的时刻(即漆点出现时刻)，对应输出谐振周期信号ZCD和膝点信号KPD。
过零检测电路101包括：辅助绕组NA、分压电阻R1、分压电阻R2、基准电压源V1、比较器COM1、与门AND1、比较器COM2、滤波电阻R3以及滤波电容C1。
辅助绕组NA与变压器的原边绕组NP耦合，辅助绕组NA的同名端与变压器的副边绕组的同名端一致，辅助绕组NA的一端接分压电阻R1的一端，另一端接分压电阻R2的一端到地；分压电阻R1的另一端与分压电阻R2的另一端连接，且分压电阻R1和分压电阻R2的连接点连接到比较器COM1的正向输入端和比较器COM2的正向输入端以及滤波电阻R3的一端。
比较器COM1的负向输入端接基准电压源V1的正极，输出端接与门AND1的一个输入端；基准电压源V1的负极接地；与门AND1的另一输入端接屏蔽信号，输出端用于输出谐振周期信号ZCD；比较器COM2的负向输入端分别接滤波电阻R3的另一端和滤波电容C1的上极板，比较器COM2的输出端输出膝点信号KPD；滤波电容C1的下极板接地。
以下结合附图4和图6，对过零检测电路101的工作原理进行说明。
辅助绕组NA耦合变压器的原边绕组NP的电压，主功率管Q1关断之后辅助绕组NA的电压为(VDS-VIN)*NA/NP，其中，VDS为主功率管Q1的开关节点电压VDS，VIN为变换器的输入电压VIN，NA为辅助绕组的匝数，NP为原边绕组的匝数，而VDS-VIN＝VOUT*NP/NS，NS为变压器的副边绕组的匝数，VOUT为变换器的输出电压。主功率管Q1的开关节点电压VDS以输入电压VIN为中点，以幅值为VDS-VIN进行正弦波振荡，图4中的分压电阻R1和分压电阻R2连接处的电压谐振到0V时刻对应为开关节点电压VDS谐振到输入电压VIN的时刻(可参考图6)。
比较器COM1根据基准电压源V1和分压电阻R1、R2分压值的比较结果输出高低电平，此处基准电压源V1的值为几十毫伏，所以，比较器COM1输出高低电平表示开关节点电压VDS谐振到输入电压VIN。
由于辅助绕组NA的异名端电压在变压器励磁阶段为负电压，也会造成比较器COM1翻转，故本实施例中，通过与门AND1将谐振阶段之外的比较器输出屏蔽掉。屏蔽信号BLK在谐振阶段为高电平，输出的谐振周期信号ZCD的下降沿对应1/4谐振周期处，谐振周期信号ZCD的上升沿对应3/4谐振周期处。
由图6可见，在一个谐振周期中，开关节点电压VDS第一次经过输入电压VIN时产生谐振周期信号ZCD的下降沿；开关节点电压VDS第二次经过输入电压时产生谐振周期信号ZCD的上升沿，也即，谐振周期信号ZCD为低电平的时长为开关节点电压VDS的1/2谐振周期的时长。
比较器COM2的正向端直接接分压电阻R1和分压电阻R2的分压值，分压值经过滤波电阻R3和滤波电容C2组成的低通滤波器接到比较器COM2的负向端，当开关节点的电压VDS的膝点出现时(对应图6中的膝点处)，比较器COM2输出的膝点信号KPD为窄脉冲低电平。
由于电压VDS膝点产生时刻对应半桥驱动芯片20输出的驱动信号GH的下降沿产生时刻，故本实施例中，通过检测电压VDS膝点产生时刻来获得半桥驱动芯片20输出的驱动信号GH的下降沿产生时刻，进而获得控制逻辑单元104输出的钳位管驱动信号DH的下降沿时刻与半桥驱动芯片20输出的驱动信号GH的下降沿时刻的时间差，从而获得半桥驱动芯片20驱动延时的时间。
请参考图5，图5为比例调节电路102及驱动延时补偿电路103的框图。其中，比例调节电路102用于根据谐振周期信号ZCD获取开关节点电压VDS理论上的波峰时刻，并在波峰出现时输出波峰时刻信号。具体地：比例调节单元102接收到谐振周期信号ZCD后，根据谐振周期信号ZCD判断出3/4个谐振周期的时长(即根据1/2个谐振周期时长判断出3/4个谐振周期的时长)，以每个谐振周期的1/4处为起点，延后3/4个谐振周期的时长作为开关节点电压VDS理论上的波峰出现时刻，即钳位管Q2的理论开通时刻。
比例调节电路具体包括：电流源I1～I2、电容C2～C4、开关K1～K3、缓冲器BUF1、采样信号产生器U1、比较器COM3以及D触发器D1。
电流源I1的电流流入端接芯片电源，电流流出端接电容C2的上极板和开关K1的一端以及缓冲器BUF1的正向输入端；电容C2的下极板接开关K1的另一端到地；所述开关K1的控制端连接采样信号产生器U1的第一输出端；缓冲器BUF1的负向输入端接自身的输出端到开关K3的一端；所述开关K3的另一端接电容C4的上极板以及第三比较器COM3的正向输入端，电容C4的下极板接地；电流源I2的电流流入端接芯片电源，电流流出端接电容C3的上极板和开关K2的一端以及比较器COM3的负向输入端；电容C3的下极板接开关K2的另一端到地；开关K2的控制端接D触发器D1的反向输出端；比较器COM3的输出端接D触发器D1的复位端，并输出开通信号QR_ON；D触发器D1的输入端接芯片电源，触发端接采样信号产生器U1的第三输出端；采样信号产生器U1的输入端接谐振周期信号ZCD。
驱动延时补偿单元103用于接收由主控芯片20输出的本周期的钳位管驱动信号DH、膝点信号KPD以及波峰时刻信号，并根据钳位管驱动信号DH和膝点信号KPD的时间差判断出半桥驱动芯片20驱动延时的时间；以及根据波峰时刻信号，在理论的波峰出现时刻提前一个驱动延时的时间产生开通信号QR_ON，以实现钳位管Q2在开关节点电压VDS波峰出现时开通。
驱动延时补偿电路具体包括电流源I3、开关K4、D触发器D2以及比较器COM3；其中，电流源I3的电流流入端接电容C4的上极板；电流源I3的电流流出端接开关K4的一端，开关K4的另一端接地，开关K4的控制端接D触发器D2的输出端；D触发器D2的输入端接芯片电源，触发端连接钳位管Q2的开通信号QR_ON，复位端接膝点信号KPD。
以下结合附图5和图6，对比例调节电路及驱动延时补偿电路的工作原理进行详细说明。其中，图6中，VDS为主功率管Q1的开关节点的电压的波形；DH为主控芯片10输出的钳位管驱动信号的波形；GH为DH经过半桥驱动芯片20输出到钳位管Q2栅极的实际驱动信号的波形，GL为主控芯片10输出到主功率管Q1栅极的驱动信号波形；ZCD为谐振周期信号的波形；KPD为膝点信号的波形；VC3为电容C3的电压的波形；VC4为电容C4的电压的波形；QR_ON为驱动延时补偿单元输出的开通信号的波形。
T1-T2阶段：在该阶段，开关K1及开关K2处于常闭状态，采样信号产生器U1依据谐振周期信号ZCD的低电平将开关K1断开，电容C2以电流I1充电，谐振周期信号ZCD为低电平的时长为1/2*TR，也就说，电容C2的充电时长为1/2*TR，TR为开关节点电压VDS的谐振周期，则可得出电容C2的电压峰值为：
Figure BDA0002968512560000091
其中C2代表电容C2的容值。与此同时，开关K3受控于采样信号产生器U1，其在谐振周期信号ZCD为低电平期间闭合，电容C2的充电过程在电容C4上复制，电容C4的电压值与电容C2相同。
T2-T3阶段：谐振周期信号ZCD变为高电平时，电容C2快速放电，电容C4不放电，电容C4继续存储电荷。
在该阶段，钳位管Q2尚未开通，D触发器D1在谐振周期信号ZCD的下降沿被触发(对应T1时刻)，反向输出端输出低电平，开关K2断开。电容C3以电流I2充电，当电容C3的电压达到电容C4上保存的电压时，比较器COM3发生翻转，开通信号QR_ON信号翻转为低电平，将D触发器D1复位。D触发器D1的反向输出端输出高电平，将电容C3放电，比较器COM3输出的开通信号QR_ON翻转为高电平。
设置电容C3的容值与电容C2的容值相同，电流源I2的电流为电流源I1电流的2/3，以谐振周期信号ZCD的下降沿为起点，电容C3的电压充电到电容C4电压值所需的时间为：
Figure BDA0002968512560000092
也就说，通过上述过程，实现了根据1/2个谐振周期时长判断出3/4个谐振周期的时长。
在第一周期，钳位管Q2的开通信号QR_ON在理论上的开关节点电压VDS波峰变为低电平，钳位管驱动信号DH经过半桥驱动芯片20之后到达钳位管Q2栅极的实际驱动信号GH存在延时，钳位管Q2滞后于波峰开通。
T4-T5阶段：钳位管驱动信号DH的下降沿触发D触发器D2，输出高电平，使得开关K4开通，电容C4上的电荷以电流I3放电；钳位管Q2关断时，开关节点电压VDS出现膝点，膝点信号KPD低电平窄脉冲使D触发器D2复位，开关K4关断。假设半桥驱动芯片20的延时为TD，则C4的电压经过放电之后为：
Figure BDA0002968512560000093
选择C3的容值等于C2的容值，I3的电流等于I2的电流，则第二开关周期从谐振周期信号ZCD变为低电平作为起点，到产生钳位管Q2开通信号的时间为：
Figure BDA0002968512560000101
上述时间
Figure BDA0002968512560000102
为主控芯片10从检测到VDS谐振1/4周期TR时刻开始到产生钳位管驱动信号DH的延时。
即，在第二周期，从检测到开关节点电压VDS谐振1/4周期TR时刻开始到产生的实际的驱动信号GH延时为：
Figure BDA0002968512560000103
所以，下一周期钳位管Q2准确地在开关节点电压VDS的波峰，即钳位管Q2的漏源极电压差谐振到波谷时开通。
图6的波形显示第一个周期，钳位管Q2实际开通时刻滞后于开关节点电压VDS的波峰，而第二个周期即将半桥驱动芯片20的驱动延时补偿进来，实现了钳位管Q2的恰好在开关节点电压波峰出现时开通(T6时刻)。
控制逻辑单元接收开通信号QR_ON以及反映变换器输出负载情况的反馈信号，并根据开通信号QR_ON产生下一周期的钳位管驱动信号DH以控制钳位管Q2开通和关断，以及根据反馈信号控制主功率管Q1开通和关断。
应当明确，本发明的实施方式不限于此，根据上述内容，按照本领域的普通技术知识和惯用手段，在不脱离本发明上述基本技术思想前提下，本发明的自适应准谐振检测电路还有其它的实施方式；因此本发明还可以做出其它多种形式的修改、替换或变更，均落在本发明权利保护范围之内。

Claims (9)

1.一种用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于，包括：
检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻；
采样主控芯片输出的钳位管驱动信号，并根据所述钳位管驱动信号，获取半桥驱动芯片驱动延时的时间；
通过在所述理论上的波峰出现时刻提前一个驱动延时的时间开通钳位管，以实现钳位管恰好在开关节点电压波峰出现时开通；其中，
根据主控芯片输出的钳位管驱动信号，获取所述半桥驱动芯片驱动延时的时间，包括：
通过检测主控芯片输出的钳位管驱动信号的下降沿产生时刻与所述开关节点的电压膝点产生时刻的时间差，来获取相对于所述主控芯片输出的钳位管驱动信号到所述半桥驱动芯片输出的驱动信号的延时时间，其中，电压膝点产生时刻对应所述半桥驱动芯片输出的驱动信号的下降沿产生时刻。
2.如权利要求1所述用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于，检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻，包括：
检测所述开关节点电压达到与输入电压相同的两个连续时间点之间间隔的时长，来获得1/2个谐振周期时长；
根据所述1/2个谐振周期时长判断出3/4个谐振周期的时长；
以每个谐振周期的1/4处为起点时刻，延后所述3/4个谐振周期时长对应的时刻确定为所述开关节点电压理论上的波峰出现时刻。
3.如权利要求1所述用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于：检测主功率管的开关节点电压的谐振周期，来确定所述开关节点电压理论上的波峰出现时刻，具体包括如下步骤：
检测所述开关节点电压达到与输入电压相同的两个连续时间点，以输出反映1/2谐振周期时长的谐振周期信号；
根据所述谐振周期信号，通过电流源I1给电容C2充电并将所述电容C2上的峰值电压采样保存下来；
每个谐振周期的起点，通过电流源I2给电容C3充电，当所述电容C3的充电电压达到保存下来的所述峰值电压时，确定为所述开关节点电压理论上的波峰出现时刻。
4.如权利要求3所述用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于：选择所述电容C2的容值与所述电容C3的容值相同，所述电流源I2的电流为所述电流源I1电流的2/3。
5.如权利要求1所述用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于：所述主功率管为MOS管时，所述开关节点电压为MOS管的漏极电压。
6.一种自适应的准谐振检测电路，其特征在于，包括：
过零检测单元，用于检测主功率管的开关节点电压经过输入电压的时刻以及钳位管关断时对应的所述开关节点电压下掉的时刻，对应输出谐振周期信号和膝点信号，其中，所述开关节点电压下掉的时刻为半桥驱动芯片输出的驱动信号的下降沿产生时刻；
比例调节单元，根据所述谐振周期信号获取所述开关节点电压理论的波峰出现时刻；
驱动延时补偿单元，接收所述膝点信号以及由主控芯片输出的本周期的钳位管驱动信号，并根据所述膝点信号和所述钳位管驱动信号下降沿的时间差判断出所述半桥驱动芯片驱动延时的时间；以及根据所述驱动延时的时间在所述理论的波峰出现时刻提前一个驱动延时的时间产生开通信号；以及
控制逻辑单元，接收所述开通信号，并根据所述开通信号产生下一周期的所述钳位管的驱动信号。
7.如权利要求6所述的自适应的准谐振检测电路，其特征在于：过零检测单元包括辅助绕组NA、分压电阻R1、分压电阻R2、基准电压源V1、比较器COM1、与门AND1、比较器COM2、滤波电阻R3以及滤波电容C1；
辅助绕组NA与变压器绕组耦合，辅助绕组NA的同名端与变压器的副边绕组的同名端一致，辅助绕组的一端接分压电阻R1的一端，另一端接分压电阻R2的一端到地；
分压电阻R1的另一端与分压电阻R2的另一端连接，且分压电阻R1和分压电阻R2的连接点连接到比较器COM1的正向输入端和比较器COM2的正向输入端以及滤波电阻R3的一端；
比较器COM1的负向输入端接基准电压源V1的正极，输出端接与门AND1的一个输入端；基准电压源V1的负极接地；与门AND1的另一输入端接屏蔽信号，输出端输出所述谐振周期信号；比较器COM2的负向输入端分别接滤波电阻R2的另一端和滤波电容C1的上极板，比较器COM2的输出端输出所述膝点信号；滤波电容C1的下极板接地；
当所述主功率管关断之后，所述主功率管的开关节点电压以输入电压为中点进行正弦波振荡；在每个周期中，所述开关节点电压第一次经过输入电压时产生所述谐振周期信号的下降沿；所述开关节点电压第二次经过输入电压时产生所述谐振周期信号的上升沿。
8.如权利要求6所述的自适应的准谐振检测电路，其特征在于：所述比例调节单元包括电流源I1、电流源I2、电容C2、电容C3、电容C4、开关K1、开关K2、开关K3、缓冲器BUF1、采样信号产生器U1、D触发器D1以及比较器COM3；
所述电流源I1的电流流入端接芯片电源，电流流出端接电容C2的上极板和开关K1的一端以及缓冲器BUF的正向输入端；所述电容C2的下极板接开关K1的另一端到地；所述开关K1的控制端连接采样信号产生器U1的第一输出端；所述缓冲器BUF1的负向输入端接自身的输出端到开关K3的一端；所述开关K3的另一端接电容C4的上极板以及第三比较器COM3的正向输入端，所述电容C4的下极板接地；所述电流源I2的电流流入端接芯片电源，电流流出端接电容C3的上极板和开关K2的一端以及比较器COM3的负向输入端；所述电容C3的下极板接开关K2的另一端到地；所述开关K2的控制端接D触发器D1的反向输出端；所述比较器COM3的输出端接D触发器D1的复位端，并输出所述开通信号；所述D触发器D1的输入端接芯片电源，触发端接采样信号产生器U1的第二输出端；所述采样信号产生器U1的输入端接所述谐振周期信号，所述采样信号产生器U1的第三输出端接开关K3的控制端；
驱动延时补偿单元包括：电流源I3、开关K4、D触发器D2以及所述比较器COM3；
所述电流源I3的电流流入连接电容C4的上极板；所述电流源I3的电流流出端接开关K4的一端，开关K4的另一端接地，开关K4的控制端接D触发器D2的输出端；所述D触发器D2的输入端接芯片电源，触发端连接所述钳位管驱动信号，复位端连接所述膝点信号。
9.一种用于有源钳位反激变换器中的钳位管的开通控制方法，其特征在于，包括：
检测主功率管的开关节点电压的谐振周期，来确定所述钳位管的理论开通点；
根据主控芯片输出的钳位管驱动信号，获取半桥驱动芯片驱动延时的时间；
在所述理论开通点的基础上提前一个驱动延时的时间开通所述钳位管；其中，
根据主控芯片输出的钳位管驱动信号，获取所述半桥驱动芯片驱动延时的时间，包括：
通过检测主控芯片输出的钳位管驱动信号的下降沿产生时刻与所述开关节点的电压膝点产生时刻的时间差，来获取相对于所述主控芯片输出的钳位管驱动信号到所述半桥驱动芯片输出的驱动信号的延时时间，其中，电压膝点产生时刻对应所述半桥驱动芯片输出的驱动信号的下降沿产生时刻。
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