CN112927652A - 像素电路及其驱动方法、显示面板和显示装置 - Google Patents

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Abstract

本申请提供了像素电路及其驱动方法、显示面板和显示装置，像素电路包括发光模块和驱动模块，驱动模块的第一端和发光模块电性连接，驱动模块的第一控制端在第一时段用于加载第一信号，驱动模块的第一控制端在第二时段用于加载第二信号，第一信号和第二信号极性相反，第一时段和第二时段无交集；此方案可以减缓驱动模块的阈值电压的漂移，以提高显示面板的寿命。

Description

像素电路及其驱动方法、显示面板和显示装置
技术领域
本申请涉及显示技术领域，尤其涉及显示器件的制造，具体涉及像素电路及其驱动方法、显示面板和显示装置。
背景技术
OLED(Organic Light Emitting Diode，有机发光二极管)显示器件具备重量轻、厚度薄、可弯曲、视角范围大等优点。
目前，OLED显示器的像素电路中采用薄膜晶体管控制通过OLED的电流以控制OLED的发光情况，但是，该薄膜晶体管在工作时栅极被唯一且固定的信号源加载为正信号，导致该薄膜晶体管的栅极信号和源极信号的差值长期保持为正信号，以至于该薄膜晶体管的阈值电压漂移呈单一变化，进一步加快了该薄膜晶体管的阈值电压的漂移，严重影响了显示面板显示的均匀性，并且降低了显示面板的寿命。
因此，有必要提供可以减缓用于驱动OLED发光的薄膜晶体管的阈值电压的漂移的像素电路及其驱动方法、显示面板和显示装置。
发明内容
本申请实施例提供像素电路及其驱动方法、显示面板和显示装置，通过将驱动模块的第一控制端在第一时段用于加载第一信号，所述驱动模块的第一控制端在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集；以解决现有的驱动模块的阈值电压单一方向漂移较严重，从而影响了显示面板显示的均匀性，并且降低了显示面板的寿命的问题。
本申请实施例提供像素电路，所述像素电路包括：
发光模块；
驱动模块，所述驱动模块的第一端和所述发光模块电性连接，所述驱动模块的第一控制端在第一时段用于加载第一信号，所述驱动模块的第一控制端在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集。
在一实施例中，所述像素电路还包括：
第一信号模块，所述第一信号模块电性连接所述驱动模块的第一控制端，用于使所述驱动模块的第一控制端在所述第一时段加载为所述第一信号，所述第一信号的极性为负；
第二信号模块，所述第二信号模块电性连接所述驱动模块的第一控制端，用于使所述驱动模块的第一控制端在所述第二时段加载为所述第二信号，所述第二信号的极性为正。
在一实施例中，所述第一信号模块包括第一信号源和第一开关，所述第一开关在所述第一时段开启以使所述第一信号源向所述驱动模块的第一控制端加载所述第一信号。
在一实施例中，所述第二信号模块包括第二信号源和第二开关，所述第二开关在所述第二时段开启以使所述第二信号源向所述驱动模块的第一控制端加载所述第二信号。
在一实施例中，所述驱动模块包括：
驱动薄膜晶体管，所述驱动薄膜晶体管为双栅薄膜晶体管，所述驱动薄膜晶体管的顶栅配置为所述驱动模块的第一控制端，所述驱动薄膜晶体管的底栅配置为所述驱动模块的第二控制端。
在一实施例中，所述像素电路还包括：
补偿模块，所述补偿模块的第一端和所述驱动模块的第二控制端电性连接，所述补偿模块的第二端和所述驱动模块的第一端电性连接，所述补偿模块用于调节所述驱动模块的阈值电压。
在一实施例中，所述补偿模块包括：
补偿电容，所述补偿电容的第一端和所述驱动模块的第二控制端电性连接，所述补偿电容的第二端接地，所述补偿电容用于存储所述驱动模块的第二控制端的信号；
补偿薄膜晶体管，所述补偿薄膜晶体管的栅极电性连接所述第二信号模块，所述补偿薄膜晶体管的源极电性连接所述驱动模块的第一端，所述补偿薄膜晶体管的漏极电性连接所述驱动模块的第二控制端以调节所述驱动模块的阈值电压。
在一实施例中，所述像素电路还包括：
数据信号模块；
写入模块，所述写入模块的输入端和所述数据信号模块电性连接；
存储模块，所述存储模块的第一端和所述写入模块的输出端、所述驱动模块的第一控制端连接，所述存储模块的第二端和所述驱动模块的第二端电性连接。
在一实施例中，所述写入模块包括写入开关，所述写入开关的第一端配置为所述写入模块的输入端，所述写入开关的第二端配置为所述写入模块的输出端，所述写入开关的控制端电性连接扫描电压模块，所述扫描电压模块用于控制所述写入开关是否开启，以控制所述数据信号模块是否向所述存储电容写入数据信号；
所述存储模块包括存储电容，所述存储电容的第一端配置为所述存储模块的第一端，所述储电容的第二端配置为所述存储模块的第二端，所述存储电容用于存储所述数据信号。
在一实施例中，所述像素电路还包括：
预存模块，所述预存模块的输入端和所述写入模块的输出端电性连接，所述预存模块的输出端和所述存储模块的第一端电性连接，所述预存模块用于存储所述数据信号模块提供的数据信号。
在一实施例中，所述预存模块包括：
预存电容，所述预存电容的第一端配置为所述预存模块的输入端，所述预存电容的第二端接地，所述预存电容用于存储所述数据信号；
预存开关，所述预存开关的第一端和所述预存电容的第一端电性连接，所述预存开关的第二端配置为所述预存模块的输出端，所述预存开关用于控制所述驱动模块的第一控制端是否加载为所述数据信号。
在一实施例中，所述发光模块包括微发光二极管。
本申请实施例还提供显示面板，所述显示面板包括如上文任一项所述的像素电路。
本申请实施例还提供显示装置，所述显示面板包括所述显示面板。
本申请实施例还提供驱动方法，所述驱动方法应用于上文任一项所述的像素电路，所述驱动方法包括：
在所述第二时段向所述驱动模块的第一控制端加载所述第二信号；
驱动所述驱动模块以控制所述发光模块发光；
在所述第一时段向所述驱动模块的第一控制端加载所述第一信号。
本申请提供了像素电路及其驱动方法、显示面板和显示装置，所述像素电路包括发光模块和驱动模块，通过将所述驱动模块的第一端和所述发光模块电性连接，所述驱动模块的第一控制端在第一时段用于加载第一信号，所述驱动模块的第一控制端在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集，以实现所述驱动模块的第一控制端在所述第一时段和所述第二时段交替地被加载为极性相反的所述第一信号和所述第二信号；因此，本方案中将所述驱动模块的第一控制端交替地被设置为极性相反的两种信号，以此减缓所述驱动模块的阈值电压的偏移，以稳定所述发光模块的驱动电流，以提高显示面板显示的均匀性，并且降低了显示面板的寿命。
附图说明
下面通过附图来对本申请进行进一步说明。需要说明的是，下面描述中的附图仅仅是用于解释说明本申请的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本申请实施例提供的像素电路的结构框图；
图2为本申请实施例提供的像素电路的电路图；
图3为本申请实施例提供的驱动薄膜晶体管和补偿薄膜晶体管的连接示意图；
图4为本申请实施例提供的一种驱动薄膜晶体管的栅极和源极的电压差随时间变化的曲线图；
图5为本申请实施例提供的另一种驱动薄膜晶体管的栅极和源极的电压差随时间变化的曲线图；
图6为本申请实施例提供的驱动薄膜晶体管的结构图；
图7为本申请实施例提供的两种类的N型垂直双栅极结构的晶体管的Vth随Vbs变化的曲线图；
图8为本申请实施例提供的一种驱动方法的流程图；
图9为本申请实施例提供的驱动方法的时序图；
图10为本申请实施例提供的另一种驱动方法的流程图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整的描述。显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
本申请中的术语“第一”、“第二”是用于区别不同对象，而不是用于描述特定顺序。此外，术语“包括”和“具有”以及它们任何变形，意图在于覆盖不排他的包含。例如包含了一系列步骤或模块的过程、方法、系统、产品或设备没有限定于已列出的步骤或模块，而是可选地还包括没有列出的步骤或模块，或可选地还包括对于这些过程、方法、产品或设备固有的其它步骤或模块。
在本文中提及“实施例”意味着，结合实施例描述的特定特征、结构或特性可以包含在本申请的至少一个实施例中。在说明书中的各个位置出现该短语并不一定均是指相同的实施例，也不是与其它实施例互斥的独立的或备选的实施例。本领域技术人员显式地和隐式地理解的是，本文所描述的实施例可以与其它实施例相结合。
本申请实施例提供了像素电路，所述像素电路包括但不限于以下实施例以及以下实施例的组合。
在一实施例中，如图1所示，所述像素电路100包括：发光模块101；驱动模块102，所述驱动模块102的第一端01和所述发光模块101电性连接，所述驱动模块102的第一控制端02在第一时段用于加载第一信号，所述驱动模块102的第一控制端02在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集。
其中，如图1所示，所述像素电路00还包括电源模块103，所述发光模块101的电源端03和所述电源模块103电性连接，所述发光模块101的工作端04和所述驱动模块102的第一端01电性连接，所述电源模块103输出的工作电压一定时，所述驱动模块102可以控制所述发光模块101的发光情况。具体的，如图2所示，所述发光模块101可以包括微发光二极管1011，所述微发光二极管1011的阳极端可以配置为所述发光模块101的电源端03，所述微发光二极管1011的阴极端可以配置为所述发光模块101的工作端04，所述电源模块103输出的信号可以为一恒定高电压信号，为所述微发光二极管1011提供工作回路。
在一实施例中，如图1所示，所述像素电路100还包括：第一信号模块104，所述第一信号模块104电性连接所述驱动模块102的第一控制端02，用于使所述驱动模块102的第一控制端02在所述第一时段加载为所述第一信号，所述第一信号的极性为负；第二信号模块105，所述第二信号模块105电性连接所述驱动模块102的第一控制端02，用于使所述驱动模块102的第一控制端02在所述第二时段加载为所述第二信号，所述第二信号的极性为正。
可以理解的，由于所述第一信号模块104使所述驱动模块102的第一控制端02在所述第一时段加载为极性为负的所述第一信号，所述第二信号模块105使所述驱动模块102的第一控制端02在所述第二时段加载为极性为正的所述第二信号，可以理解的，所述驱动模块102的工作时长的一个周期中可以包括所述第一时段和所述第二时段，那么在所述驱动模块102的工作时长中，所述驱动模块102的第一控制端02可以交替地被加载极性不同的两种电压；进一步的，可以减缓所述驱动模块102的阈值电压的偏移，以稳定所述发光模块101的驱动电流，以提高显示面板显示的均匀性，并且降低了显示面板的寿命。
在一实施例中，如图2所示，所述第一信号模块104包括第一信号源1041和第一开关1042，所述第一开关1042在所述第一时段开启以使所述第一信号源1041向所述驱动模块102的第一控制端02加载所述第一信号。具体的，所述第一开关1042的控制端05可以电性连接第一控制信号模块106，所述第一控制信号模块106可以输出呈周期性的第一脉冲信号，所述第一脉冲信号的脉宽可以等于所述第一时段，所述第一信号源1041输出所述第一信号，所述第一信号具体可以为一恒定的、且极性为负的电压信号；即当所述第一开关1042的控制端05被加载的所述第一脉冲信号处于所述第一脉冲信号的高电压期间，所述第一开关1042开启，所述第一信号通过所述第一开关1042加载在所述驱动模块102的第一控制端02。
在一实施例中，如图2所示，所述第二信号模块105包括第二信号源1051和第二开关1052，所述第二开关1052在所述第二时段开启以使所述第二信号源1051向所述驱动模块102的第一控制端02加载所述第二信号。具体的，所述第二开关1052的控制端06可以电性连接第二控制信号模块107，所述第二控制信号模块107可以输出呈周期性的第二脉冲信号，所述第二脉冲信号的脉宽可以等于所述第二时段，所述第二信号源1042输出所述第二信号，所述第二信号具体可以为一恒定的、且极性为正的电压信号；即当所述第二开关1052的控制端06被加载的信号处于所述第二脉冲信号的高电压期间，所述第二开关1052开启，所述第二信号通过所述第二开关1052加载在所述驱动模块102的第一控制端02。
在一实施例中，如图2所示，所述驱动模块102包括驱动薄膜晶体管1021，所述驱动薄膜晶体管1021为双栅薄膜晶体管，所述驱动薄膜晶体管1021的顶栅配置为所述驱动模块102的第一控制端02，所述驱动薄膜晶体管1021的底栅配置为所述驱动模块102的第二控制端08。具体的，所述驱动薄膜晶体管1021还可以包源漏极层，所述源漏极层包括同层设置的源极和漏极，所述顶栅、所述源漏极层和所述底栅层叠设置，所述驱动薄膜晶体管1021的阈值电压即为所述驱动模块102的阈值电压，所述驱动薄膜晶体管1021的顶栅和源极间的电压差和所述驱动薄膜晶体管1021的阈值电压的差值用于控制所述驱动薄膜晶体管1021的导通状态。
其中，当所述驱动薄膜晶体管1021为一个N型垂直双栅极结构的晶体管时，所述驱动薄膜晶体管1021的阈值电压和所述驱动薄膜晶体管1021的顶栅呈正相关，同时所述驱动薄膜晶体管1021的阈值电压和所述驱动薄膜晶体管1021的底栅呈负相关，此处包括但不限于通过调整所述驱动薄膜晶体管1021的底栅以调整所述驱动薄膜晶体管1021的阈值电压，具体的，此时所述驱动薄膜晶体管1021的底栅的电压跟随所述驱动薄膜晶体管1021的漏极的电压的变化而变化。
在一实施例中，如图1所示，所述像素电路100还包括补偿模块108，所述补偿模块108第一端07和所述驱动模块102的第二控制端08电性连接，所述补偿模块108的第二端09和所述驱动模块102的第一端01电性连接，所述补偿模块108用于调节所述驱动模块102的阈值电压。具体的，所述补偿模块108的第一端07可以通过控制所述驱动模块102的第二控制端08的电压以调节所述驱动模块102的第二控制端08并使得所述驱动模块102的阈值电压处于预设电压范围内，其中，所述驱动模块102的阈值电压使得所述驱动模块102处于临界导通状态。
可以理解的，当所述驱动模块102的阈值电压发生漂移时，会影响所述发光模块101的发光情况，本实施例中通过将所述驱动模块102设置为还包括所述第二控制端08，并且将所述驱动模块102的第二控制端08电性连接所述补偿模块108，以控制所述驱动模块102的第二控制端08，其中，所述驱动模块102具有“所述驱动模块102的阈值电压与所述驱动模块102的第二控制端08的电压呈负相关或者正相关”的性质，因此本实施例中可以根据实际情况合理控制所述第二控制端08的信号，使得所述驱动模块102的阈值电压处于所述预设电压范围内，即提高了所述驱动模块102的阈值电压的稳定性，提高所述发光模块90的发光的准确性。
在一实施例中，如图2所示，所述补偿模块108包括：补偿电容1081，所述补偿电容1081的第一端10和所述驱动模块102的第二控制端08电性连接，所述补偿电容1081的第二端21接地，所述补偿电容1081用于存储所述驱动模块102的第二控制端08的信号；补偿薄膜晶体管1082，所述补偿薄膜晶体管1082的栅极11电性连接所述第二信号模块105，所述补偿薄膜晶体管1082的源极12电性连接所述驱动模块102的第一端01，所述补偿薄膜晶体管1082的漏极13电性连接所述驱动模块102的第二控制端08以调节所述驱动模块102的阈值电压。具体的，如图2所示，当所述第二信号模块105输出高电压时，所述补偿薄膜晶体管1082可以开启，使得所述驱动薄膜晶体管1021的漏极和顶栅极接通，所述驱动薄膜晶体管1021的漏极和底栅的电位下降，直至所述驱动薄膜晶体管1021截至，此时所述补偿电容1081获取所述驱动薄膜晶体管1021的阈值电压。
需要注意的是，当所述驱动薄膜晶体管1021为N型垂直单栅极结构的晶体管时，如图3所示，一般所述补偿薄膜晶体管1082的源极和漏极会分别电性连接所述N型垂直单栅极结构的晶体管的漏极和栅极，若所述N型垂直单栅极结构的晶体管的栅极被加载高电压时，所述N型垂直单栅极结构的晶体管形成二极管结构。假设所述N型垂直单栅极结构的晶体管的阈值电压为Vth，所述N型垂直单栅极结构的晶体管的栅极和源极的电压差为Vgs，如图4所示，当Vth>0V时，此时所述N型垂直单栅极结构的晶体管的栅极的电压会通过所述二极管结构释放，直至Vgs＝Vth时，所述二极管结构截止，此时可以从所述N型垂直单栅极结构的晶体管的栅极侦测到所述Vth进一步做后续的Vth补偿；如图5所示，当Vth<0V时，此时所述N型垂直单栅极结构的晶体管一直处于开启状态，则Vgs＝0V，此时不能从所述N型垂直单栅极结构的晶体管的栅极侦测到所述Vth，此时无法补偿Vth。
进一步的，如图6所示，当所述驱动薄膜晶体管1021为N型垂直双栅极结构的晶体管时，假设所述N型垂直双栅极结构的晶体管的阈值电压为Vth，所述N型垂直双栅极结构的晶体管的底栅和源极的电压差为Vbs，如图7所示，为不同两种类的N型垂直双栅极结构的晶体管的所述Vth和所述Vbs的函数图像，观察可知，对于不同种类的N型垂直双栅极结构的晶体管而言，所述Vth和所述Vbs均呈线性关系，即每一所述N型垂直双栅极结构的晶体管的Vbs均能够线性动态调节Vth；因此，本实施例中将所述驱动薄膜晶体管1021设置为一个N型垂直双栅极结构的晶体管，通过改变所述N型垂直双栅极结构的晶体管的底栅的电压来调节Vth为正值从而对Vth的侦测。
在一实施例中，如图1所示，所述像素电路100还包括：数据信号模块109；写入模块201，所述写入模块201的输入端14和所述数据信号模块109电性连接；存储模块202，所述存储模块202的第一端15和所述写入模块201的输出端16、所述驱动模块102的第一控制端02连接，所述存储模块202的第二端17和所述驱动模块102的第二端22电性连接。在一实施例中，如图2所示，所述写入模块201可以包括写入开关2011，所述写入开关2011的第一端配置为所述写入模块201的输入端14，所述写入开关2011的第二端配置为所述写入模块201的输出端16，所述写入开关2011的控制端20可以电性连接扫描电压模块203，所述扫描电压模块203用于控制所述写入开关2011是否开启；所述存储模块202可以包括存储电容2021，所述存储电容2021的第一端配置为所述存储模块202的第一端15，所述存储电容2021的第二端配置为所述存储模块202的第二端17，所述存储电容2021用于存储所述数据信号。具体的，当所述扫描电压模块203控制所述写入开关2011开启时，所述数据信号模块109通过所述写入开关2011向所述存储电容2021和所述驱动薄膜晶体管1021写入所述数据信号。
在一实施例中，如图1所示，所述像素电路100还包括预存模块204，所述预存模块204的输入端18和所述写入模块201的输出端16电性连接，所述预存模块204的输出端19和所述存储模块202的第一端15电性连接，所述预存模块204用于存储所述数据信号模块109提供的数据信号。可以理解的，所述预存模块204将所述写入模块201和所述存储模块202电性连接，可以先缓存所述数据信号以在合适的时候向所述存储模块202写入所述数据信号。
在一实施例中，如图2所示，所述预存模块204包括：预存电容2041，所述预存电容2041的第一端配置为所述预存模块201的输入端18，所述预存电容2041的第二端接地，所述预存电容2041用于存储所述数据信号；预存开关2042，所述预存开关2042的第一端和所述预存电容2041的第一端电性连接，所述预存开关2042的第二端配置为所述预存模块204的输出端19，所述预存开关2042用于控制所述驱动模块102的第一控制端02是否加载为所述数据信号。可以理解的，当所述扫描电压模块203控制所述写入开关2011开启时，所述数据信号通过所述写入开关2011预存在所述预存电容2041上；当预存电压模块205控制所述预存开关2042开启时，所述数据信号通过所述预存开关2042写入所述存储电容2021和所述驱动薄膜晶体管1021。
本申请实施例提供了驱动方法，所述驱动方法应用于上文任一所述像素电路，所述驱动方法包括但不限于以下实施例以及以下实施例的组合。
在一实施例中，如图8所示，所述驱动方法包括但不限于以下步骤。
S10，在所述第二时段向所述驱动模块的第一控制端加载所述第二信号。
在一实施例中，如图1所示，所述像素电路100还包括第二信号模块105，所述第二信号模块105电性连接所述驱动模块102的第一控制端02，用于使所述驱动模块102的第一控制端02在所述第二时段加载为所述第二信号，所述第二信号的极性为正。
在一实施例中，如图2所示，所述第二信号模块105包括第二信号源1051和第二开关1052，所述第二开关1052在所述第二时段开启以使所述第二信号源1051向所述驱动模块102的第一控制端02加载所述第二信号。具体的，所述第二开关1052的控制端06可以电性连接第二控制信号模块107，所述第二控制信号模块107可以输出呈周期性的第二脉冲信号，所述第二脉冲信号的脉宽可以等于所述第二时段，所述第二信号源1042输出所述第二信号，所述第二信号具体可以为一恒定的、且极性为正的电压信号；即当所述第二开关1052的控制端06被加载的信号处于所述第二脉冲信号的高电压期间，所述第二开关1052开启，所述第二信号通过所述第二开关1052加载在所述驱动模块102的第一控制端02。
S20，驱动所述驱动模块以控制所述发光模块发光。
其中，如图1所示，所述像素电路00还包括电源模块103，所述发光模块101的电源端03和所述电源模块103电性连接，所述发光模块101的工作端04和所述驱动模块102的第一端01电性连接，所述电源模块103输出的工作电压一定时，所述驱动模块102可以控制所述发光模块101的发光情况。具体的，如图2所示，所述发光模块101可以包括微发光二极管1011，所述微发光二极管1011的阳极端可以配置为所述发光模块101的电源端03，所述微发光二极管1011的阴极端可以配置为所述发光模块101的工作端04，所述电源模块103输出的信号可以为一恒定高电压信号，且恒定高电压信号大于所述驱动模块102的第一端01的电压，使得所述微发光二极管1011发光。
S30，在所述第一时段向所述驱动模块的第一控制端加载所述第一信号。
在一实施例中，如图1所示，所述像素电路100还包括第一信号模块104，所述第一信号模块104电性连接所述驱动模块102的第一控制端，用于使所述驱动模块102的第一控制端02在所述第一时段加载为所述第一信号，所述第一信号的极性为负。
在一实施例中，如图2所示，所述第一信号模块104包括第一信号源1041和第一开关1042，所述第一开关1042在所述第一时段开启以使所述第一信号源1041向所述驱动模块102的第一控制端02加载所述第一信号。具体的，所述第一开关1042的控制端05可以电性连接第一控制信号模块106，所述第一控制信号模块106可以输出呈周期性的第一脉冲信号，所述第一脉冲信号的脉宽可以等于所述第一时段，所述第一信号源1041输出所述第一信号，所述第一信号具体可以为一恒定的、且极性为负的电压信号；即当所述第一开关1042的控制端05被加载的所述第一脉冲信号处于所述第一脉冲信号的高电压期间，所述第一开关1042开启，所述第一信号通过所述第一开关1042加载在所述驱动模块102的第一控制端02。
可以理解的，由于所述第一信号模块104使所述驱动模块102的第一控制端02在所述第一时段加载为极性为负的所述第一信号，所述第二信号模块105使所述驱动模块102的第一控制端02在所述第二时段加载为极性为正的所述第二信号，可以理解的，所述驱动模块102的工作时长的一个周期中可以包括所述第一时段和所述第二时段，那么在所述驱动模块102的工作时长中，所述驱动模块102的第一控制端02可以交替地被加载极性不同的两种电压；进一步的，可以减缓所述驱动模块102的阈值电压的偏移，以稳定所述发光模块101的驱动电流，以提高显示面板显示的均匀性，并且降低了显示面板的寿命。
在一实施例中，图9为如图2所示的电路图对应的时序图，具体的，EVDD可以为所述电源模块103输出的电信号，VSS可以为加载在所述存储电容的第二端和所述驱动薄膜晶体管的源极上的信号，Sense可以为加载在所述第一开关1042的控制端05上的信号，Vref 1可以为所述第一信号源1041输出的信号，Merge可以为所述预存电压模块205输出的信号，Scan可以为所述扫描电压模块203输出的信号，Change可以为加载在所述第二开关1052的控制端06上的信号，Vref 2可以为所述第二信号源1051输出的信号，此处以所述第一开关1042和所述第二开关1052均为N型薄膜晶体管为例进行说明，即所述第一开关1042的控制端05和所述第二开关1052的控制端06分别为对应的N型薄膜晶体管的栅极。
在一实施例中，结合如图9所示的时序图和如图2所示的电路图，所述驱动方法包括但不限于如图10所示的步骤。
S101，在初始化阶段，控制所述电源模块向所述OLED器件的的阳极端输入低电压，控制变压模块向所述驱动薄膜晶体管的源极和所述存储模块电容的第二端输入高电压，控制第二信号控制模块向所述第二开关的栅极和所述补偿薄膜晶体管的栅极输入高电压，控制所述第二信号源输出高电压。
可以理解的，如图2、9所示，在所述初始化阶段t1，由于所述Sense为高电压，即所述第二控制信号模块107输出高电压，所述第二开关1052开启，且所述Vref 1为高电压，即所述第二信号源1051输出高电压，所述驱动薄膜晶体管1021开启，且所述电源模块103输出的所述EVDD为低电压，所述变压模块206所述VSS为高电压，即所述微发光二极管1011的的阳极端电压低于所述OLED器件的的阴极端电压，即所述微发光二极管1011未导通，故所述微发光二极管1011处于熄灭状态；同时，如图2所示，所述补偿薄膜晶体管1082的栅极11也电性连接所述第二控制信号模块107，即所述补偿薄膜晶体管1082也开启，即所述驱动薄膜晶体管1021的底栅和漏极导通，故所述VSS经过所述驱动薄膜晶体管1021和所述补偿薄膜晶体管1082传输至所述驱动薄膜晶体管1021的底栅和所述补偿电容1081的第一端10，使得所述驱动薄膜晶体管1021的底栅的电压升高，进一步调节所述驱动薄膜晶体管1021的阈值电压为负值。
S102，在补偿阶段，维持所述电源模块向所述OLED器件的的阳极端输入低电压，控制所述变压模块向所述驱动薄膜晶体管的源极和所述存储模块电容的第二端输入低电压，控制第二控制模块向所述第二开关的栅极和所述补偿薄膜晶体管的栅极输入高电压，控制所述第二信号源输出低电压。
可以理解的，如图2、9所示，在所述补偿阶段t2，由于所述Sense为高电压，同理，所述第二开关1052开启，且所述Vref 1为低电压，结合所述驱动薄膜晶体管1021的阈值电压为负值，此时所述驱动薄膜晶体管1021的顶栅的电压仍然高于所述驱动薄膜晶体管1021的阈值电压，即所述驱动薄膜晶体管1021仍然开启；且所述EVDD为低电压，所述VSS为低电压，同理，所述微发光二极管1011处于熄灭状态；同时，所述驱动薄膜晶体管1021的底栅的电压依次通过所述补偿薄膜晶体管1082和所述驱动薄膜晶体管1021放电至所述变压模块206，使得所述驱动薄膜晶体管1021的底栅的电压降低，以至于所述驱动薄膜晶体管1021的阈值电压上升，直至所述驱动薄膜晶体管1021的阈值电压等于所述驱动薄膜晶体管1021的顶栅的电压也即所述Vref 1此时的电压时，所述驱动薄膜晶体管1021截至，所述补偿电容1081存储所述驱动薄膜晶体管1021的底栅的电压。
S103，在写入阶段，控制所述预存电压模块向所述预存开关输入高电压。
可以理解的，如图2、9所示，在所述写入阶段t3，所述Merge为高电压，此时上一帧预存在所述预存电容2041中的所述数据信号可以通过所述预存开关2042写入所述存储电容2021中。
S104，在发光阶段，控制所述电源模块向所述OLED器件的的阳极端输入高电压，控制所述预存电压模块向所述预存开关输入低电压，以及控制所述扫描电压模块向所述写入开关的控制端输入高电压。
可以理解的，如图2、9所示，在所述发光阶段t4，所述微发光二极管1011的的阳极端的电压为高电压，故所述微发光二极管1011发光，其中流经所述微发光二极管1011的电流为
Figure BDA0002935359880000141
所述μ为所述驱动薄膜晶体管1021的载流子迁移率，所述Cox为单位面积电容，所述(W/L)为所述驱动薄膜晶体管1021的宽长比，所述α为所述数据信号传输到所述驱动薄膜晶体管1021的栅极的效率，所述Vdata为所述数据信号的电压值，所述Vref为所述所述第一信号源1041输出的信号处于高电压的电压值；同时，所述写入开关2011开启，本帧的所述数据信号模块109通过所述写入开关2011预存于所述预存电容2041中。
S105，在反转阶段，控制第一控制模块向所述第一开关的栅极输入高电压，控制所述第一信号源输出低电压。
可以理解的，如图2、9所示，在所述反转阶段t5，由于所述Change为高电压，即所述第一控制信号模块106输出高电压，所述第一开关1042开启，且所述Vref 2为低电压，即所述第一信号源1041输出低电压，所述驱动薄膜晶体管1021的栅极和源极之间的电压差为负值，与之前相反；具体的，所述反转阶段t5可以占每帧的周期的一半，例如每帧的周期，即t1至t5之和为16.7毫秒，则所述反转阶段t5可以为8.3毫秒。进一步的，所述反转阶段也可以理解为对所述像素电路100对应的像素单元进行插黑处理，即本实施例还可以实现对于所述像素电路100对应的像素单元进行插黑处理，以减弱拖影现象。
需要注意的是，当采用SiNx:H制作所述驱动薄膜晶体管1021的有源层时，正偏应力主要引起a-Si:H中De态密度增加，负偏应力主要引起De态密度的减少；当采用SiO2制作所述驱动薄膜晶体管1021的有源层时，阈值电压的漂移是在正偏压下a-Si:H中De态的产生和在负偏压下Dh态的产生造成；当采用(SiNx:H)/SiO2复合层制作所述驱动薄膜晶体管1021的有源层时，阈值电压的漂移是在正偏压下a-Si:H中De态增加同时Dh态减少和在负偏压下De态减少同时Dh态增加造成。
可以理解的，本实施例中通过交替向所述驱动薄膜晶体管1021的栅极输入极性相反的两个电压信号，使得所述驱动薄膜晶体管1021的栅极和源极之间的电压差交替呈现为正值和负值，根据上述分析可知，本实施例可以使a-Si:H中态的产生是个动态平衡过程，即正偏应力下主要引起所述驱动薄膜晶体管1021中的有源层非晶硅中的De态密度增加和Dh态密度减少，而负偏应力主要引起De态密度的减少和Dh态密度的增加，且正偏应力和负偏应力交替进行，使所述驱动薄膜晶体管1021的阈值电压的漂移保持了一个动态平衡来实现输出电流的稳定。
本申请实施例还提供了显示面板，所述显示面板包括如上文任一项所述的像素电路。
本申请实施例还提供了显示装置，所述显示装置包括如上文所述的显示面板。
本申请提供了像素电路及其驱动方法、显示面板和显示装置，所述像素电路包括发光模块和驱动模块，通过将所述驱动模块的第一端和所述发光模块电性连接，所述驱动模块的第一控制端在第一时段用于加载第一信号，所述驱动模块的第一控制端在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集，以实现所述驱动模块的第一控制端在所述第一时段和所述第二时段交替地被加载为极性相反的所述第一信号和所述第二信号；因此，本方案中将所述驱动模块的第一控制端交替地被设置为极性相反的两种信号，以此减缓所述驱动模块的阈值电压的偏移，以稳定所述发光模块的驱动电流，以提高显示面板显示的均匀性，并且降低了显示面板的寿命。

Claims (15)

1.一种像素电路，其特征在于，所述像素电路包括：
发光模块；
驱动模块，所述驱动模块的第一端和所述发光模块电性连接，所述驱动模块的第一控制端在第一时段用于加载第一信号，所述驱动模块的第一控制端在第二时段用于加载第二信号，所述第一信号和所述第二信号极性相反，所述第一时段和所述第二时段无交集。
2.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括：
第一信号模块，所述第一信号模块电性连接所述驱动模块的第一控制端，用于使所述驱动模块的第一控制端在所述第一时段加载为所述第一信号，所述第一信号的极性为负；
第二信号模块，所述第二信号模块电性连接所述驱动模块的第一控制端，用于使所述驱动模块的第一控制端在所述第二时段加载为所述第二信号，所述第二信号的极性为正。
3.根据权利要求2所述的像素电路，其特征在于，所述第一信号模块包括第一信号源和第一开关，所述第一开关在所述第一时段开启以使所述第一信号源向所述驱动模块的第一控制端加载所述第一信号。
4.根据权利要求2所述的像素电路，其特征在于，所述第二信号模块包括第二信号源和第二开关，所述第二开关在所述第二时段开启以使所述第二信号源向所述驱动模块的第一控制端加载所述第二信号。
5.根据权利要求1所述的像素电路，其特征在于，所述驱动模块包括：
驱动薄膜晶体管，所述驱动薄膜晶体管为双栅薄膜晶体管，所述驱动薄膜晶体管的顶栅配置为所述驱动模块的第一控制端，所述驱动薄膜晶体管的底栅配置为所述驱动模块的第二控制端。
6.根据权利要求5所述的像素电路，其特征在于，所述像素电路还包括：
补偿模块，所述补偿模块的第一端和所述驱动模块的第二控制端电性连接，所述补偿模块的第二端和所述驱动模块的第一端电性连接，所述补偿模块用于调节所述驱动模块的阈值电压。
7.根据权利要求6所述的像素电路，其特征在于，所述补偿模块包括：
补偿电容，所述补偿电容的第一端和所述驱动模块的第二控制端电性连接，所述补偿电容的第二端接地，所述补偿电容用于存储所述驱动模块的第二控制端的信号；
补偿薄膜晶体管，所述补偿薄膜晶体管的栅极电性连接所述第二信号模块，所述补偿薄膜晶体管的源极电性连接所述驱动模块的第一端，所述补偿薄膜晶体管的漏极电性连接所述驱动模块的第二控制端以调节所述驱动模块的阈值电压。
8.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括：
数据信号模块；
写入模块，所述写入模块的输入端和所述数据信号模块电性连接；
存储模块，所述存储模块的第一端和所述写入模块的输出端、所述驱动模块的第一控制端连接，所述存储模块的第二端和所述驱动模块的第二端电性连接。
9.根据权利要求8所述的像素电路，其特征在于，所述写入模块包括写入开关，所述写入开关的第一端配置为所述写入模块的输入端，所述写入开关的第二端配置为所述写入模块的输出端，所述写入开关的控制端电性连接扫描电压模块，所述扫描电压模块用于控制所述写入开关是否开启；
所述存储模块包括存储电容，所述存储电容的第一端配置为所述存储模块的第一端，所述储电容的第二端配置为所述存储模块的第二端，所述存储电容用于存储所述数据信号。
10.根据权利要求8所述的像素电路，其特征在于，所述像素电路还包括：
预存模块，所述预存模块的输入端和所述写入模块的输出端电性连接，所述预存模块的输出端和所述存储模块的第一端电性连接，所述预存模块用于存储所述数据信号模块提供的数据信号。
11.根据权利要求10所述的像素电路，其特征在于，所述预存模块包括：
预存电容，所述预存电容的第一端配置为所述预存模块的输入端，所述预存电容的第二端接地，所述预存电容用于存储所述数据信号；
预存开关，所述预存开关的第一端和所述预存电容的第一端电性连接，所述预存开关的第二端配置为所述预存模块的输出端，所述预存开关用于控制所述驱动模块的第一控制端是否加载为所述数据信号。
12.根据权利要求1所述的像素电路，其特征在于，所述发光模块包括微发光二极管。
13.一种显示面板，其特征在于，所述显示面板包括如权利要求1-12任一项所述的像素电路。
14.一种显示装置，其特征在于，所述显示装置包括如权利要求13所述的显示面板。
15.一种驱动方法，其特征在于，所述驱动方法应用于权利要求1-12任一项所述的像素电路，所述驱动方法包括：
在所述第二时段向所述驱动模块的第一控制端加载所述第二信号；
驱动所述驱动模块以控制所述发光模块发光；
在所述第一时段向所述驱动模块的第一控制端加载所述第一信号。
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