CN112530366A - 像素电路及像素电路驱动方法 - Google Patents

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Abstract

本公开内容关于一种像素电路及像素电路驱动方法，像素电路包含发光元件、驱动电路、第一数据存储电路及第二数据存储电路。驱动电路电性连接于发光元件。第一数据存储电路电性连接于驱动电路，且用以在第一帧周期时传送第一数据信号至驱动电路，使得驱动电路根据第一数据信号驱动发光元件。第二数据存储电路电性连接于驱动电路，且用以在第一帧周期时接收第二数据信号。

Description

像素电路及像素电路驱动方法
技术领域
本公开内容关于一种像素电路及其驱动方法，特别是根据数据信号驱动发光元件发亮的电路。
背景技术
随着电子科技的快速进展，显示装置已被广泛地应用在人们的生活当中，诸如智能手机或电脑等。显示装置会分别控制显示面板上每个像素在不同帧画面中的亮度，以呈现出对应的影像。而显示装置在不同帧画面之间的更新方式，亦将影响其显示品质。
发明内容
本公开内容的一实施例为一种像素电路，包含发光元件、驱动电路、第一数据存储电路及第二数据存储电路。驱动电路电性连接于发光元件。第一数据存储电路电性连接于驱动电路。第一数据存储电路用以在第一帧周期时将第一数据信号传送至驱动电路，使驱动电路根据第一数据信号驱动发光元件。第二数据存储电路电性连接于驱动电路。第二数据存储电路用以在第一帧周期时接收第二数据信号。
本公开内容的另一实施例为一种像素电路驱动方法，包含下列步骤：在第一帧周期时，从第一数据存储单元接收第一数据信号，且根据第一数据信号驱动发光元件。在第一帧周期时，通过第二数据存储单元接收并存储第二数据信号。在第二帧周期时，从第二数据存储单元接收第二数据信号，且根据第二数据信号驱动发光元件。在第二帧周期时，通过第一数据存储单元接收并存储第三数据信号。
本公开内容的另一实施例为一种像素电路，包含发光元件、驱动电路、第一数据存储电路及第二数据存储电路。驱动电路电性连接于发光元件，第一数据存储电路电性连接于驱动电路。第一数据存储电路用以在第一帧周期时将第一数据信号传送至驱动电路，使驱动电路根据第一数据信号驱动发光元件。第二数据存储电路并联于第一数据存储电路。二数据存储电路用以在第二帧周期时将第二数据信号传送至驱动电路，使驱动电路根据第二数据信号驱动发光元件。
据此，由于像素电路能通过数据存储电路，于前一帧周期中预先存储数据信号，因此当进入下一帧周期时，显示面板上的像素电路能同时驱动发光元件，使整个画面的更新保持一致。
附图说明
图1为根据本公开内容的部分实施例的显示装置的示意图。
图2A为根据本公开内容的部分实施例的像素电路的示意图。
图2B为根据本公开内容的部分实施例的像素电路的信号波形图。
图3为根据本公开内容的部分实施例的像素电路驱动方法的步骤流程图。
图4A～4E为根据本公开内容的部分实施例的像素电路的第一帧周期运行示意图。
图5A～5E为根据本公开内容的部分实施例的像素电路的第二帧周期运行示意图。
附图标记说明：
100：像素电路
110：第一数据存储电路
120：第二数据存储电路
130：驱动电路
140：写入电路
150：补偿电路
200：显示装置
210：显示面板
220：控制器
T1：第一开关元件
T2：第二开关元件
T3：第三开关元件
T4：第四开关元件
Ta：驱动晶体管
Tb：开关晶体管
Tc：重置开关
Td：晶体管开关
T51：补偿开关
T52：补偿开关
P10：第一帧周期
P11：第一发亮期间
P12：第一重置期间
P13：写入期间
P14：第二重置期间
P15：第二发亮期间
P20：第二帧周期
P21：第一发亮期间
P22：第一重置期间
P23：写入期间
P24：第二重置期间
P25：第二发亮期间
具体实施方式
以下将以附图公开本发明的多个实施方式，为明确说明起见，许多实务上的细节将在以下叙述中一并说明。然而，应了解到，这些实务上的细节不应用以限制本发明。也就是说，在本公开内容的部分实施方式中，这些实务上的细节是非必要的。此外，为简化附图起见，一些现有惯用的结构与元件在附图中将以简单示意的方式示出的。
于本文中，当一元件被称为“连接”或“耦接”时，可指“电性连接”或“电性耦接”。“连接”或“耦接”亦可用以表示二或多个元件间相互搭配操作或互动。此外，虽然本文中使用“第一”、“第二”、…等用语描述不同元件，该用语仅是用以区别以相同技术用语描述的元件或操作。除非上下文清楚指明，否则该用语并非特别指称或暗示次序或顺位，亦非用以限定本发明。
本公开内容关于一种像素电路及其驱动方法。在一实施例中，像素电路100是应用于显示装置200上。请参阅图1，图1为根据本公开内容的部分实施例的显示装置200的示意图。显示装置200包含显示面板210及控制器220。显示面板210设有多个像素电路100，每个像素电路100用以驱动内部的发光元件(如：发光二极管、有机发光二极管)，显示一个影像画面中的一个像素亮度或色彩。
请参阅图1、2A及2B，其中图2A为根据本公开内容的部分实施例的像素电路100的示意图，图2B则为根据本公开内容的部分实施例的像素电路100的信号波形图。在一实施例中，控制器220电性连接至像素电路100，且用以将多组控制信号Em、S1[n]、S2[n]、S1[n+1]、So[n]、Se[n]传送至像素电路100。其中n代表用以控制显示面板210上第n排的像素电路100。像素电路100根据该些控制信号进行发光、重置、数据写入等不同的动作。
在一实施例中，像素电路100包含发光元件L、第一数据存储电路110、第二数据存储电路120及驱动电路130。发光元件L可为发光二极管。驱动电路130电性连接于发光元件L，且能根据电压源Vdd、VSS提供驱动电流，以导通发光元件L且使其发光。在部分实施例中，驱动电路包含驱动晶体管Ta及开关晶体管Tb。驱动晶体管Ta的栅极连接至驱动电路130上的节点Na。驱动电路130根据节点Na的电压(即，驱动晶体管Ta的栅极电压)调整驱动电流的大小。开关晶体管Tb则响应于控制信号EM[n]导通或关闭。
第一数据存储电路110、第二数据存储电路12电性连接于驱动电路130，且用以分别在不同帧周期中，交错地存储数据信号Vdata。在一实施例中，第一数据存储电路110用以存储对应于奇数帧周期的数据信号、第二数据存储电路120则用以存储对应于偶数帧周期的数据信号。此外，数据存储电路110、120是于前一个周期中预先接收数据信号。意即，在第一帧周期P10开始之前，第一数据存储电路110即预先存储有第一数据信号。因此进入第一帧周期P10时，第一数据存储电路110即能将第一数据信号传送至驱动电路130，使驱动电路130根据第一数据信号驱动发光元件L。
同样地，在第一帧周期P10时，第二数据存储电路120会先接收并存储第二数据信号。在第二帧周期P20中，第二数据存储电路110即能将预先存储的第二数据信号传送至驱动电路130，使驱动电路130根据第二数据信号驱动发光元件L。同时，第一数据存储电路110会在第二帧周期P20时接收并存储第三数据信号，以在第三帧周期时传送第三数据信号至驱动电路130，使驱动电路130根据第三数据信号驱动发光元件L。在部分实施例中，第一数据存储电路110、第二数据存储电路12是相互并联。
在部分实施例中，第一数据存储电路110包含第一存储元件C1及第一开关元件T1。第一存储元件C1(如：电容)用以存储对应于奇数帧周期的数据信号(如：第一数据信号、第三数据信号)。第一开关元件T1串联于第一存储元件C1，且在奇数帧周期(如：第一数据信号、第三数据信号)中的发亮期间导通，使第一数据存储元件C1存储的第一数据信号被传送至驱动电路130。如图2A所示，在一实施例中，第一开关元件T1是电性连接于驱动电路130的节点Na及第一存储元件C1之间，因此，当第一开关元件T1关断时，第一存储元件C1中存储的信号将无法被传递至驱动电路130。
同样地，第二数据存储电路120包含第二存储元件C2及第二开关元件T2。第二存储元件C2用以存储对应于偶数帧周期的数据信号(如：第二数据信号)。第二开关元件T2串联于第二存储元件C1，且在偶数帧周期(如：第二数据信号)中的发亮期间导通，使第二数据存储元件C2存储的第二数据信号被传送至驱动电路130。如图2A所示，在一实施例中，第二开关元件T2是电性连接于驱动电路130的节点Na及第二存储元件C2之间，因此，当第二开关元件T2关断时，第二存储元件C2中存储的信号将无法被传递至驱动电路130。
在一实施例中，第一开关元件T1、第二开关元件T2、驱动晶体管Ta、开关晶体管Tb皆为P型金属氧化物半导体场效晶体管(PMOS)。意即，当控制信号Se[n]、So[n]、EM[n]或该些晶体管T1、T2、Ta、Tb的栅极接收到低电平的逻辑信号时，该些晶体管T1、T2、Ta、Tb将被导通。反之，当控制信号Se[n]、So[n]、EM[n]或该些晶体管T1、T2、Ta、Tb的栅极接收到高电平的逻辑信号时，该些晶体管T1、T2、Ta、Tb将被关断。在其他部分实施例中，该些晶体管T1、T2、Ta、Tb亦可由N型金属氧化物半导体场效晶体管或其他开关元件实现。
在一实施例中，显示面板210上的所有像素电路100都会在前一个帧周期中(如：第一帧周期)预先接收数据信号，且在进入下一个帧周期时(如：第二帧周期)，同时驱动发光元件L。据此，即可确保所有的发光元件L同时发亮，使显示面板210完成画面更新。因此，将能避免显示面板210上每个像素电路100更新的时间不同，导致影像的错误问题。
如图2B所示，在一实施例中，每个帧周期中又包含发亮期间、重置期间及写入期间等多个阶段。像素电路100于发亮期间(如：第一发亮期间P11、第二发亮期间P15)根据预先存储的数据信号驱动发光元件L、于重置期间重置发光元件L或存储元件上的电压、且于写入期间预先接收下一个帧周期的数据信号。
在部分实施例中，每个帧周期一开始之时，是先进入第一发亮期间P11、P21，接着再进入写入期间，以确保每个帧周期一开始时，所有的发光元件L能同时显示出对应的亮度或色彩。
在部分实施例中，像素电路100还包含写入电路140及补偿电路150。写入电路140电性连接于第一数据存储电路110该第二数据存储电路120，用以在写入期间P13传送数据信号至对应的数据存储电路。补偿电路150电性连接于驱动电路130、第一数据存储电路110该第二数据存储电路120，用以在写入期间P13将补偿信号写入至节点Na(驱动晶体管Ta的栅极)。在部分实施例中，补偿电路150电性连接于驱动电路130中驱动晶体管Ta的栅极(节点Na)及源极之间，或电性连接于驱动晶体管Ta的源极与数据存储电路110、120之间。
以下说明第一数据存储电路110及第二数据存储电路120于不同期间的运行方式：在第一帧周期P10的第一发亮期间P11及第二发亮期间P15，第一开关元件T1导通、第二开关元件T2关断，使得第一数据存储单元C1中存储的数据信号能被传送至驱动电路130。同理，在第二帧周期P20的第二发亮期间P21及第二发亮期间P25，第一开关元件T1关断、第二开关元件T2导通，使得第二数据存储单元C2中存储的数据信号能被传送至驱动电路130。
在一实施例中，请参阅第2A及2B图所示，每个帧周期包含第一重置期间P12及第二重置期间P14。第一重置期间P12中将重置存储元件C1、C2上的电压、第二重置期间P14中则将重置发光元件L上的电压。举例而言，在第一帧周期P10的第一重置期间P12时，像素电路100中的重置开关Tc将导通，使得第二存储元件C2将通过第二开关元件T2及重置开关Tc导通至参考电压源Vr(如：接地电位)，以重置其存储的数据信号。
承上，在第一帧周期P10的第二重置期间P12，驱动电路130中的开关晶体管Tb关断、晶体管开关Td导通，使节点Nb上的电压能通过晶体管开关Td放电，避免发光元件L产生暗态漏光的问题。
此外，在第一帧周期P10的第一重置期间P12及第二重置期间P14，第一开关元件T1关断、第二开关元件T2导通，使第一数据存储元件C1中预先存储的数据信号不至于被影响。同理，在第二帧周期P20的第一重置期间P22及第二重置期间P24。第一开关元件T1导通、第二开关元件T2关断，使第二数据存储元件C2中存储的信号不至于被影响。
在一实施例中，写入期间用以接收数据信号，且同时对驱动电路130进行补偿。举例而言，在第一帧周期P10的写入期间P13，第一开关元件T1关断、第二开关元件T2导通、补偿电路130亦导通，使得第二存储元件C2能从写入电路140中接收第二数据信号。同时，电压源Vdd能通过驱动晶体管Ta及补偿电路150，在节点Na上写入补偿信号。由于第一开关元件T1关断，因此第一存储元件C1中存储的第一数据信号将不会受到影响。
同理，在第二帧周期P20的写入期间P23，第一开关元件T1导通、第二开关元件T2关断、补偿电路130亦导通，使得第一存储元件C1能从写入电路140中接收第三数据信号。同时，电压源Vdd能通过驱动晶体管Ta及补偿电路150，在节点Na上写入补偿信号。由于二开关元件T2关断，因此第二存储元件C2中存储的第二数据信号将不会受到影响。
在部分实施例中，写入电路140包含第三开关元件T3及第四开关元件T4。第三开关元件T3电性连接于参考电压Vr(如：接地电位)，第四开关元件T4则电性连接于控制器220，用以接收对应的数据信号。
为便于理解像素电路100的运行方式，在此说明像素电路100的驱动方法。图3为根据本公开内容的部分实施例的像素电路驱动方法的步骤流程图。请参阅图4A所示，在步骤S301中，当第一帧周期P10的第一发亮期间P11，第一数据存储单元C1具有前一帧周期时预先存储的第一数据信号。此时，第一开关元件T1导通、第二开关元件T2关断、驱动晶体管Ta及开关晶体管Tb导通、晶体管开关Td关断。写入电路140中的第三开关元件T3导通、第四开关元件T4关断。补偿电路150关断。驱动电路130能从第一数据存储单元C1接收第一数据信号，且根据第一数据信号驱动发光元件L。
请参阅图4B所示，在步骤S302中，在第一帧周期P10的第一重置期间P12时，第一开关元件T1关断、第二开关元件T2导通、开关晶体管Tb关断。写入电路140中的第三开关元件T3关断、第四开关元件T4导通、补偿电路150导通。此时，像素电路100的重置开关Tc导通，重置开关Tc是通过补偿电路150电性连接于节点Na，使得驱动电路130上的控制电压(即，节点Na的电压)能够通过补偿电路150及重置开关Tc导通至参考电压源Vr而重置(如：归零)。
请参阅图4C所示，在步骤S303中，在第一帧周期P10的写入期间P13，第一开关元件T1关断、第二开关元件T2导通、驱动晶体管Ta导通、开关晶体管Tb关断、晶体管开关Td关断。写入电路140中的第三开关元件T3关断、第四开关元件T4导通。补偿电路150导通、重置开关Tc关断。此时，第二数据存储单元C2通过写入电路140接收并存储第二数据信号。同时，电压源Vdd通过驱动晶体管Ta、补偿电路150及第二数据存储电路120形成回路，将补偿信号传送(写入)至驱动电路130的节点Na(即，Vdd-Vth，其中Vth为驱动晶体管Ta的临界电压值)。
请参阅图4D所示，在步骤S304中，在第一帧周期P10的第二重置期间P14，第一开关元件T1关断、第二开关元件T2导通、写入电路140关断、开关晶体管Tb关断、晶体管开关Td导通。此时，发光二极管L(节点Nb上的电压)通过晶体管开关Td放电，以避免发光元件L产生暗态漏光的问题。
在第一重置期间P12、写入期间P13及第二重置期间P14，由于第一开关元件T1皆保持关断，因此第一存储元件C1中存储的第一数据信号不会随着节点Na的电压变动而跟着变化。据此，在第二重置期间P14后，像素电路100能再进行一次发亮。如图4E所示，在步骤S305中，在第一帧周期P10的第二发亮期间P15，第一开关元件T1导通、第二开关元件T2关断、驱动晶体管Ta及开关晶体管Tb导通、晶体管开关Td关断。写入电路140中的第三开关元件T3导通、第四开关元件T4关断。驱动电路130从第一数据存储单元C1接收第一数据信号，且根据第一数据信号驱动发光元件L。
在第二帧周期P20中，像素电路100的操作原理与第一帧周期P10相同。此时像素电路100通过第二数据存储电路P120驱动发光元件L，且对第一数据存储电路写入第三数据信号。请参阅图5A所示，在步骤S306中，当第二帧周期P20的第一发亮期间P21，第二数据存储单元C2具有第一帧周期时预先存储的第二数据信号。此时，第一开关元件T1关断、第二开关元件T2导通、驱动晶体管Ta及开关晶体管Tb导通、晶体管开关Td关断。写入电路140中的第三开关元件T3导通、第四开关元件T4关断。补偿电路150关断。驱动电路130能从第二数据存储单元C2接收第二数据信号，且根据第二数据信号驱动发光元件L。
请参阅图5B所示，在步骤S307中，在第二帧周期P20的第一重置期间P22时，第一开关元件T1导通、第二开关元件T2关断、开关晶体管Tb关断。第三开关元件T3关断、第四开关元件T4导通、补偿电路150导通。此时，像素电路100的重置开关Tc导通，重置开关Tc是通过补偿电路150电性连接于节点Na，使得驱动电路130上的控制电压(即，节点Na的电压)通过补偿电路150及重置开关Tc导通至参考电压源Vr而重置(如：归零)。
请参阅图5C所示，在步骤S308中，在第二帧周期P20的写入期间P23，第一开关元件T1导通、第二开关元件T2关断、驱动晶体管Ta导通、开关晶体管Tb关断、晶体管开关Td关断。写入电路140中的第三开关元件T3关断、第四开关元件T4导通。补偿电路150导通、重置开关Tc关断。此时，第一数据存储单元C1通过写入电路140接收并存储第三数据信号。同时，电压源Vdd通过驱动晶体管Ta、补偿电路150及第一数据存储电路110形成回路，将补偿信号传送(写入)至驱动电路130的节点Na(即，Vdd-Vth，其中Vth为驱动晶体管Ta的临界电压值)。
请参阅图5D所示，在步骤S309中，在第二帧周期P20的第二重置期间P24，第一开关元件T1导通、第二开关元件T2关断、写入电路140关断、开关晶体管Tb关断、晶体管开关Td导通。此时，发光二极管L(节点Nb上的电压)通过晶体管开关Td放电，以避免发光元件L产生暗态漏光的问题。
在第一重置期间P22、写入期间P23及第二重置期间P24，由于第二开关元件T2皆保持关断，因此第二存储元件C2中存储的第二数据信号不会随着节点Na的电压变动而跟着变化。请参阅图5E所示，在步骤S310中，在第二帧周期P20的第二发亮期间P25，第一开关元件T1关断、第二开关元件T2导通、驱动晶体管Ta及开关晶体管Tb导通、晶体管开关Td关断。写入电路140中的第三开关元件T3导通、第四开关元件T4关断。驱动电路130从第二数据存储单元C2接收第二数据信号，且根据第二数据信号驱动发光元件L。
请参阅图2A所示，在一实施例中，补偿电路150包含至少一个补偿晶体管(在图2A所示的实施例中，包含两个补偿开关T51、T52)。补偿开关T51、T52分别连接于驱动晶体管Ta的源极以及栅极(节点Na)，且重置开关Tc是连接于补偿开关T51、T52之间。在各帧周期的写入期间(如：写入期间P13、P23)，补偿开关T51、T52将被导通，以将补偿信号通过补偿开关T51、T52传送至驱动晶体管Ta的栅极。
此外，在图2A所示的实施例中，重置开关Tc是连接于补偿开关T51、T52之间。然而，在其他实施例中，重置开关Tc亦可直接连接于节点Na。当第一重置期间(即，P12、P22)，重置开关Tc导通，即可使对应的存储元件(即，C1或C2)上的信号通过对应的开关元件(即，T1或T2)及重置开关Tc进行重置。
前述各实施例中的各项元件、方法步骤或技术特征，是可相互结合，而不以本公开内容中的文字描述顺序或附图呈现顺序为限。
虽然本公开内容已以实施方式公开如上，然其并非用以限定本公开内容，任何本领域技术人员，在不脱离本公开内容的构思和范围内，当可作各种变动与润饰，因此本公开内容的保护范围当视权利要求所界定者为准。

Claims (20)

1.一种像素电路，包含：
一发光元件；
一驱动电路，电性连接于该发光元件；
一第一数据存储电路，电性连接于该驱动电路，其中该第一数据存储电路用以在一第一帧周期时将一第一数据信号传送至该驱动电路，使该驱动电路根据该第一数据信号驱动该发光元件；以及
一第二数据存储电路，电性连接于该驱动电路，其中该第二数据存储电路用以在该第一帧周期时接收一第二数据信号。
2.如权利要求1所述的像素电路，其中在一第二帧周期时，该第一数据存储电路用以接收一第三数据信号，且该第二数据存储电路用以将该第二数据信号传送至该驱动电路，使该驱动电路根据该第二数据信号驱动该发光元件。
3.如权利要求2所述的像素电路，其中该第一数据存储电路包含：
一第一存储元件，用以存储该第一数据信号；以及
一第一开关元件，电性连接于该第一存储元件，其中该第一开关元件在该第一帧周期时导通，使该第一存储元件存储的该第一数据信号被传送至该驱动电路。
4.如权利要求3所述的像素电路，其中该第二数据存储电路包含：
一第二存储元件，用以存储该第二数据信号；以及
一第二开关元件，电性连接于该第二存储元件，其中该第二开关元件在该第二帧周期时导通，使该第二存储元件存储的该第二数据信号被传送至该驱动电路。
5.如权利要求4所述的像素电路，其中在该第一帧周期中的一发亮期间，该第一开关元件导通、该第二开关元件关断；在该第一帧周期中的一写入期间，该第一开关元件关断、该第二开关元件导通。
6.如权利要求4所述的像素电路，其中在该第一帧周期中的一写入期间，该第二开关元件导通，以接收该第二数据信号，且该驱动电路通过一补偿电路及该第二数据存储电路，接收一补偿信号。
7.如权利要求1所述的像素电路，还包含：
一补偿电路，电性连接于该驱动电路、该第一数据存储电路及该第二数据存储电路，其中在该第一帧周期中的一写入期间，该补偿电路中的一补偿开关被导通，以将一补偿信号传送至该驱动电路。
8.一种像素电路驱动方法，包含：
在一第一帧周期时，从一第一数据存储单元接收一第一数据信号，且根据该第一数据信号驱动一发光元件；
在该第一帧周期时，通过一第二数据存储单元接收并存储一第二数据信号；
在一第二帧周期时，从该第二数据存储单元接收该第二数据信号，且根据该第二数据信号驱动该发光元件；以及
在该第二帧周期时，通过该第一数据存储单元接收并存储一第三数据信号。
9.如权利要求8所述的像素电路驱动方法，其中根据该第一数据信号驱动该发光元件的步骤包含：
在该第一帧周期中的一发光期间，导通与该第一数据存储单元相电性串联的一第一开关元件，使该第一数据信号被传送至一驱动电路，其中该驱动电路电性连接于该发光元件。
10.如权利要求9所述的像素电路驱动方法，其中根据该第一数据信号驱动该发光元件的步骤还包含：
在该第一帧周期中的该发光期间，关断与该第二数据存储单元相电性串联的一第二开关元件。
11.如权利要求10所述的像素电路驱动方法，其中通过该第二数据存储单元接收并存储该第二数据信号的步骤包含：
在该第一帧周期中的一写入期间，导通该第二开关元件。
12.如权利要求11所述的像素电路驱动方法，其中该发光期间是位于该写入期间之前。
13.如权利要求11所述的像素电路驱动方法，还包含：
在该第一帧周期的该写入期间，关断该第一开关元件。
14.如权利要求13所述的像素电路驱动方法，还包含：
在该第一帧周期的该写入期间，导通一补偿电路及该第二开关元件，使该驱动电路通过该补偿电路及该第二数据存储电路接收补偿信号，其中该补偿电路是电性连接于该驱动电路及该第二数据存储电路之间。
15.一种像素电路，包含：
一发光元件；
一驱动电路，电性连接于该发光元件；
一第一数据存储电路，电性连接于该驱动电路，其中该第一数据存储电路用以在一第一帧周期时将一第一数据信号传送至该驱动电路，使该驱动电路根据该第一数据信号驱动该发光元件；以及
一第二数据存储电路，并联于该第一数据存储电路，其中该二数据存储电路用以在一第二帧周期时将一第二数据信号传送至该驱动电路，使该驱动电路根据该第二数据信号驱动该发光元件。
16.如权利要求15所述的像素电路，其中在该第一帧周期时，该第二数据存储电路用以接收该第二数据信号；在该第二帧周期时，该第一数据存储电路用以接收一第三数据信号，该第一数据存储电路用以在一第三帧周期时将该第三数据信号传送至该驱动电路，使该驱动电路根据该第三数据信号驱动该发光元件。
17.如权利要求16所述的像素电路，其中该第一数据存储电路包含：
一第一存储元件，用以存储该第一数据信号；以及
一第一开关元件，电性连接于该第一存储元件，其中该第一开关元件在该第一帧周期时导通，使该第一存储元件存储的该第一数据信号被传送至该驱动电路。
18.如权利要求17所述的像素电路，其中该第二数据存储电路包含：
一第二存储元件，用以存储该第二数据信号；以及
一第二开关元件，电性连接于该第二存储元件，其中该第二开关元件在该第二帧周期时导通，使该第二存储元件存储的该第二数据信号被传送至该驱动电路。
19.如权利要求18所述的像素电路，其中在该第一帧周期中的一发亮期间，该第一开关元件导通、该第二开关元件关断；在该第一帧周期中的一写入期间，该第一开关元件关断、该第二开关元件导通。
20.如权利要求18所述的像素电路，其中在该第一帧周期中的一写入期间，该第二开关元件导通，以接收该第二数据信号，且该驱动电路通过一补偿电路及该第二数据存储电路，接收一补偿信号。
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