CN112349250A - 一种显示面板以及驱动方法 - Google Patents

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Abstract

本发明公开了一种显示面板以及驱动方法。像素驱动电路包括驱动晶体管、至少两个数据写入模块，以及发光控制模块；各所述数据写入模块用于分时向所述驱动晶体管提供数据信号；所述发光控制模块分别与所述驱动晶体管以及发光元件串联，用于控制驱动电流是否流过所述发光元件；本发明实施例可以解决像素驱动电路的驱动晶体管充电不足引起的闪烁问题。

Description

一种显示面板以及驱动方法
技术领域
本发明涉及显示面板领域，尤其涉及一种显示面板以及驱动方法。
背景技术
有机发光显示装置具有自发光、驱动电压低、发光效率高、响应速度快、轻薄、对比度高等优点，被认为是下一代最具有发展潜力显示装置。
有机发光显示装置中的像素包括像素驱动电路。像素驱动电路中的驱动晶体管可产生驱动电流，发光元件响应该驱动电流而发光。但是栅极驱动电路扫描脉宽的限制，在像素驱动电路的数据写入阶段过短，导致像素驱动电路的驱动晶体管栅极充电不充分，引起发光初始阶段发光亮度较大。尤其在低灰阶下，像素驱动电路的驱动晶体管充电不足会使人眼察觉出画面闪烁。
发明内容
本发明实施例提供一种显示面板以及驱动方法，以解决像素驱动电路的驱动晶体管充电不足引起的闪烁问题。
第一方面，本发明实施例提供了一种显示面板，包括阵列排布的多个子像素；每个所述子像素包括发光元件和像素驱动电路；
所述像素驱动电路包括：
驱动晶体管、至少两个数据写入模块，以及发光控制模块；
各所述数据写入模块用于分时向所述驱动晶体管提供数据信号；
所述发光控制模块分别与所述驱动晶体管以及发光元件串联，用于控制驱动电流是否流过所述发光元件。
第二方面，本发明实施例还提供了一种显示面板的驱动方法，适用于第一方面所述的显示面板，所述显示面板的驱动周期包括数据写入阶段和发光阶段；所述数据写入阶段包括至少两个子数据写入阶段；所述驱动方法包括：
S10、在所述数据写入阶段的各子数据写入阶段，各所述数据写入模块分时向所述驱动晶体管提供数据信号；
S20、在所述发光阶段；发光控制模块控制驱动电流流过发光元件。
本发明实施例提供的显示面板，通过在像素驱动电路中设置至少两个数据写入模块，各所述数据写入模块用于分时向所述驱动晶体管提供数据信号，可以提高像素驱动电路的驱动晶体管的充电率，解决充电不充分导致的闪烁现象。
附图说明
图1为本发明实施例提供的一种显示面板的结构示意图；
图2为本发明实施例提供的一种像素驱动电路的结构示意图；
图3为本发明实施例提供的又一种像素驱动电路的结构示意图；
图4为本发明实施例提供的又一种像素驱动电路的结构示意图；
图5为本发明实施例提供的又一种像素驱动电路的结构示意图；
图6为本发明实施例提供的又一种像素驱动电路的结构示意图；
图7为本发明实施例提供的又一种像素驱动电路的结构示意图；
图8为本发明实施例提供的又一种像素驱动电路的结构示意图；
图9为本发明实施例提供的又一种像素驱动电路的结构示意图；
图10为本发明实施例提供的又一种像素驱动电路的结构示意图；
图11为本发明实施例提供的又一种像素驱动电路的结构示意图；
图12为本发明实施例提供的又一种像素驱动电路的结构示意图；
图13为本发明实施例提供的又一种像素驱动电路的结构示意图；
图14为本发明实施例提供的又一种像素驱动电路的结构示意图；
图15为本发明实施例提供的又一种像素驱动电路的结构示意图；
图16为本发明实施例提供的一种显示面板的驱动方法的流程示意图；
图17为本发明实施例提供的一种显示面板的驱动时序图；
图18为本发明实施例提供的又一种显示面板的驱动时序图；
图19为本发明实施例提供的又一种显示面板的驱动时序图；
图20为本发明实施例提供的又一种显示面板的驱动时序图；
图21为本发明实施例提供的又一种显示面板的驱动时序图；
图22为本发明实施例提供的又一种显示面板的驱动时序图；
图23为本发明实施例提供的又一种显示面板的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
本发明实施例提供一种显示面板，图1为本发明实施例提供的一种显示面板的结构示意图，如图1所示，包括阵列排布的多个子像素10。每个子像素10包括发光元件11和像素驱动电路12。图2为本发明实施例提供的一种像素驱动电路的结构示意图，如图2所示，像素驱动电路包括驱动晶体管D、至少两个数据写入模块121(图2中示例性的设置两个数据写入模块)，以及发光控制模块122。各数据写入模块用于分时向驱动晶体管D提供数据信号。发光控制模块122分别与驱动晶体管D以及发光元件11串联，用于控制驱动电流是否流过发光元件11。
由于控制数据写入的扫描信号脉冲比较短，因此在该阶段进行数据写入的充电会不充分，即驱动晶体管的控制端(栅极)的电位会小于理想电位Vdata-|Vth|，而驱动晶体管驱动发光元件的电流公式如下：
I＝K(Vsg-|Vth|)2＝K[PVDD-(Vdata-|Vth|)-|Vth|]2＝K(PVDD-Vdata)2。
其中，
Figure BDA0002789628250000041
表示μp为空穴迁移率，Cox为单位面积的电容，
Figure BDA0002789628250000042
为沟道宽长比。Vsg表示驱动晶体管的源极与栅极电压差。PVDD表示电源电压，Vth表示驱动晶体管的阈值电压。Vdata表示数据信号电压。若数据写入后，驱动晶体管的栅极的电位小于理想电位Vdata-|Vth|，那么根据驱动晶体管驱动发光元件的电流公式可知，在发光的初始阶段，电流I会变大，因此人眼会感知子像素在发光初始阶段突然变亮。尤其对于低灰阶显示时，低灰阶下的Vdata电压相对于高灰阶要高，将驱动晶体管的栅极电位充到Vdata-|Vth|需要较长的时间，因此，充电时间不足会更严重。而且低灰阶由于亮度很低，由于充电不足引起的亮度差异，人眼感知的会更明显。例如充电不足引起的亮度差异为10nit，人眼感知的低灰阶时10nit和20nit的差异会明显大于高灰阶下的300nit和310nit的差异。
因此本发明实施例通过在像素驱动电路中设置至少两个数据写入模块，在发光阶段之前，各数据写入模块分时向所述驱动晶体管提供数据信号，通过多次进行数据写入的方式，增加充电时间，实现在发光阶段前将数据信号充分写入至驱动晶体管中，避免充电不充分导致发光初始阶段亮度较大导致的闪烁问题。
可选的，本发明实施例中的数据写入模块可以通过驱动晶体管的源极写入数据信号，即相当于源极写入模块。也可以通过驱动晶体管的漏极写入数据信号，即相当于漏极写入模块。参见图3，本发明实施例以像素驱动电路包括两个数据写入模块为例进行介绍。为方便描述，将两个数据写入模块分别标记为第一数据写入模块1211和第二数据写入模块1212，并示例性的设置第一数据写入模块1211通过驱动晶体管的源极写入数据信号，第二数据写入模块1212通过驱动晶体管的漏极写入数据信号。第一数据写入模块1211和第二数据写入模块1212均可以包括第一晶体管M1和第二晶体管M2。第一晶体管M1用于将数据信号端Vdata输入的数据信号写入驱动晶体管D。第二晶体管M2用于检测和自补偿驱动晶体管D的阈值电压的偏差。
若数据写入模块通过驱动晶体管的源极写入数据信号，例如图3中的第一数据写入模块1211，第一晶体管M1的第一端与数据信号端Vdata电连接，第一晶体管M1的第二端与驱动晶体管D的第一端(驱动晶体管D的源极)电连接。第二晶体管M2的第一端与驱动晶体管D的第二端(驱动晶体管D的漏极)电连接，第二晶体管M2的第二端与驱动晶体管D的控制端电连接。第二晶体管M2的第一端与数据信号端Vdata电连接。
若数据写入模块通过驱动晶体管的漏极写入数据信号，例如图3中的第二数据写入模块1212，第一晶体管M1的第一端与数据信号端Vdata电连接，第一晶体管M1的第二端与驱动晶体管D的第二端(驱动晶体管D的漏极)电连接，第二晶体管M2的第一端与驱动晶体管的第一端(驱动晶体管D的源极)电连接。
第一数据写入模块1211中第二晶体管M2串联在驱动晶体管D的控制端与驱动晶体管D的第二端之间，第二数据写入模块1212中的第二晶体管M2串联在驱动晶体管D的控制端与驱动晶体管D的第一端之间，均用于检测和自补偿驱动晶体管D的阈值电压的偏差。像素驱动电路通过驱动晶体管D的控制端上的电压控制驱动晶体管驱动发光元件11发光的驱动电流。但是由于工艺、老化等原因会造成驱动晶体管的阈值Vth漂移和迁移率衰减，各个像素驱动电路中驱动晶体管的特性不一致，显示面板上会产生显示不均匀。第二晶体管通过检测和自补偿所述驱动晶体管的阈值电压的偏差，缓解甚至消除阈值电压对于的驱动电流的影响，从而可避免流过发光元件的驱动电流受到阈值电压不均匀和漂移的影响，进而有效的提高了流过发光元件的驱动电流的均匀性。
在其他实施方式中，像素驱动电路中的各数据写入模块可以均为通过驱动晶体管的源极写入数据信号。像素驱动电路中的各数据写入模块也可以均为通过驱动晶体管的漏极写入数据信号。亦或者，根据产品实际需求设置像素驱动电路的各数据写入模块中通过驱动晶体管的源极写入数据信号的数据写入模块数量，以及设置通过驱动晶体管的漏极写入数据信号的数据写入模块数量。如图4所示，像素驱动电路中的两个数据写入模块(第一数据写入模块1211以及第二数据写入模块1212)均为通过驱动晶体管的源极写入数据信号。如图5所示，像素驱动电路中的两个数据写入模块(第一数据写入模块1211以及第二数据写入模块1212)均为通过驱动晶体管的漏极写入数据信号。图3仅示例性的设置2个数据写入模块，一个数据写入模块为通过驱动晶体管的源极写入数据信号，一个数据写入通过驱动晶体管的漏极写入数据信号。本发明实施例对像素驱动电路中的数据写入模块的数量不做限定，且对像素驱动电路中的各数据写入模块中，通过驱动晶体管的源极写入数据信号的数据写入模块的数量，以及，通过驱动晶体管的漏极写入数据信号的数据写入模块的数量不做限定。
在上述各实施例的基础上，可选的，同一数据写入模块的第一晶体管和第二晶体管的控制端电连接。即同一数据写入模块中的第一晶体管和第二晶体管共用同一控制信号，同时导通或同时关断。这样设置可以减少显示面板中控制信号线的设置数量。例如参见图3-图5，第一数据写入模块1211的第一晶体管M1和第二晶体管M2的控制端电连接，第二数据写入模块1212的第一晶体管M1和第二晶体管M2的控制端电连接。
在上述各实施例的基础上，可选的，本发明实施例中像素驱动电路若包括两个数据写入模块，分别标记为第一数据写入模块和第二数据写入模块，第一数据写入模块中的第一晶体管的控制端和第二晶体管的控制端均与第二扫描信号端电连接；第二数据写入模块中的第一晶体管的控制端和第二晶体管的控制端均与第三扫描信号端电连接；为减少显示面板中的信号线数量，可以设置第三扫描信号端与下一行子像素中像素驱动电路的第二扫描信号端电连接。例如参见图6。图6示例性的设置第一数据写入模块1211和第二数据写入模块1212可以均通过驱动晶体管的源极写入数据信号。需要说明的是，第一数据写入模块和第二数据写入模块可以均通过驱动晶体管的源极写入数据信号，可以均通过驱动晶体管的漏极写入数据信号，也可以一个数据写入模块通过驱动晶体管的源极写入数据信号，另一个通过驱动晶体管的漏极写入数据信号。
本发明实施例将第一数据写入模块1211中的第一晶体管M1的控制端和第二晶体管M2的控制端均与第二扫描信号端S2电连接；第二数据写入模块1212中的第一晶体管M1的控制端和第二晶体管M2的控制端均与第三扫描信号端S3电连接。第三扫描信号端S3与下一行子像素中像素驱动电路的第二扫描信号端S2电连接。由于显示面板中设置有阵列排布的像素单元，每个像素单元包括像素驱动电路以及发光元件。每个驱动周期中像素驱动电路可以通过逐行扫描的方式实现驱动，为减少显示面板中信号线的数量，可以通过设置第i行子像素中像素驱动电路的第三扫描信号端S3电连接与第i+1行子像素中像素驱动电路的第二扫描信号端S2电连接。其中，i为正整数。此外，第i行子像素中像素驱动电路的第二数据写入模块进行数据写入时，同时第i+1行子像素中像素驱动电路的第一数据写入模块也进行数据写入，这样可以避免由于增加数据写入的次数导致显示画面刷新频率降低。
在上述各实施例的基础上，可选的，本发明实施例中的像素驱动电路还可以包括第一复位模块。例如参见图3-图6，第一复位模块123与驱动晶体管D的控制端电连接；第一复位模块123用于对驱动晶体管的控制端复位。为了防止前一帧画面显示时，驱动晶体管D的控制端的电压影响下一帧画面的显示，本发明实施例在向驱动晶体管D提供数据信号之前，先对驱动晶体管D的控制端进行复位。在向驱动晶体管D提供数据信号之前，第一复位模块123导通，对驱动晶体管D的控制端复位。
可选的，第一复位模块123包括第三晶体管M3。第三晶体管M3串联于驱动晶体管D的控制端与第一复位信号端Vref1之间。第三晶体管M3导通后，将第一复位信号端Vref1输入的复位信号传输至驱动晶体管D的控制端，对驱动晶体管D的控制端复位。
在上述各实施例的基础上，可选的，本发明实施例中的像素驱动电路还可以包括第二复位模块。例如参见图3-图6，第二复位模块124与发光元件11电连接，用于对发光元件11复位。在发光阶段前，可以通过第二复位模块124对发光元件上的电极电压在进行复位，防止上一驱动周期中发光元件的电极上的电位影响本次驱动周期的画面显示。
可选的，第二复位模块124包括第四晶体管M4。第四晶体管M4串联于第二复位信号端Vref2与发光元件11之间。
可选的，第四晶体管M4的控制端与第四扫描信号端S4电连接。第四扫描信号端S4输入的第四扫描信号控制第四晶体管M4导通时，第四晶体管M4将第二复位信号端Vref2输入的复位信号传输至发光元件11。
为减少显示面板中信号线的数量，第四扫描信号端S4可以与任一数据写入模块中的第一晶体管M1的控制端，或第二晶体管M2的控制端电连接。例如参见图6和图7，第四扫描信号端S4与第一数据写入模块1211的第二晶体管M2的控制端电连接，在第一数据写入模块1211进行数据写入时，控制第四晶体管M4导通，实现对发光元件电极的复位。
需要说明的是，在其他实施方式中，还可以根据实际产品需求，例如显示面板中布线的设置等要求，选择第四扫描信号端与像素驱动电路中的哪个数据写入模块中第一晶体管或第二晶体管的控制端电连接。
可选的，第一复位模块123的第三晶体管M3串联于驱动晶体管D的控制端与第一复位信号端Vref1之间。第四晶体管M4的控制端与第四扫描信号端S4电连接；第三晶体管M3的控制端与第一扫描信号端S1电连接；第四扫描信号端S4还可以与第一扫描信号端S1电连接。例如如图8所示，将四扫描信号端S4还可以与第一扫描信号端S1电连接，即第一扫描信号端S1的第一扫描信号同时控制第三晶体管M3以及第四晶体管M4的导通与关断，第一复位模块123和第二复位模块124同时进行复位操作。这样设置同样可以减少显示面板中的信号线数量。
可选的，为进一步减少显示面板中的信号线数量，还可以设置第一复位信号端与第二复位信号端电连接。例如参见图9，第一复位模块123与第二复位模块124可使用同一复位信号线获取复位信号。
在上述各实施例的基础上，可选的，发光控制模块包括第五晶体管M5和第六晶体管M6。第五晶体管M5的第一端与第一电源信号端PVDD电连接，第五晶体管M5的第二端与驱动晶体管D的第一端电连接；第六晶体管M6的第一端与驱动晶体管D的第二端电连接；第六晶体管M6的第二端与发光元件11电连接。在数据写入阶段以及数据写入阶段之前的阶段，第五晶体管M5和第六晶体管M6关断；在发光阶段，第五晶体管M5和第六晶体管M6导通，以使驱动晶体管D驱动发光元件发光。
可选的,参见图10，第五晶体管M5的控制端与第一发光控制信号输入端Emit1电连接；第六晶体管M6的控制端与第二发光控制信号输入端Emit2电连接。由于第五晶体管M5和第六晶体管M6的控制端连接不同发光控制信号输入端，因此第一发光控制信号输入端Emit1输入的时序和第二发光控制信号输入端Emit2输入的时序可以相同也可以不同。例如在对驱动晶体管D的控制端复位时，通过第二发光控制信号输入端Emit2输入的时序控制第六晶体管M6打开，以使发光元件11也实现复位。
可选的，第五晶体管M5的控制端和第六晶体管M6的控制端可以连接同一发光控制信号输入端Emit，如图3-图9所示。即通过同一发光控制信号控制第五晶体管M5和第六晶体管M6的导通和关断。这样设置可以减少面板中走线的数量。
在上述各实施例的基础上，可选的，本发明实施例提供的显示面板的像素驱动电路还包括第三复位模块；第三复位模块与驱动晶体管的第一端电连接；第三复位模块用于对驱动晶体管的第一端复位。
例如参见图11，第三复位模块125在数据写入前导通，对驱动晶体管D的第一端复位，从而使数据写入阶段时，驱动晶体管D的控制端和第一端的电位差接为零。因此不论前一帧画面的灰阶是多少，切换到下一帧时，在数据写入之前，驱动晶体管D的控制端和第一端的电位差都为相同值，因此可以避免前一帧画面导致的残影问题。
可选的，例如参见图11，第三复位模块125包括第七晶体管M7。第七晶体管M7的第一端与驱动晶体管D的控制端电连接，第七晶体管M7的第二端与驱动晶体管D的第一端电连接。第七晶体管M7导通后，驱动晶体管D的控制端与驱动晶体管D的第一端的电位相同。
可选的，本发明实施例还可以设置第七晶体管M7的控制端与第三晶体管M3的控制端电连接。例如如图11所示，第一扫描信号端S1输入的第一扫描信号同时控制第七晶体管M7以及第三晶体管M3的导通或关断。在第一复位模块对驱动晶体管的控制端复位的同时，实现对驱动晶体管的第一端复位。这样设置无线分别为第七晶体管M7以及第三晶体管M3设置控制信号线，因此可以减小显示面板中的信号线数量。
可选的，本发明实施例提供的显示面板的像素驱动电路还可以包括选通模块，选通模块包括第三复位信号端、数据信号端、第一控制端、第二控制端和输出端。选通模块的输出端与一数据写入模块电连接。选通模块用于在第一控制端输入的第一控制信号以及第二控制端输入的第二控制信号的控制下，将第三复位信号端输入的第三复位信号或将数据信号端输入的数据信号传输至与其电连接数据写入模块。
例如参见图12，选通模块126包括第三复位信号端Vref3、数据信号端Vdata、第一控制端P1、第二控制端P2和输出端OUT。选通模块126的输出端OUT与一数据写入模块电连接。图12中示例性的设置与第二数据写入模块1212电连接。选通模块126用于在第一控制端P1输入的第一控制信号以及第二控制端P2输入的第二控制信号的控制下，将第三复位信号端Vref3输入的复位信号或将数据信号端Vdata输入的数据信号传输至第二数据写入模块1212。例如，第一控制信号为有效脉冲，第二控制信号为无效脉冲时，将第三复位信号端Vref3输入的复位信号传输至第二数据写入模块1212，第二数据写入模块1212将第三复位信号端Vref3输入的复位信号传输至驱动晶体管的第二端。第一控制信号为无效脉冲，第二控制信号为有效脉冲时，将数据信号端Vdata输入的数据信号传输至第二数据写入模块1212，第二数据写入模块1212将数据信号端Vdata输入的数据信号传输至驱动晶体管的第二端，从而分时实现驱动晶体管第二端复位和数据写入。
需要说明的是，图12示例性的设置选通模块的输出端与第二数据写入模块电连接，该第二数据写入模块通过驱动晶体管的漏极进行数据写入。在其他实施方式中，选通模块可以与像素驱动电路中的任意一个数据写入模块电连接，该数据写入模块可以是通过驱动晶体管的漏极进行数据写入，也可以是通过驱动晶体管的源极进行数据写入。此外，在其他实施方式中，还可以在像素驱动电路中同时设置第三复位模块和选通模块，第三复位模块实现对驱动晶体管的第一端复位，选通模块分时实现驱动晶体管第二端复位和数据写入。
可选的，例如参见图12，选通模块126包括第八晶体管M8和第九晶体管M9。第八晶体管M8的第一端与第三复位信号端Vref3电连接。第八晶体管M8的第二端与选通模块126的输出端OUT电连接。第八晶体管M8的控制端与第一控制端P1电连接。第九晶体管M9的第一端与数据信号端Vdata电连接。第九晶体管M9的第二端与选通模块126的输出端OUT电连接。第九晶体管M9的控制端与第二控制端P2电连接。第一控制端P1输入有效脉冲，第二控制端P2输入无效脉冲时，第八晶体管M8导通，第九晶体管M9断开，第八晶体管M8将第三复位信号端Vref3输入的复位信号传输至第二数据写入模块1212中的第一晶体管M1，第一晶体管M1导通时，将第三复位信号端Vref3输入的复位信号传输至驱动晶体管D的第二端。第一控制端P1输入无效脉冲，第二控制端P2输入有效脉冲时，第八晶体管M8断开，第九晶体管M9导通，第九晶体管M9将数据信号端Vdata输入的数据信号传输至第二数据写入模块1212中的第一晶体管M1，第一晶体管M1导通时，将数据信号端Vdata输入的数据信号传输至驱动晶体管D的第二端。
可选的，为减少信号线数量，可以设置第一控制端与第二控制端电连接；第八晶体管和第九晶体管的导电类型相反，例如参见图13，第一控制端P1与第二控制端P2电连接，通过同一信号线分时控制第八晶体管和第九晶体管的导通与关断。图13以第八晶体管M8为P型晶体管，第九晶体管M9为N型晶体管为例，若第一控制端P1与第二控制端P2获取的控制信号为低电平，第八晶体管M8导通，第九晶体管M9关断，第八晶体管M8将第三复位信号端Vref3输入的复位信号传输至第二数据写入模块1212中的第一晶体管M1，在第三扫描线信号为低电平时，第一晶体管M1导通时，将第三复位信号端Vref3输入的复位信号传输至驱动晶体管D的第二端。若第一控制端P1与第二控制端P2获取的控制信号为高电平，第八晶体管M8断开，第九晶体管M9导通，第九晶体管M9将数据信号端Vdata输入的数据信号传输至第二数据写入模块1212中的第一晶体管M1，在第三扫描线信号为低电平时，第一晶体管M1导通时，将数据信号端Vdata输入的数据信号传输至驱动晶体管D的第二端。
可选的，本发明实施例还可以设置第一控制端P1以及第二控制端P2均与第一复位模块123的第一扫描信号端S1电连接。例如参见图14，将第一控制端P1以及第二控制端P2均与第一复位模块123的第一扫描信号端S1电连接，可进一步减少显示面板中的信号线数量。在第一复位模块123复位的同时，第三复位模块126实现对驱动晶体管第一端或第二端的复位(图14示例性的设置第三复位模块126实现对驱动晶体管第二端复位)。
可选的，本发明实施例可以设置第一复位信号端Vref1与第三复位信号端Vref3电连接。例如参见图15。
基于同一发明构思，本发明实施例还提供一种显示面板的驱动方法，图16为本发明实施例提供的一种显示面板的驱动方法的流程示意图，图17为本发明实施例提供的一种显示面板的驱动时序图。本发明实施例中显示面板的驱动周期包括数据写入阶段T2和发光阶段T3。数据写入阶段T2包括至少两个子数据写入阶段,图17示例性的设置数据写入阶段T2包括至少两个子数据写入阶段，分别为第一子数据写入阶段T21和第二子数据写入阶段T22。
S10、在所述数据写入阶段的各子数据写入阶段，各所述数据写入模块分时向所述驱动晶体管提供数据信号。
以图3所示像素驱动电路的结构为例，结合图17，在数据写入阶段T2中，像素驱动电路中的第一数据写入模块1211在第一子数据写入阶段T21向驱动晶体管D提供数据信号，像素驱动电路中的第二数据写入模块1212在第二子数据写入阶段T22向驱动晶体管D提供数据信号。
S20、在所述发光阶段，发光控制模块控制驱动电流流过发光元件。
本发明实施例通过在像素驱动电路中设置至少两个数据写入模块，在发光阶段之前，各数据写入模块在数据写入阶段的各子数据写入阶段分时向驱动晶体管提供数据信号，通过多次进行数据写入的方式，增加充电时间，实现在发光阶段前将数据信号充分写入至驱动晶体管中，数据写入模块充分进行驱动晶体管的阈值抓取补偿，避免充电不充分导致发光初始阶段亮度较大导致的闪烁问题。
可选的，在上述实施例的基础上，像素驱动电路还包括第一复位模块；在数据写入阶段T2前还包括初始化阶段T1：
S00、在所述初始化阶段，所述第一复位模块对所述驱动晶体管的控制端复位。
例如参见图3-图6所示的像素驱动电路，在数据写入阶段T2前，第一复位模块123导通，对驱动晶体管的控制端复位，防止前一帧画面显示时，驱动晶体管D的控制端的电压影响下一帧画面的显示。图17中以S1表示第一扫描信号，用来控制第一复位模块123导通或关断。
可选的，上述各实施中的像素驱动电路若包括第二复位模块，第二复位模块与发光元件电连接，用于对发光元件进行复位。本发明实施例提供的驱动方法中，在发光阶段T3以外的其他阶段中至少部分时间段，第二复位模块对发光元件复位。例如参见图18，第四扫描信号S4控制第二复位模块的导通或关断，在初始化阶段T1以及在数据写入阶段T2，第四扫描信号S4控制第二复位模块导通，对发光元件复位。
图19为本发明实施例提供的又一种驱动时序图，参见图19，若第四扫描信号端与第二扫描信号端电连接，在第一子数据写入阶段T21，第四扫描信号S4(或者第二扫描信号S2)控制第二复位模块导通，对发光元件复位。
图20为本发明实施例提供的又一种驱动时序图，参见图19，若第四扫描信号端与第一扫描信号端电连接，在初始化阶段T1，第四扫描信号S4(或者第一扫描信号S2)控制第二复位模块导通，对发光元件复位。
若像素驱动电路包括两个数据写入模块，分别为第一数据写入模块和第二数据写入模块，第一数据写入模块中的第一晶体管的控制端和第二晶体管的控制端与第二扫描信号端电连接；第二数据写入模块中的第一晶体管的控制端和第二晶体管的控制端与第三扫描信号端电连接；第i行子像素的像素驱动电路中第三扫描信号端与第i+1行子像素的像素驱动电路中第二扫描信号端电连接。以图6的像素驱动电路为例，其驱动时序参见图21。图21为本发明实施例提供的相邻2行子像素的一种驱动时序。相邻的两行子像素分别表示为第i行子像素、第i+1行子像素。数据写入阶段T2包括第一子数据写入阶段T21和第二子数据写入阶段T22。第i行子像素执行第二子数据写入阶段T22之时，第i+1行子像素执行第一子数据写入阶段T21，i为正整数。其中，S1,S2,S3,S4,Emit的下标表示子像素的行序号。
若像素驱动电路包括第三复位模块；第三复位模块与驱动晶体管的第一端电连接，第三复位模块用于在数据写入阶段之前，对驱动晶体管的第一端复位。若如图11所示像素驱动电路中第三复位模块125中的第七晶体管M7的控制端与第一复位模块123的第三晶体管M3的控制端连接同一信号线，第七晶体管M7和第三晶体管M3均由第一扫描信号S1控制，驱动晶体管的控制端和第一端在初始化阶段同时实现复位。
结合图4和图18，下面详细说明本实施例的像素驱动电路的工作过程。
S00、在初始化阶段，第一扫描信号S1为有效电平，控制第三晶体管M3导通，第三晶体管M3将第一复位信号端Vref1输入的复位信号传输至驱动晶体管的控制端，对驱动晶体管的控制端进行复位，防止前一帧画面显示时，驱动晶体管的控制端的电压影响下一帧画面的显示。
S10、数据写入阶段T2包括第一子数据写入阶段T2和第二子数据写入阶段T22。在第一子数据写入阶段T21，第二扫描信号S2为有效电平，控制第一数据写入模块1211的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第一数据写入模块1211的第一晶体管M1、驱动晶体管D以及第一数据写入模块1211的第二晶体管M2写入驱动晶体管D的控制端，即通过驱动晶体管的源极进行第一次数据写入。在第二子数据写入阶段T22，第三扫描信号S3为有效电平，控制第二数据写入模块1212的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第二数据写入模块1212的第一晶体管M1、驱动晶体管D以及第二数据写入模块1212的第二晶体管M2写入驱动晶体管D的控制端，即再次通过驱动晶体管的源极进行第二次数据写入。
参见图18，第四扫描信号S4在初始化阶段T1以及在数据写入阶段T2均为有效电平，第四扫描信号S4控制第四晶体管M4导通，实现对发光元件11复位。
S20、在发光阶段T3，发光控制信号Emit为有效电平，第一扫描信号S1、第二扫描信号S2、第三扫描信号S3、第四扫描信号S4均为无效电平，发光控制模块122中的第五晶体管M5以及第六晶体管M6导通，第一数据写入模块1211的第一晶体管M1和第二晶体管M2，第二数据写入模块1212中的第一晶体管M1以及第二晶体管M2，第一复位模块123的第三晶体管M3，第二复位模块124的第四晶体管M4均关断，第五晶体管M5将电源电压信号PVDD传输至驱动晶体管D的第一端，驱动晶体管D导通，驱动发光元件11发光。
图5所示像素驱动电路的驱动时序可以与图18类似，与图4所示像素驱动电路不同的是，图5中的两次子数据写入阶段均是通过驱动晶体管的漏极(驱动晶体管的第二端)进行数据写入。
以下结合图7和图19，下面详细说明本实施例的像素驱动电路的工作过程。
S00、在初始化阶段，第一扫描信号S1为有效电平，控制第三晶体管M3导通，第三晶体管M3将第一复位信号端Vref1输入的复位信号传输至驱动晶体管的控制端，对驱动晶体管的控制端进行复位，防止前一帧画面显示时，驱动晶体管的控制端的电压影响下一帧画面的显示。
S10、数据写入阶段T2包括第一子数据写入阶段T2和第二子数据写入阶段T22。在第一子数据写入阶段T21，第二扫描信号S2为有效电平，控制第一数据写入模块1211的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第一数据写入模块1211的第一晶体管M1、驱动晶体管D以及第一数据写入模块1211的第二晶体管M2写入驱动晶体管D的控制端，即通过驱动晶体管的源极进行第一次数据写入。
由于第二复位模块124的第四晶体管M4的第四扫描信号端与第一数据写入模块1211的第二扫描信号端电连接，因此第二扫描信号S2为有效电平时，第四晶体管M4导通，第四晶体管M4将第二复位信号电Vref2传输至发光元件，实现发光元件的电极复位。
在第二子数据写入阶段T22，第三扫描信号S3为有效电平，控制第二数据写入模块1212的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第二数据写入模块1212的第一晶体管M1、驱动晶体管D以及第二数据写入模块1212的第二晶体管M2写入驱动晶体管D的控制端，通过驱动晶体管的漏极进行第二次数据写入。
本发明实施例中两次数据写入过程中，流经驱动晶体管的电流方向不同，因此可以在一定程度上抑制驱动晶体管D Id-Vg曲线生偏移引起的迟滞效应。
S20、在发光阶段T3，发光控制信号Emit为有效电平，第一扫描信号S1、第二扫描信号S2、第三扫描信号S3、第四扫描信号S4均为无效电平，发光控制模块122中的第五晶体管M5以及第六晶体管M6导通，第一数据写入模块1211的第一晶体管M1和第二晶体管M2，第二数据写入模块1212中的第一晶体管M1以及第二晶体管M2，第一复位模块123的第三晶体管M3，第二复位模块124的第四晶体管M4均关断，第五晶体管M5将电源电压信号PVDD传输至驱动晶体管D的第一端，驱动晶体管D导通，驱动发光元件11发光。
以下结合图14和图22，下面详细说明本实施例的像素驱动电路的工作过程。
S00、在初始化阶段，第一扫描信号S1为有效电平，控制第三晶体管M3导通，第三晶体管M3将第一复位信号端Vref1输入的复位信号传输至驱动晶体管的控制端，对驱动晶体管的控制端进行复位，防止前一帧画面显示时，驱动晶体管的控制端的电压影响下一帧画面的显示。
选通模块126的第八晶体管M8以及第九晶体管M9的控制端均与第一扫描信号端电连接，因此第一扫描信号S1同时控制第八晶体管M8以及第九晶体管M9。第八晶体管M8以及第九晶体管M9的导电类型相反，图14中第八晶体管M8为P型晶体管，第九晶体管M9为N型晶体管，因此第一扫描信号S1在初始化阶段为低电平时，第八晶体管M8导通，第九晶体管M9关断。第八晶体管M8将第三复位信号端的复位信号传输至第二数据写入模块1212的第一晶体管M1。第三扫描信号S3在初始化阶段也为有效电平(低电平)，第一晶体管M1导通，实现对驱动晶体管D第二端的复位。
S10、数据写入阶段T2包括第一子数据写入阶段T2和第二子数据写入阶段T22。在第一子数据写入阶段T21，第二扫描信号S2为有效电平，控制第一数据写入模块1211的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第一数据写入模块1211的第一晶体管M1、驱动晶体管D以及第一数据写入模块1211的第二晶体管M2写入驱动晶体管D的控制端，即通过驱动晶体管的源极进行第一次数据写入。
由于第二复位模块124的第四晶体管M4的第四扫描信号端与第一数据写入模块1211的第二扫描信号端电连接，因此第二扫描信号S2为有效电平时，第四晶体管M4导通，第四晶体管M4将第二复位信号电Vref2传输至发光元件，实现发光元件的电极复位。
在第二子数据写入阶段T22，第三扫描信号S3为有效电平，控制第二数据写入模块1212的第一晶体管M1以及第二晶体管M2导通，数据信号端Vdata上的数据信号依次通过第二数据写入模块1212的第一晶体管M1、驱动晶体管D以及第二数据写入模块1212的第二晶体管M2写入驱动晶体管D的控制端，通过驱动晶体管的漏极进行第二次数据写入。
S20、在发光阶段T3，发光控制信号Emit为有效电平，第一扫描信号S1、第二扫描信号S2、第三扫描信号S3、第四扫描信号S4均为无效电平，发光控制模块122中的第五晶体管M5以及第六晶体管M6导通，第一数据写入模块1211的第一晶体管M1和第二晶体管M2，第二数据写入模块1212中的第一晶体管M1以及第二晶体管M2，第一复位模块123的第三晶体管M3，第二复位模块124的第四晶体管M4，第八晶体管M8以及第九晶体管M9均关断，第五晶体管M5将电源电压信号PVDD传输至驱动晶体管D的第一端，驱动晶体管D导通，驱动发光元件11发光。
由于显示面板的驱动频率越高，扫描信号脉冲越短，因此充电不充分的问题越严重，人眼感官感知的闪烁现象也越明显。据此本发明实施例还可以根据显示面板的驱动频率进行驱动方式的调整。
本发明实施例提供的显示面板的驱动方法，还包括：
获取显示面板的驱动频率；
根据显示面板的驱动频率，在数据写入阶段驱动像素驱动电路的至少部分数量的数据写入模块分时向驱动晶体管提供数据信号。
其中，显示面板的驱动频率与分时向驱动晶体管提供数据信号的数据写入模块的数量正相关。驱动频率越高，进行数据写入的次数越多，进而解决高频驱动引起的充电不充分问题。
在上述实施例的基础上，可选的，若像素驱动电路包括N个数据写入模块，那么显示面板虚设置N个栅极驱动电路。各行子像素的像素驱动电路中，在第j个子数据写入阶段向驱动晶体管提供数据信号的数据写入模块连接同一栅极驱动电路。即各行子像素的像素驱动电路中，在第j个子数据写入阶段向驱动晶体管提供数据信号的数据写入模块与同一栅极驱动电路的各级移位寄存器一一对应电连接。每个像素驱动电路中，在不同子数据写入阶段向驱动晶体管提供数据信号的数据写入模块连接不同栅极驱动电路；N为大于1的正整数；j为大于等于1小于等于N的正整数。
下面以N等于3为例进行介绍。如图23所示，每个像素驱动电路12包括3个数据写入模块，分别标记为第一数据写入模块1211、第二数据写入模块1212和第三数据写入模块1213。显示面板设置有3个栅极驱动电路，分别标记为第一栅极驱动电路131、第二栅极驱动电路132和第三栅极驱动电路133。各行子像素的像素驱动电路中的第一数据写入模块1211均与第一栅极驱动电路131连接，各行子像素的像素驱动电路中的第二数据写入模块1212均与第二栅极驱动电路132连接，各行子像素的像素驱动电路中的第三数据写入模块1213均与第三栅极驱动电路133连接。每个栅极驱动电路均包括级联的移位寄存器。
第i行子像素的各像素驱动电路中的第一数据写入模块1211均与第一栅极驱动电路131的第i级移位寄存器连接。第i行子像素的各像素驱动电路中的第二数据写入模块1212均与第二栅极驱动电路132的第i级移位寄存器连接。第i行子像素的各像素驱动电路中的第三数据写入模块1213均与第三栅极驱动电路133的第i级移位寄存器连接。i为子像素的行序号。
若显示面板的驱动频率为f1，控制第一栅极驱动电路131各行子像素的各像素驱动电路中的第一数据写入模块1211仅进行一次数据写入。若显示面板的驱动频率为f2，通过第一栅极驱动电路131控制各行子像素的各像素驱动电路中的第一数据写入模块1211进行第一次数据写入，通过第二栅极驱动电路132控制各行子像素的各像素驱动电路中的第二数据写入模块1212进行第二次数据写入。若显示面板的驱动频率为f3，通过第一栅极驱动电路131控制各行子像素的各像素驱动电路中的第一数据写入模块1211进行第一次数据写入，通过第二栅极驱动电路132控制各行子像素的各像素驱动电路中的第二数据写入模块1212进行第二次数据写入，通过第三栅极驱动电路133控制各行子像素的各像素驱动电路中的第三数据写入模块1213进行第三次数据写入。其中f1<f2<f3。
需要说明的是，本发明实施例不限定像素驱动电路中各模块中晶体管的类型，例如可以均为N型晶体管，或均为P型晶体管，亦或者根据实际需求选择其中部分晶体管为N型，部分晶体管为P型。像素驱动电路中各模块中晶体管的可以根据实际需求选择有源层采用氧化物半导体或是采用氧化物半导体。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (27)

1.一种显示面板，其特征在于，包括阵列排布的多个子像素；每个所述子像素包括发光元件和像素驱动电路；
所述像素驱动电路包括：
驱动晶体管、至少两个数据写入模块，以及发光控制模块；
各所述数据写入模块用于分时向所述驱动晶体管提供数据信号；
所述发光控制模块分别与所述驱动晶体管以及发光元件串联，用于控制驱动电流是否流过所述发光元件。
2.根据权利要求1所述的显示面板，其特征在于，所述数据写入模块中包括第一晶体管和第二晶体管；所述第一晶体管用于将所述数据信号端输入的数据信号写入所述驱动晶体管，所述第二晶体管用于检测和自补偿所述驱动晶体管的阈值电压的偏差；
其中，所述第二晶体管的第二端与所述驱动晶体管的控制端电连接；
所述第一晶体管的第一端与数据信号端电连接；所述第一晶体管的第二端与所述驱动晶体管的第一端电连接；所述第二晶体管的第一端与所述驱动晶体管的第二端电连接；
或者，所述第一晶体管的第一端与数据信号端电连接；所述第一晶体管的第二端与所述驱动晶体管的第二端电连接；所述第二晶体管的第一端与所述驱动晶体管的第一端电连接。
3.根据权利要求2所述的显示面板，其特征在于，所述像素驱动电路包括第一数据写入模块和第二数据写入模块；所述第一数据写入模块中的第一晶体管的控制端和第二晶体管的控制端电连接；所述第二数据写入模块中的第一晶体管的控制端和第二晶体管的控制端电连接。
4.根据权利要求3所述的显示面板，其特征在于，所述第一数据写入模块中的第一晶体管的控制端和第二晶体管的控制端均与第二扫描信号端电连接；所述第二数据写入模块中的第一晶体管的控制端和第二晶体管的控制端均与第三扫描信号端电连接；所述第三扫描信号端与下一行子像素中像素驱动电路的第二扫描信号端电连接。
5.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路还包括第一复位模块；所述第一复位模块与所述驱动晶体管的控制端电连接；所述第一复位模块用于对所述驱动晶体管的控制端复位。
6.根据权利要求5所述的显示面板，其特征在于，所述第一复位模块包括第三晶体管；所述第三晶体管串联于所述驱动晶体管的控制端与第一复位信号端之间。
7.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路还包括第二复位模块，所述第二复位模块与所述发光元件电连接，用于对所述发光元件复位。
8.根据权利要求7所述的显示面板，其特征在于，所述第二复位模块包括第四晶体管；所述第四晶体管串联于第二复位信号端与所述发光元件之间。
9.根据权利要求8所述的显示面板，其特征在于，所述第四晶体管的控制端与第四扫描信号端电连接；所述第四扫描信号端与任一所述数据写入模块中的所述第一晶体管的控制端，或所述第二晶体管的控制端电连接。
10.根据权利要求8所述的显示面板，其特征在于，所述像素驱动电路还包括第一复位模块；所述第一复位模块用于对所述驱动晶体管的控制端复位；所述第一复位模块包括第三晶体管；所述第三晶体管串联于所述驱动晶体管的控制端与第一复位信号端之间；所述第四晶体管的控制端与第四扫描信号端电连接；所述第三晶体管的控制端与第一扫描信号端电连接；所述第四扫描信号端与所述第一扫描信号端电连接。
11.根据权利要求8所述的显示面板，其特征在于，所述像素驱动电路还包括第一复位模块；所述第一复位模块用于对所述驱动晶体管的控制端复位；所述第一复位模块包括第三晶体管；所述第三晶体管串联于所述驱动晶体管的控制端与第一复位信号端之间；所述第一复位信号端与所述第二复位信号端电连接。
12.根据权利要求1所述的显示面板，其特征在于，所述发光控制模块包括第五晶体管和第六晶体管；
所述第五晶体管的第一端与第一电源信号端电连接，所述第五晶体管的第二端与所述驱动晶体管的第一端电连接；所述第六晶体管的第一端与所述驱动晶体管的第二端电连接；所述第六晶体管的第二端与所述发光元件电连接。
13.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路还包括第三复位模块；所述第三复位模块与所述驱动晶体管的第一端电连接；所述第三复位模块用于对所述驱动晶体管的第一端复位。
14.根据权利要求13所述的显示面板，其特征在于，所述第三复位模块包括第七晶体管；所述第七晶体管的第一端与所述驱动晶体管的控制端电连接；所述第七晶体管的第二端与所述驱动晶体管的第一端电连接。
15.根据权利要求14所述的显示面板，其特征在于，所述像素驱动电路还包括第一复位模块；所述第一复位模块与所述驱动晶体管的控制端电连接；所述第一复位模块用于对所述驱动晶体管的控制端复位；所述第一复位模块包括第三晶体管；所述第三晶体管串联于所述驱动晶体管的控制端与第一复位信号端之间；所述第七晶体管的控制端与所述第三晶体管的控制端电连接。
16.根据权利要求1所述的显示面板，其特征在于，所述像素驱动电路还包括选通模块；所述选通模块包括第三复位信号端、数据信号端、第一控制端、第二控制端和输出端；所述选通模块的输出端与一所述数据写入模块电连接；
所述选通模块用于在所述第一控制端输入的第一控制信号以及所述第二控制端输入的第二控制信号的控制下，将所述第三复位信号端输入的复位信号或将所述数据信号端输入的数据信号传输至与其电连接所述数据写入模块。
17.根据权利要求16所述的显示面板，其特征在于，所述选通模块包括第八晶体管和第九晶体管；所述第八晶体管的第一端与所述第三复位信号端电连接；所述第八晶体管的第二端与所述选通模块的输出端电连接；所述第八晶体管的控制端与所述第一控制端电连接；所述第九晶体管的第一端与所述数据信号端电连接；所述第九晶体管的第二端与所述选通模块的输出端电连接；所述第九晶体管的控制端与所述第二控制端电连接。
18.根据权利要求17所述的显示面板，其特征在于，所述第一控制端与所述第二控制端电连接；所述第八晶体管和所述第九晶体管的导电类型相反。
19.根据权利要求18所述的显示面板，其特征在于，所述像素驱动电路还包括第一复位模块；所述第一复位模块用于对所述驱动晶体管的控制端复位；所述第一复位模块包括第三晶体管；所述第三晶体管串联于所述驱动晶体管的控制端与第一复位信号端之间；所述第三晶体管的控制端与第一扫描信号端电连接；所述第一控制端以及所述第二控制端均与所述第一扫描信号端电连接。
20.根据权利要求18所述的显示面板，其特征在于，所述第一复位信号端与所述第三复位信号端电连接。
21.一种显示面板的驱动方法，其特征在于，适用于权利要求1-20任一项所述的显示面板，所述显示面板的驱动周期包括数据写入阶段和发光阶段；所述数据写入阶段包括至少两个子数据写入阶段；所述驱动方法包括：
S10、在所述数据写入阶段的各子数据写入阶段，各所述数据写入模块分时向所述驱动晶体管提供数据信号；
S20、在所述发光阶段；发光控制模块控制驱动电流流过发光元件。
22.根据权利要求21所述的驱动方法，其特征在于，所述像素驱动电路还包括第一复位模块；所述显示面板的驱动周期还包括初始化阶段；所述驱动方法还包括：
S00、在所述数据写入阶段前的所述初始化阶段，所述第一复位模块对所述驱动晶体管的控制端复位。
23.根据权利要求21所述的驱动方法，其特征在于，所述像素驱动电路还包括第二复位模块，所述第二复位模块与所述发光元件电连接；
在所述发光阶段以外的其他阶段中至少部分时间段，所述第二复位模块对所述发光元件复位。
24.根据权利要求21所述的驱动方法，其特征在于，所述数据写入模块中包括第一晶体管和第二晶体管；所述第一晶体管用于将所述数据信号端输入的数据信号写入所述驱动晶体管，所述第二晶体管用于检测和自补偿所述驱动晶体管的阈值电压的偏差；所述像素驱动电路包括第一数据写入模块和第二数据写入模块；所述第一数据写入模块中的第一晶体管的控制端和第二晶体管的控制端与第二扫描信号端电连接；所述第二数据写入模块中的第一晶体管的控制端和第二晶体管的控制端与第三扫描信号端电连接；第i行子像素的所述像素驱动电路中第三扫描信号端与第i+1行子像素的所述像素驱动电路中第二扫描信号端电连接；
所述数据写入阶段包括第一子数据写入阶段和第二子数据写入阶段；第i行子像素执行所述第二子数据写入阶段之时，第i+1行子像素执行所述第一子数据写入阶段，i为正整数。
25.根据权利要求21所述的驱动方法，其特征在于，还包括：
获取所述显示面板的驱动频率；
根据所述显示面板的驱动频率，在所述数据写入阶段驱动所述像素驱动电路的至少部分数量的所述数据写入模块分时向所述驱动晶体管提供数据信号；
其中，所述显示面板的驱动频率与分时向所述驱动晶体管提供数据信号的所述数据写入模块的数量正相关。
26.根据权利要求25所述的驱动方法，其特征在于，所述显示面板包括N个栅极驱动电路；所述像素驱动电路包括N个数据写入模块；
各行子像素的像素驱动电路中，在第j个子数据写入阶段向所述驱动晶体管提供数据信号的数据写入模块连接同一所述栅极驱动电路；每个像素驱动电路中，在不同子数据写入阶段向所述驱动晶体管提供数据信号的数据写入模块连接不同所述栅极驱动电路；N为大于1的正整数；j为大于等于1小于等于N的正整数。
27.根据权利要求21所述的驱动方法，其特征在于，所述像素驱动电路包括第三复位模块；所述第三复位模块与所述驱动晶体管的第一端电连接；
在所述数据写入阶段之前，所述第三复位模块对所述驱动晶体管的第一端复位。
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