CN111796841A - 一种双路arm远程更新的硬件实现系统及方法 - Google Patents

一种双路arm远程更新的硬件实现系统及方法 Download PDF

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Abstract

本发明提供一种双路ARM远程更新的硬件实现系统及方法，系统包括：总线缓冲器和单片机，所述总线缓冲器连接第一处理器和第二处理器，所述第一处理器和所述第二处理器的BOOT管脚和复位管脚连接所述单片机的控制引脚；所述总线缓冲器用于实现四路信号的通断控制，所述单片机用于接收来自串口的控制信息，并根据所述控制信息对管脚进行时序控制。本发明实施例提供的一种双路ARM远程更新的硬件实现系统及方法，能够克服了不拆卸板卡及设备，单路串口远程更新两路处理器的难题，且降低了在更新程序前或者更新程序后，需要手动复位的繁琐性。

Description

一种双路ARM远程更新的硬件实现系统及方法
技术领域
本发明涉及ARM处理技术领域，更具体地，涉及一种双路ARM远程更新的硬件实现系统及方法。
背景技术
对于置于机箱内部的信号处理板，往往在产品调试和使用过程中，难以避免有时需要对其更新固件，为使更新操作时不需要反复插拔和拆卸，可以采用远程更新的方式。
STM32F429处理器的启动方式由BOOT0和BOOT1两个启动位置选择位来决定；上电或者复位时，系统通过读取BOOT0和BOOT1两个管脚的高低电平，来读取存储于指定位置的机器指令；将BOOT0设置为1，BOOT1设置为0，重新上电或者复位后STM32F429处理器将从系统存储器启动，系统存储器是芯片内部一块特定的区域，STM32在出厂时，由意法半导体(ST)在这个区域内部预置了一段BootLoader，也就是常说的ISP程序，这是一块ROM区域，出厂后无法修改；可以借助这个BootLoader通过串口将程序下载到系统的Flash中，但需要再次将启动方式改为从flash启动，并且重新上电或者复位，程序才能正确执行。
为满足系统设计的必要性，在需要使用两片STM32F429处理器的场景中，且对外只有一路通信串口时，就需要对串口电路做一定的控制操作，来实现在某一时刻，更新操作只对其中一片处理器起作用。
因此，现在亟需一种双路ARM远程更新的硬件实现方法来解决上述问题。
发明内容
本发明提供一种克服上述问题或者至少部分地解决上述问题的一种双路ARM远程更新的硬件实现系统及方法，根据本发明提供的第一方面，本发明提供一种双路ARM远程更新的硬件实现系统，包括：
总线缓冲器和单片机，所述总线缓冲器连接第一处理器和第二处理器，所述第一处理器和所述第二处理器的BOOT管脚和复位管脚连接所述单片机的控制引脚；
所述总线缓冲器用于实现四路信号的通断控制，所述单片机用于接收来自串口的控制信息，并根据所述控制信息对管脚进行时序控制。
其中，所述总线缓冲器包括两个使能管脚，每个使能管脚控制一路信号的通断。
其中，所述双路ARM远程更新的硬件实现系统还包括：
电平转换芯片，所述电平转换芯片用于将输入的外部四线信号转换两线TTL信号。
其中，所述两线TTL信号分别连接所述总线缓冲器和所述单片机。
其中，所述总线缓冲器用于将所述两线TTL信号分成四线信号，其中两线连接第一处理器的串口引脚，另外两线连接第二处理器的串口引脚。
其中，所述总线缓冲器包括四个使能信号，每个使能信号分别控制一个通道的通断，所述使能信号连接所述单片机的控制引脚。
其中，所述总线缓冲器为SN74ALVC125PW。
其中，所述单片机为STC15W201S。
其中，所述电平转换芯片为MAX3077EESA。
根据本发明提供的第二方面，本发明提供一种双路ARM远程更新的硬件实现方法，包括：
若接收到更新处理器的串口信息，则控制单片机调整所述处理器对应的BOOT引脚和复位引脚；
当所述处理器更新完成后，重新调整所述处理器对应的BOOT引脚和复位引脚。
本发明实施例提供的一种双路ARM远程更新的硬件实现系统及方法，能够克服了不拆卸板卡及设备，单路串口远程更新两路处理器的难题，且降低了在更新程序前或者更新程序后，需要手动复位的繁琐性。
附图说明
图1是本发明实施例提供的一种双路ARM远程更新的硬件实现系统结构示意图；
图2是本发明实施例提供的一种双路ARM远程更新的硬件实现方法流程示意图。
具体实施方式
下面结合附图和实施例，对本发明的具体实施方式作进一步详细描述。以下实施例用于说明本发明，但不用来限制本发明的范围。
图1是本发明实施例提供的一种双路ARM远程更新的硬件实现系统结构示意图，如图1所示，包括：
总线缓冲器1和单片机2，所述总线缓冲器1连接第一处理器3和第二处理器4，所述第一处理器3和所述第二处理器4的BOOT管脚和复位管脚连接所述单片机2的控制引脚；
所述总线缓冲器1用于实现四路信号的通断控制，所述单片机2用于接收来自串口的控制信息，并根据所述控制信息对管脚进行时序控制。
可以理解的是，本发明实施例在硬件设计时，使用了一个总线缓冲器，利用该总线缓冲器能够实现四路信号的通断控制，同时利用单片机来接收串口的控制信息，那么当需要更新某个处理器的固件时，串口信息会传递到单片机，单片机可以进行必要的时序操作控制引脚，实现更新程序准确无误的加载。
本发明实施例提供的一种双路ARM远程更新的硬件实现系统及方法，能够克服了不拆卸板卡及设备，单路串口远程更新两路处理器的难题，且降低了在更新程序前或者更新程序后，需要手动复位的繁琐性。
在上述实施例的基础上，所述总线缓冲器包括两个使能管脚，每个使能管脚控制一路信号的通断。
在上述实施例的基础上，所述双路ARM远程更新的硬件实现系统还包括：
电平转换芯片，所述电平转换芯片用于将输入的外部四线信号转换两线TTL信号。
在上述实施例的基础上，所述两线TTL信号分别连接所述总线缓冲器和所述单片机。
在上述实施例的基础上，所述总线缓冲器用于将所述两线TTL信号分成四线信号，其中两线连接第一处理器的串口引脚，另外两线连接第二处理器的串口引脚。
具体的，如图1所示，本发明实施例首先通过电平转换芯片将外部四线(RX+,RX-,TX+,TX-)RS422信号转换为两线(RX,TX)TTL信号，两线TTL信号直接连接到单片机的串口引脚，与此同时，该TTL信号连接到缓冲器，缓冲器将两线TTL信号(RX,TX)分成四线(RX1,TX1,RX2,TX2)，RX1，TX1连接到第一处理器的串口引脚，RX2,TX2连接到第二处理器的串口引脚。
在上述实施例的基础上，所述总线缓冲器包括四个使能信号，每个使能信号分别控制一个通道的通断，所述使能信号连接所述单片机的控制引脚。
本发明实施例提供的缓冲器四个通道自带四个使能信号，该四个使能信号各自控制一个通道的通断，将四个使能信号连接到单片机的控制引脚；同时两个处理器的BOOT0，BOOT1以及复位信号都连接到单片机的控制引脚。
在上述实施例的基础上，所述总线缓冲器为SN74ALVC125PW。、如图1所示，本发明实施例优选的选用总线缓冲器的型号为SN74ALVC125PW。
在上述实施例的基础上，所述单片机为STC15W201S。
如图1所示，本发明实施例优选的选用单片机的型号为STC15W201S。
在上述实施例的基础上，所述电平转换芯片为MAX3077EESA。
如图1所示，本发明实施例优选的选用电平转换芯片的型号为MAX3077EESA。
图2是本发明实施例提供的一种双路ARM远程更新的硬件实现方法流程示意图，如图2所示，包括：
201、若接收到更新处理器的串口信息，则控制单片机调整所述处理器对应的BOOT引脚和复位引脚；
202、当所述处理器更新完成后，重新调整所述处理器对应的BOOT引脚和复位引脚。
如图2所示，本发明实施例当需要更新处理器时，会由单片机接收到串口指示信息，根据串口指示信息的内容确认更新的处理器，即确定是更新第一处理器或者是第二处理器。
如果是第一处理器，则单片机将第一处理器的BOOT0拉高，BOOT1拉低，这里默认两个处理器BOOT0和BOOT1都接低电平。然后打开缓冲器的两路开关，使得RX和TX信号连接到第一处理器的串口引脚，然后将第一处理器的复位脚拉低，第一处理器将从系统存储器启动，等待从串口接收更新固件并加载到FLASH中；更新完成后，单片机将第一处理器的BOOT0拉低，BOOT1拉低，再拉低复位引脚，第一处理器将FLASH启动，执行新程序，从而更新完成。
可以理解的是，同理可完成第二处理器的更新过程。
本发明实施例提供的一种双路ARM远程更新的硬件实现方法，能够克服了不拆卸板卡及设备，单路串口远程更新两路处理器的难题，且降低了在更新程序前或者更新程序后，需要手动复位的繁琐性。
以上所描述的装置实施例仅仅是示意性的，其中所述作为分离部件说明的单元可以是或者也可以不是物理上分开的，作为单元显示的部件可以是或者也可以不是物理单元，即可以位于一个地方，或者也可以分布到多个网络单元上。可以根据实际的需要选择其中的部分或者全部模块来实现本实施例方案的目的。本领域普通技术人员在不付出创造性的劳动的情况下，即可以理解并实施。
通过以上的实施方式的描述，本领域的技术人员可以清楚地了解到各实施方式可借助软件加必需的通用硬件平台的方式来实现，当然也可以通过硬件。基于这样的理解，上述技术方案本质上或者说对现有技术做出贡献的部分可以以软件产品的形式体现出来，该计算机软件产品可以存储在计算机可读存储介质中，如ROM/RAM、磁碟、光盘等，包括若干指令用以使得一台计算机设备(可以是个人计算机，服务器，或者网络设备等)执行各个实施例或者实施例的某些部分所述的方法。
最后，本申请的方法仅为较佳的实施方案，并非用于限定本发明的保护范围。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (10)

1.一种双路ARM远程更新的硬件实现系统，其特征在于，包括：
总线缓冲器和单片机，所述总线缓冲器连接第一处理器和第二处理器，所述第一处理器和所述第二处理器的BOOT管脚和复位管脚连接所述单片机的控制引脚；
所述总线缓冲器用于实现四路信号的通断控制，所述单片机用于接收来自串口的控制信息，并根据所述控制信息对管脚进行时序控制。
2.根据权利要求1所述的双路ARM远程更新的硬件实现系统，其特征在于，所述总线缓冲器包括两个使能管脚，每个使能管脚控制一路信号的通断。
3.根据权利要求2所述的双路ARM远程更新的硬件实现系统，其特征在于，所述双路ARM远程更新的硬件实现系统还包括：
电平转换芯片，所述电平转换芯片用于将输入的外部四线信号转换两线TTL信号。
4.根据权利要求3所述的双路ARM远程更新的硬件实现系统，其特征在于，所述两线TTL信号分别连接所述总线缓冲器和所述单片机。
5.根据权利要求4所述的双路ARM远程更新的硬件实现系统，其特征在于，所述总线缓冲器用于将所述两线TTL信号分成四线信号，其中两线连接第一处理器的串口引脚，另外两线连接第二处理器的串口引脚。
6.根据权利要求5所述的双路ARM远程更新的硬件实现系统，其特征在于，所述总线缓冲器包括四个使能信号，每个使能信号分别控制一个通道的通断，所述使能信号连接所述单片机的控制引脚。
7.根据权利要求1-6任一所述的双路ARM远程更新的硬件实现系统，其特征在于，所述总线缓冲器为SN74ALVC125PW。
8.根据权利要求1-6任一所述的双路ARM远程更新的硬件实现系统，其特征在于，所述单片机为STC15W201S。
9.根据权利要求3所述的双路ARM远程更新的硬件实现系统，其特征在于，所述电平转换芯片为MAX3077EESA。
10.一种双路ARM远程更新的硬件实现方法，其特征在于，包括：
若接收到更新处理器的串口信息，则控制单片机调整所述处理器对应的BOOT引脚和复位引脚；
当所述处理器更新完成后，重新调整所述处理器对应的BOOT引脚和复位引脚。
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