CN111668305A - 一种高线性mis-hemt器件及其制备方法 - Google Patents
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Abstract
本发明公开了一种高线性MIS‑HEMT器件及其制备方法,所述高线性MIS‑HEMT器件自下而上依次包括:衬底层、缓冲层、势垒层以及金属电极层,所述金属电极层两端设有源电极和漏电极,所述源电极和漏电极之间设有介质层,所述栅电极设置于所述介质层上方;其中,所述势垒层包括依次均匀排列的若干氟掺杂区(F1~Fm),m为正整数且m≥2。本发明提供的高线性MIS‑HEMT器件通过栅电极下势垒层不同浓度氟掺杂区域跨导相互补偿,能实现在较大栅源偏压范围内跨导的相对稳定,无需对器件和材料结构进行大量调整便可使器件具有很好的线性度。
Description
技术领域
本发明属于半导体技术领域,具体涉及一种高线性MIS-HEMT器件及其制备方法。
背景技术
随着半导体技术的发展,以GaN为代表的第三代半导体材料,凭借高禁带宽度、高击穿场强、较高的热导率、耐辐照、耐腐蚀等特性,表现出相较传统半导体材料Si和GaAs更大的潜力,受到了广泛的关注。特别是90年代以来,利用AlGaN/GaN异质结构制备的高电子迁移率晶体管(HEMT)器件,凭借自身极强的极化效应,能在异质结界面处形成高浓度、高迁移率的二维电子气(2DEG),实现极高的工作速度,从而特别适合于在通讯领域的应用。
在通讯应用中,传统的AlGaN/GaN HEMT器件面临线性度较差问题。非线性的器件会引起输出信号失真,严重限制器件的工作条件。一般通过在电路中加入前馈、补偿等模块,可一定程度解决此问题。然而,这种方法涉及到对电路结构进行改造,较为复杂。因此,在器件本身实现高线性度,即要求器件的跨导在较大的栅压摆幅内保持稳定,成为了当前的研究热点。而现有的HEMT器件的跨导通常在到达一定峰值后快速下降,在较大栅源偏压摆幅内无法保持稳定,这影响了器件本身的线性度。为此,通常采用渐变组分势垒结构降低2DEG浓度提高电子饱和速度或者采用Fin结构降低源串联电阻的方式保证器件跨导在较大的栅压范围内保持稳定,从而提高器件线性度。此外,还可以采用Fin宽渐变结构或者势垒厚度渐变结构等方法提高器件线性度。
然而,采用渐变组分势垒结构要求高Al组分的势垒层,会造成器件表面质量的恶化;采用Fin结构以及Fin宽渐变结构其制备过程中涉及刻蚀工艺,会引入大量的刻蚀损伤,留下的沟道侧壁也会产生大量寄生电容,影响器件性能;而势垒厚度渐变结构需要对势垒层结构进行精确的刻蚀深度控制,工艺难度过高。此外,传统的AlGaN/GaN HEMT器由于GaN材料具有较高的位错密度,普通肖特基栅结构在正向与反向电压下都会出现严重的栅漏电,从而限制了器件的工作范围并恶化增益、噪声等特性,且过大的栅漏电会降低器件耐压,影响器件能够正常工作的栅压,降低器件效率。
发明内容
为了解决现有技术中存在的上述问题,本发明提供了一种高线性MIS-HEMT器件及其制备方法。本发明要解决的技术问题通过以下技术方案实现:
一种高线性MIS-HEMT器件,自下而上依次包括:衬底层、缓冲层、势垒层以及金属电极层,所述金属电极层两端设有源电极和漏电极,所述源电极和漏电极之间设有介质层,所述栅电极设置于所述介质层上方;其中,所述势垒层包括依次均匀排列的若干氟掺杂区F1~Fm,m为正整数且m≥2。
在本发明的一个实施例中,所述氟掺杂区F1~Fm位于所述栅电极下方并沿栅宽方向排列。
在本发明的一个实施例中,所述氟掺杂区F1~Fm的氟离子浓度从所述氟掺杂区F1至所述氟掺杂区Fm依次递增或者递减。
在本发明的一个实施例中,所述氟掺杂区F1~Fm的氟离子浓度从所述氟掺杂区F1和所述氟掺杂区Fm依次向中间递增或者递减。
在本发明的一个实施例中,还包括插入层,所述插入层设置于所述缓冲层和所述势垒层之间。
在本发明的一个实施例中,还包括盖帽层,所述盖帽层设置于所述势垒层与所述金属电极层之间。
在本发明的一个实施例中,还包括钝化层,所述钝化层设置于所述势垒层或介质层上方各电极之间的区域。
一种高线性MIS-HEMT器件的制备方法,包括:
步骤1:获取外延基片并进行清洗;其中,所述外延基片包括势垒层;
步骤2:在所述势垒层上制作源电极和漏电极;
步骤3:对所述外延基片进行台面刻蚀,以在所述势垒层上形成隔离台面;
步骤4:对所述势垒层进行氟离子注入以形成若干氟掺杂区;其中,所述氟掺杂区位于所述源电极和所述漏电极之间;
步骤5:在所述势垒层上淀积介质层;
步骤6:在所述介质层上与氟掺杂区对应的区域制作栅电极,以完成高线性MIS-HEMT器件的制备。
在本发明的一个实施例中,步骤4包括:
(4a)在所述势垒层上光刻第一个氟注入区域;
(4b)对所述第一个氟注入区域进行氟离子注入以形成第一个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度为n1;
(4c)在所述势垒层上光刻第i个氟注入区域,并分别进行氟离子注入以形成第i个氟掺杂区,其中,所述第i个氟掺杂区的氟离子浓度为ni,且满足ni-1<ni或者ni-1>ni,其中,2≤i≤m,i、m均为正整数。
在本发明的一个实施例中,步骤4包括:
(41)在所述势垒层上光刻第一个氟注入区域和第m个氟注入区域;
(42)对所述第一个氟注入区域和所述第m个氟注入区域进行氟离子注入以形成第一个氟掺杂区和第m个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度n1和所述第m个氟掺杂区的氟离子浓度nm相等;
(43)在所述势垒层上光刻第1+j个氟注入区域和第m-j个氟注入区,并分别进行氟离子注入以形成第1+j个氟掺杂区和第m-j个氟掺杂区,其中,所述第1+j个氟掺杂区的氟离子浓度n1+j和所述第m-j个氟掺杂区的氟离子浓度nm-j相等,且满足nj<n1+j或者nj>n1+j,其中,
本发明的有益效果:
1、本发明提供的高线性MIS-HEMT器件通过栅电极下势垒层不同浓度氟掺杂区域跨导相互补偿,能实现在较大栅源偏压范围内跨导的相对稳定,无需对器件和材料结构进行大量调整便可使器件具有很好的线性度;
2、本发明提供的高线性MIS-HEMT器件通过介质栅结构的应用,降低了栅漏电,提高了器件耐压,扩宽了器件正常工作的栅压摆幅,进一步提高了器件线性度,同时提高了器件的增益、功率附加效率等特性;
3、本发明提供的高线性MIS-HEMT器件通过采用高介电常数的介质材料,在抑制漏电的同时能够保持较高的栅控能力与器件跨导;
4、本发明提供的高线性MIS-HEMT器件工艺简单,兼容性好,便于器件制备与工艺调节,且引入的附加应小,具有更高的可行性和重复性;
5、本发明提供的高线性MIS-HEMT器件结构与常用MIS-HEMT器件类似,可与其他相关优化技术如场板结构等兼容,保持高线性度的同时实现高击穿电压、高输出电流等特性。
以下将结合附图及实施例对本发明做进一步详细说明。
附图说明
图1是本发明实施例提供的一种高线性MIS-HEMT器件结构示意图;
图2是本发明实施例提供的高线性MIS-HEMT器件栅电极处剖面示意图;
图3是本发明实施例提供的高线性MIS-HEMT器件氟掺杂区域排布的俯视示意图;
图4是本发明实施例提供的高线性MIS-HEMT器件制备方法流程图;
图5是本发明实施例提供的另一种高线性MIS-HEMT器件制备方法流程图;
图6a~6g是本发明实施例提供的高线性MIS-HEMT器件制备方法示意图;
图7a~7b是本发明实施例提供的一种氟注入工艺的方法示意图。
具体实施方式
下面结合具体实施例对本发明做进一步详细的描述,但本发明的实施方式不限于此。
实施例一
请参见图1,图1是本发明实施例提供的一种高线性MIS-HEMT器件结构示意图,自下而上依次包括:
衬底层10、缓冲层20、势垒层30以及金属电极层40,所述金属电极层40两端设有源电极41和漏电极43,所述源电极41和漏电极43之间设有介质层50,所述栅电极42设置于所述介质层50上方;其中,所述势垒层30包括依次均匀排列的若干氟掺杂区F1~Fm,m为正整数且m≥1。
进一步地,所述氟掺杂区F1~Fm位于所述栅电极42下方并沿栅宽方向排列。
本实施例提供的高线性MIS-HEMT器件通过介质栅结构的应用,降低了栅漏电,提高了器件耐压,扩宽了器件正常工作的栅压摆幅,进一步提高了器件线性度,同时提高了器件的增益、功率附加效率等特性。
请参见图2和图3,图2是本发明实施例提供的高线性MIS-HEMT器件栅电极处剖面示意图;图3是本发明实施例提供的高线性MIS-HEMT器件氟掺杂区域排布的俯视示意图;
具体地,栅极区42下方的势垒层30中沿栅宽方向划分有若干区域F1~Fm,不同的区域中实现了不同浓度的氟离子掺杂。氟离子掺杂会改变对应栅下区域的2DEG浓度,进而调节对应区域的阈值电压。进一步地,氟离子掺杂对该区域的阈值电压调节效果受氟离子浓度影响。因而该器件可视为若干跨导分布各不相同的MIS-HEMT器件的并联,通过这一并联结构,各分立MIS-HEMT器件间跨导相互补偿,从而实现在较大的栅源偏压范围内跨导值的相对稳定。
进一步地,所述氟掺杂区F1~Fm的氟离子浓度从所述氟掺杂区F1至所述氟掺杂区Fm依次递增或者递减。
具体地,若干氟掺杂区F1~Fm的氟离子浓度可以分别表示为n1、n2、n3、……、nm,其中,n1<n2<……<nm-1<nm或者n1>n2>……>nm-1>nm,实现氟离子浓度从一端向另一端递增的氟掺杂区。
在本发明的另一个实施例中,所述氟掺杂区F1~Fm的氟离子浓度从所述氟掺杂区F1和所述氟掺杂区Fm依次向中间递增或者递减。
具体地,若干氟掺杂区F1~Fm的氟离子浓度由两端到中间逐渐增加,其中,氟掺杂区F1和Fm的氟离子浓度均可表示为n1,氟掺杂区F2和Fm-1的氟离子浓度均可表示为n2,以此类推,其中,n1<n2<……。
或者,若干氟掺杂区F1~Fm的氟离子浓度由两端到中间逐渐降低,满足n1>n2>……。
本实施例中,衬底10可以是硅、蓝宝石、碳化硅等衬底或其组合;缓冲层20的材料可为GaN等,势垒层30的材料可为AlGaN、InAlN等,介质层50的材料可为Si3N4、Al2O3等。
本实施例可通过使用高介电常数的介质材料,在抑制漏电的同时能够保持较高的栅控能力与器件跨导。
在实际器件中,为了获得高质量的外延结构,可在衬底10与缓冲层20间增加成核层,其材料可以为AlN等。
进一步地,为了获得高浓度的2DEG,可在缓冲层20与势垒层30间增加插入层,其材料可以为AlN等。
同时,为了获得高质量的欧姆接触和肖特基接触,并提高载流子迁移率,可在势垒层30与金属电极层间增加盖帽层,其材料可为GaN等。
此外,为了优化器件电学特性,势垒层30上方或介质层50上方可能制备有钝化层,如SiN等。
本实施例提供的高线性MIS-HEMT器件在栅宽方向上,通过一系列跨导峰值相近而峰值点互有平移的器件间跨导相互补偿、共同作用,从而在较大栅压范围内实现跨导的稳定,从而提高器件线性度。相比现有方式,这种方法无需从器件自身跨导特性的物理机理上着手,直接利用不同跨导特性器件互相补偿,避免了对器件和材料结构的大量调整,减小了设计难度,而线性化效果并无减弱。
此外,本实施例提供的高线性MIS-HEMT器件结构与常用MIS-HEMT器件类似,可与其他相关优化技术如场板结构等兼容,保持高线性度的同时实现高击穿电压、高输出电流等特性。
实施例二
请参见图4,图4是本发明实施例提供的高线性MIS-HEMT器件制备方法流程图,包括:
步骤1:获取外延基片并进行清洗;其中,所述外延基片包括势垒层。
具体地,外延基片自下而上可以依次包括蓝宝石衬底、GaN缓冲层、AlGaN势垒层。
在本实施例中,获取的外延基片还包含成核层和插入层,其中,成核层位于蓝宝石衬底和GaN缓冲层之间,插入层位于GaN缓冲层和AlGaN势垒层之间。
步骤2:在所述势垒层上制作源电极和漏电极。
(2a)在所述外延基片的表面涂胶并甩胶,得到光刻胶掩膜;
(2b)对所述外延基片进行烘干,并通过光刻和显影技术形成第一掩膜层;
(2c)在所述第一掩膜层表面蒸发第一金属层,以得到源、漏极金属;
(2d)利用剥离工艺去除所述第一掩膜层以及所述第一金属层,并进行快速退火,得到源电极和漏电极。
在本实施例中,第一掩膜层即为源、漏区域掩膜图形,第一金属层即为源、漏极金属层。
步骤3:对所述外延基片进行台面刻蚀,以在所述势垒层上形成隔离台面。
(3a)在步骤2所得的样品表面涂胶,并甩胶后得到光刻胶掩膜;
(3b)对外延基片进行烘干,并通过光刻和显影形成台面区域掩膜图形;
(3c)对做好掩膜的样品进行刻蚀,以在所述势垒层上形成隔离台面。
步骤4:对所述势垒层进行氟离子注入以形成若干氟掺杂区;其中,所述氟掺杂区位于所述源电极和所述漏电极之间。
请参见图5,图5是本发明实施例提供的另一种高线性MIS-HEMT器件制备方法流程图,在本发明的一个实施例中,步骤4可以包括:
(4a)在所述势垒层上光刻第一个氟注入区域,
(4b)对所述第一个氟注入区域进行氟离子注入以形成第一个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度为n1;
(4c)在所述势垒层上光刻第i个氟注入区域,并分别进行氟离子注入以形成第i个氟掺杂区,其中,所述第i个氟掺杂区的氟离子浓度为ni,且满足ni-1<ni或者ni-1>ni,其中,2≤i≤m,i、m均为正整数。
具体地,本实施例采用氟基反应等离子体刻蚀工艺进行氟离子注入,其中,反应气体为CF4等离子体,功率为60~200W,刻蚀时间为50~300s。功率越高,时间越长,则注入浓度越高。
在本实施例中,由于m个氟掺杂区的氟离子浓度是从一端向另一端递增或者递减的,在具体制备过程中,需要先形成氟注入区域并进行氟离子注入,以此类推,直至形成m个氟离子浓度从一端向另一端递增或者递减的一系列氟掺杂区。
在本发明的另一个实施例中,步骤4还可以包括:
(41)在所述势垒层上光刻第一个氟注入区域和第m个氟注入区域;
(42)对所述第一个氟注入区域和所述第m个氟注入区域进行氟离子注入以形成第一个氟掺杂区和第m个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度n1和所述第m个氟掺杂区的氟离子浓度nm相等;
(43)在所述势垒层上光刻第1+j个氟注入区域和第m-j个氟注入区,并分别进行氟离子注入以形成第1+j个氟掺杂区和第m-j个氟掺杂区,其中,所述第1+j个氟掺杂区的氟离子浓度n1+j和所述第m-j个氟掺杂区的氟离子浓度nm-j相等,且满足nj<n1+j或者nj>n1+j,其中,
在本实施例中,由于m个氟掺杂区的氟离子浓度是从两端向中间递增或者递减的,以此,可以同时形成两个氟离子浓度相同的氟注入区域,并进行氟离子注入,然后在制备下一组浓度相同的氟掺杂区,以此类推,直至形成m个氟离子浓度由两端到中间逐渐增加或者减小的一系列氟掺杂区。
步骤5:在所述势垒层上淀积介质层;
具体地,在完成氟注入的势垒层上,淀积一均匀的Si3N4或Al2O3介质层。介质层的材料、厚度和工艺要综合考虑其对器件栅控能力的影响和对栅漏电的抑制作用等进行设计。
步骤6:在所述介质层上与氟掺杂区对应的区域制作栅电极,以完成高线性MIS-HEMT器件的制备。
(6a)在步骤5所得的样品表面涂胶并甩胶,得到光刻胶掩膜;
(6b)对所述样品进行烘干,并通过光刻和显影技术形成第二掩膜层;
(6c)在所述第二掩膜层表面蒸发第二金属层,以得到栅极金属;
(6d)利用剥离工艺去除所述第二掩膜层以及所述第二金属层,并进行快速退火,得到栅电极,以完成器件制备。
在本实施例中,第二掩膜层即为栅区域掩膜图形,第二金属层即为栅极金属层。
进一步地,为了激活注入的氟离子,步骤(6d)中的退火工艺也可以在步骤4进行氟离子注入之后进行,其中,退火温度在340℃以上,时间在10min以上。
可选的,本实施例中步骤1获取的外延基片还可以包括设置于势垒层之上的盖帽层,然后再进行源、漏电极的制作以及后面工艺的制程。
本实施例提供的高线性MIS-HEMT器件工艺简单,兼容性好,便于器件制备与工艺调节,且引入的附加效应小,具有更高的可行性和重复性;同时,因通过氟注入对器件转移曲线进行调整的研究在过往增强型器件的研究中已有大量数据,可直接参考相关研究成果,各分立器件参数易于获取,工艺流程易于控制。
实施例三
下面以制备氟注入浓度由一端向另一端递增的MIS-HEMT器件为例来对本发明的制备方法进行详细说明。
请参见图6a~6g,图6a~6g是本发明实施例提供的高线性MIS-HEMT器件制备方法示意图,具体包括:
S1:获取含有蓝宝石衬底10、GaN缓冲层20以及AlGaN势垒层30的样片,并对样片进行清洗,如图6a所示;
S2:在AlGaN势垒层30上制作源级41、漏极43,如图6b所示;
具体地,在步骤S1所得的样品表面涂胶并甩胶,得到光刻胶掩膜;并进行烘干,然后通过光刻和显影技术形成源、漏区域掩膜图形;
在做好掩膜的样品表面蒸发得到源、漏极金属;
利用剥离工艺去除掩膜层及金属层,并进行快速退火,得到源电极41和漏电极43。
S3:对样品进行台面刻蚀,以在所述势垒层30上形成隔离台面;
具体地,在步骤S2所得样品表面涂胶,甩胶后得到光刻胶掩膜,经烘干后通过光刻和显影形成台面区域掩膜图形;
对做好掩膜的样品进行刻蚀,得到隔离台面。
S4:在AlGaN势垒层30中分次、分区域注入不同浓度的氟离子,以形成m个氟离子浓度不同的氟掺杂区。
具体地,在AlGaN势垒层30的栅极区域上光刻第一个氟注入区域F1:首先在步骤S3所得样品表面涂胶并甩胶,得到光刻胶掩膜,然后进行烘干,并通过光刻和显影形成栅下第一氟注入区域F1图形;如图6c所示;
利用氟基反应等离子体刻蚀工艺对做第一氟注入区域F1进行氟注入,使得区域F1内氟离子浓度为n1。
参照上述过程,分别光刻栅下氟注入区域F2、F3、……、Fm,并对其分别进行氟注入,其氟离子浓度分别为n2、n3、……、nm,其中,n1<n2<……<nm-1<nm,如图6d所示,最终得到氟离子浓度从一端向另一端递增的一系列氟掺杂区,如图6e所示。
对整个样品进行退火处理以激活氟离子,其中,退火温度在340℃以上,时间在10min以上。
S5:在源电极41和漏电极43间的势垒层30上淀积介质层50,如图6f所示。
具体地,在完成氟注入的AlGaN势垒层30上,淀积一均匀的Si3N4或Al2O3介质层50。介质层50的材料、厚度和工艺要综合考虑其对器件栅控能力的影响和对栅漏电的抑制作用等进行设计。
S6:在源电极41和漏电极43间的介质层50上与氟掺杂区对应的区域制作栅电极42,如图6g所示。
具体地,在步骤S5所得样品上涂胶并甩胶,得到光刻胶掩膜,并进行烘干,然后通过光刻和显影技术形成栅电极区域掩膜图形;
在做好掩膜的样品表面蒸发栅极金属;
利用剥离工艺去除掩膜层及金属层,得到栅电极42,完成器件制备。
实施例四
在上述实施例三的基础上,下面以制备氟注入浓度由两端到中间逐渐增加的MIS-HEMT器件为例进行说明,具体包括以下步骤:
步骤获取含有蓝宝石衬底10、GaN缓冲层20以及AlGaN势垒层30的样片,并对样片进行清洗;
步骤A:获取含有蓝宝石衬底10、GaN缓冲层20以及AlGaN势垒层30的样片,并对样片进行清洗;
步骤B:在AlGaN势垒层30上制作源级41、漏极43;
步骤C:对样品进行台面刻蚀,以在所述势垒层30上形成隔离台面;
在本实施例中,步骤A~C与实施例三的步骤S1~S3相同,在此不再赘述。
步骤D:在AlGaN势垒层30中分次、分区域注入不同浓度的氟离子,以形成m个氟离子浓度不同的氟掺杂区。
本实施例的氟注入浓度是由两端到中间逐渐增加的。请参见图7a~7b,图7a~7b是本发明实施例提供的一种氟注入工艺的方法示意图。
首先,在AlGaN势垒层30的栅极区域上光刻第一组氟注入区域F1和Fm:
具体地,在步骤C所得样品表面涂胶并甩胶,得到光刻胶掩膜,然后经烘干后通过光刻和显影形成栅下第一组氟注入区域F1和Fm的图形;如图7a所示;
利用氟基反应等离子体刻蚀工艺对第一组氟注入区域进行氟注入,使得区域F1、Fm内氟离子浓度为均为n1;
参照上述过程,分别光刻栅下第二组氟注入区域F2和Fm-1并进行氟离子注入,得到氟离子浓度为n2的氟掺杂区F2和Fm-1,以此类推。其中,n1<n2<n3<……,如图7b所示;
最终,在势垒层30中形成氟离子浓度由两端到中间逐渐增加的一系列氟掺杂区。
步骤E:在源电极41和漏电极43间的势垒层30上淀积介质层50。
步骤F:在源电极41和漏电极43间的介质层50上与氟掺杂区对应的区域制作栅电极42。
在本实施例中,步骤E~F与实施例三的步骤S5~S6相同,在此不再赘述。
本发明提供的高线性MIS-HEMT器件制备方法在实际中,工艺流程可能与上述流程不同,如台面隔离和源、漏电极制备的顺序可以互换,源、漏电极的制备可以直接在势垒层30上进行,也可先淀积介质层50,再通过对介质层50进行刻蚀实现等。此外,器件结构中也可能包括成核层、插入层、盖帽层以及钝化层等优化结构。无论具体实现方式如何,所有基于本发明所提出的器件结构所进行的结构、方法或功能上的变换均应包含在本发明的保护范围内。
以上内容是结合具体的优选实施方式对本发明所作的进一步详细说明,不能认定本发明的具体实施只局限于这些说明。对于本发明所属技术领域的普通技术人员来说,在不脱离本发明构思的前提下,还可以做出若干简单推演或替换,都应当视为属于本发明的保护范围。
Claims (10)
1.一种高线性MIS-HEMT器件,其特征在于,自下而上依次包括:衬底层(10)、缓冲层(20)、势垒层(30)以及金属电极层(40),所述金属电极层(40)两端设有源电极(41)和漏电极(43),所述源电极(41)和漏电极(43)之间设有介质层(50),所述栅电极(42)设置于所述介质层(50)上方;其中,所述势垒层(30)包括依次均匀排列的若干氟掺杂区(F1~Fm),m为正整数且m≥2。
2.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,所述氟掺杂区(F1~Fm)位于所述栅电极(42)下方并沿栅宽方向排列。
3.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,所述氟掺杂区(F1~Fm)的氟离子浓度从所述氟掺杂区F1至所述氟掺杂区Fm依次递增或者递减。
4.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,所述氟掺杂区(F1~Fm)的氟离子浓度从所述氟掺杂区F1和所述氟掺杂区Fm依次向中间递增或者递减。
5.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,还包括插入层,所述插入层设置于所述缓冲层(20)和所述势垒层(30)之间。
6.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,还包括盖帽层,所述盖帽层设置于所述势垒层(30)与所述金属电极层(40)之间。
7.根据权利要求1所述的高线性MIS-HEMT器件,其特征在于,还包括钝化层,所述钝化层设置于所述势垒层(30)或介质层(50)上方各电极之间的区域。
8.一种高线性MIS-HEMT器件的制备方法,其特征在于,包括:
步骤1:获取外延基片并进行清洗;其中,所述外延基片包括势垒层;
步骤2:在所述势垒层上制作源电极和漏电极;
步骤3:对所述外延基片进行台面刻蚀,以在所述势垒层上形成隔离台面;
步骤4:对所述势垒层进行氟离子注入以形成若干氟掺杂区;其中,所述氟掺杂区位于所述源电极和所述漏电极之间;
步骤5:在所述势垒层上淀积介质层;
步骤6:在所述介质层上与氟掺杂区对应的区域制作栅电极,以完成高线性MIS-HEMT器件的制备。
9.根据权利要求8所述的制备方法,其特征在于,步骤4包括:
(4a)在所述势垒层上光刻第一个氟注入区域,
(4b)对所述第一个氟注入区域进行氟离子注入以形成第一个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度为n1;
(4c)在所述势垒层上光刻第i个氟注入区域,并分别进行氟离子注入以形成第i个氟掺杂区,其中,所述第i个氟掺杂区的氟离子浓度为ni,且满足ni-1<ni或者ni-1>ni,其中,2≤i≤m,i、m均为正整数。
10.根据权利要求8所述的制备方法,其特征在于,步骤4包括:
(41)在所述势垒层上光刻第一个氟注入区域和第m个氟注入区域;
(42)对所述第一个氟注入区域和所述第m个氟注入区域进行氟离子注入以形成第一个氟掺杂区和第m个氟掺杂区,其中,所述第一个氟掺杂区的氟离子浓度n1和所述第m个氟掺杂区的氟离子浓度nm相等;
(43)在所述势垒层上光刻第1+j个氟注入区域和第m-j个氟注入区,并分别进行氟离子注入以形成第1+j个氟掺杂区和第m-j个氟掺杂区,其中,所述第1+j个氟掺杂区的氟离子浓度n1+j和所述第m-j个氟掺杂区的氟离子浓度nm-j相等,且满足nj<n1+j或者nj>n1+j,其中,
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2021227673A1 (zh) * | 2020-05-13 | 2021-11-18 | 西安电子科技大学 | 一种高线性hemt器件及其制备方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070224710A1 (en) * | 2005-11-15 | 2007-09-27 | The Regents Of The University Of California | Methods to shape the electric field in electron devices, passivate dislocations and point defects, and enhance the luminescence efficiency of optical devices |
CN105895686A (zh) * | 2016-01-21 | 2016-08-24 | 苏州能讯高能半导体有限公司 | 高电子迁移率晶体管器件及其制造方法 |
-
2020
- 2020-05-13 CN CN202010403434.1A patent/CN111668305A/zh active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070224710A1 (en) * | 2005-11-15 | 2007-09-27 | The Regents Of The University Of California | Methods to shape the electric field in electron devices, passivate dislocations and point defects, and enhance the luminescence efficiency of optical devices |
CN105895686A (zh) * | 2016-01-21 | 2016-08-24 | 苏州能讯高能半导体有限公司 | 高电子迁移率晶体管器件及其制造方法 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2021227673A1 (zh) * | 2020-05-13 | 2021-11-18 | 西安电子科技大学 | 一种高线性hemt器件及其制备方法 |
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