CN111402782B - 一种数字驱动像素电路及数字驱动像素的方法 - Google Patents
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Abstract
本发明实施例涉及显示技术领域,公开了一种数字驱动像素电路及数字驱动像素的方法。本发明中提供的数字驱动像素电路,包括:像素驱动模块、显示模块、存储模块和短接模块;像素驱动模块的输出端电连接显示模块的输入端,像素驱动模块的控制端电连接存储模块中任意一个输出端;短接模块的输入端电连接显示模块的输入端,短接模块的输出端电连接显示模块的输出端,短接模块的控制端电连接存储模块中任意一个输出端;在电平信号指示显示模块关闭的情况下,短接模块短接显示模块的输入端和显示模块的输出端。本发明实施方式,使得电平信号可以准确控制显示屏中的发光组件发光,提高显示屏的显示效果。
Description
技术领域
本发明实施例涉及显示技术领域,特别涉及一种数字驱动像素电路及数字驱动像素的方法。
背景技术
OLED(Organic Light-Emitting Diode)称为有机电致发光二极管,因其具有众多的优点,如主动发光无需背光源,视角宽,响应速度快,清晰度与对比度高、使用温度范围宽,可实现柔性显示与大面积全色显示等诸多优点,被应用于电视机和显示器等,另外Micro LED作为未来显示的一种解决方案也已成为显示领域研发的热点。
目前常见的像素电路分为模拟驱动像素电路和数字驱动像素电路,然而模拟驱动像素电路存在电路功耗高、信号容易受到干扰,对驱动器件一致性或者补偿电路的高度依赖等问题。数字驱动像素电路具有功耗低,信号不易受干扰,对于驱动器件一致性的容忍度高等优点。
发明人发现现有技术中至少存在如下问题:目前的数字驱动像素电路,在通过电平信号驱动OLED的过程中,在电平信号指示OLED不发光的情况下,OLED仍有发光,导致电平信号不能完全控制OLED的发光状态,影响显示效果。
发明内容
本发明实施方式的目的在于提供一种数字驱动像素电路及数字驱动像素的方法,使得电平信号可以准确控制显示屏中的发光组件发光,提高显示屏的显示效果。
为解决上述技术问题,本发明的实施方式提供了一种数字驱动像素电路,包括:像素驱动模块、显示模块、存储模块和短接模块;像素驱动模块的输入端电连接显示电压,像素驱动模块的输出端电连接显示模块的输入端,像素驱动模块的控制端电连接存储模块中任意一个输出端;短接模块的输入端电连接显示模块的输入端,短接模块的输出端电连接显示模块的输出端,短接模块的控制端电连接存储模块中任意一个输出端;存储模块用于缓存数据线输入的电平信号并输出电平信号;在电平信号指示显示模块关闭的情况下,短接模块短接显示模块的输入端和显示模块的输出端,在电平信号指示显示模块显示的情况下,像素驱动模块驱动显示模块显示。
本发明的实施方式还提供了一种数字驱动像素的方法,应用于上述的数字驱动像素电路,该数字驱动像素的方法具体包括:存储模块缓存数据线输入的电平信号;在电平信号指示显示模块显示的情况下,像素驱动模块根据电平信号,驱动显示模块显示;在电平信号指示显示模块关闭的情况下,短接模块根据电平信号,短接显示模块的输入端和输出端。
本发明实施方式相对于现有技术而言,由于数字驱动像素电路存在漏电流的情况,在电平信号指示该显示模块关闭的情况下,导致显示模块依然显示,影响了显示模块的显示效率,而本实施方式中,在显示模块的输入端电连接短接模块的输入端,在显示模块的输出端电连接短接模块的输出端,在电平信号指示显示模块关闭的情况下,该短接模块短接该显示模块的输入端和输出端,使得即使该数字驱动像素电路中存在了漏电流,也不会导致驱动显示模块显示,从而显示模块可以准确地按照电平信号的指示显示,提高了整个数字驱动像素电路的显示性能,同时,由于可以严格的按照电平信号的指示进行显示,使得在输入电压增大或减小也不会因漏电流而影响显示效果,进而可以通过调节输入电压的来调节显示模块的显示效果(如亮度值),进一步提高对显示模块的精确控制。
另外,可选地,短接模块为开关晶体管,像素驱动模块为驱动晶体管。由于晶体管为开关器件,将开关晶体管设置为短接模块,使得短接模块根据控制端接收的信号,决定该开关晶体管的源极与漏极之间是否导通,即通过开关晶体管的控制端即可确定是否短接显示模块的输入端和输出端,控制简单,准确;像素驱动模块为驱动晶体管,可以将该数字驱动像素电路中的电压信号快速转换为电流信号。
另外,可选地,若驱动晶体管与开关晶体管的导通条件不同,则驱动晶体管的栅极电连接第一输出端,开关晶体管的栅极电连接第一输出端,第一输出端输出数字信,或者,驱动晶体管的栅极电连接存储模块的第二输出端,开关晶体管的栅极电连接第二输出端,第二输出端输出与电平信号相反的反相电平信号。在驱动晶体管和开关晶体管的导通条件不相同的情况下,提供了两种电路连接的方式,即可以通过电平信号控制开关晶体管的导通或截止,也可以通过反相电平信号控制该开关晶体管的导通或截止,提高电路连接的灵活性。
另外,可选地,若驱动晶体管与开关晶体管的导通条件相同,则驱动晶体管的栅极电连接存储模块的第一输出端,开关晶体管的栅极电连接存储模块的第二输出端;或者,开关晶体管的栅极电连接存储模块的第一输出端,驱动晶体管的栅极电连接存储模块的第二输出端;其中,第一输出端输出电平信号,第二输出端输出与电平信号相反的反相电平信号。在驱动晶体管和开关晶体管的导通条件相同的情况下,提供了两种电路连接的方式,即可以通过电平信号控制开关晶体管的导通或截止,也可以通过反相电平信号控制该开关晶体管的导通或截止,进一步提高电路连接的灵活性。
另外,可选地,存储模块采用静态随机存取存储器SRAM的电路结构;存储模块的输入端分别电连接数据线和扫描线;存储模块根据扫描线输出的扫描信号,存储电平信号,或者存储模块根据扫描信号输出电平信号以及输出反相电平信号。采用SRAM电路缓存数据线输出的电平信号,缓存速度快,从而使得根据该电平信号可以快速控制显示模块的显示或关闭。
另外,可选地,驱动晶体管为P型薄膜晶体管或N型薄膜晶体管;开关晶体管为P型薄膜晶体管或N型薄膜晶体管。驱动晶体管的类型的选择灵活,开关晶体管的类型选择灵活。
另外,可选地,显示模块为有机电致发光二极管或发光二极管。显示模块的选择灵活,适用范围广。
附图说明
一个或多个实施例通过与之对应的附图中的图片进行示例性说明,这些示例性说明并不构成对实施例的限定,附图中具有相同参考数字标号的元件表示为类似的元件,除非有特别申明,附图中的图不构成比例限制。
图1是根据本发明第一实施方式提供的一种数字驱动像素电路各部分之间的连接示意图;
图2是根据本发明第一实施方式提供的一种数字驱动像素电路的具体电路示意图;
图3是根据本发明第一实施方式提供的一种数字驱动像素电路的工作时序示意图;
图4是根据本发明第一实施方式提供的另一种数字驱动像素电路的具体电路示意图;
图5是根据本发明第二实施方式提供的一种数字驱动像素电路的具体电路示意图;
图6是根据本发明第二实施方式提供的另一种数字驱动像素电路的具体电路示意图;
图7是根据本发明第三实施方式提供的一种数字驱动像素的方法的具体流程示意图;
图8是根据本发明第四实施方式提供的一种数字驱动像素的方法的具体流程示意图;
图9是根据本发明第四实施方式提供的另一种数字驱动像素的方法的具体流程示意图。
具体实施方式
为使本发明实施例的目的、技术方案和优点更加清楚,下面将结合附图对本发明的各实施方式进行详细的阐述。然而,本领域的普通技术人员可以理解,在本发明各实施方式中,为了使读者更好地理解本申请而提出了许多技术细节。但是,即使没有这些技术细节和基于以下各实施方式的种种变化和修改,也可以实现本申请所要求保护的技术方案。
本发明的第一实施方式涉及一种数字驱动像素电路。该数字驱动像素电路应用于显示装置中,显示装置可以是手机、平板电脑、电视机、显示器、笔记本电脑、数码相框或导航仪等具有显示功能的产品或部件。该数字驱动像素电路包括:像素驱动模块101、显示模块102、存储模块103和短接模块104,各部件之间的连接关系如图1所示。
像素驱动模块101的输入端电连接显示电压(如图1中所示的VOLED),像素驱动模块101的输出端电连接显示模块102的输入端,像素驱动模块101的控制端电连接存储模块103中任意一个输出端;短接模块104的输入端电连接显示模块102的输入端,短接模块104的输出端电连接显示模块102的输出端,短接模块102的控制端电连接存储模块103中任意一个输出端;存储模块103用于缓存数据线输入的电平信号并输出电平信号;在电平信号指示显示模块102关闭的情况下,短接模块104短接显示模块102的输入端和显示模块102的输出端,在电平信号指示显示模块102显示的情况下,像素驱动模块101驱动显示模块102显示,图1中,数据线以Vdata表示,负电压以Vcom表示。
具体的说,像素驱动模块101可以为驱动晶体管101,其中,该驱动晶体管101可以采用N型薄膜晶体管(Thin Film Transistor,简称“TFT”)或P型TFT,具体是选择N型TFT还是选择P型TFT,可以根据实际电路设计需要进行选择。同理,短接模块104可以为开关晶体管104,该开关晶体管104可以为N型TFT,也可以是P型TFT。驱动晶体管101的漏极电连接显示模块102的输出端,在驱动晶体管101导通的情况下,驱动该显示模块102显示。显示模块102可以选用有机电致发光二极管或发光二极管,即OLED/LED,或者AMOLED等。可以理解的是,由于N型TFT产生的漏电流较小,本实施方式中采用N型TFT。
需要说明的是,在数字驱动像素电路中包括两个时间段,即为数据写入时间段和发光时间段,数据写入时间段内,扫描信号有效的情况下存储模块103将数据线输入的信号写入,在发光时间段扫描信号无效,像素驱动模块101从存储模块103的输出端读取电平信号。数据线输入电平信号,用于指示显示模块的显示或关闭。
值得一提的是,可以根据实际应用确定有效扫描信号和无效扫描信号,例如,以扫描线输出的高电平作为扫描信号有效的情况,也可以以扫描线输出的低电平作为扫描信号有效的情况。
存储模块103可以采用静态随机存取存储器(Static Random-Access Memory,简称“SRAM”)的电路结构;该存储模块103电连接数据线和扫描线;存储模块103根据扫描线输出的扫描信号,存储电平信号,或者存储模块103根据扫描信号输出电平信号以及输出反相电平信号,其中反相电平信号与电平信号相反。
一个具体的实施例中,该存储模块103的具体结构如图2所示。该存储模块103可以由5个或6个晶体管组成,本实施例中,选取5个晶体管组成该存储模块103,晶体管M1、晶体管M2、晶体管M3以及晶体管M4构成了交叉耦合的反相器,而晶体管M5是作为控制数据线写入电平信号的控制开关。
一个具体的实施例中,该数字驱动像素电路的电路如图2所示,其中,驱动晶体管101为P型TFT,开关管晶体管与N型TFT;驱动晶体管101的栅极电连接存储模块103第一输出端(第一输出端为图2中的Q点),开关晶体管104的栅极电连接第一输出端,第一输出端输出电平信号,其中,驱动晶体管101在该电平信号指示显示模块102显示的情况下导通。在该电平信号指示显示模块102显示的情况下,该电平信号通过开关晶体管104的栅极控制该开关晶体管104处于截止状态,在该电平信号指示显示模块102关闭的情况下,电平信号通过开关晶体管104的栅极控制开关晶体管104处于导通状态,以短接显示模块102的输入端和输出端。
具体的说,由于驱动晶体管101在电平信号指示显示模块102显示的情况下导通,而在电平信号指示显示模块102关闭的情况下,开关晶体管104导通,因而,驱动晶体管101的导通条件与开关晶体管104的导通条件相反,即驱动晶体管为P型TFT,则开关晶体管为N型TFT,若驱动晶体管为N型TFT,则开关晶体管P型TFT,具体可以根据实际应用进行选择。
驱动晶体管101的栅极电连接第一输出端,驱动晶体管101的源极电连接显示电压VOLED,驱动晶体管101的漏极电连接显示模块102的输入端,显示模块102的输出端电连接负电压(如图2中的Vcom),开关晶体管104的栅极电连接第一输出端,该开关晶体管104的源极电连接该显示模块102的输入端,该开关晶体管104的漏极电连接该显示模块102的输出端。第一输出端输出电平信号,当电平信号导通驱动晶体管101的情况下,该电平信号控制开关晶体管104处于截止状态。
下面结合图2和时序图3,详解介绍数字驱动像素电路的工作过程,其中,图3中在Vdata为高电平时表示数字为“0”状态时序,Vdata为低电平时表示数字为“1”状态时序,T1表示在电平信号为高的状态下的数据写入时间段,T2表示电平信号为高的状态下的发光时间段,T3表示在电平信号为低的状态下的数据写入时间段,T4表示电平信号为低的状态下的发光时间段。
例如,假设数字为“1”时指示显示模块显示,那么在数据写入时间段内(图3中的T3时间段内),扫描信号为低电平(即图3中row为低电平),数据线输出的电平信号的电压为低(即图3中的Vdata为低电平),如图2中所示,晶体管M5导通,Q点的电压为低,从而导通晶体管M4,晶体管M3截止,/Q点与VDD电连接,使得/Q点电压等于VDD的电压,即/Q点为高电平,由于g点与Q点为同一点,电压相同,则g为低电平,驱动晶体管101导通,而开关晶体管104截止,则OLED发光。在发光时间段内(即图3中的T4),扫描信号为高电平(即图3中row为高电平),则晶体管M5处于截止状态,Q点与接地线电连接,即Q点为低,g点为低电平,则驱动晶体管101继续导通,开关晶体管104继续处于截止状态,OLED继续发光。
当数字为“0”时指示显示模块关闭,那么数据写入时间段内(即图3中的T1),扫描信号为低电平(即图3中row为低电平),数据线输出的电平信号为高电平(即图3中的Vdata为高电平),晶体管M5导通,Q点的电压为高,从而导通晶体管M 3,晶体管M 4截止,/Q点与GND电连接,使得/Q点电压等于GND的电压,即/Q点为低电平,则晶体管M2导通,使得Q点与VDD电连接,Q点为高电平,则g电压为高电平,驱动晶体管101截止,而开关晶体管104导通,则OLED不发光。在发光时间段内(即图3中的T2),扫描信号为高电平(即图3中row为高电平),则晶体管M5处于截止状态,Q点与VDD线电连接,即Q点为高电平,g点为高电平,则驱动晶体管101继续处于截止状态,开关晶体管104继续处于导通状态,OLED继续不发光。
另一个具体的实施例中,该数字驱动像素电路的电路如图4所示,其中,驱动晶体管101为N型TFT,开关管晶体管与P型TFT;驱动晶体管101的栅极电连接存储模块的第二输出端(即图4中的/Q点),开关晶体管104的栅极电连接第二输出端,第二输出端输出与电平信号相反的反相电平信号,其中,驱动晶体管101在该电平信号指示显示模块102显示的情况下截止;在该电平信号指示显示模块102显示的情况下,该反相电平信号通过开关晶体管104的栅极控制开关晶体管104截止,在该电平信号指示显示模块102关闭的情况下,反相电平信号通过开关晶体管104的栅极控制开关晶体管104导通,以短接显示模块102的输入端和输出端。
同理,下面以一个具体的例子说明,该数字驱动像素电路的工作原理,例如,假设数字为“1”时指示显示模块显示,那么在数据写入时间段内,扫描信号(即图4中row线输出的信号)为低电平,数据线(图4中的Vdata线)输出的电平信号的电压为低,如图4中所示,晶体管M5导通,Q点的电压为低,从而导通晶体管M4,而截止晶体管M3,/Q点与VDD线电连接,使得/Q点电压等于VDD上的电压,即/Q点为高电平,由于g点与/Q点为同一点,电压相同,则g点为高电平,驱动晶体管101导通,而开关晶体管104截止,则OLED发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与接地线(GND)电连接,即Q点为低电平,/Q为高电平,则g点为高电平,驱动晶体管101继续导通,开关晶体管104继续处于截止状态,OLED继续发光。
当数子为“0”时指示显示模块关闭,那么数据写入时间段内,扫描信号为低电平,数据线输出的电平信号为高电平,晶体管M5导通,Q点的电压为高,从而导通晶体管M 3,晶体管M 4截止,/Q点与GND电连接,使得/Q点电压等于GND的电压,即/Q点为低电平,驱动晶体管101截止,而开关晶体管104导通,则OLED不发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与VDD线电连接,即Q点为高电平,/Q点与GND电连接,/Q点为低电平,g点为低电平,则驱动晶体管101继续处于截止状态,开关晶体管104继续处于导通状态,OLED继续不发光。
本发明实施方式相对于现有技术而言,由于数字驱动像素电路存在漏电流的情况,在电平信号指示该显示模块关闭的情况下,导致显示模块依然显示,影响了显示模块的显示效率,而本实施方式中,在显示模块的输入端电连接短接模块的输入端,在显示模块的输出端电连接短接模块的输出端,在电平信号指示显示模块关闭的情况下,该短接模块短接该显示模块的输入端和输出端,使得即使该数字驱动像素电路中存在了漏电流,也不会导致驱动显示模块显示,从而显示模块可以准确地按照电平信号的指示显示,提高了整个数字驱动像素电路的显示性能,同时,由于可以严格的按照电平信号的指示进行显示,使得在输入电压增大或减小也不会因漏电流而影响显示效果,进而可以通过调节输入电压的来调节显示模块的显示效果(如亮度值),进一步提高对显示模块的精确控制。
本发明的第二实施方式涉及一种数字驱动像素电路。第二实施方式与第一实施方式大致相同,主要区别之处在于:在本发明第二实施方式中,驱动晶体管101和开关晶体管104的导通条件相同情况下,提供了另一种的电路连接方式,以提高驱动晶体管的灵活性。
一个具体的实施例中,该数字驱动像素电路的电路如图5所示;其中,以驱动晶体管为P型TFT,开关晶体管也为P型TFT为例进行说明。驱动晶体管101的栅极电连接存储模块103的第一输出端(即图5中的Q点),开关晶体管104的栅极电连接存储模块103的第二输出端(即图5中的/Q点),第一输出端输出电平信号,第二输出端输出与电平信号相反的反相电平信号,其中,驱动晶体管101和开关晶体管104均在电平信号指示显示模块102显示的情况下导通。在电平信号指示显示模块102显示的情况下,电平信号通过驱动晶体管101的栅极控制驱动晶体管101驱动显示模块102显示,反相电平信号通过开关晶体管104的栅极控制开关晶体管104截止;在电平信号指示显示模块102关闭的情况下,电平信号通过驱动晶体管101的栅极控制驱动晶体管101截止,反相电平信号通过开关晶体管104的栅极控制开关晶体管104导通,以短接显示模块102的输入端和显示模块102的输出端。
下面以一个具体的例子说明,该数字驱动像素电路的工作原理。例如,假设数字为“1”时指示显示模块显示,那么在数据写入时间段内,扫描信号为低电平,数据线输出的电平信号为低电平,如图5中所示,晶体管M5导通,Q点的电压为低,从而导通晶体管M4,晶体管M3截止,/Q点与VDD电连接,使得/Q点电压等于VDD的电压,即/Q点为高电平,由于g点与Q点为同一点,电压相同,则g电压为低,驱动晶体管101导通,而/g点与/Q电压相同,则开关晶体管104截止,则OLED发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与接地线电连接,即Q点为低电平,g点为低电平,/g为高电平,则驱动晶体管101继续导通,开关晶体管104继续处于截止状态,OLED继续发光。
当数子为“0”时指示显示模块关闭,那么数据写入时间段内,扫描信号为低电平,数据线输出的电平信号为高电平,晶体管M5导通,Q点的电压为高,从而导通晶体管M 3,晶体管M 4截止,/Q点与GND电连接,使得/Q点电压等于GND的电压,即/Q点为低电平,则晶体管M 1截止,晶体管M2导通,使得Q点与VDD电连接,Q点为高电平,则g电压为高电平,驱动晶体管101截止,而/g为低电平,开关晶体管104导通,则OLED不发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与VDD线电连接,即Q点输出电平信号,/Q输出反相电平信号,则驱动晶体管101继续处于截止状态,开关晶体管104继续处于导通状态,OLED继续不发光。
另一个具体的实施例中,该数字驱动像素电路的电路如图5所示,其中,驱动晶体管101为N型TFT,开关管晶体管104与N型TFT为例进行说明。开关晶体管104的栅极电连接存储模块103的第一输出端(即图6中的Q点),驱动晶体管101的栅极电连接存储模块103的第二输出端(即图6中的/Q点),第一输出端输出电平信号,第二输出端输出与电平信号相反的反相电平信号,其中,开关晶体管104和驱动晶体管101在电平信号指示显示模块102关闭的情况下导通。在电平信号指示显示模块102关闭的情况下,电平信号通过开关晶体管104的栅极控制开关晶体管104导通,以短接显示模块102的输入端和输出端,反相电平信号通过驱动晶体管101的栅极控制驱动晶体管101截止;在电平信号指示显示模块102显示的情况下,电平信号通过开关晶体管104的栅极控制开关晶体管104截止,反相电平信号通过驱动晶体管101的栅极控制驱动晶体管101驱动显示模块102显示。
同理,下面以一个具体的例子说明,该数字驱动像素电路的工作原理,例如,假设数字为“1”时指示显示模块显示,那么在数据写入时间段内,扫描信号为低电平,数据线输出的电平信号的电压为低,如图4中所示,晶体管M5导通,Q点的电压为低,从而导通晶体管M4,晶体管M3截止,/Q点与VDD电连接,使得/Q点电压等于VDD的电压,即/Q点为高,由于g点与/Q点为同一点,电压相同,则g点为高电平,驱动晶体管101导通,而/g点为电平,开关晶体管104截止,则OLED发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与接地线电连接,即Q点为低电平,g点为高电平,/g为低电平,则驱动晶体管101继续导通,开关晶体管104继续处于截止状态,OLED继续发光。
当数子为“0”时指示显示模块关闭,那么数据写入时间段内,扫描信号为低电平,数据线输出的电平信号为高电平,晶体管M5导通,Q点的电压为高,从而导通晶体管M 3,晶体管M 4截止,/Q点与GND电连接,使得/Q点电压等于GND的电压,即/Q点为低电平,驱动晶体管101截止,而Q点为高电平,开关晶体管104导通,则OLED不发光。在发光时间段内,扫描信号为高点平,则晶体管M5处于截止状态,Q点与VDD线电连接,即Q点为高电平,/Q点与GND电连接,/Q点为低电平,g点为低电平,则驱动晶体管101继续处于截止状态,/g点为高电平,开关晶体管104继续处于导通状态,OLED继续不发光。
本实施方式提供的数字驱动像素电路,在驱动晶体管的导通条件和开关晶体管的导通条件相同的情况,提供了多种电路连接方式,从而可以根据实际需要,选择驱动晶体管和开关晶体管的类型,提高了该数字驱动像素电路的灵活性和适用性。
本发明第三实施方式涉及一种数字驱动像素的方法,该数字驱动像素的方法应用于如第一实施方式的数字驱动像素电路。本实施方式中将结合第一实施方式中图2的像素电路,介绍的该像素驱动的方法,该像素驱动的方法具体的流程如图7所示。
步骤301:存储模块缓存数据线输入的电平信号。
具体的说,如图2中所示的电路结构,数据线输入的电平信号通过SRAM电路结构,可以缓存该电平信号,并通过存储模块的第一输出端输出,该存储模块的第二输出端输出反相电平信号,该电平信号与反相电平信号互为相反的电平信号。
步骤302:在电平信号指示显示模块显示的情况下,像素驱动模块根据电平信号,驱动显示模块显示。
具体的说,如图2中所示,像素驱动模块为驱动晶体管101,该驱动晶体管101为P型TFT,即该驱动晶体管的栅极为低电平时导通,短接模块104为开关晶体管104,该开关晶体管104为N型TFT,即开关晶体管的栅极为高电平时导通。
下面以一个具体的例子说明当电平信号为指示该显示模块显示情况下,该数字驱动像素电路的工作原理。假设数字为“1”的时序的情况下,那么在数据写入时间段内,扫描信号为低电平,数据线输出的电平信号的为低电平;则存储模块的第一输出端输出低电平,第二输出端输出高点平,该低电平信号控制该驱动晶体管101处于导通状态,同时该低电平信号控制开关晶体管104处于截止状态,OLED发光。在发光时间段内,扫描信号为高电平,数据线输出的电平信号的为低电平,此时存储模块输出在数据写入时间段内存入的电平信号,即此时,该第一输出端继续输出低电平,第二输出端输出高电平,则该低电平信号继续控制该驱动晶体管101处于导通状态,同时该低电平信号控制开关晶体管104继续处于截止状态,OLED发光。
步骤303:在电平信号指示显示模块关闭的情况下,短接模块根据电平信号,短接显示模块的输入端和输出端。
下面以一个具体的例子说明当电平信号为指示该显示模块显示情况下,该数字驱动像素电路的工作原理。假设,数字为“0”的时序的情况下,那么在数据写入时间段内,扫描信号为低电平,数据线输出的电平信号的为高电平;则存储模块的第一输出端输出高电平,第二输出端输出低点平。第一输出端输出的高电平信号控制该驱动晶体管101处于截止状态,同时该高电平信号控制开关晶体管104处于导通状态,OLED不发光。在发光时间段内,扫描信号为高电平,数据线输出的电平信号的为高电平,此时存储模块输出在数据写入时间段内存入的电平信号,即此时,该第一输出端继续输出高电平,第二输出端输出低电平,则该高平信号继续控制该驱动晶体管101处于截止状态,同时该高电平信号控制开关晶体管104继续处于导通状态,从而短接该OLED的输入端和输出端,OLED不发光。
上面各种方法的步骤划分,只是为了描述清楚,实现时可以合并为一个步骤或者对某些步骤进行拆分,分解为多个步骤,只要包括相同的逻辑关系,都在本专利的保护范围内;对算法中或者流程中添加无关紧要的修改或者引入无关紧要的设计,但不改变其算法和流程的核心设计都在该专利的保护范围内。
不难发现,本实施方式为与第一实施方式相对应的方法实施例,本实施方式可与第一实施方式互相配合实施。第一实施方式中提到的相关技术细节在本实施方式中依然有效,为了减少重复,这里不再赘述。相应地,本实施方式中提到的相关技术细节也可应用在第一实施方式中。
本发明第四实施方式涉及一种数字驱动像素的方法。第四实施方式是对第三实施方式中步骤303的进一步细化,该像素驱动的方法具体的流程如图8或图9所示。
步骤401:存储模块缓存数据线输入的电平信号。
步骤402:在电平信号指示显示模块显示的情况下,像素驱动模块根据电平信号,驱动显示模块显示。
步骤403:在电平信号指示显示模块关闭的情况下,若短接模块的控制端接收电平信号,则电平信号控制短接模块导通,短接显示模块的输入端和输出端。
具体的说,短接模块为开关晶体管,像素驱动模块为驱动晶体管;若驱动晶体管与开关晶体管的导通条件不同,可以采用第一实施方式中的图2的数字像素驱动电路的结构,若驱动晶体管与开关晶体管的导通条件相同,可以采用如第二实施方式中的图6中所示的数字驱动像素电路的结构。
若采用图2中的电路结构,驱动晶体管101和开关晶体管104均与存储模块103的第一输出端电连接,图2中驱动晶体管101在低电平的信号下导通,开关晶体管104在高电平的信号导通,若电平信号为低电平时指示该显示模块102显示,那么在该电平信号指示显示模块102显示的情况下,第一输出端输出电平信号,该电平信号通过驱动晶体管101的栅极控制该驱动晶体管导通,从而驱动显示模块102显示,同时,该电平信号通过开关晶体管104的栅极控制该开关晶体管104处于截止状态,则显示模块102显示。若在该电平信号指示显示模块102关闭的情况下,该电平信号通过驱动晶体管101的栅极控制该驱动晶体管101处于截止状态,同时,该电平信号通过开关晶体管104的栅极控制该开关晶体管104处于导通状态,从而短接该显示模块102的输入端和输出端;具体的工作原理与第一实施方式中图2的工作原理大致相同,此处不再进行赘述。
若采用图6中所示的数字驱动像素电路,驱动晶体管101的栅极电连接第二输出端,开关晶体管104的栅极,图6中驱动晶体管101在低电平的信号下导通,开关晶体管104在高电平的信号导通,若电平信号为低电平时指示该显示模块102显示,那么在该电平信号指示显示模块102显示的情况下,第一输出端输出电平信号。驱动晶体管101为N型TFT,开关晶体管104为N型TFT,在电平信号指示显示模块102显示的情况下,电平信号为低电平,则该电平信号通过开关晶体管104的栅极控制开关晶体管处于截止状态,反相电平信号为高电平,反相电平信号控制驱动晶体管101导通,则显示模块102显示。在电平信号指示显示模块102显关闭的情况下,电平信号为高电平,该电平信号通过开关晶体管104的栅极控制给开关晶体管104导通,反相电平信号为低电平,则反相电平信号控制开关晶体管104处于截止状态,显示模块102关闭。
可以理解的是,若驱动晶体管与开关晶体管的导通条件不同,该数字像素驱动电路还可以采用图4中的电路结构,若驱动晶体管与开关晶体管的导通条件相同还可以采用图5中的电路结构,那么数字驱动像素的方法具体流程如图9所示:
步骤401:存储模块缓存数据线输入的电平信号。
步骤402:在电平信号指示显示模块显示的情况下,像素驱动模块根据电平信号,驱动显示模块显示。
步骤403:若短接模块的控制端接收反相电平信号,则反相电平信号控制短接模块导通,短接显示模块的输入端和输出端。
具体的说,若采用图4中的电路结构,在电平信号指示显示模块102显示的情况下,开关晶体管104的栅极通过反相电平信号控制开关晶体管截止,在电平信号指示显示模块102关闭的情况下,开关晶体管104的栅极通过反相电平信号控制开关晶体管104导通,以短接显示模块102的输入端和输出端。驱动晶体管101在高电平的信号下导通,开关晶体管104在低电平的信号导通,若电平信号为低电平时指示该显示模块102显示,那么,第一输出端输出低电平,反相电平信号为高电平,从而该反相电平信号控制该驱动晶体管101处于导通状态,同时,该高电平使得开关晶体管104处于截止状态。若电平信号为高电平时指示显示模块102关闭,则第一输出端输出的高电平信号,电平信号为高电平,反相电平信号为低电平,该反相电平信号控制驱动晶体管101处于截止状态,而该反相电平信号使开关晶体管101处于导通状态,从而短接显示模块102的输入端和输出端。
若采用图5中的电路结构,驱动晶体管101在高电平的信号下导通,开关晶体管104在高电平的信号导通,若电平信号为低电平时指示该显示模块102显示,那么,第一输出端输出低电平,从而驱动该驱动晶体管101导通,同时,反相电平信号为高电平,该反相电平信号使得开关晶体管104处于截止状态。若电平信号为高电平时指示显示模块102关闭,则第一输出端输出的高电平信号控制驱动晶体管101处于截止状态,而该反相电平信号为低电平,则反相电平信号控制该开关晶体管104处于导通状态,从而短接显示模块102的输入端和输出端。
值得一提的是,本实施方式中的图8以及图9中的步骤401至步骤402均与第三实施方式中的步骤301至步骤302大致相同,本实施方式中不在赘述。
本实施方式中提供的数字驱动像素的方法,根据与短接模块控制端接收的信号类型,确定该短接模块根据电平信号或反相电平信号的控制下短接显示模块的输入端和输出端。
本领域的普通技术人员可以理解,上述各实施方式是实现本发明的具体实施例,而在实际应用中,可以在形式上和细节上对其作各种改变,而不偏离本发明的精神和范围。
Claims (10)
1.一种数字驱动像素电路,其特征在于,包括:像素驱动模块、显示模块、存储模块和短接模块;
所述像素驱动模块的输入端电连接显示电压,所述像素驱动模块的输出端电连接所述显示模块的输入端,所述像素驱动模块的控制端电连接所述存储模块中任意一个输出端;
所述短接模块的输入端电连接所述显示模块的输入端,所述短接模块的输出端电连接所述显示模块的输出端,所述短接模块的控制端电连接所述存储模块中任意一个输出端;
所述存储模块用于缓存数据线输入的电平信号并输出所述电平信号;
在所述电平信号指示所述显示模块关闭的情况下,所述短接模块短接所述显示模块的输入端和所述显示模块的输出端,在所述电平信号指示所述显示模块显示的情况下,所述像素驱动模块驱动所述显示模块显示。
2.根据权利要求1所述的数字驱动像素电路,其特征在于,所述短接模块为开关晶体管,所述像素驱动模块为驱动晶体管。
3.根据权利要求2所述的数字驱动像素电路,其特征在于,若所述驱动晶体管与所述开关晶体管的导通条件不同,则所述驱动晶体管的栅极电连接第一输出端,所述开关晶体管的栅极电连接所述第一输出端,所述第一输出端输出所述电平信号;
或者,所述驱动晶体管的栅极电连接所述存储模块的第二输出端,所述开关晶体管的栅极电连接所述第二输出端,所述第二输出端输出与所述电平信号相反的反相电平信号。
4.根据权利要求2所述的数字驱动像素电路,其特征在于,若所述驱动晶体管与所述开关晶体管的导通条件相同,则所述驱动晶体管的栅极电连接所述存储模块的第一输出端,所述开关晶体管的栅极电连接所述存储模块的第二输出端;
或者,
所述开关晶体管的栅极电连接所述存储模块的第一输出端,所述驱动晶体管的栅极电连接所述存储模块的第二输出端;
其中,所述第一输出端输出所述电平信号,所述第二输出端输出与所述电平信号相反的反相电平信号。
5.根据权利要求1至4中任一项所述的数字驱动像素电路,其特征在于,所述存储模块采用静态随机存取存储器SRAM的电路结构;
所述存储模块的输入端分别电连接所述数据线和扫描线;
所述存储模块根据扫描线输出的扫描信号,存储所述电平信号,或者所述存储模块根据所述扫描信号输出所述电平信号以及输出反相电平信号。
6.根据权利要求2至4中任一项所述的数字驱动像素电路,其特征在于,所述驱动晶体管为P型薄膜晶体管或N型薄膜晶体管;
所述开关晶体管为所述P型薄膜晶体管或所述N型薄膜晶体管。
7.根据权利要求1至4中任一项所述的数字驱动像素电路,其特征在于,所述显示模块为有机电致发光二极管或发光二极管。
8.一种数字驱动像素的方法,应用于如权利要求1至7中任一项所述的数字驱动像素电路,其特征在于,所述数字驱动像素的方法具体包括:
存储模块缓存数据线输入的电平信号;
在所述电平信号指示显示模块显示的情况下,像素驱动模块根据所述电平信号,驱动所述显示模块显示;
在所述电平信号指示所述显示模块关闭的情况下,短接模块根据所述电平信号,短接所述显示模块的输入端和输出端。
9.根据权利要求8所述的数字驱动像素的方法,其特征在于,所述短接模块为开关晶体管,所述像素驱动模块为驱动晶体管;
在所述电平信号指示所述显示模块关闭的情况下,短接模块根据所述电平信号,短接所述显示模块的输入端和输出端,具体包括:
若所述驱动晶体管与所述开关晶体管的导通条件不同且所述开关晶体管在所述电平信号指示所述显示模块显示的情况下截止,则在所述电平信号指示所述显示模块显示的情况下,所述电平信号通过所述开关晶体管的栅极控制所述开关晶体管截止,在所述电平信号指示所述显示模块关闭的情况下,所述电平信号通过所述开关晶体管的栅极控制所述开关晶体管导通,以短接所述显示模块的输入端和输出端;
或者,
若所述驱动晶体管与所述开关晶体管的导通条件不同且所述开关晶体管在所述电平信号指示所述显示模块显示的情况下导通,则在所述电平信号指示所述显示模块显示的情况下,所述开关晶体管的栅极通过反相电平信号控制所述开关晶体管截止,在所述电平信号指示所述显示模块关闭的情况下,所述开关晶体管的栅极通过所述反相电平信号控制所述开关晶体管导通,以短接所述显示模块的输入端和输出端。
10.根据权利要求8所述的数字驱动像素的方法,其特征在于,所述短接模块为开关晶体管,所述像素驱动模块为驱动晶体管;
在所述电平信号指示所述显示模块关闭的情况下,短接模块根据所述电平信号,短接所述显示模块的输入端和输出端,具体包括:
若所述驱动晶体管与所述开关晶体管的导通条件相同且所述开关晶体管在所述电平信号指示所述显示模块显示的情况下导通,则在所述电平信号指示所述显示模块显示的情况下,所述电平信号通过所述驱动晶体管的栅极控制所述驱动晶体管驱动所述显示模块显示,反相电平信号通过所述开关晶体管的栅极控制所述开关晶体管截止,在所述电平信号指示所述显示模块关闭的情况下,所述电平信号通过所述驱动晶体管的栅极控制所述驱动晶体管截止,所述反相电平信号通过所述开关晶体管的栅极控制所述开关晶体管导通,以短接所述显示模块的输入端和所述显示模块的输出端;
或者,若所述驱动晶体管与所述开关晶体管的导通条件相同且所述开关晶体管在所述电平信号指示所述显示模块关闭的情况下导通,则在所述电平信号指示所述显示模块关闭的情况下,所述电平信号通过所述开关晶体管的栅极控制所述开关晶体管导通,以短接所述显示模块的输入端和输出端,所述反相电平信号通过所述驱动晶体管的栅极控制所述驱动晶体管截止,在所述电平信号指示所述显示模块显示的情况下,所述电平信号通过所述开关晶体管的栅极控制所述开关晶体管截止,所述反相电平信号通过所述驱动晶体管的栅极控制所述驱动晶体管驱动所述显示模块显示。
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