CN111061663B - 一种数据传输方法、装置及相关组件 - Google Patents

一种数据传输方法、装置及相关组件 Download PDF

Info

Publication number
CN111061663B
CN111061663B CN201911287932.8A CN201911287932A CN111061663B CN 111061663 B CN111061663 B CN 111061663B CN 201911287932 A CN201911287932 A CN 201911287932A CN 111061663 B CN111061663 B CN 111061663B
Authority
CN
China
Prior art keywords
bus
data
ahb
apb
address
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201911287932.8A
Other languages
English (en)
Other versions
CN111061663A (zh
Inventor
王朝辉
刘同强
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Suzhou Metabrain Intelligent Technology Co Ltd
Original Assignee
Suzhou Inspur Intelligent Technology Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Suzhou Inspur Intelligent Technology Co Ltd filed Critical Suzhou Inspur Intelligent Technology Co Ltd
Priority to CN201911287932.8A priority Critical patent/CN111061663B/zh
Publication of CN111061663A publication Critical patent/CN111061663A/zh
Priority to PCT/CN2020/103999 priority patent/WO2021120623A1/zh
Priority to US17/785,199 priority patent/US20230009095A1/en
Application granted granted Critical
Publication of CN111061663B publication Critical patent/CN111061663B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/382Information transfer, e.g. on bus using universal interface adapter
    • G06F13/387Information transfer, e.g. on bus using universal interface adapter for adaptation of different data processing systems to different peripheral devices, e.g. protocol converters for incompatible systems, open system
    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/40Bus structure
    • G06F13/4004Coupling between buses
    • G06F13/4027Coupling between buses using bus bridges
    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/16Handling requests for interconnection or transfer for access to memory bus
    • G06F13/1668Details of memory controller

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Information Transfer Systems (AREA)
  • Bus Control (AREA)
  • Memory System Of A Hierarchy Structure (AREA)

Abstract

本申请公开了一种数据传输方法,应用于连接APB总线和AHB总线的APB桥,包括:根据AHB总线特征将传输分为地址相位阶段和数据相位阶段;在地址相位阶段,当AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;在数据相位阶段,当APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,总线为APB总线或AHB总线。本申请不需要对地址信息和控制信息及数据进行缓存,从而减少对存储空间的占用。本申请还公开了一种数据传输装置及电子设备,具有以上有益效果。

Description

一种数据传输方法、装置及相关组件
技术领域
本申请涉及AMBA总线领域,特别涉及一种数据传输方法、装置及相关组件。
背景技术
BMC(Baseboard Management Controller,基板管理控制器)芯片内部集成一个处理器,处理器通过数据总线与其外部设备进行通信。以ARM处理器为例,ARM处理器通过AMBA(Advanced Microcontroller Bus Architecture,先进微控制器总线体系结构)总线与外部设备进行通信,根据AMBA协议规范,需要将AHB(Advanced High Performance Bus,高级高性能总线)总线上的数据传输到APB(Advanced Peripheral Bus,外围总线)总线上,一般是通过Bridge实现两条总线上数据的转换和传输。
参照图1和图2所示,图1为AHB总线的传输时序图,图2为APB总线的传输时序图,可见,现有的AHB总线的传输方案中,对于当前事务,先传输地址信息和控制信息,在下一时钟周期再传输数据,且传输地址信息和控制信息仅需要一个时钟周期,而传输数据需要多个时钟周期,现有的APB总线的传输方案中,对同一事务是同时传输地址信息、控制信息及数据的,因此需要在APB桥中,需要对AHB总线发送的地址信息、控制信息进行缓存,等到所有信息和数据均接收完毕后再传输,这样会使用过多的缓存隔离,占用存储空间。
因此,如何提供一种解决上述技术问题的方案是本领域技术人员目前需要解决的问题。
发明内容
本申请的目的是提供一种数据传输方法、装置及电子设备,不需要对地址信息和控制信息及数据进行缓存,从而减少对存储空间的占用。
为解决上述技术问题,本申请提供了一种数据传输方法,应用于连接APB总线和AHB总线的APB桥,包括:
根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段;
在所述地址相位阶段,当所述AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;
在所述数据相位阶段,当所述APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,所述总线为所述APB总线或所述AHB总线。
优选的,所述根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段之后,该数据传输方法还包括:
设置所述地址相位阶段对应的第一标识及所述数据相位阶段对应的第二标识;
根据所述第一标识或所述第二标识是否有效判断当前传输为所述地址相位阶段或所述数据相位阶段。
优选的,所述地址传输条件包括所述AHB总线的HTRANS为2’b01,且所述AHB总线的HREADY有效。
优选的,所述当前操作包括读操作或写操作;
若当前操作为所述读操作,所述数据传输有效条件包括:
PREADY、PENABLE及PSEL均为高电平;
若当前操作为所述写操作,所述数据传输有效条件包括:
所述PREADY为高电平。
优选的,所述将接收到的数据发送至与当前操作对应的总线的同时,该数据传输方法还包括:
将所述PREADY的值赋予HREADY。
优选的,该数据传输方法还包括:
当所述第一标识和所述第二标识同时有效时,判定当前传输为所述地址相位阶段。
优选的,该数据传输方法还包括:
当HREADY及HTRANS均有效时所述第一标识有效;
所述第一标识有效后的下一时钟周期,所述第二标识有效。
优选的,该数据传输方法还包括:
当所述第一标识和所述第二标识均无效时,触发HREADY转换为高电平。
为解决上述技术问题,本申请还提供了一种数据传输装置,应用于连接APB总线和AHB总线的APB桥,包括:
划分模块,用于根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段;
第一传输模块,用于在所述地址相位阶段,当所述AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;
第二传输模块,用于在所述数据相位阶段,当所述APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,所述总线为所述APB总线或所述AHB总线。
为解决上述技术问题,本申请还提供了一种电子设备,包括:
存储器,用于存储计算机程序;
处理器,用于执行所述计算机程序时实现如上文任意一项所述数据传输方法的步骤。
本申请提供了一种数据传输方法,应用于连接APB总线和AHB总线的APB桥,首先将传输过程按AHB总线特征分为地址相位阶段和数据相位阶段,以便在各自对应的时钟周期传输地址信息、控制信息及数据,本申请中,收到信息或数据后,满足当前相位阶段对应的条件即进行传输,从而减少对地址信息、控制信息及数据的缓存时间,进而减少对存储空间的占用。本申请还提供了一种数据传输装置及电子设备,具有和上述数据传输方法相同的有益效果。
附图说明
为了更清楚地说明本申请实施例,下面将对实施例中所需要使用的附图做简单的介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本申请所提供的一种AHB总线的传输时序图;
图2为本申请所提供的一种APB总线的传输时序图;
图3为本申请所提供的一种数据传输系统的结构示意图;
图4为本申请所提供的一种数据传输方法的步骤流程图;
图5为本申请所提供的一种AHB总线转APB总线的读操作时序图;
图6为本申请所提供的一种AHB总线转APB总线的写操作时序图;
图7为现有技术中一种AHB总线转APB总线的多事务时序图;
图8为本申请所提供的一种AHB总线转APB总线的多事务时序图;
图9为本申请所提供的一种数据传输装置的结构示意图;
图10为本申请所提供的一种电子设备的结构示意图。
具体实施方式
本申请的目的是提供一种数据传输方法、装置及电子设备,不需要对地址信息和控制信息及数据进行缓存,从而减少对存储空间的占用。
为使本申请实施例的目的、技术方案和优点更加清楚,下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本申请保护的范围。
为了便于理解本申请的数据传输方法,下面对于本申请的数据传输方法所适用的系统进行介绍,参照图3,其示出了本申请实施例的一种数据传输系统的结构示意图。
如图3所示,AHB总线上挂载有高带宽内存接口High-bandwidth MemoryInterface、高性能ARM处理器High-performance ARM processor、高带宽RAM芯片High-bandwidth on-chip RAM、DMA总线主控DMA bus master,APB总线上挂载有UART(UniversalAsynchronous Receiver Transmitter,通用异步收发传输器)、键盘Keypad、计时器Timer、电脑PIO(Parts In One,可自由组装成一体电脑的新型准电脑)等外设,AHB总线和APB总线通过AHB to APB Bridge桥连接,以下简称APB桥。本申请所提供的数据传输方法具体可以通过APB桥实现,APB桥可看作AHB总线的从设、看作APB总线的主设。
请参照图4,图4为本申请所提供的一种数据传输方法的步骤流程图,该数据传输方法包括:
S101:根据AHB总线特征将传输分为地址相位阶段和数据相位阶段;
S102:在地址相位阶段,当AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;
S103:在数据相位阶段,当APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,总线为APB总线或AHB总线。
具体的,根据AHB总线的特征,将传输分为两个阶段,一个为地址相位阶段,一个为数据相位阶段。本实施例中,当前操作可以包括读操作或写操作,参照图5、图6所示,图5为AHB总线转APB总线的读操作对应的时序图,图6为AHB总线转APB总线的写操作对应的时序图,在地址相位阶段,例如当HTRANS为2’b01,同时HREADY有效(高电平)的情况下,将HADDR赋值给PADDR,将HWRITE赋值给PWRITE,同时使能PENABLE,当PREADY为高电平以后,PENABLE恢复为低电平,HWRITE为AHB总线的写控制信号(即控制信息),HWRITE为高电平时,当前操作为写操作,HWRITE为低电平时,当前操作为读操作。
具体的,若当前操作为读操作,参照图5所示,只有第一个时钟周期为地址相位阶段,在数据相位阶段,等待APB总线的PREADY信号为高电平,同时数据有效,数据有效即PSEL为高电平且PENABLE为高电平,将数据反馈到AHB总线的HRDATA上。
具体的,若当前操作为写操作,参照图6所示,地址相位阶段的操作和读操作相同,在数据相位阶段,需要等待PREADY有效后,将AHB总线的HWDATA直接赋值给APB总线上的PWDATA,并使HREADY等于PREADY。
进一步的,在将传输分为地址相位阶段和数据相位阶段后,分别用ahb_trans_head和 ahb_trans_data进行标识,其中ahb_trans_head为第一标识,ahb_trans_data为第二标识,当ahb_trans_head有效,且ahb_trans_data无效时,判定传输当前处于地址相位阶段,当ahb_trans_data有效,且ahb_trans_head无效时,判定传输当前处于数据相位阶段。ahb_trans_head有效的条件为HREADY有效,且HTRANS有效。ahb_trans_data有效的条件是发生在ahb_trans_head的第二拍,当HREADY为低电平并且没有ahb_trans_head时,ahb_trans_data就会变为无效,以上所有信号均为高电平有效。当ahb_trans_head和ahb_trans_data都无效的时候,会触发HREADY变为高电平。也就是说HREADY默认为高电平,其他情况下,HREADY等于PREADY。
可以理解的是,当AHB总线进行如图7所示的多事务传输时,当前事务的数据相位阶段,同时也是下一个事务的地址相位阶段,传输过程容易出现bug,因此,当ahb_trans_data与ahb_trans_head同时有效时,即图8中的第三周期,本申请采取地址相位阶段优先的方式,即在第3周期,将HADDR赋值给PADDR,所以在第4周期的PADDR变为地址B,从而达到区分事务的地址相位阶段和数据相位阶段的目的。
本申请提供了一种数据传输方法,应用于连接APB总线和AHB总线的APB桥,首先将传输过程按AHB总线特征分为地址相位阶段和数据相位阶段,以便在各自对应的时钟周期传输地址信息、控制信息及数据,本申请中,收到信息或数据后,满足当前相位阶段对应的条件即进行传输,从而减少对地址信息、控制信息及数据的缓存时间,进而减少对存储空间的占用。
请参照图9,图9为本申请所提供的一种数据传输装置,应用于连接APB总线和AHB总线的APB桥,包括:
划分模块1,用于根据AHB总线特征将传输分为地址相位阶段和数据相位阶段;
第一传输模块2,用于在地址相位阶段,当AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;
第二传输模块3,用于在数据相位阶段,当APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,总线为APB总线或AHB总线。
可见,本实施例首先将传输过程按AHB总线特征分为地址相位阶段和数据相位阶段,以便在各自对应的时钟周期传输地址信息、控制信息及数据,本申请中,收到信息或数据后,满足当前相位阶段对应的条件即进行传输,从而减少对地址信息、控制信息及数据的缓存时间,进而减少对存储空间的占用。
作为一种优选的实施例,该数据传输装置还包括:
标识设置模块,用于设置地址相位阶段对应的第一标识及数据相位阶段对应的第二标识;
相位阶段判断模块,用于根据第一标识或第二标识是否有效判断当前传输为地址相位阶段或数据相位阶段。
作为一种优选的实施例,地址传输条件包括AHB总线的HTRANS为2’b01,且AHB总线的HREADY有效。
作为一种优选的实施例,当前操作包括读操作或写操作;
若当前操作为读操作,数据传输有效条件包括:
PREADY、PENABLE及PSEL均为高电平;
若当前操作为写操作,数据传输有效条件包括:
PREADY为高电平。
作为一种优选的实施例,该数据传输装置还包括:
赋值模块,用于将PREADY的值赋予HREADY。
作为一种优选的实施例,相位阶段判断模块,具体用于当第一标识和第二标识同时有效时,判定当前传输为地址相位阶段。
作为一种优选的实施例,当HREADY及HTRANS均有效时,第一标识有效;第一标识有效后的下一时钟周期,判定第二标识有效。
作为一种优选的实施例,该数据传输装置还包括:
触发模块,用于当第一标识和第二标识均无效时,触发HREADY转换为高电平。
另一方面,本申请还提供了一种电子设备,如参见图10,其示出了本申请实施例一种电子设备的一种组成结构示意图,本实施例的电子设备2100可以包括:处理器2101和存储器2102。
可选的,该电子设备还可以包括通信接口2103、输入单元2104和显示器2105和通信总线2106。
处理器2101、存储器2102、通信接口2103、输入单元2104、显示器2105、均通过通信总线2106完成相互间的通信。
在本申请实施例中,该处理器2101,可以为中央处理器(Central ProcessingUnit,CPU),特定应用集成电路,数字信号处理器,现成可编程门阵列或者其他可编程逻辑器件等。
该处理器可以调用存储器2102中存储的程序。具体的,处理器可以执行以下数据传输方法的实施例中电子设备侧所执行的操作。
存储器2102中用于存放一个或者一个以上程序,程序可以包括程序代码,程序代码包括计算机操作指令,在本申请实施例中,该存储器中至少存储有用于实现以下功能的程序:
根据AHB总线特征将传输分为地址相位阶段和数据相位阶段;
在地址相位阶段,当AHB总线满足当前操作对应的地址传输条件,将AHB总线发送的地址信息和控制信息传输到APB总线上;
在数据相位阶段,当APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,总线为APB总线或AHB总线。
可见,本实施例首先将传输过程按AHB总线特征分为地址相位阶段和数据相位阶段,以便在各自对应的时钟周期传输地址信息、控制信息及数据,本申请中,收到信息或数据后,满足当前相位阶段对应的条件即进行传输,从而减少对地址信息、控制信息及数据的缓存时间,进而减少对存储空间的占用。
在一种可能的实现方式中,该存储器2102可包括存储程序区和存储数据区,其中,存储程序区可存储操作系统、以及至少一个功能(比如有效性判断功能等)所需的应用程序等;存储数据区可存储根据计算机的使用过程中所创建的数据。
此外,存储器2102可以包括高速随机存取存储器,还可以包括非易失性存储器,例如至少一个磁盘存储器件或其他易失性固态存储器件。
该通信接口2103可以为通信模块的接口,如GSM模块的接口。
本申请还可以包括显示器2104和输入单元2105等等。
当然,图10所示的物联网设备的结构并不构成对本申请实施例中物联网设备的限定,在实际应用中电子设备可以包括比图10所示的更多或更少的部件,或者组合某些部件。
还需要说明的是,在本说明书中,诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来,而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且,术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含,从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素,而且还包括没有明确列出的其他要素,或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的状况下,由语句“包括一个……”限定的要素,并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
对所公开的实施例的上述说明,使本领域专业技术人员能够实现或使用本申请。对这些实施例的多种修改对本领域的专业技术人员来说将是显而易见的,本文中所定义的一般原理可以在不脱离本申请的精神或范围的情况下,在其他实施例中实现。因此,本申请将不会被限制于本文所示的这些实施例,而是要符合与本文所公开的原理和新颖特点相一致的最宽的范围。

Claims (10)

1.一种数据传输方法,其特征在于,应用于连接APB总线和AHB总线的APB桥,包括:
根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段;
在所述地址相位阶段,当所述AHB总线满足当前操作对应的地址传输条件,将所述AHB总线发送的地址信息和控制信息传输到所述APB总线上;
在所述数据相位阶段,当所述APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,所述总线为所述APB总线或所述AHB总线。
2.根据权利要求1所述的数据传输方法,其特征在于,所述根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段之后,该数据传输方法还包括:
设置所述地址相位阶段对应的第一标识及所述数据相位阶段对应的第二标识;
根据所述第一标识或所述第二标识是否有效判断当前传输为所述地址相位阶段或所述数据相位阶段。
3.根据权利要求1所述的数据传输方法,其特征在于,所述地址传输条件包括所述AHB总线的HTRANS为2’b01,且所述AHB总线的HREADY有效。
4.根据权利要求1所述的数据传输方法,其特征在于,所述当前操作包括读操作或写操作;
若当前操作为所述读操作,所述数据传输有效条件包括:
PREADY、PENABLE及PSEL均为高电平;
若当前操作为所述写操作,所述数据传输有效条件包括:
所述PREADY为高电平。
5.根据权利要求1所述的数据传输方法,其特征在于,所述将接收到的数据发送至与当前操作对应的总线的同时,该数据传输方法还包括:
将PREADY的值赋予HREADY。
6.根据权利要求2所述的数据传输方法,其特征在于,该数据传输方法还包括:
当所述第一标识和所述第二标识同时有效时,判定当前传输为所述地址相位阶段。
7.根据权利要求2所述的数据传输方法,其特征在于,该数据传输方法还包括:
当HREADY及HTRANS均有效时所述第一标识有效;
所述第一标识有效后的下一时钟周期,所述第二标识有效。
8.根据权利要求7所述的数据传输方法,其特征在于,该数据传输方法还包括:
当所述第一标识和所述第二标识均无效时,触发HREADY转换为高电平。
9.一种数据传输装置,其特征在于,应用于连接APB总线和AHB总线的APB桥,包括:
划分模块,用于根据所述AHB总线特征将传输分为地址相位阶段和数据相位阶段;
第一传输模块,用于在所述地址相位阶段,当所述AHB总线满足当前操作对应的地址传输条件,将所述AHB总线发送的地址信息和控制信息传输到所述APB总线上;
第二传输模块,用于在所述数据相位阶段,当所述APB总线满足当前操作对应的数据传输有效条件,将接收到的数据发送至与当前操作对应的总线,所述总线为所述APB总线或所述AHB总线。
10.一种电子设备,其特征在于,包括:
存储器,用于存储计算机程序;
处理器,用于执行所述计算机程序时实现如权利要求1-8任意一项所述数据传输方法的步骤。
CN201911287932.8A 2019-12-15 2019-12-15 一种数据传输方法、装置及相关组件 Active CN111061663B (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN201911287932.8A CN111061663B (zh) 2019-12-15 2019-12-15 一种数据传输方法、装置及相关组件
PCT/CN2020/103999 WO2021120623A1 (zh) 2019-12-15 2020-07-24 一种数据传输方法、装置及相关组件
US17/785,199 US20230009095A1 (en) 2019-12-15 2020-07-24 Data transmission method and apparatus, and related assembly

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201911287932.8A CN111061663B (zh) 2019-12-15 2019-12-15 一种数据传输方法、装置及相关组件

Publications (2)

Publication Number Publication Date
CN111061663A CN111061663A (zh) 2020-04-24
CN111061663B true CN111061663B (zh) 2021-03-26

Family

ID=70301687

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201911287932.8A Active CN111061663B (zh) 2019-12-15 2019-12-15 一种数据传输方法、装置及相关组件

Country Status (3)

Country Link
US (1) US20230009095A1 (zh)
CN (1) CN111061663B (zh)
WO (1) WO2021120623A1 (zh)

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111061663B (zh) * 2019-12-15 2021-03-26 苏州浪潮智能科技有限公司 一种数据传输方法、装置及相关组件
CN112527717B (zh) * 2020-12-18 2024-06-11 中科芯集成电路有限公司 一种区分主机写入操作的AHB-to-APB转换桥
CN115114201B (zh) * 2022-06-27 2024-07-02 山东云海国创云计算装备产业创新中心有限公司 一种fsi控制器和包括其的bmc芯片
CN115617721B (zh) * 2022-11-05 2023-11-21 深圳三地一芯电子股份有限公司 数据传输方法、dma装置及主控芯片
CN116974963B (zh) * 2023-09-25 2023-12-15 上海云豹创芯智能科技有限公司 一种访问存储器的装置及其方法、芯片、存储介质
CN117130964B (zh) * 2023-10-27 2024-03-12 沐曦集成电路(上海)有限公司 一种APB-to-AHB转换桥及其控制方法
CN120045485B (zh) * 2025-02-08 2025-11-18 上海励驰半导体有限公司 基于apb的外设访问系统、访问方法、存储介质及芯片

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101026528A (zh) * 2007-04-05 2007-08-29 中兴通讯股份有限公司 一种同步串行接口装置
CN101183347A (zh) * 2006-11-14 2008-05-21 智多微电子(上海)有限公司 一种自适应速率匹配总线的桥接电路
CN101196859A (zh) * 2006-12-04 2008-06-11 中芯国际集成电路制造(上海)有限公司 直接访问存储装置及直接访问存储操作方法
CN103198043A (zh) * 2013-01-24 2013-07-10 杭州中科微电子有限公司 一种改进的AHB to APB总线桥及其控制方法
CN108255776A (zh) * 2017-12-01 2018-07-06 广东高云半导体科技股份有限公司 一种兼容apb总线的i3c主设备、主从系统及通信方法

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6859852B2 (en) * 2000-09-08 2005-02-22 Texas Instruments Incorporated Immediate grant bus arbiter for bus system
US7020807B2 (en) * 2001-09-19 2006-03-28 Koninklijke Philips Electronics N.V. Data communication bus traffic generator arrangement
JP2007058716A (ja) * 2005-08-26 2007-03-08 Oki Electric Ind Co Ltd データ転送バスシステム
KR101842245B1 (ko) * 2011-07-25 2018-03-26 삼성전자주식회사 시스템 온 칩 버스 장치 및 그에 따른 루트 클럭 게이팅 방법
US9164938B2 (en) * 2013-01-02 2015-10-20 Intel Corporation Method to integrate ARM ecosystem IPs into PCI-based interconnect
US10503674B2 (en) * 2016-02-03 2019-12-10 Samsung Electronics Co., Ltd. Semiconductor device including a clock source for generating a clock signal and a clock control circuit for controlling the clock source in hardware, a semiconductor system including the semiconductor device, and a method of operating the semiconductor device
CN107832239A (zh) * 2017-09-13 2018-03-23 东莞市爱协生智能科技有限公司 一种基于ahb总线的传输控制方法及装置
EP3819778A1 (en) * 2019-11-07 2021-05-12 Ams Ag Bus system and method for operating a bus system
CN111061663B (zh) * 2019-12-15 2021-03-26 苏州浪潮智能科技有限公司 一种数据传输方法、装置及相关组件
US11487683B2 (en) * 2020-04-15 2022-11-01 AyDeeKay LLC Seamlessly integrated microcontroller chip

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101183347A (zh) * 2006-11-14 2008-05-21 智多微电子(上海)有限公司 一种自适应速率匹配总线的桥接电路
CN101196859A (zh) * 2006-12-04 2008-06-11 中芯国际集成电路制造(上海)有限公司 直接访问存储装置及直接访问存储操作方法
CN101026528A (zh) * 2007-04-05 2007-08-29 中兴通讯股份有限公司 一种同步串行接口装置
CN103198043A (zh) * 2013-01-24 2013-07-10 杭州中科微电子有限公司 一种改进的AHB to APB总线桥及其控制方法
CN108255776A (zh) * 2017-12-01 2018-07-06 广东高云半导体科技股份有限公司 一种兼容apb总线的i3c主设备、主从系统及通信方法

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
AHB-to-APB总线桥的硬件设计;王彬等;《火力与指挥控制》;20080430;第33卷;第94-96页 *

Also Published As

Publication number Publication date
WO2021120623A1 (zh) 2021-06-24
US20230009095A1 (en) 2023-01-12
CN111061663A (zh) 2020-04-24

Similar Documents

Publication Publication Date Title
CN111061663B (zh) 一种数据传输方法、装置及相关组件
CN102511039B (zh) 将不可预取存储单元映射到存储器映射输入/输出空间中
RU2619540C1 (ru) Преобразователь протоколов между шиной cpci и шиной isa и соответствующий ему способ преобразования
CN107111576B (zh) 发布的中断架构
US11983136B2 (en) PCIe device and operating method thereof
US9003091B2 (en) Flow control for a Serial Peripheral Interface bus
US7171509B2 (en) Method and apparatus for host messaging unit for Peripheral Component Interconnect busmaster devices
US9952643B2 (en) Device power management state transition latency advertisement for faster boot time
US12292849B2 (en) PCIe device
KR20050080828A (ko) 개방형 코어 프로토콜을 기반으로 하는 버스 시스템
US12242625B2 (en) PCIe function and operating method thereof
US20220327080A1 (en) PCIe DEVICE AND OPERATING METHOD THEREOF
TW202026895A (zh) 聚集帶內中斷
US5968144A (en) System for supporting DMA I/O device using PCI bus and PCI-PCI bridge comprising programmable DMA controller for request arbitration and storing data transfer information
CN104714907A (zh) 一种pci总线转换为isa和apb总线设计方法
CN202948447U (zh) 基于PCI总线的串行Rapid IO协议控制器
JP4837659B2 (ja) 分割トランザクションを処理するためのバス・コントローラ
CN100517283C (zh) 先进高性能系统总线连接装置及先进高性能系统总线装置
CN101673254B (zh) 嵌入式x86处理器应用于通用片上总线的方法、系统芯片
US20080059669A1 (en) Method and Apparatus for Enhancing Data Rate of Advanced Micro-Controller Bus Architecture
US5915103A (en) Method and system for an extensible on silicon bus supporting multiple functional blocks
CN114281499A (zh) 一种总线互连时的中断传递处理方法及系统
JP5146796B2 (ja) ホストコントローラ
TW200424858A (en) System bus controller and the method thereof
US20250335093A1 (en) Controller and memory system including a mailbox

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant
CP03 Change of name, title or address
CP03 Change of name, title or address

Address after: Building 9, No.1, guanpu Road, Guoxiang street, Wuzhong Economic Development Zone, Wuzhong District, Suzhou City, Jiangsu Province

Patentee after: Suzhou Yuannao Intelligent Technology Co.,Ltd.

Country or region after: China

Address before: Building 9, No.1, guanpu Road, Guoxiang street, Wuzhong Economic Development Zone, Wuzhong District, Suzhou City, Jiangsu Province

Patentee before: SUZHOU LANGCHAO INTELLIGENT TECHNOLOGY Co.,Ltd.

Country or region before: China