CN110836992A - 基于fpga的示波功率仪采集系统 - Google Patents

Abstract

本发明公开了一种基于FPGA的示波功率仪采集系统，在进行定频采样时，待测信号经ADC模块采集后经过抽点模块存入定频采样模块中；在进行同步采样时，采样数据首先通过基波频率测量模块准确测量得到基波频率，其方法为先使用FFT分析法粗略计算出输入信号的基波频率，经过滤除毛刺后通过测频法或测周法精确测量出信号的频率，最后通过对输入信号倍频后完成同步采样。本发明可以在精准测量输入信号基波频率并显示的同时，快速实现定频采样和同步采样。

Description

基于FPGA的示波功率仪采集系统

技术领域

本发明属于示波功率仪技术领域，更为具体地讲，涉及一种基于FPGA的示波功率仪采集系统。

背景技术

目前，全球对于能源和电力效率的关注日益增加，但是传统功率测量仪表无法实现精确的动态测量和波形的捕获，而示波器无法用于高精度的功率测量。示波功率仪能够精确测量并计算相关功率参数，同时具有一定示波器的功能，可以对电压电流的波形进行捕获。采集模块是示波功率仪的一个重要组成部分，对于基于FPGA(Field ProgrammableGate Array，现场可编程门阵列)的示波功率仪采集模块而言，其重点及难点主要体现在系统级层面搭建采集架构，主要包括定频采样模式和同步采样模式，并设计出最符合用户需求并且可以广泛应用的方案。

定频采样模式是指示波功率仪中ADC以恒定速率进行采样，采样数据ADC_DATA发送至FPGA中。当用户选择不同时基档位时，采样数据ADC_DATA在FPGA中进行抽点。当一帧波形采样完成后，FPGA将这一帧波形数据发送至上位机进行显示。

同步采样也称为跟踪采样，即为了使采样频率f_s始终与输入信号的频率f₁保持固定的比例关系M＝f_s/f₁，必须使采样频率随输入信号的频率的变化而实时地调整。这种同步采样方式实施的技术保障可利用硬件测频设备或软件计算频率的方法来配合实现。同步采样的难点是准确获取输入信号的基波频率f₁，当输入信号中含有谐波成分时，该信号通过交流耦合后，其一个周期内可能会有多个过零点，因此该信号通过零比较器后，不论是测频法还是测周法其测量结果都大于输入信号的基波频率。同时，示波功率仪的时基档位一般是采用1-2-5步进，当示波功率仪工作在同步采样模式时，由于采样率f_s随着输入信号频率f₁的变化处于动态变化中，f_s可能不是1-2-5的整倍数，因此上位机无法根据当前的采样率f_s来制定时基档位和计算抽点系数，用户难以观测到当前的采样波形。

综上所述，如何精准测量输入信号的基波频率和搭建采集架构是示波功率仪数据采集部分的重点及难点。

发明内容

本发明的目的在于克服现有技术的不足，提供一种基于FPGA的示波功率仪采集系统，在精准测量输入信号基波频率并显示的同时，快速实现定频采样和同步采样。

为了实现上述发明目的，本发明基于FPGA的示波功率仪采集系统包括比较器模块，ADC模块，FFT运算模块，参考时钟选择模块，滤毛刺模块，频率测量模块和上位机，其中FFT运算模块，参考时钟选择模块，滤毛刺模块和频率测量模块在FPGA中实现，其中：

比较器模块用于对经过交流耦合后的输入信号进行过0比较，得到与输入信号同频同相的矩形波信号CARD_CNV，并将矩形波信号CARD_CNV输出至滤毛刺模块；

ADC模块用于对同一输入信号进行采集，将采集得到的包含N个采样点的采集数据序列ADC_DATA发送至抽点模块、触发模块、定频采样模块和同步采样模块，ADC的采样率f_s由输入ADC的参考时钟ADC_CNV频率决定，即f_s＝f_{ADC_CNV}；

抽点模块根据上位机发送的抽点系数对采样序列ADC_DATA进行抽点，将抽点后的序列DATA_IN发送至定频采样模块；

触发模块对采样序列ADC_DATA进行检测，当检测到有效触发到来时，触发模块输出持续一个系统时钟的高电平的触发信号Trig至定频采样模块和同步采样模块，要求触发信号Trig有效时与有效触发点在DATA_IN序列中所在位置对齐；

定频采样模块用于缓存由抽点模块发送的波形数据，当一帧波形采集完成后输出定频采样数据存满标识Full_2＝1至数据选择模块；

基波频率测量模块用于对输入信号的基波频率进行精准测量并发送给倍频模块和上位机模块；基波频率测量模块包括FFT运算模块、参考时钟选择模块、滤毛刺模块和频率测量模块，其中：FFT运算模块采用FFT分析法初步确定输入信号的频率，具体方法为：将接收到的采集数据序列ADC_DATA进行FFT运算，输出N点的频谱序列，记每一点的频谱包括实部Re[k]和虚部Im[k]两部分，k＝1,2,…,N，采用如下公式计算得到k点处的频率能量X[k]：

找出频率能量X[k]的最大值和其对应的点序号k_max，将点序号k_max发送给参考时钟选择模块；

参考时钟选择模块用于选择一个参考时钟clk_fre作为滤毛刺模块中滤除毛刺成分的时钟源，其中参考时钟clk_fre的频率f_ref以及对应的掩码值m需要满足需要满足的条件为

f₁表示基波频率，

f₂表示二次谐波频率，

滤毛刺模块用于根据掩码值m和参考时钟clk_fre将矩形波信号CARD_CNV中的毛刺滤除，得到矩形波信号CARD_FREQ并发送至频率测量模块；

频率测量模块用于基于测频法或测周法对矩形波信号CARD_FREQ进行测量，将输入信号中基波的精准频率fre₁发送至倍频模同步块和上位机模块；

倍频模块对基波频率fre₁进行M倍倍频后输出参考时钟Clock2给时钟选择模块，即时钟Clock2频率f_Clock2＝M×fre₁；

时钟源模块用于输出一个固定频率的参考时钟Clock1给时钟选择模块，其频率f_Clock1即为ADC工作在定频采样模式下的频率；

时钟选择模块用于根据接收到的工作模块指令Mode对输入的时钟信号进行选择，并输出参考时钟信号给ADC模块；当用户选择定频采样模式时，时钟选择模块选择参考时钟Clock1并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0；当用户选择同步采样模式时，时钟选择模块首先选择参考时钟Clock1并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0，当基波频率测量模块完成频率测量并且倍频模块完成信号倍频并输出参考时钟Clock2时，时钟选择模块选择参考时钟Clock2并输出，有f_{ADC_CNV}＝f_Clock2，同时输出参考时钟Clock1有效标识Clock1_valid＝0，参考时钟Clock2有效标识Clock2_valid＝1至同步采样模块；

同步采样模块用于缓存由ADC模块发送的波形数据，当一帧波形采集完成后输出同步采样数据存满标识Full_2＝1至数据选择模块；

数据选择模块用于根据接收到的定频采样数据存满标识Full_1、同步采样数据存满标识Full_2和工作模式指令Mode对数据序列DATA_1和DATA_2进行选择，并发送至上位机模块；当用户选择定频采样模式时，如果定频采样数据存满标识Full_1＝1，数据选择模块将DATA_1发送至上位机模块，即Dout＝DATA_1；当用户选择同步采样模式时，如果定频采样数据存满标识Full_1＝1时，数据选择模块将DATA_1发送至上位机模块，如果定频同步采样数据存满标识Full_2＝1，数据选择模块将DATA_2发送至上位机模块，即Dout＝DATA_2；

上位机模块用于根据用户选择的工作模式生成工作模式指令Mode发送给时钟选择模块和数据选择模块，并将相应的预触发深度参数发送给定频采样模块和同步采样模块；接收数据选择模块发送的数据Dout和基波频率测量模块发送的基波频率fre₁，进行相应的分析计算，并将波形数据和测频结果发送至显示模块进行显示；

显示模块接收上位机模块发送的波形数据和测频结果并进行显示。

本发明基于FPGA的示波功率仪采集系统，在进行定频采样时，待测信号经ADC模块采集后经过抽点模块存入定频采样模块中；在进行同步采样时，采样数据首先通过基波频率测量模块准确测量得到基波频率，其方法为先使用FFT分析法粗略计算出输入信号的基波频率，经过滤除毛刺后通过测频法或测周法精确测量出信号的频率，最后通过对输入信号倍频后完成同步采样。

本发明具有以下有益效果：

(1)本发明中的基波频率测量模块通过FFT运算和滤毛刺模块等可以精准测量出基波频率，相较于现有的测频方法具有较高的精度；

(2)本发明只采用一片ADC即实现同步采样，相较于现有技术中采用两片ADC采样(高精度ADC对输入波形进行采样，低精度ADC负责测频)的方法减少了硬件开发成本；

(3)本发明中基波频率测量模块可以单独工作，在进行定频采样时可以同时精准测量出基波频率并在屏幕上显示，在进行同步采样时，每测量一次频率然后采集一帧波形，保证了同步采样中采样率实时快速地调整；

(4)本发明中在进行同步采样时，时钟选择模块首先选择参考时钟Clock1信号并输出，此时ADC的采样数据ADC_DATA被同时送入基波频率测量模块和抽点模块，ADC_DATA经过抽点后被送入定频采样模块，波形采样完成后传输至上位机，用户在选择同步采样时仍然能够选择合适的时基档位观测采样波形。

附图说明

图1是本发明基于FPGA的示波功率仪采集系统的具体实施方式结构图；

图2是本发明中基波频率测量模块的结构图；

图3是本发明中毛刺产生及测频示意图；

图4是本发明毛刺滤除的原理示意图。

具体实施方式

下面结合附图对本发明的具体实施方式进行描述，以便本领域的技术人员更好地理解本发明。需要特别提醒注意的是，在以下的描述中，当已知功能和设计的详细描述也许会淡化本发明的主要内容时，这些描述在这里将被忽略。

实施例

图1是本发明基于FPGA的示波功率仪采集系统的具体实施方式结构图。如图1所示，本发明基于FPGA的示波功率仪采集系统包括比较器模块1，ADC模块2，抽点模块3，触发模块4，定频采样模块5，基波频率测量模块6，倍频模块7，时钟源模块8，时钟选择模块9，同步采样模块10，数据选择模块11，上位机模块12和显示模块13，其中，抽点模块3，触发模块4，定频采样模块5，基波频率测量模块6，倍频模块7，时钟源模块8，时钟选择模块9，同步采样模块10和数据选择模块11在FPGA中实现，下面分别对各个模块进行详细说明。

比较器模块1用于对经过交流耦合后的输入信号进行过0比较，得到与输入信号同频同相的矩形波信号CARD_CNV，并将矩形波信号CARD_CNV输出至基波频率测量模块6。若输入信号为单一频率的正弦波，则比较器模块1输出即为与输入正弦波同频同相的方波，即在一个周期内高电平和低电平时间各占50％。

ADC模块2用于对同一输入信号进行采集，将采集得到的包含N个采样点的采集数据序列ADC_DATA发送至抽点模块3、触发模块4、定频采样模块5和同步采样模块10，ADC的采样率f_s由输入ADC的参考时钟ADC_CNV频率决定，即f_s＝f_{ADC_CNV}。

抽点模块3根据上位机发送的抽点系数对采样序列ADC_DATA进行抽点，将抽点后的序列DATA_IN发送至定频采样模块5。

触发模块4对采样序列ADC_DATA进行检测，当检测到有效触发到来时，触发模块输出持续一个系统时钟的高电平的触发信号Trig至定频采样模块5和同步采样模块10，要求触发信号Trig有效时与有效触发点在DATA_IN序列中所在位置对齐。

定频采样模块5用于缓存由抽点模块3发送的波形数据，当一帧波形采集完成后输出定频采样数据存满标识Full_2＝1至数据选择模块11。本实施例的定频采样模块内部是一个ACQ_FIFO，当用户选择定频采样模式时，定频采样模块5接收到时钟选择模块9输出的参考时钟Clock1有效标识Clock1_valid＝1，采样序列DATA_IN写入ACQ_FIFO中，ACQ_FIFO工作在只写不读的状态；当预触发深度写满时，ACQ_FIFO工作在边读边写的状态，等待有效触发信号到来；当有效的Trig信号到来后，ACQ_FIFO工作在只写不读的状态直到ACQ_FIFO写满，然后ACQ_FIFO读写均关闭，输出定频采样数据存满标识Full＝1至数据选择模块。当一帧波形采集完成后，上位机打开ACQ_FIFO的读使能，将一帧波形的有效数据DATA_1输出至数据选择模块11。当用户选择同步采样模式时，首先需要完成基波频率测量，因此时钟选择模块9首先选择参考时钟Clock1输出，同时参考时钟Clock1有效标识Clock1_valid＝1，此时ADC模块2工作在定频采样模式下，ADC_DATA被同时送到数据入基波频率测量模块和抽点模块，ADC_DATA经过抽点后被送入定频采样模块，当ACQ_FIFO写满时输出定频采样数据存满标识Full_1＝1，波形采样数据被传输至上位机模块12，用户在选择同步采样时仍然能够选择合适的时基档位观测采样波形。当参考时钟Clock1有效标识Clock1_valid＝0时，采样序列DATA_IN不再写入ACQ_FIFO中。

基波频率测量模块6用于对输入信号的基波频率进行精准测量。图2是本发明中基波频率测量模块的结构图。如图2所示，本发明中基波频率测量模块6包括FFT运算模块61、参考时钟选择模块62、滤毛刺模块63和频率测量模块64。

FFT运算模块61采用FFT分析法初步确定输入信号的频率，具体方法为：将接收到的采集数据序列ADC_DATA进行FFT运算，输出N点的频谱序列，记每一点的频谱包括实部Re[k]和虚部Im[k]两部分，k＝1,2,…,N，采用如下公式计算得到k点处的频率能量X[k]：

找出频率能量X[k]的最大值和其对应的点序号k_max，将点序号k_max发送给参考时钟选择模块62。假设ADC模块2的采样频率为f_s，由于频谱函数以f_s/2为对称轴左右对称，因此只需计算0≤k′≤N/2-1范围内的频率能量X[k′]，即可以比较得到频率能量的最大值。由于频率分辨率Δf＝f_s/N，因此k_max对应的频率误差为Δf。

参考时钟选择模块62用于选择一个参考时钟clk_fre作为滤毛刺模块中滤除毛刺成分的时钟源。为了更好地说明参考时钟选择模块62的工作过程，首先对本发明中毛刺产生及测频进行简单说明。图3是本发明中毛刺产生及测频示意图。如图3所示，当输入信号中含有谐波成分时，通过比较器模块1输出的矩形波信号CARD_CNV中含有窄脉宽成分，该窄脉宽可以看成是一个毛刺，其宽度记为T_pulse。根据FFT运算模块中得到的基波对应的点序号k_max，则基波频率为

由于频率分辨率Δf＝f_s/N，因此输入的周期信号基波频率实际范围为(f₁-Δf/2,f₁+Δf/2)，周期T₁范围为

二次谐波频率

对应的频率范围为(f₂-Δf/2,f₂+Δf/2)，周期T₂范围为

由于二次谐波的周期长度是所有谐波周期中最长的，因此只需要将二次谐波所造成的毛刺长度T_pulse滤除，即可得到与输入信号同频同相的矩形波CARD_FREQ。毛刺长度T_pulse范围为

需要据此选择参考时钟ref_clk的频率f_ref。

假设m为滤除毛刺成分所需参考时钟的个数，称之为掩码值，则只需要m个参考时钟的时间长度大于毛刺长度即可，那么掩码值m和频率f_ref需要满足但是由于掩码值m如果过大可能将矩形波信号CARD_CNV中的基波成分滤掉，因此需要令

综上所述，掩码值m和频率f_ref需要满足的条件为由于掩码值m较大时会消耗FPGA内部较多的寄存器资源，因此需要根据基波频率f₁的大小来设置不同的档位，合理选择掩码值m和参考时钟频率f_ref。当基波频率f₁较小时，选择频率较低的参考时钟clk_fre；当基波频率f₁较大时，选择频率较高的参考时钟clk_fre。参考时钟选择模块62确定掩码值m和参考时钟频率f_ref后，将掩码值m和参考时钟clk_fre发送给滤毛刺模块63。

滤毛刺模块63用于根据掩码值m和参考时钟clk_fre将矩形波信号CARD_CNV中的毛刺滤除，得到矩形波信号CARD_FREQ并发送至频率测量模块。图4是本发明毛刺滤除的原理示意图。如图4所示，本发明中毛刺滤除的具体方法为：构建一个长度为m、值全为1的一维数组作为滑动窗口，在矩形波信号CARD_CNV按位滑动，如果若相与后结果全为1或全为0，如图4(a)和4(b)所示，则表示信号CARD_CNV中不存在缺口，CARD_FREQ仍然输出1或0，若相与后出现部分0和部分1的结果，如图4(c)，表示矩形波信号CARD_CNV出现缺口或为信号电平跳转处，信号CARD_FREQ输出前一刻的值，经过滤除缺口后，即可得到与输入信号同频同相位的矩形波信号CARD_FREQ。由于本实施例中在设置掩码值和参考时钟clk_fre频率时，使m个参考时钟的时间长度大于毛刺长度而小于基波长度，那么在滑动窗口在遇到毛刺出现时，相与后便出现部分0和部分1的结果，从而采用前一时刻值替换毛刺中的值，实现对毛刺的滤除，而不会对基波造成影响。

频率测量模块64用于基于测频法或测周法对矩形波信号CARD_FREQ进行测量，将输入信号中基波的精准频率fre₁发送至倍频模块和上位机模块。例如采用测周法时，当形波信号CARD_FREQ的上升沿到来时，频率测量模块6开始对一个高频时钟信号CLK_SYS进行时钟周期计数，时钟信号CLK_SYS的时钟周期为T_sys，当CNV_FREQ的上升沿第K次到来时，计数器停止工作，从而得到脉冲计数结果COUNT_T。在得到脉冲计数结果COUNT_T后，则输入信号的基波周期T₁＝T_sys×COUNT_T/K，输入信号的基波频率fre₁＝1/T₁。

倍频模块7对基波频率fre₁进行M倍倍频后输出参考时钟Clock2给时钟选择模块9，即时钟Clock2频率f_Clock2＝M×fre₁。

时钟源模块8用于输出一个固定频率的参考时钟Clock1给时钟选择模块9，其频率f_Clock1即为ADC工作在定频采样模式下的频率。

时钟选择模块9用于根据接收到的工作模块指令Mode对输入的时钟信号进行选择，并输出参考时钟信号给ADC模块2。当用户选择定频采样模式时，Mode＝2‘b01，时钟选择模块9选择参考时钟Clock1并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0；当用户选择同步采样模式时，Mode＝2‘b10，时钟选择模块9首先选择Clock1信号并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0，当基波频率测量模块6完成频率测量并且倍频模块7完成信号倍频并输出参考时钟Clock2时，时钟选择模块9选择参考时钟Clock2并输出，有f_{ADC_CNV}＝f_Clock2，同时输出参考时钟Clock1有效标识Clock1_valid＝0，参考时钟Clock2有效标识Clock2_valid＝1至同步采样模块10。

同步采样模块10用于缓存由ADC模块2发送的波形数据，当一帧波形采集缓存完成后输出同步采样数据存满标识Full_2＝1至数据选择模块11。本实施例中同步采样模块10的内部是一个SY_FIFO，当用户选择定频采样时且Clock2_valid＝1时，采样序列ADC_DATA写入SY_FIFO中，SY_FIFO工作在只写不读的状态；当预触发深度写满时，SY_FIFO工作在边读边写的状态，等待有效触发信号到来；当有效的Trig信号到来后，SY_FIFO工作在只写不读的状态直到SY_FIFO写满，然后SY_FIFO读写均关闭。当一帧波形采集完成后，输出同步采样数据存满标识Full_2＝1至数据选择模块11，上位机打开SY_FIFO的读使能，将一帧波形的有效数据DATA_2输出至数据选择模块11。

数据选择模块11用于根据接收到的定频采样数据存满标识Full_1、同步采样数据存满标识Full_2和工作模式指令Mode对数据序列DATA_1和DATA_2进行选择，并发送至上位机模块12。当用户选择定频采样模式时，如果定频采样数据存满标识Full_1＝1，数据选择模块11将DATA_1发送至上位机模块12，即Dout＝DATA_1；当用户选择同步采样模式时，如果定频采样数据存满标识Full_1＝1时，数据选择模块11将DATA_1发送至上位机模块12，如果同步采样数据存满标识Full_2＝1，数据选择模块将DATA_2发送至上位机模块12，即Dout＝DATA_2。

上位机模块12用于根据用户选择的工作模式生成工作模式指令Mode发送给时钟选择模块9和数据选择模块11，并将相应的预触发深度参数发送给定频采样模块5和同步采样模块10；接收数据选择模块11发送的数据Dout和基波频率测量模块6发送的基波频率fre₁，进行相应的分析计算，并将波形数据和测频结果发送至显示模块13进行显示，该过程为示波功率仪的基本功能，具体过程在此不再赘述。

显示模块13接收上位机模块12发送的波形数据和测频结果并进行显示。

为了更好地说明本发明，采用一个具体实施例对本发明的工作流程进行说明。本实施例中基于FPGA的示波功率仪采集系统的具体工作流程如下：

步骤1：当用户选择定频采样时，上位机模块12首先对定频采样模块5中的ACQ_FIFO和时钟选择模块9进行复位，参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0。示波功率仪中ADC模块2的采样率为1MSPS，分辨率为16bits，ACQ_FIFO位宽为16bits，深度为1k。上位机模块12将预触发深度pre_depth1＝500发送至定频采样模块5，将抽点系数发送至抽点模块3。时钟源模块8输出1MHz的参考时钟Clock1给时钟选择模块9，时钟选择模块9选择Clock1作为ADC模块的参考时钟并输出到ADC模块2。

步骤2、复位完成后，经过抽点后的采样序列DATA_IN被写入ACQ_FIFO中，当预触发深度被写满后，ACQ_FIFO处于边读边写状态，当有效触发Trig到来后，将ACQ_FIFO写满。ACQ_FIFO写满后，一帧波形采样完成，定频采样数据存满标识Full_1＝1,上位机模块12将ACQ_FIFO中的数据读出，数据选择模块11将DATA_1发送至上位机柜12并由显示模块13进行显示。

步骤3、当用户选择同步采样时，上位机模块12首先对同步采样模块10中的SY_FIFO、时钟选择模块9和定频采样模块5中的ACQ_FIFO进行复位，参考时钟Clock2有效标识Clock2_valid＝0。ADC模块2首先工作在1MHz的采样率下，SY_FIFO位宽为16bits，深度为8k。上位机模块12将预触发深度pre_depth2＝4k发送至同步采样模块10。时钟源模块8输出1MHz的参考时钟Clock1给时钟选择模块9，时钟选择模块9选择Clock1作为ADC的参考时钟并输出到ADC,参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0。

步骤4、复位完成后，经过抽点后的采样序列DATA_IN被写入ACQ_FIFO中，当一帧波形采集完成后，定频采样数据存满标识Full_1＝1，上位机将ACQ_FIFO中的数据读出并进行显示，用户在选择同步采样时仍然能够选择合适的时基档位观测采样波形。同时，输入信号经过比较器模块1后输出矩形波CARD_CNV信号到基波频率测量模块6。基波频率测量模块6将测量结果fre1＝66.7Hz发送至倍频模块7。倍频模块7中倍频系数M＝8000，因此倍频模块7中输出参考时钟Clock2的频率f_Clock2＝533600Hz给时钟选择模块9。

步骤5、时钟选择模块9选择参考时钟Clock2作为ADC模块2的参考时钟并输出到ADC模块2，同时输出参考时钟Clock1有效标识Clock1_valid＝0至定频采样模块5，输出参考时钟Clock2有效标识Clock2_valid＝1至同步采样模块10。

步骤6、当同步采样模块10判断到Clock2_valid＝1时，采样序列ADC_DATA写入SY_FIFO中，当预触发深度被写满后，SY_FIFO处于边读边写状态，当有效触发Trig到来后，将SY_FIFO写满。SY_FIFO写满后，一帧波形采样完成，同步采样数据存满标识Full_2＝1，上位机模块12将SY_FIFO中的数据读出，数据选择模块11将DATA_2发送至上位机模块12并进行相关功率参数的运算。

步骤7、返回步骤3，开始下一次同步采样过程。若用户关闭同步采样功能，则FPGA不再进行同步采样操作。

尽管上面对本发明说明性的具体实施方式进行了描述，以便于本技术领域的技术人员理解本发明，但应该清楚，本发明不限于具体实施方式的范围，对本技术领域的普通技术人员来讲，只要各种变化在所附的权利要求限定和确定的本发明的精神和范围内，这些变化是显而易见的，一切利用本发明构思的发明创造均在保护之列。

Claims (1)

1.一种基于FPGA的示波功率仪采集系统，其特征在于包括比较器模块，ADC模块，FFT运算模块，参考时钟选择模块，滤毛刺模块，频率测量模块和上位机，其中FFT运算模块，参考时钟选择模块，滤毛刺模块和频率测量模块在FPGA中实现，其中：

比较器模块用于对经过交流耦合后的输入信号进行过0比较，得到与输入信号同频同相的矩形波信号CARD_CNV，并将矩形波信号CARD_CNV输出至滤毛刺模块；

ADC模块用于对同一输入信号进行采集，将采集得到的包含N个采样点的采集数据序列ADC_DATA发送至抽点模块、触发模块、定频采样模块和同步采样模块10，ADC的采样率f_s由输入ADC的参考时钟ADC_CNV频率决定，即f_s＝f_{ADC_CNV}；

抽点模块根据上位机发送的抽点系数对采样序列ADC_DATA进行抽点，将抽点后的序列DATA_IN发送至定频采样模块；

触发模块对采样序列ADC_DATA进行检测，当检测到有效触发到来时，触发模块输出持续一个系统时钟的高电平的触发信号Trig至定频采样模块和同步采样模块，要求触发信号Trig有效时与有效触发点在DATA_IN序列中所在位置对齐；

定频采样模块用于缓存由抽点模块发送的波形数据，当一帧波形采集完成后输出定频采样数据存满标识Full_2＝1至数据选择模块；

基波频率测量模块用于对输入信号的基波频率进行精准测量并发送给倍频模块和上位机模块；基波频率测量模块包括FFT运算模块、参考时钟选择模块、滤毛刺模块和频率测量模块，其中：FFT运算模块采用FFT分析法初步确定输入信号的频率，具体方法为：将接收到的采集数据序列ADC_DATA进行FFT运算，输出N点的频谱序列，记每一点的频谱包括实部Re[k]和虚部Im[k]两部分，k＝1,2,…,N，采用如下公式计算得到k点处的频率能量X[k]：

找出频率能量X[k]的最大值和其对应的点序号k_max，将点序号k_max发送给参考时钟选择模块；

参考时钟选择模块用于选择一个参考时钟clk_fre作为滤毛刺模块中滤除毛刺成分的时钟源，其中参考时钟clk_fre的频率f_ref以及对应的掩码值m需要满足需要满足的条件为

f₁表示基波频率，

f₂表示二次谐波频率，

滤毛刺模块用于根据掩码值m和参考时钟clk_fre将矩形波信号CARD_CNV中的毛刺滤除，得到矩形波信号CARD_FREQ并发送至频率测量模块；

频率测量模块用于基于测频法或测周法对矩形波信号CARD_FREQ进行测量，将输入信号中基波的精准频率fre₁发送至倍频模同步块和上位机模块；

倍频模块对基波频率fre₁进行M倍倍频后输出参考时钟Clock2给时钟选择模块，即时钟Clock2频率f_Clock2＝M×fre₁；

时钟源模块用于输出一个固定频率的参考时钟Clock1给时钟选择模块，其频率f_Clock1即为ADC工作在定频采样模式下的频率；

时钟选择模块用于根据接收到的工作模块指令Mode对输入的时钟信号进行选择，并输出参考时钟信号给ADC模块；当用户选择定频采样模式时，时钟选择模块选择参考时钟Clock1并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0；当用户选择同步采样模式时，时钟选择模块首先选择参考时钟Clock1并输出，有f_{ADC_CNV}＝f_Clock1，同时参考时钟Clock1有效标识Clock1_valid＝1，参考时钟Clock2有效标识Clock2_valid＝0，当基波频率测量模块完成频率测量并且倍频模块完成信号倍频并输出参考时钟Clock2时，时钟选择模块选择参考时钟Clock2并输出，有f_{ADC_CNV}＝f_Clock2，同时输出参考时钟Clock1有效标识Clock1_valid＝0，参考时钟Clock2有效标识Clock2_valid＝1至同步采样模块；

同步采样模块用于缓存由ADC模块发送的波形数据，当一帧波形采集完成后输出同步采样数据存满标识Full_2＝1至数据选择模块；

数据选择模块用于根据接收到的定频采样数据存满标识Full_1、同步采样数据存满标识Full_2和工作模式指令Mode对数据序列DATA_1和DATA_2进行选择，并发送至上位机模块；当用户选择定频采样模式时，如果定频采样数据存满标识Full_1＝1，数据选择模块将DATA_1发送至上位机模块，即Dout＝DATA_1；当用户选择同步采样模式时，如果定频采样数据存满标识Full_1＝1时，数据选择模块将DATA_1发送至上位机模块，如果定频同步采样数据存满标识Full_2＝1，数据选择模块将DATA_2发送至上位机模块，即Dout＝DATA_2；

上位机模块用于根据用户选择的工作模式生成工作模式指令Mode发送给时钟选择模块和数据选择模块，并将相应的预触发深度参数发送给定频采样模块和同步采样模块；接收数据选择模块发送的数据Dout和基波频率测量模块发送的基波频率fre₁，进行相应的分析计算，并将波形数据和测频结果发送至显示模块进行显示；

显示模块接收上位机模块发送的波形数据和测频结果并进行显示。

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