CN110764585A - 一种通用的独立bmc板卡 - Google Patents

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Abstract

本发明提供一种通用的独立BMC板卡，包括独立BMC板卡，独立BMC板卡上设置有BMC、第一CPLD和金手指；BMC与第一CPLD和金手指均连接，第一CPLD与金手指连接；独立BMC板卡通过金手指与服务器主板连接，服务器主板上设置有BMC接口，BMC接口与金手指连接；当BMC与服务器主板通信的时间需求小于设定阈值时，BMC与金手指直接通信；当BMC与服务器主板通信的时间需求大于等于设定阈值时，BMC通过第一CPLD与金手指通信。本发明避免了BMC的重复开发，极大的减轻了研发的工作量；BMC将实时信号和非实时信号区别处理，既保证了实时信号的时效性，又节约了通信端口资源。

Description

一种通用的独立BMC板卡
技术领域
本发明属于BMC板卡技术领域，具体涉及一种通用的独立BMC板卡。
背景技术
BMC是服务器系统管理的核心，负责监控和管理服务器。目前绝大多数服务器系统的BMC都是集成在主板上，用于管理整个服务器，例如风扇调控、电压侦测、温度侦测、系统log记录等功能都需要由BMC控制。BMC相关线路的设计比较复杂，每次设计新的主板都需要重新设计BMC线路，增加设计的复杂度。而现有的模块化的独立BMC卡，由于受接口连接器触点数的限制，无法接入更多的GPIO，BMC的功能受限，不够灵活。
此为现有技术的不足，因此，针对现有技术中的上述缺陷，提供一种通用的独立BMC板卡，是非常有必要的。
发明内容
针对现有技术的上述BMC相关线路的设计比较复杂，每次设计新的主板都需要重新设计BMC线路，现有的模块化的独立BMC卡，由于受接口连接器触点数的限制，无法接入更多GPIO的缺陷，本发明提供一种通用的独立BMC板卡，以解决上述技术问题。
本发明提供一种通用的独立BMC板卡，包括独立BMC板卡，独立BMC板卡上设置有BMC、第一CPLD和金手指；
BMC与第一CPLD和金手指均连接，第一CPLD与金手指连接；
独立BMC板卡通过金手指与服务器主板连接，服务器主板上设置有BMC接口，BMC接口与金手指连接；
当BMC与服务器主板通信的时间需求小于设定阈值时，BMC与金手指直接通信；
当BMC与服务器主板通信的时间需求大于等于设定阈值时，BMC通过第一CPLD与金手指通信。
进一步地，服务器主板上设置有第二CPLD和CPU，第二CPLD与CPU和BMC接口连接，CPU还与BMC接口连接；
当BMC与服务器主板的CPU的通信时间小于设定阈值时，BMC依次通过金手指、BMC接口与CPU通信；
当BMC与服务器主板的CPU的通信时间大于等于设定阈值时，BMC依次通过第一CPLD、金手指、BMC接口、第二CPLD与CPU通信。通过独立BMC板卡和服务器主板上各放置一颗CPLD，通过CPLD内部进行串并协议转换，克服了BMC大量GPIO需求下接口连接器触点不足的困难。
进一步地，服务器主板上还设置有南桥芯片PCH，南桥芯片PCH与第二CPLD和BMC接口连接；
当BMC与服务器主板的南桥芯片PCH的通信时间小于设定阈值时，BMC依次通过金手指、BMC接口与南桥芯片PCH通信；
当BMC与服务器主板的南桥芯片PCH的通信时间大于等于设定阈值时，BMC依次通过第一CPLD、金手指、BMC接口、第二CPLD与南桥芯片PCH通信。不限于南桥芯片PCH，服务器主板上需要与BMC通信的器件均可直接或通过第二CPLD经BMC接口与BMC通信。
进一步地，BMC上设置有BMC实时端口和若干BMC并行端口；
BMC通过BMC实时端口与金手指连接，BMC通过若干BMC并行端口与第一CPLD连接；
第一CPLD将若干BMC并行端口的信号转换为一路串行信号提供给金手指，第一CPLD还将金手指的一路串行信号转换为并行信号提供给每个BMC并行端口。
进一步地，BMC并行端口采用GPIO端口，第一CPLD将BMC的并行GPIO信号转换为一路串行GPIO信号提供给金手指，还将金手指的一路串行GPIO信号转换为并行GPIO信号提供给BMC。第一CPLD实现GPIO和串行GPIO的协议转换。
进一步地，金手指采用OCP NIC金手指，BMC接口采用OCP NIC3.0连接器。OCP是由Facebook发起成立的开放计算项目，致力于推动开放硬件技术标准，OCP NIC 3.0是OCP组织制定的连接器标准，其总共有280个触点，是OCP组织未来主推的接口形态。BMC接口通用的OCP NIC 3.0连接器，并在连接器上传输标准sGPIO协议，使得独立BMC板卡具有极强的通用性。
进一步地，CPU上设置有CPU实时端口和若干CPU并行端口；
CPU通过CPU实时端口与BMC接口连接，CPU通过若干CPU并行端口与第二CPLD连接；
第二CPLD将若干CPU并行端口的信号转换为一路串行信号提供给BMC接口，第二CPLD还将BMC接口的一路串行信号转换为并行信号提供给每个CPU并行端口。
进一步地，CPU并行端口采用GPIO端口，第二CPLD将CPU的并行GPIO信号转换为一路串行GPIO信号提供给BMC接口，还将BMC接口的一路串行GPIO信号转换为并行GPIO信号提供给CPU。第二CPLD实现GPIO和串行GPIO的协议转换。
进一步地，南桥芯片PCH上设置有PCH实时端口和若干PCH并行端口；
南桥芯片PCH通过PCH实时端口与BMC接口连接，南桥芯片PCH通过若干PCH并行端口与第二CPLD连接；
第二CPLD将若干PCH并行端口的信号转换为一路串行信号提供给BMC接口，第二CPLD还将BMC接口的一路串行信号转换为并行信号提供给每个PCH并行端口。
进一步地，PCH并行端口采用GPIO端口，第二CPLD将南桥芯片PCH的并行GPIO信号转换为一路串行GPIO信号提供给BMC接口，还将BMC接口的一路串行GPIO信号转换为并行GPIO信号提供给南桥芯片PCH。第一CPLD实现GPIO和串行GPIO的协议转换。
本发明的有益效果在于，
本发明提供的通用的独立BMC板卡，避免了BMC的重复开发，极大的减轻了研发的工作量；BMC将需要实时处理的关键信号直接传递给服务器主板，使得独立BMC板卡具有快速反应的能力，而非实时的信号经过CPLD处理后发送给服务器主板，节约通信端口资源。
此外，本发明设计原理可靠，结构简单，具有非常广泛的应用前景。
由此可见，本发明与现有技术相比，具有突出的实质性特点和显著的进步，其实施的有益效果也是显而易见的。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，对于本领域普通技术人员而言，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本发明的结构示意图一；
图2是本发明的结构示意图二；
图中，1-独立BMC板卡；2-BMC；3-第一CPLD；4-金手指；5-服务器主板；6-BMC接口；7-第二CPLD；8-CPU；9-BMC接口；10-南桥芯片PCH。
具体实施方式
为了使本技术领域的人员更好地理解本发明中的技术方案，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本发明保护的范围。
实施例1：
如图1所示，本发明提供一种通用的独立BMC板卡，包括独立BMC板卡1，独立BMC板卡1上设置有BMC 2、第一CPLD 3和金手指4；
BMC 2与第一CPLD 3和金手指4均连接，第一CPLD 3与金手指4连接；
独立BMC板卡1通过金手指4与服务器主板5连接，服务器主板5上设置有BMC接口6，BMC接口6与金手指4连接；
当BMC 2与服务器主板5通信的时间需求小于设定阈值时，BMC 2与金手指4直接通信；
当BMC 2与服务器主板5通信的时间需求大于等于设定阈值时，BMC 2通过第一CPLD 3与金手指4通信。
实施例2：
如图1和图2所示，本发明提供一种通用的独立BMC板卡，包括独立BMC板卡1，独立BMC板卡1上设置有BMC 2、第一CPLD 3和金手指4；金手指4采用OCP NIC金手指，BMC接口9采用OCP NIC3.0连接器；
BMC 2与第一CPLD 3和金手指4均连接，第一CPLD 3与金手指4连接；
独立BMC板卡1通过金手指4与服务器主板5连接，服务器主板5上设置有第二CPLD7、CPU 8、南桥芯片PCH 10和BMC接口6，BMC接口6与金手指4连接，第二CPLD 7与CPU 8、南桥芯片PCH 10和BMC接口9均连接，BMC接口9还与CPU 8和南桥芯片PCH 10连接；
BMC 2上设置有BMC实时端口和若干BMC并行端口；BMC并行端口采用GPIO端口；
BMC 2通过BMC实时端口与金手指4连接，BMC 2通过若干BMC并行端口与第一CPLD3连接；
第一CPLD 3将若干BMC并行端口的GPIO信号转换为一路串行的GPIO信号提供给金手指4，第一CPLD 3还将金手指4的一路串行GPIO信号转换为并行GPIO信号提供给每个BMC并行端口；
CPU 8上设置有CPU实时端口和若干CPU并行端口；CPU并行端口采用GPIO端口；
CPU 8通过CPU实时端口与BMC接口9连接，CPU 8通过若干CPU并行端口与第二CPLD7连接；
第二CPLD 7将若干CPU并行端口的GPIO信号转换为一路串行GPIO信号提供给BMC接口9，第二CPLD 7还将BMC接口9的一路串行GPIO信号转换为并行GPIO信号提供给每个CPU并行端口；
当BMC 2与服务器主板5的CPU 8的通信时间小于设定阈值时，BMC 2依次通过金手指4、BMC接口9与CPU 8通信；
当BMC 2与服务器主板5的CPU 8的通信时间大于等于设定阈值时，BMC 2依次通过第一CPLD 3、金手指4、BMC接口9、第二CPLD 7与CPU 9通信；
南桥芯片PCH 10上设置有PCH实时端口和若干PCH并行端口；PCH并行端口采用GPIO端口；
南桥芯片PCH 10通过PCH实时端口与BMC接口连接，南桥芯片PCH 10通过若干PCH并行端口与第二CPLD 7连接；
第二CPLD 7将若干PCH并行端口的GPIO信号转换为一路串行GPIO信号提供给BMC接口9，第二CPLD 7还将BMC接口9的一路串行GPIO信号转换为并行GPIO信号提供给每个PCH并行端口；
当BMC 2与服务器主板5的南桥芯片PCH 10的通信时间小于设定阈值时，BMC 2依次通过金手指4、BMC接口9与南桥芯片PCH 10通信；
当BMC 2与服务器主板5的南桥芯片PCH 10的通信时间大于等于设定阈值时，BMC2依次通过第一CPLD 3、金手指4、BMC接口9、第二CPLD 7与南桥芯片PCH 10通信。
尽管通过参考附图并结合优选实施例的方式对本发明进行了详细描述，但本发明并不限于此。在不脱离本发明的精神和实质的前提下，本领域普通技术人员可以对本发明的实施例进行各种等效的修改或替换，而这些修改或替换都应在本发明的涵盖范围内/任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种通用的独立BMC板卡，其特征在于，包括独立BMC板卡(1)，独立BMC板卡(1)上设置有BMC(2)、第一CPLD(3)和金手指(4)；
BMC(2)与第一CPLD(3)和金手指(4)均连接，第一CPLD(3)与金手指(4)连接；
独立BMC板卡(1)通过金手指(4)与服务器主板(5)连接，服务器主板(5)上设置有BMC接口(6)，BMC接口(6)与金手指(4)连接；
当BMC(2)与服务器主板(5)通信的时间需求小于设定阈值时，BMC(2)与金手指(4)直接通信；
当BMC(2)与服务器主板(5)通信的时间需求大于等于设定阈值时，BMC(2)通过第一CPLD(3)与金手指(4)通信。
2.如权利要求1所述的通用的独立BMC板卡，其特征在于，服务器主板(5)上设置有第二CPLD(7)和CPU(8)，第二CPLD(7)与CPU(8)和BMC接口(9)连接，CPU(8)还与BMC接口(9)连接；
当BMC(2)与服务器主板(5)的CPU(8)的通信时间小于设定阈值时，BMC(2)依次通过金手指(4)、BMC接口(9)与CPU(8)通信；
当BMC(2)与服务器主板(5)的CPU(8)的通信时间大于等于设定阈值时，BMC(2)依次通过第一CPLD(3)、金手指(4)、BMC接口(9)、第二CPLD(7)与CPU(9)通信。
3.如权利要求2所述的通用的独立BMC板卡，其特征在于，服务器主板(5)上还设置有南桥芯片PCH(10)，南桥芯片PCH(10)与第二CPLD(7)和BMC接口(9)连接；
当BMC(2)与服务器主板(5)的南桥芯片PCH(10)的通信时间小于设定阈值时，BMC(2)依次通过金手指(4)、BMC接口(9)与南桥芯片PCH(10)通信；
当BMC(2)与服务器主板(5)的南桥芯片PCH(10)的通信时间大于等于设定阈值时，BMC(2)依次通过第一CPLD(3)、金手指(4)、BMC接口(9)、第二CPLD(7)与南桥芯片PCH(10)通信。
4.如权利要求3所述的通用的独立BMC板卡，其特征在于，BMC(2)上设置有BMC实时端口和若干BMC并行端口；
BMC(2)通过BMC实时端口与金手指(4)连接，BMC(2)通过若干BMC并行端口与第一CPLD(3)连接；
第一CPLD(3)将若干BMC并行端口的信号转换为一路串行信号提供给金手指(4)，第一CPLD(3)还将金手指(4)的一路串行信号转换为并行信号提供给每个BMC并行端口。
5.如权利要求4所述的通用的独立BMC板卡，其特征在于，BMC并行端口采用GPIO端口，第一CPLD(3)将BMC(2)的并行GPIO信号转换为一路串行GPIO信号提供给金手指(4)，还将金手指(4)的一路串行GPIO信号转换为并行GPIO信号提供给BMC(2)。
6.如权利要求1或4所述的通用的独立BMC板卡，其特征在于，金手指(4)采用OCP NIC金手指，BMC接口(9)采用OCP NIC3.0连接器。
7.如权利要求6所述的通用的独立BMC板卡，其特征在于，CPU(8)上设置有CPU实时端口和若干CPU并行端口；
CPU(8)通过CPU实时端口与BMC接口(9)连接，CPU(8)通过若干CPU并行端口与第二CPLD(7)连接；
第二CPLD(7)将若干CPU并行端口的信号转换为一路串行信号提供给BMC接口(9)，第二CPLD(7)还将BMC接口(9)的一路串行信号转换为并行信号提供给每个CPU并行端口。
8.如权利要求6所述的通用的独立BMC板卡，其特征在于，CPU并行端口采用GPIO端口，第二CPLD(7)将CPU(8)的并行GPIO信号转换为一路串行GPIO信号提供给BMC接口(9)，还将BMC接口(9)的一路串行GPIO信号转换为并行GPIO信号提供给CPU(8)。
9.如权利要求6所述的通用的独立BMC板卡，其特征在于，南桥芯片PCH(10)上设置有PCH实时端口和若干PCH并行端口；
南桥芯片PCH(10)通过PCH实时端口与BMC接口连接，南桥芯片PCH(10)通过若干PCH并行端口与第二CPLD(7)连接；
第二CPLD(7)将若干PCH并行端口的信号转换为一路串行信号提供给BMC接口(9)，第二CPLD(7)还将BMC接口(9)的一路串行信号转换为并行信号提供给每个PCH并行端口。
10.如权利要求9所述的通用的独立BMC板卡，其特征在于，PCH并行端口采用GPIO端口，第二CPLD(7)将南桥芯片PCH(10)的并行GPIO信号转换为一路串行GPIO信号提供给BMC接口(9)，还将BMC接口(9)的一路串行GPIO信号转换为并行GPIO信号提供给南桥芯片PCH(10)。
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