CN110335571A - 一种驱动装置、驱动方法和显示面板 - Google Patents

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CN110335571A CN201910564639.5A CN201910564639A CN110335571A CN 110335571 A CN110335571 A CN 110335571A CN 201910564639 A CN201910564639 A CN 201910564639A CN 110335571 A CN110335571 A CN 110335571A
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Chongqing HKC Optoelectronics Technology Co Ltd
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Abstract

本申请公开了一种驱动装置、驱动方法和显示面板,驱动装置包括多个驱动电路,每个驱动电路包括电压输入端、电压输出端、比较单元、开关单元以及延时单元;比较单元包括第一输入端、第二输入端和信号输出端;第二输入端连接一预设的参考电压;开关单元包括控制端、输入端和输出端;控制端与信号输出端连接,输入端与电压输入端连接,输出端连接到电压输出端;每个驱动电路的输出端与下一个驱动电路的第一输入端连接;延时单元连接至信号输出端与控制端之间,延时单元将上述信号输出端的信号延迟一预设时间后,导通上述对应的开关单元。通过延时单元和时序控制各驱动电路导通,避免在供电时发生闩锁效应。

Description

一种驱动装置、驱动方法和显示面板
技术领域
本申请涉及显示技术领域,尤其涉及一种驱动装置、驱动方法和显示面板。
背景技术
薄膜晶体管液晶显示器(Thin Film Transistor Liquid Crystal Display,TFT-LCD)是当前平板显示的主要品种之一。薄膜晶体管液晶显示器主要驱动原理为,系统主板将R/G/B(红/绿/蓝)压缩信号、控制信号及电源通过线材与印制电路板相连接,数据经过印制电路板上的时序控制器(Timing Controller,TCON)驱动芯片处理后,经印制电路板,通过源极薄膜驱动芯片(Source-Chip on Film,S-COF)和栅极薄膜驱动芯片(Gate-Chip onFilm,G-COF)与显示区连接,从而使薄膜晶体管液晶显示器获得所需的电源和信号。
但是,在源极薄膜驱动芯片通电时易发生闩锁效应,从而导致芯片功能混乱、无法正常工作。
发明内容
本申请的目的是提供一种驱动装置、电路驱动方法和显示面板,以使源极薄膜驱动芯片正常工作。
为实现上述目的,本申请提供了一种驱动装置,所述驱动装置包括多个驱动电路,每个所述驱动电路包括电压输入端、电压输出端、比较单元、开关单元以及延时单元;所述比较单元包括第一输入端、第二输入端和信号输出端;所述第二输入端连接一预设的参考电压,所述第一输入端可以接收大功率的输入电压;所述开关单元包括控制端、输入端和输出端;所述开关单元的控制端与所述比较单元的信号输出端连接,所述开关单元的输入端与所述电压输入端连接,所述开关单元的输出端连接到所述电压输出端;所述每个驱动电路的开关单元的输出端与下一个驱动电路的比较单元的第一输入端连接;所述延时单元连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元;
其中,所述首个驱动电路的比较单元的第一输入端连接所述驱动电路的电压输入端;所述每个驱动电路的延迟单元延迟一预设时间后,输出驱动信号至下一个驱动电路的比较单元,依此逐个导通所有的驱动电路的开关单元,使所述每个驱动电路的所述电压输出端与电压输入端导通。
可选的,多个所述驱动电路内的延时单元的预设时间互不相同。
可选的,多个所述驱动电路内的延时单元的预设时间均相同。
可选的,所述延时单元为电容,所述电容一端连接至所述比较单元的信号输出端与所述开关单元的控制端之间,另一端接地,所述电容的容值可调节。
可选的,所述延时单元为计时器,所述计时器连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元。
可选的,所述比较单元为比较器;所述比较器的第一输入端的电压高于第二输入端的电压时,输出为高电平;所述比较器的第一输入端的电压不高于第二输入端的电压时,输出为低电平;所述预设的参考电压小于每个所述驱动电路内的比较器的第一输入端接收到的电压;所述开关单元在控制端高电平时导通。
可选的,所述比较单元为比较器;所述比较器的第一输入端的电压高于第二输入端的电压时,输出为低电平;所述比较器的第一输入端的电压不高于第二输入端的电压时,输出为高电平;所述预设的参考电压大于每个所述驱动电路内的比较器的第一输入端接收到的电压;所述开关单元在控制端低电平时导通。
可选的,所述开关单元采用金属氧化物半导体场效应晶体管。
本申请还公开了一种如上任意所述的驱动装置的驱动方法,所述驱动方法包括以下步骤:
首个驱动电路的比较单元的输出信号端输出的驱动信号,经过延时单元延迟一段预设时间后,导通对应的所述开关单元,控制对应的所述电压输出端输出电压;
下一级的驱动电路的比较单元的输出信号端输出的驱动信号,在经过延时单元延迟一段预设时间后,导通对应的所述开关单元,控制对应的所述电压输出端输出电压;直至所有驱动电路导通。
本申请还公开了一种显示面板,所述显示面板包括显示屏、源极薄膜驱动芯片以及电源,所述源极薄膜驱动芯片与所述显示屏连接;所述电源上具有多个电压输出端,所述源极薄膜驱动芯片上具有多个电压输入端,每个所述电源的电压输出端连接至一个所述源极薄膜驱动芯片的电压输入端,以对应形成多条驱动电路,每个所述驱动电路包括电压输入端、电压输出端、比较单元、开关单元以及延时单元;所述比较单元包括第一输入端、第二输入端和信号输出端;所述第二输入端连接一预设的参考电压,所述第一输入端可以接收大功率的输入电压;所述开关单元包括控制端、输入端和输出端;所述开关单元的控制端与所述比较单元的信号输出端连接,所述开关单元的输入端与所述电压输入端连接,所述开关单元的输出端连接到所述电压输出端;所述每个驱动电路的开关单元的输出端与下一个驱动电路的比较单元的第一输入端连接;所述延时单元连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元;
其中,所述首个驱动电路的比较单元的第一输入端连接所述驱动电路的电压输入端;所述每个驱动电路的延迟单元延迟一预设时间后,输出驱动信号至下一个驱动电路的比较单元,依此逐个导通所有的驱动电路的开关单元,使所述每个驱动电路的所述电压输出端与电压输入端导通。
本申请在比较单元导通后,会对延时单元充电一预设时间,然后将开关单元导通,开关单元导通后使电压输出端与电压输入端导通,同时会对下一条驱动电路的比较单元发出驱动信号,下一个驱动电路的延时单元再充电一预设时间,如此,依次打开每条驱动电路的开关单元。本申请通过时序控制各驱动电路导通,从而实现错开不同驱动电路的导通时间,同时,因为部分源极薄膜驱动芯片会对其各路供电电源的供电时序进行要求,所以在每条驱动电路上采用延时单元可以调节各路供电电源的供电时序,来避免在供电时发生闩锁效应的现象,以使源极薄膜驱动芯片正常工作,而且比较单元可以接收大功率的输入,然后输出低电压,这样功耗低。
附图说明
所包括的附图用来提供对本申请实施例的进一步的理解,其构成了说明书的一部分,用于例示本申请的实施方式,并与文字描述一起来阐释本申请的原理。显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动性的前提下,还可以根据这些附图获得其他的附图。在附图中:
图1是本申请的一种显示面板的示意图;
图2是本申请的一种采用电容为延时单元的驱动装置的示意图;
图3是本申请的一种采用计时器为延时单元的驱动装置的示意图;
图4是本申请的一种采用触发器和延时单元为电容的驱动装置的示意图;
图5是本申请的一种采用触发器和延时单元为计时器的驱动装置的示意图;
图6本申请的一种驱动方法步骤的示意图。
其中,100、显示面板;110、显示屏;120、源极薄膜驱动芯片;130、驱动装置;131、电源;132、驱动电路;140、比较单元;141、第一输入端;142、第二输入端;143、信号输出端;150、延时单元;152、计时器;160、开关单元;161、输入端;162、控制端;163、输出端;170、电压输入端;180、电压输出端。
具体实施方式
这里所公开的具体结构和功能细节仅仅是代表性的,并且是用于描述本申请的示例性实施例的目的。但是本申请可以通过许多替换形式来具体实现,并且不应当被解释成仅仅受限于这里所阐述的实施例。
在本申请的描述中,需要理解的是,术语“中心”、“横向”、“上”、“下”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”等指示的方位或位置关系为基于附图所示的方位或位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作,因此不能理解为对本申请的限制。此外,术语“第一”、“第二”仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个该特征。在本申请的描述中,除非另有说明,“多个”的含义是两个或两个以上。另外,术语“包括”及其任何变形,意图在于覆盖不排他的包含。
在本申请的描述中,需要说明的是,除非另有明确的规定和限定,术语“安装”、“相连”、“连接”应做广义理解,例如,可以是固定连接,也可以是可拆卸连接,或一体地连接;可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以具体情况理解上述术语在本申请中的具体含义。
这里所使用的术语仅仅是为了描述具体实施例而不意图限制示例性实施例。除非上下文明确地另有所指,否则这里所使用的单数形式“一个”、“一项”还意图包括复数。还应当理解的是,这里所使用的术语“包括”和/或“包含”规定所陈述的特征、整数、步骤、操作、单元和/或组件的存在,而不排除存在或添加一个或更多其他特征、整数、步骤、操作、单元、组件和/或其组合。
下面结合附图和实施例对本申请作说明。
如图1和图2所示,本申请一实施例公开了一种显示面板100,所述显示面板100包括显示屏110、源极薄膜驱动芯片120以及电源131,所述源极薄膜驱动芯片120与所述显示屏110连接;所述电源131上具有多个电压输出端A/B/C,所述源极薄膜驱动芯片上具有多个电压输入端,每个所述电源的电压输出端A/B/C连接至一个所述源极薄膜驱动芯片的电压输入端A-1/B-1/C-1,以对应形成多条驱动电路132,每个所述驱动电路包括电压输入端170、电压输出端180、比较单元140、开关单元160以及延时单元150;所述比较单元160包括第一输入端141、第二输入端142和信号输出端143;所述第二输入端142连接一预设的参考电压Vref,所述第一输入端141可以接收大功率的输入电压;所述开关单元160包括控制端162、输入端161和输出端163;所述开关单元的控制端162与所述比较单元的信号输出端143连接,所述开关单元的输入端161与所述驱动电路的电压输入端170连接,所述开关单元的输出端163连接到所述驱动电路的电压输出端180;所述每个驱动电路132的开关单元的输出端163与下一个驱动电路的比较单元的第一输入端连接161;所述延时单元150连接至所述比较单元的信号输出端143与所述开关单元的控制端162之间,所述延时单元150将上述比较单元的信号输出端143的信号延迟一预设时间后,导通上述开关单元160。
其中,所述首个驱动电路的比较单元的第一输入端141连接所述驱动电路的电压输入端170;多个所述驱动电路内的延时单元150的预设时间互不相同。所述每个驱动电路的延迟单元150延迟一预设时间后,输出驱动信号至下一个驱动电路的比较单元140,依次逐个导通所有的驱动电路的开关单元160,使所述每个驱动电路的电压输出端180与电压输入端170导通。
本申请在比较单元140导通后,会对延时单元150充电一预设时间,然后将开关单元160导通,开关单元160导通后使驱动电路的电压输出端180与电压输入端170导通,同时会对下一条驱动电路132的比较单元140发出驱动信号,如此,依次打开每条驱动电路132的开关单元160。本申请通过时序控制各驱动电路132导通,从而实现错开不同驱动电路132的导通时间,同时,因为部分源极薄膜驱动芯片120会对其各路供电电源131的供电时序进行要求,所以在每条驱动电路132上采用延时单元150可以调节各路供电电源131的供电时序,而多个驱动电路内的延时单元150的预设时间互不相同,可以充分保证错开不同驱动电路132的导通时间,来避免在供电时发生闩锁效应的现象,以使源极薄膜驱动芯片120正常工作。例如:对要求导通较晚的源极薄膜驱动芯片120,可以将其对应的驱动电路上的延时单元150的预设时间设置长些;对要求导通较早的源极薄膜驱动芯片120,可以将其对应的驱动电路上的延时单元150的预设时间设置短些。另外,比较单元140作为大功率模拟电路元件,可以直接接收大功率的输入,因此可以与大功率输入的电压输入端170直接连接,而比较后,通过设置比较合适的参考电压Vref,可以输出一较低的电压,控制所述开关单元160,降低整个驱动电路132的功耗。
相反的,若与每条驱动电路132相连的源极薄膜驱动芯片120的供电时序要求相同时,那么使多个所述驱动电路132内的延时单元150的预设时间均相同,使得驱动电路可以灵活调动,满足多种需求,利用率高。
具体的,所述延时单元150为容值可调节的电容,所述电容一端连接至所述比较单元的信号输出端143与所述开关单元的控制端162之间,另一端接地。采用电容作为延时单元150,这样可以使驱动电路132简单,而且方便调整。参考上述,因为部分源极薄膜驱动芯片120会对其各路供电电源131的供电时序进行要求,那么,为了避免因源极薄膜驱动芯片120自身的供电时序要求而影响各驱动电路132的导通顺序,所以采用容值可调节的电容作用延时单元150,这样可以方便调整电容的容值,可以在电路制作完成后,根据需要,随时调整延时的预设时间。例如,对要求导通较晚的源极薄膜驱动芯片120,可以将其对应的驱动电路上的延时单元150的预设时间设置长些,即将对应的电容容值调大些;对要求导通较早的源极薄膜驱动芯片120,可以将其对应的驱动电路上的延时单元150的预设时间设置短些,即将对应的电容容值调小些。
当然,如图3所示,所述延时单元150也可以采用其它具有电路导通延时功能的单元,如计时器152,所述计时器152连接至所述比较单元的信号输出端143与所述开关单元的控制端162之间,所述计时器152将上述比较单元的信号输出端143的信号延迟一预设时间后,导通上述开关单元160。计时器152具有较高调节精度,且具备易用性、低廉的价格和良好的可靠性,使方便并精确延时时间。
更具体的,所述比较单元140采用比较器;所述比较器的第一输入端141的电压高于第二输入端142的电压时,输出为高电平;所述比较器的第一输入端141的电压不高于第二输入端142的电压时,输出为低电平;所述第二输入端142与一参考电压Vref连接,所述参考电压Vref小于每个所述驱动电路内的比较器的第一输入端141接收到的电压,即所述参考电压Vref小于每个电源131电压;所述开关单元160采用金属氧化物半导体场效应晶体管,具体为N-MOS管。因为电源131电压高于参考电压Vref,所以当首条驱动电路132通电后,对应的比较器会输出高电平,高电平连接到对应的N-MOS管后,N-MOS管导通,从而使首条驱动电路132导通,同时,高电平会继续输入到第二条驱动电路132的比较器,第二条驱动电路132的比较器也会导通,接着导通第二条驱动电路132的N-MOS管,依此类推,将所有驱动电路132有顺序的导通,可控性高。
当然,还可以是所述比较单元140为比较器;所述比较器的第一输入端141的电压高于第二输入端142的电压时,输出为低电平;所述比较器的第一输入端141的电压不高于第二输入端142的电压时,输出为高电平;所述预设的参考电压Vref大于每个所述驱动电路内的比较器的第一输入端接收到的电压;所述开关单元160在控制端162低电平时导通,即金属氧化物半导体场效应晶体管为P-MOS管。
如图4至图5所示,本申请一实施例还公开了一种驱动装置130,所述驱动装置包括电源131及与电源连接的多条驱动电路132,每条所述驱动电路132包括触发器、开关单元160、延时单元150、电压输入端170以及电压输出端180;所述开关单元160包括输入端161、控制端162以及输出端163;所述开关单元的输入端161与所述驱动电路的电压输入端170相连;所述开关单元的控制端162与所述触发器的输出端相连;所述开关单元的输出端163输出驱动信号并作为下一条驱动电路的触发器的触发信号连接至所述触发器的输入端;所述延时单元的一端连接至所述触发器与开关单元160之间,所述延时单元的另一端接地;其中,在首个所述触发器接收到原始触发信号后,所述触发器控制对应的开关单元160逐个导通以输出所述驱动信号。
具体的,如图4所示,所述延时单元150为容值可调节的电容,所述电容一端连接至所述比较单元的信号输出端143与所述开关单元的控制端162之间,另一端接地。
当然,如图5所示,所述延时单元150也可以采用其它具有电路导通延时功能的单元,如计时器152,所述计时器152连接至所述比较单元的信号输出端143与所述开关单元的控制端162之间,所述计时器152将上述比较单元的信号输出端143的信号延迟一预设时间后,导通上述开关单元160。本方案通过采用时序控制,通过触发器及开关单元160控制电源131及与电源连接的多条驱动电路132逐个导通。在每一条驱动电路132上分别设置一触发器及开关单元160,所述首个触发器在接收原始触发信号后控制首个开关单元160导通,在所述开关单元160导通时,开关单元160则发送驱动信号作为下一个触发器的触发信号,以使下一个所述触发器控制与其对应连接的开关单元160导通,依次,直到最后一个所述开关单元160被导通。从而实现错开不同所述驱动电路132的导通时间,即通过时序控制各驱动电路132导通,从而避免在供电时发生闩锁效应的现象,同时,因为部分源极薄膜驱动芯片120会对其各路供电电源的供电时序进行要求,本方案在每条驱动电路132上采用延时单元150,延时单元150的一端连接至触发器与开关单元160之间,另一端接地,那么在触发器导通后,接下来会对延时单元150充电,充电一段时间后,接下来会将开关单元160导通,开关单元160导通后使驱动电路的电压输出端180与电压输入端170导通,同时会对下一条驱动电路的触发器发出触发信号,如此,依次打开每条驱动电路的开关单元160,避免了源极薄膜驱动芯片120本身对驱动电路132的时序影响。
如图6所示,本申请一实施例公开了一种驱动方法,所述驱动方法包括以下步骤:
S1、首个驱动电路的比较单元的输出信号端输出的驱动信号,经过延时单元延迟一段预设时间后,导通对应的所述开关单元,控制对应的所述驱动电路的电压输出端输出电压;
S2、下一级的驱动电路的比较单元的输出信号端输出的驱动信号,在经过延时单元延迟一段预设时间后,导通对应的所述开关单元,控制对应的所述驱动电路的电压输出端输出电压;直至所有驱动电路导通。
本申请中涉及到的各步骤的限定,在不影响具体申请实施的前提下,并不认定为对步骤先后顺序做出限定,写在前面的步骤可以是在先执行的,也可以是在后执行的,甚至也可以是同时执行的,只要能实施本申请,都应当视为属于本申请的保护范围。
本申请涉及到显示面板的零部件,所述的显示面板可以是(TN,Twisted Nematic)扭曲向列型面板、(VA,Vertical Alignment)垂直配向面板或(MVA,Multi-domainVertical Alignment)多象限垂直配向面板,当然,也可以是其他类型的面板,适用即可。
以上内容是结合具体的可选实施方式对本申请所作的详细说明,不能认定本申请的具体实施只局限于这些说明。比如电压输入端不仅限于三个,可以是两个,还可以是更多个,对于本申请所属技术领域的普通技术人员来说,在不脱离本申请构思的前提下,还可以做出若干简单推演或替换,都应当视为属于本申请的保护范围。

Claims (10)

1.一种驱动装置,其特征在于,所述驱动装置包括多个驱动电路,每个所述驱动电路包括:
电压输入端和电压输出端;
比较单元,包括第一输入端、第二输入端和信号输出端;所述第二输入端连接一预设的参考电压;
开关单元,包括控制端、输入端和输出端;所述开关单元的控制端与所述比较单元的信号输出端连接,所述开关单元的输入端与所述电压输入端连接,所述开关单元的输出端连接到所述电压输出端;每个所述驱动电路的开关单元的输出端与下一个驱动电路的比较单元的第一输入端连接;以及
延时单元,连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元;
其中,所述首个驱动电路的比较单元的第一输入端连接所述驱动电路的电压输入端;所述每个驱动电路的延迟单元延迟一预设时间后,输出驱动信号至下一个驱动电路的比较单元,依此逐个导通所有的驱动电路的开关单元,使所述每个驱动电路的所述电压输出端与电压输入端导通。
2.如权利要求1所述的一种驱动装置,其特征在于,多个所述驱动电路内的延时单元的预设时间互不相同。
3.如权利要求1所述的一种驱动装置,其特征在于,多个所述驱动电路内的延时单元的预设时间均相同。
4.如权利要求1所述的一种驱动装置,其特征在于,所述延时单元为电容,所述电容一端连接至所述比较单元的信号输出端与所述开关单元的控制端之间,另一端接地,所述电容的容值可调节。
5.如权利要求1所述的一种驱动装置,其特征在于,所述延时单元为计时器,所述计时器连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元。
6.如权利要求1所述的一种驱动装置,其特征在于,所述比较单元为比较器;
所述比较器的第一输入端的电压高于第二输入端的电压时,输出为高电平;
所述比较器的第一输入端的电压不高于第二输入端的电压时,输出为低电平;
所述预设的参考电压小于每个所述驱动电路内的比较器的第一输入端接收到的电压;所述开关单元在控制端高电平时导通。
7.如权利要求1所述的一种驱动装置,其特征在于,所述比较单元为比较器;
所述比较器的第一输入端的电压高于第二输入端的电压时,输出为低电平;
所述比较器的第一输入端的电压不高于第二输入端的电压时,输出为高电平;
所述预设的参考电压大于每个所述驱动电路内的比较器的第一输入端接收到的电压;所述开关单元在控制端低电平时导通。
8.如权利要求1所述的一种驱动装置,其特征在于,所述开关单元采用金属氧化物半导体场效应晶体管。
9.一种如权利要求1-8任一项所述的驱动装置的驱动方法,其特征在于,所述驱动方法包括以下步骤:
首个驱动电路的比较单元的输出信号端输出的驱动信号,经过延时单元延迟一段预设时间后,导通对应的开关单元,控制对应的电压输出端输出电压;
下一级的驱动电路的比较单元的输出信号端输出的驱动信号,在经过延时单元延迟一段预设时间后,导通对应的开关单元,控制对应的电压输出端输出电压;直至所有驱动电路导通。
10.一种显示面板,其特征在于,所述显示面板包括显示屏、源极薄膜驱动芯片以及电源,所述源极薄膜驱动芯片与所述显示屏连接;
所述电源上具有多个电压输出端,所述源极薄膜驱动芯片上具有多个电压输入端,每个所述电源的电压输出端连接至一个所述源极薄膜驱动芯片的电压输入端,以对应形成多条驱动电路,每个所述驱动电路包括:
电压输入端和电压输出端;
比较单元,包括第一输入端、第二输入端和信号输出端;所述第二输入端连接一预设的参考电压,所述第一输入端可以接收大功率的输入电压;
开关单元,包括控制端、输入端和输出端;所述开关单元的控制端与所述比较单元的信号输出端连接,所述开关单元的输入端与所述电压输入端连接,所述开关单元的输出端连接到所述电压输出端;所述每个驱动电路的开关单元的输出端与下一个驱动电路的比较单元的第一输入端连接;以及
延时单元,连接至所述比较单元的信号输出端与所述开关单元的控制端之间,所述延时单元将上述比较单元的信号输出端的信号延迟一预设时间后,导通上述开关单元;
其中,所述首个驱动电路的比较单元的第一输入端连接所述驱动电路的电压输入端;所述每个驱动电路的延迟单元延迟一预设时间后,输出驱动信号至下一个驱动电路的比较单元,依此逐个导通所有的驱动电路的开关单元,使所述每个驱动电路的所述电压输出端与电压输入端导通,以将所述源极薄膜驱动芯片与所述电源导通。
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