CN109270734B - 像素结构 - Google Patents

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Abstract

像素结构包括第一像素、第二像素、数据线及黑矩阵层。第一像素包括第一色阻。第二像素包括第二色阻。第一色阻与第二色阻排列在第一方向上。数据线包括延伸在第二方向上的第一线段与第二线段。第一方向与第二方向彼此交错。黑矩阵层包括第一黑部件。第一黑部件与第一线段重叠，且未与第二线段重叠。第一色阻与第二色阻彼此堆叠以形成交叠区域。交叠区域重叠于第二线段上，而设置于第一黑部件上的第一色阻与第二色阻彼此不交叠。

Description

像素结构
技术领域
本发明涉及一种像素结构。
背景技术
随着消费性电子及通信产品的发展，液晶显示器(Liquid Crystal Display，LCD)已广泛地应用于液晶电视、笔记本电脑、台式电脑，以及智能手机(Smart Phone)等产品。但随着液晶显示器的像素分辨率不断提升的发展，各像素单元的尺寸必须愈来愈小。目前仍有受限于工艺极限与元件的配置设计相关的议题需要克服。
发明内容
本发明涉及一种像素结构，其可具有较高的开口率。
根据本发明的一实施例，提出一种像素结构，其包括第一像素、第二像素、数据线及黑矩阵层。第一像素包括第一色阻。第二像素包括第二色阻。第一色阻与第二色阻排列在第一方向上。数据线包括延伸在第二方向上的第一线段与第二线段。第一方向与第二方向彼此交错。黑矩阵层包括第一黑部件。第一黑部件与第一线段重叠，且未与第二线段重叠。第一色阻与第二色阻彼此堆叠以形成交叠区域。交叠区域重叠于第二线段上，而设置于第一黑部件上的第一色阻与第二色阻彼此不交叠。
为了对本发明的上述及其他方面有更佳的了解，下文特举实施例，并配合说明书附图详细说明如下：
附图说明
图1是依照本发明的一实施例的像素结构的主动元件阵列基板的示意图。
图2是依照本发明的一实施例的像素结构的彩色滤光基板的示意图。
图3是依照本发明的一实施例的像素结构的剖面图。
图4示出依照本发明的一实施例的像素结构的色阻、黑矩阵层与数据线的配置示意图。
图5是依照本发明的另一实施例的像素结构的彩色滤光基板的示意图。
图6示出依照本发明的另一实施例的像素结构的色阻、黑矩阵层与数据线的配置示意图。
图7是依照本发明的另一实施例的像素结构的剖面图。
图8示出依照本发明的再一实施例的像素结构的剖面图。
图9示出依照本发明的再一实施例的像素结构的剖面图。
图10示出依照本发明的再一实施例的像素结构的剖面图。
图11显示一实施例中彩色滤光基板在第一黑部件附近的剖面图。
图12显示一实施例中彩色滤光基板在第二黑部件附近的剖面图。
附图标记说明：
102、202、302、402、502：像素结构
104、304、404、504：主动元件阵列基板
106、206：彩色滤光基板
CL1、CL2：信号线
112：第一基板
114：第一绝缘层
116：第二绝缘层
118：第二基板
120：电极层
BL、BL'：黑色材料层
BM、BM'、BM”：黑矩阵层
BM1、BM1’：第一黑部件
BM2、BM2'、BM2a：第二黑部件
BMK：遮光干部
BM1TS1、BM2TS2：上表面
BMW1、BMW2：尺寸
CE1：第一共通电极
CE2：第二共通电极
CEE1：第一共通电极元件
CEE2：第二共通电极元件
CE1S1、CE2S2：侧边
CES：共通电极线
CF1：第一色阻
CF2：第二色阻
CF3：第三色阻
CF4：第四色阻
CH1：第一通道层
CH2：第二通道层
CH3：第三通道层
D1：第一方向
D2：第二方向
D3：垂直投影方向
DE1：第一漏极
DE2：第二漏极
DE3：第三漏极
DL、DL1、DL2：数据线
DLP1：第一线段
DLP2：第二线段
DLS1、DLS3、BM1S1、BM2S1、BMKS1：第一侧边
DLS2、DLS4、BM1S2、BM2S2、BMKS2：第二侧边
BM1S3：第三侧边
BMW1、BMW2、DLW1、DLW2：尺寸
LC：显示介质
G1：第一栅极
G2：第二栅极
G3：第三栅极
P1：第一像素
P2：第二像素
P3：第三像素
P4：第四像素
OV：交叠区域
Q：间距
PE1：第一像素电极
PE2：第二像素电极
PE3：第三像素电极
PE4：第四像素电极
PS：间隔元件
SE1：第一源极
SE2：第二源极
SE3：第三源极
SL：扫描线
SP1、SP1'：第一子像素
SP2、SP2'：第二子像素
SP3、SP3'：第三子像素
SP4、SP4'：第四子像素
T1：第一开关元件
T2：第二开关元件
T3：第三开关元件
T4：第四开关元件
T5：第五开关元件
T6：第六开关元件
V1、V2、V3、V4：接触窗
具体实施方式
在下文中将参照附图更全面地描述本发明，在附图中示出了本发明的示例性实施例。如本领域技术人员将认识到的，可以以各种不同的方式修改所描述的实施例，而不脱离本发明的构思或范围。
本文参考作为理想化实施例的示意图的截面图来描述示例性实施例。因此，可以预期到作为例如制造技术及/或公差的结果的图示的形状变化。因此，本文所述的实施例不应被解释为限于如本文所示的区域的特定形状，而是包括例如由制造导致的形状偏差。例如，示出或描述为平坦的区域通常可以具有粗糙及/或非线性特征。此外，所示的锐角可以是圆的。因此，图中所示的区域本质上是示意性的，并且它们的形状不是旨在示出区域的精确形状，并且不是旨在限制权利要求的范围。
以下是以一些实施例做说明。须注意的是，本公开并非显示出所有可能的实施例，未于本公开提出的其他实施方式也可能可以应用。再者，附图上的尺寸比例并非按照实际产品等比例绘制。因此，说明书和图示内容仅作叙述实施例之用，而非作为限缩本公开保护范围之用。另外，实施例中的叙述，例如细节结构、工艺步骤和材料应用等等，仅为举例说明之用，并非对本公开欲保护的范围做限缩。实施例的步骤和结构各的细节可在不脱离本公开的构思和范围内根据实际应用工艺的需要而加以变化与修饰。以下是以相同/类似的符号表示相同/类似的元件做说明。
请参照图1至图4。图1为依照本发明的一实施例的像素结构的主动元件阵列基板的示意图。图2为像素结构的彩色滤光基板的示意图。图3为像素结构的剖面图。图4示出像素结构的色阻、黑矩阵层与数据线的配置示意图。图3可对应图1、图2与图4的结构中的AB剖面线区域。为求简单了解，图2与图4中是以透视第二基板的方式呈现在其下方的元件配置。
请参照图1至图4。像素结构102可包括多个像素，例如包括第一像素P1、第二像素P2、第三像素P3及第四像素P4。第一像素P1及第二像素P2排列在第一方向D1上。第三像素P3及第四像素P4排列在第一方向D1上。第一像素P1及第三像素P3排列在第二方向D2上。第二像素P2及第四像素P4排列在第二方向D2上。第一方向D1与第二方向D2彼此交错。一实施例中，第一方向D1是实质上垂直第二方向D2。例如第一方向D1为X方向，且第二方向D2为Y方向。第一像素P1包括排列在第二方向D2上的第一子像素SP1与第二子像素SP2。第二像素P2包括排列在第二方向D2上的第三子像素SP3与第四子像素SP4。第三像素P3包括排列在第二方向D2上的第一子像素SP1'与第二子像素SP2'。第四像素P4包括排列在第二方向D2上的第三子像素SP3'与第四子像素SP4'。
请参照图1。第一像素P1包括第一子像素SP1、第二子像素SP2、第一开关元件T1、第二开关元件T2以及第三开关元件T3。第一子像素SP1包括第一像素电极PE1。第二子像素SP2包括第二像素电极PE2。第二像素P2包括第三子像素SP3、第四子像素SP4、第四开关元件T4、第五开关元件T5以及第六开关元件T6。第三子像素SP3包括第三像素电极PE3。第四子像素SP4包括第四像素电极PE4。第一像素电极PE1、第二像素电极PE2、第三像素电极PE3、第四像素电极PE4可为透明电极层(例如氧化铟锡等)、反射电极层或是半穿透半反射电极层。第一像素电极PE1、第二像素电极PE2、第三像素电极PE3、第四像素电极PE4可设置配向图案(配向狭缝或配向凸起)。
请参照图1与图3。在本实施例中，第一开关元件T1、第二开关元件T2以及第三开关元件T3设置于第一基板112上。第一开关元件T1包含第一栅极G1、第一通道层CH1、第一源极SE1与第一漏极DE1。第一栅极G1与扫描线SL电性连接，且第一源极SE1与数据线DL1电性连接。第二开关元件T2包含第二栅极G2、第二通道层CH2、第二源极SE2与第二漏极DE2。第二栅极G2与扫描线SL电性连接，且第二源极SE2通过第一源极SE1与数据线DL1电性连接。第一通道层CH1与第二通道层CH2可为同一半导体图案。第三开关元件T3包含第三栅极G3、第三通道层CH3、第三源极SE3与第三漏极DE3。第三栅极G3与扫描线SL电性连接，第三源极SE3与第二漏极DE2连接，且第三漏极DE3与信号线CL1电性连接。同样的，在本实施例中，第四开关元件T4、第五开关元件T5以及第六开关元件T6设置于第一基板112上。第四开关元件T4电性连接于扫描线SL与数据线DL2。第五开关元件T5电性连接于扫描线SL与数据线DL2。第六开关元件T6电性连接于扫描线SL与信号线CL2。再者，关于第四开关元件T4、第五开关元件T5或第六开关元件T6的细节结构类似于前述的第一开关元件T1、第二开关元件T2或第三开关元件T3，在此不再赘述。在本实施例中，扫描线SL沿第一方向D1延伸；数据线DL1、DL2沿第二方向D2延伸；信号线CL1、CL2沿第二方向D2延伸。扫描线SL与数据线DL1、DL2彼此交错；扫描线SL与信号线CL1、CL2彼此交错。
在本实施例中，第一像素电极PE1通过接触窗V1与第一开关元件T1的第一漏极DE1电性连接。第二像素电极PE2通过接触窗V2与第二开关元件T2的第二漏极DE2电性连接。第三像素电极PE3通过接触窗V3与第三开关元件T3电性连接。第四像素电极PE4通过接触窗V4与第四开关元件T4电性连接。
请再参照图1，第一像素P1还包括第一共通电极CE1。第二像素P2还包括第二共通电极CE2。第一共通电极CE1沿第二方向D2延伸，第二共通电极CE2沿第二方向D2延伸。第一共通电极CE1与第二共通电极CE2电性连接于共通电极线CES，其中共通电极线CES沿第一方向D1延伸。在本实施例中，第一共通电极CE1、第二共通电极CE2与共通电极线CES电性连接到第一电压，信号线CL1、CL2电性连接到第二电压。在一实施例中，第一电压可不同于第二电压，借此像素结构的穿透率可以大幅提升。
在本实施例中，第一共通电极CE1与第一像素电极PE1在垂直投影方向D3(例如Z方向)上部分重叠；第一共通电极CE1并未延伸至第二子像素SP2，第一共通电极CE1在垂直投影方向D3上并未与第二像素电极PE2重叠，亦即第二子像素SP2并不具有共通电极。第二共通电极CE2与第三像素电极PE3在垂直投影方向D3(例如Z方向)上部分重叠；第二共通电极CE2并未延伸至第四子像素SP4，第二共通电极CE2在垂直投影方向D3上并未与第四像素电极PE4重叠，亦即第四子像素SP4并不具有共通电极。
数据线DL1包括延伸在第二方向D2上的第一线段DLP1与第二线段DLP2。第一线段DLP1在第一像素电极PE1及第三像素电极PE3之间。第二线段DLP2在第二像素电极PE2及第四像素电极PE4之间。第一共通电极CE1与第二共通电极CE2分别设置于第一线段DLP1的相对的第一侧边DLS1与第二侧边DLS2。
请参照图2，在一实施例中，彩色滤光基板106可包括黑矩阵层BM及色阻。色阻例如第一像素P1的第一色阻CF1、第二像素P2的第二色阻CF2、第三像素P3的第三色阻CF3、第四像素P4的第四色阻CF4等。第一色阻CF1与第二色阻CF2排列在第一方向D1上。黑矩阵层BM包括遮光干部BMK以及第一黑部件BM1。遮光干部BMK延伸在第一方向D1上。遮光干部BMK包括相对的第一侧边BMKS1与第二侧边BMKS2。第一黑部件BM1从遮光干部BMK的第一侧边BMKS1延伸在第二方向D2上。第一黑部件BM1包括第一侧边BM1S1、第二侧边BM1S2与第三侧边BM1S3，第三侧边BM1S3在相对的第一侧边BM1S1与第二侧边BM1S2之间。第一色阻CF1在第一黑部件BM1的第一侧边BM1S1。第二色阻CF2在第一黑部件BM1的第二侧边BM1S2。第一色阻CF1与第二色阻CF2在垂直投影方向D3上与第一黑部件BM1重叠的部分是以一间距Q彼此隔开。在本实施例中，第一色阻CF1与第二色阻CF2是在遮光干部BMK的第二侧边BMKS2侧彼此堆叠以形成交叠区域OV，但不以此为限，第一色阻CF1与第二色阻CF2是在遮光干部BMK的第二侧边BMKS2侧彼此也可以彼此不堆叠。第一色阻CF1、第二色阻CF2、第三色阻CF3与第四色阻CF4可包括不同颜色的色阻。在一实施例中，第一色阻CF1与第三色阻CF3为相同颜色的色阻，第二色阻CF2与第四色阻CF4为相同颜色的色阻。例如但不限于，第一色阻CF1与第三色阻CF3为绿色色阻，第二色阻CF2与第四色阻CF4为蓝色色阻。
请参照图3。主动元件阵列基板104包括第一基板112。第一基板112包括但不限于玻璃基板。第一共通电极元件CEE1(包括共通电极线CES、第一共通电极CE1及第二共通电极CE2)、扫描线SL、第二共通电极元件CEE2设置在第一基板112上。一实施例中，第一共通电极元件CEE1、扫描线SL、第二共通电极元件CEE2可包括相同的导电材料，或可利用相同工艺同时形成，例如为第一金属层。第一绝缘层114设置在第一共通电极元件CEE1、扫描线SL、第二共通电极元件CEE2上。通道层，例如第二通道层CH2，可设置在第一绝缘层114上。第二源极SE2与第二漏极DE2可设置在第二通道层CH2上。数据线DL(例如包含数据线DL1、DL2)可设置在第一绝缘层114上。在一实施例中，数据线DL、第二源极SE2与第二漏极DE2可包括相同的导电材料，或可利用相同工艺同时形成，例如为第二金属层。第二绝缘层116可设置在第一绝缘层114、数据线DL、第二源极SE2与第二漏极DE2上。像素电极可设置在第二绝缘层116上。例如第一像素P1的第一像素电极PE1和第二像素电极PE2以及第二像素P2的第三像素电极PE3和第四像素电极PE4等设置在第二绝缘层116上。
请参照图3，彩色滤光基板106包括第二基板118。第二基板118包括但不限于玻璃基板。黑矩阵层BM与色阻(第一色阻CF1和第二色阻CF2)设置在第二基板118上。例如黑矩阵层BM的遮光干部BMK与第一黑部件BM1设置在第二基板118上。第一黑部件BM1可包括上表面BM1TS1。上表面BM1TS1在第一侧边BM1S1与第二侧边BM1S2之间。上表面BM1TS1可为平坦表面。第一色阻CF1堆叠在第一黑部件BM1的第一侧边BM1S1与上表面BM1TS1。第二色阻CF2堆叠在第一黑部件BM1的第二侧边BM1S2与上表面BM1TS1。堆叠在第一黑部件BM1的上表面BM1TS1的第一色阻CF1与第二色阻CF2是彼此不交叠，并以间距Q彼此隔开。电极层120可设置在黑矩阵层BM与色阻上。电极层120可为透明电极层(例如氧化铟锡等)。
请参照图3，主动元件阵列基板104与彩色滤光基板106是相对设置，且显示介质LC设置在主动元件阵列基板104与彩色滤光基板106之间。显示介质LC包括液晶层。间隔元件PS可设置在主动元件阵列基板104与彩色滤光基板106之间，用以隔开主动元件阵列基板104与彩色滤光基板106。于此，垂直投影方向D3可为垂直于第一基板112或第二基板118的表面的方向。
请参照图3，第一共通电极CE1与第二共通电极CE2是在垂直投影方向D3上与第一黑部件BM1重叠。第一黑部件BM1与第一共通电极CE1可在垂直投影方向D3上部分重叠第一像素电极PE1。第一黑部件BM1与第二共通电极CE2可在垂直投影方向D3上部分重叠第三像素电极PE3。第一黑部件BM1的第一侧边BM1S1可对准第一共通电极CE1的远离第一线段DLP1的侧边CE1S1。第一黑部件BM1的第二侧边BM1S2可对准第二共通电极CE2的远离第一线段DLP1的侧边CE2S2。遮光干部BMK可遮蔽薄膜晶体管，例如包括第一开关元件T1(图1)、第二开关元件T2、与第三开关元件T3(图1)。
请参照图3，第一黑部件BM1在第一方向D1上的尺寸BMW1(例如宽度)大于第一线段DLP1在第一方向D1上的尺寸DLW1(例如宽度)。在一实施例中，第一线段DLP1在第一方向D1上的尺寸DLW1(例如宽度)与第二线段DLP2在第一方向D1上的尺寸DLW2(例如宽度)可实质上相同。亦即第一黑部件BM1在第一方向D1上的尺寸BMW1(例如宽度)大于第二线段DLP2在第一方向D1上的尺寸DLW2(例如宽度)。
请参照图3与图4，第一黑部件BM1与数据线DL1的第一线段DLP1在垂直投影方向D3上重叠，且未与数据线DL1的第二线段DLP2重叠。第一黑部件BM1的第一侧边BM1S1与第二侧边BM1S2分别在第一线段DLP1的第一侧边DLS1与第二侧边DLS2的外侧。此实施例中，数据线DL1的第二线段DLP2在垂直投影方向D3上并未与黑矩阵层BM重叠。第一色阻CF1与第二色阻CF2的交叠区域OV与数据线DL1的第二线段DLP2在垂直投影方向D3上是至少部分重叠。
在实施例的像素结构102中，第二子像素SP2的第二像素电极PE2及第四子像素SP4的第四像素电极PE4之间并未配置黑矩阵层。一比较例中，黑矩阵层(未显示)包括设置在第二子像素SP2的第二像素电极PE2及第四子像素SP4的第四像素电极PE4之间的一黑矩阵部分，且此黑矩阵部分与第一黑部件BM1皆等宽，造成大面积的遮蔽范围。因此跟比较例的像素结构相比，本发明的实施例的像素结构102可具有较高的开口率。
请参照图5至图7。图5为根据另一实施例的像素结构的彩色滤光基板的示意图。图6示出像素结构的色阻、黑矩阵层与数据线的配置示意图。图7为像素结构的剖面图，其可沿图5、图6中的CD线绘制。像素结构202的主动元件阵列基板104可类似图1所示的主动元件阵列基板104。像素结构202与图3所示的像素结构102类似，差异在于像素结构202的彩色滤光基板206的黑矩阵层BM'还包括第二黑部件BM2。
请参照图5与图6，遮光干部BMK可连接在第二黑部件BM2与第一黑部件BM1之间。第二黑部件BM2可从遮光干部BMK的第二侧边BMKS2沿第二方向D2延伸。第二黑部件BM2包括相对的第一侧边BM2S1与第二侧边BM2S2。
请参照图7，第二黑部件BM2设置在第二基板118上。第二黑部件BM2可包括上表面BM2TS2。上表面BM2TS2在第一侧边BM2S1与第二侧边BM2S2之间。上表面BM2TS2可为平坦表面。第一色阻CF1堆叠在第二黑部件BM2的第一侧边BM2S1与上表面BM2TS2。第二色阻CF2堆叠在第二黑部件BM2的第二侧边BM2S2与上表面BM2TS2。第一色阻CF1与第二色阻CF2是在第二黑部件BM2的上表面BM2TS2上彼此堆叠以形成交叠区域OV。第二黑部件BM2在垂直投影方向D3上不重叠第一共通电极CE1及第二共通电极CE2。第一黑部件BM1在第一方向D1上的尺寸BMW1(例如宽度)大于第二黑部件BM2在第一方向D1上的尺寸BMW2(例如宽度)。第二黑部件BM2在第一方向D1上的尺寸BMW2(例如宽度)是等于或小于第二线段DLP2在第一方向D1上的尺寸DLW2(例如宽度)。
请参照图6与图7，第二黑部件BM2与数据线DL1的第二线段DLP2在垂直投影方向D3上重叠，且第二黑部件BM2与第一色阻CF1及第二色阻CF2的交叠区域OV重叠。第二线段DLP2具有相对的第一侧边DLS3与第二侧边DLS4。在一实施例中，第二线段DLP2的第一侧边DLS3是对准第二黑部件BM2的第一侧边BM2S1。或者，第二线段DLP2的第一侧边DLS3在第二黑部件BM2的第一侧边BM2S1外侧，亦即第二线段DLP2的第一侧边DLS3在垂直投影方向D3上未重叠第二黑部件BM2。第二线段DLP2的第二侧边DLS4是对准第二黑部件BM2的第二侧边BM2S2。或者，第二线段DLP2的第二侧边DLS4在第二黑部件BM2的第二侧边BM2S2外侧，亦即第二线段DLP2的第二侧边DLS4在垂直投影方向D3上并未重叠第二黑部件BM2。第一色阻CF1与第二色阻CF2的交叠区域OV与数据线DL1的第二线段DLP2在垂直投影方向D3上是至少部分重叠。在本实施例中，第二黑部件BM2在垂直投影方向D3上与第二子像素SP2的第二像素电极PE2以及第四子像素SP4的第四像素电极PE4部分重叠。
在实施例的像素结构202中，黑矩阵层BM'其设置在第二子像素SP2的第二像素电极PE2及第四子像素SP4的第四像素电极PE4之间的第二黑部件BM2的宽度较第一黑部件BM1窄。一比较例中，黑矩阵层(未显示)其设置在两相邻的子像素之间的黑矩阵部分皆等宽，造成大面积的遮蔽范围。因此跟比较例的像素结构相比，本发明的实施例的像素结构202可具有较高的开口率，例如至少提高开口率5％以上。
请参照图8。图8为像素结构302的剖面图。像素结构302可类似图7所示的像素结构202，差异在于像素结构302的主动元件阵列基板304包括黑色材料层BL。黑色材料层BL可设置在第一绝缘层114之上，覆盖于第二开关元件T2上。第二绝缘层116可设置在黑色材料层BL上。在一实施例中，黑色材料层BL的概念亦可应用至例如图3所示的像素结构102中。
请参照图9。图9为像素结构402的剖面图。像素结构402可类似图8所示的像素结构302，差异在于像素结构402的主动元件阵列基板404的黑色材料层BL'包含图8中黑色材料层BL的遮光作用以及图8中间隔元件PS的作用。一实施例中，黑色材料层BL'的概念亦可应用至例如图3所示的像素结构中。
请参照图10。图10为像素结构502的剖面图。像素结构502可类似图7所示的像素结构202，差异在于像素结构502的主动元件阵列基板504中，黑矩阵层BM”的第二黑部件BM2a在垂直投影方向D3上未与第二子像素SP2的第二像素电极PE2以及第四子像素SP4的第四像素电极PE4重叠。更详而言之，第二黑部件BM2a及/或数据线DL1的第二线段DLP2在垂直投影方向D3上未与第二像素电极PE2以及第四像素电极PE4重叠。此概念亦可例如应用至类似图7、图8、图9的像素结构。
请参照图11。图11显示一实施例中彩色滤光基板在第一黑部件BM1’附近的剖面图。第一黑部件BM1’的第一侧边BM1S1与第二侧边BM1S2可为倾斜的侧壁，且第一黑部件BM1’具有往远离第二基板118的方向逐渐变窄的梯形形状。第一黑部件BM1’的相对边缘可分别为第一侧边BM1S1与第二侧边BM1S2邻接第二基板118的边缘。在一实施例中，第一黑部件BM1’的相对边缘对于其它元件的配置关系可类似如图3、图7、图10中所述第一黑部件BM1的第一侧边BM1S1与第二侧边BM1S2对于其它元件的配置关系。
请参照图12。图12显示一实施例中彩色滤光基板在第二黑部件BM2'附近的剖面图。第二黑部件BM2'的第一侧边BM2S1与第二侧边BM2S2可为倾斜的侧壁，且第二黑部件BM2'具有往远离第二基板118的方向逐渐变窄的梯形形状。第二黑部件BM2'的相对边缘可分别为第一侧边BM2S1与第二侧边BM2S2邻接第二基板118。在一实施例中，第二黑部件BM2'的相对边缘对于其它元件的配置关系可类似如图7中所述第二黑部件BM2的第一侧边BM2S1与第二侧边BM2S2对于其它元件的配置关系。例如当以第二黑部件BM2'取代第二黑部件BM2时，第二黑部件BM2'的相对两边缘是实质上分别对准第二线段DLP2的第一侧边DLS3与第二侧边DLS4。
综上所述，本发明的实施例的像素结构中，第二子像素的第二像素电极及第四子像素的第四像素电极之间并未配置黑矩阵层；或者，黑矩阵层具有第二黑部件设置于第二子像素的第二像素电极及第四子像素的第四像素电极之间，且第二黑部件的宽度比设置在第一子像素的第一像素电极及第三子像素的第三像素电极之间的第一黑部件窄。因此，本发明的实施例的像素结构可具有较高的开口率。
综上所述，虽然本发明已以实施例公开如上，然其并非用以限定本发明。本发明所属技术领域中技术人员，在不脱离本发明的构思和范围内，当可作各种的变动与润饰。因此，本发明的保护范围当视权利要求所界定者为准。

Claims (8)

1.一种像素结构，包括：
一第一像素，包括一第一色阻；
一第二像素，包括一第二色阻，该第一色阻与该第二色阻排列在一第一方向上；
一数据线，包括延伸在一第二方向上的一第一线段与一第二线段，该第一方向与该第二方向彼此交错；及
一黑矩阵层，包括一第一黑部件，其中该第一黑部件与该第一线段重叠，且未与该第二线段重叠；其中
该第一色阻与该第二色阻彼此堆叠以形成一交叠区域，该交叠区域重叠于该第二线段上，而设置于该第一黑部件上的该第一色阻与该第二色阻彼此不交叠且以一间距彼此隔开，
其中该黑矩阵层还包括一第二黑部件，该第二黑部件与该第二线段重叠，且该第二黑部件与该交叠区域重叠，
其中该第一黑部件在该第一方向上的尺寸大于该第二黑部件在该第一方向上的尺寸，
其中该第一像素包括排列在该第二方向上的一第一子像素与一第二子像素，以及一第一共通电极，而该第一共通电极与该第一黑部件重叠，该第二黑部件不重叠该第一共通电极，
其中该第二像素包括排列在该第二方向上的一第三子像素与一第四子像素，
其中该第二子像素与该第四子像素相邻，
其中该第二黑部件位于该第二子像素的第二像素电极与该第四子像素的第四像素电极之间。
2.如权利要求1所述的像素结构，其中该第一黑部件具有相对的一第一侧边与一第二侧边，该第一色阻堆叠于该第一侧边上，以及该第二色阻堆叠于该第二侧边上。
3.如权利要求1所述的像素结构，其中该第一黑部件在该第一方向上的尺寸大于该第二线段在该第一方向上的尺寸。
4.如权利要求1所述的像素结构，其中该第二黑部件在该第一方向上的尺寸是等于或小于该第二线段在该第一方向上的尺寸。
5.如权利要求1所述的像素结构，还包括相对设置的一第一基板与一第二基板，其中该数据线设置在该第一基板上，且该黑矩阵层、该第一色阻与该第二色阻设置在该第二基板上。
6.如权利要求1所述的像素结构，其中该第二像素包括一第二共通电极，而该第二共通电极与该第一黑部件重叠。
7.如权利要求1所述的像素结构，其中该第一线段与该第二线段在该第一方向上的尺寸是实质上相同。
8.如权利要求1所述的像素结构，其中该黑矩阵层还包括一遮光干部，该遮光干部延伸在该第一方向上。
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