CN108847178B - 显示装置 - Google Patents
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Abstract
一种显示装置,包括多条扫描线、多条数据线、多个像素单元、多个栅极驱动电路以及多条连接线。扫描线沿着第一方向延伸。数据线沿着第二方向延伸。多个像素单元沿着第一方向排列成多行,且沿着第二方向排列成多列。栅极驱动电路沿着第一方向延伸,且每个栅极驱动电路横跨像素单元中的至少两个。相邻的两列像素单元之间包括至少两个栅极驱动电路。多条连接线沿着第二方向延伸,且电性连接至栅极驱动电路。至少部分连接线重叠于数据线。连接线包括多条输出线以及多条信号线。输出线电性连接至扫描线。
Description
技术领域
本发明是有关于一种显示装置,且特别是有关于一种具有栅极驱动电路的显示装置。
背景技术
栅极驱动电路基板技术(Gate on Array;GOA)指的是在制作显示装置时,直接将栅极驱动电路形成于有源元件阵列基板上,以代替外接驱动芯片的技术。
一般而言,栅极驱动电路是设置在显示装置的显示区之外,位于显示装置的边框位置。然而,栅极驱动电路通常占了边框面积的很大一部分。严重的影响了显示装置的外观。因此,要如何解决前述问题是目前显示装置领域中重要的课题之一。
发明内容
本发明提供一种显示装置,可以改善栅极驱动电路占据边框面积的问题。
本发明的一种显示装置,包括多条扫描线、多条数据线、多个像素单元、多个栅极驱动电路以及多条连接线。扫描线沿着第一方向延伸。数据线沿着第二方向延伸。多个像素单元沿着第一方向排列成多行,且沿着第二方向排列成多列。栅极驱动电路沿着第一方向延伸,且每个栅极驱动电路横跨像素单元中的至少两个。相邻的两列像素单元之间包括至少两个栅极驱动电路。多条连接线沿着第二方向延伸,且电性连接至栅极驱动电路。至少部分连接线重叠于数据线。连接线包括多条输出线以及多条信号线。输出线电性连接至扫描线。
基于上述,在本发明的至少一实施例中,栅极驱动电路设置于像素单元之间,藉此能缩小显示装置的边框面积。
以下结合附图和具体实施例对本发明进行详细描述,但不作为对本发明的限定。
附图说明
图1为依据本发明一实施例的一种显示装置的上视示意图。
图2为依据本发明一实施例的一种像素阵列的排列示意图。
图3为依据本发明一实施例的一种栅极驱动电路的电路图。
图4为依据本发明一实施例的一种栅极驱动电路的电路图。
图5A为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。
图5B为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。
图5C为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。
图5D为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。
其中,附图标记:
100:显示装置
101:像素阵列
A1~A9、B1~B8:薄膜晶体管
AR:显示区
BR:非显示区
CK、D2U、RST、STV、U2D、VGH、XCK、XDONB:信号线
D1、D2:方向
DL1~DL3:数据线
DR:栅极驱动电路
L:连接线
R:电阻
SL1、SL2:扫描线
SR0、SR1:输出线
T1~T12:有源元件
P1~P6:子像素
PU1~PU6:像素单元
X1:有源控制单元
X2:升压单元
X3:下拉单元
X4:预充电控制器
X5:输出单元
X6:防漏电单元
W1、W2:宽度
具体实施方式
下面结合附图对本发明的结构原理和工作原理作具体的描述:
图1为依据本发明一实施例的显示装置的上视示意图。
请参考图1,本实施例的显示装置100包括有显示区AR以及非显示区BR,其中,非显示区BR位于显示区AR的一侧,或是非显示区BR环绕显示区AR。换言之,非显示区BR可位于显示区AR的其中一侧边,且可依不同需求而调整。举例而言,非显示区BR系环绕于显示区AR,应用于矩形显示区时,非显示区BR可位于显示区AR的其中一侧边、两侧边、三侧边或四侧边;应用于非矩形显示区或圆形显示区时,非显示区BR可邻近于显示区AR,形成显示区AR的部分周边或全部周边为非显示区BR。一般来说,栅极驱动电路(Gate on Array;GOA)通常是制作在显示面板的非显示区BR上,例如是位于边框的位置。然而,在本发明实施例中,栅极驱动电路是设置在显示区AR中。以下,将对如何设置栅极驱动电路于显示区AR中进行说明。
图2为依据本发明一实施例的像素阵列的排列示意图。
显示装置100的显示区AR中包括像素阵列101,像素阵列101包括多条扫描线(SL1、SL2)、多条数据线(DL1~DL3)、多个像素单元(PU1~PU6)、多个栅极驱动电路DR以及多条连接线L。在图2中仅绘出六个像素单元以及一个栅极驱动电路。但需注意的是,显示面板100实际上应包括更多个像素单元以及栅极驱动电路。
扫描线(SL1、SL2)沿着第一方向D1延伸。数据线(DL1~DL3)沿着第二方向D2延伸。像素单元(PU1~PU6)沿着第一方向D1排列成多行(Column),且沿着第二方向D2排列成多列(row)。
像素单元PU2~PU6的设置方式与像素单元PU1的设置方式相同,因此,仅以像素单元PU1做为代表来说明。
在本实施例中,每个像素单元(PU1~PU6)具有对应的两条扫描线(SL1、SL2)、对应的三条数据线(DL1~DL3)以及对应的六个子像素(P1~P6)。子像素P1电性连接扫描线SL1与数据线DL1。子像素P2电性连接扫描线SL1与数据线DL2。子像素P3电性连接扫描线SL2与数据线DL1。子像素P4电性连接扫描线SL1与数据线DL3。子像素P5电性连接扫描线SL2与数据线DL2。子像素P6电性连接扫描线SL2与数据线DL3。在一些实施例中,相同行的子像素可以为相同颜色的子像素,但本发明不以此为限。
虽然在本实施例中是以每个像素单元(PU1~PU6)具有对应的两条扫描线(SL1、SL2)、对应的三条数据线(DL1~DL3)以及对应的六个子像素(P1~P6)为例,但本发明不以此为限。在其他实施例中,每个像素单元具有对应的四条扫描线、对应的六条数据线以及对应的十二个子像素。
栅极驱动电路DR沿着第一方向D1延伸,且每个栅极驱动电路DR横跨像素单元(PU1~PU6)中的至少两个。
在本实施例中,每列像素单元对应了两条扫描线(SL1、SL2),换句话说,相邻的两列像素单元之间包括至少两个栅极驱动电路DR。对应的两条扫描线(SL1、SL2)分别电性连接至对应的两个栅极驱动电路DR。
多条连接线L沿着第二方向D2延伸,且电性连接至栅极驱动电路DR。在本实施例中,至少部分连接线L重叠于数据线DL1、数据线DL2和/或数据线DL3。在本实施例中,部分连接线L重叠于数据线DL2,且至少部分数据线互相重叠。举例来说,像素单元(PU1、PU4)的数据线DL3重叠于像素单元(PU2、PU5)的数据线DL1,像素单元(PU2、PU5)的数据线DL3重叠于像素单元(PU3、PU6)的数据线DL1,但本发明不以此为限。然而为了方便说明,图2所绘示的连接线L并未重叠于数据线DL1、数据线DL2和/或数据线DL3,且数据线DL1和数据线DL3并未互相重叠。
由于连接线L重叠于数据线DL1、数据线DL2和/或数据线DL3,因此可以降低连接线L对显示装置开口率的影响。
连接线L包括多条输出线(绘于图3)以及多条信号线(绘于图3)。输出线电性连接至扫描线(SL1、SL2)。举例来说,输出线电性连接栅极驱动电路DR至对应的扫描线(SL1、SL2),信号线电性连接栅极驱动电路DR至其他元件。
图3为依据本发明一实施例的栅极驱动电路的电路图。图4为依据本发明一实施例的一种栅极驱动电路的电路图,其中图4的电路图为图3的电路图的等效电路。在此必须说明的是,图3、图4的实施例沿用图2的实施例的元件标号与部分内容,其中采用相同或近似的标号来表示相同或近似的元件,并且省略了相同技术内容的说明。关于省略部分的说明可参考前述实施例,在此不赘述。
请同时参考图3、图4,在本实施例中,栅极驱动电路DR包括有源控制单元X1、升压单元X2、下拉单元X3、预充电控制器X4以及输出单元X5。在一些实施例中,栅极驱动电路DR还包括防漏电单元X6。
升压单元X2电性连接至有源控制单元X1。下拉单元X3电性连接至有源控制单元X1。预充电控制器X4电性连接至有源控制单元X1。输出单元X2电性连接至升压单元X2。防漏电单元X6电性连接至有源控制单元X1。
更具体地说,下拉单元X3包括有源元件T1,有源控制单元X1包括有源元件T2~T7以及电阻R,预充电控制器X4包括有源元件T8、T9,防漏电单元X6包括有源元件T10,升压单元X2包括有源元件T11,输出单元X5包括有源元件T12。有源元件T1~T12各自具有控制端、第一端以及第二端。
有源元件T1的控制端电性连接至有源元件T2的控制端、有源元件T3的控制端、有源元件T4的第二端、电阻R以及有源元件T5的第一端。有源元件T1的第二端电性连接至输出线SR0。有源元件T1的第二端电性连接至有源元件T3的第二端、有源元件T5的第二端以及信号线XDONB。
有源元件T2的控制端电性连接至有源元件T1的控制端、有源元件T3的控制端、有源元件T4的第二端、电阻R以及有源元件T5的第一端。有源元件T2的第一端电性连接至有源元件T7的第二端、有源元件T10的第二端、有源元件T5的控制端、有源元件T9的第一端以及有源元件T8的第二端。有源元件T2的第二端电性连接至有源元件T3的第一端。
有源元件T3的控制端电性连接至有源元件T1的控制端、有源元件T2的控制端、有源元件T4的第二端、电阻R以及有源元件T5的第一端。有源元件T3的第一端电性连接至有源元件T2的第二端。有源元件T3的第二端电性连接至有源元件T1的第二端、有源元件T5的第二端以及信号线XDONB。
有源元件T4的控制端电性连接至有源元件T4的第一端以及信号线XCK。有源元件T4的第二端电性连接至有源元件T1的控制端、有源元件T2的控制端、有源元件T3的控制端、电阻R以及有源元件T5的第一端。
有源元件T5的控制端电性连接至有源元件T2的第一端、有源元件T7的第二端、有源元件T10的第二端、有源元件T9的第一端以及有源元件T8的第二端。有源元件T5的第一端电性连接至有源元件T1的控制端、有源元件T2的控制端、有源元件T3的控制端、有源元件T4的第二端以及电阻R。有源元件T5的第二端电性连接至有源元件T1的第二端、有源元件T3的第二端以及信号线XDONB。
有源元件T6的控制端电性连接至信号线XCK。有源元件T6的第一端电性连接至信号线VGH以及有源元件T10的控制端。有源元件T6的第二端电性连接至电阻R
有源元件T7的控制端电性连接至输出线SR0以及有源元件T7的第一端。有源元件T7的第二端电性连接至有源元件T2的第一端、有源元件T5的控制端、有源元件T10的第二端、有源元件T9的第一端以及有源元件T8的第二端。
有源元件T8的控制端电性连接至信号线STV。有源元件T8的第一端电性连接至信号线U2D。有源元件T8的第二端电性连接至有源元件T2的第一端、有源元件T5的控制端、有源元件T10的第二端、有源元件T9的第一端以及有源元件T7的第二端。
有源元件T9的控制端电性连接至输出线SR1。有源元件T9的第一端电性连接至有源元件T2的第一端、有源元件T5的控制端、有源元件T10的第二端、有源元件T8的第二端以及有源元件T7的第二端。有源元件T9的第二端电性连接至信号线D2U。
有源元件T10的控制端电性连接至信号线VGH以及有源元件T6的第一端。有源元件T10的第一端电性连接至有源元件T11的控制端以及有源元件T12的控制端。有源元件T10的第二端电性连接至有源元件T2的第一端、有源元件T5的控制端、有源元件T9的第一端、有源元件T8的第二端以及有源元件T7的第二端。
有源元件T11的控制端电性连接至有源元件T10的第一端以及有源元件T12的控制端。有源元件T11的第一端电性连接至有源元件T11的第二端、有源元件T12的第二端以及输出线SR0。
有源元件T12的控制端电性连接至有源元件T10的第一端以及有源元件T11的控制端。有源元件T12的第一端电性连接至信号线CK。有源元件T12的第二端电性连接至有源元件T11的第一端、有源元件T11的第二端以及输出线SR0。
虽然本实施例的栅极驱动电路DR的电路图是以图2为例,但本发明不以此为限。在其他实施例中,栅极驱动电路DR还可以为具有其他形式的电路图的驱动电路。
图5A为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。图5B为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。图5C为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。图5D为依据本发明一实施例的一种栅极驱动电路的局部俯视示意图。
图5A~图5D的栅极驱动电路对应了图4的电路图。图5A~图5D为栅极驱动电路不同位置的俯视示意图,图5A的最左侧接续图5B的最右侧,图5B的最右侧接续图5C的最左侧,且图5C的最右侧接续图5D的最左侧。
在图5A~图5D中,栅极驱动电路DR周围的连接线L以及数据线DL的数量仅是用于示意,图5A~图5D省略绘示了部分的数据线DL。此外,于巨观情况下,连接线L以及数据线DL沿着方向D2延伸,然而由于连接线L以及数据线DL可能为锯齿状(zigzag)或其他形状,因此局部的连接线L以及局部的数据线DL可能与方向D2夹有夹角。
在本实施例中,下拉单元X3包括有源元件T1(下拉有源元件),有源元件T1重叠于数据线DL中的两条以上。举例来说,有源元件T1由多个薄膜晶体管A1~A9串在一起而构成,薄膜晶体管A1~A9的漏极彼此电性相连,源极彼此电性相连,且栅极彼此电性相连。虽然在本实施例中是以有源元件T1包括九个薄膜晶体管为例,但本发明不以此为限。在其他实施例中,有源元件T1包括九个以上的薄膜晶体管,例如包括十二个薄膜晶体管。
在较佳的实施例中,栅极驱动电路DR于第二方向D2延伸的长度等于有源元件T1于第二方向D2延伸的长度。也可以说栅极驱动电路DR的宽度较佳不超过有源元件T1的宽度W1,有源元件T1的宽度W1例如为19.5微米±5%,但本发明不以此为限。在一些实施例中,宽度W1小于30微米,藉此改善沟道热效应(Channel heating)问题,但本发明不以此为限。
在本实施例中,升压单元X2包括有源元件T11(升压有源元件),有源元件T11重叠于数据线DL中的两条以上。举例来说,有源元件T11由多个薄膜晶体管B1~B8串在一起而构成,薄膜晶体管B1~B8的漏极彼此电性相连,源极彼此电性相连,且栅极彼此电性相连。虽然在本实施例中是以有源元件T11包括八个薄膜晶体管为例,但本发明不以此为限。在其他实施例中,有源元件T11包括八个以上的薄膜晶体管,例如包括十二个薄膜晶体管。
在本实施例中,输出单元X5包括有源元件T12(输出有源元件),有源元件T12重叠于数据线DL中的两条以上。举例来说,有源元件T12由多个薄膜晶体管C1~C10串在一起而构成,薄膜晶体管C1~C10的漏极彼此电性相连,源极彼此电性相连,且栅极彼此电性相连。虽然在本实施例中是以有源元件T12包括十个薄膜晶体管为例,但本发明不以此为限。在其他实施例中,有源元件T12包括十个以上的薄膜晶体管,例如包括十五个薄膜晶体管。
在较佳的实施例中,栅极驱动电路DR于第二方向D2延伸的长度等于有源元件T12于第二方向D2延伸的长度。也可以说栅极驱动电路DR的宽度较佳不超过有源元件T12的宽度W2,有源元件T12的宽度W2例如为19.5微米±5%,但本发明不以此为限。在一些实施例中,宽度W2小于30微米,藉此改善沟道热效应(Channel heating)问题,但本发明不以此为限。
输出单元X5与下拉单元X3分别邻近于栅极驱动电路DR的左右两端,且升压单元X2邻近于输出单元X5。换句话说,栅极驱动电路DR中体积较大的有源元件T1、有源元件T11以及有源元件T12靠近栅极驱动电路DR的左右两端设置,可以减少栅极驱动电路DR中横跨有源元件T1与有源元件T12的走线,藉此缩小栅极驱动电路DR的宽度。
在本实施例中,有源元件T7、有源元件T12、有源元件T11以及有源元件T1藉由与数据线DL重叠的输出线SR0而连接至同条扫描线SL,藉此增加线路布局的弹性。
当然,本发明还可有其它多种实施例,在不背离本发明精神及其实质的情况下,熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形,但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。
Claims (10)
1.一种显示装置,其特征在于,包括:
多条扫描线,沿着第一方向延伸;
多条数据线,沿着第二方向延伸;
多个像素单元,沿着该第一方向排列成多行,且沿着该第二方向排列成多列,其中每个该些像素单元具有对应的两条扫描线、对应的三条数据线以及对应的六个子像素;
多个栅极驱动电路,沿着该第一方向延伸,且每个该些栅极驱动电路横跨该些像素单元中的至少两个,其中相邻的两列像素单元之间包括至少两个栅极驱动电路;以及
多条连接线,沿着该第二方向延伸,且电性连接至该些栅极驱动电路,其中至少部分该些连接线重叠于该些数据线,该些连接线包括多条输出线以及多条信号线,该些输出线电性连接至该些扫描线;
其中每个该些栅极驱动电路包括:
一有源控制单元;
一升压单元,电性连接至该有源控制单元;
一下拉单元,电性连接至该有源控制单元;
一预充电控制器,电性连接至该有源控制单元;以及
一输出单元,电性连接至该升压单元;
该下拉单元包括一下拉有源元件,该下拉有源元件重叠于该些数据线中的两条以上。
2.如权利要求1所述的显示装置,其特征在于,其中该对应的两条扫描线包括第一扫描线与第二扫描线,该对应的三条数据线包括第一数据线、第二数据线与第三数据线,该对应的六个子像素包括:
一第一子像素,电性连接该第一扫描线与该第一数据线;
一第二子像素,电性连接该第一扫描线与该第二数据线;
一第三子像素,电性连接该第二扫描线与该第一数据线;
一第四子像素,电性连接该第一扫描线与该第三数据线;
一第五子像素,电性连接该第二扫描线与该第二数据线;
一第六子像素,电性连接该第二扫描线与该第三数据线。
3.如权利要求1所述的显示装置,其特征在于,其中每个该些像素单元具有对应的四条扫描线、对应的六条数据线以及对应的十二个子像素。
4.如权利要求1所述的显示装置,其特征在于,其中该对应的两条扫描线分别电性连接至对应的两个栅极驱动电路。
5.如权利要求1所述的显示装置,其特征在于,其中至少部分数据线互相重叠。
6.如权利要求1所述的显示装置,其特征在于,其中每个该些栅极驱动电路更包括:
一防漏电单元,电性连接至该有源控制单元。
7.如权利要求1所述的显示装置,其特征在于,其中于至少一栅极驱动电路中,该至少一栅极驱动电路的该输出单元与该至少一栅极驱动电路的该下拉单元分别邻近于该至少一栅极驱动电路的左右两端。
8.如权利要求1所述的显示装置,其特征在于,其中该些栅极驱动电路于该第二方向延伸的长度等于该下拉有源元件于该第二方向延伸的长度。
9.如权利要求1所述的显示装置,其特征在于,其中该输出单元包括一输出有源元件,该输出有源元件重叠于该些数据线中的两条以上。
10.如权利要求9所述的显示装置,其特征在于,其中该些栅极驱动电路于该第二方向延伸的长度等于该输出有源元件于该第二方向延伸的长度。
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