CN108738375A - 无线通信系统中用于同步和装置标识的偶数长度序列 - Google Patents

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Abstract

本发明描述了与在无线通信中使用偶数长度序列进行同步和装置标识有关的技术、方案和示例。一种设备的处理器可以生成至少包含偶数长度Zadoff‑Chu(ZC)序列的信号并且将该信号发送到接收装置。偶数长度ZC序列标识设备，承载用于发讯的信息或者用于时间‑频率同步。处理器还可以接收至少包含偶数长度ZC序列的信号，并且检测接收到的信号中的偶数长度ZC序列。

Description

无线通信系统中用于同步和装置标识的偶数长度序列
相关专利申请的交叉引用
本发明是要求于2017年2月24日提交的美国临时专利申请No.62/463,012的优先权权益的非临时申请的一部分。以上列出的申请的内容通过引用完整地并入本文中。
技术领域
本发明总体上涉及移动通信。具体地，本发明涉及移动通信系统中的同步和装置标识(device identification)。
背景技术
除非在本文中另外指示，否则本部分中描述的方法不是对于下面列出的权利要求的现有技术，并且不因包含在该部分中而被承认是现有技术。
在长期演进(Long-Term Evolution，LTE)网络中，奇数长度Zadoff-Chu(ZC)序列被用作主同步信号(Primary Synchronization Signal，PSS)，如下面的等式1所表达。
当N是奇数时，Z[k]是周期性的，周期为N。Z[k]的离散傅里叶逆变换(InverseDiscrete Fourier Transfer，IDFT)具有恒定幅值的闭式表达式，如下面的等式2所示。
在该表达式中，在mod(uμ,N)＝1的意义上，μ＝1/u。当N是质数时，如果u1和u2互质，则不同根索引u1和u2的两个ZC序列之间的互相关(cross correlation)是N的平方根。
通常，在LTE网络中，选择下面的值：在三个根索引u＝25、29和34的情况下，N＝63。因为正交频分复用(Orthogonal Frequency-Division Multiplexing，OFDM)系统通常采用作为2的幂(例如，64、128和256)的离散傅里叶变换(Discrete Fourier Transform，DFT)/IDFT大小，所以将序列Z[k]置于OFDM系统的频域中。然而，这些长度的ZC序列的DFT/IDFT不具有能够被用于高效实现时域中的检测器的闭合形式。
发明内容
以下发明内容仅是例示性的，并且不旨在以任何方式限制。即，提供以下发明内容以引入这里所描述的新颖且非明显技术的概念、亮点、益处以及优点。以下在具体实施方式中进一步描述选择的并非所有实现方式。因此，以下发明内容不旨在识别所要求保护的主题的必要特征，也不旨在用于确定所要求保护的主题的范围。
在一方面中，一种方法可以涉及设备的处理器生成至少包括偶数长度ZC序列的信号。该方法还可以涉及所述处理器将所述信号发送到接收装置。所述偶数长度ZC序列可以标识设备，承载用于发讯的信息或者用于时间-频率同步。
在一方面中，一种方法可以涉及设备的处理器接收至少包括偶数长度ZC序列的信号。该方法还可以涉及所述处理器检测所接收到的信号中的所述偶数长度ZC序列。所述偶数长度ZC序列可以标识设备，承载用于发讯的信息或者用于时间-频率同步。
附图说明
附图被包括进来以提供对本发明的进一步理解，并入本发明并构成本发明的一部分。附图例示了本发明的实现方式，并且与说明书一起用于说明本发明的原理。能理解的是，附图不一定是按比例的，因为为了清楚地例示本发明的构思，一些组件可以被显示为与实际实现方式中的尺寸不成比例。
图1是根据本发明的用两个或更多个偶数长度ZC序列合成复合序列的各种方式的示例的图。
图2是根据本发明的使用交织TDM将两个偶数长度ZC序列合成为复合序列的示例场景的图。
图3是根据本发明的用于低复杂度检测的方法的示例场景。
图4是根据本发明的用于低复杂度检测的方法的示例逻辑流程。
图5是根据本发明的用于低复杂度检测的方法的示例场景。
图6是根据本发明的用于低复杂度检测的方法的示例场景。
图7是根据本发明的用于低复杂度检测的方法的示例逻辑流程。
图8是根据本发明的用于对接收到的信号进行过采样的方法的示例场景。
图9是根据本发明的关于复合序列的两个序列的示例表。
图10是根据本发明的复合序列的示例场景。
图11是根据本发明的用于复合序列的方法的示例逻辑流程。
图12是根据本发明的示例无线通信系统的图。
图13是根据本发明的进程的流程图。
图14是根据本发明的进程的流程图。
具体实施方式
在下面的具体实施方式中，通过示例的方式阐述了众多具体细节，以便提供对相关教导的彻底理解。基于本文中描述的教导的任何变型、衍生和/或扩展在本发明的保护范围内。在一些情形下，可以以相对高级别在没有细节的情况下描述与本文中公开的一个或更多个示例实现方式有关的公知方法、过程、组件和/或电路，以便避免不必要地混淆本发明教导的一些方面。
概述
在本发明提出的方案下，下面表达为等式3的偶数长度ZC序列可以被用于PSS。
在等式3中，N是2的幂并且根索引u是奇数。Z[k]的IDFT可以被表达为下面的等式4。
这里，mod(uμ,N)＝1。此外，恒幅零自相关(Constant Amplitude Zero Auto-Correlation，CAZAC)属性被保留。
在本发明提出的方案下，可以通过将奇数长度ZC序列扩展一个样本来推导出下面表达为等式5的另一个偶数长度序列。
当序列置于时域中时，根据本发明的所有实施方式(包括本文中描述的实施方式)都是适用的。此外，在提出的方案下，频域中的序列可以被表达为下面的等式6。
在根据本发明的第一实施方式中，在关于发送/发送器(Transmitting/Transmitter，TX)独立使用的情况下，通信装置可以出于各种目的来传输单个序列，这些目的包括(例如但是不限于)装置标识、发讯和时间-频率同步。就发讯而言，发讯目的可以包括由特定波束成形器来标识传输。另外，另一个发讯目的可以包括在一系列传输信号中标识时序索引。为了标识和发讯，可以通过具有根索引u的序列的循环或非循环时间-频率移位来执行单个序列的传输。值得注意的是，单个序列可以被用在时域或频域中。
在根据本发明的第二实施方式中，同样关于传输，可以按照各种方式将两个或更多个偶数长度ZC序列合成为复合序列。例如，可以使用连续或非连续频分复用(FrequencyDivision Multiplexing，FDM)和/或交织FDM将两个或更多个偶数长度ZC序列合成为复合序列。另选地，可以使用连续或非连续时分复用(Time Division Multiplexing，TDM)和/或交织TDM将两个或更多个偶数长度ZC序列合成为复合序列。另选地，可以使用码分复用(Code Division Multiplexing，CDM)将两个或更多个偶数长度ZC序列合成为复合序列，例如，在相同频率中同时发送的多个分量序列。另选地，可以使用FDM和TDM的组合将两个或更多个偶数长度ZC序列合成为复合序列。值得注意的是，两个或更多个偶数长度ZC序列可以具有相同的长度或不同的长度。此外，两个或更多个偶数长度ZC序列可以具有相同的索引或不同的索引。在从两个分量序列的复用推导出的复合序列的情况下，两个根索引可以被选择为彼此共轭，诸如例如u1＝-u2。
图1提供了根据本发明的用两个或更多个偶数长度ZC序列合成或者以其它方式形成复合序列的各种方式的示例100。参照图1，可以通过交织时分复用(TDM)、连续TDM、非连续TDM、连续频分复用(FDM)、交织FDM来合成两个或更多个偶数长度ZC序列。值得注意的是，图1仅仅作为例示性示例被提供，并不限制关于可以如何合成两个或更多个偶数长度ZC序列以形成复合序列的方式。例如，可以通过码分复用(CDM)来合成两个或更多个偶数长度ZC序列，以形成复合序列。
图2提供了根据本发明的使用交织TDM将两个偶数长度ZC序列(表示为“序列1”和“序列2”)合成为复合序列的示例场景200。
在根据本发明的第三实施方式中，在关于接收/接收器(Receiving/Receiver，RX)的低复杂度检测的背景下，序列的检测可以涉及二维相关器，如下面的等式7所表达。
在等式7中，[τ,v]是时间-频率偏移假设。ν的范围取决于频率栅格(所传输的序列的潜在中心频率)以及传输序列的通信装置的振荡器的精确度。
在第三实施方式中，在RX侧，可以按两个阶段来分解接收到的信号：(1)将接收到的信号进行相位展开(phase-unwrapping)，以及(2)执行逐个样本滑动DFT。
相位展开后的接收到的信号可以在下面被表达为等式8。
为了找到最大值(max)k＝k0的逐个样本滑动DFT可以在下面被表达为等式9。
检测到的时间-频率偏移可以在下面被表达为等式10。
v0＝k0+μτ0 (10)
图3例示了根据本发明的用于低复杂度检测的方法的示例场景300。参照图3，通过单个DFT来联合搜索τ和ν。对于所有的时间-频率假设，使用滑动DFT，每个样本要进行N次乘法，而不是N2次。
图4例示了根据本发明的第三实施方式的用于低复杂度检测的方法的示例逻辑流程400。逻辑流程400可以表示关于按两个阶段分解接收到的信号来实现所提出的构思和方案的方面。逻辑流程400可以包括如由框410、420、430和440中的一个或更多个例示的一个或更多个操作、动作或功能。虽然被例示为分立框，但是根据所期望的实现方式，逻辑流程400的各个框可以被划分成附加框、组合成更少的框或者被消除。此外，逻辑流程400的框可以按照图4中示出的顺序执行，或者另选地按照不同的顺序执行。逻辑流程400的框可以被迭代地执行。逻辑流程400可以从框410开始。
在410中，逻辑流程400可以涉及接收器将接收到的信号进行相位展开，以提供相位展开后的信号。逻辑流程400可以从410行进到420。
在420中，逻辑流程400可以涉及接收器对相位展开后的信号执行逐个样本滑动DFT。逻辑流程400可以从420行进到430。
在430中，逻辑流程400可以涉及接收器基于逐个样本DFT的结果来标识或以其它方式找到τ＝τ0,k＝k0处的最大相关输出。逻辑流程400可以从430行进到440。
在440中，逻辑流程400可以涉及接收器使用最大相关输出来检测或以其它方式确定时间-频率偏移(τ0,k0+μτ0)。
在根据本发明的第四实施方式中，在关于RX的低复杂度检测的背景下，可以按三个阶段分解接收到的信号，即：(1)将接收到的信号进行相位展开，(2)执行部分交叠逐个样本滑动DFT(Partially Overlapped Sample-By-Sample Sliding DFT，POSD)，以检测窗口内的信号的存在，以及(3)使用如上所述的逐个样本滑动DFT来执行局部细化。
相位展开后的接收到的信号可以在下面被表达为等式11。
用于检测窗口内的信号的存在的POSD可以在下面被表达为等式12，在总和中减去τ。
图5例示了根据本发明的用于低复杂度检测的另一种方法的示例场景500。参照图5，该方法涉及对于每N个样本的相位展开的长度2N的DFT而言每个样本进行一次乘法以及对于所有时间-频率假设而言每个样本进行2Nlog2(2N)/N+1＝2log2N+1次乘法。
在所提出的方案下，窗口大小和交叠区间可以不同。图6例示了根据本发明的用于低复杂度检测的另一种方法的示例场景600。参照图6，该方法涉及对于每N个样本的相位展开的长度2N的DFT而言每个样本进行一次乘法以及对于所有时间-频率假设而言每个样本进行Nlog2N/(N/2)+1＝2log2N+1次乘法。
图7例示了根据本发明的第三实施方式的用于低复杂度检测的方法的示例逻辑流程700。逻辑流程700可以表示关于按两个阶段分解接收到的信号来实现所提出的构思和方案的方面。逻辑流程700可以包括如由框710、720、730和740中的一个或更多个例示的一个或更多个操作、动作或功能。虽然被例示为分立框，但是根据所期望的实现方式，逻辑流程700的各个框可以被划分成附加框、组合成更少的框或者被消除。此外，逻辑流程700的框可以按照图7中示出的顺序执行，或者另选地按照不同的顺序执行。逻辑流程700的框可以被迭代地执行。逻辑流程700可以从框710开始。
在710中，逻辑流程700可以涉及接收器将接收到的信号进行相位展开，以提供相位展开后的信号。逻辑流程700可以从710行进到720。
在720中，逻辑流程700可以涉及接收器对相位展开后的信号执行部分交叠滑动DFT。逻辑流程700可以从720行进到730。
在730中，逻辑流程700可以涉及接收器基于部分交叠滑动DFT的结果来检测或以其它方式标识包含偶数长度ZC序列的窗口(例如，时间窗口)。逻辑流程700可以从730行进到740。
在740中，逻辑流程700可以涉及接收器在检测到的窗口中执行逐个样本滑动DFT，以标识、检测或以其它方式确定精确的时间-频率偏移。
在根据本发明的第五实施方式中，在关于RX的过采样后的接收到的信号的背景下，可以在频域中或时域中执行过采样。关于频域中的过采样，第五实施方式可以涉及执行如图8中所示的零填充滑动DFT，图8例示了根据本发明的对接收到的信号进行过采样的方法的示例场景800。
关于时域中的过采样，在给定M倍的过采样后的接收到的信号r↑[n]的情况下，对M个流的串并行处理可以在下面被表达为等式13。
rm[n]＝r↑[Mn+m],for m＝0,…,M-1 (13)
在第五实施方式中，每个流都可以经历两阶段的流水线(相位展开和逐个样本滑动DFT)或三阶段的流水线(相位展开、部分交叠逐个样本滑动DFT和使用逐个样本滑动DFT进行的局部细化)。多个流的输出可以被相干地或非相干地组合，以实现更好的性能。
在根据本发明的第六实施方式中，在关于RX的复合序列的背景下，可以发送具有不同根索引u1和u2的两个序列，并且两个相关器可以并行地运行，各自对应于两个不同根索引中的相应一个。可以使用TDM、FDM、CDM或者TDM、FDM和CDM的任何组合来发送具有不同根索引的两个序列。可以标识每个相关器在滑动DFT的输出处的具有最高幅值的频率窗口。然后，可以求解线性方程，以找到时间-频率偏移。图9示出了根据本发明的关于复合序列的两个序列u1和u2的示例表900。图10例示了根据本发明的复合序列的示例场景1000。
图11例示了根据本发明的第六实施方式的用于低复杂度检测的方法的示例逻辑流程1100。也就是说，当接收到复合序列，并且该复合序列由具有两个不同根索引的两个偶数长度ZC序列组成时，可以利用逻辑流程1100。逻辑流程1100可以表示关于按两个阶段分解接收到的信号来实现所提出的构思和方案的方面。逻辑流程1100可以包括如由框1110、1120、1130、1140、1150、1160、1170、1180和1190中的一个或更多个例示的一个或更多个操作、动作或功能。如图11中所示，框1110～1140与第一相关器(表示为“相关器1”)有关，而框1150～1180与第二相关器(表示为“相关器2”)有关。虽然被例示为分立框，但是根据所期望的实现方式，逻辑流程1100的各个框可以被划分成附加框、组合成更少的框或者被消除。此外，逻辑流程1100的框可以按照图11中示出的顺序执行，或者另选地按照不同的顺序执行。逻辑流程1100的框可以被迭代地执行。逻辑流程1100可以从框1110(针对相关器1)和/或框1150(针对相关器2)开始。
在1110中，逻辑流程1100可以涉及接收器将接收到的信号进行相位展开，以提供第一相位展开后的信号。逻辑流程1100可以从1110行进到1120。
在1120中，逻辑流程1100可以涉及接收器对第一相位展开后的信号执行部分交叠滑动DFT。逻辑流程1100可以从1120行进到1130。
在1130中，逻辑流程1100可以涉及接收器检测或以其它方式标识包含第一偶数长度ZC序列的第一窗口(例如，时间窗口)。逻辑流程1100可以从1130行进到1140。
在1140中，逻辑流程1100可以涉及接收器针对第一偶数长度ZC序列检测、确定、标识或以其它方式找到最大DFT输出的第一索引k1。逻辑流程1100可以从1140行进到1190。
在1150中，逻辑流程1100可以涉及接收器将接收到的信号进行相位展开，以提供第二相位展开后的信号。逻辑流程1100可以从1150行进到1160。
在1160中，逻辑流程1100可以涉及接收器对第二相位展开后的信号执行部分交叠滑动DFT。逻辑流程1100可以从1160行进到1170。
在1170中，逻辑流程1100可以涉及接收器检测或以其它方式标识包含第二偶数长度ZC序列的第二窗口(例如，时间窗口)。逻辑流程1100可以从1170行进到1180。
在1180中，逻辑流程1100可以涉及接收器针对第二偶数长度ZC序列检测、确定、标识或以其它方式找到最大DFT输出的第二索引k2。逻辑流程1100可以从1180行进到1190。
在1190中，逻辑流程1100可以涉及接收器通过对k1、k2、μ1和μ2的线性方程14进行求解来确定、标识或以其它方式找到时间-频率偏移
鉴于以上，据信，本领域的普通技术人员将领会，偶数长度ZC序列保留了奇数长度ZC序列的CAZAC性质。此外，偶数长度ZC序列有助于使用FFT在时域和频域之间进行序列的低复杂度转换。可以用低复杂度检测器来检测时域序列。检测器的复杂度没有随着TX装置和RX装置之间可能的频率偏移而增加。另外，在所提出的方案下，可允许任意的栅格位置，由此使得能够进行无栅格设计。此外，所提出的方案使得能够放宽对振荡器精确度的要求。
例示性实现方式
图12例示了根据本发明的实现方式的示例无线通信系统1200，无线通信系统1200至少包括示例通信设备1202和示例网络设备1204。通信设备1202和网络设备1204中的每一个可以执行各种功能，以实现本文中描述的与使用用于无线通信中的同步和装置标识的偶数长度序列有关的方案、技术、进程和方法，包括以上关于图1～图11描述的那些以及以下描述的进程1300和1400。
通信设备1202可以是电子设备的一部分，其可以是诸如便携式或移动设备、可穿戴设备、无线通信设备或计算设备这样的用户设备(User Equipment，UE)。例如，通信设备1202可以在智能手机、智能手表、个人数字助理、数码相机或者诸如平板计算机、膝上型计算机或笔记本计算机这样的计算设备中实施。通信设备1202可以是机械型设备的一部分，其可以是诸如不动或固定设备、家庭设备、有线通信设备或计算设备这样的IoT或NB-IoT设备。例如，通信设备1202可以在智能恒温器、智能冰箱、智能门锁、无线扬声器或家庭控制中心中实施。另选地，通信设备1202可以按诸如例如但是不限于一个或更多个单核处理器、一个或更多个多核处理器或者一个或更多个复杂指令集计算(Complex-Instruction-Set-Computing，CISC)处理器这样的一个或更多个集成电路(Integrated-Circuit，IC)芯片的形式来实施。例如，通信设备1202可以包括诸如处理器1210这样的图12中示出的那些组件中的至少一些。通信设备1202还可以包括与本发明提出的方案不相关的一个或更多个其它组件(例如，内部电源、显示装置和/或用户界面装置)，因此为了简单和简洁，通信设备1202的这些组件既没有在图12中示出，也没有在以下描述。
网络设备1204可以是电子设备的一部分，其可以是诸如基站、小小区、路由器或网关这样的网络节点。例如，网络设备1204可以在LTE、高级LTE或高级专业LTE网络中的eNodeB中实施或者在5G、NR、IoT或NB-IoT网络中的gNB中实施。另选地，网络设备1204可以按照诸如例如但是不限于一个或更多个单核处理器、一个或更多个多核处理器或者一个或更多个CISC处理器这样的一个或更多个IC芯片的形式来实施。例如，网络设备1204可以包括诸如处理器1240这样的图12中示出的那些组件中的至少一些。网络设备1204还可以包括与本发明提出的方案不相关的一个或更多个其它组件(例如，内部电源、显示装置和/或用户界面装置)，因此为了简单和简洁，通信设备1204的这些组件既没有在图12中示出，也没有在以下描述。
在一个方面，处理器1210和处理器1240中的每一个可以按照一个或更多个单核处理器、一个或更多个多核处理器或者一个或更多个CISC处理器的形式来实施。也就是说，即使在本文中使用单数术语“处理器”来表示处理器1210和处理器1240，根据本发明，处理器1210和处理器1240中的每一个也可以在一些实现方式中包括多个处理器，而在其它实现方式中包括单个处理器。在另一个方面，处理器1210和处理器1240中的每一个可以按照具有电子组件的硬件(并且可选地，固件)的形式来实施，这些电子组件包括(例如但是不限于)被配置并布置成实现根据本发明的特定目的的一个或更多个晶体管、一个或更多个二极管、一个或更多个电容器、一个或更多个电阻器、一个或更多个电感器、一个或更多个忆阻器和/或一个或更多个变容器。换句话说，在至少一些实现方式中，处理器1210和处理器1240中的每一个被专门设计、布置和配置成执行特定任务的专用机器，所述特定任务包括根据本发明的各种实现方式使用用于无线通信中的同步和装置标识的偶数长度序列。在一些实现方式中，处理器1210可以包括检测器1212，检测器1212可以包括第一相关器1214(表示为“相关器1”)和第二相关器1216(表示为“相关器2”)。在一些实现方式中，处理器1240可以包括检测器1242，检测器1242可以包括第一相关器1244(表示为“相关器1”)和第二相关器1246(表示为“相关器2”)。
在一些实现方式中，通信设备1202还可以包括收发器1230，收发器1230与处理器1210耦接并且能够无线地发送和接收数据。具体地，收发器1230可以包括分别能够进行无线发送和无线接收的发送器1232和接收器1234。在一些实现方式中，通信设备1202还可以包括存储器1220，存储器1220与处理器1210耦接并且能够被处理器1210访问并将数据存储在其中。在一些实现方式中，网络设备1204还可以包括收发器1260，收发器1260与处理器1240耦接并且能够无线地发送和接收数据。具体地，收发器1260可以包括分别能够进行无线发送和无线接收的发送器1262和接收器1264。在一些实现方式中，网络设备1204还可以包括存储器1250，存储器1250与处理器1240耦接并且能够被处理器1240访问并将数据存储在其中。因此，通信设备1202和网络设备1204可以分别经由收发器1230和收发器1260彼此无线地通信。为了有助于更好地理解，以下对通信设备1202和网络设备1204中的每一个的操作、功能和能力的描述是在移动通信环境的背景下提供的，在该移动通信环境中，通信设备1202在通信设备或UE中实现或者被实现为通信设备或UE，并且网络设备1204在通信网络的网络节点中实现或者被实现为通信网络的网络节点。
在一些实现方式中，通信设备1202的处理器1210可以生成至少包括偶数长度ZC序列的信号，并且处理器1210可以经由收发器1230的发送器1232将该信号发送到接收装置(例如，网络设备1204的收发器1260的接收器1264)。偶数长度ZC序列可以标识通信设备1202，承载用于发讯的信息或者用于时间-频率同步。
在一些实现方式中，偶数长度ZC序列的长度可以是2的幂。
在一些实现方式中，在生成包括偶数长度ZC序列的信号时，处理器1210可以在时域中生成偶数长度ZC序列。另选地，在生成包括偶数长度ZC序列的信号时，处理器1210可以在频域中生成偶数长度ZC序列。
在一些实现方式中，偶数长度ZC序列可以用于装置标识和发讯中的任一者或二者。在这些情况下，在发送信号时，处理器1210可以经由收发器1230的发送器1232发送偶数长度ZC序列，该偶数长度ZC序列具有由以下项中的任一个所承载的装置标识和发讯中的任一者或二者的信息：(1)偶数长度ZC序列的循环或非循环时间-频率偏移和(2)偶数长度ZC序列的根索引。
在一些实现方式中，在生成信号时，处理器1210可以通过将两个或更多个偶数长度ZC序列合成为复合序列来生成信号。此外，在将两个或更多个偶数长度ZC序列合成为复合序列时，处理器1210可以使用以下方式来合成两个或更多个偶数长度ZC序列：(1)连续或非连续FDM或交织FDM；(2)连续或非连续TDM或交织TDM；(3)CDM或者(4)FDM、TDM和CDM中的一些或全部的组合(例如，FDM加TDM、FDM加CDM、TDM加CDM或者FDM加TDM加CDM)。
在一些实现方式中，两个或更多个偶数长度ZC序列可以具有相同的长度。另选地，两个或更多个偶数长度ZC序列可以具有不同的长度。
在一些实现方式中，两个或更多个偶数长度ZC序列可以具有相同的根索引。另选地，两个或更多个偶数长度ZC序列可以具有不同的根索引。
在一些实现方式中，两个或更多个偶数长度ZC序列可以包括具有两个不同的根索引的两个偶数长度ZC序列，并且这两个不同的根索引可以是彼此共轭的。
在一些实现方式中，处理器1210可以经由收发器1230的接收器1234(例如，从网络设备1204)接收至少包括偶数长度ZC序列的信号，并且处理器1210可以检测接收到的信号中的偶数长度ZC序列。偶数长度ZC序列可以标识设备，承载用于发讯的信息或者用于时间-频率同步。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，处理器1210的检测器1212可以执行多个操作。例如，检测器1212可以将接收到的信号进行相位展开，以提供相位展开后的信号。另外，检测器1212可以对相位展开后的信号执行逐个样本滑动DFT。此外，检测器1212可以基于逐个样本DFT的结果来标识最大相关输出。此外，检测器1212可以使用最大相关输出来确定时间-频率偏移。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，处理器1210的检测器1212可以执行多个操作。例如，检测器1212可以将接收到的信号进行相位展开，以提供相位展开后的信号。另外，检测器1212可以对相位展开后的信号执行部分交叠滑动DFT。此外，检测器1212可以基于部分交叠滑动DFT的结果来检测包含偶数长度ZC序列的窗口。此外，检测器1212可以在检测到的窗口中执行逐个样本滑动DFT，以确定时间-频率偏移。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，检测器1212可以在频域中对接收到的信号进行过采样，使得偶数长度ZC序列的检测分辨率增加。在一些实现方式中，在频域中对接收到的信号进行过采样时，检测器1212可以对接收到的信号执行零填充滑动DFT。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，检测器1212可以在时域中对接收到的信号进行过采样，使得频域中的偶数长度ZC序列的检测范围增加。在一些实现方式中，在时域中对接收到的信号进行过采样时，检测器1212可以执行将M倍的接收到的信号串并行处理成M个处理流，其中，M是大于1的正整数。此外，检测器1212可以相干地或非相干地组合M个流的输出。
在一些实现方式中，M个处理流中的每一个可以包括执行包括以下的操作的两级流水线：(1)将接收到的信号进行相位展开，以提供相位展开后的信号；以及(2)对相位展开后的信号执行逐个样本滑动DFT。另选地，M个处理流中的每一个可以包括执行包括以下的操作的三级流水线：(1)将接收到的信号进行相位展开，以提供相位展开后的信号；(2)对相位展开后的信号执行部分交叠滑动DFT，以检测包含偶数长度ZC序列的窗口；以及(3)在检测到的窗口中执行逐个样本滑动DFT。
在一些实现方式中，信号可以包括由具有彼此不同的第一根索引和第二根索引的第一偶数长度ZC序列和第二偶数长度ZC序列组成的复合序列。在这些情况下，在检测接收到的信号中的偶数长度ZC序列时，检测器1212可以并行地执行第一相关器处理(例如，使用第一相关器1214)和第二相关器处理(例如，使用第二相关器1216)，然后基于第一相关器处理的结果和第二相关器处理的结果来确定时间-频率偏移。例如，在执行第一相关器处理中，第一相关器1214可以执行包括以下的多个操作：(1)将接收到的信号进行相位展开，以提供第一相位展开后的信号；(2)对第一相位展开后的信号执行部分交叠滑动DFT；(3)基于对第一相位展开后的信号进行的部分交叠滑动DFT的结果来检测包含第一偶数长度ZC序列的第一窗口；以及(4)检测第一最大DFT输出的第一索引。类似地，在执行第二相关器处理时，第二相关器1216可以执行包括以下的多个操作：(1)将接收到的信号进行相位展开，以提供第二相位展开后的信号；(2)对第二相位展开后的信号执行部分交叠滑动DFT；(3)基于对第二相位展开后的信号进行的部分交叠滑动DFT的结果来检测包含第二偶数长度ZC序列的第二窗口；以及(4)检测第二最大DFT输出的第二索引。此外，检测器1212可以通过对第一最大DFT输出的第一索引、第二最大DFT输出的第二索引、第一偶数长度ZC序列的根索引和及第二偶数长度ZC序列的根索引的线性方程进行求解来确定时间-频率偏移。
值得注意的是，以上关于处理器1210(以及通常的通信设备1202)的能力的描述适用于处理器1240(以及通常的网络设备1204)，反之亦然。也就是说，处理器1240可以执行如上所述的处理器1210的操作、功能和动作，并且网络设备1204可以执行如上所述的通信设备1202的操作、功能和动作。同样地，处理器1210可以执行如上所述的处理器1240的操作、功能和动作，并且网络设备1202可以执行如上所述的网络设备1204的操作、功能和动作。
例示性处理
图13例示了根据本发明的实现方式的示例进程1300。进程1300可以表示实现诸如以上关于图1至图11描述的各种方案、构思、实施方式和示例中的一个或更多个这样的所提出的构思和方案的一方面。更具体地，进程1300可以表示与使用偶数长度序列在无线通信中进行同步和装置标识有关的所提出的构思和方案的一方面。例如，进程1300可以是以上从TX的角度描述的用于使用偶数长度序列在无线通信中进行同步和装置标识的所提出的方案、构思和示例的示例实现方式(部分地或完全地)。进程1300可以包括如由框1310和1320中的一个或更多个所例示的一个或更多个操作、动作或功能。虽然被例示为分立框，但是根据所期望的实现方式，进程1300的各个框可以被划分成附加框，组合成更少的框或者被消除。进程1300还可以包括图13中未示出的附加操作和/或动作。此外，进程1300的框可以按照图13中示出的顺序执行，或者另选地按照不同的顺序执行。进程1300的框可以被迭代地执行。进程1300可以由设备1202和设备1204以及其任何变型来实施或者在设备1202和设备1204以及其任何变型中实施。仅出于例示目的并且不限制范围地，下面参照设备1202来描述进程1300。进程1300可以从框1310开始。
在1310中，进程1300可以涉及设备1202的处理器1210生成至少包括偶数长度ZC序列的信号。偶数长度ZC序列可以标识设备1202，承载用于发讯的信息或者用于时间-频率同步。进程1300可以从1310行进到1320。
在1320中，进程1300可涉及处理器1210经由设备1202的收发器1230的发送器1232将信号发送到接收装置(例如，设备1204的收发器1260的接收器1264)。
在一些实现方式中，偶数长度ZC序列的长度可以是2的幂。
在一些实现方式中，在生成包括偶数长度ZC序列的信号时，处理器1300可以涉及处理器1210在时域中生成偶数长度ZC序列。另选地，在生成包括偶数长度ZC序列的信号时，处理器1300可以涉及处理器1210在频域中生成偶数长度ZC序列。
在一些实现方式中，偶数长度ZC序列可以被用于装置标识和发讯中的任一者或二者。在这些情况下，在传输信号时，进程1300可以涉及处理器1210经由发送器1232发送偶数长度ZC序列，该偶数长度ZC序列具有由以下项中的任一个所承载的装置标识和发讯中的任一者或二者的信息：(1)偶数长度ZC序列的循环或非循环时间-频率偏移和(2)偶数长度ZC序列的根索引。
在一些实现方式中，在生成信号时，进程1300可以涉及处理器1210通过将两个或更多个偶数长度ZC序列合成为复合序列来生成信号。
在一些实现方式中，在将两个或更多个偶数长度ZC序列合成为复合序列时，进程1300可以涉及处理器1210使用以下方式来合成两个或更多个偶数长度ZC序列：(1)连续或非连续FDM或交织FDM；(2)连续或非连续TDM或交织TDM；(3)CDM或者(4)FDM、TDM和CDM中的一些或全部的组合(例如，FDM加TDM、FDM加CDM、TDM加CDM或者FDM加TDM加CDM)。
在一些实现方式中，两个或更多个偶数长度ZC序列可以具有相同的长度。另选地，两个或更多个偶数长度ZC序列可以具有不同的长度。
在一些实现方式中，两个或更多个偶数长度ZC序列可以具有相同的根索引。另选地，两个或更多个偶数长度ZC序列可以具有不同的根索引。
在一些实现方式中，两个或更多个偶数长度ZC序列可以包括具有两个不同的根索引的两个偶数长度ZC序列，并且这两个不同的根索引可以是彼此共轭的。
图14例示了根据本发明的实现方式的示例进程1400。进程1400可以表示实现诸如以上关于图1至图11描述的各种方案、构思、实施方式和示例中的一个或更多个这样的所提出的构思和方案的一方面。更具体地，进程1400可以表示与使用偶数长度序列在无线通信中进行同步和装置标识有关的所提出的构思和方案的一方面。例如，进程1400可以是以上从RX的角度描述的用于使用偶数长度序列在无线通信中进行同步和装置标识所提出方案、构思和示例的示例实现方式(部分地或完全地)。进程1400可以包括如由框1410和1420中的一个或更多个例示的一个或更多个操作、动作或功能。虽然被例示为分立框，但是根据所期望的实现方式，进程1400的各个框可以被划分成附加框，组合成更少的框或者被消除。进程1400还可以包括图14中未示出的附加操作和/或动作。此外，进程1400的框可以按照图14中示出的顺序执行，或者另选地按照不同的顺序执行。进程1400的框可以被迭代地执行。进程1400可以由设备1202和设备1204以及其任何变型来实施或者在设备1202和设备1204以及其任何变型中实施。仅出于例示目的并且不限制范围地，下面参照设备1202来描述进程1400。进程1400可以从框1410开始。
在1410中，进程1400可以涉及设备1202的处理器1210经由设备1202的收发器1230的接收器1234接收至少包括偶数长度ZC序列(例如，来自设备1204)的信号。偶数长度ZC序列可以标识设备1204，承载用于发讯的信息或者用于时间-频率同步。进程1400可以从1410行进到1420。
在1420中，进程1400可以涉及处理器1210检测接收到的信号中的偶数长度ZC序列。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，进程1400可以涉及处理器1210执行多个操作(例如，以执行如上所述的逻辑流程400)。例如，进程1400可以涉及处理器1210将接收到的信号进行相位展开，以提供相位展开后的信号。另外，进程1400可以涉及处理器1210对相位展开后的信号执行逐个样本滑动DFT。此外，检测1400可以涉及处理器1210基于逐个样本DFT的结果来标识最大相关输出。此外，进程1400可以涉及处理器1210使用最大相关输出来确定时间-频率偏移。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，进程1400可以涉及处理器1210执行多个操作(例如，以执行如上所述的逻辑流程700)。例如，进程1400可以涉及处理器1210将接收到的信号进行相位展开，以提供相位展开后的信号。另外，进程1400可以涉及处理器1210对相位展开后的信号执行部分交叠滑动DFT。此外，进程1400可以基于部分交叠滑动DFT的结果来检测包含偶数长度ZC序列的窗口。此外，进程1400可以涉及处理器1210在检测到的窗口中执行逐个样本滑动DFT，以确定时间-频率偏移。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，进程1400可以涉及处理器1210在频域中对接收到的信号进行过采样，使得偶数长度ZC序列的检测分辨率增加。在一些实现方式中，在频域中对接收到的信号进行过采样时，进程1400可以涉及处理器1210对接收到的信号执行零填充滑动DFT。
在一些实现方式中，在检测接收到的信号中的偶数长度ZC序列时，进程1400可以涉及处理器1210在时域中对接收到的信号进行过采样，使得频域中的偶数长度ZC序列的检测范围增加。在一些实现方式中，在时域中对接收到的信号进行过采样时，进程1400可以涉及处理器1210执行将M倍的接收到的信号串并行处理成M个处理流，其中，M是大于1的正整数。此外，进程1400可以涉及处理器1210相干地或非相干地组合M个流的输出。
在一些实现方式中，M个处理流中的每一个可以包括执行包括以下的多个操作的两级流水线：(1)将接收到的信号进行相位展开，以提供相位展开后的信号；以及(2)对相位展开后的信号执行逐个样本滑动DFT。另选地，M个处理流中的每一个可以包括执行包括以下的多个操作的三级流水线：(1)将接收到的信号进行相位展开，以提供相位展开后的信号；(2)对相位展开后的信号执行部分交叠滑动DFT，以检测包含偶数长度ZC序列的窗口；以及(3)在检测到的窗口中执行逐个样本滑动DFT。
在一些实现方式中，信号可以包括由具有彼此不同的第一根索引和第二根索引的第一偶数长度ZC序列和第二偶数长度ZC序列组成的复合序列。在这些情况下，在检测接收到的信号中的偶数长度ZC序列时，进程1400可以涉及处理器1210并行地执行第一相关器处理和第二相关器处理，并且基于第一相关器处理的结果和第二相关器处理的结果来确定时间-频率偏移(例如，以执行如上所述的逻辑流1100)。在执行第一相关器处理时，进程1400可以涉及处理器1210执行以下操作：(1)将接收到的信号进行相位展开，以提供第一相位展开后的信号；(2)对第一相位展开后的信号执行部分交叠滑动DFT；(3)基于对第一相位展开后的信号进行的部分交叠滑动DFT的结果来检测包含第一偶数长度ZC序列的第一窗口；以及(4)检测第一最大DFT输出的第一索引。在执行第二相关器处理时，进程1400可以涉及处理器1210执行以下操作：(1)将接收到的信号进行相位展开，以提供第二相位展开后的信号；(2)对第二相位展开后的信号执行部分交叠滑动DFT；(3)基于对第二相位展开后的信号进行的部分交叠滑动DFT的结果来检测包含第二偶数长度ZC序列的第二窗口；以及(4)检测第二最大DFT输出的第二索引。
在一些实现方式中，在基于第一相关器处理的结果和第二相关器处理的结果来确定时间-频率偏移时，进程1400可以涉及处理器1210对第一最大DFT输出的第一索引、第二最大DFT输出的第二索引、第一偶数长度ZC序列的根索引和第二偶数长度ZC序列的根索引的线性方程进行求解。
补充说明
本文中所描述的主题有时例示了包含在不同的其它部件之内或与其连接的不同部件。要理解的是，这些所描绘的架构仅是示例，并且实际上能够实施实现相同功能的许多其它架构。在概念意义上，实现相同功能的部件的任意布置被有效地“关联”成使得期望的功能得以实现。因此，独立于架构或中间部件，本文中被组合为实现特定功能的任何两个部件能够被看作彼此“关联”成使得期望的功能得以实现。同样，如此关联的任何两个部件也能够被视为彼此“在操作上连接”或“在操作上耦接”，以实现期望的功能，并且能够如此关联的任意两个部件还能够被视为彼此“在操作上可耦接”，以实现期望的功能。在操作在可耦接的特定示例包括但不限于物理上能配套和/或物理上交互的部件和/或可无线地交互和/或无线地交互的部件和/或逻辑上交互和/或逻辑上可交互的部件。
此外，关于本文中任何复数和/或单数术语的大量使用，本领域技术人员可针对上下文和/或应用按需从复数转化为单数和/或从单数转化为复数。为了清楚起见，本文中可以明确地阐述各种单数/复数互易。
另外，本领域技术人员将理解，通常，本文中所用的术语且尤其是在所附的权利要求(例如，所附的权利要求的主体)中所使用的术语通常意为“开放”术语，例如，术语“包含”应被解释为“包含但不限于”，术语“具有”应被解释为“至少具有”，术语“包括”应解释为“包括但不限于”，等等。本领域技术人员还将理解，如果引入的权利要求列举的特定数目是有意的，则这种意图将在权利要求中明确地列举，并且在这种列举不存在时不存在这种意图。例如，作为理解的帮助，所附的权利要求可以包含引入权利要求列举的引入性短语“至少一个”和“一个或更多个”的使用。然而，这种短语的使用不应该被解释为暗示权利要求列举通过不定冠词“一”或“一个”的引入将包含这种所引入的权利要求列举的任何特定权利要求限制于只包含一个这种列举的实现方式，即使当同一权利要求包括引入性短语“一个或更多”或“至少一个”以及诸如“一”或“一个”这样的不定冠词(例如，“一和/或一个”应被解释为意指“至少一个”或“一个或更多个”)时，这同样适用于用来引入权利要求列举的定冠词的使用。另外，即使明确地列举了特定数量的所引入的权利要求列举，本领域技术人员也将认识到，这种列举应被解释为意指至少所列举的数量(例如，在没有其它的修饰语的情况下，“两个列举”的无遮蔽列举意指至少两个列举或者两个或更多个列举)。此外，在使用类似于“A、B和C中的至少一个等”的惯例的那些情况下，在本领域技术人员将理解这个惯例的意义上，通常意指这种解释(例如，“具有A、B和C中的至少一个的系统”将包括但不限于单独具有A、单独具有B、单独具有C、一同具有A和B、一同具有A和C、一同具有B和C和/或一同具有A、B和C等的系统)。在使用类似于“A、B或C等中的至少一个”的惯例的那些情况下，在本领域技术人员将理解这个惯例的意义上，通常意指这样的解释(例如，“具有A、B或C中至少一个的系统”将包括但不限于单独具有A、单独具有B、单独具有C、一同具有A和B、一同具有A和C、一同具有B和C、和/或一同具有A、B和C等的系统)。本领域技术人员还将理解，无论在说明书、权利要求还是附图中，实际上呈现两个或更多个另选的项的任何转折词语和/或短语应当被理解为构想包括这些项中的一个、这些项中的任一个或者这两项的可能性。例如，短语“A或B”将被理解为包括“A”或“B”或“A和B”的可能性。
根据上述内容，将领会的是，本文中已经为了例示的目的而描述了本发明的各种实现方式，并且可以在不脱离本发明的范围和精神的情况下进行各种修改。因此，本文中所公开的各种实现方式不旨在是限制性的，真正的范围和精神由所附的权利要求指示。

Claims (15)

1.一种方法，包括：
通过设备的处理器，生成至少包括偶数长度Zadoff-Chu(ZC)序列的信号；以及
通过所述处理器将所述信号发送到接收装置，
其中，所述偶数长度Zadoff-Chu序列标识所述设备，承载用于发讯的信息或者用于时间-频率同步。
2.根据权利要求1所述的方法，其中，所述生成包括所述偶数长度Zadoff-Chu序列的所述信号的步骤包括在时域中生成所述偶数长度Zadoff-Chu序列。
3.根据权利要求1所述的方法，其中，所述生成包括所述偶数长度Zadoff-Chu序列的所述信号的步骤包括在频域中生成所述偶数长度Zadoff-Chu序列。
4.根据权利要求1所述的方法，其中，所述偶数长度Zadoff-Chu序列用于装置标识和发讯中的任一者或二者，并且其中，所述发送所述信号的步骤包括：发送具有由以下项中的任一个所承载的装置标识和发讯中的任一者或二者的信息的所述偶数长度Zadoff-Chu序列：
所述偶数长度Zadoff-Chu序列的循环或非循环时间-频率偏移；以及
所述偶数长度Zadoff-Chu序列的根索引。
5.根据权利要求1所述的方法，其中，所述生成所述信号的步骤包括通过将两个或更多个偶数长度Zadoff-Chu序列合成为复合序列来生成所述信号。
6.根据权利要求5所述的方法，其中，所述将所述两个或更多个偶数长度Zadoff-Chu序列合成为所述复合序列的步骤包括使用以下方式来合成所述两个或更多个偶数长度Zadoff-Chu序列：
连续或非连续频分复用(FDM)或者交织FDM；
连续或非连续时分复用(TDM)或者交织TDM；
码分复用(CDM)；或者
FDM、TDM和CDM中的一些或全部的组合。
7.一种方法，包括：
通过设备的处理器，接收至少包括偶数长度Zadoff-Chu(ZC)序列的信号；以及
通过所述处理器检测所接收到的信号中的所述偶数长度Zadoff-Chu序列，
其中，所述偶数长度Zadoff-Chu序列标识所述设备，承载用于发讯的信息或者用于时间-频率同步。
8.根据权利要求7所述的方法，其中，所述检测所接收到的信号中的所述偶数长度Zadoff-Chu序列的步骤包括：
对所接收到的信号进行相位展开，以提供相位展开后的信号；
对所述相位展开后的信号执行逐个样本滑动离散傅里叶变换(DFT)；
基于所述逐个样本离散傅里叶变换的结果来标识最大相关输出；以及
使用所述最大相关输出来确定时间-频率偏移。
9.根据权利要求7所述的方法，其中，所述检测所接收到的信号中的所述偶数长度Zadoff-Chu序列的步骤包括：
对所接收到的信号进行相位展开，以提供相位展开后的信号；
对所述相位展开后的信号执行部分交叠滑动离散傅里叶变换(DFT)；
基于所述部分交叠滑动离散傅里叶变换的结果来检测包含所述偶数长度Zadoff-Chu序列的窗口；并且
在检测到的所述窗口中执行逐个样本滑动离散傅里叶变换，以确定时间-频率偏移。
10.根据权利要求7所述的方法，其中，所述检测所接收到的信号中的所述偶数长度Zadoff-Chu序列的步骤包括在频域中对所接收到的信号进行过采样，使得所述偶数长度Zadoff-Chu序列的检测分辨率增加。
11.根据权利要求7所述的方法，其中，检测所接收到的信号中的所述偶数长度Zadoff-Chu序列的步骤包括在时域中对所接收到的信号进行过采样，使得所述偶数长度Zadoff-Chu序列的检测范围增加。
12.根据权利要求11所述的方法，其中，所述在所述时域中对所接收到的信号进行过采样的步骤包括：
执行将M倍的所接收到的信号串并行处理成M个处理流；以及
相干地或非相干地组合所述M个流的输出，
其中，M是大于1的正整数。
13.根据权利要求12所述的方法，其中，所述M个处理流中的每一个包括执行包括以下操作的两级流水线：
对所接收到的信号进行相位展开，以提供相位展开后的信号；并且
对所述相位展开后的信号执行逐个样本滑动离散傅里叶变换(DFT)。
14.根据权利要求12所述的方法，其中，所述M个处理流中的每一个包括执行包括以下操作的三级流水线：
对所接收到的信号进行相位展开，以提供相位展开后的信号；
对所述相位展开后的信号执行部分交叠滑动离散傅里叶变换(DFT)，以检测包含所述偶数长度Zadoff-Chu序列的窗口；以及
在检测到的所述窗口中执行逐个样本滑动离散傅里叶变换。
15.根据权利要求7所述的方法，其中，所述信号包括由具有彼此不同的第一根索引和第二根索引的第一偶数长度Zadoff-Chu序列和第二偶数长度Zadoff-Chu序列组成的复合序列，其中，所述检测所接收到的信号中的所述偶数长度Zadoff-Chu序列的步骤包括并行地执行第一相关器处理和第二相关器处理，并且基于所述第一相关器处理的结果和所述第二相关器处理的结果来确定时间-频率偏移，并且其中：
所述第一相关器处理包括：
对所接收到的信号进行相位展开，以提供第一相位展开后的信号；
对所述第一相位展开后的信号执行部分交叠滑动离散傅里叶变换(DFT)；
基于对所述第一相位展开后的信号进行所述部分交叠滑动离散傅里叶变换的结果来检测包含所述第一偶数长度Zadoff-Chu序列的第一窗口；以及
检测第一最大离散傅里叶变换输出的第一索引，以及
所述第二相关器处理包括：
对所接收到的信号进行相位展开，以提供第二相位展开后的信号；
对所述第二相位展开后的信号执行部分交叠滑动离散傅里叶变换；
基于对所述第二相位展开后的信号进行所述部分交叠滑动离散傅里叶变换的结果来检测包含所述第二偶数长度Zadoff-Chu序列的第二窗口；以及
检测第二最大离散傅里叶变换输出的第二索引，
所述确定所述时间-频率偏移的步骤包括：
对所述第一最大离散傅里叶变换输出的所述第一索引、所述第二最大离散傅里叶变换输出的所述第二索引、所述第一偶数长度Zadoff-Chu序列的根索引和所述第二偶数长度Zadoff-Chu序列的根索引的线性方程进行求解。
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