CN108614797A - 一种多类型高低速串行总线集成接口 - Google Patents

一种多类型高低速串行总线集成接口 Download PDF

Info

Publication number
CN108614797A
CN108614797A CN201611140240.7A CN201611140240A CN108614797A CN 108614797 A CN108614797 A CN 108614797A CN 201611140240 A CN201611140240 A CN 201611140240A CN 108614797 A CN108614797 A CN 108614797A
Authority
CN
China
Prior art keywords
bus
pci
speed
low
pci express
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201611140240.7A
Other languages
English (en)
Inventor
闫海明
冯源
范祥辉
雷红
王世奎
王红春
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Xian Aeronautics Computing Technique Research Institute of AVIC
Original Assignee
Xian Aeronautics Computing Technique Research Institute of AVIC
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Xian Aeronautics Computing Technique Research Institute of AVIC filed Critical Xian Aeronautics Computing Technique Research Institute of AVIC
Priority to CN201611140240.7A priority Critical patent/CN108614797A/zh
Publication of CN108614797A publication Critical patent/CN108614797A/zh
Pending legal-status Critical Current

Links

Classifications

    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/42—Bus transfer protocol, e.g. handshake; Synchronisation
    • G06F13/4282—Bus transfer protocol, e.g. handshake; Synchronisation on a serial bus, e.g. I2C bus, SPI bus
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/40—Bus structure
    • G06F13/4004—Coupling between buses

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Bus Control (AREA)

Abstract

本发明属于计算机通信技术，公开了一种多类型高低速串行总线集成接口，高速串行总线以IEEE 1394B总线为代表，低速总线以1553B、ARINC429、RS232、离散量等为代表。本发明提出高速串行总线独占一条PCI总线，低速串行总线独占另一条PCI总线，通过独立PCI Express‑PCI桥将PCI总线接口逻辑转换成PCI Express总线接口逻辑，再通过多路交换开关SWITCH把两路PCI Express总线接口合并成一个PCI Express总线接口共享给主机。本发明解决了多类型高低速串行总线共享同一主机接口带宽时高速总线有效带宽与低速总线实时性之间的矛盾。

Description

一种多类型高低速串行总线集成接口
技术领域：
本发明属于计算机通信技术领域，涉及一种多类型高低速串行总线集成接口。
背景技术：
随着机载计算趋向集中，机载系统也由独立式架构向综合化系统架构发展，多类型串行总线集成接口已经成为下一代机载计算机输入输出设备主流技术。以高速1394总线为代表的高速串行总线正加速推广应用，同时传统控制类现场总线(例如1553B、ARINC429、RS232、离散量等)依然存在，形成了多类型高低速串行总线共存的现状。为了追求体积更小、重量更轻、可靠性更高，多类型集成总线接口是必然选择。因此，需要提出一种多类型高低速串行总线集成接口，有效解决多类型高低速串行总线共享同一主机接口带宽时高速总线有效带宽与低速总线实时性之间的矛盾。
发明内容：
提出一种多类型高低速串行总线集成接口，在保证高速串行总线有效带宽的同时，确保了其他多类型低速总线的实时性，解决了高低速混合总线接口高速带宽和低速实时性之间的矛盾。
本发明提供了一种多类型高低速串行总线集成接口，即保证了速串行总线共享主机总线带宽中既保证高速总线有效带宽又兼顾低速总线实时性。
本发明的技术解决方案是，
一种多类型高低速串行总线集成接口，包括多路交换开关SWITCH、PCI Express-PCI桥1、PCI Express-PCI桥2、一个高速总线接口单元和多个低速总线接口单元；其中，
SWITCH的上行端口与主机相连。SWITCH的上行端口和下行端口均符合PCIExpress总线标准；
SWITCH以下部分，高速总线接口和低速总线接口的逻辑通道相互独立，不存在逻辑耦合；
PCI Express-PCI桥1通过PCI Express总线1与SWITCH的下行端口连接，第二PCIExpress-PCI桥通过PCI Express总线2与SWITCH的下行端口连接；
PCI Express-PCI桥1和PCI Express-PCI桥2的上行端口符合PCI Express总线标准，下行端口符合PCI总线标准，且两个PCI Express-PCI桥工作模式为前向透明模式；
高速总线接口单元通过PCI总线A与PCI Express-PCI桥1连接，每个低速总线接口单元均通过PCI总线B与PCI Express-PCI桥2连接；
高速总线接口单元用于挂载高速总线，且与高速总线接口相适配。多个低速总线接口单元分别用于挂载低速总线，且与相应的低速总线接口单元相适配；
高速总线采用Burst传输机制与主机通信，多类型低速总线采用周期查询或中断机制与主机通信。
本发明的优点是：
a)物理上实现了多类型总线接口的集成；
b)逻辑上实现了高速和低速串行总线的统一主机接口；
c)可保证速总线有效带宽，又确保低速总线访问主机的实时性
d)接口逻辑层次清晰，易于实现；
e)体积更小，可靠性更高。
附图说明
图1是本发明的结构示意图。
具体实施方式:
一种多类型高低速串行总线集成接口，包括多路交换开关SWITCH、PCI Express-PCI桥1、PCI Express-PCI桥2、一个高速总线接口单元和多个低速总线接口单元。高速总线接口单元用于挂载高速总线。多个低速总线接口单元分别用于挂载低速总线，低速总线与相应的低速总线接口单元应遵循统一通信标准和电气标准，实现适配挂接。
通过对高低速总线共享同一主机接口应用模式进行分析，针对高速总线大数据块周期传输，低速总线数据量小但收发随机应用场景，创新性地提出将高速和低速总线分离到两条独立PCI总线上。PCI总线A挂接高速总线接口单元，PCI总线B挂接多类型低速总线接口单元。高速总线接口单元的传输控制功能应符合高速总线控制协议规范，低速总线接口单元的传输控制功能应符合相应低速总线控制协议规范。
SWITCH的上行端口与主机相连。SWITCH的上行端口和下行端口均符合PCIExpress总线标准。SWITCH以下部分，高速总线接口和低速总线接口的逻辑通道相互独立，不存在逻辑耦合。
PCI Express-PCI桥1通过PCI Express总线1与SWITCH的下行端口连接，第二PCIExpress-PCI桥通过PCI Express总线2与SWITCH的下行端口连接。两条PCI总线逻辑分别通过PCI Express-PCI桥转换成PCI Express总线逻辑，提供给多路交换开关SWITCH的下行端口，两条PCI Express总线通过多路总线开关SWITCH汇聚到同一主机接口。本发明采用的PCI Express-PCI桥工作中前向桥透明访问模式，可有效支撑主机高速透明访问多类型总线接口资源。
PCI Express-PCI桥1和PCI Express-PCI桥2的上行端口符合PCI Express总线标准，下行端口符合PCI总线标准，且两个PCI Express-PCI桥工作模式为前向透明模式。
高速总线接口单元通过PCI总线A与PCI Express-PCI桥1连接，每个低速总线接口单元均通过PCI总线B与PCI Express-PCI桥2连接。
高速总线采用Burst传输机制与主机通信，多类型低速总线采用周期查询或中断机制与主机通信。
高速和低速总线在PCI总线层的分离，可以保证高速总线的Brust传输不会被低速总线的访问中断，低速总线的主机处理请求也不会因高速总线的连续占用造成“不可容忍”的延时，既保证了高速总线的有效带宽,又确保了低速总线上消息收发的“实时”传输。
高速总线与低速总线传输交叉节点从PCI总线移到PCI Express实现了主机接口的高速访问，同时在PCI总线层的分离实现了高速总线和低速总线的并行传输，提升了整个集成接口的处理效率，解决了多类型高低速串行总线共享同一主机接口带宽时高速总线有效带宽与低速总线实时性之间的矛盾。
由于集成多类型总线于同一接口，使得该接口体积更小，可靠性更高。

Claims (1)

1.一种多类型高低速串行总线集成接口，其特征是，包括多路交换开关SWITCH、PCIExpress-PCI桥1、PCI Express-PCI桥2、一个高速总线接口单元和多个低速总线接口单元；其中，
SWITCH的上行端口与主机相连；SWITCH的上行端口和下行端口均符合PCI Express总线标准；
SWITCH以下部分，高速总线接口和低速总线接口的逻辑通道相互独立，不存在逻辑耦合；
PCI Express-PCI桥1通过PCI Express总线1与SWITCH的下行端口连接，第二PCIExpress-PCI桥通过PCI Express总线2与SWITCH的下行端口连接；
PCI Express-PCI桥1和PCI Express-PCI桥2的上行端口符合PCI Express总线标准，下行端口符合PCI总线标准，且两个PCI Express-PCI桥工作模式为前向透明模式；
高速总线接口单元通过PCI总线A与PCI Express-PCI桥1连接，每个低速总线接口单元均通过PCI总线B与PCI Express-PCI桥2连接；
高速总线接口单元用于挂载高速总线，且与高速总线接口相适配；多个低速总线接口单元分别用于挂载低速总线，且与相应的低速总线接口单元相适配；
高速总线采用Burst传输机制与主机通信，多类型低速总线采用周期查询或中断机制与主机通信。
CN201611140240.7A 2016-12-12 2016-12-12 一种多类型高低速串行总线集成接口 Pending CN108614797A (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201611140240.7A CN108614797A (zh) 2016-12-12 2016-12-12 一种多类型高低速串行总线集成接口

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201611140240.7A CN108614797A (zh) 2016-12-12 2016-12-12 一种多类型高低速串行总线集成接口

Publications (1)

Publication Number Publication Date
CN108614797A true CN108614797A (zh) 2018-10-02

Family

ID=63657288

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201611140240.7A Pending CN108614797A (zh) 2016-12-12 2016-12-12 一种多类型高低速串行总线集成接口

Country Status (1)

Country Link
CN (1) CN108614797A (zh)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109445855A (zh) * 2018-10-30 2019-03-08 天津津航计算技术研究所 一种用于多路低速外设集成的桥接装置
CN112087359A (zh) * 2020-09-28 2020-12-15 北京东土科技股份有限公司 一种串行通信系统
CN112597088A (zh) * 2020-12-25 2021-04-02 航天科工微电子系统研究院有限公司 一种双总线高速图像处理系统及方法
CN113609044A (zh) * 2021-06-25 2021-11-05 天津津航计算技术研究所 一种双pcie接口的多路接口转接卡实现系统

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1507225A (zh) * 2002-12-12 2004-06-23 华为技术有限公司 一种实现通信设备高速端口的装置
CN101686132A (zh) * 2008-09-23 2010-03-31 宏正自动科技股份有限公司 通用串行总线矩阵切换系统
CN104216844A (zh) * 2014-09-01 2014-12-17 山东超越数控电子有限公司 一种cpci/cpci-e混合总线互联的实现方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1507225A (zh) * 2002-12-12 2004-06-23 华为技术有限公司 一种实现通信设备高速端口的装置
CN101686132A (zh) * 2008-09-23 2010-03-31 宏正自动科技股份有限公司 通用串行总线矩阵切换系统
CN104216844A (zh) * 2014-09-01 2014-12-17 山东超越数控电子有限公司 一种cpci/cpci-e混合总线互联的实现方法

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109445855A (zh) * 2018-10-30 2019-03-08 天津津航计算技术研究所 一种用于多路低速外设集成的桥接装置
CN112087359A (zh) * 2020-09-28 2020-12-15 北京东土科技股份有限公司 一种串行通信系统
CN112087359B (zh) * 2020-09-28 2022-03-18 北京东土科技股份有限公司 一种串行通信系统
CN112597088A (zh) * 2020-12-25 2021-04-02 航天科工微电子系统研究院有限公司 一种双总线高速图像处理系统及方法
CN112597088B (zh) * 2020-12-25 2022-07-22 航天科工微电子系统研究院有限公司 一种双总线高速图像处理系统及方法
CN113609044A (zh) * 2021-06-25 2021-11-05 天津津航计算技术研究所 一种双pcie接口的多路接口转接卡实现系统

Similar Documents

Publication Publication Date Title
CN108614797A (zh) 一种多类型高低速串行总线集成接口
WO2016206198A1 (zh) 存储系统
CN202535384U (zh) 基于PCIe总线的网络设备扩展连接和虚拟机互连优化系统
CN101304322B (zh) 一种网络设备和报文转发方法
US20170374139A1 (en) Cloud server system
WO2014032233A1 (zh) 虚拟机热迁移的系统和方法
WO2014209347A1 (en) Mechanism to control resource utilization with adaptive routing
CN102263698B (zh) 虚拟通道的建立方法、数据传输的方法及线卡
US20210311800A1 (en) Connecting accelerator resources using a switch
WO2014201623A1 (zh) 用于数据传输的方法、装置和系统以及物理网卡
CN103840993A (zh) 一种双冗余can总线数据发送方法
KR20120040535A (ko) 버스 시스템 및 그것의 동작 방법
CN111177065A (zh) 一种多芯片互联方法和装置
CN103136163B (zh) 可配置实现fc-ae-asm和fc-av协议的协议处理器芯片
CN116185641B (zh) 融合架构系统、非易失性存储系统及存储资源获取方法
CN113691397A (zh) 工业控制数据传输用低延时5g无线透明传输方法
US9203895B1 (en) System and method for lateral connection between interface devices with bypass of external network
CN104598403A (zh) 一种基于pcie交换器的集群存储系统
CN104125292A (zh) 一种数据处理装置、云服务器及其使用方法
CN104714832A (zh) 一种用于机载数据网络异步数据交互区的缓冲管理方法
CN103036815B (zh) 一种信息技术和通信技术ict融合系统
CN107102961A (zh) 加速arm处理器并行工作的方法及系统
CN103810142B (zh) 可重构系统及其构建方法
CN112380038A (zh) 基于共享物理通道的通讯设备控制面和数据面分离方法
CN103164370B (zh) 一种高速局部总线访问控制接口模块

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
RJ01 Rejection of invention patent application after publication
RJ01 Rejection of invention patent application after publication

Application publication date: 20181002