CN108428433B - 一种oled驱动电路 - Google Patents

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Abstract

本发明公开了一种OLED驱动电路，包括N个多路复用控制模和N组数据信号输出通道；每组数据信号输出通道通过一个多路复用控制模块至少与依次竖直排列的第一至第六条数据线电性连接；每个多路复用控制模块，包括均接入同一组数据信号输出通道的第一分路开关元件、第二分路开关元件，以及分别与第一至第六条数据线电性连接的第一至第六支路开关元件；第一至第三支路开关元件并联接入第一分路开关元件；第四至第六支路开关元件并联接入第二分路开关元件；栅极驱动信号扫描子像素阵列的奇数行、偶数行时，第一分路开关元件和第二分路开关元件交替导通的先后顺序不同，使得各个像素的显示亮度呈不规则分布，进而达到弱化条纹的目的。

Description

一种OLED驱动电路
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种OLED驱动电路。
背景技术
针对小尺寸AMOLED(Active-matrix organic light emitting diode，有源矩阵有机发光二极体)产品，通常源极驱动Source Driver，一般采用多路传输的方式，为了减少驱动芯片外围的线路的数量，在显示面板上需要增加开关阵列，将Driver IC输出的Sourcechannel信号分割成不同等分，每一等分由一个开关控制数据写入，写入对应的Pixel阵列显示内容，以减小IC的面积，从而节省成本。
例如，如图1所示的显示面板，包括源极驱动器和显示像素阵列，每6列子像素(R00，G00，B00，R01，G01，B01)为一组像素，第一组像素接收第一个数据驱动信号S1，第二组像素接收第二个数据驱动信号S2，第三组像素接收第三个数据驱动信号S3，一组像素的驱动时序参见图2。这6列子像素点亮的先后顺序依次是(R00，R01，G00，G01，B00，B01)，对于子像素R00和子像素R01，充电起点不同，子像素R00先开始充电，子像素R01后开始充电，源极驱动器向S1提供Data电压的时间有限，因此，在同一图框时间内，保持在子像素R00和子像素R01内的Data电压会有差异，以图2为例，S1对子像素R00充电足够，S1对子像素R01充电不足，使得保持在子像素R00内的Data电压接近目标电压，保持在子像素R01内的Data电压无法达到目标电压，因此显示面板呈现出的显示效果是子像素R00显示较亮的红色图像，子像素R01显示较暗的红色图像。同理，在一组像素中，G00显示较亮的绿色图像，G01显示较暗的绿色图像，B00显示较亮的蓝色图像，B01显示较暗的蓝色图像。对于整个显示装置来说，显示的图像就是明暗相间的图像，因此，上述源极驱动方式使得相邻像素(一列像素包括三列子像素，三列子像素分别与R，G，B对应)间存在明显的明暗相间的垂直条纹，给观察者的直观感受是条纹感较强，有画面粗糙现象。
综上，现有技术中存在着显示面板部分像素充电充足，部分像素充电不足，导致显示面板存在较明显的明暗相间的垂直条纹的问题。
发明内容
本发明提供一种OLED驱动电路，用以解决现有技术中存在的显示面板部分像素充电不足，导致显示面板存在较明显的明暗相间的垂直条纹的问题。
本发明实施例提供一种OLED驱动电路，包括多行多列呈阵列式排布的子像素，所述子像素所在列对应的数据线，所述子像素所在行对应的栅极线，包括：
源极驱动器，栅极驱动器，和N个多路复用控制模块；
所述源极驱动器包括N组数据信号输出通道；每组所述数据信号输出通道通过一个所述多路复用控制模块至少与依次竖直排列的至少第一至第六条数据线电性连接；
每个所述多路复用控制模块，包括第一分路开关元件、第二分路开关元件，以及第一至第六支路开关元件；所述第一至所述第六支路开关元件分别与所述第一至所述第六条数据线电性连接；
所述第一分路开关元件和所述第二分路开关元件均接入同一组所述数据信号输出通道，所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件并联接入所述第一分路开关元件；所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件并联接入所述第二分路开关元件；
其中，所述第一分路开关元件和所述第二分路开关元件交替导通，且所述栅极驱动器提供的栅极驱动信号扫描所述子像素阵列的奇数行、偶数行时，所述第一分路开关元件和所述第二分路开关元件交替导通的先后顺序不同；
在第一分路控制信号依次向所述第一分路开关元件提供的三个导通周期内，所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件依次交替导通；
在第二分路控制信号依次向所述第二分路开关元件提供的三个导通周期内，所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件依次交替导通。
进一步地，所述第一分路开关元件的输入端、所述第二分路开关元件的输入端均与一组所述数据信号输出通道的输出端电性连接；
所述第一分路开关元件的控制端与所述第一分路控制信号电性连接，所述第一分路开关元件的输出端分别与第一支路开关元件、第二支路开关元件和第三支路开关元件的输入端连接；
所述第二分路开关元件的控制端与所述第二分路控制信号电性连接；所述第二分路开关元件的输出端分别与第三支路开关元件、第四支路开关元件和第五支路开关元件的输入端连接；
所述第一支路开关元件、所述第二支路开关元件和所述第三支路开关元件的控制端分别与第一支路控制信号、第二支路控制信号、第三支路控制信号电性连接；所述第一支路开关元件、所述第二支路开关元件和所述第三支路开关元件的输出端分别与所述第一数据线、所述第二数据线、所述第三数据线电性连接；
所述第四支路开关元件、所述第五支路开关元件和所述第六支路开关元件的控制端分别与第四支路控制信号、第五支路控制信号、第六支路控制信号电性连接；所述第四支路开关元件、所述第五支路开关元件和所述第六支路开关元件的输出端分别与所述第四数据线、所述第五数据线、所述第六数据线电性连接。进一步地，所述第一分路控制信号提供的控制信号将所述第一分路开关元件导通时，所述第二分路控制信号提供的控制信号将所述第二分路开关元件断开；
所述第二分路控制信号提供的控制信号将所述第二分路开关元件导通时，所述第一分路控制信号将所述第一分路开关元件断开。
进一步地，所述第一支路控制信号与所述第四支路控制信号的脉冲信号相同，所述第二支路控制信号与所述第五支路控制信号的脉冲信号相同；所述第三支路控制信号与所述第六支路控制信号的脉冲信号相同。
进一步地，若所述第一分路开关元件的充电时长和所述第二分路开关元件的充电时长均为T；
所述第一支路控制信号至所述第六支路控制信号提供的导通电压的持续时间至少为2T。
进一步地，
所述第一支路控制信号与所述第四支路控制信号的脉冲信号不同，所述第二支路控制信号与所述第五支路控制信号的脉冲信号不同；所述第三支路控制信号与所述第六支路控制信号的脉冲信号不同；
若所述第一分路开关元件的充电时长、所述第二分路开关元件的充电时长均为T；所述第一支路控制信号至所述第六支路控制信号提供的导通电压的持续时间均为一个T。
进一步地，
在每一帧图框的扫描时间内：若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为第二时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序。
进一步地，
在奇数帧图框的扫描时间内：
若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第二时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序；在偶数帧图框的扫描时间内：
若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第二时序。
进一步地，所述第一分路开关元件和所述第二分路开关元件均为P型薄膜晶体管；
所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件、所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件均为P型薄膜晶体管；
所述控制端、所述输入端、所述输出端分别对应P型薄膜晶体管的栅极、源极和漏极。
进一步地，所述第一数据线、所述第二数据线、所述第三数据线、所述第四数据线、所述第五数据线、所述第六数据线分别与第一R子像素列，第一G子像素列，一B子像素列、第二R子像素列，第二G子像素列，第二B子像素列连接。
上述OLED驱动电路中，通过在每个多路复用控制模块中设置两个并联连接的第一分路开关元件和第二分路开关元件，设置第一分路开关元件与并联连接的第一支路开关元件、第二支路开关元件、第三支路开关元件连接，设置第二分路开关元件与并联连接的第四支路开关元件、第五支路开关元件、第六支路开关元件连接；通过第一分路控制信号SWO和第二分路控制信号SWE控制第一分路开关元件和第二分路开关元件交替导通，进而能够切换子像素数据写入的先后顺序，即由第一分路开关元件和第一支路开关元件、第二支路开关元件、第三支路开关元件的驱动时序来控制第一列像素的数据写入顺序，由第二分路开关元件和第四支路开关元件、第五支路开关元件、第六支路开关元件的驱动时序来控制与第一列像素相邻的第二列像素的数据写入顺序。在此基础上，只需根据第一分路控制信号SWO和第二分路控制信号SWE控制第一分路开关元件和第二分路开关元件在奇数行、偶数行交替导通的先后顺序不同，即可得与同一条数据线连接的相邻像素中，归属于奇数行的像素数据写入先后顺序与归属于偶数行的像素数据写入先后顺序不同，这样在显示一帧图框的时间内，相邻行的像素，或者相邻列的像素的数据写入的先后顺序不同，使与同一数据线连接的相邻像素的显示亮度不一致，以及与同一栅极线连接的相邻像素的显示亮度不一致，进而避免充分充电的像素规则分布在一列像素，以及避免未得到充分充电的像素规则分布在相邻列，使得各个像素的显示亮度呈不规则分布，达到弱化条纹的目的，显示面板整体显示出来的画质就不会因为显示亮度的规则分布而产生条纹感。
附图说明
附图用来提供对本发明的进一步理解，并且构成说明书的一部分，与本发明实施例一起用于解释本发明，并不构成对本发明的限制。在附图中：
图1为现有技术中的多路复用驱动电路的结构示意图；
图2为现有技术中的多路复用驱动电路的时序图；
图3为本发明实施例提供的一种OLED驱动电路的结构示意图；
图4为本发明实施例提供的一种1:6的多路复用控制模块A1、数据信号输出通道S1，以及第一数据线至第六数据线的连接关系示意图；
图5为本发明实施例提供的第一种多路复用控制模块A1的时序图；
图6为本发明实施例提供的第二种多路复用控制模块A1的时序图；
图7为本发明实施例提供的一种任一帧图框在逐行扫描时多路复用控制模块A1的时序图；
图8为本发明实施例提供的一种任一帧图框在逐行扫描时多路复用控制模块A1的时序图；
图9为本发明实施例提供的奇数帧图框在逐行扫描时每一多路复用控制模块的时序图；
图10为本发明实施例提供的偶数帧图框在逐行扫描时每一多路复用控制模块的时序图；
图11为本发明实施例提供的OLED驱动电路控制下显示面板上各像素的显示效果示意图；
图12为本发明实施例提供的一种1:9的多路复用控制模块Ai、数据信号输出通道Si，以及第一数据线至第九数据线的连接关系示意图；
图13为本发明实施例提供的一种1:9的多路复用控制模块Ai的时序图。
具体实施方式
为了使本发明所解决的技术问题、技术方案以及有效果更加清楚明白，以下结合说明书附图对本发明的优选实施例进行说明，应当理解，此处所描述的优选实施例仅用于说明和解释本发明，并不用于限定本发明。并且在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。
如图3所示，本发明实施例提供一种OLED驱动电路，包括多行多列呈阵列式排布的子像素，子像素所在列对应的数据线，子像素所在行对应的栅极线，包括：
源极驱动器，栅极驱动器和N个多路复用控制模块；
源极驱动器包括N组数据信号输出通道(S1至Sn)；每组数据信号输出通道通过一个多路复用控制模块与依次竖直排列的第一至第六条数据线电性连接；
源极驱动器包括N组数据信号输出通道；每组数据信号输出通道通过一个多路复用控制模块与依次竖直排列的第一至第六条数据线电性连接；
每个多路复用控制模块，包括第一分路开关元件、第二分路开关元件，以及第一至第六支路开关元件；第一至第六支路开关元件分别与第一至第六条数据线电性连接；
第一分路开关元件和第二分路开关元件均接入同一组数据信号输出通道，第一支路开关元件、第二支路开关元件、第三支路开关元件并联接入第一分路开关元件；第四支路开关元件、第五支路开关元件、第六支路开关元件并联接入第二分路开关元件；
其中，第一分路开关元件和第二分路开关元件交替导通，且栅极驱动器提供的栅极驱动信号扫描子像素阵列的奇数行、偶数行时，第一分路开关元件和所述第二分路开关元件交替导通的先后顺序不同；
在第一分路控制信号SWO依次向第一分路开关元件提供的三个导通周期内，第一支路开关元件、第二支路开关元件、第三支路开关元件依次交替导通；
在第二分路控制信号SWE依次向第二分路开关元件提供的三个导通周期内，第四支路开关元件、第五支路开关元件、第六支路开关元件依次交替导通。
具体的，每个多路复用控制模块与对应的数据信号输出通道，以及该多路复用控制模块对应的六条数据线的连接关系，包括：
第一分路开关元件的输入端、第二分路开关元件的输入端均与一组数据信号输出通道通的输出端电性连接；
第一分路开关元件的控制端与第一分路控制信号SWO电性连接，第一分路开关元件的输出端分别与第一支路开关元件、第二支路开关元件和第三支路开关元件的输入端连接；
第二分路开关元件的控制端与第二分路控制信号电性连接；第二分路开关元件的输出端分别与第三支路开关元件、第四支路开关元件和第五支路开关元件的输入端连接；
第一支路开关元件、第二支路开关元件和第三支路开关元件的控制端分别与第一支路控制信号SW1、第二支路控制信号SW2、第三支路控制信号SW3电性连接；第一支路开关元件、第二支路开关元件和第三支路开关元件的输出端分别与第一数据线、第二数据线、第三数据线电性连接；
第四支路开关元件、第五支路开关元件和第六支路开关元件的控制端分别与第四支路控制信号SW4、第五支路控制信号SW5、第六支路控制信号SW6电性连接；第四支路开关元件、第五支路开关元件和第六支路开关元件的输出端分别与第四数据线、第五数据线、第六数据线电性连接。
上述OLED驱动电路中，通过在每个多路复用控制模块中设置两个并联连接的第一分路开关元件和第二分路开关元件，设置第一分路开关元件与并联连接的第一支路开关元件、第二支路开关元件、第三支路开关元件连接，设置第二分路开关元件与并联连接的第四支路开关元件、第五支路开关元件、第六支路开关元件连接；通过第一分路控制信号SWO和第二分路控制信号SWE控制第一分路开关元件和第二分路开关元件交替导通，进而能够切换子像素数据写入的先后顺序，即由第一分路开关元件和第一支路开关元件、第二支路开关元件、第三支路开关元件的驱动时序来控制第一列像素的数据写入顺序，由第二分路开关元件和第四支路开关元件、第五支路开关元件、第六支路开关元件的驱动时序来控制与第一列像素相邻的第二列像素的数据写入顺序。
在此基础上，只需根据第一分路控制信号SWO和第二分路控制信号SWE控制第一分路开关元件和第二分路开关元件在奇数行、偶数行交替导通的先后顺序不同，即可得与同一条数据线连接的相邻像素中，归属于奇数行的像素数据写入先后顺序与归属于偶数行的像素数据写入先后顺序不同，这样在显示一帧图框的时间内，相邻行的像素，或者相邻列的像素的数据写入的先后顺序不同，使与同一数据线连接的相邻像素的显示亮度不一致，以及与同一栅极线连接的相邻像素的显示亮度不一致，进而避免充分充电的像素规则分布在一列像素，以及避免未得到充分充电的像素规则分布在相邻列，使得各个像素的显示亮度呈不规则分布，达到弱化条纹的目的，显示面板整体显示出来的画质就不会因为显示亮度的规则分布而产生条纹感。
值得说明的是，本发明实施例为了解决条纹显示问题，并不是控制同一颜色的子像素的充电起点相同，而是通过控制相邻行各个像素的数据写入先后顺序，使与同一数据线连接的相邻像素的显示亮度不一致，以及与同一栅极线连接的相邻像素的显示亮度不一致，进而弱化条纹，如图11所示，O代表一个像素数据写入时充电充分时的显示亮度，X代表一个像素数据写入时未充电充分时的显示亮度，若本发明实施例中一个多路复用控制模块的第一分路开关元件先导通，第二分路开关元件后导通，则一个多路复用控制模块向相邻两个像素写入的数据信号对应的显示亮度依次为O和X，第二分路开关元件先导通，第一分路开关元件后导通，则一个多路复用控制模块控制向相邻两个像素写入的数据信号对应的显示亮度分别为X和O，因此，通过本发明实施例的上述方案，可以实现每两个相邻像素的显示像素的亮度不同，如图11所示，O和X均匀分布，显示面板整体的显示亮度均匀化，去除了条纹显示。
因每列像素由三列子像素构成，这三列子像素分别与三条数据线连接，具体的，由第一分路开关元件和第一支路开关元件的驱动时序来控制第一条数据线上的子像素的数据写入顺序，由第一分路开关元件和第二支路开关元件的驱动时序来控制第二条数据线上的子像素的数据写入顺序，由第一分路开关元件和第三支路开关元件的驱动时序来控制三条数据线上的子像素的数据写入顺序；由第二分路开关元件和第四支路开关元件的驱动时序来控制四条数据线上的子像素的数据写入顺序；由第二分路开关元件和第五支路开关元件的驱动时序来控制五条数据线上的子像素的数据写入顺序；由第二分路开关元件和第六支路开关元件的驱动时序来控制六条数据线上的子像素的数据写入顺序。
下面以1:6的多路复用控制模块为例，说明多路复用控制模块A1、数据信号输出通道S1，以及第一数据线至第六数据线D1-D6的连接关系。
如图4所示，多路复用控制模块A1，包括第一分路开关元件TO、第二分路开关元件TE，以及第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3、第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6；其中，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3、第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6，分别与第一至第六条数据线电性连接；
第一分路开关元件TO的输入端、第二分路开关元件TE的输入端均与一组数据信号输出通道通的输出端电性连接(S1的输出端)；
第一分路开关元件TO的控制端与第一分路控制信号SWO电性连接，第一分路开关元件TO的输出端分别与第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的输入端连接；
第二分路开关元件TE的控制端与第二分路控制信号SWE电性连接；第二分路开关元件TE的输出端分别与第三支路开关元件T3、第四支路开关元件T4和第五支路开关元件T5的输入端连接；
第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的控制端分别与第一支路控制信号SW1、第二支路控制信号SW2、第三支路控制信号SW3电性连接；第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的输出端分别与第一数据线D1、第二数据线D2、第三数据线D3电性连接；
第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6的控制端分别与第四支路控制信号SW4、第五支路控制信号SW5、第六支路控制信号SW6电性连接；第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6的输出端分别与第四数据线D4、第五数据线D5、第六数据线D6电性连接。
其中，第一分路开关元件TO和第二分路开关元件TE交替导通，且栅极驱动器提供的栅极驱动信号扫描子像素阵列的奇数行、偶数行时，第一分路开关元件TO和第二分路开关元件TE交替导通的先后顺序不同；
在第一分路控制信号SWO依次向第一分路开关元件TO提供的三个导通周期内，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3依次交替导通；
在第二分路控制信号SWE依次向第二分路开关元件TE提供的三个导通周期内，第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6依次交替导通。
基于上述连接关系，第一分路控制信号SWO提供的控制信号将第一分路开关元件TO导通时，第二分路控制信号SWE提供的控制信号将第二分路开关元件TE断开；第二分路控制信号SWE提供的控制信号将第二分路开关元件TE导通时，第一分路控制信号SWO将第一分路开关元件TO断开。
若第一分路开关元件TO为N型TFT，则第一分路控制信号SWO向第一分路开关元件TO施加低电平的驱动电压时，第一分路开关元件TO导通，第一分路开关元件TO的导通周期是指第一分路控制信号SWO每次向第一分路开关元件TO施加低电平的持续时长，可以理解为第一分路开关元件TO每次充电的充电时长。
为了使第一分路开关元件TO和第二分路开关元件TE交替导通，控制第一分路控制信号SWO与第二分路控制信号SWE的波形相同，但是第一分路控制信号SWO与第二分路控制信号SWE的相位相差半个周期。
如图5所示的时序图，第一分路控制信号SWO周期性的向第一分路开关元件TO提供低电平电压，第二分路控制信号SWE周期性的向第二分路开关元件TE提供低电平电压，第一分路控制信号SWO与第二分路控制信号SWE的周期相同，第一分路控制信号SWO与第二分路控制信号SWE相比，相位相差半个周期，并且第一分路开关元件TO先导通，第二分路开关元件TE后导通。在其他实施例中，也可以第二分路开关元件TE先导通，第一分路开关元件TO后导通。
本发明实施例中，第一分路开关元件TO先导通，第二分路开关元件TE后导通时，第一分路控制信号SWO驱动第一分路开关元件导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件导通的时序为第二时序。
本发明实施例中，第二分路开关元件TE先导通，第一分路开关元件TO后导通时，第一分路控制信号SWO驱动第一分路开关元件导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件导通的时序为第一时序。
基于上述多路复用控制模块A1、数据信号输出通道S1，以及第一数据线至第六数据线D1-D6的连接关系，因第一分路开关元件TO通过第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3控制第一至第三条数据线的数据写入顺序，因此，第一分路控制信号SWO依次向第一分路开关元件TO提供三个导通周期；同理，第二分路开关元件TE通过第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6控制第四至第六条数据线的数据写入顺序，因此，第二分路控制信号SWE依次向第二分路开关元件TE提供三个导通周期。
结合图5，在第一分路控制信号SWO依次向第一分路开关元件TO提供的三个导通周期内，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3依次交替导通；在第二分路控制信号SWE依次向第二分路开关元件TE提供的三个导通周期内，第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6依次交替导通。
进一步，优选的，如图5所示，第一支路控制信号SW1与第四支路控制信号SW4的脉冲信号相同，第二支路控制信号SW2与第五支路控制信号SW5的脉冲信号相同；第三支路控制信号SW3与第六支路控制信号SW6的脉冲信号相同。若第一分路开关元件TO的充电时长和第二分路开关元件TE的充电时长均为T；第一支路控制信号SW1至第六支路控制信号SW6提供的导通电压的持续时间至少为2T，第一支路开关元件至第六支路开关元件的充电时长均相同，且至少大于或等于2T，图5中为3T。
可选的，如图6所示，第一支路控制信号SW1与第四支路控制信号SW4的脉冲信号不同，第二支路控制信号SW2与第五支路控制信号SW5的脉冲信号不同；第三支路控制信号SW3与第六支路控制信号SW6的脉冲信号不同。若第一分路开关元件的充电时长、第二分路开关元件的充电时长均为T；第一支路控制信号SW1至第六支路控制信号SW6提供的导通电压的持续时间均为一个T。为了保证第一分路控制信号SWO依次向第一分路开关元件TO提供的三个导通周期内，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3依次交替导通；在第二分路控制信号SWE依次向第二分路开关元件TE提供的三个导通周期内，第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6依次交替导通。若第一分路开关元件TO的充电时长、第二分路开关元件TE的充电时长均为T，在扫描奇数行像素时，第一支路控制信号SW1、第四支路控制信号SW4、第二支路控制信号SW2、第五支路控制信号SW5第三支路控制信号SW3、第六支路控制信号SW6的脉冲信号依次相差一个T；第一支路开关元件至第六支路开关元件依次交替充电，且充电时长均为T；扫描偶数行像素时，第四支路控制信号SW4、第一支路控制信号SW1、第五支路控制信号SW5、第二支路控制信号SW2、第六支路控制信号SW6、第三支路控制信号SW3的脉冲信号依次相差一个T。
对于本发明实施例提供的上述OLED驱动电路，第一分路开关元件TO和第二分路开关元件TE均为P型薄膜晶体管；第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3、第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6均为P型薄膜晶体管；上述所有开关元件的控制端、输入端、输出端分别对应P型薄膜晶体管的栅极、源极和漏极。
对于本发明实施例提供的上述OLED驱动电路，第一数据线D1、第二数据线D2、第三数据线D3、第四数据线D4、第五数据线D5、第六数据线D6分别与第一R子像素列，第一G子像素列，一B子像素列、第二R子像素列，第二G子像素列，第二B子像素列连接。第一R子像素列，第一G子像素列，一B子像素列组成像素阵列的一列像素，第二R子像素列，第二G子像素列，第二B子像素组成像素阵列的上述列像素的相邻列像素。
通常，显示屏在正常显示画面的时候，都是一帧一帧地显示图像的，每秒显示60帧画面就是每秒刷新频率为60Hz。目前大多数显示器显示一帧画面，并不是所有像素同时显示，而是一行一行地逐行改写的。
从开始显示第一帧为起点，奇数帧图框(Odd Frame)指的是第1、3、5、7、9、11等奇数帧的图像内容，偶数数帧图框(Even Frame)指的是第2、4、6、8、10等偶数帧的图像内容。
对于每一帧图框，无论是奇数帧图框还是偶数数帧图框，每一帧图框的显示都是进行像素阵列的逐行扫描和数据写入，例如扫描第一行像素时，N组数据信号输出通道S1，S2……，Sn同时向该行的各个像素写入显示内容，相邻行像素写入的显示内容有所不同；然后扫描和数据写入第二行，第三行……直到最后一行，之后开始改写第二帧图框的第一行像素。对于每一帧图框，本发明实施例中的像素阵列中子像素所在的行，是指栅极线对应的行，子像素所在的列，是指数据线对应的列；奇数行指的是每一帧图框逐行改写的栅极侧第1、3、5、7、9，……行，偶数行指的是每一帧图框逐行改写的栅极侧第2、4、6、8、10……行。
结合本发明实施例提供的上述OLED驱动电路，对于任一帧图像框，奇数行像素和偶数行像素的数据写入时序不同，一种优选实施例中，如图7所示，在每一帧图框的扫描时间内：
若子像素所在行为奇数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第二时序；
若子像素所在行为偶数数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第一时序。
例如，如图7所示，栅极驱动器输出的栅极驱动信号在扫描第一行像素时，第一分路开关元件TO先导通，第二分路开关元件TE后导通，栅极驱动器输出的栅极驱动信号在扫描第二行像素时，第二分路开关元件TE先导通，第一分路开关元件TO后导通。
进一步地，栅极驱动器输出的栅极驱动信号在扫描奇数行像素时，第一分路开关元件TO先导通，第二分路开关元件TE后导通，栅极驱动器输出的栅极驱动信号在扫描偶数行像素时，第二分路开关元件TE先导通，第一分路开关元件TO后导通。
结合图7和图4，栅极驱动器输出的栅极驱动信号在扫描第一行像素时，数据信号输出通道S1通过多路复用控制模块A1、向第一数据线D1至第六数据线D6写入数据信号的具体过程如下：
在第一分路控制信号SWO提供的第一个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第一支路开关元件T1导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第一支路开关元件T1写入到与第一条数据线连接的子像素(例如，与第一条数据线连接的子像素为子像素R，写入到子像素R的数据为R00)；
在第二分路控制信号SWE提供的第一个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第四支路开关元件T4导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第四支路开关元件T4写入到与第四条数据线连接的子像素(例如，与第四条数据线连接的子像素为子像素R，写入到子像素R的数据为R01)；
在第一分路控制信号SWO提供的第二个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第二支路开关元件T2导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第二支路开关元件T2写入到与第二条数据线连接的子像素(例如，与第二条数据线连接的子像素为子像素G，写入到子像素G的数据为G00)；
在第二分路控制信号SWE提供的第二个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第五支路开关元件T5导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第五支路开关元件T5写入到与第五条数据线连接的子像素(例如，与第五条数据线连接的子像素为子像素G，写入到子像素G的数据为G01)；
在第一分路控制信号SWO提供的第三个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第三支路开关元件T3导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第三支路开关元件T3写入到与第三条数据线连接的子像素(例如，与第三条数据线连接的子像素为子像素B，写入到子像素B的数据为B00)；
在第二分路控制信号SWE提供的第三个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第六支路开关元件T6导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第六支路开关元件T6写入到与第六条数据线连接的子像素(例如，与第六条数据线连接的子像素为子像素B，写入到子像素B的数据为B01)；
栅极驱动器输出的栅极驱动信号在扫描第二行像素时，数据信号输出通道S1通过多路复用控制模块A1、向第一数据线D1至第六数据线D6写入数据信号的具体过程如下：
在第二分路控制信号SWE提供的第一个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第四支路开关元件T4导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第四支路开关元件T4写入到与第四条数据线连接的子像素(例如，与第四条数据线连接的子像素为子像素R，写入到子像素R的数据为R11)；
在第一分路控制信号SWO提供的第一个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第一支路开关元件T1导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第一支路开关元件T1写入到与第一条数据线连接的子像素(例如，与第一条数据线连接的子像素为子像素R，写入到子像素R的数据为R10)；
在第二分路控制信号SWE提供的第二个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第五支路开关元件T5导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第五支路开关元件T5写入到与第五条数据线连接的子像素(例如，与第五条数据线连接的子像素为子像素G，写入到子像素G的数据为G11)；
在第一分路控制信号SWO提供的第二个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第二支路开关元件T2导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第二支路开关元件T2写入到与第二条数据线连接的子像素(例如，与第二条数据线连接的子像素为子像素G，写入到子像素G的数据为G10)；
在第二分路控制信号SWE提供的第三个导通周期内，第一分路开关元件TO关闭，第二分路开关元件TE导通，第六支路开关元件T6导通，数据信号输出通道S1输出的数据信号，先后经第二分路开关元件TE、第六支路开关元件T6写入到与第六条数据线连接的子像素(例如，与第六条数据线连接的子像素为子像素B，写入到子像素B的数据为B11)；
在第一分路控制信号SWO提供的第三个导通周期内，第一分路开关元件TO导通，第二分路开关元件TE关闭，第三支路开关元件T3导通，数据信号输出通道S1输出的数据信号，先后经第一分路开关元件TO、第三支路开关元件T3写入到与第三条数据线连接的子像素(例如，与第三条数据线连接的子像素为子像素B，写入到子像素B的数据为B10)。
可选的，在上述实施例中，也可以在栅极驱动器输出的栅极驱动信号在扫描第一行像素时，第二分路开关元件TE先导通，第一分路开关元件TO后导通；在栅极驱动器输出的栅极驱动信号在扫描第二行像素时，第一分路开关元件TO先导通，第二分路开关元件TE后导通，如图8所示，具体内容与上述实施例类似，此处不再累述。
进一步地，在栅极驱动器输出的栅极驱动信号在扫描奇数行像素时，第二分路开关元件TE先导通，第一分路开关元件TO后导通；在栅极驱动器输出的栅极驱动信号在扫描偶数行像素时，第一分路开关元件TO先导通，第二分路开关元件TE后导通。
另一种优选实施例中，为了更好的减弱条纹显示，在将一帧图框的奇数行和偶数行的数据写入顺序打乱的基础上，同时将奇数帧图框和偶数帧图框的数据写入时序进行调整，使奇数帧图框和偶数帧图框的数据写入时序不一致。
例如，一种实施例中，如图9所示，在奇数帧图框的扫描时间内：若子像素所在行为奇数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第二时序；若子像素所在行为偶数数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第一时序；
如图10所示，在偶数帧图框的扫描时间内：若子像素所在行为奇数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第一时序；若子像素所在行为偶数数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第二时序。
再例如，另一可选的实施例中，在奇数帧图框的扫描时间内：若子像素所在行为奇数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第一时序；若子像素所在行为偶数数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第二时序。在偶数帧图框的扫描时间内：若子像素所在行为奇数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第一时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第二时序；若子像素所在行为偶数数行，且子像素所在行的栅极线施加栅极驱动信号时，第一分路控制信号SWO驱动第一分路开关元件TO导通的时序为第二时序；第二分路控制信号SWE驱动第二分路开关元件TE导通的时序为第一时序。
对于多路复用控制模块A2～An、数据信号输出通道S2～Sn，以及多路复用控制模块A2～An各自对应的六条数据线的连接关系，以及栅极驱动器输出的栅极驱动信号进行逐行扫描时，数据信号输出通道S1通过多路复用控制模块A2～An、向多路复用控制模块A2～An各自对应的六条数据线写入数据信号的具体过程，可参见上述实施例示例出的多路复用控制模块A1、数据信号输出通道S1，以及第一数据线至第六数据线的连接关系，栅极驱动器输出的栅极驱动信号进行逐行扫描时，数据信号输出通道S1通过多路复用控制模块A1、向第一数据线至第六数据线写入数据信号的具体过程，此处不再累述。
上述实施例的OLED驱动电路中，通过在每个多路复用控制模块中设置两个并联连接的第一分路开关元件TO和第二分路开关元件TE，设置第一分路开关元件TO与并联连接的第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3连接，设置第二分路开关元件TE与并联连接的第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6连接；通过第一分路控制信号SWO和第二分路控制信号SWE控制第一分路开关元件TO和第二分路开关元件TE交替导通，进而能够切换子像素数据写入的先后顺序，即由第一分路开关元件TO和第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3的驱动时序来控制第一列像素的数据写入顺序，由第二分路开关元件TE和第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6的驱动时序来控制与第一列像素相邻的第二列像素的数据写入顺序。
在此基础上，将奇数行像素、偶数行像素的数据写入的先后顺序进行调整，使得与同一条数据线连接的相邻像素中，归属于奇数行的像素数据写入先后顺序与归属于偶数行的像素数据写入先后顺序不同，这样在显示一帧图框的时间内，相邻行的像素，或者相邻列的像素的数据写入的先后顺序不同，使与同一数据线连接的相邻像素的显示亮度不一致，以及与同一栅极线连接的相邻像素的显示亮度不一致，进而避免充分充电的像素规则分布在一列像素，以及避免未得到充分充电的像素规则分布在相邻列，使得各个像素的显示亮度呈不规则分布，达到弱化条纹的目的，显示面板整体显示出来的画质就不会因为显示亮度的规则分布而产生条纹感。通过本发明实施例的上述方案，可以实现每两个相邻像素的显示像素的亮度不同，如图11所示，O和X均匀分布，显示面板整体的显示亮度均匀化，去除了条纹显示。
值得说明的是，本发明实施例并不局限于1:6的多路复用像素结构，还适用于1:9等多路复用像素结构。例如，将本发明实施例的上述方案应用在1:9的多路复用像素结构中时，如图12所示，只需每组数据信号输出通道(S1～Sn中任一个)通过一个多路复用控制模块与依次竖直排列的第一至第九条数据线电性连接；每个多路复用控制模块Ai，包括第一分路开关元件TO、第二分路开关元件TF，以及第一至第九支路开关元件；第一至第九支路开关元件分别与第一至第九条数据线电性连接。其中，第一分路开关元件TO、第二分路开关元件TE，第三分路开关元件TF均接入同一组数据信号输出通道Si，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3并联接入第一分路开关元件TO；第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6并联接入第二分路开关元件TE；第七支路开关元件T7、第八支路开关元件T8、第九支路开关元件T9并联接入第三分路开关元件TF。
此时，对于任一多路复用控制模块Ai，与数据信号输出通道Si，以及该多路复用控制模块Ai对应的相邻九条数据线的连接关系，具体如下：
第一分路开关元件TO的输入端、第二分路开关元件TE的输入端、第三分路开关元件TF的输入端均与一组数据信号输出通道通Si的输出端电性连接；
第一分路开关元件TO的控制端与第一分路控制信号SWO电性连接，第一分路开关元件TO的输出端分别与第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的输入端连接；
第二分路开关元件TE的控制端与第二分路控制信号SWE电性连接；第二分路开关元件TE的输出端分别与第三支路开关元件T3、第四支路开关元件T4和第五支路开关元件T5的输入端连接；
第三分路开关元件TF的控制端与第三分路控制信号SWF电性连接；第三分路开关元件TF的输出端分别与第七支路开关元件T7、第八支路开关元件T8和第九支路开关元件T9的输入端连接；
第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的控制端分别与第一支路控制信号SW1、第二支路控制信号SW2、第三支路控制信号SW3电性连接；第一支路开关元件T1、第二支路开关元件T2和第三支路开关元件T3的输出端分别与第一数据线D1、第二数据线D2、第三数据线D3电性连接；
第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6的控制端分别与第四支路控制信号SW4、第五支路控制信号SW5、第六支路控制信号SW6电性连接；第四支路开关元件T4、第五支路开关元件T5和第六支路开关元件T6的输出端分别与第四数据线D4、第五数据线D5、第六数据线D6电性连接；
第七支路开关元件T7、第八支路开关元件T8和第九支路开关元件T9的控制端，分别与第七支路控制信号SW7、第八支路控制信号SW8、第九支路控制信号SW9电性连接；第七支路开关元件T7、第八支路开关元件T8和第九支路开关元件T9的输出端，分别与第七数据线D7、第八数据线D8、第九数据线D9电性连接。
其中，由第一分路控制信号SWO、第二分路控制信号SWE、第三分路控制信号SWF控制第一分路开关元件TO、第二分路开关元件TE、第三分路开关元件TF交替导通，且栅极驱动器提供的栅极驱动信号扫描子像素阵列的奇数行、偶数行时，第一分路开关元件TO、第二分路开关元件TE和第三分路开关元件TF交替导通的先后顺序不同；
在第一分路控制信号SWO依次向第一分路开关元件TO提供的三个导通周期内，第一支路开关元件T1、第二支路开关元件T2、第三支路开关元件T3依次交替导通；
在第二分路控制信号SWE依次向第二分路开关元件TE提供的三个导通周期内，第四支路开关元件T4、第五支路开关元件T5、第六支路开关元件T6依次交替导通。
在第三分路控制信号SWF依次向第三分路开关元件TF提供的三个导通周期内，第七支路开关元件T7、第八支路开关元件T8、第九支路开关元件T9依次交替导通。
其中，第一分路开关元件TO和第二分路开关元件TE交替导通，且栅极驱动器提供的栅极驱动信号扫描子像素阵列的奇数行、偶数行时，第一分路开关元件TO、第二分路开关元件TE和第三分路开关元件TF交替导通的先后顺序不同。
如图13所示，奇数行像素在进行数据写入时，第一分路控制信号SWO、第二分路控制信号SWE、以及第三分路控制信号SWF的驱动时序，与偶数行像素在进行数据写入时，第一分路控制信号SWO、第二分路控制信号SWE、以及第三分路控制信号SWF的驱动时序不同，其中，第一支路控制信号SW1、第四支路控制信号SW4和第七支路控制信号SW7的驱动时序相同，第二支路控制信号SW2、第五支路控制信号SW5和第八支路控制信号SW8的驱动时序相同，第三支路控制信号SW3、第六支路控制信号SW6和第九支路控制信号SW9的驱动时序相同。根据图13所示的时序图，奇数行像素在进行数据写入时，第一分路开关元件TO先导通，其次是第二分路开关元件TE导通，再次是第三分路开关元件TF导通，在第一分路开关元件TO、第二分路开关元件TE、第三分路开关元件TF依次交替导通的三个循环周期内，第一支路开关元件T1、第四支路开关元件T4、第七支路开关元件T7交替导通，第二支路开关元件T2、第五支路开关元件T5、第八支路开关元件T8交替导通，第三支路开关元件T3、第六支路开关元件T6、第九支路开关元件T9交替导通，进而使得与第一条数据线连接的子像素、与第四条数据线连接的子像素、与第七条数据线连接的子像素、与第二条数据线连接的子像素、与第五条数据线连接的子像素、与第八条数据线连接的子像素、与第三条数据线连接的子像素、与第六条数据线连接的子像素、与第九条数据线连接的子像素依次交替写入各自对应的数据信号。偶数行像素在进行数据写入时，第三分路开关元件TF先导通，其次是第二分路开关元件TE导通，再次是第一分路开关元件TO导通，在第三分路开关元件TF、第二分路开关元件TE、第一分路开关元件TO依次交替导通的三个循环周期内，第七支路开关元件T7、第四支路开关元件T4、第一支路开关元件T1交替导通，第八支路开关元件T8、第五支路开关元件T5、第二支路开关元件T2交替导通，第九支路开关元件T9、第六支路开关元件T6、第三支路开关元件T3交替导通，进而使得与与第七条数据线连接的子像素、与第四条数据线连接的子像素、第一条数据线连接的子像素、与第八条数据线连接的子像素、与第五条数据线连接的子像素、与第二条数据线连接的子像素、与第九条数据线连接的子像素、与第六条数据线连接的子像素、与第三条数据线连接的子像素依次交替写入各自对应的数据信号。由此可见，奇数行像素在进行数据写入时的时序与偶数行像素在进行数据写入的时序不同，使得显示面板各个像素的显示亮度呈不规则分布，达到弱化条纹的目的。
在栅极驱动器输出的栅极驱动信号进行逐行扫描时，任一数据信号输出通道通过对应的多路复用控制模块、向该多路复用控制模块对应的相邻九条数据线写入数据信号的具体内容，可参见本发明实施例，此处不再累述。
结合本发明实施例上述奇数行和偶数行的数据写入顺序不同，显示面板整体的显示亮度均匀化，去除了条纹显示。
上述OLED驱动电路中，通过在每个多路复用控制模块中设置三个个并联连接的第一分路开关元件、第二分路开关元件和第三分路开关元件，设置第一分路开关元件与并联连接的第一支路开关元件、第二支路开关元件、第三支路开关元件连接，设置第二分路开关元件与并联连接的第四支路开关元件、第五支路开关元件、第六支路开关元件连接；设置第三分路开关元件与并联连接的七支路开关元件、第八支路开关元件、第九支路开关元件连接，通过第一分路控制信号、第二分路控制信号和第三分路控制信号控制第一分路开关元件、第二分路开关元件和第三分路开关元件交替导通，进而能够切换子像素数据写入的先后顺序，即由第一分路开关元件和第一支路开关元件、第二支路开关元件、第三支路开关元件的驱动时序来控制第一列像素的数据写入顺序；由第二分路开关元件和第四支路开关元件、第五支路开关元件、第六支路开关元件的驱动时序来控制第二列像素的数据写入顺序；由第三分路开关元件和第七支路开关元件、第八支路开关元件、第九支路开关元件控制与第三列像素的数据写入顺序连接，第一至第三列像素为相邻三列像素，来自同一数据信号输出导通的数据信号交替写入这三列像素的子像素中。
在此基础上，只需根据第一分路控制信号、第二分路控制信号和第三控制信号控制第一分路开关元件、第二分路开关元件和第三分路开关单元在奇数行、偶数行交替导通的先后顺序不同，即可得与同一条数据线连接的相邻像素中，归属于奇数行的像素数据写入先后顺序与归属于偶数行的像素数据写入先后顺序不同，这样在显示一帧图框的时间内，相邻行的像素，或者相邻列的像素的数据写入的先后顺序不同，使与同一数据线连接的相邻像素的显示亮度不一致，以及与同一栅极线连接的相邻像素的显示亮度不一致，进而避免充分充电的像素规则分布在一列像素，以及避免未得到充分充电的像素规则分布在相邻列，使得各个像素的显示亮度呈不规则分布，达到弱化条纹的目的，显示面板整体显示出来的画质就不会因为显示亮度的规则分布而产生条纹感。
尽管已描述了本发明的优选实施例，但本领域内的技术人员一旦得知了基本创造性概念，则可对这些实施例作出另外的变更和修改。所以，所附权利要求意欲解释为包括优选实施例以及落入本发明范围的所有变更和修改。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (10)

1.一种OLED驱动电路，包括多行多列呈阵列排布的子像素，所述子像素所在列对应的数据线，所述子像素所在行对应的栅极线，其特征在于，包括：
源极驱动器，栅极驱动器，和N个多路复用控制模块；
所述源极驱动器包括N组数据信号输出通道；每组所述数据信号输出通道通过一个所述多路复用控制模块至少与依次竖直排列的至少第一至第六条数据线电性连接；
每个所述多路复用控制模块，包括第一分路开关元件、第二分路开关元件，以及第一至第六支路开关元件；所述第一至所述第六支路开关元件分别与所述第一至所述第六条数据线电性连接；
所述第一分路开关元件和所述第二分路开关元件均接入同一组所述数据信号输出通道，所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件并联接入所述第一分路开关元件；所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件并联接入所述第二分路开关元件；
其中，所述第一分路开关元件和所述第二分路开关元件交替导通，且所述栅极驱动器提供的栅极驱动信号扫描所述子像素阵列的奇数行、偶数行时，所述第一分路开关元件和所述第二分路开关元件交替导通的先后顺序不同；
在第一分路控制信号依次向所述第一分路开关元件提供的三个导通周期内，所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件依次交替导通；
在第二分路控制信号依次向所述第二分路开关元件提供的三个导通周期内，所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件依次交替导通。
2.如权利要求1所述的OLED驱动电路，其特征在于，
所述第一分路开关元件的输入端、所述第二分路开关元件的输入端均与一组所述数据信号输出通道的输出端电性连接；
所述第一分路开关元件的控制端与所述第一分路控制信号电性连接，所述第一分路开关元件的输出端分别与第一支路开关元件、第二支路开关元件和第三支路开关元件的输入端连接；
所述第二分路开关元件的控制端与所述第二分路控制信号电性连接；所述第二分路开关元件的输出端分别与第三支路开关元件、第四支路开关元件和第五支路开关元件的输入端连接；
所述第一支路开关元件、所述第二支路开关元件和所述第三支路开关元件的控制端分别与第一支路控制信号、第二支路控制信号、第三支路控制信号电性连接；所述第一支路开关元件、所述第二支路开关元件和所述第三支路开关元件的输出端分别与所述第一数据线、所述第二数据线、所述第三数据线电性连接；
所述第四支路开关元件、所述第五支路开关元件和所述第六支路开关元件的控制端分别与第四支路控制信号、第五支路控制信号、第六支路控制信号电性连接；所述第四支路开关元件、所述第五支路开关元件和所述第六支路开关元件的输出端分别与所述第四数据线、所述第五数据线、所述第六数据线电性连接。
3.如权利要求2所述的OLED驱动电路，其特征在于，所述第一分路控制信号提供的控制信号将所述第一分路开关元件导通时，所述第二分路控制信号提供的控制信号将所述第二分路开关元件断开；
所述第二分路控制信号提供的控制信号将所述第二分路开关元件导通时，所述第一分路控制信号将所述第一分路开关元件断开。
4.如权利要求3所述的OLED驱动电路，其特征在于，所述第一支路控制信号与所述第四支路控制信号的脉冲信号相同，所述第二支路控制信号与所述第五支路控制信号的脉冲信号相同；所述第三支路控制信号与所述第六支路控制信号的脉冲信号相同。
5.如权利要求4所述的OLED驱动电路，其特征在于，若所述第一分路开关元件的充电时长和所述第二分路开关元件的充电时长均为T；
所述第一支路控制信号至所述第六支路控制信号提供的导通电压的持续时间至少为2T。
6.如权利要求3所述的OLED驱动电路，其特征在于，所述第一支路控制信号与所述第四支路控制信号的脉冲信号不同，所述第二支路控制信号与所述第五支路控制信号的脉冲信号不同；所述第三支路控制信号与所述第六支路控制信号的脉冲信号不同；
若所述第一分路开关元件的充电时长、所述第二分路开关元件的充电时长均为T；所述第一支路控制信号至所述第六支路控制信号提供的导通电压的持续时间均为一个T。
7.如权利要求1至6中任一项所述的OLED驱动电路，其特征在于，在每一帧图框的扫描时间内：若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为第二时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序。
8.如权利要求1至6中任一项所述的OLED驱动电路，其特征在于，在奇数帧图框的扫描时间内：
若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为第二时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序；在偶数帧图框的扫描时间内：
若所述子像素所在行为奇数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第二时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第一时序；
若所述子像素所在行为偶数数行，且所述子像素所在行的栅极线施加栅极驱动信号时，所述第一分路控制信号驱动所述第一分路开关元件导通的时序为所述第一时序；所述第二分路控制信号驱动所述第二分路开关元件导通的时序为所述第二时序。
9.如权利要求1所述的OLED驱动电路，其特征在于，
所述第一分路开关元件和所述第二分路开关元件均为P型薄膜晶体管；
所述第一支路开关元件、所述第二支路开关元件、所述第三支路开关元件、所述第四支路开关元件、所述第五支路开关元件、所述第六支路开关元件均为P型薄膜晶体管；
控制端、输入端、输出端分别对应P型薄膜晶体管的栅极、源极和漏极。
10.如权利要求1所述的OLED驱动电路，其特征在于，
所述第一数据线、所述第二数据线、所述第三数据线、所述第四数据线、所述第五数据线、所述第六数据线分别与第一R子像素列，第一G子像素列，一B子像素列、第二R子像素列，第二G子像素列，第二B子像素列连接。
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