CN108305900A - 一种功率mosfet的缓变掺杂材料片及其制造方法 - Google Patents

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Abstract

本发明公开了一种功率MOSFET的缓变掺杂材料片及其制造方法;其特征在于:包括第一导电类型的高掺杂衬底、第一导电类型的缓变外延层区和第一导电类型的顶层外延层;通过多个单层的、浓度依次减低的过渡外延层组合形成的缓变外延层区,增大的MOSFET中寄生三极管集电区寄生电阻,能有效的抑制了单粒子烧毁效应;具有工艺实现简单、工艺效果可控、易重复的优点。

Description

一种功率MOSFET的缓变掺杂材料片及其制造方法
技术领域
本发明涉及半导体器件材料制造领域,具体是一种功率MOSFET的缓变掺杂材料片及其制造方法。
背景技术
垂直双扩散功率MOSFET(VDMOS:Vertical Double-diffusion Metal OxideSemiconductor)器件因其具有功耗低、开关速度快、驱动能力强、负温度系数等优点,而广泛用于应用于电机调速、逆变器、电子开关、汽车电器和电子镇流器等,是功率集成电路及功率集成系统的核心元器件之一。
在低阻衬底片上生长高阻外延而形成的材料片是制作VDMOS器件的基础工艺,外延的电阻率、厚度直接影响器件的核心参数,电阻率和厚度越大,器件的耐压越高,导通电阻也越大。
常规的外延加工需要尽可能的控制衬底高掺杂质在外延生长过程和后续的高温加工过程中的上翻程度,避免损失有效外延低掺杂区的厚度(如图1)。尽可能的用较小的外延电阻率和厚度,在保证耐压的前提下,满足低导通电阻的要求。这就要求衬底和外延层之间的过渡区应具有宽度短、浓度突变的特点。
而对于有抗单粒子烧毁要求的MOSFET器件,将外延层过渡区做成缓变掺杂(如图2)是一种有效的加固方法,该方法可以降低MOSFET器件寄生三极管集电区电阻,提高其二次击穿点,达到提高MOSFET抗单粒子烧毁的能力。
如以常规的方式制作缓变掺杂外延片,需要调节衬底和外延层过渡区制备过程中,一边生长外延,一边调整氛围和流量。但是其有两个弊端:第一,难以精确控制过渡区杂质分布;第二,难以实现几个微米以上的厚过渡区制备。
综上所述,现有的外延材料片制备方法存在制备方法上的瑕疵,应用范围窄,工艺较难控制。
发明内容
本发明的目的是解决现有技术中存在的问题,提供一种功率MOSFET的缓变掺杂材料片及其制造方法。
为实现本发明目的而采用的技术方案是这样的,一种功率MOSFET的缓变掺杂材料片,其特征在于:包括第一导电类型的高掺杂衬底、第一导电类型的缓变外延层区和第一导电类型的顶层外延层。
所述第一导电类型的缓变外延层区覆盖于第一导电类型的高掺杂衬底之上。
所述第一导电类型的顶层外延层覆盖于第一导电类型的缓变外延层区之上。
所述第一导电类型的缓变外延层区由多个单层的过渡外延层构成。所述多个单层的过渡外延层的掺杂浓度依次降低,
所述过渡外延层的最大浓度不大于第一导电类型的高掺杂衬底的浓度、最小浓度不小于第一导电类型的顶层外延层的浓度。
所述多个单层的过渡外延层按浓度高低排序,依次覆盖于第一导电类型的高掺杂衬底之上。
当完成外延时,所述多个单层的过渡外延层的整体结构呈阶梯状。当经过整个功率MOSFET高温推进加工后,所述多个单层的过渡外延层的整体结构呈缓坡状。
一种功率MOSFET的缓变掺杂材料片的制造方法,其特征在于,包括以下步骤:
1)将第一导电类型的高掺杂衬底的浓度记为X,第一导电类型的顶层外延层的浓度记为Y。
2)依次制备第一导电类型的缓变外延层区内的多个单层的过渡外延层。
所述过渡外延层的掺杂最大浓度不大于X,最小浓度不小于Y。
所述过渡外延层依次分层降低掺杂浓度,并依次淀积到第一导电类型的高掺杂衬底上。
3)将所述第一导电类型的顶层外延层覆盖于第一导电类型的缓变外延层区上。完成整个MOSFET的高温加工制程,得到缓变掺杂的浓度分布。
进一步,所述第一导电类型的高掺杂衬底材料包括硅(Si)、碳化硅(SiC)或氮化镓(GaN)。
进一步,所述过渡外延层的层数为N,1≤N≤10,每层厚度为1~10um。更优选的,所述过渡外延层的层数为N,3≤N≤6,每层厚度为2~5um。
所述步骤2)中各过渡外延层的分段、每段厚度和浓度是可以根据需要调整和组合的。
本发明的技术效果是毋庸置疑的,本发明具有以下优点:
1)本发明可以采用常规的半导体材料制备工艺实现,其浓度和厚度可以做到精确控制。
2)本发明在第一导电类型的高掺杂衬底和第一导电类型的顶层外延层之间增加了一个由多个单层的过渡外延层组成的第一导电类型的缓变外延层区,由于各个过渡外延层的浓度依次分层降低,故而在经过后续高温加工过程后,会形成一个缓变的掺杂分布,降低了寄生三极管集电区电阻,提高了功率MOSFET的抗单粒子烧毁的能力。
附图说明
图1是常规外延材料片的掺杂分布浓度示意图;
图2是缓变掺杂外延材料片的掺杂分布浓度示意图;
图3是高掺杂衬底的掺杂分布浓度示意图;
图4是完成缓变外延层区后的掺杂分布浓度示意图;
图5是完成顶层外延层后的掺杂分布浓度示意图;
图6是MOSFET全工艺高温加工过程后的掺杂分布浓度示意图。
图中:第一导电类型的高掺杂衬底101、第一导电类型的缓变外延层区102和第一导电类型的顶层外延层103。
具体实施方式
下面结合实施例对本发明作进一步说明,但不应该理解为本发明上述主题范围仅限于下述实施例。在不脱离本发明上述技术思想的情况下,根据本领域普通技术知识和惯用手段,做出各种替换和变更,均应包括在本发明的保护范围内。
实施例1:
一种功率MOSFET的缓变掺杂材料片,其特征在于:包括第一导电类型的高掺杂衬底101、第一导电类型的缓变外延层区102和第一导电类型的顶层外延层103。
所述第一导电类型的缓变外延层区102覆盖于第一导电类型的高掺杂衬底101之上。
所述第一导电类型的顶层外延层103覆盖于第一导电类型的缓变外延层区102之上。
所述第一导电类型的缓变外延层区102由多个单层的过渡外延层构成。所述多个单层的过渡外延层的掺杂浓度依次降低,
所述过渡外延层的最大浓度不大于第一导电类型的高掺杂衬底101的浓度、最小浓度不小于第一导电类型的顶层外延层103的浓度。
所述多个单层的过渡外延层按浓度高低排序,依次覆盖于第一导电类型的高掺杂衬底101之上。
当完成外延时,所述多个单层的过渡外延层的整体结构呈阶梯状。当经过整个功率MOSFET高温推进加工后,所述多个单层的过渡外延层的整体结构呈缓坡状。
所述第一导电类型的高掺杂衬底101材料包括硅、碳化硅或氮化镓。
实施例2:
一种功率MOSFET的缓变掺杂材料片的制造方法,其特征在于,包括以下步骤:
1)将第一导电类型的高掺杂衬底101的浓度记为X,第一导电类型的顶层外延层103的浓度记为Y;
如图3所示,所述第一导电类型的高掺杂衬底101的浓度为1e20;
2)依次制备第一导电类型的缓变外延层区102内的多个单层的过渡外延层;如图4所示,将所述过渡外延层分为4段,每段2μm,浓度依次为1e18、1e17、1e16、1e15;
所述过渡外延层依次分层降低掺杂浓度,并依次淀积到第一导电类型的高掺杂衬底101上。该过程中采用减压外延,工艺温度为1150℃±10℃,掺杂剂为PH3
3)将所述第一导电类型的顶层外延层103覆盖于第一导电类型的缓变外延层区102上;该过程中采用减压外延,工艺温度为1150℃±10℃;如图5所示,所述第一导电类型的顶层外延层103浓度为5e14,厚度为10μm;
4)进行后续的MOSFET加工,在完成高温推进工艺后,最终材料片浓度分布如图6所示。
所述第一导电类型的高掺杂衬底101材料包括硅、碳化硅或氮化镓。
实施例3:
一种功率MOSFET的缓变掺杂材料片的制造方法,其特征在于,包括以下步骤:
1)将第一导电类型的高掺杂衬底101的浓度记为X,第一导电类型的顶层外延层103的浓度记为Y;
如图3所示,所述第一导电类型的高掺杂衬底101的浓度为1e20;
2)依次制备第一导电类型的缓变外延层区102内的多个单层的过渡外延层;如图4所示,将所述过渡外延层分为4段,第一段2μm,其他段4μm,浓度依次为1e18、1e17、1e16、5e15;
所述过渡外延层依次分层降低掺杂浓度,并依次淀积到第一导电类型的高掺杂衬底101上。该过程中采用减压外延,工艺温度为1180℃±10℃,掺杂剂为PH3
3)将所述第一导电类型的顶层外延层103覆盖于第一导电类型的缓变外延层区102上;该过程中采用减压外延,工艺温度为1150℃±10℃;如图5所示,所述第一导电类型的顶层外延层103浓度为6e14,厚度为25μm;
4)进行后续的MOSFET加工,在完成高温推进工艺后,最终材料片浓度分布如图6所示。
所述第一导电类型的高掺杂衬底101材料包括硅、碳化硅或氮化镓。

Claims (4)

1.一种功率MOSFET的缓变掺杂材料片,其特征在于:包括第一导电类型的高掺杂衬底(101)、第一导电类型的缓变外延层区(102)和第一导电类型的顶层外延层(103);
所述第一导电类型的缓变外延层区(102)覆盖于第一导电类型的高掺杂衬底(101)之上;
所述第一导电类型的顶层外延层(103)覆盖于第一导电类型的缓变外延层区(102)之上;
所述第一导电类型的缓变外延层区(102)由多个单层的过渡外延层构成;所述多个单层的过渡外延层的掺杂浓度依次降低,
所述过渡外延层的最大浓度不大于第一导电类型的高掺杂衬底(101)的浓度、最小浓度不小于第一导电类型的顶层外延层(103)的浓度。
所述多个单层的过渡外延层按浓度高低排序,依次覆盖于第一导电类型的高掺杂衬底(101)之上;
当完成外延时,所述多个单层的过渡外延层的整体结构呈阶梯状;当经过整个功率MOSFET高温推进加工后,所述多个单层的过渡外延层的整体结构呈缓坡状。
2.一种功率MOSFET的缓变掺杂材料片的制造方法,其特征在于,包括以下步骤:
1)将第一导电类型的高掺杂衬底101)的浓度记为X,第一导电类型的顶层外延层(103)的浓度记为Y;
2)依次制备第一导电类型的缓变外延层区(102)内的多个单层的过渡外延层;
所述过渡外延层的掺杂最大浓度不大于X,最小浓度不小于Y;
所述过渡外延层依次分层降低掺杂浓度,并依次淀积到第一导电类型的高掺杂衬底(101)上;
3)将所述第一导电类型的顶层外延层(103)覆盖于第一导电类型的缓变外延层区(102)上;完成整个MOSFET的高温加工制程,得到缓变掺杂的浓度分布。
3.根据权利要求1或2所述的一种功率MOSFET的缓变掺杂材料片及其制造方法,其特征在于:所述第一导电类型的高掺杂衬底(101)材料包括硅、碳化硅或氮化镓。
4.根据权利要求1或2所述的一种功率MOSFET的缓变掺杂材料片及其制造方法,其特征在于:所述过渡外延层的层数为N,1≤N≤10,每层厚度为1~10um。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN112510081A (zh) * 2020-11-30 2021-03-16 西安微电子技术研究所 一种星用抗辐射沟槽型mos场效应晶体管的加固结构和制备方法
CN117174738A (zh) * 2023-11-02 2023-12-05 苏州迈志微半导体有限公司 一种沟槽屏蔽栅mosfet器件及其制造方法和电子设备

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02188965A (ja) * 1989-01-17 1990-07-25 Fuji Electric Co Ltd エピタキシャル成長方法
JP2009158788A (ja) * 2007-12-27 2009-07-16 Oki Semiconductor Co Ltd 縦型mosfetおよび縦型mosfetの製造方法
CN105633019A (zh) * 2016-01-25 2016-06-01 中国电子科技集团公司第二十四研究所 一种双多晶自对准互补双极器件结构及其制作方法
CN107221559A (zh) * 2017-06-07 2017-09-29 重庆中科渝芯电子有限公司 一种用于功率mosfet器件的变掺杂半导体材料片及其制造方法

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02188965A (ja) * 1989-01-17 1990-07-25 Fuji Electric Co Ltd エピタキシャル成長方法
JP2009158788A (ja) * 2007-12-27 2009-07-16 Oki Semiconductor Co Ltd 縦型mosfetおよび縦型mosfetの製造方法
CN105633019A (zh) * 2016-01-25 2016-06-01 中国电子科技集团公司第二十四研究所 一种双多晶自对准互补双极器件结构及其制作方法
CN107221559A (zh) * 2017-06-07 2017-09-29 重庆中科渝芯电子有限公司 一种用于功率mosfet器件的变掺杂半导体材料片及其制造方法

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN112510081A (zh) * 2020-11-30 2021-03-16 西安微电子技术研究所 一种星用抗辐射沟槽型mos场效应晶体管的加固结构和制备方法
CN112510081B (zh) * 2020-11-30 2023-03-14 西安微电子技术研究所 一种星用抗辐射沟槽型mos管的加固结构和制备方法
CN117174738A (zh) * 2023-11-02 2023-12-05 苏州迈志微半导体有限公司 一种沟槽屏蔽栅mosfet器件及其制造方法和电子设备

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