CN108122543B - 数据驱动器和使用该数据驱动器的显示装置 - Google Patents

数据驱动器和使用该数据驱动器的显示装置 Download PDF

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Abstract

公开了一种数据驱动器和使用该数据驱动器的显示装置。该显示装置包括：显示面板，显示面板具有显示图像的显示区域；信号线，信号线包括数据线、第一电力线和感测线，信号线连接至显示面板；以及数据驱动器。数据驱动器包括连接至数据线并且输出数据信号的第一通道组、输出和感测感测电压的第二通道组、以及连接至第一电力线并且输出高电势电压的第三通道组。第一通道组和第三通道组被定义为第一输出单元，并且第二通道组被定义为第二输出单元。第二通道组每隔M个通道相继地设置，使得第二通道组连接至感测线，其中M是等于或大于2的整数。

Description

数据驱动器和使用该数据驱动器的显示装置
本申请要求于2016年11月30日提交的韩国专利申请号10-2016-0161663的权益，该专利申请通过引用并入本文，如同在本文中完全阐述一样。
技术领域
本公开内容涉及数据驱动器和使用该数据驱动器的显示装置。
背景技术
随着信息技术的发展，用作用户和信息之间的连接介质的显示装置的市场正在增长。因此，诸如有机发光二极管(OLED)显示器、液晶显示器(LCD)和等离子体显示面板(PDP)的显示装置的使用正在增多。
OLED显示器包括含有多个子像素的显示面板和用于驱动显示面板的驱动器。驱动器包括用于向显示面板提供扫描信号(或称为“栅极信号”)的扫描驱动器、用于向显示面板提供数据信号的数据驱动器等。
当将扫描信号和数据信号提供至以矩阵布置的子像素时，响应于扫描信号和数据信号而选择的子像素发光。因此，OLED显示器可以显示图像。
当OLED显示器使用了较长时间时，OLED显示器具有下述问题：包括在子像素中的部件中的一些部件经受特性(例如，阈值电压，电流迁移率等)的变化。为了补偿特性的变化，已经提出了根据相关技术的方法来添加用于感测包括在子像素中的部件的特性的感测电路。该方法通过连接至感测电路的感测线获得感测值并基于感测值对部件的特性进行补偿。
然而，随着感测电路的添加，感测线沿与数据线相同的方向设置在显示面板上。显示面板上的至少三个子像素彼此共享一个感测线。因此，一个感测线被设置在多个数据线之间。
因此，添加感测电路的相关技术的方法具有一个感测线与相邻于该一个感测线的左侧和右侧的数据线之一短路的高的可能性。如果在感测线和数据线之间发生短路，则共享被短路的感测线的所有子像素可能受到短路的影响。
发明内容
在一个方面，提供了一种显示装置，包括：显示面板，显示面板具有显示图像的显示区域；信号线，信号线包括数据线、第一电力线和感测线，信号线连接至显示面板；以及数据驱动器，数据驱动器包括连接至数据线并且输出数据信号的第一通道组、输出和感测感测电压的第二通道组、以及连接至第一电力线并且输出高电势电压的第三通道组，其中，第一通道组和第三通道组被定义为第一输出单元，并且第二通道组被定义为第二输出单元，并且其中，第二通道组每隔M个通道相继地设置，使得第二通道组连接至感测线，其中M是等于或大于2的整数。
在另一方面，提供了一种数据驱动器，包括被配置成输出数据信号的第一通道组、被配置成输出和感测感测电压的第二通道组和被配置成输出高电势电压的第三通道组，其中，第一通道组和第三通道组被定义为第一输出单元，并且第二通道组被定义为第二输出单元，并且其中，第二通道组每隔M个通道相继地设置，其中M是等于或大于2的整数。
附图说明
包括附图以提供对本发明的进一步理解，并且附图被并入本文中并构成该说明书的一部分，附图示出了本发明的实施方式并且与说明书一起用于解释本发明的原理。
图1是有机发光二极管(OLED)显示器的示意性框图；
图2示意性地示出子像素的电路配置；
图3详细示出了子像素的电路配置；
图4是显示面板的示例性截面图；
图5示意性地示出了子像素的平面布局；
图6示出了根据相关技术的数据驱动器的输出通道；
图7示出了安装有数据驱动器的显示面板的垫部的信号线；
图8是沿图7的线A1-A2截取的截面图；
图9示出了根据相关技术的结构的问题；
图10示出了根据本公开内容的第一实施方式的数据驱动器的输出通道的布置构思；
图11详细示出了根据本公开内容的第一实施方式的图10所示的数据驱动器的输出通道；
图12示出了安装有数据驱动器的显示面板的垫部的信号线；
图13是沿图12的线B1-B2截取的截面图；
图14示出了链接部周围的信号线；
图15是沿图14的线C1-C2截取的截面图；
图16示出了根据本公开内容的第二实施方式的数据驱动器的输出通道的布置构思；
图17详细示出了根据本公开内容的第二实施方式的图16所示的数据驱动器的输出通道；
图18示出了安装有数据驱动器的显示面板的垫部的信号线；
图19是沿图18的线D1-D2截取的截面图；
图20示出了链接部周围的信号线；
图21是沿图20的线E1-E2截取的截面图；
图22示出了根据本公开内容的第三实施方式的数据驱动器的输出通道；以及
图23示出了根据本公开内容的第四实施方式的数据驱动器的输出通道。
具体实施方式
现在将详细参考本公开内容的实施方式，其示例在附图中示出。为了便于说明本文提供的实施方式，在整个附图中将使用相同的附图标记来指代相同或相似的部分。在本公开内容中，如果确定对已知部件或功能的详细描述可能误导或以其他方式模糊本公开内容的实施方式的描述，则可以省略对这些已知部件或功能的详细描述。
根据实施方式的显示装置可以实现为电视系统、视频播放器、个人计算机(PC)、家庭影院系统和智能电话等。在下面的描述中，作为示例，根据实施方式的显示装置可以是基于有机发光二极管(或发光元件)实现的有机发光二极管(OLED)显示器。根据实施方式的OLED显示器执行用于显示图像的图像显示操作和用于补偿部件随时间变化的特性(或时变特性)的外部补偿操作。
外部补偿操作可以在图像显示操作期间的垂直消隐间隔、图像显示操作开始之前的通电序列间隔、或图像显示操作结束之后的断电序列间隔中执行。垂直消隐间隔是不施加用于图像显示的数据信号期间的时间段，并且被布置在施加用于一帧的数据信号的垂直活动时段之间。
通电序列间隔是用于驱动显示装置的电源开启与图像显示时段开始之间的时间段，在该图像显示时段期间图像被显示在显示装置上。断电序列间隔是图像显示时段结束与用于驱动装置的电源关闭之间的时间段。
执行外部补偿操作的外部补偿方法可以以源极跟随器的方式操作驱动晶体管，然后感测存储在感测线的线电容器中的电压(例如，驱动晶体管的源极电压)，但不限于此。线电容器指的是存在于感测线上的比电容。
为了补偿驱动晶体管的阈值电压的变化，当驱动晶体管的源极节点的电压饱和时(即，当驱动晶体管的电流Ids为0时)，外部补偿方法感测源极电压。此外，为了补偿驱动晶体管的迁移率的变化，外部补偿方法在驱动晶体管的源极节点的电压饱和之前以线性状态感测源极节点的电压。
在下面的描述中，根据薄膜晶体管的类型，薄膜晶体管的除了栅电极之外的电极可以被称为源电极和漏电极或者漏电极和源电极。此外，在下面的描述中，薄膜晶体管的源电极和漏电极或者漏电极和源电极可以被称为第一电极和第二电极。
图1是OLED显示器的示意性框图。图2示意性地示出子像素的电路配置。图3详细示出子像素的电路配置。图4是显示面板的示例性截面图。图5示意性地示出子像素的平面布局。
如图1所示，根据实施方式的OLED显示器包括图像处理单元110、时序控制器120、数据驱动器130、扫描驱动器140和显示面板150。
图像处理单元110输出从显示装置的外部提供的数据信号DATA和数据使能信号DE。除了数据信号DATA和数据使能信号DE之外，图像处理单元110还可以输出垂直同步信号、水平同步信号和时钟信号中的一个或多个。为了简洁和便于阅读起见，这些信号未示出。
时序控制器120从图像处理单元110接收数据信号DATA和数据使能信号DE，并且还可以接收包括垂直同步信号、水平同步信号、时钟信号等的驱动信号。时序控制器120输出用于控制扫描驱动器140的操作时序的栅极时序控制信号GDC和用于基于驱动信号控制数据驱动器130的操作时序的数据时序控制信号DDC。
数据驱动器130响应于从时序控制器120提供的数据时序控制信号DDC采样并锁存从时序控制器120接收到的数据信号DATA，并且使用伽马参考电压转换所采样和锁存的数据信号DATA。数据驱动器130输出转换的数据信号DATA至数据线DL1至DLn。数据驱动器130可以形成为集成电路(IC)。
扫描驱动器140响应于从时序控制器120提供的栅极时序控制信号GDC输出扫描信号。扫描驱动器140输出扫描信号至扫描线GL1至GLm。扫描驱动器140形成为IC或者以面板内栅极(GIP)方式形成在显示面板150上。
显示面板150响应于分别从数据驱动器130和扫描驱动器140接收到的数据信号DATA和扫描信号显示图像。显示面板150包括被配置成显示图像的子像素SP。
子像素SP可以包括红色、绿色和蓝色子像素，或者可以包括白色、红色、绿色和蓝色子像素。根据发射特性子像素SP可以具有一个或更多个不同的发光区域。
如图2所示，每个子像素可以包括开关晶体管SW、驱动晶体管DR、电容器Cst、补偿电路CC和有机发光二极管OLED。
开关晶体管SW执行开关操作，使得通过第一数据线DL1提供的数据信号响应于通过第一扫描线GL1提供的扫描信号而被存储在电容器Cst中作为数据电压。驱动晶体管DR使得驱动电流能够基于存储在电容器Cst中的数据电压在第一电力线(或称为“高电势电力线”)EVDD和第二电力线(或称为“低电势电力线”)EVSS之间流动。有机发光二极管OLED根据由驱动晶体管DR提供的驱动电流发光。
补偿电路CC是被添加至子像素并补偿驱动晶体管DR的诸如阈值电压等的特性的电路。补偿电路CC包括一个或更多个晶体管。取决于外部补偿方法补偿电路CC的配置可以根据各种实施方式不同地改变并且在下面参照图3进行描述。
如图3所示，补偿电路CC可以包括感测晶体管ST和感测线(或称为“参考线”)VREF。感测晶体管ST连接在感测线VREF和被电耦接至驱动晶体管DR的源电极及被耦接至有机发光二极管OLED的阳电极的节点(以下称为“感测节点”)之间。感测晶体管ST可以将通过感测线VREF传输的感测电压(或称为“初始化电压或参考电压”)提供至驱动晶体管DR的感测节点，或者可以感测驱动晶体管DR的感测节点的电压或电流(即，存在于线电容器中的电压或电流)或感测线VREF的电压或电流(即，存在于线电容器中的电压或电流)。
开关晶体管SW的第一电极连接至第一数据线DL1，且开关晶体管SW的第二电极连接至驱动晶体管DR的栅电极。驱动晶体管DR的第一电极连接至第一电力线EVDD，且驱动晶体管DR的第二电极连接至有机发光二极管OLED的阳电极。电容器Cst的第一电极连接至驱动晶体管DR的栅电极，且电容器Cst的第二电极连接至有机发光二极管OLED的阳电极。有机发光二极管OLED的阳电极连接至驱动晶体管DR的第二电极，且有机发光二极管OLED的阴电极连接至第二电力线EVSS。感测晶体管ST的第一电极连接至感测线VREF，且感测晶体管ST的第二电极连接至感测节点，即有机发光二极管OLED的阳电极和驱动晶体管DR的第二电极。
感测晶体管ST的操作时间根据外部补偿算法(或根据补偿电路的配置)可以类似于(或相同)或不同于开关晶体管SW的操作时间。例如，开关晶体管SW的栅电极可以连接至1a扫描线GL 1a，且感测晶体管ST的栅电极可以连接至1b扫描线GL 1b。在这种情况下，扫描信号(Scan)可以被发送至1a扫描线GL 1a，且感测信号(Sense)可以被发送至1b扫描线GL1b。作为另一示例，开关晶体管SW的栅电极和感测晶体管ST的栅电极可以共享1a扫描线GL1a或1b扫描线GL 1b，因而开关晶体管SW的栅电极和感测晶体管ST的栅电极可以被连接。
感测线VREF可以连接至数据驱动器，例如图1所示的数据驱动器130。在这种情况下，数据驱动器可以在实时图像的非显示时段或N帧时段期间经由感测线VREF感测子像素的感测节点并生成感测的结果，其中N是等于或大于1的整数。开关晶体管SW和感测晶体管ST可以同时导通。在这种情况下，根据数据驱动器的时分方法，使用感测线VREF的感测操作和用于基于由数据驱动器输出的数据信号驱动有机发光二极管OLED的数据输出操作被相互分离(或区分开)。
此外，根据感测结果的补偿目标可以是数字数据信号、模拟数据信号、伽马信号等。用于基于感测结果生成补偿信号(或补偿电压)的补偿电路可以实现为在数据驱动器内部、在时序控制器内部或作为单独的电路。
遮光层LS可以仅被设置在驱动晶体管DR的沟道区的下方。可替代地，遮光层LS可以被设置在驱动晶体管DR的沟道区的下方以及开关晶体管SW的沟道区和感测晶体管ST的沟道区的下方。遮光层LS可以简单地用于屏蔽外部的光。此外，遮光层LS可以连接至另一个电极或另一条线并用作构成电容器等的电极。因此，遮光层LS可以被设置为由金属形成的多层元件(例如，两种不同金属的多层)，以具有遮光特性。
图3通过示例的方式示出了具有3T(晶体管)1C(电容器)配置的子像素，包括开关晶体管SW、驱动晶体管DR、电容器Cst、有机发光二极管OLED和感测晶体管ST。然而，当补偿电路CC被添加至子像素时，子像素可以具有各种配置，例如3T2C、4T2C、5T1C和6T2C。
如图4所示，子像素形成在第一衬底(或称为“薄膜晶体管衬底”)150a的显示区域AA上，并且每个子像素可以具有图3所示的电路结构。显示区域AA上的子像素通过保护膜(或称为“保护衬底”)150b密封。在图4中，标记“NA”表示显示面板150的非显示区域。第一衬底150a可以由诸如玻璃的刚性或半刚性材料形成，或者可以由柔性材料形成。
子像素被布置在第一衬底150a的表面上，并且根据第一衬底150a的取向，可以在显示区域AA上以红色(R)、白色(W)、蓝色(B)和绿色(G)子像素的顺序被水平地或竖直地布置。红色(R)、白色(W)、蓝色(B)和绿色(G)子像素一起形成一个像素P。然而，实施方式不限于此。例如，子像素的布置顺序可以根据发光材料、发光区域、补偿电路的配置(或结构)等而不同地变化。此外，红色(R)、蓝色(B)和绿色(G)子像素可以形成一个像素P。
如图4和图5所示，均具有发光区域EMA和电路区域DRA的第一子像素SPn1至第四子像素SPn4形成在第一衬底150a的显示区域AA上。有机发光二极管(或发光元件)形成在发光区域EMA中，且用于驱动有机发光二极管的包括开关晶体管、感测晶体管、驱动晶体管等的电路形成在电路区域DRA中。发光区域EMA和电路区域DRA中的元件通过薄膜沉积工艺形成并包括多个金属层和多个绝缘层。
在第一子像素SPn1至第四子像素SPn4中，发光区域EMA中的有机发光二极管根据电路区域DRA中的开关晶体管和驱动晶体管的操作发光。在与第一子像素SPn1至第四子像素SPn4中的每一个子像素相邻的区域提供线部(或称为“线区域”)WA。也就是说，线部WA可以是包括相应子像素之间的所有区域的复合区域。第一电力线EVDD、感测线VREF和第一数据线DL1至第四数据线DL4被设置在线部WA中。第一电力线EVDD通过第一电力连接线EVDDC连接至所有第一子像素SPn1至第四子像素SPn4。感测线VREF通过感测连接线VREFC连接至所有第一子像素SPn1至第四子像素SPn4。
例如，第一电力线EVDD可以位于第一子像素SPn1的左侧，感测线VREF可以位于第二子像素SPn2的右侧，且第一数据线DL1和第二数据线DL2可以位于第一子像素SPn1和第二子像素SPn2之间。感测线VREF可以位于第三子像素SPn3的左侧，第一电力线EVDD还可以位于第四子像素SPn4的右侧，且第三数据线DL3和第四数据线DL4可以位于第三子像素SPn3和第四子像素SPn4之间。
第一子像素SPn1可以被电连接至第一子像素SPn1的左侧的第一电力线EVDD、第一子像素SPn1的右侧的第一数据线DL1和第二子像素SPn2的右侧的感测线VREF。第二子像素SPn2可以被电连接至第一子像素SPn1的左侧的第一电力线EVDD、第二子像素SPn2的左侧的第二数据线DL2和第二子像素SPn2的右侧的感测线VREF。
第三子像素SPn3可以被电连接至第三子像素SPn3的左侧的感测线VREF、第三子像素SPn3的右侧的第三数据线DL3和第四子像素SPn4的右侧的第一电力线EVDD。第四子像素SPn4可以被电连接至第三子像素SPn3的左侧的感测线VREF、第四子像素SPn4的左侧的第四数据线DL4和第四子像素SPn4的右侧的第一电力线EVDD。
第一子像素SPn1至第四子像素SPn4可以被公共地连接至第二子像素SPn2和第三子像素SPn3之间的感测线VREF。换言之，第一子像素SPn1至第四子像素SPn4可以彼此共享感测线VREF。然而，实施方式不限于此。
诸如第一电力线EVDD和感测线VREF的线以及构成薄膜晶体管的电极位于不同的层上，但是通过接触孔(或通孔)彼此电连接。接触孔通过干式或湿式蚀刻工艺形成，以部分地露出电极、信号线或位于子像素的下部的电力线。
如上所述，随着感测电路的添加，感测线VREF沿与数据线DL1至DLn相同的方向被设置在显示面板150上。显示面板150上的至少三个子像素彼此共享一个感测线VREF。因此，一个感测线VREF被设置在多个数据线DL1至DLn之间。然而，用于添加感测电路的方法具有一个感测线VREF与相邻于感测线VREF的左侧和右侧的数据线中的一个短路的较高的可能性。
在下文中，将描述用于讨论相关技术的问题并解决问题的本公开内容的实施方式。
<相关技术>
图6示出了根据相关技术的数据驱动器的输出通道。图7示出了安装有数据驱动器的显示面板的垫部的信号线。图8是沿图7的线A1-A2截取的截面图。图9示出了根据相关技术的结构的问题。
如图6所示，相关技术的数据驱动器130包括：输出数据信号的第一通道组CH1、CH2、CH4和CH5；输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组CH3；以及输出高电势电压的第三通道组CH6。第一通道组CH1、CH2、CH4和CH5连接至数据线DL1至DL4。第二通道组CH3连接至感测线VREF，且第三通道组CH6连接至第一电力线EVDD。
相关技术的数据驱动器130基于第一通道组CH1、CH2、CH4、CH5和第三通道组CH6输出用于驱动子像素的数据信号和高电势电压。相关技术的数据驱动器130基于第二通道组CH3输出用于感测子像素的感测电压(例如，初始化电压或参考电压等)并且还感测输出电压(或电流)。为了便于说明，图6示出了一个第二通道组CH3。然而，提供了多个第二通道组CH3。
在包括如上所述执行不同目的的多个通道CH1至CHn的相关技术的数据驱动器130中，第一通道CH1至第n通道CHn按照第一通道组CH1、CH2、CH4与CH5，第二通道组CH3以及第三通道组CH6的顺序布置。该布置除了数据驱动器130的通道组的输入和输出特性之外还考虑了在显示面板上的通道组和信号线(以下，包括数据线、第一电力线和感测线)之间的链接。
参照示出显示面板的垫部的图7，在数据线G、B、W和R之间设置有感测线VREF，并且在最后的数据线R之外设置有第一电力线EVDD。换言之，连接至显示面板的垫部的各种信号线根据数据驱动器130的通道CH1至CH6的布置被设置。
在图8中，“BUF”是位于第一衬底150a上的缓冲层，且“ILD”是位于缓冲层上方的绝缘层。在图7中，数据线用“G、B、W和R”表示以指示数据线以指定顺序被分别地连接至绿色(G)、蓝色(B)，白色(W)和红色(R)子像素。然而，子像素可以以其他顺序布置。
如图7和图8所示，数据线G、B、W和R、感测线VREF以及第一电力线EVDD由源极漏极金属层SD和第一电极层PXL构成。换言之，数据线G、B、W和R、感测线VREF以及第一电力线EVDD使用相同的金属层形成在第一衬底150a上。
如上所述，相关技术被配置成使得数据线G、B、W和R以及感测线VREF通过相同的工艺使用相同的材料形成，并且一个感测线VREF被设置在数据线G、B、W和R之间。因此，相关技术具有感测线VREF与相邻于感测线VREF的左侧和右侧的数据线G、B、W和R中的一个短路的较高的可能性。
此外，相关技术具有如下的较高的可能性：当外部材料PTC在制造显示面板的过程中进入感测线VREF时，在感测线路VREF与相邻于感测线VREF的左侧和右侧的数据线G、B、W和R中的一个之间可能发生外部短路。
作为示例，图7和图8示出了相对较大的外部材料PTC。然而，即使当外部材料PTC的尺寸相对较小时，也存在如下的较高的可能性：随着时间的推移，相邻于外部材料PTC的两种不同类型的信号线之间会发生渐进式短路。
根据实验，随着感测线VREF以及数据线G、B、W和R之间的外部短路的范围和影响随着时间的推移增加，外部短路趋向于发展为渐进式短路。此外，根据实验，感测线VREF与数据线G、B、W和R之间的短路很多发生在附接有数据驱动器的垫部或连接信号线的链接部中。链接部被设置在显示面板的显示区域外的非显示区域中。
当短路发生在感测线VREF和数据线G、B，W和R中的一个之间时，充载至子像素的执行感测操作的线电容器的电荷流向短路的数据线，从而获得不准确的感测结果(例如，感测电压的降低)。
如上所述，当短路发生在两种不同类型的信号线之间时，短路不仅影响相应的子像素而且影响其周围。因此，如图9的PNT1部分所示，在显示面板150的显示区域AA中出现诸如竖直线的线缺陷的显示缺陷。在图9中，“130A至130C”表示安装在柔性衬底上的数据驱动器。
因此，用于添加感测电路的相关技术的方法具有如下的较高的可能性：一个感测线VREF与相邻于该一个感测线VREF的左侧和右侧的数据线G、B、W和R中的一个短路。如果短路发生在两种不同类型的信号线之间，则共享一个感测线VREF的所有子像素可能受到短路的影响。
<第一实施方式>
图10示出了根据本公开内容的第一实施方式的数据驱动器的输出通道的布置构思。图11详细示出了根据本公开内容的第一实施方式的图10所示的数据驱动器的输出通道。图12示出了安装有数据驱动器的显示面板的垫部的信号线。图13是沿图12的线B1-B2截取的截面图。图14示出了链接部周围的信号线。图15是沿图14的线C1-C2截取的截面图。
如图10所示，根据本公开内容的第一实施方式的数据驱动器130包括具有输出数据信号的第一通道组和输出高电势电压的第三通道组的第一输出单元DATAA、以及具有输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组的第二输出单元VREFA。
由于具有通道组的数据驱动器130的输出单元DATAA和VREFA被如上所述配置，信号线的交叉区域形成在链接部“Link”中使得信号线连接至设置在显示面板150的显示区域AA的子像素。链接部“Link”被设置在显示面板150的显示区域AA之外的非显示区域中。下面详细描述链接部“Link”以及输出单元DATA和VREFA。
如图11所示，根据本公开内容的第一实施方式的数据驱动器130包括第一输出单元DATAA和被设置在第一输出单元DATAA的左侧和右侧的第二输出单元VREFA。第二输出单元VREFA被设置在第一输出单元DATAA的左侧和右侧，并且包括在第二输出单元VREFA中的通道的数目被相等地或不相等地划分。所需的感测线的数目可以根据子像素的感测方法或感测线的设计而变化。此外，一个像素可以不包括四个子像素而是包括三个子像素，或者构成一个像素的子像素中的仅一些子像素可以被选择性地连接至感测线并进行补偿。因此，感测线的数目可以变化。此外，包括在第二输出单元VREFA中的通道的数目可以取决于感测线的数目而不相等地划分。
第一输出单元DATAA包括输出数据信号的第一通道组CHh、Chi、CHk、CHl、...、CHm和输出高电势电压的第三通道组CHj。第一通道组CHh、Chi、CHk、CH1、...、CHm连接至数据线DL1至DL4、...、DLm。第三通道组CHj连接至第一电力线EVDD。为了便于说明，图11示出了一个第三通道组CHj。然而，提供了多个第三通道组CHj。
第二输出单元VREFA包括输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组CH1、CH2、CH3、...、CHn。第二通道组CH1、CH2、CH3、...、CHn每隔M个通道相继地设置，使得它们连接至感测线VREF1至VREF3、...、VREFn，其中M是等于或大于2的整数。
根据本公开内容的第一实施方式的数据驱动器130基于第一输出单元DATAA的第一通道组CHh、Chi、CHk、CH1、...、CHm和第三通道组CHj输出用于驱动子像素的数据信号和高电势电压。此外，根据本公开内容的第一实施方式的数据驱动器130基于第二输出单元VREFA的第二通道组CH1、CH2、CH3、...、CHn输出用于感测子像素的感测电压并且感测输出电压(或电流)。
在根据本公开内容的第一实施方式的包括执行如上所述的不同目的的多个通道CH1至CHn的数据驱动器130中，第一通道CH1至第n通道CHn按照第二输出单元VREFA、第一输出单元DATAA和第二输出单元VREFA的顺序布置。该布置除了显示面板上的通道组和信号线之间的链接之外还考虑了数据驱动器130的通道组的输入输出特性。
参照示出显示面板的垫部的图12，感测线VREF1至VREF3和数据线B、G、W和R彼此间隔开，并且第一电力线EVDD被设置在数据线B、G、W和R之间。换言之，根据数据驱动器130的输出单元VREFA和DATAA的布置来设置连接至显示面板的垫部的各种信号线。
在图13中，“BUF”是位于第一衬底150a上的缓冲层，且“ILD”是位于缓冲层上方的绝缘层。在图12中，数据线用“G、B、W和R”表示以指示数据线以指定顺序被分别地连接至绿色(G)、蓝色(B)、白色(W)和红色(R)子像素。然而，子像素可以以其他顺序布置。
如图12和图13所示，数据线B、G、W和R由源极漏极金属层SD和第一电极层PXL构成。第三感测线VREF由遮光层VREF3_LS、源极漏极金属层VREF3_SD和第一电极层VREF3_PXL构成。换言之，第三感测线VREF以及数据线B、G、W和R基于相同的金属层形成在第一衬底150a上。然而，第三感测线VREF还包括位于第一衬底150a的最下层处的遮光层VREF3_LS。尽管未示出，第一电源线EVDD基于与数据线B、G、W和R相同的金属层形成在第一衬底150a上。
如上所述，本公开内容的第一实施方式被配置成使得数据线B、G、W和R以及感测线VREF1至VREF3通过相同的工艺使用相同的材料形成并且彼此间隔开。此外，第一电力线EVDD以与相关技术相同的方式被设置在数据线B、G、W和R之间。在本公开内容的第一实施方式中，感测线VREF1至VREF3不被设置在数据线B、G、W和R之间而是与数据线B、G、W和R间隔开。因此，本公开内容的第一实施方式在两种不同类型的信号线之间发生短路的可能性很低。
此外，本公开内容的第一实施方式具有如下的低可能性：即使在外部材料PTC在制造显示面板的过程中进入感测线VREF1至VREF3时，在两种不同类型的数据线(即，感测线VREF1至VREF3以及数据线B、G、W和R)之间发生外部短路，原因是在感测线的左侧和右侧设置了相同类型的其他感测线。
根据实验，与由不同类型的信号线(例如，感测线VREF1至VREF3以及数据线B、G、W和R)之间的短路引起的问题相比，由相同类型的信号线之间的短路引起的问题相对不那么严重。当在不同类型的信号线之间发生短路时，至少三个或四个子像素受短路影响。然而，当在相同类型的信号线之间发生短路时，只有两个子像素受短路影响。此外，当在不同类型的信号线之间发生短路时，由输入电压和输出电压之间的差异引起电路的损坏或错误的操作。然而，当在相同类型的信号线之间发生短路时，由被施加至两个短路信号线的电压之间的差异仅引起出现亮度变化。
根据本公开内容的第一实施方式，即使当产生外部短路时，第一实施方式可以在相同类型的信号线之间而不是在不同类型的信号线之间产生外部短路，从而与相关技术相比减轻了短路所产生的问题。此外，本公开内容的第一实施方式在感测线VREF1至VREF3以及数据线B、G、W和R之间发生短路的可能性很低。因此，第一实施方式可以解决如下问题：当充载至子像素的执行感测操作的线电容器的电荷流向短路的数据线时引起的不准确的感测结果(例如，感测电压的降低)。
根据实验，感测线VREF1至VREF3和数据线B、G、W和R之间的短路很多发生在附接有数据驱动器的垫部或连接信号线的链接部中。因此，本公开内容的第一实施方式提出了以下面的层级结构定位在链接部中的感测线VREF1至VREF3。
如图14和图15所示，第三感测线VREF3被设置在第十一数据线DL11至第十四数据线DL14的右外侧，但是被公共地连接至第十一子像素SP11至第十四子像素SP14。第三感测线VREF3被设置在第十二子像素SP12和第十三子像素SP13之间。
第三感测线VREF3被设置在第十二数据线DL12和第十三数据线DL13之间并且在竖直方向上被延伸至显示面板的下部。因此，第三感测线VREF3在链接部“Link”中沿斜方向(或对角方向)设置，并且第三感测线VREF3与第十二数据线DL12和第十三数据线DL13之间的交叉形成在链接部“Link”中。
第三感测线VREF3在显示区域AA中沿直方向设置。换言之，第三感测线VREF3具有在非显示区域的链接部“Link”中沿斜方向设置的斜线区域，并且具有在显示区域AA的线部中沿直方向设置的直线区域。
从图15中可以看出，第三感测线VREF3包括存在于链接部“Link”中的最下层处的遮光层VREF3_LS，但在显示区域AA中包括遮光层VREF3_LS和源极漏极金属层VREF3_SD。另一方面，第十一数据线DL11至第十四数据线DL14在显示区域AA以及链接部“Link”中沿直方向设置并且在显示区域AA和链接部“Link”中仅包括源极漏极金属层DL11_SD至DL14_SD。
如上所述，本公开内容的第一实施方式通过示例的方式描述了第三感测线VREF3除了链接部中的源极漏极金属层VREF3_SD之外还包括遮光层VREF3_LS。然而，实施方式不限于此。
<第二实施方式>
图16示出了根据本公开内容的第二实施方式的数据驱动器的输出通道的布置构思。图17详细示出了根据本公开内容的第二实施方式的图16所示的数据驱动器的输出通道。图18示出了安装有数据驱动器的显示面板的垫部的信号线。图19是沿图18的线D1-D2截取的截面图。图20示出了链接部周围的信号线。图21是沿图20的线E1-E2截取的截面图。
如图16所示，根据本公开内容的第二实施方式的数据驱动器130包括具有输出数据信号的第一通道组和输出高电势电压的第三通道组的第一输出单元DATAA、以及具有输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组的第二输出单元VREFA。
由于具有通道组的数据驱动器130的输出单元DATAA和VREFA如上所述配置，信号线的交叉区域形成在链接部“Link”中使得信号线连接至设置在显示面板150的显示区域AA中的子像素。下面详细描述链接部“Link”和输出单元DATAA和VREFA。
如图17所示，根据本公开内容的第二实施方式的数据驱动器130包括第二输出单元VREFA和被设置在第二输出单元VREFA的左侧和右侧的第一输出单元DATAA。第一输出单元DATAA被设置在第二输出单元VREFA的左侧和右侧，并且包括在第一输出单元DATAA中的通道的数目被相等地或不相等地划分。包括在第一输出单元DATAA中的通道的数目被相等地或不相等地划分的事实意味着包括在第一输出单元DATAA中的通道的数目可以取决于子像素的布置而变化。
第一输出单元DATAA包括输出数据信号的第一通道组CH1、CH2、...、CHn以及输出高电势电压的第三通道组CH3、...、CHn-2。第一通道组CH1、CH2、...、CHn连接至数据线DL1、DL2、...、DLn。第三通道组CH3、...、CHn-2连接至第一电力线EVDD。为了便于说明，图17示出了两个第三通道组。然而，提供了多个第三通道组。
第二输出单元VREFA包括输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组CHh、Chi、CHj、CHk、...、CHm。第二通道组CHh、Chi、CHj、CHk、...、CHm每隔M个通道相继地设置，使得它们连接至感测线VREF1至VREF4、...、VREFm，其中M是等于或大于2的整数。
根据本公开内容的第二实施方式的数据驱动器130基于第一输出单元DATAA的第一通道组CH1、CH2、...、CHn和第三通道组CH3、...、CHn-2输出用于驱动子像素的数据信号和高电势电压。此外，根据本公开内容的第二实施方式的数据驱动器130基于第二输出单元VREFA的第二通道组CHh、Chi、CHj、CHk、...、CHm输出用于感测子像素的感测电压并且感测输出电压(或电流)。
在根据本公开内容的第二实施方式的包括如上所述执行不同目的的多个通道CH1至CHn的数据驱动器130中，第一通道CH1至第n通道CHn按照第一输出单元DATAA、第二输出单元VREFA和第一输出单元DATAA的顺序布置。该布置除了显示面板上的通道组和信号线之间的链接之外还考虑了数据驱动器130的通道组的输入输出特性。
参照示出显示面板的垫部的图18，感测线VREFh至VREFj和数据线B、G、W和R彼此间隔开，且第一电力线EVDD被设置在数据线B、G、W和R之间。换言之，连接至显示面板的垫部的各种信号线根据数据驱动器130的输出单元VREFA和DATAA的布置被设置。
在图19中，“BUF”是位于第一衬底150a上的缓冲层，且“ILD”是位于缓冲层上方的绝缘层。在图19中，数据线用“G、B、W和R”表示以指示数据线以指定顺序被分别地连接至绿色(G)、蓝色(B)、白色(W)和红色(R)子像素。然而，子像素可以以其他顺序布置。
如图18和图19所示，数据线B、G、W和R由源极漏极金属层SD和第一电极层PXL构成。第j感测线VREFj由遮光层VREFj_LS、源极漏极金属层VREFj_SD和第一电极层VREFj_PXL构成。即，第j感测线VREFj以及数据线B、G、W和R基于相同的金属层形成在第一衬底150a上。然而，第j感测线VREFj还包括位于最下层处的遮光层VREFj_LS。尽管未示出，第一电力线EVDD基于与数据线B、G、W和R相同的金属层形成在第一衬底150a上。
如上所述，本公开内容的第二实施方式被配置成使得数据线B、G、W和R以及感测线VREFh至VREFj通过相同的工艺使用相同的材料形成并且彼此间隔开。此外，第一电力线EVDD以与相关技术相同的方式被设置在数据线B、G、W和R之间。在本公开内容的第二实施方式中，感测线VREFh至VREFj不被设置在数据线B，G，W和R之间而是与数据线B、G、W和R间隔开。因此，本公开内容的第二实施方式在两种不同类型的信号线之间发生短路的可能性很低。
此外，本公开内容的第二实施方式具有如下的低可能性：即使在外部材料PTC在制造显示面板的过程中进入感测线VREFh至VREFj时，在两种不同类型的信号线(即，感测线VREFh至VREFj以及数据线B、G、W和R)之间发生外部短路，原因是在感测线的左侧和右侧设置了相同类型的其他感测线。
根据实验，与由不同类型的信号线(例如，感测线VREFh至VREFj以及数据线B、G、W和R)之间的短路引起的问题相比，由相同类型的信号线之间的短路引起的问题相对不那么严重。当在不同类型的信号线之间发生短路时，至少三个或四个子像素受短路影响。然而，当在相同类型的信号线之间发生短路时，仅有两个子像素受短路影响。此外，当在不同类型的信号线之间发生短路时，由输入电压和输出电压之间的差异引起电路的损坏或错误的操作。然而，当在相同类型的信号线之间发生短路时，由被施加至两个短路信号线的电压之间的差异仅引起出现亮度变化。
根据本公开内容的第二实施方式，即使当产生外部短路时，第二实施方式可以在相同类型的信号线之间而不是在不同类型的信号线之间产生外部短路，从而与相关技术相比减轻了短路引起的问题。此外，本公开内容的第二实施方式在感测线VREFh至VREFj以及数据线B、G、W和R之间发生短路的可能性非常低。因此，第二实施方式可以解决如下问题：当充载至子像素的执行感测操作的线电容器的电荷流向短路的数据线时引起的不准确的感测结果(例如，感测电压的降低)。
根据实验，感测线VREFh至VREFj与数据线B、G、W和R之间的短路很多发生在附接有数据驱动器的垫部或连接信号线的链接部中。因此，本公开内容的第二实施方式提出了在下面的层级结构中感测线VREFh至VREFj位于链接部中。
在图21中，“BUF”是位于第一衬底150a上的缓冲层，“GI”是位于缓冲层上方的栅极绝缘层，且“ILD”是位于栅极绝缘层上方的层间绝缘层。
如图20和图21所示，第j感测线VREFj被设置在第三十一数据线DL31至第三十四数据线DL34的右外侧，但是被公共地连接至第三十一子像素SP31至第三十四子像素SP34。第j感测线VREFj被设置在第三十二子像素SP32和第三十三子像素SP33之间。
第j感测线VREFj被设置在第三十二数据线DL32和第三十三数据线DL33之间并且在竖直方向上被延伸至显示面板的下部。因此，第j感测线VREFj在链接部“Link”中以斜方向(或对角方向)设置，并且第j感测线VREFj与第三十一数据线DL31和第三十二数据线DL32之间的交叉形成在链接部“Link”中。
第j感测线VREFj在显示区域AA中沿直方向设置。换言之，第j感测线VREFj具有在非显示区域的链接部“Link”中沿斜方向设置的斜线区域，并且具有在显示区域AA的线部中沿直方向设置的直线区域。
从图21可以看出，第j感测线VREFj在链接部“Link”中包括存在于最下层处的遮光层VREFj_LS以及遮光层VREFj_LS上的栅极金属层VREFj_GAT。另一方面，第j感测线VREFj在显示区域AA中除了包括遮光层VREFj_LS和栅极金属层VREFj_GAT以外还包括栅极金属层VREFj_GAT上的源极漏极金属层VREFj_SD。此外，第三十一数据线DL31至第三十四数据线DL34在显示区域AA以及链接部“Link”中沿直方向设置，并且在显示区域AA和链接部“Link”中仅包括源极漏极金属层DL31_SD至DL33_SD。
如上所述，本公开内容的第二实施方式通过示例的方式描述了第j感测线VREFj除了链接部分中的源极漏极金属层VREFj_SD之外还包括遮光层VREFj_LS和栅极金属层VREFj_GAT。然而，实施方式不限于此。
此外，数据驱动器的输出通道可以以如第一实施方式和第二实施方式以以下方式配置，以便降低不同类型的信号线之间短路的可能性。
<第三实施方式>
图22示出了根据本公开内容的第三实施方式的数据驱动器的输出通道。
如图22所示，根据本公开内容的第三实施方式的数据驱动器130包括按照指定顺序设置的第二输出单元VREFA和第一输出单元DATAA。因此，根据本公开内容的第三实施方式的数据驱动器130的第一通道CH1至第n通道CHn按照第二输出单元VREFA、第一输出单元DATAA、...、第二输出单元VREFA和第一个输出单元DATAA的顺序布置。
第二输出单元VREFA包括输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组CH1至CH3。第二通道组CH1至CH3连接至感测线VREF1至VREF3。
第一输出单元DATAA包括输出数据信号的第一通道组CH4至CH15和输出高电势电压的第三通道组CH16。第一通道组CH4至CH15连接至数据线DL1至DL12。第三通道组CH16连接至第一电力线EVDD。为了便于说明，图22示出了一个第三通道组CH16。然而，提供了多个第三通道组CH16，并且第三通道组CH16的位置不限于此。
图22通过示例的方式示出了基于三个单位像素布置通道组，每个单位像素包括四个子像素R、W、G和B。因此，图22通过示例的方式示出了作为最小单位的三个第二通道组CH1至CH3、十二个第一通道组CH4至CH15和一个第三通道组CH16。然而，实施方式不限于此。
<第四实施方式>
图23示出了根据本公开内容的第四实施方式的数据驱动器的输出通道。
如图23所示，根据本公开内容的第四实施方式的数据驱动器130包括按照指定顺序设置的第一输出单元DATAA和第二输出单元VREFA。因此，根据本公开内容的第四实施方式的数据驱动器130的第一通道CH1至第n通道CHn按照第一输出单元DATAA、第二输出单元VREFA、...、第一输出单元DATAA和第二个输出单元VREFA的顺序布置。
第一输出单元DATAA包括输出数据信号的第一通道组CH1至CH12和输出高电势电压的第三通道组CH13。第一通道组CH1至CH12连接至数据线DL1至DL12。第三通道组CH13连接至第一电力线EVDD。为了便于说明，图23示出了一个第三通道组CH13。然而，提供了多个第三通道组CH13，并且第三通道组CH13的位置不限于此。
第二输出单元VREFA包括输出和感测感测电压(例如，初始化电压或参考电压等)的第二通道组CH14至CH16。第二通道组CH14至CH16连接至感测线VREF1至VREF3。
图23通过示例的方式示出了基于三个单位像素布置通道组，每个单位像素包括四个子像素R、W、G和B。因此，图23通过示例的方式示出了作为最小单位的十二个第一通道组CH1至CH12、一个第三通道组CH13和三个第二通道组CH14至CH16。然而，实施方式不限于此。
如上所述，本公开内容的实施方式通过改变数据驱动器的输出通道的布置和改变感测线的位置(包括垫部和连接部)和感测线的层级结构可以降低在用于制造显示面板的过程中可能发生的不同类型的信号线之间的短路(或外部短路)的可能性。因此，本公开内容的实施方式可以防止或减少显示面板的显示缺陷并且提高显示装置的制造成品率和可靠性。
虽然已经参考许多说明性实施方式描述了实施方式，但是本领域技术人员可以设计出落入本公开内容的范围的许多其他修改和实施方式。特别地，在本公开内容的附图和所附权利要求的范围内，主题组合布置的组成部分和/或布置中的各种变化和修改是可能的。除了组成部分和/或布置中的变化和修改之外，替代用途对于本领域技术人员也是明显的。

Claims (14)

1.一种显示装置，包括：
显示面板，所述显示面板具有显示图像的显示区域；
信号线，所述信号线包括数据线、第一电力线和感测线，所述信号线连接至所述显示面板；以及
数据驱动器电路，所述数据驱动器电路连接至所述信号线，所述数据驱动器电路包括：第一通道组，每个第一通道组包括向所述数据线输出数据信号的多个第一通道；第二通道组，每个第二通道组包括输出感测电压和从所述感测线接收感测电压的多个第二通道；以及第三通道组，每个第三通道组包括每个都向所述第一电力线输出高电势电压的一个或更多个第三通道，
其中，所述第一通道组和所述第三通道组被定义为第一输出单元，并且所述第二通道组被定义为第二输出单元，并且
其中，包括在每个所述第二通道组中的所述多个第二通道被设置成使得每个第二通道与包括在所述第二通道组中的至少另一个第二通道相邻。
2.根据权利要求1所述的显示装置，其中，所述第三通道组被设置在所述第二通道组之间。
3.根据权利要求1所述的显示装置，其中，所述第二输出单元被设置在所述第一输出单元的左侧和右侧。
4.根据权利要求3所述的显示装置，其中，包括在所述第二输出单元中的所述多个第二通道在所述第一输出单元的左侧和右侧以不相等的数目分开。
5.根据权利要求1所述的显示装置，其中，所述感测线每个都具有斜线区域和直线区域，其中，每个感测线的所述斜线区域在所述显示面板中所限定的非显示区域的链接部中沿斜方向设置，其中，所述链接部是所述信号线交叉于的所述数据驱动器电路与所述显示面板之间的区域，并且其中，每个感测线的所述直线区域在所述显示面板的所述显示区域的线部中沿直方向设置，所述线部在所述显示面板的两个相邻像素之间。
6.根据权利要求5所述的显示装置，其中，每个所述感测线的所述斜线区域包括所述显示面板的第一衬底上的遮光层，或者包括所述显示面板的所述第一衬底上的所述遮光层和所述遮光层上的栅极金属层。
7.根据权利要求5所述的显示装置，其中，每个所述感测线的所述斜线区域具有与所述数据线中的一些数据线交叉的区域。
8.根据权利要求5所述的显示装置，其中，对于至少一个所述感测线，所述感测线的所述斜线区域与所述数据线的子集交叠，其中所述子集中的数据线连续地设置，并且所述感测线的所述直线区域平行于所述数据线的所述子集而设置，其中，所述感测线的所述直线区域在所述数据线的所述子集中的最后的数据线与所述数据线的所述子集中的所述最后的数据线之后的另一个数据线之间。
9.根据权利要求5所述的显示装置，其中，每个所述感测线的所述斜线区域包括所述显示面板的第一衬底上的遮光层，并且
其中，每个所述感测线的所述直线区域包括所述遮光层和所述遮光层上的源极漏极金属层。
10.根据权利要求5所述的显示装置，其中，每个所述感测线的所述斜线区域包括所述显示面板的第一衬底上的遮光层和所述遮光层上的栅极金属层，并且
其中，每个所述感测线的所述直线区域包括所述遮光层、所述遮光层上的栅极金属层以及所述栅极金属层上的源极漏极金属层。
11.一种数据驱动器电路，包括：
第一通道组，每个第一通道组包括向数据线输出数据信号的多个第一通道；
第二通道组，每个第二通道组包括输出感测电压和从感测线接收感测电压的多个第二通道；以及
第三通道组，每个第三通道组包括每个都向第一电力线输出高电势电压的一个或更多个第三通道，
其中，所述第一通道组和所述第三通道组被定义为第一输出单元，并且所述第二通道组被定义为第二输出单元，并且
其中，包括在每个所述第二通道组中的所述多个第二通道被设置成使得每个第二通道与包括在所述第二通道组中的至少另一个第二通道相邻。
12.根据权利要求11所述的数据驱动器电路，其中，所述第三通道组被设置在所述第二通道组之间。
13.根据权利要求11所述的数据驱动器电路，其中，所述第二输出单元被设置在所述第一输出单元的左侧和右侧。
14.根据权利要求13所述的数据驱动器电路，其中，包括在所述第二输出单元中的所述多个第二通道在所述第一输出单元的左侧和右侧以不相等的数目分开。
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