CN107153553A - 基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法 - Google Patents

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Abstract

本发明公开了一种基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，通过Cscripts对Purley平台CPU的PCIe Tx Eq进行更改，更改完成后进行Eq参数确认。若更改完后PCIe链路降速到Gen1，则通过re‑enable相应PCIe Port的方法使相应链路重新training回Gen3，再次确认Eq参数修改是否有效。该方法在修改完Tx Eq参数后，可立即执行相关测试，无需重启系统，可极大缩短测试的时间。

Description

基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法
技术领域
本发明涉及一种基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法。
背景技术
由于PCIE 3.0的速率已经达到8Gb/s，而且传输的通道往往需要经历主板至板卡，整个链路会比较长，这样就会导致高速信号比较大的损耗。为补偿通道的损耗，确保接收端信号眼图能够张开，通过使用相应的加重(去加重或者预加重)及均衡技术是非常有必要的。因此，PCIE 3.0在发送端使用了施加去加重(de-emphasis)和前冲(preshoot)功能。实际上，PCIE 3.0的去加重(de-emphasis)和前冲(preshoot)功能是通过一个三阶FIR滤波器实现的。如图1所示，其中：C-1,C0与C+1三个参数值即我们所说的Tx Eq值。现有方案是通过在BIOS中对DN Tx Preset选项进行修改来调整，选项中有Auto、P0、P1、P2、P3、P4、P5、P6、P7、P8、P9总共11种设置。当选择Auto时，PCIe链路在training完成后将CPU端的PCIe Tx Eq自动设置为理论上的最优值，选择P0到P9这10中设置时，Tx Eq会被固定为P0到P9对应的参数。
由于需要开机进入BIOS界面进行设置，且为使设置的参数值生效，需要重启系统，该过程所需要的时间较长，在需要调整试验多种Tx Eq参数时，会占用测试工程师较多的时间，检验效率低。
发明内容
本发明的目的是提供一种基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，该方法在修改完Tx Eq参数后，可立即执行相关测试，无需重启系统，可极大缩短测试的时间。
为实现上述目的，本发明采用下述技术方案：
一种基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，包括以下步骤：
S1、进行Tx Eq调整前，需先将CPU halt，使CPU只响应修改Tx Eq参数的命令，不进行其他计算操作；
S2、确认当前CPU uniPhy所有lane的状态，判断待调整的PCIe port是否处在L0状态，是，确认该port所有lane的状态；否，在BIOS中调整或者重启机台；
S3、确认当前的PCIe拓扑，确认待调整PCIe port的port number；
S4、对相应PCIe port的Tx Eq进行调整；
S5、判断参数修改是否有效，若修改无效，则判断当前PCIe port是否处在Gen3状态下，如果当前PCIe port处在Gen3状态下,重启系统后从步骤S1执行；如果当前PCIe port回退到了Gen1状态下，则通过re-enable该PCIe port，然后判断参数修改是否有效，若仍然无效，则重启系统后从步骤S1执行；有效，结束。
进一步地，步骤S1中，需先将CPU halt是通过输入命令unistart(),使以uni.为前缀的命令可以执行实现的。
进一步地，步骤S2中，执行命令uni.showStatus()，确认当前CPU uniPhy部分所有lane的状态，具体包括UPI port，DMI Port，PCIe port的lane的状态，读取PCIe port的lane的状态。
进一步地，步骤S3中，执行命令pcie.topology()，确认当前的PCIe拓扑，执行命令pcie.port_map()，确认待调整Port的port number。
进一步地，步骤S4中，执行uni.setTxEq()命令，对相应PCIe port的Tx Eq进行调整。
进一步地，对相应PCIe port的Tx Eq进行调整具体包括对cm1、c0、cp1参数的调整，cm1、c0、cp1分别对应三阶FIR滤波器的C-1、C0与C+1，根据链路的实际情况采用下表中这十组值或其他取值
进一步地，其他取值需要满足cm1+c0+cp1＝63。
进一步地，步骤S5中，执行uni.getTxEq()命令，确认参数修改是否有效，若修改无效，则执行pcie.topology()命令确认当前PCIe port是否处在Gen3状态下，如果当前port回退到了Gen1状态下，则通过re-enable该port，然后再次执行uni.getTx()命令来确认参数修改是否有效。
本发明的有益效果是，
本发明通过Cscripts对Purley平台CPU的PCIe Tx Eq进行更改，更改完成后进行Eq参数确认。若更改完后PCIe链路降速到Gen1，则通过re-enable相应PCIe Port的方法使相应链路重新training回Gen3，再次确认Eq参数修改是否有效。实现在无需频繁重启系统的情况下对CPU端PCIe Tx Eq进行连续修改，可以做到即改即测，可以极大地提高测试效率。
附图说明
图1是三阶FIR滤波器示意图；
图2是本发明流程图；
图3是CPU uniPhy部分所有lane的状态图。
具体实施方式
如图2所示，一种基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，包括以下步骤：S1、进行Tx Eq调整前，需先将CPU halt，使CPU只响应修改Tx Eq参数的命令，不进行其他计算操作；S2、确认当前CPU uniPhy所有lane的状态，如图3所示，判断待调整的PCIe port是否处在L0状态，是，确认该port所有lane的状态；否，在BIOS中调整或者重启机台；S3、确认当前的PCIe拓扑，确认待调整PCIe port的port number；S4、对相应PCIe port的Tx Eq进行调整；S5、判断参数修改是否有效，若修改无效，则判断当前PCIe port是否处在Gen3状态下，如果当前PCIe port处在Gen3状态下,重启系统后从步骤S1执行；如果当前PCIe port回退到了Gen1状态下，则通过re-enable该PCIe port，然后判断参数修改是否有效，若仍然无效，则重启系统后从步骤S1执行；有效，结束。
下面以将连接在x8带宽下的CPU0 PCIe Port 1A Tx Eq修改为Preset8为例，通过具体实施方式对本发明进一步说明：该方法的实现步骤如下：
1、在待检验的主板上安装上CPU、内存、服务器电源；
2、接通AC电源，并开机进入BIOS设置界面，将EV DFX Features选项设置为Enable，重启系统。
3、用Intel的ITP工具将主板的XDP接口与PC连接。在PC端打开Cscripts脚本。
4、执行命令halt()，将CPU停住。
5、执行命令uni.showStatus(),查看CPU0的Port1A所有lane的状态，确认是否link在x8的Gen3速率下。
6、执行命令pcie.topology()，查看CPU0的PCIe拓扑。执行pcie.port_map(),确认CPU0 Port1A对应的port number。
7、执行命令uni.setTxEq(cpu0,”p1”,laneMask＝0xFF,cm1＝0x8,c0＝0x2F,cp1＝0x8),将CPU0 Port 1A的Tx Eq参数设置为preset8所对应的参数。
8、执行命令uni.getTxEq(cpu0,”p1”),确认参数修改是否有效。若无效，则先后执行命令pcie.linkdisable(0,2)与pcie.linkenable(0,2)，将该PCIe port重新激活。再次执行命令uni.getTxEq(cpu0,”p1”)确认参数，一般情况下，此时参数修改已经生效。若参数修改仍无效，则重启系统，重新执行以上步骤。
上述虽然结合附图对本发明的具体实施方式进行了描述，但并非对本发明保护范围的限制，所属领域技术人员应该明白，在本发明的技术方案的基础上，本领域技术人员不需要付出创造性劳动即可做出的各种修改或变形仍在本发明的保护范围以内。

Claims (8)

1.基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，包括以下步骤：
S1、进行Tx Eq调整前，需先将CPU halt，使CPU只响应修改Tx Eq参数的命令，不进行其他计算操作；
S2、确认当前CPU uniPhy所有lane的状态，判断待调整的PCIe port是否处在L0状态，是，确认该port所有lane的状态；否，在BIOS中调整或者重启机台；
S3、确认当前的PCIe拓扑，确认待调整PCIe port的portnumber；
S4、对相应PCIe port的Tx Eq进行调整；
S5、判断参数修改是否有效，若修改无效，则判断当前PCIe port是否处在Gen3状态下，如果当前PCIe port处在Gen3状态下,重启系统后从步骤S1执行；如果当前PCIe port回退到了Gen1状态下，则通过re-enable该PCIe port，然后判断参数修改是否有效，若仍然无效，则重启系统后从步骤S1执行；有效，结束。
2.如权利要求1所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，步骤S1中，需先将CPU halt是通过输入命令unistart(),使以uni.为前缀的命令可以执行实现的。
3.如权利要求1所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，步骤S2中，执行命令uni.showStatus()，确认当前CPU uniPhy部分所有lane的状态，具体包括UPI port，DMI Port，PCIe port的lane的状态，读取PCIe port的lane的状态。
4.如权利要求1所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，步骤S3中，执行命令pcie.topology()，确认当前的PCIe拓扑，执行命令pcie.port_map()，确认待调整Port的port number。
5.如权利要求1所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，步骤S4中，执行uni.setTxEq()命令，对相应PCIe port的Tx Eq进行调整。
6.如权利要求5所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，对相应PCIe port的Tx Eq进行调整具体包括对cm1、c0、cp1参数的调整，cm1、c0、cp1分别对应三阶FIR滤波器的C-1、C0与C+1，根据链路的实际情况采用下表中这十组值或其他取值
7.如权利要求6所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，其他取值需要满足cm1+c0+cp1＝63。
8.如权利要求1所述的基于CScripts进行Purley平台CPU端PCIe Tx Eq调整的方法，其特征在于，步骤S5中，执行uni.getTxEq()命令，确认参数修改是否有效，若修改无效，则执行pcie.topology()命令确认当前PCIe port是否处在Gen3状态下，如果当前port回退到了Gen1状态下，则通过re-enable该port，然后再次执行uni.getTx()命令来确认参数修改是否有效。
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