CN106777846A - 一种跨层参考管控阻抗的设计方法 - Google Patents

一种跨层参考管控阻抗的设计方法 Download PDF

Info

Publication number
CN106777846A
CN106777846A CN201710192241.4A CN201710192241A CN106777846A CN 106777846 A CN106777846 A CN 106777846A CN 201710192241 A CN201710192241 A CN 201710192241A CN 106777846 A CN106777846 A CN 106777846A
Authority
CN
China
Prior art keywords
signal
layer
layers
management
lower floor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201710192241.4A
Other languages
English (en)
Inventor
李晓
崔铭航
刘永哲
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Jinan Inspur Hi Tech Investment and Development Co Ltd
Original Assignee
Jinan Inspur Hi Tech Investment and Development Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Jinan Inspur Hi Tech Investment and Development Co Ltd filed Critical Jinan Inspur Hi Tech Investment and Development Co Ltd
Priority to CN201710192241.4A priority Critical patent/CN106777846A/zh
Publication of CN106777846A publication Critical patent/CN106777846A/zh
Pending legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F30/00Computer-aided design [CAD]
    • G06F30/30Circuit design
    • G06F30/39Circuit design at the physical level

Abstract

本发明公开了一种跨层参考管控阻抗的设计方法,具体方法如下:S1、8层板叠层设计;S2、将对应RGB单端高速信号所在的下层对应信号的路径铜皮挖空;S3、在挖空层的下层铺GND铜,以实现改变信号参考层介质的厚度。本发明和现有技术相比,通过优化PCB走线及内层GND切割降低设计阻抗管控误差,提高信号质量;在降低研发成本的同时,实现信号完成性的目的。

Description

一种跨层参考管控阻抗的设计方法
技术领域
本发明涉及PCB设计的技术领域,具体地说是一种跨层参考管控阻抗的设计方法。
背景技术
伴随着云计算时代的到来,服务器的发展迅速崛起,在服务器主板设计中,信号速率越来越高,高速信号对信号完成性的需求也在不断的提升。
在高速线设计中,信号线的线长、线宽、线距、信号线到参考平面见介质厚度、班车的电性能参数、铜的粗糙度等都会影响信号阻抗管控,进而影响信号完整性。如何合理利用这些因素,使信号质量满足设计要求,成为研发工程师一直致力优选的方向。
其中,信号线到参考平面间的介质厚度可影响信号的阻抗和损耗,合理利用可有效控制信号质量,针对一些单根信号线阻抗要求,一般叠层设计中,计算出的阻抗与设计要求阻抗误差较大,无法满足设计要求。
发明内容
本发明的技术任务是提供一种跨层参考管控阻抗的设计方法。
本发明的技术任务是按以下方式实现的,一种跨层参考管控阻抗的设计方法,具体方法如下:S1、8层板叠层设计;S2、将对应RGB单端高速信号所在的下层对应信号的路径铜皮挖空;S3、在挖空层的下层铺GND铜,以实现改变信号参考层介质的厚度。
进一步的,优选的方法为,所述的在对应RGB单端高速信号所在的下层为L7层。
进一步的,优选的方法为,所述的RGB单端高速信号阻抗为75ohm。
进一步的,优选的方法为,所述的8层板叠层设计,BOT 层为75ohm单端高速信号走线层,正常信号参考为L7层。
一种印制电路板PCB,所述的PCB为8层板叠层设计,对应RGB单端高速信号所在的下层对应信号的路径铜皮挖空,在挖空层的下层铺GND铜。
进一步的,优选的结构为,BOT 层为75ohm单端高速信号走线层,正常信号参考为L7层。
本发明的一种跨层参考管控阻抗的设计方法和现有技术相比,有益效果如下:
1、通过优化PCB走线及内层GND切割降低设计阻抗管控误差,提高信号质量;
2、在降低研发成本的同时,实现信号完成性的目的;
3、此方法可普遍应用在各板卡PCB走线设计中,是一种普遍的布线方式。
附图说明
图1是8层板叠层设计参数图。
具体实施方式
实施例1:
针对RGB 单端高速信号,设计75ohm单端高速信号,根据先板材及叠层,在对应RGB单端高速信号所在的下层路径挖空,在挖空层的下层铺GND,使得RGB单端高速信号阻抗75ohm。其中75ohm单端高速信号走线层为BOT 层,正常信号参考为L7层,将L7层对应信号的路径铜皮挖空,在L6层信号对应路径铺GND铜,使信号跨层参考L6。
这样通过将L7层对应信号路径铜皮挖空的方法,就可以使得L6层信号这样就可以改变信号参考层介质厚度,从而使信号阻抗达到设计要求。
传统单端信号阻抗管控在图1叠层设计中计算结果 50ohm±10,实施本发明后单端信号阻抗管控在叠层设计中计算结果75ohm±10。
八层板通常使用下面三种叠层方式;
第一种:它的结构如下: 1 Signal 1 元件面、微带走线层; 2 Signal 2 内部微带走线层,较好的走线层(X 方向); 3 Ground; 4 Signal 3 带状线走线层,较好的走线层(Y方向); 5 Signal 4 带状线走线层; 6 Power; 7 Signal 5 内部微带走线层; 8 Signal6 微带走线层 5。
第二种:由于增加了参考层,具有较好的 EMI 性能,各信号层的特性阻抗可以很好的控制: 1 Signal 1 元件面、微带走线层,好的走线层; 2 Ground 地层,较好的电磁波吸收能力; 3 Signal 2 带状线走线层,好的走线层; 4 Power 电源层,与下面的地层构成优秀的电磁吸收; 5 Ground 地层; 6 Signal 3 带状线走线层,好的走线层; 7 Power 地层,具有较大的电源阻抗; 8 Signal 4 微带走线层,好的走线层。
第三种:最佳叠层方式,由于多层地参考平面的使用具有非常好的地磁吸收能力。1 Signal 1 元件面、微带走线层,好的走线层; 2 Ground 地层,较好的电磁波吸收能力;3 Signal 2 带状线走线层,好的走线层; 4 Power 电源层,与下面的地层构成优秀的电磁吸收; 5 Ground 地层; 6 Signal 3 带状线走线层,好的走线层; 7 Ground 地层,较好的电磁波吸收能力; 8 Signal 4 微带走线层,好的走线层。
通过上面具体实施方式,所述技术领域的技术人员可容易的实现本发明。但是应当理解,本发明并不限于上述的几种具体实施方式。在公开的实施方式的基础上,所述技术领域的技术人员可任意组合不同的技术特征,从而实现不同的技术方案。

Claims (6)

1.一种跨层参考管控阻抗的设计方法,其特征在于,具体方法如下:
S1、8层板叠层设计;
S2、将对应RGB单端高速信号所在的下层对应信号的路径铜皮挖空;
S3、在挖空层的下层铺GND铜,以实现改变信号参考层介质的厚度。
2.根据权利要求1所述的一种跨层参考管控阻抗的设计方法,其特征在于,所述的在对应RGB单端高速信号所在的下层为L7层。
3.根据权利要求1所述的一种跨层参考管控阻抗的设计方法,其特征在于,所述的RGB单端高速信号阻抗为75ohm。
4.根据权利要求1所述的一种跨层参考管控阻抗的设计方法,其特征在于,所述的8层板叠层设计,BOT 层为75ohm单端高速信号走线层,正常信号参考为L7层。
5.一种印制电路板PCB,所述的PCB为8层板叠层设计,其特征在于, 对应RGB单端高速信号所在的下层对应信号的路径铜皮挖空,在挖空层的下层铺GND铜。
6.根据权利要求5所述的一种印制电路板PCB,其特征在于,BOT 层为75ohm单端高速信号走线层,正常信号参考为L7层。
CN201710192241.4A 2017-03-28 2017-03-28 一种跨层参考管控阻抗的设计方法 Pending CN106777846A (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201710192241.4A CN106777846A (zh) 2017-03-28 2017-03-28 一种跨层参考管控阻抗的设计方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201710192241.4A CN106777846A (zh) 2017-03-28 2017-03-28 一种跨层参考管控阻抗的设计方法

Publications (1)

Publication Number Publication Date
CN106777846A true CN106777846A (zh) 2017-05-31

Family

ID=58966573

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201710192241.4A Pending CN106777846A (zh) 2017-03-28 2017-03-28 一种跨层参考管控阻抗的设计方法

Country Status (1)

Country Link
CN (1) CN106777846A (zh)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114501823A (zh) * 2022-04-15 2022-05-13 成都万创科技股份有限公司 一种pcb板叠层优化方法及pcb板

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2641438A1 (fr) * 1988-12-30 1990-07-06 Trt Telecom Radio Electr Circuit inductif integre
JP2000294930A (ja) * 1999-04-06 2000-10-20 Mitsubishi Electric Corp 多層プリント基板の製造方法およびこの多層プリント基板を用いた半導体装置
CN1758828A (zh) * 2004-10-09 2006-04-12 鸿富锦精密工业(深圳)有限公司 适用于高速信号的印刷电路板结构
CN101309547A (zh) * 2007-05-18 2008-11-19 鸿富锦精密工业(深圳)有限公司 印刷电路板
CN102076163A (zh) * 2009-11-25 2011-05-25 鸿富锦精密工业(深圳)有限公司 印刷电路板
CN201947528U (zh) * 2011-02-28 2011-08-24 博罗康佳精密科技有限公司 多层印制电路板
CN204065944U (zh) * 2014-09-04 2014-12-31 山东超越数控电子有限公司 一种基于龙芯1a处理器的手持式计算机

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2641438A1 (fr) * 1988-12-30 1990-07-06 Trt Telecom Radio Electr Circuit inductif integre
JP2000294930A (ja) * 1999-04-06 2000-10-20 Mitsubishi Electric Corp 多層プリント基板の製造方法およびこの多層プリント基板を用いた半導体装置
CN1758828A (zh) * 2004-10-09 2006-04-12 鸿富锦精密工业(深圳)有限公司 适用于高速信号的印刷电路板结构
CN101309547A (zh) * 2007-05-18 2008-11-19 鸿富锦精密工业(深圳)有限公司 印刷电路板
CN102076163A (zh) * 2009-11-25 2011-05-25 鸿富锦精密工业(深圳)有限公司 印刷电路板
CN201947528U (zh) * 2011-02-28 2011-08-24 博罗康佳精密科技有限公司 多层印制电路板
CN204065944U (zh) * 2014-09-04 2014-12-31 山东超越数控电子有限公司 一种基于龙芯1a处理器的手持式计算机

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
MARK L.MONTROSE: "《电磁兼容的印制电路板设计(原书第2版)》", 31 January 2008 *

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN114501823A (zh) * 2022-04-15 2022-05-13 成都万创科技股份有限公司 一种pcb板叠层优化方法及pcb板
CN114501823B (zh) * 2022-04-15 2022-07-01 成都万创科技股份有限公司 一种pcb板叠层优化方法及pcb板

Similar Documents

Publication Publication Date Title
US20090044968A1 (en) Flexible printed circuit board
CN103970956A (zh) 一种同层不同阻抗控制传输线的设计方法
US20090260860A1 (en) Flexible printed circuit board
EP3334259A1 (en) Pcb transmission lines having reduced loss
CN110719690A (zh) 高速多层pcb板叠层以及布线方法
CN103298274B (zh) 一种埋容印制电路板的制作方法以及埋容印制电路板
CN106777846A (zh) 一种跨层参考管控阻抗的设计方法
CN101772267A (zh) 一种高层板压制过程改善铜箔起皱的方法
TWI590518B (zh) 帶線中之串音消除
CN107333383A (zh) 印刷电路板
TW201138565A (en) Flexible printed circuit board
CN104981113B (zh) 电路板金手指的加工方法和金手指电路板
JPH03105410A (ja) 複数のロジツク群を有するバツクパネル
CN108282969B (zh) 一种实现内层连通的pcb制作方法及pcb
CN207969077U (zh) 一种印制电路板
CN105188266A (zh) 一种dual模式高速信号线立体布线的方法
CN206775820U (zh) 一种抗电磁干扰的pcb电路板
CN106714475A (zh) Pcb六层板叠层方法
WO2022012007A1 (zh) 电路板以及服务器
CN100478827C (zh) 窄板显示卡的存储器总线布线结构与布线方法
CN105205260A (zh) 一种低成本且抗干扰的dual模式叠层设计方法
CN103108486A (zh) 一种跨层参考降低损耗的设计方法
CN106455295A (zh) Pcb板
CN206525026U (zh) 多重过孔电路板及验证用测试板
CN105468863A (zh) 一种差分对分层走线设计方法

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
RJ01 Rejection of invention patent application after publication

Application publication date: 20170531

RJ01 Rejection of invention patent application after publication