CN105959599A - 修正cmos图像传感器时序逻辑的方法 - Google Patents
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Abstract
本发明公开一种修正CMOS图像传感器时序逻辑的方法,其特征在于,该方法包括如下步骤:采用一个counter计数的方式进行实现,首先将counter计数器的起点设置为时序的起点;然后,当counter进行计数时将counter计数的值与各个register进行比较P(0‑8),当counter的值与register值相等时,改变对应的时序电路。本发明采用修正时序电路中counter计数方式保证了设计的灵活性,易用性;采用该时序电路结构可以简单的移植到不同项目中,降低在项目的移植风险。
Description
技术领域
本发明属于图像传感器时序电路结构的技术领域,具体地说,是涉及一种修正CMOS图像传感器时序逻辑的方法。
背景技术
CMOS图像传感器的感光部分是由像素以及模拟读出电路构成,一个标准的4T结构如图1所示。光电二极管由模拟读出电路控制其工作方式进而进行图像的采集以及传输,该结构采用的时序电路进行控制,在不同的项目中,由于模拟电路结构的偏差以及时序逻辑的需求不同,进而需要的时序逻辑也不尽相同。一种最基本的读出时序如图2所示,首先CMOS图像传感器打开rst信号进行复位,而后通过ADC对复位信息进行量化,量化完成后,通过开启tx管读取CMOS图像传感器中二极管的积分信号,最后将积分信号通过ADC量化,并减去复位信号,完成信号读取。
目前广泛采用的时序电路结构设计原理:该技术方案采用多个counter对相邻的时序边沿起始点进行计数,当counter的值与对应的register一致时开始接下来的时序计数。如图3所示,当row_sel改变时开始计数,当Cnt0与电路中对应register P0的值相等时,将rst拉起。但在CMOS图像传感器实际工作过程中,上述时序电路由于设计的相对位置固定,会造成调试过程中无法灵活的调整时序逻辑。例如该电路无法实现tx的上升沿挪到ADC第一个下降沿之前。因此对于不同需求的电路结构无法实现简单移植。其次上述电路在实现过程中需要多个counter或是多个状态机进行设计,提升了电路结构的复杂程度,增大了芯片设计风险,图4为采用该设计方案的芯片结构。
发明内容
本发明提供一种修正CMOS图像传感器时序逻辑的方法,以解决目前在CMOS图像传感器时序设计过程中,由于实现过程中将相对位置固定,而造成的在不同项目的时序移植过程中无法灵活的调整时序的技术问题。
本发明的技术方案:一种修正CMOS图像传感器时序逻辑的方法,其特征在于,该方法包括如下步骤:采用一个counter计数的方式进行实现,首先将counter计数器的起点设置为时序的起点;当counter进行计数时将counter计数的值与各个register进行比较P(0-8),当counter的值与register值相等时,改变对应的时序电路。
例如Cnt=P0时,将rst信号的值置为1。
采用本发明的技术方案的电路结构如图6所示,通过将原始的多个cnt计数器改变为一个计数器进行计数,当计数起始条件触发时开始计数,在计数的过程中,通过数据选择器MUX与寄存器P0—P8的值进行比较,当比较成立时,产生对应的P0信号驱动信号产生器,从而实现时序逻辑,其时序为图5所示。
图4为现有技术方案的芯片结构,该方案采用cnt(0-8)作为信号产生器的输入信号,当时序起始条件触发时,将按照顺序由cnt0到cnt8进行计数,例如cnt0计数完成后,即等于寄存器P0,开始cnt1的计数,以此类推,最终将触发条件给予信号产生器产生信号。
有益效果:
1、本发明提出了一种灵活简单的通用时序电路结构,采用修正时序电路中counter计数方式保证了设计的灵活性,易用性;采用该时序电路结构可以简单的移植到不同项目中,降低在项目的移植风险。
2、本发明采用一种新型的时序设计电路结构,将原本相对位置固定的设计方式,改为灵活通用的时序电路结构,进而降低时序电路在不同项目中的移植风险。
3、本发明的时序电路的实现方式可以带来两个好处,首先采用该电路结构,各个时序没有相对的固定关系,可以根据在不同项目中不同需求灵活实现;其次,采用一个counter进行计数对比,将降低电路的复杂程度,降低移植时带来的修改风险。
附图说明
图1为4T像素的电路结构图;
图2为4T像素结构的工作时序图;
图3为图像传感器的传统逻辑;
图4为传统图像传感器读出电路结构。
图5为修正后的时序设计方案。
图6为修正后的图像传感器读出电路结构。
具体实施方式
下面结合附图和实施例对本发明作进一步的说明。
实施例:一种修正CMOS图像传感器时序逻辑的方法,其特征在于,该方法包括如下步骤:采用一个counter计数的方式进行实现,首先将counter计数器的起点设置为时序的起点;当counter进行计数时将counter计数的值与各个register进行比较P(0-8),当counter的值与register值相等时,改变对应的时序电路。
例如Cnt=P0时,将rst信号的值置为1。
采用本发明的技术方案的电路结构如图6所示,通过将原始的多个cnt计数器改变为一个计数器进行计数,当计数起始条件触发时开始计数,在计数的过程中,通过数据选择器MUX与寄存器P0—P8的值进行比较,当比较成立时,产生对应的P0信号驱动信号产生器,从而实现时序逻辑,其时序图如为图5所示。
图4为现有技术方案的芯片结构,该方案采用cnt(0-8)作为信号产生器的输入信号,当时序起始条件触发时,将按照顺序由cnt0到cnt8进行计数,例如cnt0计数完成后,即等于寄存器P0,开始cnt1的计数,以此类推。最终将触发条件给予信号产生器产生信号。
以上详细描述了本发明的较佳具体实施例。应当理解,本领域的普通技术人员无需创造性劳动就可以根据本发明的构思作出诸多修改和变化。因此,凡本技术领域中技术人员依本发明的构思在现有技术的基础上通过逻辑分析、推理或者有限的实验可以得到的技术方案,皆应在由权利要求书所确定的保护范围内。
Claims (2)
1.修正CMOS图像传感器时序逻辑的方法,其特征在于,该方法包括如下步骤:采用一个counter计数的方式进行实现,首先将counter计数器的起点设置为时序的起点;然后,当counter进行计数时将counter计数的值与各个register进行比较P(0-8),当counter的值与register值相等时,改变对应的时序电路。
2.如权利要求1所述的修正CMOS图像传感器时序逻辑的方法,其特征在于,所述方法是通过将原始的多个cnt计数器改变为一个计数器进行计数,当计数起始条件触发时开始计数,在计数的过程中,通过数据选择器MUX与寄存器P0-P8的值进行比较,当比较成立时,产生对应的P0信号驱动信号产生器,从而实现时序逻辑。
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CN201610443807.1A CN105959599A (zh) | 2016-06-16 | 2016-06-16 | 修正cmos图像传感器时序逻辑的方法 |
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Citations (4)
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2016
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