CN105427808A - 一种像素驱动电路及其驱动方法、显示装置 - Google Patents

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Abstract

本发明实施例提供一种像素驱动电路及其驱动方法、显示装置，涉及显示技术领域，能够改善由于阈值电压引起的显示器显示亮度不均匀的不良现象。该像素驱动电路包括输入模块、补偿模块、驱动模块、发光模块以及控制信号输入模块。输入模块用于在第一栅极信号端的控制下，将数据电压端的信号输出至补偿模块。补偿模块用于在输入模块以及阈值电压控制端的控制下，对驱动模块进行阈值电压的补偿；发光模块用于在第一控制信号端的控制下驱动发光模块进行发光；控制信号输入模块用于在第二控制信号端和第三控制信号端的控制下，将第二电压端或第三电压端的信号输出至第一控制信号端。用于驱动像素单元发光。

Description

一种像素驱动电路及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、显示装置。
背景技术
随着显示技术的急速进步，作为显示装置核心的半导体元件技术也随之得到了飞跃性的进步。对于现有的显示装置而言，有机发光二极管(OrganicLightEmittingDiode，OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点而越来越多地被应用于高性能显示领域当中。
OLED按驱动方式可分为PMOLED(PassiveMatrixDrivingOLED，无源矩阵驱动有机发光二极管)和AMOLED(ActiveMatrixDrivingOLED，有源矩阵驱动有机发光二极管)两种，由于AMOLED显示器具有低制造成本、高应答速度、省电、可用于便携式设备的直流驱动、工作温度范围大等等优点而可望成为取代LCD(liquidcrystaldisplay,液晶显示器)的下一代新型平面显示器。
在现有的AMOLED显示面板中，每个OLED均包括多个TFT(ThinFilmTransistor，薄膜晶体管)开关电路。然而由于生产工艺和多晶硅的特性，导致在大面积玻璃基板上制作的TFT开关电路时，常常在诸如阈值电压Vth、迁移率等电学参数上出现波动，从而使得流经AMOLED显示面板中OLED器件的电流不仅会随着TFT长时间导通所产生的导通电压应力的变化而改变，而且其还会随着TFT的阈值电压Vth漂移而有所不同。如此一来，将会影响到显示器的亮度均匀性与亮度恒定性。从而降低显示器的画面品质和质量。
发明内容
本发明的实施例提供一种像素驱动电路及其驱动方法、显示装置，能够改善由于阈值电压引起的显示器显示亮度不均匀的不良现象。
为达到上述目的，本发明的实施例采用如下技术方案：
本发明实施例的一方面，提供一种像素驱动电路，包括输入模块、补偿模块、驱动模块、发光模块以及控制信号输入模块；所述输入模块连接第一栅极信号端、数据电压端以及所述补偿模块，用于在所述第一栅极信号端的控制下，将所述数据电压端的信号输出至所述补偿模块；所述补偿模块还连接阈值电压控制端以及所述驱动模块，用于在所述输入模块、所述阈值电压控制端的控制下，对所述驱动模块进行阈值电压的补偿；所述发光模块连接第一电压端和所述驱动模块；所述驱动模块还连接第一控制信号端，用于在所述第一控制信号端的控制下驱动所述发光模块进行发光；所述控制信号输入模块连接所述第一控制信号端、第二控制信号端、第三控制信号端、第二电压端以及第三电压端，用于在所述第二控制信号端和所述第三控制信号端的控制下，将所述第二电压端或所述第三电压端的信号输出至所述第一控制信号端。
优选的，所述输入模块包括第一晶体管，所述第一晶体管的栅极连接所述第一栅极信号端、第一极连接所述数据电压端，第二极与所述补偿模块相连接。
优选的，所述补偿模块包括第二晶体管以及存储电容；所述第二晶体管的栅极连接所述阈值电压控制端，第一极连接所述存储电容的另一端，第二极与驱动模块相连接。
优选的，所述驱动模块包括第三晶体管；所述第三晶体管的栅极连接所述存储电容的另一端，第一极连接所述第一控制信号端，第二极连接所述发光模块。
优选的，所述控制信号输入模块包括第四晶体管、第五晶体管、第六晶体管以及第七晶体管；所述第四晶体管的栅极连接所述第二控制信号端，第一极连接所述第二电压端，第二极与所述第一控制信号端相连接；所述第五晶体管的栅极连接所述第三控制信号端，第一极连接所述第二电压端，第二极与所述第一控制信号端相连接；所述第六晶体管的栅极连接所述第二控制信号端，第一极连接所述第一控制信号端，第二极与所述第七晶体管的第二极相连接；所述第七晶体管的栅极连接所述第三控制信号端，第一极与所述第三电压端相连接。
优选的，所述输入模块还包括第八晶体管；所述第八晶体管的栅极连接第二栅极信号端，第一极连接所述数据电压端，第二极与所述补偿模块相连接。
本发明实施例的另一方面，提供一种显示装置，包括如上所述的任意一种像素驱动电路。
优选的，所述显示装置还包括显示面板，所述显示面板具有横纵交叉的多条栅线和数据线，所述栅线和所述数据线交叉界定多个像素单元；位于第J行、第I列的第一像素单元中的控制信号输入模块和补偿模块，与位于第J+1行、第I-1列的第二像素单元中的控制信号输入模块和补偿模块共用；其中，J≥1，I≥2，J、I均为正整数。
优选的，当所述补偿模块包括第一晶体管和第八晶体管时，所述第一晶体管位于所述第一像素单元，所述第八晶体管位于所述第二像素单元。
本发明实施例的又一方面，提供一种用于驱动上述任意一种像素驱动电路的方法，包括：在重置阶段，控制信号输入模块将第三电压端的信号输出至第一控制信号端，驱动模块进行重置；在补偿阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在输入模块以及所述阈值电压控制端的控制下，所述补偿模块对所述驱动模块进行阈值电压的补偿；在写入阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在所述输入模块以及所述阈值电压控制端的控制下，所述数据电压端输出的信号写入所述驱动模块；发光阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在所述输入模块以及所述阈值电压控制端的控制下，所述驱动模块驱动发光模块进行发光。
本发明实施例提供一种像素驱动电路及其驱动方法、显示装置。其中，该像素驱动电路包括输入模块、补偿模块、驱动模块、发光模块以及控制信号输入模块。具体的，输入模块连接第一栅极信号端、数据电压端以及补偿模块，用于在第一栅极信号端的控制下，将数据电压端的信号输出至补偿模块。而补偿模块还连接阈值电压控制端以及驱动模块，用于在输入模块、阈值电压控制端的控制下，对驱动模块进行阈值电压的补偿。发光模块连接第一电压端和驱动模块，该驱动模块还连接第一控制信号端，用于在第一控制信号端的控制下驱动发光模块进行发光。控制信号输入模块连接第一控制信号端、第二控制信号端、第三控制信号端、第二电压端以及第三电压端，用于在第二控制信号端和第三控制信号端的控制下，将第二电压端或第三电压端的信号输出至第一控制信号端。
这样一来，通过控制信号输入模块能够在不同阶段根据需要将第二电压端或第三电压端的信号输出至第一控制信号端，以在该第一控制信号端的控制下驱动模块进行重置，或者使得驱动模块能够驱动发光模块发光。由于在发光模块发光前，补偿模块可以对驱动模块进行阈值电压补偿，因此能够避免由于阈值电压的漂移造成显示亮度不均的问题。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为本发明实施例提供的一种像素驱动电路的结构示意图；
图2为图1中各个模块的一种具体结构示意图；
图3为图1中各个模块的另一种具体结构示意图；
图4为采用图3中的像素驱动电路的显示面板上TFT的排布示意图；
图5为用于控制图2或图3所示的像素驱动电路的信号时序图；
图6为图3中第一栅极信号端和第二栅极信号端的时序示意图；
图7为设置有图3所示的像素驱动电路的显示面板上TFT的排布示意图；
图8为本发明实施例提供的一种像素驱动电路的驱动方法流程图。
附图标记：
60-输入模块；10-补偿模块；20-发光模块；30-驱动模块；40-控制信号输入模块；50-栅极驱动器；51-源极驱动器；S1-第一信号控制端；S2-第二控制信号端；S3-第三控制信号端；Gn-第一栅极信号端；G(n+1)-第二栅极信号端；Dm-数据电压端；Em-阈值电压控制端；VSS-第一电压端；VDD-第二电压端；VEE-第三电压端；70-像素驱动电路中除了第一晶体管或第八晶体管以外的其余电源器件的省略示意。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供一种像素驱动电路，如图1所示，可以包括输入模块60、补偿模块10、驱动模块30、发光模块20以及控制信号输入模块40。
其中，输入模块60连接第一栅极信号端Gn、数据电压端Dm以及补偿模块10，用于在第一栅极信号端Gn的控制下，将数据电压端Dm的信号输出至补偿模块10。
补偿模块10还连接阈值电压控制端Em以及驱动模块30，用于在上述输入模块60、阈值电压控制端Em的控制下，对驱动模块30进行阈值电压的补偿。
发光模块10连接第一电压端VSS和驱动模块30。在此情况下，驱动模块30还连接第一控制信号端S1，用于在第一控制信号端S1的控制下驱动发光模块20进行发光。
控制信号输入模块40连接第一控制信号端S1、第二控制信号端S2、第三控制信号端S3、第二电压端VDD以及第三电压端VEE，用于在第二控制信号端S2和第三控制信号端S3的控制下，将第二电压端VDD或第三电压端VEE的信号输出至第一控制信号端S1。
需要说明的是，本发明实施例中，以使第一电压端VSS、第三电压端VEE输入低电平或接地处理，第二电压端VDD输入高电平为例进行的说明。
本发明实施例提供一种像素驱动电路，包括输入模块、补偿模块、驱动模块、发光模块以及控制信号输入模块。具体的，输入模块连接第一栅极信号端、数据电压端以及补偿模块，用于在第一栅极信号端的控制下，将数据电压端的信号输出至补偿模块。而补偿模块还连接阈值电压控制端以及驱动模块，用于在输入模块、阈值电压控制端的控制下，对驱动模块进行阈值电压的补偿。发光模块连接第一电压端和驱动模块，该驱动模块还连接第一控制信号端，用于在第一控制信号端的控制下驱动发光模块进行发光。控制信号输入模块连接第一控制信号端、第二控制信号端、第三控制信号端、第二电压端以及第三电压端，用于在第二控制信号端和第三控制信号端的控制下，将第二电压端或第三电压端的信号输出至第一控制信号端。
这样一来，通过控制信号输入模块能够在不同阶段根据需要将第二电压端或第三电压端的信号输出至第一控制信号端，以在该第一控制信号端的控制下驱动模块进行重置，或者使得驱动模块能够驱动发光模块发光。由于在发光模块发光前，补偿模块可以对驱动模块进行阈值电压补偿，因此能够避免由于阈值电压的漂移造成显示亮度不均的问题。
以下对像素电路中各个模块的具体结构进行详细的描述。
如图2所示，输入模块60包括第一晶体管T1，第一晶体管T1的栅极连接第一栅极信号端Gn、第一极连接数据电压端Dm，第二极与补偿模块10相连接。
补偿模块10可以包括第二晶体管T2以及存储电容C。第二晶体管T2的栅极连接阈值电压控制端Em，第一极连接存储电容C的另一端(节点a)，第二极与驱动模块30相连接。其中，当输入模块60的结构如上所述时，第二极与存储电容C的一端(节点b)相连接。
驱动模块30可以包括第三晶体管T3。在此情况下，当补偿模块10的结构如上所述时，上述第二晶体管T2的第二极与该第三晶体管T3的第二极相连接
第三晶体管T3的栅极连接存储电容C的另一端(节点a)，第一极连接第一控制信号端S1，第二极连接发光模块20。其中，该发光模块20包括有机发光二极管OLED，该有机发光二极管OLED的阳极与驱动模块30相连接，阴极连接第一电压端VSS。当驱动模块30的结构如上所述时，上述有机发光二极管OLED的阳极与第二晶体管T3的第二极相连接。
此外，控制信号输入模块40可以包括第四晶体管T4、第五晶体管T5、第六晶体管T6以及第七晶体管T7。
其中，第四晶体管T4的栅极连接第二控制信号端S2，第一极连接第二电压端VDD，第二极与第一控制信号端S1相连接。
第五晶体管T5的栅极连接第三控制信号端S3，第一极连接第二电压端VDD，第二极与第一控制信号端S1相连接。
第六晶体管T6的栅极连接第二控制信号端S2，第一极连接第一控制信号端S1，第二极与第七晶体管T7的第二极相连接。
第七晶体管T7的栅极连接第三控制信号端S3，第一极与第三电压端VEE相连接。
上述像素电路可以设置于显示面板的每个像素单元中。其中显示面板上的薄膜晶体管(英文全称ThinFilmTransistor，英文简称：TFT)的排布方式有多种。通常位于同一列的像素单元中的薄膜晶体管(英文全称ThinFilmTransistor，英文简称：TFT)可以连接同一条数据线。此外，还有可以如图4所示，显示面板上的TFT呈Z字型排布。即，位于同一列的像素单元中的TFT并未连接同一条数据线。而是位于相邻两行(L1和L2)且位于相邻两列(H1和H2)的任一两个亚像素。例如第一像素单元①和第二像素单元②，其中第一像素单元①的TFT和第二像素单元②的TFT与同一条数据线相连接。
在此情况下，为了实现像素驱动单元的驱动，上述输入模块60如图3所示，包括上述第八晶体管T8。其中，第一晶体管T1位于第一像素单元①，第八晶体管T8位于第二像素单元②。此外，该第八晶体管T8的栅极连接第二栅极信号端G(n+1)，第一极连接数据电压端Dm，第二极与存储电容C的一端(节点b)相连接。需要说明的是，图3中的方框70表示上述像素驱动电路中除了第一晶体管T1或第八晶体管T8以外的其余电源器件的省略示意。
具体的，第一晶体管T1和第八晶体管T8公用一条数据线Data，该数据线Data用于接收上述数据电压端Dm输出的信号。而第一晶体管T1的栅极连接第一栅线Gate1，该第一栅线Gate1用于接收所述第一栅极信号端Gn输出的信号。第二栅线Gate2用于接收第二栅极信号端G(n+1)输出的信号。上述第一栅线Gate1与第二栅线Gate2为显示面板上所有栅线中，为任意相邻的两条栅线。
在此情况下，在栅线逐行扫描的过程中，当第一栅极信号端G(n)输出信号时，第一晶体管T1导通，数据信号端Dm的输出信号可以通过第一晶体管T1输出至位于第一像素单元①的驱动晶体管(第三晶体管T3)的栅极。当第二栅极信号端G(n+1)输出信号时，第八晶体管T2导通，数据信号端Dm的输出信号可以通过第八晶体管T8输出至位于第二像素单元②的驱动晶体管(第三晶体管T3)的栅极。从而能够实现对于TFT呈Z字型排布时，驱动像素单元发光。
需要说明的是，本发明实施例提供的晶体管可以均为N晶体管，也可以均为P型晶体管；或者一部分为N型晶体管，另一部分为P型晶体管。本发明对此不做限定。本发以下实施例是以第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5以及第八晶体管T8为P型晶体管，第六晶体管T6和第七晶体管T7为N型晶体管为例进行的说明。
在此基础上，上述晶体管的第一极可以为源极，第二极可以为漏极；或者，第一极可以为漏极，第二极为源极。本发明对此不做限定。
此外，上述晶体管可以为增强型晶体管，也可以为耗尽型晶体管。本发明对此不做限定。
以下针对图2或图3所示的像素驱动电路，结合图5所示的控制信号时序图，对该像素驱动电路的驱动过程进行详细的说明。
第一阶段P1，如图5所示，Gn＝0，S1＝0，S2＝1，S3＝1，Dm＝Vdata，Em＝0；其中，“1”表示高电平，“0”表示低电平。
在此情况下，由于第二控制信号端S2和第三控制信号端S3均输入的高电平，第六晶体管T6和第七晶体管T7导通，第四晶体管T4和第五晶体管T5处于截止状态。第三电压端VEE输入的低电平通过第七晶体管T7和第六晶体管T6输出至第一信号控制端S1。
第一栅极信号端Gn输入低电平，第一晶体管T1导通，将数据电压端Dm输出的第一数据电压Vdata通过第一晶体管T1输出至存储电容C的一端(节点b)。阈值电压控制端Em输出低电平，将第二晶体管T2导通，使得作为驱动晶体管的第三晶体管T3的栅极和第二极导通。在此情况下，由于第一信号控制端S1输出第三电压端VEE的电压，因此第三晶体管T3的栅极电压Vg＝Va和第二极的电压Vd均为VEE+Vth。其中Vth为第三晶体管T3的阈值电压。此时，存储电容两端的压差Vb-Va＝Vdata-VEE-Vth。
综上所述，上述第一阶段P1为重置阶段，上述第三电压端VEE输入的是低电平，因此能够使得作为驱动晶体管(第三晶体管T3)的栅极能够得到重置，避免上一帧画面残留于第三晶体管T3栅极的电压对本帧画面造成影响。
第二阶段P2，如图5所示，Gn＝0，S1＝1，S2＝0，S3＝0，Dm＝Vdata，Em＝0。
在此情况下，由于第二控制信号端S2和第三控制信号端S3均输入的低电平，第四晶体管T4和第五晶体管T5导通，第六晶体管T6和第七晶体管T7处于截止状态。第二电压端VDD输入的高电平通过第四晶体管T4和第五晶体管T5输出至第一信号控制端S1。
第一栅极信号端Gn输入低电平，第一晶体管T1仍然保持导通状态。数据电压端Dm输出的第一数据电压Vdata通过第一晶体管T1输出至存储电容C的一端(节点b)。阈值电压控制端Em输出低电平，将第二晶体管T2导通，使得作为驱动晶体管的第三晶体管T3的栅极和第二极导通。在此情况下，由于第一信号控制端S1输出第二电压端VDD的电压，因此第三晶体管T3的栅极电压Va和第二极的电压Vd均为VDD+Vth。此时，存储电容两端的压差Vb-Va＝Vdata-VDD-Vth。
综上所述，上述第二阶段P2，为阈值电压的补偿阶段，用于对第三晶体管T3的阈值电压进行补偿。
第三阶段P3，如图5所示，Gn＝0，S1＝1，S2＝0，S3＝1，Dm＝Vref，Em＝1。
在此情况下，由于第二控制信号端S2输出低电平，第三控制信号端S3输出高电平，因此第四晶体管T4、第七晶体管T7导通，第五晶体管T5和第六晶体管T6处于截止状态。第二电压端VDD输入的高电平通过第四晶体管T4输出至第一信号控制端S1。
阈值电压控制端Em输出高电平，使得第二晶体管T2处于截止状态。第一栅极信号端Gn输入低电平，第一晶体管T1仍然保持导通状态，数据电压端Dm输出的第二数据电压Vref通过第一晶体管T1输出至存储电容C的一端(节点b)，使得存储电容C的一端的电压由第一数据电压Vdata变为第二数据电压Vref。此时，在存储电容的自举作用下，该存储电容另一端(节点a)的电压Va为Vref-Vdata+VDD+Vth。在此情况下，第三晶体管T3的栅极电压Vg＝Va＝Vref-Vdata+VDD+Vth。由于第一信号控制端S1输出第二电压端VDD的电压，因此第三晶体管T3的第一极(节点e)的电压Vs＝VDD。
综上所述，上述第三阶段P3为数据写入阶段，用于将第二数据电压Vref写入第三晶体管T3的栅极。
第四阶段P4，如图5所示，Gn＝1，S1＝1，S2＝1，S3＝0，Dm＝Vdata，Em＝1。
在此情况下，由于第二控制信号端S2输出高电平，第三控制信号端S3输出低电平，因此第五晶体管T5和第六晶体管T6导通，第四晶体管T4、第七晶体管T7处于截止状态。第二电压端VDD输入的高电平通过第五晶体管T5输出至第一信号控制端S1。
第一栅极信号端Gn输入高电平，第一晶体管T1截止。阈值电压控制端Em输出高电平，使得第二晶体管T2处于截止状态。这时流过第三晶体管T3的电流驱动发光器件OLED进行发光。因此第四阶段P1为发光阶段。
此外，在上述发光阶段第三晶体管M3处于饱和区，由于第三晶体管T3的栅极电压Vg＝Vref-Vdata+VDD+Vth，源极电压Vs＝VDD，因此可以根据饱和区TFT的电流特性，得出流经第三晶体管M3的电流为：
I＝1/2×K×(Vgs-Vth)2
＝1/2×K×{Vref-Vdata+VDD+Vth-VDD-Vth}2
＝1/2×K×(Vref-Vdata)2
其中，K为关联于第三晶体管T3的电流常数；Vgs为第三晶体管T3的栅极相对于源级的电压，即此时节点a相对于节点e的电压。
现有技术中，不同像素单元之间的Vth不尽相同，且同一像素中的Vth还有可能随时间发生漂移，这将造成显示亮度差异，由于这种差异与之前显示的图像有关，因此常呈现为残影现象。然而，由上述公式可以看出，本发明实施例提供的像素驱动电路中，流经第三晶体管T3的电流I与第三晶体管M3的阈值电压Vth无关。因此可以避免由于第三晶体管T3的阈值电压Vth的不一致或漂移对流过发光器件的电流所造成的影响，显著改善了显示装置显示亮度的均匀性。
需要说明的是，第一、由于上述过程是以第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5以及第八晶体管T8为P型晶体管，第六晶体管T6和第七晶体管T7为N型晶体管为例进行的说明。当上述晶体管的类型发生变化时，图5中的控制信号也需要发生相应的变化。以N型晶体管需要导通时，其栅极能够接收到高电平，而P型晶体管需要导通时，其栅极能够接收到低电平。
第二、显示面板上的栅线一般采用逐行扫描的方式，即第一栅极信号端Gn向如图4所示的第一栅线Gate1输入栅极驱动信号后，第二栅极信号端G(n+1)才会向如图4所示的第二栅线Gate2输入栅极驱动信号。其中，第一栅极信号端Gn和第二栅极信号端G(n+1)输出的栅线的时序信号如图6所示，使能信号端OE用于输出控制第一栅极信号端Gn和第二栅极信号端G(n+1)的使能信号。由于上述第一晶体管T1和第八晶体管T8分别位于相邻的两行。因此上述驱动过程只针对具有第一晶体管T1的第一像素单元①进行的说明。而具有第八晶体管T8的第二像素单元②的驱动过程同上所述，区别在于由第二栅极信号端G(n+1)控制第八晶体管T8的导通和截止。具体驱动过程此处不再赘述。
本发明实施例提供一种显示装置，包括如上所述的任意一种像素驱动电路，具有与前述实施例提供的像素驱动电路相同的结构和有益效果。由于前述实施例已经对像素驱动电路的结构和有益效果进行了详细的描述，此处不再赘述。
具体的，本发明实施例所提供的显示装置可以是包括LED显示器或OLED显示器在内的具有电流驱动发光器件的显示装置。
在此基础上，还包括显示面板。如图7所示，该显示面板具有横纵交叉的多条栅线Gate和数据线Data。栅线Gate和数据线Data交叉界定多个像素单元。
其中，位于第J行、第I列的第一像素单元①中的控制信号输入模块40和补偿模块60，与位于第J+1行、第I-1列的第二像素单元②中的控制信号输入模块40和补偿模块60共用。其中，J≥1，I≥2，J、I均为正整数。这样一来，上述像素驱动电路中，除了输入模块60和发光模块40以外，其余的模块均可以与其它像素单元共用，因此无需在每一个像素单元中均设置上述控制信号输入模块40和发光模块40，从而可以提高像素的开口率。
其中，当上述显示面板上的TFT为Z字型排布时，该补偿模块10可以包括第一晶体管T1和第八晶体管T8。在此情况下，如图4所示，第一晶体管T1位于上述第一像素单元①，第八晶体管T8位于上述第二像素单元②。这样一来，在栅线逐行扫描的过程中，当第一栅极信号端G(n)输出信号时，第一晶体管T1导通，数据信号端Dm的输出信号可以通过第一晶体管T1输出至位于第一像素单元①的驱动晶体管(第三晶体管T3)的栅极。当第二栅极信号端G(n+1)输出信号时，第八晶体管T2导通，数据信号端Dm的输出信号可以通过第八晶体管T8输出至位于第二像素单元②的驱动晶体管(第三晶体管T3)的栅极。从而能够实现对于TFT呈Z字型排布时，驱动像素单元发光。
此外，该显示面板还可以包括用于向栅线Gate输入驱动信号的栅极驱动器50，以及用于向数据线Date输入数据信号的源极驱动器51。
本发明实施例提供一种用于驱动上述任意一种像素驱动电路的方法，如图8所示，包括：
S101、在重置阶段，即如图6所示的第一阶段P1，控制信号输入模40将第三电压端VEE的信号输出至第一控制信号端S1，驱动模块30进行重置。
具体的，第二控制信号端S2和第三控制信号端S3均输入的高电平，第六晶体管T6和第七晶体管T7导通，第四晶体管T4和第五晶体管T5处于截止状态。第三电压端VEE输入的低电平通过第七晶体管T7和第六晶体管T6输出至第一信号控制端S1。
第一栅极信号端Gn输入低电平，第一晶体管T1导通，将数据电压端Dm输出的第一数据电压Vdata通过第一晶体管T1输出至存储电容C的一端(节点b)。阈值电压控制端Em输出低电平，将第二晶体管T2导通，使得作为驱动晶体管的第三晶体管T3的栅极和第二极导通。在此情况下，由于第一信号控制端S1输出第三电压端VEE的电压，因此第三晶体管T3的栅极电压Vg＝Va和第二极的电压Vd均为VEE+Vth。其中Vth为第三晶体管T3的阈值电压。此时，存储电容两端的压差Vb-Va＝Vdata-VEE-Vth。
S102、在补偿阶段，即如图6所示的第二阶段P2，控制信号输入模块40将第二电压端VDD的信号输出至第一控制信号端S1，开启驱动模块30；并且在输入模块60以及阈值电压控制端Em的控制下，补偿模块10对驱动模块30进行阈值电压的补偿。
具体的，第二控制信号端S2和第三控制信号端S3均输入的低电平，第四晶体管T4和第五晶体管T5导通，第六晶体管T6和第七晶体管T7处于截止状态。第二电压端VDD输入的高电平通过第七晶体管T7和第六晶体管T6输出至第一信号控制端S1。
第一栅极信号端Gn输入低电平，第一晶体管T1仍然保持导通状态。数据电压端Dm输出的第一数据电压Vdata通过第一晶体管T1输出至存储电容C的一端(节点b)。阈值电压控制端Em输出低电平，将第二晶体管T2导通，使得作为驱动晶体管的第三晶体管T3的栅极和第二极导通。在此情况下，由于第一信号控制端S1输出第二电压端VDD的电压，因此第三晶体管T3的栅极电压Va和第二极的电压Vd均为VDD+Vth。此时，存储电容两端的压差Vb-Va＝Vdata-VDD-Vth。
S103、在写入阶段，即如图6所示的第三阶段P3，控制信号输入模块40将第二电压端VDD的信号输出至第一控制信号端S1，开启驱动模块30；并且在输入模块60以及阈值电压控制端Em的控制下，数据电压端Dm输出的信号写入驱动模块30。
具体的，第二控制信号端S2输出低电平，第三控制信号端S3输出高电平，因此第四晶体管T4、第七晶体管T7导通，第五晶体管T5和第六晶体管T6处于截止状态。第二电压端VDD输入的高电平通过第四晶体管T4输出至第一信号控制端S1。
阈值电压控制端Em输出高电平，使得第二晶体管T2处于截止状态。第一栅极信号端Gn输入低电平，第一晶体管T1仍然保持导通状态，数据电压端Dm输出的第二数据电压Vref通过第一晶体管T1输出至存储电容C的一端(节点b)，使得存储电容C的一端的电压由第一数据电压Vdata变为第二数据电压Vref。此时，在存储电容的自举作用下，该存储电容另一端(节点a)的电压Va为Vref-Vdata+VDD+Vth。在此情况下，第三晶体管T3的栅极电压Vg＝Va＝Vref-Vdata+VDD+Vth。由于第一信号控制端S1输出第二电压端VDD的电压，因此第三晶体管T3的第一极(节点e)的电压Vs＝VDD。
S104、发光阶段，即如图6所示的第四阶段P4，控制信号输入模块40将第二电压端VDD的信号输出至第一控制信号端S1，开启驱动模块30；并且在输入模块60以及阈值电压控制端Em的控制下，驱动模块30驱动发光模块20进行发光。
具体的，第二控制信号端S2输出高电平，第三控制信号端S3输出低电平，因此第五晶体管T5和第六晶体管T6导通，第四晶体管T4、第七晶体管T7处于截止状态。第二电压端VDD输入的高电平通过第五晶体管T5输出至第一信号控制端S1。
第一栅极信号端Gn输入高电平，第一晶体管T1截止。阈值电压控制端Em输出高电平，使得第二晶体管T2处于截止状态。这时流过第三晶体管T3的电流驱动发光器件OLED进行发光。因此第四阶段P1为发光阶段。
此外，在上述发光阶段第三晶体管M3处于饱和区，由于第三晶体管T3的栅极电压Vg＝Vref-Vdata+VDD+Vth，源极电压Vs＝VDD，因此可以根据饱和区TFT的电流特性，得出流经第三晶体管M3的电流为：
Id＝1/2×K×(Vgs-Vth)2
＝1/2×K×{Vref-Vdata+VDD+Vth-VDD-Vth}2
＝1/2×K×(Vref-Vdata)2
其中，K为关联于第三晶体管T3的电流常数；Vgs为第三晶体管T3的栅极相对于源级的电压，即此时节点a相对于节点e的电压。
现有技术中，不同像素单元之间的Vth不尽相同，且同一像素中的Vth还有可能随时间发生漂移，这将造成显示亮度差异，由于这种差异与之前显示的图像有关，因此常呈现为残影现象。然而，由上述公式可以看出，本发明实施例提供的像素驱动电路中，流经第三晶体管T3的电流Id与第三晶体管M3的阈值电压Vth无关。因此可以避免由于第三晶体管T3的阈值电压Vth的不一致或漂移对流过发光器件的电流所造成的影响，显著改善了显示装置显示亮度的均匀性。
本领域普通技术人员可以理解：实现上述方法实施例的全部或部分步骤可以通过程序指令相关的硬件来完成，前述的程序可以存储于一计算机可读取存储介质中，该程序在执行时，执行包括上述方法实施例的步骤；而前述的存储介质包括：ROM、RAM、磁碟或者光盘等各种可以存储程序代码的介质。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种像素驱动电路，其特征在于，包括输入模块、补偿模块、驱动模块、发光模块以及控制信号输入模块；
所述输入模块连接第一栅极信号端、数据电压端以及所述补偿模块，用于在所述第一栅极信号端的控制下，将所述数据电压端的信号输出至所述补偿模块；
所述补偿模块还连接阈值电压控制端以及所述驱动模块，用于在所述输入模块、所述阈值电压控制端的控制下，对所述驱动模块进行阈值电压的补偿；
所述发光模块连接第一电压端和所述驱动模块；所述驱动模块还连接第一控制信号端，用于在所述第一控制信号端的控制下驱动所述发光模块进行发光；
所述控制信号输入模块连接所述第一控制信号端、第二控制信号端、第三控制信号端、第二电压端以及第三电压端，用于在所述第二控制信号端和所述第三控制信号端的控制下，将所述第二电压端或所述第三电压端的信号输出至所述第一控制信号端。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述输入模块包括第一晶体管，所述第一晶体管的栅极连接所述第一栅极信号端、第一极连接所述数据电压端，第二极与所述补偿模块相连接。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述补偿模块包括第二晶体管以及存储电容；
所述第二晶体管的栅极连接所述阈值电压控制端，第一极连接所述存储电容的另一端，第二极与驱动模块相连接。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述驱动模块包括第三晶体管；
所述第三晶体管的栅极连接所述存储电容的另一端，第一极连接所述第一控制信号端，第二极连接所述发光模块。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述控制信号输入模块包括第四晶体管、第五晶体管、第六晶体管以及第七晶体管；
所述第四晶体管的栅极连接所述第二控制信号端，第一极连接所述第二电压端，第二极与所述第一控制信号端相连接；
所述第五晶体管的栅极连接所述第三控制信号端，第一极连接所述第二电压端，第二极与所述第一控制信号端相连接；
所述第六晶体管的栅极连接所述第二控制信号端，第一极连接所述第一控制信号端，第二极与所述第七晶体管的第二极相连接；
所述第七晶体管的栅极连接所述第三控制信号端，第一极与所述第三电压端相连接。
6.根据权利要求2所述的像素驱动电路，其特征在于，所述输入模块还包括第八晶体管；
所述第八晶体管的栅极连接第二栅极信号端，第一极连接所述数据电压端，第二极与所述补偿模块相连接。
7.一种显示装置，其特征在于，包括如权利要求1-6任一项所述的像素驱动电路。
8.根据权利要求7所述的显示装置，其特征在于，还包括显示面板，所述显示面板具有横纵交叉的多条栅线和数据线，所述栅线和所述数据线交叉界定多个像素单元；
位于第J行、第I列的第一像素单元中的控制信号输入模块和补偿模块，与位于第J+1行、第I-1列的第二像素单元中的控制信号输入模块和补偿模块共用；
其中，J≥1，I≥2，J、I均为正整数。
9.根据权利要求8所述的显示装置，其特征在于，当所述补偿模块包括第一晶体管和第八晶体管时，
所述第一晶体管位于所述第一像素单元，所述第八晶体管位于所述第二像素单元。
10.一种用于驱动如权利要求1-6任一项所述的像素驱动电路的方法，其特征在于，包括：
在重置阶段，控制信号输入模块将第三电压端的信号输出至第一控制信号端，驱动模块进行重置；
在补偿阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在输入模块以及阈值电压控制端的控制下，所述补偿模块对所述驱动模块进行阈值电压的补偿；
在写入阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在所述输入模块以及所述阈值电压控制端的控制下，所述数据电压端输出的信号写入所述驱动模块；
发光阶段，所述控制信号输入模块将第二电压端的信号输出至所述第一控制信号端，开启所述驱动模块；并且在所述输入模块以及所述阈值电压控制端的控制下，所述驱动模块驱动发光模块进行发光。
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