CN105224481A - Pwm在输入模式下传输数据的实现方式 - Google Patents
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Abstract
本发明提供一种PWM在输入模式下传输数据的实现方式,所述PWM在输入模式时,CPU配置输入波形采用控制寄存器中的FIFO缓冲模式,当遇到输入波形跳变时,将跳变信息及其相应的标志位保存至FIFO中,当FIFO中的存储值达到限定值时,则CPU中断PWM输出波形,并读取FIFO中的数据;当CPU读取完FIFO中的数据后启动PWM输出波形,CPU不用频繁响应中断,可以快速读取数据,降低数据丢失的可能性。
Description
技术领域
本发明涉及一种PWM在输入模式下传输数据的实现方式。
背景技术
目前PWM在输入模式下会以工作时钟来检测外部输入的波形的跳变情况,当外部的波形发生跳变的时候,PWM就会将相应的高电平时间和低电平的时间反映到寄存器上(即PWM在输入模式下记录外部时钟的高低电平的时间,这个寄存器里面通过PWM操作记录的是这个时间信息),同时产生中断通知CPU去读取寄存器。但是在外部输入波形变化比较快的情况下,传统的设计方法,会导致CPU去读取这个寄存器的信息的时候,这个信息可能被后面的波形信息覆盖,导致信息丢失。这个数据就是波形的周期,高低电平各自持续的时间等相关信息(即CPU读取数据不够快,从而使数据丢失)。
发明内容
本发明要解决的技术问题,在于提供一种PWM在输入模式下传输数据的实现方式。
本发明是这样实现的:PWM在输入模式下传输数据的实现方式,所述PWM在输入模式时,CPU配置输入波形采用控制寄存器中的FIFO缓冲模式,当遇到输入波形跳变时,将跳变信息及其相应的标志位保存至FIFO中,当FIFO中的存储值达到限定值时,则CPU中断PWM输出波形,并读取FIFO中的数据;当CPU读取完FIFO中的数据后启动PWM输出波形。
进一步地,所述当FIFO中的存储值达到限定值时,PWM产生一中断请求信号,CPU检测到该中断请求信号时,则中断PWM输出波形。
进一步地,所述跳变信息为外部时钟的高低电平时间。
进一步地,所述FIFO即为先进先出队列。
本发明具有如下优点:本发明PWM在输入模式下传输数据的实现方式,CPU不用频繁响应中断;CPU可连续高速读取该信息,就不会导致CPU时常间歇性打断严重影响CPU效率,而且避免输入波形变化较快时,输入数据的丢失可能性大大减小,保证IP设计的以及SOC电路设计的稳定。
附图说明
下面参照附图结合实施例对本发明作进一步的说明。
图1为本发明PWM在输入模式下传输数据的实现方式的示意框图。
图2为本发明的PWM波形输出示意图。
具体实施方式
如图1所示,本发明PWM在输入模式下传输数据的实现方式,所述PWM在输入模式时,CPU配置输入波形采用控制寄存器中的FIFO缓冲模式,当遇到输入波形跳变时,将跳变信息及其相应的标志位保存至FIFO中,当FIFO中的存储值达到限定值时,则CPU中断PWM输出波形,并读取FIFO中的数据;当CPU读取完FIFO中的数据后启动PWM输出波形,所述当FIFO中的存储值达到限定值时,PWM产生一中断请求信号,CPU检测到该中断请求信号时,则中断PWM输出波形,所述跳变信息为外部时钟的高低电平时间,所述FIFO即为先进先出队列。
如图2所示,对输入的波形进行采样,如果出现高低电平的翻转,产生中断信号。具体说明:上图时序中pwm_in是输入信号,在时钟信号clk_pwm信号的采样下,采样到pwm_in由低电平到高电平切换,产生一个终端请求信号并输出,告知CPU响应中断。同样pwm_in由高电平到低电平切换也会产生一个终端输出。
如图1和图2所示,输入的pwm_in波形会在pwm的通道中可控配置,也就是说CPU如果配置pwm_in输出采用FIFO缓冲模式的话,就可以启动通道内部的FIFO对输入的pwm_in跳变信息的采集将会传递到FIFO中,FIFO是先进先出队列,不会出现数据丢失。当采集到的pwm_in跳变信息(实际就是pwm_in)达到FIFO设置的阈值之后,就触发CPU读取该状态。
虽然以上描述了本发明的具体实施方式,但是熟悉本技术领域的技术人员应当理解,我们所描述的具体的实施例只是说明性的,而不是用于对本发明的范围的限定,熟悉本领域的技术人员在依照本发明的精神所作的等效的修饰以及变化,都应当涵盖在本发明的权利要求所保护的范围内。
Claims (4)
1.PWM在输入模式下传输数据的实现方式,其特征在于:所述PWM在输入模式时,CPU配置输入波形采用控制寄存器中的FIFO缓冲模式,当遇到输入波形跳变时,将跳变信息及其相应的标志位保存至FIFO中,当FIFO中的存储值达到限定值时,则CPU中断PWM输出波形,并读取FIFO中的数据;当CPU读取完FIFO中的数据后启动PWM输出波形。
2.根据权利要求1所述的PWM在输入模式下传输数据的实现方式,其特征在于:所述当FIFO中的存储值达到限定值时,PWM产生一中断请求信号,CPU检测到该中断请求信号时,则中断PWM输出波形。
3.根据权利要求1所述的PWM在输入模式下传输数据的实现方式,其特征在于:所述跳变信息为外部时钟的高低电平时间。
4.根据权利要求1所述的PWM在输入模式下传输数据的实现方式,其特征在于:所述FIFO即为先进先出队列。
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