CN104966667B - Iii‑v族化合物半导体器件及其欧姆接触电阻改善方法 - Google Patents
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Abstract
本发明提供了一种III‑V族化合物半导体器件及其欧姆接触电阻改善方法。该方法包括:在外延层上形成掩膜层,并采用光刻工艺在掩膜层上形成欧姆接触区域和非欧姆接触区域;对露出在欧姆接触区域内的外延层进行铟离子注入;在欧姆接触区域和非欧姆接触区域上沉积与外延层采用的半导体材料的功函数对应的欧姆接触金属层;采用湿法工艺剥离非欧姆接触区域上的掩膜层以及欧姆接触金属层;加热晶圆,使欧姆接触区域内的外延层、至少部分铟离子以及欧姆接触金属层形成合金化合物,进而实现欧姆接触。通过上述方式,本发明能够降低III‑V族化合物半导体器件的欧姆接触电阻。
Description
技术领域
本发明涉及半导体工艺技术领域,特别是涉及一种III-V族化合物半导体器件及其欧姆接触电阻改善方法。
背景技术
化合物半导体由两种及以上元素组成,不同的组合方式可以产生不同类型的化合物半导体材料,同时借助超晶格、组分变化等手段,可以得到无穷多种类的化合物半导体材料,从而实现多功能和多特性的半导体器件。以GaAs、GaN为代表的III-V族化合物半导体因其优越的高频、高速、大功率、耐高温、防辐射以及光电特性等特性,广泛应用于无线通信、光通信、激光器、电力电子以及军事电子领域。
III-V族化合物半导体器件制造工艺中关键技术之一是欧姆接触,即源、漏区域内的金属与半导体之间的接触,要求接触电极与有源层(器件内的电流层,属于外延层)之间具有较小的电阻,因为电阻增大会直接对器件的跨导、噪声、饱和电流以及可靠性产生负面的影响。而降低III-V族化合物半导体器件的欧姆接触电阻存在以下几个方面的困难:(1)半导体材料本身具有较大的禁带宽度,导致金属与半导体之间具有较高的势垒;(2)半导体材料化学性质稳定,与接触电极难以形成合金化合物;(3)半导体器件通常采用较复杂的外延结构,然而,一些位于接触电极与有源层之间的外延结构会阻碍欧姆接触,主要是外延层之间的界面存在势垒阻挡载流子的运动,特别是一些功能层,如腐蚀截止层,不仅导电性能差,而且阻碍接触电极与有源层之间的元素扩散。
发明内容
本发明主要解决的技术问题是提供一种III-V族化合物半导体器件及其欧姆接触电阻改善方法,能够降低III-V族化合物半导体器件的欧姆接触电阻。
为解决上述技术问题,本发明采用的一个技术方案是:提供一种III-V族化合物半导体器件的欧姆接触电阻改善方法,所述III-V族化合物半导体器件包括晶圆,所述晶圆包括由下至上的衬底和外延层,所述欧姆接触电阻改善方法包括:在外延层上形成掩膜层,并采用光刻工艺在所述掩膜层上形成欧姆接触区域和非欧姆接触区域;对露出在所述欧姆接触区域内的外延层进行铟离子注入;在所述欧姆接触区域和所述非欧姆接触区域上沉积与所述外延层采用的半导体材料的功函数对应的欧姆接触金属层;采用湿法工艺剥离所述非欧姆接触区域上的掩膜层以及欧姆接触金属层;加热所述晶圆,使所述欧姆接触区域内的外延层、至少部分铟离子以及所述欧姆接触金属层形成合金化合物,进而实现欧姆接触。
优选地,所述外延层的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层。
优选地,所述欧姆接触金属层至少为一层。
优选地,所述欧姆接触金属层包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层。
优选地,所述对露出在所述欧姆接触区域内的外延层进行铟离子注入的步骤具体为:对露出在欧姆接触区域内的AlGaAs势垒层、第一AlAs腐蚀截止层以及GaAsN-层进行铟离子注入。
优选地,所述掩膜层的材料为光刻胶。
为解决上述技术问题,本发明采用的另一个技术方案是:提供一种III-V族化合物半导体器件,包括晶圆,所述晶圆包括衬底、外延层和合金化合物,所述外延层和所述合金化合物均形成在所述衬底上,其中,所述合金化合物由所述外延层、外延层中注入的铟离子以及在外延层上沉积的欧姆接触金属层形成,用以实现欧姆接触。
优选地,所述外延层的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层。
优选地,所述欧姆接触金属层至少为一层。
优选地,所述欧姆接触金属层包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层。
区别于现有技术的情况,本发明的有益效果是:通过在外延层中注入铟离子,并使外延层、至少部分铟离子以及欧姆接触金属层形成合金化合物来实现欧姆接触,从而能够降低III-V族化合物半导体器件的欧姆接触电阻,可以与传统的III-V族化合物半导体器件制造工艺兼容。
附图说明
图1是本发明实施例III-V族化合物半导体器件的欧姆接触电阻改善方法的流程示意图。
图2是本发明实施例III-V族化合物半导体器件的晶圆结构示意图。
图3~图6是本发明实施例III-V族化合物半导体器件的制备过程示意图。
图7是本发明实施例的III-V族化合物半导体器件中外延层的部分铟离子分布示意图。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅是本发明的一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
请参见图1,是本发明实施例III-V族化合物半导体器件的欧姆接触电阻改善方法的流程示意图。本实施例的III-V族化合物半导体器件包括晶圆,晶圆包括由下至上的衬底1和外延层3,外延层3包含有源层2,有源层2是外延层3的某一层,有源层2可以在外延层3的底部或者夹在外延层3的中间,晶圆的结构如图2所示。下面结合图3~图6说明本实施例的欧姆接触电阻改善方法,该欧姆接触电阻改善方法包括以下步骤:
S1:在外延层3上形成掩膜层4,并采用光刻工艺在掩膜层4上形成欧姆接触区域31和非欧姆接触区域32。
其中,掩膜层4的材料通常采用光刻胶。如图1所示,光刻胶经过光刻工艺刻蚀掉特定部分,被刻蚀的部分即为欧姆接触区域31,没有被刻蚀的部分即为非欧姆接触区域32,欧姆接触区域31露出外延层3,其目的是将铟离子注入的范围限制在欧姆接触区域31内,保护其他区域不受铟离子注入的影响,有利于后续剥离光刻胶。
S2:对露出在欧姆接触区域31内的外延层3进行铟离子注入。
其中,如图2所示,铟离子注入只影响欧姆接触区域31内的外延层3。在本实施例中,铟离子注入的过程包括一次或多次不同能量和浓度的注入过程,以实现在纵向结构上特定深度的注入。注入的能量依据所需到达外延层3的深度确定,深度越大,需要能量越高,一般注入能量范围为5~500keV、注入剂量范围为1015~1017cm-2、注入角度范围为0°~10°。
S3:在欧姆接触区域31和非欧姆接触区域32上沉积与外延层3采用的半导体材料的功函数对应的欧姆接触金属层5。
其中,如图5所示,欧姆接触金属层5的厚度与半导体材料的功函数相对应。在本实施例中,欧姆接触金属层5至少为一层。欧姆接触金属层5除了可以实现欧姆接触的功能外,还可以实现增强附着力、改善表面润湿性、对外延层3掺杂、与外延层3形成合金等功能。
S4:采用湿法工艺剥离非欧姆接触区域32上的掩膜层4以及欧姆接触金属层5。
其中,该步骤仅仅剥离非欧姆接触区域32上掩膜层4以及掩膜层4上的欧姆接触金属层5后,而欧姆接触区域31内的外延层3上的欧姆接触金属层5被保留。
S5:加热晶圆,使欧姆接触区域31内的外延层3、至少部分铟离子以及欧姆接触金属层5形成合金化合物6,进而实现欧姆接触。
其中,如图6所示,经过加热后,所注入的铟离子与外延层3的半导体材料合金化,并且与欧姆接触金属层5形成合金化合物6,以实现欧姆接触。在本实施例中,通过降低合金化的温度可以减少欧姆接触层(即合金化合物6)表面和边缘粗糙度以利可靠性和后续工艺。
在本实施例中,步骤S2对外延层3,特别针对半导体材料较为稳定的外延层,产生大量的损伤,所以在外延层3中形成了元素扩散通道61,元素扩散通道61可以增强外延层3与欧姆接触金属层5之间的合金化。而经过步骤S5后,未合金化的铟离子部分聚集,形成金属颗粒62,从而提高了外延层3的电子浓度,增强了外延层3的导电性。元素扩散通道61和金属颗粒62在外延层3中的结构如图7所示。
本发明实施例的欧姆接触电阻改善方法由于采用了铟离子注入的方式,可以增加外延层3中铟组分的含量,降低外延层3的禁带宽度以及表面或界面的势垒,提高外延层3的电子浓度,增强外延层3与欧姆接触金属层5之间的合金化,增强外延层3的导电性。
下面将通过一具体应用实例对本发明实施例的欧姆接触电阻改善方法的工艺流程进行说明。在该具体应用实例中,外延层3的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层,AlGaAs势垒层的厚度为23nm,第一AlAs腐蚀截止层和第二AlAs腐蚀截止层的厚度为5nm,GaAsN-层和GaAsN+层的厚度为50nm。欧姆接触金属层5包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层,Au+金属层和Ge金属层的厚度为50nm,Ni金属层的厚度为30nm,Au-金属层的厚度为200nm。欧姆接触电阻改善方法的工艺流程包括:
步骤一:在外延层上旋涂光刻胶后,烘烤光刻胶形成掩膜层,并采用光刻工艺在掩膜层上形成欧姆接触区域和非欧姆接触区域,其中,光刻胶的型号为AZ P4210,旋涂厚度为5um,烘烤温度为120°。
步骤二:对露出在欧姆接触区域内的AlGaAs势垒层、第一AlAs腐蚀截止层以及GaAsN-层进行铟离子注入,其中,铟离子的注入剂量为2×1016cm-2,注入角度为7°,注入能量为200kev。
步骤三:采用电子束蒸发在欧姆接触区域和非欧姆接触区域的表面蒸镀欧姆接触金属层,其中,真空腔本底真空≤2X10-6Pa,蒸发速率<1nm/sec。
步骤四:将晶圆在NMP(N-甲基吡咯烷酮)溶剂中浸泡5分钟,温度80℃,然后采用NMP冲洗液进行压力冲洗,以剥离非欧姆接触区域上的掩膜层以及欧姆接触金属层。
步骤五:加热所述晶圆,并进行快速退火,使欧姆接触区域内的外延层、至少部分铟离子以及欧姆接触金属层形成合金化合物,进而实现欧姆接触,其中,加热温度≤380℃,升温时间为20s,保温时间为30s,降温时间为100s,保护气氛为氮气。
本发明实施例还提供一种III-V族化合物半导体器件,III-V族化合物半导体器件包括晶圆,该晶圆即为前述实施例中欧姆接触电阻改善方法的步骤S5所得产物,如图6所示。其中,晶圆包括衬底1、外延层3和合金化合物6,外延层3和合金化合物6均形成在衬底1上。外延层3包含有源层2,有源层2是外延层3的某一层,有源层2可以在外延层3的底部或者夹在外延层3的中间。其中,合金化合物6由外延层3、外延层3中注入的铟离子以及在外延层3上沉积的欧姆接触金属层形成,用以实现欧姆接触。
在本实施例中,外延层3的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层。欧姆接触金属层至少为一层,具体而言,欧姆接触金属层包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层。
通过上述方式,本发明实施例的III-V族化合物半导体器件及其欧姆接触电阻改善方法通过在外延层中注入铟离子,并使外延层、至少部分铟离子以及欧姆接触金属层形成合金化合物来实现欧姆接触,从而能够降低III-V族化合物半导体器件的欧姆接触电阻,可以与传统的III-V族化合物半导体器件制造工艺兼容。
以上所述仅为本发明的实施例,并非因此限制本发明的专利范围,凡是利用本发明说明书及附图内容所作的等效结构或等效流程变换,或直接或间接运用在其他相关的技术领域,均同理包括在本发明的专利保护范围内。
Claims (9)
1.一种III-V族化合物半导体器件的欧姆接触电阻改善方法,其特征在于,所述III-V族化合物半导体器件包括晶圆,所述晶圆包括由下至上的衬底和外延层,所述欧姆接触电阻改善方法包括:
在外延层上形成掩膜层,并采用光刻工艺在所述掩膜层上形成欧姆接触区域和非欧姆接触区域;
对露出在所述欧姆接触区域内的外延层进行铟离子注入;
在所述欧姆接触区域和所述非欧姆接触区域上沉积与所述外延层采用的半导体材料的功函数对应的欧姆接触金属层;
采用湿法工艺剥离所述非欧姆接触区域上的掩膜层以及欧姆接触金属层;
加热所述晶圆,使所述欧姆接触区域内的外延层、至少部分铟离子以及所述欧姆接触金属层形成合金化合物,进而实现欧姆接触。
2.根据权利要求1所述的欧姆接触电阻改善方法,其特征在于,所述外延层的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层。
3.根据权利要求2所述的欧姆接触电阻改善方法,其特征在于,所述欧姆接触金属层至少为一层。
4.根据权利要求3所述的欧姆接触电阻改善方法,其特征在于,所述欧姆接触金属层包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层。
5.根据权利要求2至4任一项所述的欧姆接触电阻改善方法,其特征在于,所述对露出在所述欧姆接触区域内的外延层进行铟离子注入的步骤具体为:对露出在欧姆接触区域内的AlGaAs势垒层、第一AlAs腐蚀截止层以及GaAsN-层进行铟离子注入。
6.根据权利要求1所述的欧姆接触电阻改善方法,其特征在于,所述掩膜层的材料为光刻胶。
7.一种III-V族化合物半导体器件,其特征在于,包括晶圆,所述晶圆包括衬底、外延层和合金化合物,所述外延层和所述合金化合物均形成在所述衬底上,其中,所述合金化合物由所述外延层、外延层中注入的铟离子以及在外延层上沉积的欧姆接触金属层形成,用以实现欧姆接触;所述外延层的结构由下至上依次为AlGaAs势垒层、第一AlAs腐蚀截止层、GaAsN-层、第二AlAs腐蚀截止层、GaAsN+层。
8.根据权利要求7所述的III-V族化合物半导体器件,其特征在于,所述欧姆接触金属层至少为一层。
9.根据权利要求8所述的III-V族化合物半导体器件,其特征在于,所述欧姆接触金属层包括由下至上的Au+金属层、Ge金属层、Ni金属层和Au-金属层。
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