CN104536229A - 一种阵列基板及显示面板 - Google Patents
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Abstract
本发明实施例提供了一种阵列基板及显示面板,涉及显示技术领域,可进一步降低具有Gate On Array结构的显示面板的边框宽度,满足用户对于窄边框显示面板显示效果的要求。该阵列基板包括位于衬底基板上的显示区域;所述显示区域内设置有像素单元;所述显示区域内还包括设置有GOA单元的GOA区域;其中,所述GOA单元与所述像素单元无重叠。用于阵列基板及包括该阵列基板的显示面板。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种阵列基板及显示面板。
背景技术
随着TFT-LCD技术(Thin Film Transistor-Liquid CrystalDisplay,薄膜场效应晶体管液晶显示装置)的不断发展,用户对于显示装置窄边框的要求也越来越高,以求获得视野更宽大的观看效果。
如图1所示,为了降低显示装置边框的宽度,目前行业内普遍的设计方法是将设置有栅极驱动电路(Gate On Array,简称GOA)单元的GOA区域200制作在阵列基板01显示区域100的外侧且位于封框胶70的内侧,从而减小了传统阵列基板边框区域中的栅极驱动芯片(Gate IC)以及连接Gate IC与栅线40的PAD区所占用的面积,从而达到减小边框宽度的效果。
然而,上述的Gate On Array设计结构对显示装置边框宽度的减小效果有限,仍然无法进一步达到用户期望获得的窄边框显示装置的显示效果。
发明内容
鉴于此,为进一步解决现有技术的不足,本发明的实施例提供一种阵列基板及显示面板,可进一步降低具有Gate On Array结构的显示面板的边框宽度,满足用户对于窄边框显示面板显示效果要求。
为达到上述目的,本发明的实施例采用如下技术方案:
本发明实施例提供了一种阵列基板,包括位于衬底基板上的显示区域;所述显示区域内设置有像素单元;所述显示区域内还包括设置有GOA单元的GOA区域;其中,所述GOA单元与所述像素单元无重叠。
优选的,沿栅线方向,所述显示区域包括主显示子区、位于所述主显示子区两侧的第一辅显示子区、第二辅显示子区;所述GOA区域包括分别位于所述第一辅显示子区、所述第二辅显示子区内的第一GOA子区、第二GOA子区;所述显示区域内设置有贯穿所述主显示子区、所述第一辅显示子区以及所述第二辅显示子区的m行栅线,m为正整数;所述第一GOA子区、所述第二GOA子区内均设置有m行GOA单元、与所述GOA单元相连的时钟信号线;其中,每行栅线与每行GOA单元相连。
进一步优选的,所述第一辅显示子区、所述主显示子区以及所述第二辅显示子区内依次设置有n1列像素单元、n列像素单元以及n2列像素单元;n1、n、n2均为正整数;其中,在所述第一辅显示子区内,所述第一GOA子区将所述n1列像素单元间隔为两部分;和/或,在所述第二辅显示子区内,所述第二GOA子区将所述n2列像素单元间隔为两部分。
进一步优选的,在所述第一GOA子区内,所述时钟信号线垂直于所述栅线,且奇数行的GOA单元与偶数行的GOA单元交错排列于所述时钟信号线两侧;在所述第一辅显示子区内,靠近所述时钟信号线两侧的两列像素单元中的各像素单元间隔开所述m行GOA单元交错排列;和/或,在所述第二GOA子区内,所述时钟信号线垂直于所述栅线,且奇数行的GOA单元与偶数行的GOA单元交错排列于所述时钟信号线两侧;在所述第二辅显示子区内,靠近所述时钟信号线两侧的两列像素单元中的各像素单元间隔开所述m行GOA单元交错排列。
进一步优选的,在所述第一辅显示子区内,位于所述第一GOA子区远离所述主显示子区的一侧像素单元中,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸;和/或,在所述第二辅显示子区内,位于所述第二GOA子区远离所述主显示子区的一侧像素单元中,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸。
进一步优选的,在所述第一辅显示子区内,位于所述第一GOA子区远离所述主显示子区的一侧像素单元中,除靠近所述时钟信号线的一列像素单元外,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸;和/或,在所述第二辅显示子区内,位于所述第二GOA子区远离所述主显示子区的一侧像素单元中,除靠近所述时钟信号线的一列像素单元外,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸。
在上述基础上优选的,n1<n,和/或,n2<n。
优选的,n1=5%(n1+n+n2),和/或,n2=5%(n1+n+n2)。
在上述基础上优选的,所述显示区域的横纵比例大于16∶9;所述主显示子区的横纵比例等于16∶9。
在上述基础上优选的,在所述显示区域的外侧,所述阵列基板还包括位于所述m行栅线两端、且与m行栅线分别相连的2m个静电放电ESD保护单元。
本发明实施例还提供了一种显示面板,包括彩膜基板、与所述彩膜基板对盒的上述所述的阵列基板;所述彩膜基板上设置有黑矩阵;其中,所述黑矩阵包括开口区域;所述开口区域露出设置在所述阵列基板上的显示区域内的像素单元。
基于此,通过本发明实施例提供的上述阵列基板,由于设置有GOA单元的GOA区域位于显示区域的内部,减小了这部分GOA区域所占用的边框区域的面积,从而减小了上述阵列基板与彩膜基板对盒后形成的显示面板的边框宽度,进一步满足了用户对于窄边框显示面板显示效果的要求,为用户提供了视觉效果更优的观感。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本发明的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为现有技术提供的一种Gate On Array的阵列基板的俯视结构示意图;
图2为本发明实施例提供的一种阵列基板的俯视结构示意图(一);
图3为本发明实施例提供的一种阵列基板与图1所示的现有技术的阵列基板的剖面结构比对示意图;
图4为本发明实施例提供的一种阵列基板的俯视结构示意图(二);
图5为本发明实施例提供的一种阵列基板中GOA单元的电路结构及对应的时序控制图;
图6为本发明实施例提供的一种阵列基板的俯视结构示意图(三);
图7为本发明实施例提供的一种阵列基板的俯视结构示意图(四);
图8为本发明实施例提供的一种阵列基板的俯视结构示意图(五);
图9为本发明实施例提供的一种阵列基板的俯视结构示意图(六);
图10为本发明实施例提供的一种显示面板中彩膜基板的俯视结构示意图。
附图标记:
01-阵列基板;100-显示区域;101-第一辅显示子区;102-第二辅显示子区;103-主显示子区;200-GOA区域;201-第一GOA子区;202-第二GOA子区;10-衬底基板;20-像素单元;30-GOA单元;40-栅线;50-时钟信号线;60-ESD单元;70-封框胶;90-黑矩阵;91-开口区域;02-彩膜基板。
具体实施方式
下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
本发明实施例提供了一种阵列基板,如图2所示,所述阵列基板01包括位于衬底基板10上的显示区域100;所述显示区域100内设置有像素单元20;所述显示区域100内还包括设置有GOA单元30的GOA区域200;其中,所述GOA单元30与所述像素单元20无重叠。
需要指出的是,图2示意出的显示区域100内包括两个相对的GOA区域200,是针对大尺寸显示面板而言,为了避免栅极信号的延迟,因此驱动每行像素单元20进行图像显示的GOA单元30有一对的设计结构,并非对本发明实施例中的GOA区域200数量的限定。
本发明实施例对GOA区域200的数量及位于显示区域100内的具体位置不作限定,可根据阵列基板01的尺寸灵活设计。
由于GOA单元30通常包括有多个开关管、电容以及相应的连接电路等结构组成,GOA单元30所在的区域即为不透明的,为了避免GOA单元30对图像正常显示的影响,在本发明实施例提供的上述阵列基板01中,GOA单元30与像素单元20无重叠。
此外,参考图2中的虚线放大部分所示,像素单元20可至少包括三个子像素,以分别对应于彩膜基板上的红色滤光单元、绿色滤光单元以及蓝色滤光单元。
如图3所示,下面进一步具体说明本发明实施例提供的上述阵列基板01与彩膜基板02对盒后形成的显示面板具有比图1所示的现有技术更窄的边框宽度:
参考图1与图3可知,图3中的(a)部分即为现有技术提供的显示面板沿阵列基板01中栅线方向一侧的边框区域剖面图,可以看出,在现有技术中,阵列基板01与彩膜基板02对盒后形成的显示面板的边框宽度(图中标记为a)为:
a=b+c+e; 表达式(1)
其中,b为切割各个显示面板的切割余量(cutting margin);c为用于密封显示面板的封框胶70的宽度;e为GOA区域200的宽度。
一并参考图2与图3可知,图3中的(b)部分即为本发明实施例提供的上述阵列基板01与彩膜基板02对盒后形成的显示面板的边框区域剖面图,可以看出,在本发明实施例中,阵列基板01与彩膜基板02对盒后形成对盒后的显示面板的边框宽度(图中标记为a′)为:
a′=b+c; 表达式(2)
其中,为了便于比较a与a′的大小关系,上述表达式(1)、(2)中的b、c值分别相同。
通过对以上两个表达式进行比较可知,由于本发明实施例提供的上述阵列基板01中,GOA区域位于显示区域100的内部,相比于现有技术,本发明实施例中显示区域100的边界(图中标记为100edge)明显地向边框一侧延伸,可以非常贴近于封框胶70,因此,图3中(a)部分的边框宽度a明显小于(b)部分的边框宽度a′。
基于此,通过本发明实施例提供的上述阵列基板,由于设置有GOA单元30的GOA区域200位于显示区域100的内部,减小了这部分GOA区域200所占用的边框区域的面积,从而减小了上述阵列基板01与彩膜基板02对盒后形成的显示面板的边框宽度,进一步满足了用户对于窄边框显示面板显示效果的要求,为用户提供了视觉效果更优的观感。
此处以显示屏尺寸为55英寸的显示面板为例,采用本发明提供的上述阵列基板01与彩膜基板对盒后形成的显示面板的边框宽度相比于现有技术可减小1cm左右,明显减小了边框的宽度。
在上述基础上,由于GOA区域200位于显示区域100的内部,从而将设置在显示区域100内部的像素单元20分隔为不同的区域;对于大尺寸显示面板而言,由于其尺寸较大,相应的阵列基板01上的显示区域100的整体尺寸也较大,用户观看的视角范围会集中于能够显示区域,容易将不进行显示的GOA区域200忽略。因此,本发明实施例提供的上述阵列基板01优选为应用于大尺寸的显示面板。
进一步的,为了避免大尺寸显示面板由于尺寸较大而产生栅极信号延迟,本发明实施例进一步优选为:
如图4所示,沿栅线方向(图中标记为Dgate line),所述显示区域100包括主显示子区103、位于所述主显示子区103两侧的第一辅显示子区101、第二辅显示子区102;所述GOA区域200包括分别位于所述第一辅显示子区101、所述第二辅显示子区102内的第一GOA子区201、第二GOA子区202;所述显示区域100内设置有贯穿所述主显示子区103、所述第一辅显示子区101以及所述第二辅显示子区102的m行栅线40,m为正整数;所述第一GOA子区201、所述第二GOA子区202内均设置有m行GOA单元30、与所述GOA单元30相连的时钟信号线50;其中,每行栅线40与每行GOA单元30相连。
需要说明的是,第一、图4中仅示意出阵列基板01中的7行栅线40,并非对栅线40行数m的具体限定。
第二、本发明实施例对第一GOA子区201、第二GOA子区202内设置的时钟信号线50的数量不作限定,可根据现有技术中GOA单元30的具体电路结构灵活设计,图4中仅以每个GOA单元30连接两条时钟信号线50为例进行示意。
这里,GOA单元30的具体电路结构和制备工艺可沿用现有技术,对此不作限定。例如,时钟信号线50可以与阵列基板01的数据线采用同一次构图工艺形成,GOA单元30与时钟信号线50的连接可通过与栅线40采用同一次构图工艺形成的连接线来实现。
示例地,连接两条时钟信号线50的GOA单元30的具体结构单元及对应的时序控制图可参见图5。
其中,CLK和CLKR分别为一个GOA单元30连接的两条时钟信号线50输出的时钟信号;Input和Output分别表示一个GOA单元30输入和输出的信号;Reset表示GOA单元30中的重置信号;VGL表示GOA单元30中的栅线低电压信号;PD和PU分别表示一个GOA单元30的电路结构中的下拉控制节点和上拉控制节点。
第三、由于用户在观看显示图像时,视觉的焦点往往集中于显示屏的正前方区域。因此,参考图4所示,虽然位于显示区域100中心处的主显示子区103两侧的第一GOA子区201和第二GOA子区202没有进行显示,但由于上述两个GOA子区位于主显示子区103两侧的第一辅显示子区101和第二辅显示子区102内,第一辅显示子区101和第二辅显示子区102内设置的像素单元20同时也在进行图像显示,人眼不易察觉到主显示子区103两侧的没有进行显示的区域,从而保证了用户在获得窄边框显示面板的宽景显示效果的同时,还可使得显示区域100整体的显示品质与现有技术中的宽边框显示面板的显示效果相近。
示例地,可设置第一GOA子区201和第二GOA子区202的宽度约等于显示区域100内像素单元20宽度的两倍,由于像素单元20的尺寸数量级通常在微米(μm)数量级,因此不进行显示的GOA子区的宽度与像素单元20的宽度非常接近,人眼不易于察觉到这部分不进行显示的区域。
这里,所述第一辅显示子区101、所述主显示子区103以及所述第二辅显示子区102内依次设置有n1列像素单元、n列像素单元以及n2列像素单元;其中,n1、n、n2均为正整数。
在上述基础上,如图6所示,在所述第一辅显示子区101内,所述第一GOA子区201将所述n1列像素单元间隔为两部分;和/或,在所述第二辅显示子区102内,所述第二GOA子区202将所述n2列像素单元间隔为两部分。
这样一来,当阵列基板01与彩膜基板02对盒后形成的显示面板进行图像显示时,由于不进行显示的第一GOA子区201与主显示子区103之间还设置有一部分的第一辅显示子区101的像素单元20,用户在观看显示面板显示的图像时,焦点容易集中于显示图像的连贯完整性,更不易察觉到这部分不进行显示的第一GOA子区,从而保证用户获得更优的观看体验。
同样地,第二GOA子区202将n2列像素单元间隔为两部分,也可起到保证用户获得更优的观看体验的有益效果。
在上述基础上,在第一辅显示子区101远离主显示子区103的一侧,即靠近阵列基板01与彩膜基板对盒后形成的显示面板的边框区域,由于人眼的视觉焦点集中于主显示子区103中,用户容易忽略显示区域100靠近边框的两侧,可以理解为人眼对显示区域100两侧的图像显示质量要求不高。
因此,本发明实施例进一步优选的,如图7所示,在所述第一辅显示子区101内,位于所述第一GOA子区201远离所述主显示子区103的一侧像素单元中,至少有一列像素单元中的各像素单元20的尺寸大于所述主显示子区内的像素单元的尺寸。
和/或,在所述第二辅显示子区102内,位于所述第二GOA子区202远离所述主显示子区103的一侧像素单元20中,至少有一列像素单元20中的各像素单元20的尺寸大于所述主显示子区103内的像素单元20的尺寸。
这样一来,由于至少一列像素单元中的各像素单元20的尺寸大于所述主显示子区内的像素单元的尺寸,一方面可以降低GOA单元30的负载,简化GOA单元30对这部分像素尺寸较大的像素单元20的处理,从而降低阵列基板01的整体电路消耗;另一方面,由于这部分尺寸较大的像素单元20是设置在第一GOA子区201和/或第二GOA子区202远离主显示子区103的一侧处,人眼难以察觉到,对显示区域100的整体显示品质影响很小。
这里,综合考量整体显示品质与降低GOA单元负载的效果,在第一GOA子区201和/或第二GOA子区202远离主显示子区103的一侧处,至少有一列像素单元20中的各像素单元20的尺寸等于所述主显示子区103内的像素单元20的尺寸的2至3倍。
在上述基础上,如图8所示,在所述第一GOA子区201内,所述时钟信号线50垂直于所述栅线40,且奇数行的GOA单元30与偶数行的GOA单元30交错排列于所述时钟信号线50两侧;在所述第一辅显示子区101内,靠近所述时钟信号线50两侧的两列像素单元中的各像素单元20间隔开所述m行GOA单元30交错排列。
和/或,在所述第二GOA子区202内,所述时钟信号线50垂直于所述栅线40,且奇数行的GOA单元30与偶数行的GOA单元30交错排列于所述时钟信号线50两侧;在所述第二辅显示子区102内,靠近所述时钟信号线50两侧的两列像素单元中的各像素单元20间隔开所述m行GOA单元30交错排列。
这样一来,通过使用于显示的像素单元20和不进行显示的GOA单元30交错排列,可进一步降低在显示区域100内部的不显示的GOA区域200的存在感。
进一步的,如图9所示,在所述第一辅显示子区101内,位于所述第一GOA子区201远离所述主显示子区103的一侧像素单元20中,除靠近所述时钟信号线50的一列像素单元20外,至少有一列像素单元20中的各像素单元20的尺寸大于所述主显示子区103内的像素单元20的尺寸。
和/或,在所述第二辅显示子区102内,位于所述第二GOA子区202远离所述主显示子区103的一侧像素单元20中,除靠近所述时钟信号线50的一列像素单元外,至少有一列像素单元20中的各像素单元20的尺寸大于所述主显示子区103内的像素单元20的尺寸。
这里,由于在第一辅显示子区101和/或第二辅显示子区102内,靠近所述时钟信号线50两侧的两列像素单元20中的各像素单元20间隔开所述m行GOA单元30交错排列,以进一步降低人眼对显示区域100内部的不显示的GOA区域200的可察觉感。因此,在进行图像显示时,为了保证这部分交错排列的像素单元20与主显示子区103中的像素单元20的连贯性,靠近所述时钟信号线50两侧的交错排列的两列像素单元20中的像素尺寸与主显示子区103内的像素单元20的尺寸相同。
这样一来,由于除靠近所述时钟信号线50的一列像素单元外,至少一列像素单元中的各像素单元20的尺寸大于所述主显示子区内的像素单元的尺寸,一方面可以降低GOA单元30的负载,简化GOA单元30对这部分像素尺寸较大的像素单元20的处理,从而降低阵列基板01的整体电力消耗;另一方面,由于这部分尺寸较大的像素单元20是设置在第一GOA子区201和/或第二GOA子区202远离主显示子区103的一侧处,人眼难以察觉到,对显示区域100的整体显示品质影响很小。
同样地,综合考量整体显示品质与降低GOA单元负载的效果,在第一GOA子区201和/或第二GOA子区202远离主显示子区103的一侧处,由于除靠近所述时钟信号线50的一列像素单元外,至少有一列像素单元20中的各像素单元20的尺寸等于所述主显示子区103内的像素单元20的尺寸的2至3倍。
在上述基础上,第一辅显示子区101内设置的n1列像素单元、主显示子区103内设置的n列像素单元以及第二辅显示子区102内设置的n2列像素单元满足:n1<n,和/或,n2<n的条件;即尽可能地使主显示子区103占据显示区域100较大的面积比例,而减小两侧第一辅显示子区101和第二辅显示子区102的面积比例,使得第一GOA子区201和/或第二GOA子区202更加远离主显示子区103,提高显示效果。
具体的,第一辅显示子区101内设置的n1列像素单元、主显示子区103内设置的n列像素单元以及第二辅显示子区102内设置的n2列像素单元进一步满足以下条件:n1=5%(n1+n+n2),和/或,n2=5%(n1+n+n2)。
这里,由于人眼的视觉特性,n1=5%(n1+n+n2),即第一辅显示子区101在显示区域100一侧的5%处,人眼难以察觉到第一辅显示子区101内的第一GOA子区201;同样的,n2=5%(n1+n+n2),即第二辅显示子区102在显示区域100相对侧的5%处,人眼难以察觉到第一辅显示子区101内的第二GOA子区202。
在上述基础上,所述显示区域100的横纵比例大于16∶9;所述主显示子区103的横纵比例等于16∶9。
由于目前输入到显示面板中的高清数字电视信号的图像比例为16∶9,因此,但显示区域100的横纵比例大于16∶9,例如可以为21∶9,同时,主显示子区103的横纵比例等于16∶9,可使得主显示子区103来显示16∶9的高清数字电视信号,而无需对高清数字电视信号进行拉伸或压缩处理;而位于主显示子区103两侧的第一辅显示子区101和第二辅显示子区102可进行菜单、文字等对主显示子区103进行说明的操作。
在上述基础上,为了防止阵列基板01中的静电导致的瞬间电流过大击穿GOA单元30,影响阵列基板01的正常显示,阵列基板01中还包括有与栅线40相连的静电放电ESD保护单元60(简称ESD单元)。
为了减小ESD单元60设置在GOA区域200内部时,导致的显示区域100中不进行显示的区域变大,影响显示品质,本发明实施例进一步优选的,参考图7或图9所示,在所述显示区域100的外侧,所述阵列基板01还包括位于所述m行栅线40两端、且与m行栅线40分别相连的2m个静电放电ESD保护单元60(简称ESD单元)。
本发明实施例还提供了一种显示面板,所述显示面板包括彩膜基板02,与所述彩膜基板02对盒的上述的阵列基板01;其中,如图10所示,所述彩膜基板02上设置有黑矩阵90;所述黑矩阵90包括开口区域91,所述开口区域91露出设置在所述阵列基板01上的显示区域内的像素单元20。
上述显示装置具体可以是液晶显示装置,可以为液晶显示器、液晶电视、数码相框、手机、平板电脑等具有任何显示功能的产品或者部件。
需要说明的是,本发明所有附图是上述阵列基板及包括该阵列基板的显示面板的简略的示意图,只为清楚描述本方案体现了与发明点相关的结构,对于其他的与发明点无关的结构是现有结构,在附图中并未体现或只体现部分。
以上所述,仅为本发明的具体实施方式,但本发明的保护范围并不局限于此,任何熟悉本技术领域的技术人员在本发明揭露的技术范围内,可轻易想到变化或替换,都应涵盖在本发明的保护范围之内。因此,本发明的保护范围应以所述权利要求的保护范围为准。
Claims (11)
1.一种阵列基板,包括位于衬底基板上的显示区域;所述显示区域内设置有像素单元;其特征在于,所述显示区域内还包括设置有GOA单元的GOA区域;其中,所述GOA单元与所述像素单元无重叠。
2.根据权利要求1所述的阵列基板,其特征在于,沿栅线方向,所述显示区域包括主显示子区、位于所述主显示子区两侧的第一辅显示子区、第二辅显示子区;
所述GOA区域包括分别位于所述第一辅显示子区、所述第二辅显示子区内的第一GOA子区、第二GOA子区;
所述显示区域内设置有贯穿所述主显示子区、所述第一辅显示子区以及所述第二辅显示子区的m行栅线,m为正整数;
所述第一GOA子区、所述第二GOA子区内均设置有m行GOA单元、与所述GOA单元相连的时钟信号线;
其中,每行栅线与每行GOA单元相连。
3.根据权利要求2所述的阵列基板,其特征在于,所述第一辅显示子区、所述主显示子区以及所述第二辅显示子区内依次设置有n1列像素单元、n列像素单元以及n2列像素单元;n1、n、n2均为正整数;
其中,在所述第一辅显示子区内,所述第一GOA子区将所述n1列像素单元间隔为两部分;和/或,在所述第二辅显示子区内,所述第二GOA子区将所述n2列像素单元间隔为两部分。
4.根据权利要求3所述的阵列基板,其特征在于,
在所述第一GOA子区内,所述时钟信号线垂直于所述栅线,且奇数行的GOA单元与偶数行的GOA单元交错排列于所述时钟信号线两侧;在所述第一辅显示子区内,靠近所述时钟信号线两侧的两列像素单元中的各像素单元间隔开所述m行GOA单元交错排列;
和/或,在所述第二GOA子区内,所述时钟信号线垂直于所述栅线,且奇数行的GOA单元与偶数行的GOA单元交错排列于所述时钟信号线两侧;在所述第二辅显示子区内,靠近所述时钟信号线两侧的两列像素单元中的各像素单元间隔开所述m行GOA单元交错排列。
5.根据权利要求3所述的阵列基板,其特征在于,
在所述第一辅显示子区内,位于所述第一GOA子区远离所述主显示子区的一侧像素单元中,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸;
和/或,在所述第二辅显示子区内,位于所述第二GOA子区远离所述主显示子区的一侧像素单元中,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸。
6.根据权利要求4所述的阵列基板,其特征在于,
在所述第一辅显示子区内,位于所述第一GOA子区远离所述主显示子区的一侧像素单元中,除靠近所述时钟信号线的一列像素单元外,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸;
和/或,在所述第二辅显示子区内,位于所述第二GOA子区远离所述主显示子区的一侧像素单元中,除靠近所述时钟信号线的一列像素单元外,至少有一列像素单元中的各像素单元的尺寸大于所述主显示子区内的像素单元的尺寸。
7.根据权利要求3至6任一项所述的阵列基板,其特征在于,
n1<n,和/或,n2<n。
8.根据权利要求7所述的阵列基板,其特征在于,
n1=5%(n1+n+n2),和/或,n2=5%(n1+n+n2)。
9.根据权利要求2至6任一项所述的阵列基板,其特征在于,
所述显示区域的横纵比例大于16∶9;
所述主显示子区的横纵比例等于16∶9。
10.根据权利要求2至6任一项所述的阵列基板,其特征在于,在所述显示区域的外侧,所述阵列基板还包括位于所述m行栅线两端、且与m行栅线分别相连的2m个静电放电ESD保护单元。
11.一种显示面板,其特征在于,包括彩膜基板、与所述彩膜基板对盒的如权利要求1至10任一项所述的阵列基板;所述彩膜基板上设置有黑矩阵;
其中,所述黑矩阵包括开口区域;所述开口区域露出设置在所述阵列基板上的显示区域内的像素单元。
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