CN104505046B - 一种栅极驱动电路、阵列基板、显示面板和显示装置 - Google Patents

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Abstract

本发明公开了一种栅极驱动电路、阵列基板、显示面板和显示装置,解决由于栅极驱动电路中由于某一极移位寄存单元出现异常无法使与该移位寄存单元具有依赖关系的后续移位寄存单元被触发,导致整个GOA电路出现误动作甚至无法工作的问题。所述栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,所述栅极驱动电路还包括多个选通单元,所述选通单元被选通后,将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线。

Description

一种栅极驱动电路、阵列基板、显示面板和显示装置

技术领域

[0001] 本发明涉及显示技术领域,尤其涉及一种栅极驱动电路、阵列基板、显示面板和显示装置。背景技术

[0002] 液晶显示器(liquid crystal display,LCD)或有机发光二极管(Organic Light-Emitting D1de ,0LED) 具有低福射、体积小及低耗能等优点, 已逐渐在部分应用中取代传统的阴极射线管显示器(Cathode Ray Tube display,CRT),因而被广泛地应用在笔记本电脑、个人数字助理(Personal Digital Assistant,PDA)、平面电视,或移动电话等信息产品上。传统液晶显示器的方式是利用外部驱动芯片来驱动面板上的芯片以显示图像,但为了减少元件数目并降低制造成本,近年来逐渐发展成将驱动电路结构直接制作于显示面板上,例如采用将栅极驱动电路(Gate Driver)整合于阵列基板上(Gate On Array,G0A)的技术。

[0003] G0A技术相比传统覆晶薄膜(Chip On Flex/Film,C0F)和直接绑定在玻璃上(Chip On Glass,C0G)的工艺,G0A技术不仅可以节省成本,而且面板可以做到两边对称,该技术的主要特点是依靠G0A单元连续触发实现其移位寄存的功能,省去了栅集成电路(Gate 1C)的绑定(Bonding)区域以及Fan-out布线空间,实现了窄边框的设计;同时由于可以省去Gate 方向Bond i ng的工艺,对产能和良品率提升也比较有利。

[0004] 现有技术中对G0A技术的栅极驱动电路进行了优化,从而确保输出的稳定。例如: 为了防止由于时钟信号延迟等原因造成的时序絮乱,G0A技术中的各级移位寄存单元按序输出,各时钟信号的占空比小于50%,且各时钟信号依序具有小于1/2脉冲宽度的交叠,从而使当前级移位寄存单元的输出信号与前一级移位寄存单元的输出信号具有小于1/2脉冲宽度的交叠。但是在某些情况下,G0A技术的栅极驱动电路仍存在问题,例如,G0A技术中的某一移位寄存单元依赖于自身之上某一级移位寄存单元的输出信号,将自身之上某一级移位寄存单元的输出信号作为本级移位寄存单元的输入信号,若自身之上某一级移位寄存单元因出现故障或无效使其输出信号出现异常,将造成本级和后续移位寄存单元不能正常输出信号,也即将导致整个G0A电路出现误动作,甚至无法工作。发明内容

[0005] 本发明的目的是提供一种栅极驱动电路、阵列基板、显示面板和显示装置,解决由于栅极驱动电路中由于某一级移位寄存单元出现异常无法使与其具有依赖关系的后续移位寄存单元被触发,导致整个G0A电路出现误动作甚至无法工作的问题。

[0006] 本发明的目的是通过以下技术方案实现的:

[0007] 本发明实施例提供一种栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,所述栅极驱动电路还包括多个选通单元,所述选通单元被选通后,将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线。

[0008] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。

[0009] 本发明实施例提供一种阵列基板,所述阵列基板包括显示区和包围所述显示区的非显示区,所述显示区内设置有N行栅线;所述非显示区内设置有如上实施例提供的所述栅极驱动电路。

[0010] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。

[0011] 本发明实施例提供一种显示面板,包括如上实施例提供的所述阵列基板。

[0012] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。

[0013] 本发明实施例提供一种显示装置,包括如上实施例所述的显示面板。

[0014] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。附图说明

[0015] 图1A为本发明一优选实施例提供的一种栅极驱动电路的示意图;

[0016] 图1B为本发明另一优选实施例提供的一种栅极驱动电路的示意图;

[0017] 图2为本发明另一优选实施例提供的一种栅极驱动电路的示意图;

[0018] 图3A为本发明实施例提供的第一种具体的栅极驱动电路的示意图;

[0019] 图3B为图3A提供的栅极驱动电路正常时的部分输出时序图;[〇〇2〇]图3C为图3A提供的栅极驱动电路中第2移位寄存单元异常,进行修复后的部分输出时序图;

[0021]图4为本发明实施例提供的第二种具体的栅极驱动电路的示意图;[〇〇22]图5为本发明实施例提供的第三种具体的栅极驱动电路的示意图;

[0023] 图6为图5的栅极驱动电路修复后的示意图;

[0024] 图7为本发明实施例提供的第四种具体的栅极驱动电路的示意图;

[0025] 图8为本发明实施例提供的第五种具体的栅极驱动电路的示意图;

[0026] 图9为本发明实施例提供的第一种显示面板的示意图;[〇〇27]图10为本发明实施例提供的第二种显示面板的示意图;[〇〇28]图11为本发明实施例提供的显示装置的示意图。具体实施方式

[0029] 下面结合说明书附图对本发明实施例的实现过程进行详细说明。需要注意的是, 自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的,仅用于解释本发明,而不能理解为对本发明的限制。

[0030] 本发明实施例提供一种栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,栅极驱动电路还包括多个选通单元,选通单元被选通后,将前一行栅线对应连接的移位寄存单元和/或后一行栅线对应连接的移位寄存单元的输出信号提供至当前行栅线。

[0031] 本发明实施例中,通过在栅极驱动电路中设置多个选通单元,当前行栅线对应连接的移位寄存单元出现异常时,由选通单元将前一行栅线对应连接的移位寄存单元和/或后一行栅线对应连接的移位寄存单元的输出信号提供至当前行栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。

[0032] 本发明实施例中栅极驱动电路的选通单元所包括的元件有如下说明:[〇〇33] 一个选通单元可以包括两个TFT,该两个TFT可以是串联的两个N型TFT,也可以是串联的两个P型TFT,也可以是一个N型TFT和一个P型TFT串联;或者,一个选通单元包括一个 TFT,全部的选通单元的TFT均为N型TFT或P型TFT,或者第奇数个选通单元为N型/P型TFT,第偶数个选通单元为P型/N型TFT。[〇〇34] 参考图1A,示出了本发明一优选实施例提供的栅极驱动电路,该栅极驱动电路包括:[〇〇35] 与显示面板的N行栅线一一对应连接的N个移位寄存单元,N个移位寄存单元如G1、G2、G3……G (N-2)、G (N-1)和G (N),N行栅线如GL1、GL2、GL3……GL (N_2)、GL (N-1)和GL (N); [0〇36] N-2个选通单元,如R1、R2、R3……R (N_4)、R (N-3)和R (N-2);第h移位寄存单元G (h)和第h+2移位寄存单元G(h+2)之间设置一个选通单元R(h),第h选通单元R(h)的第一端1连接第h移位寄存单元G (h)的输出信号端Gout,第h选通单元R (h)的第二端2连接第h+2移位寄存单元G (h+2)的输出信号端Gout,第h选通单元R (h)的第三端3连接第h+1行栅线GL (h+1); 被选通后的第h选通单元R (h)将第h移位寄存单元G (h)和第h+2移位寄存单元G (h+2)的输出信号依序提供至第h+1行栅线GL (h+1),h= 1,2,3,…N-2。例如,第2移位寄存单元G2和第4移位寄存单元G4之间设置一个选通单元R2,第2选通单元R2的第一端1连接第2移位寄存单元 G2的输出信号端Gout,第2选通单元R2的第二端2连接第4移位寄存单元G4的输出信号端 Gout,第2选通单元R2的第三端3连接第3行栅线GL3;被选通后的第2选通单元R2将第2移位寄存单元G2和第4移位寄存单元G4的输出信号依序提供至第3行栅线GL3,其他各个选通单元具有相同的连接逻辑,在此不再赘述。选通单元的选通是根据选通信号线S1、S2、S3和S4 所提供的脉冲信号进行的,该此选通信号线连接按设计需要连接各选通单元的第一控制端4或第二控制端5。[〇〇37] 本实施例中,为了使栅极驱动电路正常工作,还需要为移位寄存单元提供诸如初始触发信号线(如图1A中所示的第一初始触发信号线STV1和第二初始触发信号线STV2)、复位信号线RESET、低电平信号线VGL、正向扫描信号线FW、反向扫描信号线BW、时钟信号线CK_ L、时钟信号线CKB_L、时钟信号线CK_R和时钟信号线CKB_R;但是,该些信号线的数量和连接关系并不限于图1A所示,上述的各信号及提供各信号的信号线的数量根据移位寄存单元结构的不同,会有多种变化,例如图1B所示另一优选的栅极驱动电路,该栅极驱动电路为8相时钟信号控制的栅极驱动电路,提供时钟信号线(如时钟信号CK0、时钟信号CK1、时钟信号 CK2、……时钟信号CK6、时钟信号CK7),提供4条初始触发信号线(如第一初始触发信号线 STV1、第二初始触发信号线STV2、第三初始触发信号线STV3、第四初始触发信号线STV4)。需要说明的是,时钟信号的增加(即增加时钟信号线,例如8时钟信号、16时钟信号、32时钟信号或更多时钟信号)时,选通单元R1、R2、R3……R(N-4)、R(N-3)和R(N-2)与栅极驱动电路的匹配关系与图1A中相同,即各选通单元与各移位寄存单元的连接关系是相同的;当然,基于时钟信号的增加,相应的提供更多的选通信号线(例如图1B所示的选通信号线S1至选通信号线S8)。因此,基于如图1A或图1B所示栅极驱动电路的相同原理可以进行诸多变型,而在时钟信号增加时,相应的增加选通信号线。

[0038] 参考图2,示出了本发明再一优选实施例提供的栅极驱动电路,该栅极驱动电路包括:[〇〇39] 与显示面板的N行栅线一一对应连接的N个移位寄存单元,N个移位寄存单元如G1、G2、G3……G (N-2)、G (N-1)和G (N),N行栅线如GL1、GL2、GL3……GL (N_2)、GL (N-1)和GL (N);

[0040] N-1个选通单元,如R1、R2、R3……R (N_3)、R (N-2)和R (N-1);第k移位寄存单元G (k) 和第k+1移位寄存单元G (k+1)之间设置一个选通单元R (k),

[0041] 第k选通单元R (k)的第二端2和第k+1选通单元R (k+1)的第一端1均连接第k+1行栅线GL (k+1),第k选通单元R (k)的第一端1连接第k移位寄存单元G (k)的输出信号端Gout,第k + 1选通单元R (k+1)的第二端2连接第k+2移位寄存单元G(k+2)的输出信号端Gout;被选通后的第k选通单元R (k)和第k+1选通单元R (k+1)分别将第k移位寄存单元G (k)和第k+2移位寄存单元G (k+2)的输出信号依序提供至第k+1行栅线GL (k+1),k= 1,2,3,…N-1。例如,第2选通单元R2的第二端2和第3选通单元R3的第一端1均连接第3行栅线GL3,第2选通单元R2的第一端1连接第2移位寄存单元G2的输出信号端Gout,第3选通单元R3的第二端2连接第4移位寄存单元G4)的输出信号端Gout;被选通后的第2选通单元R2和第3选通单元R (3分别将第2 移位寄存单元G2和第4移位寄存单元G4的输出信号依序提供至第3行栅线GL3,其他各个选通单元具有相同的连接逻辑,在此不再赘述。选通单元的选通是根据选通信号线S1和S2所提供的脉冲信号进行的,该此选通信号线连接按设计需要连接各选通单元的第一控制端4。 [〇〇42] 本实施例中,为了使栅极驱动电路正常工作,还需要为移位寄存单元提供诸如第一初始触发信号STV1、第二初始触发信号STV2、复位信号RESET、低电平信号VGL、正向扫描信号FW、反向扫描信号BW、时钟信号CK_1、时钟信号CKB_1、时钟信号CK_2和时钟信号CKB_2; 上述的各信号及提供各信号的信号线的数量根据移位寄存单元结构的不同,会有多种变化,在此不再赘述。

[0043] 对应不同元件构成的选通单元,本发明实施例提供的栅极驱动电路提供至少一种用于控制是否选通选通单元的方式:例如,在不需要选通单元工作时,通过一条或多条信号线提供关断信号,在需要选通单元工作时通过一条或多条信号线提供脉冲信号,用于提供关断信号和提供脉冲信号的信号线可以共用,仅在不同的状态下或不同的时间段提供不同的信号;又例如,栅极驱动电路包括分别提供关断信号和脉冲信号的不同信号线,此种情况下为了使选通单元工作,需要断开选通单元和提供关断信号的信号线之间的连接,并使选通单元和提供脉冲信号的信号线连接。为了更加清楚的描述不同元件构成的选通单元的选通方式,结合附图3A至8所示出的栅极驱动电路进行说明,如下:[〇〇44] 参见图3A,提供第一种具体的栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,N个移位寄存单元如G1、G2、G3……G (N_2)、G (N-1)和G (N),N行栅线如GL1、GL2、GL3……GL (N_2)、GL (N-1)和GL (N) ;N_2个选通单元,如R1、R2、R3……R (N-4)、 R(N-3)和R(N-2),每个选通单元包括串联的第一TFT II和第二TFT T2,T1和T2为N型TFTJ1 的栅极、源极和漏极分别连接选通单元的第一控制端4、第一端1和第三端3,T2的栅极、源极和漏极分别连接选通单元的第二控制端5、第二端2和第三端3。栅极驱动电路提供选通信号线S1〜S4,基于选通信号线S1〜S4所提供的信号的控制,可以实现栅极驱动电路正常时对各选通单元关断,在栅极驱动电路出现异常时使各选通单元工作;或者基于选通信号线S1 〜S4所提供的信号的控制,使选通单元在栅极驱动电路的工作时即进行有规律的关断和选通,从而在栅极驱动电路出现异常时自动修复栅极驱动电路。具体举例如下:

[0045] 基于图3A所示的栅极驱动电路,修复方法之一:[〇〇46] 栅极驱动电路正常时,由选通信号线S1〜S4提供低电平信号,使全部选通单元关断;栅极驱动电路异常时,由选通信号线S1〜S4提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相反,选通信号线S3和选通信号线S4提供的脉冲信号相位相反,S卩T1导通时T2关断,T1关断时T2导通,选通信号线S1〜S4提供的脉冲信号与各时钟信号 (如时钟信号CK_1、时钟信号CKB_1、时钟信号CK_2和时钟信号CKB_2)配合,使T1和T2依序导通或关断,从而实现被选通后的第h选通单元R (h)将第h移位寄存单元G (h)和第h+2移位寄存单元G (h+2)的输出信号依序提供至第h+1行栅线GL (h+1)。

[0047] 基于图3A所示的栅极驱动电路,修复方法之二:[〇〇48] 无论栅极驱动电路正常或是异常,均由选通信号线S1〜S4提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相反,选通信号线S3和选通信号线S4提供的脉冲信号相位相反,即T1导通时T2关断,T1关断时T2导通,选通信号线S1〜S4提供的脉冲信号与各时钟信号(如时钟信号CK_1、时钟信号CKB_1、时钟信号CK_2和时钟信号CKB_2)配合,使T1和T2依序导通或关断,在栅极驱动电路正常时不会影响栅极驱动电路的输出,在栅极驱动电路异常时,第h选通单元R(h)自动将第h移位寄存单元G(h)和第h+2移位寄存单元G (h+2)的输出信号依序提供至第h+1行栅线GL (h+1),从而实现栅极驱动电路异常时的修复, h = l,2,3,."N-2〇

[0049] 基于修改方法1或2,以栅极驱动电路中的第2移位寄存单元出现异常后,进行修复为例说明如下:

[0050] 图3B为图3A所示的栅极驱动电路中的各个移位寄存单元正常时的输出时序图,为了便于说明仅示出第1移位寄存单元的输出信号G1、第2移位寄存单元的输出信号G2和第3 移位寄存单元的输出信号G3;其中,第2移位寄存单元的输出信号G2和第1移位寄存单元的输出信号G1具有t时间段的交叠,第3移位寄存单元的输出信号G3和第2移位寄存单元的输出信号G2具有t时间段的交叠。[〇〇51]图3C为图3A所示的栅极驱动电路中第2移位寄存单元异常并进行修复后的输出时序图,为了便于说明仅示出第1移位寄存单元的输出信号G1、第2移位寄存单元的输出信号 G2和第3移位寄存单元的输出信号G3,具体如下:[〇〇52] tl时间段,选通信号S1为高电平信号,选通信号S2为低电平信号,第1选通单元的 T1打开,第1选通单元的T2关断,第1移位寄存单元G1为第2移位寄存单元G2的输出端提供高电平信号。[〇〇53] t2时间段,选通信号S1为低电平信号,选通信号S2为高电平信号,第1选通单元的 T1关断,第1选通单元的T2打开,由于第1、3移位寄存单元均输出低电平信号,第2移位寄存单元G2的输出端低电平信号。

[0054] t3时间段,选通信号S1为低电平信号,选通信号S2为高电平信号,第1选通单元的 T1关断,第1选通单元的T2打开,由第3移位寄存单元G3为第2移位寄存单元G2的输出端提供高电平信号。

[0055] t4时间段,第3移位寄存单元G3输出高电平信号。[〇〇56] t5时间段,第1移位寄存单元G1、第2移位寄存单元G2、第3移位寄存单元G3均输出低电平信号。[〇〇57] 对于图3C中所示的第2移位寄存单元G2的输出端所输出的信号,需要在tl时间段和t3时间段之间t2时间段的低电平信号,但是t2时间段并非主充电时间段,而t3时间段作为主充电时间段,t3时间段与第2移位寄存单元G2的正常输出时的t时间段(参见图3B)是相等的,因此不会影响第2移位寄存单元G2的驱动能力。图3A所示的栅极驱动电路中,除第1移位寄存单元和第N移位寄存单元外,其他的移位寄存单元出现问题时,其修复后的输出均与图3C所示的第2移位寄存单元G2的输出信号相同。[〇〇58] 需要说明的是,图3A所示的栅极驱动电路中,选通单元所包括的T1和T2也可以均为P型TFT,相应的,基于图3A所示的栅极驱动电路的修复方法之一中,仅需使栅极驱动电路正常时关断选通单元的信号为高电平信号即可。无论基于图3A所示的栅极驱动电路的修复方法之一或之二,选通信号线S1〜S4由于提供脉冲信号,仅需要调整时序以配合各时钟信号,在此不再赘述。[〇〇59] 参见图4,提供第二种具体的栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,N个移位寄存单元如G1、G2、G3……G (N_2)、G (N-1)和G (N),N行栅线如GL1、GL2、GL3……GL (N_2)、GL (N-1)和GL (N) ;N_2个选通单元,如R1、R2、R3……R (N-4)、 R(N-3)和R(N-2),每个选通单元包括串联的第一TFT T1和第二TFT T2,T1为P型TFT,T2为N 型TFT,T1的栅极、源极和漏极分别连接选通单元的第一控制端4、第一端1和第三端3,T2的栅极、源极和漏极分别连接选通单元的第二控制端5、第二端2和第三端3。栅极驱动电路提供选通信号线S1〜S4,基于选通信号线S1〜S4所提供的信号的控制,可以实现栅极驱动电路正常时对各选通单元关断,在栅极驱动电路出现异常时使各选通单元工作;或者基于选通信号线S1〜S4所提供的信号的控制,使选通单元在栅极驱动电路的工作时即进行有规律的关断和选通,从而在栅极驱动电路出现异常时自动修复栅极驱动电路。具体举例如下:

[0060] 基于图4所示的栅极驱动电路,修复方法之一:

[0061] 栅极驱动电路正常时,由选通信号线S1和S3提供高电平信号,由选通信号线S2和 S4提供低电平信号,使全部选通单元关断;栅极驱动电路异常时,由选通信号线S1〜S4提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相同,选通信号线S3和选通信号线S4提供的脉冲信号相位相同,S卩T1导通时T2关断,T1关断时T2导通,选通信号线 S1〜S4提供的脉冲信号与各时钟信号(如时钟信号CK_1、时钟信号CKB_1、时钟信号0(_2和时钟信号CKB_2)配合,使T1和T2依序导通或关断,从而实现被选通后的第h选通单元R(h)将第h移位寄存单元G (h)和第h+2移位寄存单元G (h+2)的输出信号依序提供至第h+1行栅线GL (h+1) 〇

[0062] 基于图4所示的栅极驱动电路,修复方法之二:[〇〇63] 无论栅极驱动电路正常或是异常,均由选通信号线S1〜S4由选通信号线S1〜S4提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相同,选通信号线S3 和选通信号线S4提供的脉冲信号相位相同,S卩T1导通时T2关断,T1关断时T2导通,选通信号线S1〜S4提供的脉冲信号与各时钟信号(如时钟信号CK_1、时钟信号CKB_1、时钟信号CK_2 和时钟信号CKB_2)配合,使T1和T2依序导通或关断,在栅极驱动电路正常时不会影响栅极驱动电路的输出,在栅极驱动电路异常时,第h选通单元R(h)自动将第h移位寄存单元G(h) 和第h+2移位寄存单元G (h+2)的输出信号依序提供至第h+1行栅线GL (h+1),从而实现栅极驱动电路异常时的修复。实际上,由于无论栅极驱动电路正常或是异常,均由选通信号线S1 〜S4由选通信号线S1〜S4提供脉冲信号,且选通信号线S1和选通信号线S2提供的脉冲信号相位相同,选通信号线S3和选通信号线S4提供的脉冲信号相位相同因此,因此,选通单元的第一控制端和第二控制端仅由一条选通信号线提供脉冲信号即可,在此不再赘述。

[0064] 需要说明的是,图4所示的栅极驱动电路中,选通单元所包括的T1也可以为N型下?1',12为?型1?1',相应的,基于图4所示的栅极驱动电路的修复方法之一中,仅需使栅极驱动电路正常时关断T1的信号为低电平信号,关断T2的信号为高电平信号即可。无论基于图4 所示的栅极驱动电路的修复方法之一或之二,选通信号线S1〜S4由于提供脉冲信号,因此仅需要调整时序以配合各时钟信号,在此不再赘述。[〇〇65] 参见图5,提供第三种具体的栅极驱动电路,其是在图3A所示的栅极驱动电路的基础上的变型,与图3A所示的栅极驱动电路的不同之处在于:栅极驱动电路不仅具有选通信号线S1〜S4,还具有关断信号线C1〜C4,第奇数个选通单元的第一控制端4和第二控制端5 分别与关断信号线C1和C2连接,第偶数个选通单元的第一控制端4和第二控制端5分别与关断信号线C3和C4连接,则关断信号线C1〜C4提供低电平信号,使各个选通单元所包括N型 TFT关断。同时,选通单元的控制端(如第一控制端4和第二控制端5)向外延伸的连接线与选通信号线S1和S2、或者与选通信号线S3和S4交叉,在交叉处彼此绝缘且形成有熔接点10。

[0066] 栅极驱动电路异常时,断开能够为异常的移位寄存单元的输出进行修改的选通单元的控制端(如第一控制端4和第二控制端5)与关断信号线(如关断信号线C1和C2,或者,关断信号线C3和C4)的连接,如图6中所示的断开点14;使该选通单元的控制端与选通信号线 (如选通信号线S1和S2,或者,选通信号线S3和S4)在熔接点10处熔接,形成如图6中所示的连接点13,进而由选通信号线提供脉冲信号。[〇〇67]当然,也可以依据图4所示的栅极驱动电路,在栅极驱动电路正常时,利用关断信号线提供关断信号使选通单元关断;在栅极驱动电路异常时,利用选通信号线提供脉冲信号使选通单元工作,其变型与图5所示的栅极驱动电路具有相似的结构和修复原理,在此不再赘述。[〇〇68] 参见图7,提供第四种具体的栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元,N个移位寄存单元如G1、G2、G3……G (N_2)、G (N-1)和G (N),N行栅线如GL1、GL2、GL3……GL (N_2)、GL (N-1)和GL (N) ;N_1个选通单元,每相邻两个移位寄存单元的输出端之间设置一个选通单元,如R1、R2、R3……R(N-4)、R(N-3)和R(N-2),每个选通单元包括一个第一TFT T1,T1可以如图7所示全部为N型TFT。!!的栅极、源极和漏极分别连接选通单元的第一控制端4、第一端1和第三端2。对于全部选通单元的第一 TFT均为N型TFT的情况,栅极驱动电路需要提供两条选通信号线,如选通信号线S1和S2,以使第奇数个选通单元和第偶数个选通单元能够在不同的时刻导通。基于选通信号线S1和S2所提供的信号的控制,可以实现栅极驱动电路正常时对各选通单元关断,在栅极驱动电路出现异常时使各选通单元工作;或者,基于选通信号线S1和S2所提供的信号的控制,使选通单元在栅极驱动电路的工作时即进行有规律的关断和选通,从而在栅极驱动电路出现异常时自动修复栅极驱动电路。

[0069] 基于图7所示的栅极驱动电路,修复方法之一:

[0070] 栅极驱动电路正常时,由选通信号线S1和S2提供低电平信号,使全部选通单元关断;栅极驱动电路异常时,由选通信号线S1和S2提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相反,即第奇数个T1导通时,第偶数个T1关断,第奇数个T1关断时,第偶数个T1导通。选通信号线S1和S2提供的脉冲信号与各时钟信号(如时钟信号CK_ 1、时钟信号CKB_1、时钟信号CK_2和时钟信号CKB_2)配合,使第奇数个T1和第偶数个T1依序导通或关断,从而实现被选通后的第k选通单元R (k)和第k+1选通单元R (k+1)分别将第k移位寄存单元G (k)和第k+2移位寄存单元G (k+2)的输出信号依序提供至第k+1行栅线GL (k+ 1),k=l,2,3,."N-l〇

[0071] 基于图7所示的栅极驱动电路,修复方法之二:[〇〇72] 无论栅极驱动电路正常或是异常,均由选通信号线S1和S2提供脉冲信号,其中,选通信号线S1和选通信号线S2提供的脉冲信号相位相反,即第奇数个T1导通时,第偶数个T1 关断,第奇数个T1关断时,第偶数个T1导通。选通信号线S1和S2提供的脉冲信号与各时钟信号(如时钟信号CK_1、时钟信号CKB_1、时钟信号CK_2和时钟信号CKB_2)配合,使第奇数个T1 和第偶数个T1依序导通或关断。在栅极驱动电路正常时不会影响栅极驱动电路的输出,在栅极驱动电路异常时,实现被选通后的第k选通单元R (k)和第k+1选通单元R (k+1)分别将第 k移位寄存单元G (k)和第k+2移位寄存单元G (k+2)的输出信号依序提供至第k+1行栅线GL (k +l),k=l,2,3,…N-1。从而实现栅极驱动电路异常时的修复。

[0073] 需要说明的是,图7所示的栅极驱动电路中,选通单元所包括的T1也可以均为P型 TFT,相应的,基于图7所示的栅极驱动电路的修复方法之一中,仅需使栅极驱动电路正常时关断选通单元的信号为高电平信号即可。或者,第奇数个选通单元所包括的T1为N型/P型 TFT,第偶数个选通单所包括的T1为P型/N型TFT,相应的,基于图7所示的栅极驱动电路的修复方法之一中,仅需要对应该T1的类型由不同的选通信号线对第奇数行选通单元和第偶数行选通单元提供低电平信号或高电平信号。[〇〇74]图7所示的栅极驱动电路也可以提供如图5所示的关断信号线(如关断信号线C1〜C4),提供的关断信号线的数量可以根据栅极驱动电路中各个选通单元所包括T1的类型进行灵活设置,其修改原理与图5相似,在此不再赘述。[〇〇75] 对于图3A至图7所示的栅极驱动电路,可以根据设计需要进行变型,以显示面板的显示区A/A为参照物,可以将第奇数个移位寄存单元和第偶数个移位寄存单元分别设置于显示区A/A左侧和右侧,或者第奇数个移位寄存单元和第偶数个移位寄存单元均设置于显示区A/A的左侧或右侧。参见图8,提供第五种具体的栅极驱动电路,该栅极驱动电路是在图 3A基础上所进行的,即将图3A所示的栅极驱动电路中分别设置于显示区A/A的左侧和右侧的移位寄存单元均设置于显示区A/A的左侧,图8所示的栅极驱动电路的工作原理和修复方法与图3A所示的栅极驱动电路相同。同样原理,图4至图6所示的栅极驱动电路同样可以参照图8所示进行变型,从而全部移位寄存单元设置于显示区A/A的一侧;图7所示的栅极驱动电路中,第奇数个移位寄存单元和第偶数个移位寄存单元可以分加紧设置于显示区A/A的左侧和右侧,此外,图4至图8所示的栅极驱动电路的修复后的输出时序可参考图3C所示,在此不再赘述。[〇〇76] 参见图9,本发明实施例提供一种显示面板900,包括划分为显示区(A/A) 11和包围显示区(A/A) 11的非显示区12的阵列基板1,显示区11内设置有N行栅线(GL1、GL2〜..GL(N-1)、GL(N)),阵列基板1上设置有如上实施例提供的栅极驱动电路,栅极驱动电路的N个移位寄存单元(G1、G2〜..G (N-l)、G (N))的输出信号端与N行栅线一一对应连接。[〇〇77]与奇数行的栅线连接的各个移位寄存单元设置于显示区11左侧的非显示区12内, 与偶数行的栅线连接的各个移位寄存单元设置于显示区11右侧的非显示区内。

[0078]图9所示的显示面板是以图3A所示的栅极驱动电路为例进行说明的,当然也可以采用如图4至图8所示的栅极驱动电路。例如,与奇数行的栅线连接的各个移位寄存单元设置于显示区11右侧的非显示区12内,与偶数行的栅线连接的各个移位寄存单元设置于显示区11左侧的非显示区12内。[〇〇79]图10 (附图标记含义与图9相同)的示出了第二种显示面板900,所有移位寄存单元均设置于显示区11的一侧,图10所示的显示面板是采用如图8所示的栅极驱动电路而形成的。

[0080] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。

[0081] 参见图11,本发明实施例提供一种显示装置100,包括上述实施例提供的显示面板 900 〇

[0082] 本发明实施例有益效果如下:通过在栅极驱动电路中设置多个选通单元,当前行所述栅线对应连接的移位寄存单元出现异常时,由所述选通单元将前一行所述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信号提供至当前行所述栅线,提高了栅极驱动电路的修复能力,避免整个G0A电路由于某一级移位寄存单元异常所出现的误动作或无法工作的问题。[〇〇83]显然,本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样,倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内,则本发明也意图包含这些改动和变型在内。

Claims (10)

1.一种栅极驱动电路,包括与显示面板的N行栅线一一对应连接的N个移位寄存单元, 其特征在于,所述栅极驱动电路还包括多个选通单元,所述选通单元被选通后,将前一行所 述栅线对应连接的移位寄存单元和/或后一行所述栅线对应连接的移位寄存单元的输出信 号提供至当前行所述栅线;所述栅极驱动电路包括N-2个选通单元,第h移位寄存单元和第h+2移位寄存单元之间 设置一个所述选通单元,第h所述选通单元的第一端连接第h移位寄存单元的输出信号端, 第h所述选通单元的第二端连接第h+2移位寄存单元的输出信号端,第h所述选通单元的第 三端连接第h+1行所述栅线;被选通后的第h所述选通单元将第h移位寄存单元和第h+2移位 寄存单元的输出信号依序提供至第h+1行所述栅线,h = 1,2,3,…N-2;或者,所述栅极驱动电路包括N-1个选通单元,每相邻的两个所述移位寄存单元的输出 信号端之间设置一个所述选通单元;第k所述选通单元的第二端和第k+1所述选通单元的第 一端均连接第k+1行所述栅线,第k所述选通单元的第一端连接第k移位寄存单元的输出信 号端,第k+1所述选通单元的第二端连接第k+2移位寄存单元的输出信号端;被选通后的第k 所述选通单元和第k+1所述选通单元分别将第k移位寄存单元和第k+2移位寄存单元的输出 信号依序提供至第k+1行所述栅线,k= 1,2,3,…N-1。
2.如权利要求1所述的栅极驱动电路,其特征在于,当所述栅极驱动电路包括N-2个选 通单元时,所述选通单元包括第一 TFT和第二TFT,所述第一 TFT的栅极、源极和漏极分别连 接所述选通单元的第一控制端、第一端和第三端,所述第二TFT的栅极、源极和漏极分别连 接所述选通单元的第二控制端、第二端和第三端;所述第一 TFT和所述第二TFT分别根据所述选通单元的第一控制端和第二控制端接收 的选通信号导通或关断。
3.如权利要求2所述的栅极驱动电路,其特征在于,所述选通单元的第一控制端和第二 控制端分别通过第一连接线和第二连接线接收关断信号,所述第一连接线和所述第二连接 线与为所述选通单元的第一控制端和第二控制端提供选通信号的选通信号线交叉且彼此 绝缘,在交叉处设置有熔接点。
4.如权利要求2或3所述的栅极驱动电路,其特征在于,所述第一TFT为N型/P型TFT,所 述第二TFT为P型/N型TFT;或者,所述第一 TFTT和所述第二TFT均为P型TFT或N型TFT。
5.如权利要求1所述的栅极驱动电路,其特征在于,当所述栅极驱动电路包括N-1个选 通单元时,所述选通单元仅包括第一 TFT,所述第一 TFT的栅极、源极和漏极分别连接所述选 通单元的控制端、第一端和第二端;所述第一 TFT根据所述选通单元的控制端接收的选通信 号导通或关断。
6.如权利要求5所述的栅极驱动电路,其特征在于,所述第一TFT为N型TFT或P型TFT,或 者,第奇数个所述选通单元的所述第一 TFT为N型/P型TFT,第偶数个所述选通单元的所述第 一 TFT 为P 型/N型 TFT。
7.—种阵列基板,所述阵列基板包括显示区和包围所述显示区的非显示区,所述显示 区内设置有N行栅线;其特征在于,所述非显示区内设置有如权利要求1至6任一项所述的栅 极驱动电路。
8.如权利要求7所述的阵列基板,其特征在于,所述栅极驱动电路设置于所述显示区左 侧或右侧的所述非显示区内;或者,与奇数行的所述栅线连接的各个所述移位寄存单元设置于所述显示区左/右侧的所述非显示区内,与偶数行的所述栅线连接的各个所述移位寄 存单元设置于所述显示区右/左侧的所述非显示区内。
9.一种显示面板,其特征在于,包括如权利要求7至8任一项所述的阵列基板。
10.—种显示装置,其特征在于,包括如权利要求9所述的显示面板。
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