CN104375426A - 一种片内信号间的相位信息处理和延迟控制电路 - Google Patents
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Abstract
本发明公开了一种片内信号间的相位信息处理和延迟控制电路,它包括存储器、控制器、自动解码器、手动控制逻辑和输出控制逻辑,所述的存储器、自动调节解码器和输出逻辑控制器分别与控制器连接,所述的手动调节控制逻辑与输出逻辑控制器连接。该相位信息处理和延迟控制电路根据输入的相位码,比较相位信息与所设定的目标相位间的关系,输出控制信号来调整信号间的相位关系,通过相位检测电路对相位关系进行跟踪,当相位关系不等于目标相位后,通过对延时码进行增减,将当前相位重新调整到目标相位上。
Description
技术领域
本发明涉及一种处理电路,特别是一种片内信号间的相位信息处理和延迟控制电路。
背景技术
在高速信号处理电路中,存在多个电路功能模块间进行数据传输时,时钟信号和数据信号有严格的同步要求。特别是在高速的数模混合信号电路中,因为模拟域需要高品质的时钟信号,数字域的时钟信号往往质量差,而数字域的数据只能和数据域的时钟保持同步关系,数据信号要传递给模拟域时需要与模拟域的时钟进行严格的同步。为了使得两个信号能够同步,需要对信号的相位进行调整,使两个信号能够同步。
发明内容
本发明的目的在于克服现有技术的不足,提供一种片内信号间的相位信息处理和延迟控制电路,该电路根据输入的相位码,比较相位信息与所设定的目标相位间的关系,输出控制信号来调整信号间的相位关系,通过相位检测电路对相位关系进行跟踪,当相位关系不等于目标相位后,通过对延时码进行增减,将当前相位重新调整到目标相位上。
本发明的目的是通过以下技术方案来实现的:一种片内信号间的相位信息处理和延迟控制电路,它包括存储器、控制器、自动解码器、手动控制逻辑和输出控制逻辑,所述的存储器、自动调节解码器和输出逻辑控制器分别与控制器连接,所述的手动调节控制逻辑与输出逻辑控制器连接;
所述的存储器用于存储在目标相位附近,满足门限要求的相位和步进值;
所述的控制器在搜索阶段控制搜索目标相位的搜索方向以及搜索步进等,在跟踪阶段,判断是否进行重新搜索,并且产生警示信号和锁定信号;
所述的自动解码器用于将温度码编码成二进制补码;
所述的手动控制逻辑通过手动的控制搜索步进,然后读出对应相位,并且判断相位是否为目标相位;
所述的输出控制逻辑控制目标相位以及锁定步进输出。
一种片内信号间的相位信息处理和延迟控制电路进行相位信息处理和延迟控制的方法,它包括如下步骤:
S1:相位码输入控制器,控制器进入开始状态,所有寄存器设置初值,若系统进入未定义状态,则通过默认赋值,控制器将会自动将状态跳转到初始状态,确保不会进入死循环;
S2:控制器将存储器中的参数值重新载入到控制器中;
S3:控制器确认搜索参数后进入搜索状态,对控制信号进行搜索,搜索状态的每个搜索周期完成一个相位关系与目标相位的比较和延迟码的调整;
S4:控制器控制延迟码和相位码的对应关系存储在存储器中;
S5:控制器根据存储的目标相位附近的相位码与延迟码的对应关系判断出该处的斜率取向;
S6:控制器将S5中计算的斜率取向与目标斜率进行比较,根据比较结果,进行如下子步骤:
A:若比较结果处于设定的门限值内,则将存储器中记录的值读出来,计算出对应于目标相位的延迟码的中间值,并采用该值锁定环相位;
B:若比较结果超出设定的门限值,判定失锁,输出警示信号和锁定信号,跳转到步骤S4进行重新搜索;
S7:输出逻辑控制根据输入控制信号和S6得到的延迟码的中间值,输出延迟相位和步进。
所述的门限值为系统所允许的最大的相位偏差。
本发明的有益效果是:该相位信息处理和延迟控制电路根据输入的相位码,比较相位信息与所设定的目标相位间的关系,输出控制信号来调整信号间的相位关系,通过相位检测电路对相位关系进行跟踪,当相位关系不等于目标相位后,通过对延时码进行增减,将当前相位重新调整到目标相位上。
附图说明
图1为相位信息处理和延迟控制电路;
图2为相位信息处理和延迟控制方法流程图。
具体实施方式
下面结合附图进一步详细描述本发明的技术方案,但本发明的保护范围不局限于以下所述。
如图1所示,一种片内信号间的相位信息处理和延迟控制电路,它包括存储器、控制器、自动解码器、手动控制逻辑和输出控制逻辑,所述的存储器、自动调节解码器和输出逻辑控制器分别与控制器连接,所述的手动调节控制逻辑与输出逻辑控制器连接;
所述的存储器用于存储在目标相位附近,满足门限要求的相位和步进值;
所述的控制器在搜索阶段控制搜索目标相位的搜索方向以及搜索步进等,在跟踪阶段,判断是否进行重新搜索,并且产生警示信号和锁定信号;
所述的自动解码器用于将温度码编码成二进制补码;
所述的手动控制逻辑通过手动的控制搜索步进,然后读出对应相位,并且判断相位是否为目标相位;
所述的输出控制逻辑控制目标相位以及锁定步进输出。
如图2所示,一种片内信号间的相位信息处理和延迟控制电路进行相位信息处理和延迟控制的方法,它包括如下步骤:
S1:相位码输入控制器,控制器进入开始状态,所有寄存器设置初值,若系统进入未定义状态,则通过默认赋值,控制器将会自动将状态跳转到初始状态,确保不会进入死循环;
S2:控制器将存储器中的参数值重新载入到控制器中;
S3:控制器确认搜索参数后进入搜索状态,对控制信号进行搜索,搜索状态的每个搜索周期完成一个相位关系与目标相位的比较和延迟码的调整;
S4:控制器控制延迟码和相位码的对应关系存储在存储器中;
S5:控制器根据存储的目标相位附近的相位码与延迟码的对应关系判断出该处的斜率取向;
S6:控制器将S5中计算的斜率取向与目标斜率进行比较,根据比较结果,进行如下子步骤:
A:若比较结果处于设定的门限值内,则将存储器中记录的值读出来,计算出对应于目标相位的延迟码的中间值,并采用该值锁定环相位;
B:若比较结果超出设定的门限值,判定失锁,输出警示信号和锁定信号,跳转到步骤S4进行重新搜索;
S7:输出逻辑控制根据输入控制信号和S6得到的延迟码的中间值,输出延迟相位和步进。
所述的门限值为系统所允许的最大的相位偏差。
如图1所示的一种片内信号间的相位信息处理和延迟控制电路相位检测电路输出的相位码输入自动调节解码器,经解码后输出二进制相位到控制器,控制器根据控制信号将二进制相位和数据信号进行对比,判定是否在系统允许相位差内,若在相位差内,输出延迟相位和延迟步进对信号进行调整,并输出步进控制信号、相位信号以及地址信号到存储器进行存储,若不在系统允许相位差内,输出警示信号和锁定信号,提示失锁。
Claims (3)
1.一种片内信号间的相位信息处理和延迟控制电路,其特征在于:它包括存储器、控制器、自动解码器、手动控制逻辑和输出控制逻辑,所述的存储器、自动调节解码器和输出逻辑控制器分别与控制器连接,所述的手动调节控制逻辑与输出逻辑控制器连接;
所述的存储器用于存储在目标相位附近,满足门限要求的相位和步进值;
所述的控制器在搜索阶段控制搜索目标相位的搜索方向以及搜索步进等,在跟踪阶段,判断是否进行重新搜索,并且产生警示信号和锁定信号;
所述的自动解码器用于将温度码编码成二进制补码;
所述的手动控制逻辑通过手动的控制搜索步进,然后读出对应相位,并且判断相位是否为目标相位;
所述的输出控制逻辑控制目标相位以及锁定步进输出。
2.如权利要求1所述的一种片内信号间的相位信息处理和延迟控制电路进行相位信息处理和延迟控制的方法,其特征在于:它包括如下步骤:
S1:相位码输入控制器,控制器进入开始状态,所有寄存器设置初值,若系统进入未定义状态,则通过默认赋值,控制器将会自动将状态跳转到初始状态,确保不会进入死循环;
S2:控制器将存储器中的参数值重新载入到控制器中;
S3:控制器确认搜索参数后进入搜索状态,对控制信号进行搜索,搜索状态的每个搜索周期完成一个相位关系与目标相位的比较和延迟码的调整;
S4:控制器控制延迟码和相位码的对应关系存储在存储器中;
S5:控制器根据存储的目标相位附近的相位码与延迟码的对应关系判断出该处的斜率取向;
S6:控制器将S5中计算的斜率取向与目标斜率进行比较,根据比较结果,进行如下子步骤:
A:若比较结果处于设定的门限值内,则将存储器中记录的值读出来,计算出对应于目标相位的延迟码的中间值,并采用该值锁定环相位;
B:若比较结果超出设定的门限值,判定失锁,输出警示信号和锁定信号,跳转到步骤S4进行重新搜索;
S7:输出逻辑控制根据输入控制信号和S6得到的延迟码的中间值,输出延迟相位和步进。
3.根据权利要求2所述的一种内信号间的相位信息处理和延迟控制电路进行相位信息处理和延迟控制的方法,其特征在于:所述的门限值为系统所允许的最大的相位偏差。
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Application Number | Priority Date | Filing Date | Title |
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Application Number | Title | Priority Date | Filing Date |
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