CN103839774A - SiGeSn层及其形成方法 - Google Patents

SiGeSn层及其形成方法 Download PDF

Info

Publication number
CN103839774A
CN103839774A CN201410063268.XA CN201410063268A CN103839774A CN 103839774 A CN103839774 A CN 103839774A CN 201410063268 A CN201410063268 A CN 201410063268A CN 103839774 A CN103839774 A CN 103839774A
Authority
CN
China
Prior art keywords
layer
sigesn
formation method
substrate
sigesn layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
CN201410063268.XA
Other languages
English (en)
Inventor
肖磊
王敬
赵梅
梁仁荣
许军
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tsinghua University
Original Assignee
Tsinghua University
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tsinghua University filed Critical Tsinghua University
Priority to CN201410063268.XA priority Critical patent/CN103839774A/zh
Priority to US14/350,715 priority patent/US9299566B2/en
Priority to PCT/CN2014/073847 priority patent/WO2015127702A1/en
Publication of CN103839774A publication Critical patent/CN103839774A/zh
Pending legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • H01L21/02524Group 14 semiconducting materials
    • H01L21/02535Group 14 semiconducting materials including tin
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/0257Doping during depositing
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02612Formation types
    • H01L21/02617Deposition types
    • H01L21/02631Physical deposition at reduced pressure, e.g. MBE, sputtering, evaporation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/16Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System
    • H01L29/161Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System including two or more of the elements provided for in group H01L29/16, e.g. alloys

Abstract

本发明提出一种SiGeSn层及其形成方法。该方法包括以下步骤:提供顶部具有Ge层的衬底;向Ge层表层注入同时含有Si和Sn元素的原子、分子、离子或等离子体,以形成SiGeSn层。本方法能够形成厚度较薄、质量较好的SiGeSn层,具有简单易行、成本低的优点。

Description

SiGeSn层及其形成方法
技术领域
本发明涉及半导体薄膜制造领域,具体涉及一种SiGeSn层及其形成方法。
背景技术
随着微电子技术的发展,器件尺寸的不断缩小,Si材料较低的迁移率已成为制约器件性能的主要因素。为了不断提升器件的性能,必须采用更高迁移率的沟道材料。目前研究的主要技术方案为:采用Ge材料做PMOSFET器件的沟道材料,III-V化合物半导体材料为NMOSFET器件的沟道材料。Ge具有四倍于Si的空穴迁移率,随着研究的不断深入,Ge沟道MOSFET中的技术难点逐一被攻克。与Ge相兼容的Ge1-xSnx合金(GeSn)是一种IV族半导体材料,具有良好的电学特性。首先,应变GeSn材料具有比Ge更高的空穴迁移率,具有应用于PMOSFET器件沟道的前景;其次,当以Ge材料为沟道时,在源漏中填充GeSn合金,可以在Ge沟道中引入单轴压应变,大幅度提升Ge沟道的性能,当沟道长度在纳米尺度时,其性能提升尤为明显;第三,理论计算结果表明,当x>0.11时,应变Ge1-xSnx合金将成为一种直接带隙的半导体,这使得GeSn合金逐渐成为Si基集成光电子学中的一个新的研究热点。并且,GeSn合金与硅的互补金属氧化物半导体(CMOS)工艺具有良好的兼容性。
然而,直接生长高质量高Sn含量的GeSn合金非常困难。首先,Sn在Ge中的平衡固溶度小于1%(约为0.3%);其次,Sn的表面能比Ge小,非常容易发生表面分凝;再次,Ge和α-Sn具有很大的晶格失配(14.7%)。为了抑制Sn的表面分凝,提高Sn的含量,可在材料生长时掺入一定量的Si,形成SiGeSn层。Si的晶格常数比Ge小,而Sn的晶格常数比Ge大,通过在GeSn合金中掺入Si,可以提高GeSn合金的稳定性。
在生长SiGeSn材料时,通常采用的方法为分子束外延(MBE)。其中,现有的MBE工艺生长SiGeSn材料的过程为:先在衬底上外延生长一层SiGe缓冲层,再外延SiGeSn薄膜。该方法可得到晶体质量较好的SiGeSn薄膜,但设备昂贵,生长过程较为费时,成本高,在大规模生产中将受到一定限制。
也有人采用化学气相淀积(CVD)工艺生长SiGeSn薄膜,但工艺不稳定,制得的SiGeSn薄膜质量较差,热稳定性不佳,Sn易分凝,成本也较高。
发明内容
本发明的目的在于至少解决上述技术缺陷之一,特别是提供一种简单易行且成本低的SiGeSn层及其形成方法。
为实现上述目的,本发明第一方面实施例的SiGeSn层的形成方法可以包括以下步骤:提供顶部具有Ge层的衬底;向所述Ge层表层注入同时含有Si和Sn元素的原子、分子、离子或等离子体,以形成SiGeSn层。
根据本发明实施例的SiGeSn层的形成方法可以得到厚度较薄、质量较好的SiGeSn层,具有简单易行、成本低的优点。
在本发明的一个实施例中,所述注入的方法包括离子注入。
在本发明的一个实施例中,所述离子注入包括等离子体源离子注入和等离子体浸没离子注入。
在本发明的一个实施例中,所述注入的方法包括磁控溅射。
在本发明的一个实施例中,在利用所述磁控溅射注入的过程中,在所述衬底上加载负偏压。
在本发明的一个实施例中,还包括,去除所述磁控溅射在所述SiGeSn层之上形成的Si-Sn薄膜。
在本发明的一个实施例中,利用对SiGeSn和Si-Sn具有高腐蚀选择比的溶液清洗以去除所述Si-Sn薄膜。
在本发明的一个实施例中,所述注入的过程中对所述衬底加热,加热温度为100-600℃。
在本发明的一个实施例中,还包括,在所述注入之后,对所述SiGeSn层退火,退火温度为100-600℃。
在本发明的一个实施例中,所述SiGeSn层为应变SiGeSn层。
在本发明的一个实施例中,所述应变SiGeSn层的厚度为0.5-100nm。
在本发明的一个实施例中,所述应变SiGeSn层中Sn的原子百分含量小于20%。
在本发明的一个实施例中,所述顶部具有Ge层的衬底包括:纯Ge衬底、绝缘体上Ge衬底、具有Ge表面的Si衬底。
为实现上述目的,本发明第二方面实施例的SiGeSn层,采用上文公开的方法形成。
本发明实施例的SiGeSn层具有厚度较薄、质量较好、成本较低的优点。
本发明的附加方面和优点将在下面的描述中部分给出,部分将从下面的描述中变得明显,或通过本发明的实践了解到。
附图说明
本发明的上述和/或附加的方面和优点从结合下面附图对实施例的描述中将变得明显和容易理解,其中:
图1是本发明实施例的SiGeSn层的形成方法的流程图;
图2是本发明实施例的SiGeSn/Ge结构(004)面XRD扫描曲线图;
图3是本发明实施例的SiGeSn/Ge结构(224)面XRD扫描曲线图;
图4是本发明实施例的SiGeSn/Ge结构的横截面TEM图;和
图5是本发明实施例的SiGeSn/Ge结构的横截面TEM进行能谱线扫描测试图。
具体实施方式
下面详细描述本发明的实施例,所述实施例的示例在附图中示出,其中自始至终相同或类似的标号表示相同或类似的元件或具有相同或类似功能的元件。下面通过参考附图描述的实施例是示例性的,旨在用于解释本发明,而不能理解为对本发明的限制。
在本发明中,除非另有明确的规定和限定,第一特征在第二特征之“上”或之“下”可以包括第一和第二特征直接接触,也可以包括第一和第二特征不是直接接触而是通过它们之间的另外的特征接触。而且,第一特征在第二特征“之上”、“上方”和“上面”包括第一特征在第二特征正上方和斜上方,或仅仅表示第一特征水平高度高于第二特征。第一特征在第二特征“之下”、“下方”和“下面”包括第一特征在第二特征正下方和斜下方,或仅仅表示第一特征水平高度小于第二特征。
本发明第一方面提出一种SiGeSn层的形成方法。
如图1所示,根据本发明实施例的SiGeSn层的形成方法,可以包括如下步骤:
S1.提供顶部具有Ge层的衬底。
具体地,提供的顶部具有Ge层的衬底可以是纯Ge衬底、绝缘体上Ge衬底(Ge-On-Insulator,GeOI)、具有Ge表面的Si衬底等等。
S2.向Ge层表层注入同时含有Si和Sn元素的原子、分子、离子或等离子体,以形成SiGeSn层。
具体地,当需要形成较厚的SiGeSn层时,可以注入同时含有Si和Sn元素的离子或等离子体。离子和等离子体能量高,可以注入达到一定深度。当需要形成较薄的SiGeSn层时,不仅注入离子或等离子体可以形成SiGeSn层,注入Sn原子或含有Sn元素的分子也可以形成SiGeSn层。需要说明的是,原有的Ge层可以仅有表层部分变化为SiGeSn层,也可以全部变化为SiGeSn层。
根据本发明上述实施例的SiGeSn层的形成方法通过利用注入工艺对原有的Ge层进行表面改性,即将含有Sn元素的原子、分子、离子或等离子体注入到原有的Ge层中,通过控制合适的温度和注入剂量,使注入的Sn元素不明显扩散,就可以使得晶格中的Sn原子不会聚集形成Sn的沉淀物,保持SiGeSn合金的亚稳态而不发生分凝,这样可以得到厚度较薄、质量较好的SiGeSn层,具有简单易行、成本低的优点。而已有的SiGeSn形成方法中,MBE方法需要昂贵的设备且需要超高真空,工艺复杂且成本高;CVD方法还不完全成熟,因为生长温度高,所以处于亚稳态的SiGeSn经常发生Sn元素的分凝,从而影响SiGeSn层的晶体质量,且其设备和气源较为昂贵,因而成本也较高。
在本发明的一个示例中,注入的方法可以采用离子注入,即将具有一定能量的、同时含有Si和Sn元素的离子束(包括离子或等离子体)入射到Ge层中去,并停留在Ge层中,使Ge层部分或全部转换为SiGeSn合金。通过改变离子束的能量来改变注入的深度,离子束能量越高,则注入越深。在注入过程中,可以采用变化的电压来获得变化的离子束能量,从而使Si/Sn元素在一定范围内较为均匀地分布。具体地,除常规的离子注入外,离子注入还包括等离子体源离子注入和等离子体浸没离子注入,即等离子体基离子注入。在等离子体基离子注入时,Ge层湮没在含有Sn元素的等离子体中,含Si/Sn元素的正离子在电场作用下被加速,射向Ge层表面并注入到Ge层中。通过等离子体基离子注入,可以很容易达到很高的注入剂量,即很容易获得1%~20%的Sn含量的SiGeSn层,生产效率很高,成本也很低,且受表面形状的影响小,即非平面的Ge表面也可以实现均匀地注入。离子注入可以形成较厚的SiGeSn层,注入能量越高,SiGeSn层越厚。优选地,SiGeSn层的厚度为0.5-100nm。
在本发明的一个示例中,注入的方法可以采用磁控溅射。磁控溅射时,Ar离子在电场作用下加速飞向阴极Si-Sn复合靶,并以高能量轰击靶表面,使靶材发生溅射。溅射粒子主要是原子,还有少量离子。通过调整电场电压,真空度等工艺参数,使溅射粒子具有较高的能量,并以较高的速度射向Ge层,部分粒子可以注入到Ge层中并形成亚稳态的SiGeSn合金。可选地,在利用磁控溅射向Ge层注入的过程中,在衬底上加载负偏压,比如-40~-120V,这样可以使溅射出的部分粒子具有更高能量,有利于粒子注入到Ge表层的更深处,例如可以深至若干纳米。需要说明的是,由于磁控溅射时溅射出的材料较多,通常会在形成SiGeSn层之后进一步形成非晶态Si-Sn薄膜(Si和Sn的混合物)。因此在磁控溅射之后,还需要去除磁控溅射在SiGeSn层之上形成的Si-Sn薄膜。例如,可以利用对SiGeSn和Si-Sn具有高腐蚀选择比的溶液清洗以去除Si-Sn薄膜以及露出SiGeSn层。常见的清洗溶液包括稀盐酸、稀硫酸、稀硝酸。清洗后保留下来的SiGeSn层的厚度为0.5-20nm,优选地,该SiGeSn层厚度为0.5-10nm。
在本发明的一个示例中,在注入工艺中加热温度可控制在100-600℃之间,优选150-450℃。在该温度范围下得到的薄膜质量更好。温度过低,注入带来的损伤不能修复,SiGeSn层的质量较差;温度过高,将使得SiGeSn层中的Sn扩散严重,而Sn在Ge中的固溶度很低(平衡态下为原子百分比0.3%),SiGeSn层中的Sn容易析出形成Sn沉淀物。
在本发明的一个示例中,在形成SiGeSn层之后还可以通过退火处理来强化该SiGeSn层。退火的温度范围为100-600℃,优选150-450℃。温度过低,注入带来的损伤不能修复,SiGeSn层的质量较差;温度过高,将使得SiGeSn层中的Sn扩散严重,而Sn在Ge中的固溶度很低,SiGeSn中的Sn容易析出形成Sn沉淀物。
在本发明的一个示例中,SiGeSn层为应变SiGeSn层。应变SiGeSn层的厚度为0.5-100nm。应变SiGeSn层中Sn的原子百分含量小于20%。需要说明的是,完全应变的SiGeSn层中Sn含量越高,其应变度越大,相应地其厚度应降低到弛豫的临界厚度以下,才能保持完全应变。应变SiGeSn层中Sn含量越高,则其临界厚度越薄。当Si含量为20%、Sn含量为20%时,Ge上完全应变的SiGeSn薄膜的应变度约为2.3%,此时应变SiGeSn层的临界厚度约7nm;而当Si含量为20%、Sn含量为10%时,其应变度约0.8%,其临界厚度可以达到100nm甚至130nm以上。
需要进一步说明的是,当SiGeSn层为应变SiGeSn层时,注入工艺中加热温度和退火工艺中退火温度的高低需要与应变SiGeSn层的材料性质匹配。例如常见半导体器件中需要10-15%Sn含量的应变SiGeSn层,通过加入Si,10-15%的SiGeSn层在450℃下基本是稳定的,所以该Sn含量下上述注入工艺中衬底温度和退火工艺中退火温度需要不超过450℃。
本发明第二方面提出一种SiGeSn层。该SiGeSn层是通过上述公开的任一种方法形成的。本发明实施例的SiGeSn层具有厚度较薄、质量较好、成本较低的优点。
为使本领域技术人员更好地理解本发明,发明人结合图2-图5阐述具体实施例如下:
首先,准备n型Ge衬底,并依次采用丙酮、无水乙醇、去离子水及氢氟酸清洗备用。
其次,按照一定面积比将Si片贴覆于Sn靶表面制作Si-Sn复合靶备用,或制备Si-Sn合金靶备用。
然后,采用磁控溅射仪,抽真空至真空度<10-4Pa,通入高纯氩气。此时衬底加热温度为100-200℃,打开射频电源,对Si-Sn靶材进行溅射。溅射过程中,首先在Ge衬底表层先形成SiGeSn层,继而在SiGeSn层之上形成Si-Sn层。对沉积好的薄膜进行退火处理,退火温度为100-200℃,以进一步强化SiGeSn层。
最后,采用10%的稀盐酸清洗去除SiGeSn层之上的Si-Sn层,以露出SiGeSn层。
用高分辨X射线衍射仪(HRXRD)表征了材料的结构、结晶状态、应变状态及Sn含量。对SiGeSn材料的(004)进行了Theta-2Theta扫描,结果如图2所示,其中0位为Ge衬底的(004)面衍射峰,SiGeSn(004)的衍射峰位出现在-2750arcsec左右。对SiGeSn(224)面进行了Theta-XTheta扫描,结构如图3所示,其中0位为Ge衬底(224)面衍射峰,SiGeSn(224)的衍射峰位出现在-650arcsec左右。由此可判断,该实验制备的SiGeSn层完全应变。
用高分辨透射电镜(TEM)表征了材料的横截面形貌及界面状态,结果如图4所示。由图可知,SiGeSn层界面较为平整,薄膜质量较好。由横截面TEM进行能谱(EDS)线扫描(如图5所示)表征了SiGeSn材料的元素分布,由图可知,SiGeSn层厚约10nm左右。
在本说明书的描述中,参考术语“一个实施例”、“一些实施例”、“示例”、“具体示例”、或“一些示例”等的描述意指结合该实施例或示例描述的具体特征、结构、材料或者特点包含于本发明的至少一个实施例或示例中。在本说明书中,对上述术语的示意性表述不一定指的是相同的实施例或示例。而且,描述的具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
尽管上面已经示出和描述了本发明的实施例,可以理解的是,上述实施例是示例性的,不能理解为对本发明的限制,本领域的普通技术人员在不脱离本发明的原理和宗旨的情况下在本发明的范围内可以对上述实施例进行变化、修改、替换和变型。

Claims (14)

1.一种SiGeSn层的形成方法,其特征在于,包括以下步骤:
提供顶部具有Ge层的衬底;
向所述Ge层表层注入同时含有Si和Sn元素的原子、分子、离子或等离子体,以形成SiGeSn层。
2.如权利要求1所述的SiGeSn层的形成方法,其特征在于,所述注入的方法包括离子注入。
3.如权利要求2所述的SiGeSn层的形成方法,其特征在于,所述离子注入包括等离子体源离子注入和等离子体浸没离子注入。
4.如权利要求1所述的SiGeSn层的形成方法,其特征在于,所述注入的方法包括磁控溅射。
5.如权利要求4所述的SiGeSn层的形成方法,其特征在于,在利用所述磁控溅射注入的过程中,在所述衬底上加载负偏压。
6.如权利要求4或5所述的SiGeSn层的形成方法,其特征在于,还包括,去除所述磁控溅射在所述SiGeSn层之上形成的Si-Sn薄膜。
7.如权利要求6所述的SiGeSn层的形成方法,其特征在于,利用对SiGeSn和Si-Sn具有高腐蚀选择比的溶液清洗以去除所述Si-Sn薄膜。
8.如权利要求1所述的SiGeSn层的形成方法,其特征在于,所述注入的过程中对所述衬底加热,加热温度为100-600℃。
9.如权利要求1所述的SiGeSn层的形成方法,其特征在于,还包括,在所述注入之后,对所述SiGeSn层退火,退火温度为100-600℃。
10.如权利要求1所述的SiGeSn层的形成方法,其特征在于,所述SiGeSn层为应变SiGeSn层。
11.如权利要求10所述的SiGeSn层的形成方法,其特征在于,所述应变SiGeSn层的厚度为0.5-100nm。
12.如权利要求10所述的SiGeSn层的形成方法,其特征在于,所述应变SiGeSn层中Sn的原子百分含量小于20%。
13.如权利要求1-12任一项所述的SiGeSn层的形成方法,其特征在于,所述顶部具有Ge层的衬底包括:纯Ge衬底、绝缘体上Ge衬底、具有Ge表面的Si衬底。
14.一种SiGeSn层,其特征在于,通过如权利要求1-13任一项所述的方法形成。
CN201410063268.XA 2014-02-25 2014-02-25 SiGeSn层及其形成方法 Pending CN103839774A (zh)

Priority Applications (3)

Application Number Priority Date Filing Date Title
CN201410063268.XA CN103839774A (zh) 2014-02-25 2014-02-25 SiGeSn层及其形成方法
US14/350,715 US9299566B2 (en) 2014-02-25 2014-03-21 Method for forming germanium-based layer
PCT/CN2014/073847 WO2015127702A1 (en) 2014-02-25 2014-03-21 Method for forming germanium-based layer

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201410063268.XA CN103839774A (zh) 2014-02-25 2014-02-25 SiGeSn层及其形成方法

Publications (1)

Publication Number Publication Date
CN103839774A true CN103839774A (zh) 2014-06-04

Family

ID=50803165

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201410063268.XA Pending CN103839774A (zh) 2014-02-25 2014-02-25 SiGeSn层及其形成方法

Country Status (1)

Country Link
CN (1) CN103839774A (zh)

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1123470A (zh) * 1994-09-13 1996-05-29 株式会社东芝 具有窄带隙-源区结构的绝缘栅器件及其制造方法
WO2013030529A1 (en) * 2011-08-29 2013-03-07 Iqe Plc. Photovoltaic device
CN103594419A (zh) * 2012-08-16 2014-02-19 中国科学院微电子研究所 半导体器件制造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1123470A (zh) * 1994-09-13 1996-05-29 株式会社东芝 具有窄带隙-源区结构的绝缘栅器件及其制造方法
WO2013030529A1 (en) * 2011-08-29 2013-03-07 Iqe Plc. Photovoltaic device
CN103594419A (zh) * 2012-08-16 2014-02-19 中国科学院微电子研究所 半导体器件制造方法

Similar Documents

Publication Publication Date Title
KR20130122649A (ko) 반도체 적층체, 반도체 디바이스, 및 그들의 제조 방법
CN102386246B (zh) 一种p型导电氧化锌薄膜材料及制备方法
CN102024768A (zh) 半导体装置及半导体结构的制造方法
WO2008054957A1 (en) System and method for providing a nanoscale, highly selective, and thermally resilient silicon, germanium, or silicon-germanium etch-stop
KR101521555B1 (ko) 게르마늄 응축 공정을 이용한 기판 제조 방법 및 이를 이용한 반도체 소자의 제조 방법
Hartmann et al. Low temperature boron and phosphorous doped SiGe for recessed and raised sources and drains
US20150243505A1 (en) Method for forming fin field effect transistor
CN103840005A (zh) 具有SiGeSn源漏的鳍式场效应晶体管及其形成方法
CN103811304A (zh) GeSn层及其形成方法
US9105475B1 (en) Method for forming fin field effect transistor
CN103839829A (zh) 具有SiGeSn沟道的鳍式场效应晶体管及其形成方法
CN103839775A (zh) 选区GeSn层及其形成方法
Dobbie et al. Growth of smooth, low-defect germanium layers on (111) silicon via an intermediate islanding process
CN103839788A (zh) SiGeSn层及其形成方法
CN103839789A (zh) 选区SiGeSn层及其形成方法
CN103839774A (zh) SiGeSn层及其形成方法
Cho et al. High performance thin film transistor with HfSiO x dielectric fabricated at room temperature RF-magnetron sputtering
CN103972105A (zh) 具有SiGe沟道的MOSFET及其形成方法
CN103839786A (zh) 选区SiGeSn层及其形成方法
CN103839980A (zh) 具有SiGeSn源漏的MOSFET及其形成方法
TWI728151B (zh) 半導體層疊膜的製造方法及半導體層疊膜
CN107634097B (zh) 一种石墨烯场效应晶体管及其制造方法
CN103839830A (zh) 具有SiGeSn沟道的MOSFET及其形成方法
CN103839827A (zh) 具有SiGeSn源漏的MOSFET及其形成方法
CN103972065A (zh) SiGe层的形成方法

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
RJ01 Rejection of invention patent application after publication
RJ01 Rejection of invention patent application after publication

Application publication date: 20140604