CN102300120A - 一种对多路信号进行选择输出的切换器及方法 - Google Patents
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Abstract
本发明提供一种对多路信号进行选择输出的切换器及方法,该包括:切换器接收多路异步串行接口(ASI)码流,当所述切换器工作在现场可编程门阵列(FPGA)选通路模式时,对接收的各路码流进行信号分析,之后按照预设规则将其中一路ASI码流作为输出码流输出至调制器。采用本发明的技术方案,可对接收的多路ASI码流进行信号分析,并选择信号较好的ASI码流输出,提高了移动多媒体广播系统稳定性及用户体验;并且提供了用户可配的切换策略接口,用户可以根据该设备的实际使用环境与要求组合出一种能最大效率满足客户要求的切换策略。
Description
技术领域
本发明涉及移动多媒体广播领域,具体涉及一种对多路信号进行选择输出的切换器及方法。
背景技术
现有的移动多媒体广播前端系统如图1所示,节目内容通过网口将多套节目的音视频数据发送给复用器,由复用器统一将节目数据打包为PMS码流后送给下一级调制器。复用器的主要功能是完成音频、视频、数据、电子业务指南、紧急广播等信息封装,使其能够在移动多媒体广播信道上传送。调制器主要完成将符合多媒体广播系统的PMS码流发射出去。
该链路存在较大的稳定性隐患,一旦前端复用器出现异常(例如异常掉电,PMS码流数据打包异常等),将严重的影响整个多媒体广播系统的稳定性,从而影响用户对多媒体广播系统的使用。为了保证用户的使用和多媒体系统的商用,提高多媒体系统的稳定性显得越来越重要。
发明内容
本发明提供一种对多路信号进行选择输出的切换器及方法,可实现对多路信号进行选择输出,将质量好的ASI码流输出至调制器。
一种对多路信号进行选择输出的方法,包括:
切换器接收多路异步串行接口(ASI)码流,当所述切换器工作在现场可编程门阵列(FPGA)选通路模式时,对接收的各路码流进行信号分析,之后按照预设规则将其中一路ASI码流作为输出码流输出至调制器。
进一步地,所述对码流进行信号分析包括:
(1)对码流进行编码违例检测、(2)无数据检测和(3)包头“47”连续失同步检测;
所述按照预设规则将其中一路ASI码流作为输出码流是指,所述切换器工作在FPGA选通路模式时,将接收的n路ASI码流中的一路作为输出码流;对信号进行分析后,若检测周期内当前输出码流的上述检测项中的任一项出现告警则进行输出码流的切换,切换至上述检测项均未出现告警的码流;
所述n≥2。
进一步地,所述切换器在上电过程中及FPGA选通路模式发生故障时工作在直通模式,此时将多路ASI码流中的任一路作为默认的输出码流。
进一步地,所述切换器对码流的分析还包括检测以下信息中的一项或多项:
(4)预设时间段内PMS包头“47”非连续丢失次数;
(5)预设时间段内PMS包不连续的次数;
(6)预设时间段内包序号不连续的次数;
(7)净荷类型非法检测;
(8)TOD包的时间值不连续检测;
(9)TOD包超时检测;
(10)1秒内TOD包错误检测;
若检测周期内所述检测项(1)至(3)均未出现告警的码流有多个,则选择检测项(4)至(10)中没有任何告警项的码流作为切换的目标码流。
进一步地,若不存在没有任何告警项的码流,则按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,选择告警项最少的码流作为切换的目标码流;
(b)对所述(4)至(10)中的检测项设置优先级,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
进一步地,所述切换模式包括直接切换及PMS包头“47”不失步模式;
所述PMS包头“47”不失步模式是指,当切换前正在输出的PMS包完全输出后将码流切换至目标码流;
所述直接切换模式是指,当判定需要进行切换时无论当前输出的PMS包是否输出完成立即切换至目标码流输出。
进一步地,所述切换器设置两种输出,一种为切换器自身对多路码流解析结果进行仲裁,并选择其中一路码流输出,另一种为用户自行选定所需要的一路码流输出。
本发明还提供一种对多路信号进行选择输出的切换器,包括n个码流接收模块、现场可编程门阵列FPGA、控制模块、码流输出模块;
每个码流接收模块均具有一输入端以及两个输出端,起输入端与复用器相连,接收复用器发来的ASI码流,其输出端中的一个与所述FPGA相连;
所述FPGA具有n个输入端,用于接收ASI码流,FPGA用于对接收的n路ASI码流进行信号分析,并将分析结果发送至控制模块;
所述控制模块,用于收到分析结果后根据预设规则将其中一路ASI码流作为输出码流;
所述码流输出模块,用于将选择的输出码流输出至调制器;
所述n≥2。
进一步地,所述FPGA对码流的分析包括:(1)对码流进行编码违例检测;(2)无数据检测;(3)包头“47”连续失同步检测;
所述FPGA向控制模块发送的分析结果包括检测周期内ASI码流出现告警项的信息;
所述控制模块根据预设规则将其中一路ASI码流作为输出码流是指:所述切换器刚工作在FPGA选通路模式时,将接收的n路ASI码流中的一路作为输出码流;当控制模块收到分析结果后,若当前输出码流的上述检测项中的任一项出现告警则判定进行输出码流的切换,通知FPGA将输出码流切换至上述检测项均未出现告警的码流。
进一步地,所述切换器还包括码流选择模块;
所述每个码流接收模块的另一输出端与所述码流选择模块相连,用于切换器工作在直通模式时将接收的ASI码流发送至码流选择模块;
所述码流选择模块,用于切换器工作在直通模式时将接收的ASI码流中的一路作为默认的输出码流发送至码流输出模块。
进一步地,所述FPGA对码流的分析还包括检测以下信息中的一项或多项:
(4)预设时间段内PMS包头“47”非连续丢失次数;
(5)预设时间段内PMS包不连续的次数;
(6)预设时间段内包序号不连续的次数;
(7)净荷类型非法检测;
(8)TOD包的时间值不连续检测;
(9)TOD包超时检测;
(10)1秒内TOD包错误检测;
所述分析结果还包括所述检测项(4)至(10)中出现告警项的信息;
所述控制模块选择目标码流时,若检测项(1)至(3)中未出现告警的码流有多个,则选择检测项(4)至(10)中没有任何告警项的码流作为切换的目标码流。
进一步地,若不存在没有任何告警项的码流,则控制模块按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,选择告警项最少的码流作为切换的目标码流;
(b)对所述(4)至(10)中的检测项设置优先级,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
进一步地,所述FPGA进行输出码流的切换时包括直接切换模式及PMS包头“47”不失步模式;
所述PMS包头“47”不失步模式是指,当切换前正在输出的PMS包完全输出后将码流切换至目标码流;
所述直接切换模式是指,当判定需要进行切换时无论当前输出的PMS包是否输出完成立即切换至目标码流输出。
综上所述,本发明提供一种对多路信号进行选择输出的切换器及方法,可对接收的多路ASI码流进行信号分析,并选择信号较好的ASI码流输出,提高了移动多媒体广播系统稳定性及用户体验;并且提供了用户可配的切换策略接口,用户可以根据该设备的实际使用环境与要求组合出一种能最大效率满足客户要求的切换策略。
附图说明
图1是现有的移动多媒体广播前端系统结构示意图;
图2是本发明实施例切换器在移动多媒体广播系统中的位置示意图;
图3是本发明切换器内部结构示意图;
图4是本发明方法实施例的流程图;
图5是本发明实施例中PMS包结构示意图;
图6是本发明实施例中包头“47”不失步模式示意图;
图7是本发明实施例中直接切换模式示意图。
具体实施方式
本发明提供一种对多路信号进行选择输出的切换器及方法,在移动多媒体广播前端系统中,本切换器设备的位置如图2所示,可对接收的多路ASI码流进行质量分析并将信号质量较好的输出至调制器。
为了兼容现有的网络传输设备,复用器,切换器,调制器之间的码流交互采用ASI(Asynchronous Serial Interface)接口,ASI接口采用非直流平衡编码方式(8b/10b),ASI的净荷为PMS(Packaged MultiplexingStream),PMS的净荷为复用帧。
本实施例提供一种对多路信号进行选择输出的切换器,如图3所示,包括n个码流接收模块,分别记为码流接收模块1、码流接收模块2...码流接收模块n,n≥2;还包括码流选择模块、码流输出模块、n个解码芯片、EPLD、存储模块及控制模块;其中,
EPLD与每个码流接收模块相连,用于控制各码流接收模块是向码流选择模块输出码流还是向解码芯片输出码流,具体地,当切换器开始上电及由FPGA(现场可编程门阵列)选通路模式切换至直通模式时,EPLD向各码流接收模块发送控制信号通知其将接收的ASI码流输出至码流选择模块,以及读取存储模块中记录的码流,当切换器由直通模块切换至FPGA选通路模式时,EPLD向各码流接收模块发送控制信号通知其将接收的ASI码流输出至对应的解码芯片;
EPLD还与码流选择模块相连,用于切换器工作在直通模式时读取存储模块中记录的码流信息,并向码流选择模块发送控制信令通知其将记录的码流作为直通模式时的输出码流发送至码流输出模块;
EPLD还与码流输出模块相连,用于控制码流输出模块的工作模式,具体地,当切换器开始上电及由FPGA选通路模式切换至直通模式时,通知码流输出模块将接收端切换至码流选择模块,当切换器由直通模块切换至FPGA选通路模式时,通知码流输出模块将接收端切换至FPGA。
每个码流接收模块均具有一输入端以及两个输出端,输入端与n个复用器中的一个相连,接收复用器的ASI码流,输出端中的一个与码流选择模块相连,用于直通模式下输出ASI码流,另一输出端与一个解码芯片相连,用于FPGA选通路模式下输出ASI码流。
解码芯片i的输入端接收码流接收模块i输出的ASIi,对ASIi进行8b/10b解码,将10bit串行数据转化为8bit并行PMS码流数据,并将解码后的控制信号及PMS码流输出至FPGA;
FPGA具有n个输入端,每个输入端接收一路解码后的控制信号及PMS码流数据,根据控制信号及PMS码流数据进行信号分析,并将分析结果发送至控制模块;
对信号的分析包括,(1)编码违例检测;(2)无数据检测以及(3)包头“47”连续失同步检测;具体地,可为各检测项设置告警门限,当达到告警门限时产生告警,并周期性地向控制模块发送分析报告,其中携带检测周期内发生告警的告警项。
对上述(1)至(3)项的检测顺序不作限制。
对信号的分析还可以包括对以下一项或多项进行检测:
(4)PMS包头“47”非连续丢失检测;
(5)PMS包连续计数值的不连续检测;
(6)PMS包序号不连续检测;
(7)净荷类型非法检测;
(8)TOD包的时间值不连续检测;
(9)TOD包超时检测;
(10)TOD包错误检测;
上述(4)至(10)项中各项的具体检测方式及告警方式同以下方法中所述;上报分析结果中还包括上述(4)至(10)项发生告警的告警项。
FPGA,还用于收到控制模块发来的切换指令后进行输出码流的切换,切换时,可按照以下方式中的任一种进行切换:一种是PMS包头“47”不失步模式,一种是直接切换模式。具体方式同以下方法中所述。
控制模块,用于接收FPGA的分析结果,并根据该结果判断是否满足切换条件,是则选择进行切换的目标码流,并通知FPGA进行输出码流的切换;
满足切换条件是指,检测周期内当前输出码流的上述检测项(1)至(3)中的任一个出现告警则满足切换条件;
选择目标码流时,从其他码流中选择上述检测项(1)至(3)均未产生告警的码流作为目标码流进行切换;
进一步地,若上述检测检测项(1)至(3)均未产生告警的码流有多个,则选择没有任何告警项的码流作为目标码流,若不存在没有任何告警项的码流,则可按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,即告警项越少的信号越好,因此可选择告警项最少的码流作为切换的目标码流;
(b)对(4)至(10)中的检测项设置优先级,优先级越高的项出现告警说明信号越差,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
码流选择模块具有n个输入端及一个输出端,n个输入端分别与n个码流接收模块相连,码流选择模块用于根据EPLD的指示选择将n个码流接收模块中的1个ASI码流通过其输出端发送至码流输出模块。
码流输出模块具有2个输入端,其中1个与码流选择模块相连,另1个与FPGA相连,用于根据EPLD的指示于直通模式时将码流选择模块发来的ASI码流通过其输出端发送至调制器,并于FPGA选通路模式时将FPGA发来的ASI码流通过其输出端发送至调制器。
以上实施例中所述的码流接收模块、码流选择模块及码流输出模块可以但不限于是OR(继电器)。
本实施例提供一种对多路信号进行选择输出的方法,如图4所示,包括以下步骤:
步骤S1:切换器开始上电,收到多个复用器发来的ASI码流,上电过程中选用直通模式输出接收的多路码流,可将其中一路作为默认的输出;
步骤S2:切换器上电完成,切换器切换至FPGA选通路模式,并将上电过程中输出的那路ASI码流作为信号分析完成前切换器的输出码流;
步骤S3:切换器周期性地开始对接收的多路信号进行分析,对多路信号进行分析的过程包括:
对接收的每路ASI码流,先通过解码芯片进行8b/10b解码,将10bit串行数据转化为8bit并行PMS码流数据及控制信号;
对解码后的控制信号进行(1)编码违例检测;(2)无数据检测;对控制信号与数据一起进行(3)包头“47”连续失同步检测;
对上述(1)至(3)的检测方式可参照现有技术;对上述(1)至(3)项的检测顺序不作限制。
步骤S4:切换器判断检测周期内当前输出码流是否满足切换条件,若是则执行步骤S5,否则执行步骤S6;
满足切换条件是指,当前输出码流的上述检测项(1)至(3)中的任一个出现告警则满足切换条件;
具体地,可对各项参数设置门限值,若当前输出的码流的一项参数达到门限值时便进行切换,例如,设置编码违例的门限值为1/1000,若当前输出的码流编码违例检测达到1/1000时产生告警,又如,设置无数据的门限值为20ms,若当前输出的码流连续20ms没有数据则产生告警,再如,设置包头“47”连续失同步的门限值为255,若当前输出的码流连续255个PMS的包头“47”失步则产生告警。
进一步地,切换器还可以对解码后的PMS包进行以下一种或多种的信号分析:
(4)由于可能存在PMS包头“47”偶尔丢失的情况,此时尚未达到包头“47”连续丢失状态,可统计预设时间段内PMS包头“47”非连续丢失次数,可设置一丢失门限,当预设时间段内非连续丢失次数达到该丢失门限时向控制模块上报非连续丢失告警。预设时间可以但不限于是1S。
如图5所示为PMS包结构示意图,前16个字节为包头,该包头的第1个字节为包头“47”。
(5)因PMS包的第4个字节是连续计数值,通过检测相邻PMS包的连续计数值是否连续来统计预设时间段内PMS包不连续的次数,并将不连续的次数上报控制模块。
(6)PMS包序号不连续检测:PMS包的第11,12个字节是包序号值,通过检测相邻PMS包的包序号值是否连续来统计预设时间段内包序号不连续的次数,并将不连续的次数上报控制模块。
(7)净荷类型非法检测:PMS包的第14、15个字节是净荷类型值,根据复用规范,定义了4种净荷类型,分别为TOD包的净荷类型值为0x1111,复用帧描述包的净荷类型值为0x3333,复用帧数据包的净荷类型值为0x5555,空包净荷类型值为0x0000。当检测到净荷类型不属于这4个值时,向控制模块上报净荷类型非法的告警。
(8)TOD包的时间值不连续检测:对TOD包的值进行检测,对比相邻TOD的值是否连续,若不连续则向控制模块上报TOD值不连续的告警。
(9)TOD包超时检测:对TOD包的到来时间进行检测,如果两个TOD包之间的间隔时间超过预设值(如2S),则向控制模块上报TOD包超时的告警。
(10)对1秒内的TOD包进行统计,因1秒内只能出现1个TOD包,当1秒内没有收到1个TOD包或者收到多个TOD包时,向控制模块上报TOD包错误的告警。
步骤S5:进行输出码流的切换,从其他码流中选择上述检测项(1)至(3)均未产生告警的码流作为目标码流进行切换;
进一步地,若上述检测检测项(1)至(3)均未产生告警的码流有多个,则选择没有任何告警项的码流作为目标码流,若不存在没有任何告警项的码流,则可按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,即告警项越少的信号越好,因此可选择告警项最少的码流作为切换的目标码流;
(b)对(4)至(10)中的检测项设置优先级,优先级越高的项出现告警说明信号越差,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
切换时,可设置两种切换模式,一种是PMS包头“47”不失步模式,一种是直接切换模式。如图6所示,PMS包头“47”不失步模式是当切换前正在输出的PMS包完全输出后将码流切换至目标码流,如切换器输出ASI1的PMS包2,PMS2包还未完全输出时需要切换至码流ASI2输出,则当PMS包2完全输出后切换至ASI2输出PMS包7。为了保证切换器进行切换时,每一个PMS包(188字节)的完整性,避免因切换带来的调制器对PMS码流重新进行PMS包头“47”同步。如图7所示,直接切换模式是指当判定需要进行切换时无论当前输出的PMS包是否输出完成立即切换至目标码流输出,如FPGA将由正在发送ASI1路的PMS包2,直接切换至ASI2路,改为发送PMS包6的后半部分数据。
步骤S6:不进行码流切换,并返回步骤S3继续对接收的各路ASI码流进行检测。
在FPGA选通路模式工作过程中,若FPGA出现故障,则执行步骤S7;
步骤S7:切换器切换至直通模式,并将故障发生前的输出码流作为当前输出码流;
步骤S8:FPGA故障恢复,切换器切回FPGA选通路模式,并将直通模式下的输出码流作为当前输出码流,并执行步骤S3对接收的各路码流进行检测。
当工作在FPGA选通路模式时,切换器输送出去的码流将通过再8b/10b编码以后传递给下一级调制器。
进一步地,切换器设置两种输出,一种为Smart输出,一种为Monitor输出。Smart输出是切换器自身对多路码流解析结果进行仲裁,将当前码流质量较好的一路码流输出给下一级调制器。Monitor输出是由用户自行选定所需要的某一路码流输出给下一级调制器。
进一步地,切换器和用户还可以将上述检测项(4)至(10)中的一项或多项设置为切换条件,即检测周期内被设置为切换条件的检测项产生告警则进行输出码流的切换。
本领域普通技术人员可以理解上述方法中的全部或部分步骤可通过程序来指令相关硬件完成,所述程序可以存储于计算机可读存储介质中,如只读存储器、磁盘或光盘等。可选地,上述实施例的全部或部分步骤也可以使用一个或多个集成电路来实现。相应地,上述实施例中的各模块/单元可以采用硬件的形式实现,也可以采用软件功能模块的形式实现。本发明不限制于任何特定形式的硬件和软件的结合。
以上所述仅为本发明的较佳实施例而已,并不用以限制本发明,凡在本发明的精神和原则之内所作的任何修改、等同替换和改进等,均应包含在本发明的保护范围之内。
Claims (13)
1.一种对多路信号进行选择输出的方法,包括:
切换器接收多路异步串行接口(ASI)码流,当所述切换器工作在现场可编程门阵列(FPGA)选通路模式时,对接收的各路码流进行信号分析,之后按照预设规则将其中一路ASI码流作为输出码流输出至调制器。
2.如权利要求1所述的方法,其特征在于:
所述对码流进行信号分析包括:
(1)对码流进行编码违例检测、(2)无数据检测和(3)包头“47”连续失同步检测;
所述按照预设规则将其中一路ASI码流作为输出码流是指,所述切换器工作在FPGA选通路模式时,将接收的n路ASI码流中的一路作为输出码流;对信号进行分析后,若检测周期内当前输出码流的上述检测项中的任一项出现告警则进行输出码流的切换,切换至上述检测项均未出现告警的码流;
所述n≥2。
3.如权利要求1所述的方法,其特征在于,所述方法还包括:
所述切换器在上电过程中及FPGA选通路模式发生故障时工作在直通模式,此时将多路ASI码流中的任一路作为默认的输出码流。
4.如权利要求2所述的方法,其特征在于:
所述切换器对码流的分析还包括检测以下信息中的一项或多项:
(4)预设时间段内PMS包头“47”非连续丢失次数;
(5)预设时间段内PMS包不连续的次数;
(6)预设时间段内包序号不连续的次数;
(7)净荷类型非法检测;
(8)TOD包的时间值不连续检测;
(9)TOD包超时检测;
(10)1秒内TOD包错误检测;
若检测周期内所述检测项(1)至(3)均未出现告警的码流有多个,则选择检测项(4)至(10)中没有任何告警项的码流作为切换的目标码流。
5.如权利要求4所述的方法,其特征在于:
若不存在没有任何告警项的码流,则按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,选择告警项最少的码流作为切换的目标码流;
(b)对所述(4)至(10)中的检测项设置优先级,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
6.如权利要求2所述的方法,其特征在于:
所述切换模式包括直接切换及PMS包头“47”不失步模式;
所述PMS包头“47”不失步模式是指,当切换前正在输出的PMS包完全输出后将码流切换至目标码流;
所述直接切换模式是指,当判定需要进行切换时无论当前输出的PMS包是否输出完成立即切换至目标码流输出。
7.如权利要求2所述的方法,其特征在于,所述方法还包括:
所述切换器设置两种输出,一种为切换器自身对多路码流解析结果进行仲裁,并选择其中一路码流输出,另一种为用户自行选定所需要的一路码流输出。
8.一种对多路信号进行选择输出的切换器,包括n个码流接收模块、
现场可编程门阵列FPGA、控制模块、码流输出模块;其特征在于:
每个码流接收模块均具有一输入端以及两个输出端,起输入端与复用器相连,接收复用器发来的ASI码流,其输出端中的一个与所述FPGA相连;
所述FPGA具有n个输入端,用于接收ASI码流,FPGA用于对接收的n路ASI码流进行信号分析,并将分析结果发送至控制模块;
所述控制模块,用于收到分析结果后根据预设规则将其中一路ASI码流作为输出码流;
所述码流输出模块,用于将选择的输出码流输出至调制器;
所述n≥2。
9.如权利要求8所述的切换器,其特征在于:
所述FPGA对码流的分析包括:(1)对码流进行编码违例检测;(2)无数据检测;(3)包头“47”连续失同步检测;
所述FPGA向控制模块发送的分析结果包括检测周期内ASI码流出现告警项的信息;
所述控制模块根据预设规则将其中一路ASI码流作为输出码流是指:所述切换器刚工作在FPGA选通路模式时,将接收的n路ASI码流中的一路作为输出码流;当控制模块收到分析结果后,若当前输出码流的上述检测项中的任一项出现告警则判定进行输出码流的切换,通知FPGA将输出码流切换至上述检测项均未出现告警的码流。
10.如权利要求8所述的切换器,其特征在于:
所述切换器还包括码流选择模块;
所述每个码流接收模块的另一输出端与所述码流选择模块相连,用于切换器工作在直通模式时将接收的ASI码流发送至码流选择模块;
所述码流选择模块,用于切换器工作在直通模式时将接收的ASI码流中的一路作为默认的输出码流发送至码流输出模块。
11.如权利要求9所述的切换器,其特征在于:
所述FPGA对码流的分析还包括检测以下信息中的一项或多项:
(4)预设时间段内PMS包头“47”非连续丢失次数;
(5)预设时间段内PMS包不连续的次数;
(6)预设时间段内包序号不连续的次数;
(7)净荷类型非法检测;
(8)TOD包的时间值不连续检测;
(9)TOD包超时检测;
(10)1秒内TOD包错误检测;
所述分析结果还包括所述检测项(4)至(10)中出现告警项的信息;
所述控制模块选择目标码流时,若检测项(1)至(3)中未出现告警的码流有多个,则选择检测项(4)至(10)中没有任何告警项的码流作为切换的目标码流。
12.如权利要求11所述的切换器,其特征在于:
若不存在没有任何告警项的码流,则控制模块按以下方式中的任一种选择进行切换的目标码流:
(a)根据检测项(4)至(10)中产生告警的个数进行选择,选择告警项最少的码流作为切换的目标码流;
(b)对所述(4)至(10)中的检测项设置优先级,选择出现告警的检测项优先级最低的码流作为切换的目标码流。
13.如权利要求8所述的切换器,其特征在于:
所述FPGA进行输出码流的切换时包括直接切换模式及PMS包头“47”不失步模式;
所述PMS包头“47”不失步模式是指,当切换前正在输出的PMS包完全输出后将码流切换至目标码流;
所述直接切换模式是指,当判定需要进行切换时无论当前输出的PMS包是否输出完成立即切换至目标码流输出。
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