CN102147635A - 时序控制电路 - Google Patents
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Abstract
一种时序控制电路，包括一开关电路、一电源电路、至少一主板部件及一主芯片，开关电路包括第一及第二电开关，第一电开关的第一端连接一电源端，第一电开关的第二端接地，第一电开关的第三端通过一第一电阻连接一第一电源，还连接第二电开关的第一端，第二电开关的第二端接地，第二电开关的第三端通过一第二电阻连接一第二电源，还连接电源电路的电源状态信号引脚及主芯片的电源状态信号输入引脚，电源电路的使能引脚连接电源端，电源电路的电源状态信号引脚连接主芯片的电源状态信号输入引脚，还连接第二电阻与第二电开关的第三端之间的节点，电源电路的供电引脚连接主板部件的电源引脚。本发明时序控制电路可满足电脑主板的时序要求。
Description
技术领域
本发明涉及一种时序控制电路，特别涉及一种适用于电脑主板的时序控制电路。
背景技术
随着电子技术日新月异的发展，业界对电脑主板的时序提出了各种各样的要求，例如在一主板时序要求中，电脑开机并且电源电路接收到高电平的使能信号时，才产生符合主板部件规格的电压，然后输出高电平的电源状态信号给主芯片，例如南桥芯片等。
但是，如果不遵照上述时序要求，则会导致主芯片内部逻辑混乱，最终导致电脑不能正常运行。
发明内容
鉴于以上内容，有必要提供一种能准确地控制电脑主板时序的时序控制电路。
一种时序控制电路，包括一开关电路、一电源电路、至少一主板部件及一主芯片，所述开关电路包括第一及第二电开关，所述第一电开关的第一端连接一电源端，所述第一电开关的第二端接地，所述第一电开关的第三端通过一第一电阻连接一第一电源，还连接所述第二电开关的第一端，所述第二电开关的第二端接地，所述第二电开关的第三端通过一第二电阻连接一第二电源，还连接所述电源电路的电源状态信号引脚及所述主芯片的电源状态信号输入引脚，所述电源电路的使能引脚连接所述电源端，所述电源电路的电源状态信号引脚连接所述主芯片的电源状态信号输入引脚，还连接所述第二电阻与所述第二电开关的第三端之间的节点，所述电源电路的供电引脚连接所述主板部件的电源引脚；电脑开机后，所述电源端输出高电平给所述电源电路的使能引脚，所述电源电路工作并通过所述电源电路的供电引脚输出电压给所述主板部件的电源引脚，所述第一电开关导通，所述第二电开关截止，所述电源电路的电源状态信号引脚输出高电平的电源状态信号给所述主芯片的电源状态信号输入引脚。
本发明时序控制电路通过所述电源端在电脑开机后输出高电平给所述电源电路的使能引脚，所述电源电路工作并给主板部件供电，所述第一电开关导通，所述第二电开关截止，所述电源电路的电源状态信号引脚输出高电平的电源状态信号以使所述主芯片开始工作，从而准确地控制了电脑主板的时序。
附图说明
图1是本发明时序控制电路的较佳实施方式的电路图。
主要元件符号说明
| 开关电路 | 20 |
| 电源电路 | 30 |
| 主板部件 | 40 |
| 主芯片 | 50 |
| 场效应管 | Q1、Q2 |
| 电源 | V1、V2 |
| 电阻 | R1、R2 |
具体实施方式
请参考图1，本发明时序控制电路的较佳实施方式包括一开关电路20、一电源电路30、若干主板部件40及一主芯片50。在本实施方式中，所述主板部件40为内存、显卡等，所述主芯片50为CPU(Central Processing Unit，中央处理器)、南桥芯片或Super I/O芯片。
所述开关电路20包括两场效应管Q1、Q2。所述场效应管Q1的栅极连接一电源端PR。场效应管Q1的源极接地。场效应管Q1的漏极通过电阻R1连接电源V1，还连接场效应管Q2的栅极。场效应管Q2的源极接地。场效应管Q2的漏极通过电阻R2连接所述电源V2，还连接电源电路30及主芯片50。在本实施方式中，所述场效应管Q1及Q2作为电开关，均为(N-channelMental Oxide Semiconductor，N沟道金属氧化物半导体)NMOS场效应管，所述电源V1为5伏特的备用(stand by)电源，所述电源V2为3.3伏特的系统电源。在其它实施方式中，所述场效应管Q1及Q2也可采用其它类型的电开关，例如NPN型三极管等。
所述电源电路30的使能引脚EN连接电源端PR，电源电路30的电源状态信号引脚PWRGOOD连接主芯片50的电源状态信号输入引脚P2，还连接电阻R2与场效应管Q2的漏极之间的节点。电源电路30的供电引脚PE连接主板部件40的电源引脚P1。
下面详细介绍本发明时序控制电路在电脑开机后先控制电源电路30的使能端EN接收到高电平的使能信号，再产生符合主板部件40的所需电压，然后电源电路30的电源状态信号引脚PWRGOOD输出高电平的电源状态信号到主芯片50的工作过程：
当电脑开机前，电源端PR为低电平(如0伏特)使得电源电路30的使能引脚EN为低电平，电源电路30不工作，此时场效应管Q1截止，场效应管Q2的栅极为高电平使得场效应管Q2导通，电源电路30的电源状态信号引脚PWRGOOD输出低电平的电源状态信号给所述主芯片50的电源状态信号输入引脚P2，表示主板上电源未准备就绪。主芯片50不工作。
当电脑开机后，电源端PR输出高电平(如2伏特)给电源电路30的使能引脚EN，电源电路30工作并通过电源电路30的供电引脚PE输出电压给主板部件40的电源引脚P1，此时场效应管Q1导通，场效应管Q2的栅极为低电平使得场效应管Q2截止，电源电路30的电源状态信号引脚PWRGOOD输出高电平的电源状态信号给所述主芯片50的电源状态信号输入引脚P2，表示主板上电源准备就绪。主芯片50开始工作。
本发明时序控制电路通过电源端PR在电脑开机前为低电平，场效应管Q2导通使得电源电路30的电源状态信号引脚PWRGOOD为低电平，从而防止电源状态信号引脚PWRGOOD在电源电路30未正常工作时发出高电平，而主芯片50不工作，电源端PR在电脑开机后输出高电平，场效应管Q2截止使得电源电路30的电源状态信号引脚PWRGOOD为高电平而主芯片50才开始工作，从而满足了主板的时序要求。
Claims (5)
1.一种时序控制电路，包括一开关电路、一电源电路、至少一主板部件及一主芯片，所述开关电路包括第一及第二电开关，所述第一电开关的第一端连接一电源端，所述第一电开关的第二端接地，所述第一电开关的第三端通过一第一电阻连接一第一电源，还连接所述第二电开关的第一端，所述第二电开关的第二端接地，所述第二电开关的第三端通过一第二电阻连接一第二电源，还连接所述电源电路的电源状态信号引脚及所述主芯片的电源状态信号输入引脚，所述电源电路的使能引脚连接所述电源端，所述电源电路的电源状态信号引脚连接所述主芯片的电源状态信号输入引脚，还连接所述第二电阻与所述第二电开关的第三端之间的节点，所述电源电路的供电引脚连接所述主板部件的电源引脚；电脑开机后，所述电源端输出高电平给所述电源电路的使能引脚，所述电源电路工作并通过所述电源电路的供电引脚输出电压给所述主板部件的电源引脚，所述第一电开关导通，所述第二电开关截止，所述电源电路的电源状态信号引脚输出高电平的电源状态信号给所述主芯片的电源状态信号输入引脚。
2.如权利要求1所述的时序控制电路，其特征在于：所述第一及第二电开关均为一NMOS场效应管，所述第一及第二电开关的第一端、第二端及第三端分别为所述NMOS场效应管的栅极、源极及漏极。
3.如权利要求1所述的时序控制电路，其特征在于：所述主板部件为内存或显卡。
4.如权利要求1所述的时序控制电路，其特征在于：所述主芯片为一CPU、一南桥芯片或一Super I/O芯片。
5.如权利要求1所述的时序控制电路，其特征在于：所述第一电源为5伏特的备用电源，所述第二电源为3.3伏特的系统电源。
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