CN102110655B - Eeprom器件的制作方法 - Google Patents

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Abstract

本发明公开了一种EEPROM器件的制作方法,其中依次包括有如下步骤:首先,生长一层高压井注入的牺牲氧化层,形成高压井注入;然后,去除该牺牲氧化层,生长高压栅氧化层、形成隧穿窗口;之后,淀积浮栅,在逻辑区刻蚀掉浮栅,再淀积ONO介质层,在逻辑区刻蚀掉ONO;最后,生长5V栅氧化层,作为低压井注入的牺牲氧化层,形成低压井注入,并制作低压器件。本发明通过上述方法,将高低压井注入放在高压栅氧生长后进行,避免了低压器件的沟道注入受到高压栅氧生长的影响而耗尽,从而增强了低压器件的阈值电压可调节性。

Description

EEPROM器件的制作方法
技术领域
本发明涉及一种半导体存储器的制作方法,尤其是一种EEPROM器件的制作方法。
背景技术
在嵌入式EEPROM工艺中,需要多种器件实现各种功能:在0.18um工艺中,1.8V作为逻辑器件,5V作为输入输出端口器件,18V作为实现EEPROM操作的高压器件。集成不同电压的器件和EEPROM存储器件是嵌入式存储器工艺的重大挑战。
传统的嵌入式EEPROM工艺,高低压井注入利用同一牺牲氧化层。牺牲氧化层在井注入结束后去除,然后分别生长高压栅氧,形成隧穿窗口、浮栅以及ONO(氧化硅/氮化硅/氧化硅)介质层,最后形成逻辑低压器件的栅氧化层。这种方式会使低压器件的沟道注入受到高压栅氧生长的影响而耗尽,导致低压器件的阈值电压难以调节,最终使得器件失效。
发明内容
本发明所要解决的技术问题是提供一种EEPROM器件的制作方法,能够采用简单便捷的步骤,避免EEPROM器件的制作工艺中高压井注入和低压井注入相互之间的影响,提高器件的可靠性。
为解决上述技术问题,本发明EEPROM器件的制作方法的技术方案是,其中依次包括有如下步骤:
首先,生长一层高压井注入的牺牲氧化层,形成高压井注入;
然后,去除该牺牲氧化层,生长高压栅氧化层、形成隧穿窗口;
之后,淀积浮栅,在逻辑区刻蚀掉浮栅,再淀积ONO介质层,在逻辑区刻蚀掉ONO;
最后,生长5V栅氧化层,作为低压井注入的牺牲氧化层,形成低压井注入,并制作低压器件。
本发明通过上述方法,将高低压井注入放在高压栅氧生长后进行,避免了低压器件的沟道注入受到高压栅氧生长的影响而耗尽,从而增强了低压器件的阈值电压可调节性。
附图说明
下面结合附图和实施例对本发明作进一步详细的说明:
图1为本发明中生长高压井注入的牺牲氧化层的示意图;
图2为本发明中生长高压栅氧化层、形成隧穿窗口的示意图;
图3为本发明中刻蚀掉ONO介质层之后的示意图;
图4为本发明中生长5V栅氧化层作为低压井注入的牺牲氧化层的示意图。
具体实施方式
本发明提供了一种EEPROM器件的制作方法,如图1~图4所示,其中依次包括有如下步骤:
首先,生长一层高压井注入的牺牲氧化层,形成高压井注入;
然后,去除该牺牲氧化层,生长高压栅氧化层、形成隧穿窗口;
之后,淀积浮栅,在逻辑区刻蚀掉浮栅,再淀积ONO介质层,在逻辑区刻蚀掉ONO;
最后,生长5V栅氧化层,作为低压井注入的牺牲氧化层,形成低压井注入,并制作低压器件。
所述高压井注入的牺牲氧化层的厚度为
Figure G2009102020263D00031
所述高压栅氧化层的厚度为
Figure G2009102020263D00032
所述浮栅的厚度为
本发明通过上述方法,将高低压井注入放在高压栅氧生长后进行,避免了低压器件的沟道注入受到高压栅氧生长的影响而耗尽,从而增强了低压器件的阈值电压可调节性。

Claims (4)

1.一种EEPROM器件的制作方法,其特征在于,其中依次包括有如下步骤:
首先,生长一层高压井注入的牺牲氧化层,形成高压井注入;
然后,去除该牺牲氧化层,生长高压栅氧化层、形成隧穿窗口;
之后,淀积浮栅,在逻辑区刻蚀掉浮栅,再淀积ONO介质层,在逻辑区刻蚀掉ONO;
最后,生长5V栅氧化层,作为低压井注入的牺牲氧化层,形成低压井注入,并制作低压器件;
所述高压井和低压井形成于P型衬底中。
2.根据权利要求1所述的EEPROM器件的制作方法,其特征在于,所述高压井注入的牺牲氧化层的厚度为
Figure FSB00001010201600011
3.根据权利要求1所述的EEPROM器件的制作方法,其特征在于,所述高压栅氧化层的厚度为
Figure FSB00001010201600012
4.根据权利要求1所述的EEPROM器件的制作方法,其特征在于,所述浮栅的厚度为
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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5514889A (en) * 1992-08-18 1996-05-07 Samsung Electronics Co., Ltd. Non-volatile semiconductor memory device and method for manufacturing the same
CN1525552A (zh) * 2003-02-27 2004-09-01 ����ʿ�뵼�����޹�˾ 制造高压双栅装置的方法
US7598139B2 (en) * 2003-06-20 2009-10-06 Samsung Electronics Co., Ltd. Single chip data processing device with embedded nonvolatile memory and method thereof

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5514889A (en) * 1992-08-18 1996-05-07 Samsung Electronics Co., Ltd. Non-volatile semiconductor memory device and method for manufacturing the same
CN1525552A (zh) * 2003-02-27 2004-09-01 ����ʿ�뵼�����޹�˾ 制造高压双栅装置的方法
US7598139B2 (en) * 2003-06-20 2009-10-06 Samsung Electronics Co., Ltd. Single chip data processing device with embedded nonvolatile memory and method thereof

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