CN101998159B - 接收装置和方法及接收系统 - Google Patents

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Abstract

本发明公开了接收装置和方法、程序及接收系统。这里公开了一种接收装置，该装置包括：缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列重构一个输送流；以及输出装置，用于输出重构出的输送流。

Description

接收装置和方法及接收系统
技术领域
本发明涉及接收装置和方法、程序及接收系统，并且更具体地，涉及被配置来防止输送流(transport stream)不被输出的时间段的接收装置和方法、程序及接收系统。 
背景技术
近年来，被称为OFDM(正交频分复用)的调制方案被用于数字信号传输方案。在该OFDM方案中，在传输频带中许多正交子载波被准备并且数据被分配给各个子载波的幅度和相位，从而对这些子载波执行基于PSK(相移键控)或QAM(正交幅度调制)的数字调制。 
OFDM方案通常应用于受多径干扰的严重影响的地面数字广播。基于OFDM方案的地面数字广播包括如下标准，例如，DVB-T(地面数字视频广播)和ISDB-T(地面综合业务数字广播)。 
同时，DVB(数字视频广播)-T.2正由ETSI(欧洲电信标准协会)建立作为下一代地面数字广播，其在2009年8月5日在DVB主页URLhttp://www.dvb.org/technology/standards/上搜索到的2008年9月1日的DVB蓝宝书A122 Rev.1中的Frame structure channel coding and modulation for a second-generation digital terrestrial television broadcasting system(DVB-T2)中被公开，该文献在下面被称为非专利文献1。 
发明内容
DVB-T.2标准使用被称为M-PLP(多物理层管道)的方案。在该M-PLP方案中，数据传输是通过具有从两个或更多个输送流(下面称为TS)中提取出的共同分组的被称为共同PLP(物理层管道)的分组序列以及提取了共同分组的被称为数据PLP的分组序列来执行的。然后，接收侧从共 同PLP及数据PLP中重构一个TS。 
这里应当注意，接收侧通过使共同PLP与数据PLP同步来重构TS并输出重构的TS；然而，如果该输出的定时太早，则在下一帧到达之前重构的TS都被输出，从而使得可能在TS输出时段期间造成无输出(non-output)时段。 
如果出现TS无输出时段，则由后续译码器进行的译码可能失败。因此，必须防止出现TS无输出时段。 
因此，本发明处理上面提到的以及与相关技术的方法和装置相关联的其它问题，并且通过提供被配置来防止TS无输出时段出现从而提供安全的译码操作的接收装置和方法、程序及接收系统，可以解决所处理的问题。 
在实现本发明时，根据本发明第一实施例，提供了一种接收装置。该接收装置具有：缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个输送流；以及输出装置，用于输出重构出的输送流。 
在上述接收装置中，第一分组序列和第二分组序列是通过DVB-T.2中的M-PLP从多个TS生成的共同PLP和数据PLP。 
在上述接收装置中，在经过了从与FEF(未来扩展帧)相关联的信息获得的延迟时间之后，读控制装置开始从缓冲器读取分组，从而重构输送流，该FEF具有与作为数据基于DVB-T.2被发送的单位的T2帧不同的结构。 
在上述接收装置中，在经过了从TTO(输出的时间)获得的延迟时间之后，读控制装置开始从缓冲器读取分组，从而重构输送流，该TTO指示从布置在作为数据基于DVB-T.2被发送的单位的T2帧中的P1符号的开始起到预定分组的输出为止的时间。 
在实现本发明时，根据本发明第一实施例，提供了一种用于接收装置 的接收方法，该接收装置具有用于存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组的缓冲器。该接收方法具有以下步骤：在分组之间同步之后经过了预定延迟时间后，从缓冲器读取第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；并且输出重构出的TS。 
在实现本发明时，根据本发明第一实施例，提供了一种程序。该程序被配置为使得用于控制如下设备的计算机执行下面的步骤，所述设备具有缓冲器，该缓冲器用于存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组，这些步骤为：在分组之间同步之后经过了预定延迟时间后，从缓冲器读取第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；并且输出重构出的TS。 
在本发明的第一实施例中，由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组被存储在缓冲器中，在这些分组序列的分组之间同步之后经过了预定延迟时间后，存储在缓冲器中的第一分组序列和第二分组序列被读出，从这些分组序列中重构出一个TS，并且该重构出的TS被输出。 
在实现本发明时，根据本发明第二实施例，提供了一种接收系统。该接收系统具有：获取装置，用于经由传输路径获取信号；以及传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理。该传输路径译码处理部件具有：缓冲器，被配置为存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；以及输出装置，用于输出重构出的TS。 
在实现本发明时，根据本发明第三实施例，提供了一种接收系统。该 接收系统具有：传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及信息源译码处理部件，被配置为对已被执行了传输路径译码处理的信号执行信息源译码处理，信息源译码处理至少包括对经压缩信息进行解压缩的处理。该传输路径译码处理部件具有：缓冲器，被配置为存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；以及输出装置，用于输出重构出的TS。 
在实现本发明时，根据本发明第四实施例，提供了一种接收系统。该接收系统具有：传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及输出部件，被配置为基于被执行了传输路径译码处理的信号，输出图像数据和音频数据中的至少一者。该传输路径译码处理部件具有：缓冲器，被配置为存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；以及输出装置，用于输出重构出的TS。 
在实现本发明时，根据本发明第五实施例，提供了一种接收系统。该接收系统具有：传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及记录块，被配置为记录被执行了传输路径译码处理的信号。该传输路径译码处理部件具有：缓冲器，被配置为存储由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组；读控制装置，用于在第一分组序列的分组与第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在缓冲器中的第一分组序列和第 二分组序列的分组，由此从第一分组序列和第二分组序列来重构一个TS；以及输出装置，用于输出重构出的TS。 
在本发明第二至第五实施例中，由从一个TS提取出的与另一TS的分组共同的分组组成的第一分组序列的分组以及提取出了共同分组的第二分组序列的分组被存储在缓冲器中，在这些分组序列的分组之间同步之后经过了预定延迟时间后，存储在缓冲器中的第一分组序列和第二分组序列被读出，从这些分组序列中重构出一个TS，并且该重构出的TS被输出。 
上述接收装置可以是独立单元或者组成一个单元的组件块。 
上述程序可以通过经由传输介质进行传输来提供或者通过记录到记录介质中来提供。 
如所描述的并且根据本发明，可以无故障地执行译码。 
附图说明
图1是示出基于DVB-T.2中的M-PLP的发送机和接收机的配置示例的概况的示图； 
图2是示出被实施为本发明一个实施例的接收装置的配置示例的框图； 
图3是示出输出I/F的配置示例的框图； 
图4是示出发送侧的分组配置的示图； 
图5是示出发送侧上的共同PLP和数据PLP的配置示例的示图； 
图6是示出发送侧上的空分组删除模式中的共同PLP和数据PLP的配置示例的示图； 
图7是示出接收侧上的共同PLP和数据PLP的配置示例的示图； 
图8是用于描述接收侧上的TS重构方法的示图； 
图9是用于描述接收侧上的TS重构方法的细节的示图； 
图10A和图10B是示出TS速率计算方法的示图； 
图11是用于描述缓冲器写入和读取定时的示图； 
图12A和12B是指示用于防止TS无输出时段的第一防止方法的时序图； 
图13A、13B和13C是指示用于防止TS无输出时段的第二防止方法的时序图； 
图14是指示解调处理的流程图； 
图15是示出被实施为本发明第一实施例的接收系统的配置示例的框图； 
图16是示出被实施为本发明第二实施例的接收系统的配置示例的框图； 
图17是示出被实施为本发明第三实施例的接收系统的配置示例的框图；以及 
图18是示出计算机的硬件配置示例的框图。 
具体实施方式
将参考附图通过本发明的实施例来更详细的描述本发明。 
[整体配置概况] 
图1是示出M-PLP方案被用在DVB-T.2中的情况中的发送机(Tx)和接收机(Rx)的配置示例的概况的示图。 
如图1所示，当两个或更多个TS(附图中的TS1至TSN)以恒定比特速率被输入时，发送机侧从组成这些TS的分组中提取出共同分组，以生成被称为共同PLP的分组序列(附图中的TSPSC(CPLP))。另外，被提取了共同分组的TS提供分组序列(TSPS1(PLP1)至TSPSN(PLPN))。 
更具体而言，在发送机侧，从N个TS生成N个数据PLP和一个共同PLP。因此，对于每个PLP，OFDM等调制方案和纠错编码率等可以以适应性方式来分配。应当注意，在本实施例中，术语“PLP”表示共同PLP和数据PLP两者。还应注意，术语“共同PLP”和“数据PLP”表示组成这些PLP中的每个PLP的各个分组。 
例如，在基于MPEG的TS(输送流)分组的情况中，两个或更多个数据PLP(附图中的TSPS1(PLP1)至TSPSN(PLPN))包括诸如控制 信息(如SDT(服务描述表)和EIT(事件信息表))之类的相同信息，所以提取并发送作为共同PLP的这些共同信息可以防止传输效率降低。 
另一方面，接收机侧通过诸如OFDM之类的解调来解调接收到的两个或更多个数据PLP(附图中的TSPS1(PLP1)至TSPSN(PLPN))以及接收到的共同PLP(附图中的TSPSC(CPLP))，并且随后仅提取所希望的PLP(附图中的TSPS2(PLP2))以执行纠错处理，从而重构出所希望的TS。 
例如，如图1所示，如果TSPS2(PLP2)已从TSPS1(PLP1)至TSPSN(PLPN)中被选择，则通过将TSP2(PLP2)用作数据PLP并将TSPSC(CPLP)用作共同PLP来重构TS2。因此，提取一个数据PLP和一个共同PLP允许重构TS，从而提供了提高接收的操作效率的优点。 
接下来，在接收机侧重构出的TS被输出给后面的译码器。该译码器对TS中包括的经编码数据进行MPEG译码，并且输出得到的图像和音频数据。 
如上所述，在M-PLP方案被用在DVB-T.2中的情况中，发送机侧(Tx)从N个TS生成N个数据PLP和一个共同PLP，并且发送所生成的数据PLP和共同PLP，并且接收机侧(Rx)从所希望的数据PLP和一个共同PLP中重构(或再生)出所希望的TS。 
[接收装置的配置示例] 
图2是示出被实施为本发明一个实施例的接收装置的配置示例的示图。 
应当注意，参考图2，接收装置1等同于图1所示的接收机(Rx)并且发送装置2等同于图1中的发送机(Tx)。 
图2所示的接收装置1接收从发送装置2发送来的数字广播信号。该信号提供了通过对PLP执行诸如纠错和OFDM调制之类的处理而获得的OFDM信号，所述PLP是通过利用被制定为下一代地面数字广播标准的DVB-T.2所采用的M-PLP方案从TS中生成的。 
更具体而言，诸如广播站之类的发送装置2例如经由传输路径发送数 字广播的OFDM信号。接收装置1接收来自发送装置2的OFDM信号，对接收到的OFDM信号执行包括解调和纠错在内的传输路径译码处理，并且将得到的译码数据输出给后面的处理级。 
在图2所示的示例中，接收装置1由天线11、获取部件12、传输路径译码处理部件13、译码器14和输出部件15构成。 
天线11接收从发送装置2经由传输路径发送来的OFDM信号，并将接收到的OFDM信号提供给获取部件12。 
例如由STB(机顶盒)构成的获取部件12将由天线11接收到的OFDM信号(或RF(射频)信号)频率转换为IF(中频)信号，将IF信号提供给传输路径译码处理部件13。 
传输路径译码处理部件13对从获取部件12提供来的OFDM信号执行例如解调和纠错之类的必要处理，以从得到的PLP来重构TS，并且将重构出的TS提供给译码器14。 
即，传输路径译码处理部件13由解调单元21、纠错单元22和输出I/F(接口)23构成。 
解调单元21对从获取部件12提供来的OFDM信号进行解调并且将所希望的数据PLP和一个共同PLP作为得到的解调信号输出给纠错单元22。另外，解调单元21获取通过解调处理获得的与FEF(未来扩展帧)相关联的信息以及后面将描述的诸如N_TI等之类的用于计算延迟时间的信息(下面称为延迟时间计算信息)，将所获得的信息提供给输出I/F23。 
应当注意，FEF表示具有与作为在DVB-T.2中发送数据的单位的T2帧不同结构的帧。该结构将在未来被确定。对于与该FEF相关联的信息，指示FEF长度的FEF_Length和指示FEF排列间隔的FEF_Interval被获取。N_TI表示指示T2帧中的时间交织(time interleave)的数目的信息。 
更具体而言，T2帧和FEF各自具有被称为P1的前导信号。该前导信号包含判断对象帧是T2帧还是FEF的信息以及诸如解调之类的对OFDM信号的处理所需的信息。此外，T2帧包含被称为P2的前导信号。该P2除了包含T2帧的解调所需的信息以外还包含诸如FEF_Length和 FEF_Interval之类的FEF信息。 
因此，如果T2帧和FEF被复用在一起，则解调单元21从T2帧检测P2以获取包含在该P2中的FEF信息，并将所获得的FEF信号作为延迟时间计算信息提供给输出I/F 23。另外，解调单元21从前导信号中获取N_TI，并将T_TI作为延迟时间计算信息提供给输出I/F 23。 
纠错单元22对作为从解调单元21获得的解调信号的PLP执行预定纠错处理，并将得到的PLP输出给输出I/F 23。 
应当注意，发送装置2通过MPEG(运动图像专家组)来对诸如程序图像和音频数据之类的数据进行编码，并且将从由包括该MPEG编码数据的TS分组构成的TS中生成的PLP作为OFDM信号来发送。 
另外，发送装置2将PLP编码为RS(里德-索罗门)码或LDPC(低密度奇偶校验)码来作为针对传输路径上出现的错误的措施。因此，纠错单元22执行对这些码进行译码的处理来作为纠错处理。 
输出I/F 23从自纠错单元22提供来的PLP中重构TS，并且将重构出的TS以预定速率(下面称为TS速率)输出到外面。 
更具体而言，基于从解调单元21提供来的延迟时间计算信息以及从纠错单元22提供来的PLP，输出I/F 23获取共同PLP和数据PLP之间的同步与TS重构的开始之间的预定延迟时间。接下来，输出I/F 23在共同PLP和数据PLP之间同步之后不立即开始TS重构，而是在该预定延迟时间过去之后重构TS，并根据TS速率将重构出的TS提供给译码器14。后面将参考图3描述输出I/F 23的配置细节。 
译码器14对包含在从输出I/F 23提供来的TS中的经编码的数据进行MPEG译码，并将得到的图像和音频数据提供给输出部件15。 
由例如显示监视器和扬声器构成的输出部件15根据从译码器14提供来的图像和音频数据来显示图像并输出声音。 
接收装置1被如上所述那样配置。 
[输出I/F的详细配置示例] 
图3示出了图2所示的输出I/F 23的配置示例。 
在图3所示的示例中，输出I/F 23由缓冲器31、写控制块32、读速率计算块33和读控制块34构成。 
从纠错单元22提供来的PLP(共同PLP和数据PLP)被提供给缓冲器31、写控制块32、读速率计算块33和读控制块34。 
缓冲器31在写控制块32进行的写控制下依次存储从纠错单元22提供来的PLP。另外，缓冲器31在读控制块34进行的读控制下读取所存储的PLP以重构TS，并将重构出的TS输出给译码器14。 
基于从纠错单元22提供来的PLP，写控制块32对缓冲器31执行写地址控制，从而将PLP存储在缓冲器31中。 
基于从纠错单元22提供来的PLP，读速率计算块33计算TS速率并将所获得的TS速率提供给读控制块34。后面将参考图10A和10B描述由读速率计算块33执行的TS速率计算的细节。 
除了来自纠错单元22的PLP以及来自读速率计算块33的TS速率以外，延迟时间计算信息也从图2所示的解调单元21被提供给读控制块34。 
根据从读速率计算块33提供来的TS速率，读控制块34对缓冲器31执行读地址控制，以使得将要从自缓冲器31读取的PLP中重构出的TS被输出。 
另外，基于从纠错单元22提供来的PLP和从解调单元21提供来的延迟时间计算信息，读控制块34针对存储在缓冲器31中的共同PLP和数据PLP检测经过了读定时同步的共同PLP和数据PLP的组合，并且随后获取直到开始读取为止的预定延迟时间。 
因此，在检测到进行了读定时同步的共同PLP和数据PLP之后经过预定延迟时间之后，读控制块34开始读取这些PLP，并且根据TS速率将通过该读取重构出的TS提供给译码器14。 
应当注意，后面将参考图11至图13C描述由写控制块32和读控制块34执行的操作的细节。 
[发送装置进行的处理] 
下面将参考图4至图13C详细描述将在接收装置1与发送装置2之间执行的发送和接收处理。首先，参考图4至图6描述由发送装置2执行的处理。然后，参考图7至图13C描述由接收装置1执行的处理。 
应当注意，在下面对发送和接收处理的描述中，为了简化描述，假设TS1至TS4的4个TS被输入到发送装置2，由这些TS生成的PLP被纠错并被进行OFDM调制，并且得到的PLP被发送给接收装置1。 
如图4所示，与TS1至TS4相对应的五个框各自指示一分组。在本实施例中，组成这些TS中的每个TS的TS分组被划分为三类：TS分组、空分组(null packet)和共同分组。 
应当注意，TS分组是其中提供了用于提供诸如经MPEG编码的数据之类的服务(附图中所示的服务1至服务4)的数据的分组。空分组表示用于调节的数据，该数据被发送以使得当没有数据从发送侧被发送时，从发送侧输出的信息量保持恒定。例如，MPEG指定的空分组是这样的分组：每个TS分组的前四个字节为0x47、0x1F、0xFF和0x1F；对于有效载荷，例如采用全1。 
共同分组是其中所存储的数据为两个或更多个TS共有的分组。例如，在MPEG情况中，诸如上述的SDT和EIT之类的控制信息是这种共同分组。 
即，在图4所示的示例中，在组成TS1至TS4中的每个TS的五个分组中，从图中左边起的第三个分组是共同分组。这些共同分组包含相同的信息，所以这些共同分组被提取为共同PLP，如图5所示。 
更具体而言，在图4所示的TS1至TS4中，如果存在共同分组，则共同分组被提取为如图5所示的共同PLP，并且被提取出的共同分组由空分组取代。然后，共同分组被提取出的每个TS变成了被称为数据PLP的序列；即，TS分别变成数据PLP1至数据PLP4。 
如果发送装置2以被称为空分组删除的模式操作，则空分组在被称为1字节DNP(被删除的空分组)的信令中被发送。 
例如，对于图5所示的数据PLP1，从图中左边起的第二和第三分组为空分组；如果两个空分组连续，则这些空分组由具有值2的1字节信号 取代，如图6所示。即，DNP值与连续空分组的数目相对应；例如，对于图5所示的数据PLP3，从图中左边起的第三和第五分组为独立的空分组，所以这些空分组各自被具有值1的1字节信号取代。 
如上所述，用1字节DNP取代空分组提供了这样的状态：其中，图5所示的数据PLP1至数据PLP4变成图6所示的。因而，在发送装置2中，数据PLP1至数据PLP4以及共同PLP已被生成。 
因此，在发送装置2中，从四个TS生成四个数据PLP和一个共同PLP并且对这五个信号执行诸如纠错和OFDM调制之类的预定处理，得到的OFDM信号被发送给接收装置1。 
[接收装置进行的处理] 
下面参考图7至图13C描述由接收装置1执行的处理。 
应当注意，如上所述，假设在根据发送装置2进行的处理对图6所示的数据PLP1至PLP4和共同PLP进行的纠错和OFDM调制处理中，OFDM信号已被处理。 
在接收装置1中，从发送装置2经由预定传输路径发送来的OFDM信号被接收，以由解调单元21按诸如OFDM解调之类的预定方式处理，从而提供与图6所示的数据PLP1至PLP4和共同PLP相对应的图7所示的数据PLP1至PLP4和共同PLP。然后，如果例如服务2通过用户操作被选择，则数据PLP2从数据PLP1至数据PLP4中被提取出并且提取出的数据PLP2和共同PLP由纠错单元22以诸如纠错之类的预定方式进行处理，得到的信号被输出给输出I/F 23。 
更具体而言，仅与数据PLP2相对应的共同PLP2和数据PLP2(两者都被图7所示的粗线围绕)被输入到输出I/F 23。然后，如图8所示，对于被输入的数据PLP 2和共同PLP，输出I/F 23用布置在相应的共同PLP中的共同分组来取代布置在数据PLP2中的空分组。因此，如图8所示，与图4所示的TS2类似的原始TS2被重构出。 
图9示出了用于描述将被输入到输出I/F 23的所希望的数据PLP(数据PLP2)和共同PLP以及将从输出I/F 23输出的TS的细节。 
如图9所示，将被输入到输出I/F 23的数据PLP和共同PLP以TS分组为单位被附加了被称为DNP和ISSY(输入流同步器)的信息。 
该ISSY包括诸如ISCR(输入流时间参考)、BUFS(缓冲器大小)或TTO(Time to Output，输出的时间)之类的信息。ISCR是指示在发送每个TS分组时在发送装置2一侧所添加的时间戳的信息。BUFS是指示PLP所需的缓冲器大小的信息。参考该信息，接收装置1能够确定缓冲器面积。 
TTO是指示从对TS分组执行处理的T2帧中所布置的P1符号的开始起到该TS分组的输出为止的时间的信息。 
DNP是在如上所述的空分组删除模式中添加的信息，在空分组删除模式中，连续的空分组信号被发送，其中连续的数目是一个字节。例如，对于接收装置1，如果DNP＝3，则可以利用彼此连续的三个空分组来重构原始分组序列。 
利用从PLP获得的这些信息项，输出I/F 23从数据PLP和共同PLP检测两个经同步的分组的组合，从而通过使数据PLP和共同PLP的定时相匹配来提供同步。 
更具体而言，在输出I/F 23中，读速率计算块33通过利用添加到数据PLP的DNP以读取添加到TS分组的ISCR，来将数据PLP重构为原始分组序列，从而通过下面的公式(1)获得TS输出速率(或TS速率)。 
rate = N - bits × ( N - packets + ΣNP ) ( ISCR - b - ISCR - a ) × T . . . ( 1 )
应当注意，在上面的公式(1)中，N_bits表示每个分组的比特数，其中，例如1504(比特/分组)可被代入。T表示基本时段的单位，其中，例如在8MHz频带的情况中7/64μs的值可被代入。 
图10A和10B示出了用于描述在读速率计算块33中执行的TS速率计算示例的示图。应当注意，在图10A和10B中，时间在从左向右的方向上，如向右的箭头所指的。 
在读速率计算块33中，TS分组作为数据PLP被输入，并且被附加到每个TS分组的DNP和ISCR被输入，如图10A所示。在该示例的情况 中，被附加到从图中右边起第1个TS分组的DNP指示3并且ISCR指示3000[T]。同样，第二个TS分组的DNP指示0并且ISCR指示1000[T]。第三个TS分组的DNP指示2并且ISCR指示500[T]。 
当利用这些DNP将空分组重构为原始状态时，图10A所示的数据PLP变成图10B所示的。即，三个空分组被布置在第一TS分组之后，这三个空分组之后是第二和第三TS分组，第二和第三TS分组之后又布置了两个空分组。 
因此，令分组速率(packet rate)为Pts，则该Pts可如下这样获得。 
Pts＝(ISCR_b-ISCR_b)/(N_packets+∑DNP)＝(3000[T]-500[T])/5[packets]＝500[T/packet] 
接下来，令TS速率为RTS，则该RTS可根据公式(1)和上面所示的Pts如下这样来获得。 
RTS＝N_bits/Pts×T＝1504[bit/packet]/500[T/packet]×(7/64[μs])＝27.5[Mbps] 
如此获得的RTS＝27.5[Mbps]作为TS速率被提供给读控制块34。 
下面参考图11至图13C描述写控制块32和读控制块34对缓冲器31执行的操作的细节。 
图11示出了用于描述对缓冲器31执行的读和写操作的定时的示意图。 
在图11所示的示例中，示意性地示出了PLP被依次存储在缓冲器31中的方式。在该示意图中，共同PLP从上部区域向下依次被存储，数据PLP从底部区域向上被依次被存储。 
即，在图11所示示例中，输入到输出I/F 23中的共同PLP在写控制块32的控制下被依次存储在缓冲器31中，结果，五个共同分组与所附加的ISSY和DNY一起被存储到附图中的预定上部区域中。对于被附加到每个共同分组的这些ISSY和DNY，在本示例中，TTO＝92000[T]和DNP＝1被布置在起始的共同分组中，并且BUFS和DNP＝2被布置在第二共同分组中。在第三至第五共同分组中，DNP＝3，0，1与ISCR一起被布置。 
另一方面，所输入的数据PLP在写控制块32的控制下被依次存储在 缓冲器31中，结果，五个TS分组与所附加的ISSY和DNY一起被存储到附图中的预定底部区域中。对于被附加到每个TS分组的这些ISSY和DNY，在本示例中，TTO＝92000[T]和DNP＝0被布置在起始TS分组中，并且BUFS和DNP＝2被布置在第二TS分组中。在第三至第五TS分组中，DNP＝1，0，1与ISCR一起被布置。应当注意，在图11所示的示例中，未示出BUFS和ISCR的具体值；然而，实际上，与TTO一样，预定值被分配给这些ISSY。 
如上所述，共同PLP和数据PLP被存储在缓冲器31中。然后，存储在缓冲器31中的共同PLP和数据PLP在读控制块34的控制下被读出。在图11所示示例中，通过利用TTO的值在从P1符号的开始起90000[T]之后读取数据PLP的起始帧，并且在从P1符号的开始起92000[T]之后，即，在读取数据PLP的起始TS分组后的2000[T]之后，读取数据PLP的开始处的共同分组。 
更具体而言，当从缓冲器31读取共同PLP和数据PLP两者时，读控制块34通过利用TTO来提供共同PLP和数据PLP的输出定时之间的匹配。接下来，对于所读取的PLP，如果检测到读取定时被同步的共同PLP和数据PLP的组合，则读控制块34用共同PLP的共同分组来取代布置在数据PLP中的空分组，从而重构出原始TS。 
这里应当注意，当在共同PLP和数据PLP之间同步时输出该共同PLP和数据PLP时，太早的输出定时将导致在下一帧到来之前重构出的TS全部输出，从而使得可能在TS输出时段中产生无输出时段，如前所述。如果出现该TS无输出时段，则译码器14可能无法译码。 
如上所述，在本实施例中，通过由读控制块34控制存储在缓冲器31中的共同PLP和数据PLP的读取，在检测到读取定时被同步的共同PLP和数据PLP的组合之后的预定延迟时间时开始PLP的读取，从而防止了TS无输出时段的产生。 
因此，下面将描述由读控制块34执行的防止TS无输出时段的第一防止方法至第三防止方法的示例。 
首先，参考图12A和12B所示的时序图，描述第一TS无输出时段防 止方法。 
应当注意，为了使描述容易理解，图12A示出了出现TS无输出时段的时序图，并且图12B示出了未出现TS无输出时段的时序图。 
还应当注意，在图12A和12B所示的各个时序图中，水平轴指示时间，其中，时间从左向右流逝。垂直轴指示存储在缓冲器31中的数据的地址；轴越高，地址越大。此外，在图12A和12B中，虚线指示写地址，实线指示读地址。这些轴的含义与后面将描述的图13A至13C中所示的轴的含义相同。 
在图12A和12B中，F_idx指示T2帧的索引。在图12A和12B所示示例中，具有F_idx＝0，1，2，3，...的T2帧被依次输入到输出I/F 23。另外，如图中的“数据”所示的，包含在一个T2帧中的TS分组的数目在各个帧中是相同的。 
首先，描述图12A所示的出现TS无输出时段的示例。 
如图12A所示，在输出I/F 23中，当T2帧(F_idx＝0)的TS分组被输入时，由写控制块32开始将所输入的TS分组存储到缓冲器31中，同时，由读控制块34开始读取存储在缓冲器31中的TS分组。此刻，如图12A所示，指示写地址和读地址的速度的倾斜度不同，以使得在TS分组的存储量达到预定水平时，存储在缓冲器31中的TS分组才被读取。 
更具体而言，读控制块34与TS分组的写入异步地读取TS分组。另外，如果读定时被同步的共同PLP和数据PLP的组合已被检测到，则读控制块34直接输出通过用共同PLP的共同分组取代该数据PLP的空分组而重构出的TS。然后，读控制块34继续读取TS分组直到在T2帧(F_idx＝0)的TS分组的写入结束之后存储在缓冲器31中的所有TS分组被读取为止。 
当T2帧(F_idx＝0)的TS分组的读取结束时，与T2帧(F_idx＝0)一样，对T2帧(F_idx＝1)执行TS分组的写入和读取。在图12A和12B所示的示例中，帧被混合有抖动，这导致了T2帧(F_idx＝2)的帧开头的延迟。在此情况中，T2帧(F_idx＝2)在所有TS分组的读取结束之后将不被输入。 
即，连续的T2帧的帧开头等距离地被输入，并且对于正常输入，T2帧的分组总数总是相同的。然而，在图12A和12B所示示例中，由于抖动混入帧中，因此，分组数目对于每帧是相同的，但是T2帧(F_idx＝2)的帧开头的间隔变化了。 
当上述状态被提供时，读地址赶上写地址，然而由于不存在读数据，因此，出现了TS无输出时段。 
在图12B所示示例中，与图12A所示的示例相比，在与写控制块32进行的写入的开始相同的时间处启动的由读控制块34进行的读取的开始定时被延迟了预定延迟时间。因此，在图12B所示的情况中，即使T2帧(F_idx＝2)的帧开头由于抖动混入帧中而被延迟，读地址也不会赶上写地址，从而使得可以防止TS无输出时段的出现。 
更具体而言，即使读取定时被同步的共同PLP和数据PLP的组合已被检测到，读控制块34也不立即开始读取，而是在诸如10ms之类的延迟时间过去之后开始PLP的读取。 
该延迟时间可以在接收装置1被使用的环境中通过用户操作被设置，或者可以被设置为所谓的出厂设定值，在出厂设定值中，接收装置1的制造商根据通常希望的使用环境来进行设置。 
如上所述，通过将读开始定时延迟诸如10ms之类的预定延迟时间，在检测到读定时被同步的共同PLP和数据PLP的组合之后，可以防止TS无输出时段的出现，从而使得译码器14能够稳妥地执行译码。 
下面参考图13A至13C所示的时序图描述第二TS无输出时段防止方法。 
应当注意，在图13A至13C所示示例中，为了使描述容易理解，图13A和13C示出了未出现TS无输出时段的情况中的时序图，图13B示出了出现TS无输出时段的情况中的时序图。 
在图13A至13C中，除了如图12A和12B所示的T2帧之类的T2帧之外，FEF也被包含在输入数据中。在输出I/F 23中，FEF、T2帧(F_idx＝0)、T2帧(F_idx＝1)、T2帧(F_idx＝2)、FEF、T2帧(F_idx＝3)等被依次输入。即，第二防止方法在将T2帧与FEF复用时使用。 
下面描述这样的示例，其中，如果图13A所示的读取开始不被延迟，则不会出现TS无输出时段。 
如图13A所示，如果在紧邻FEF之后检测到读取定时被同步的共同PLP和数据PLP的组合，则当读控制块34的读取在与写控制块32开始写入时相同的时间处开始时，在F_idx＝0，1，2的T2帧中，读地址将不会赶上写地址。这是因为读地址在紧接着T2帧(F_idx＝2)被输入的FEF的结束处赶上写地址，所以在图13A所示的示例的情况中不会出现TS无输出时段。 
下面描述出现图13B所示的TS无输出时段的示例。 
相比之下，如图13B所示，如果不是在紧邻FEF之后，例如是在T2帧(F_idx＝2)的开始处检测到读取定时被同步的共同PLP和数据PLP的组合，则当读控制块34的读取在与写控制块32的写入相同的时间处开始时，在缓冲器31中未存储足够数据的情况下，T2帧(F_idx＝2)的下一FEF时段被输入，从而导致读地址赶上写地址。因此，在图13B所示示例的情况中，将出现TS无输出时段。 
下面描述图13C所示的未出现TS无输出时段的示例。 
在图13C所示示例中，如果读取定时被同步的共同PLP和数据PLP的组合被检测到，则读控制块34不立即开始读取，而是在经过了从FEF信息获得的延迟时间之后开始读取这些PLP。 
例如，令FEF的长度为FEF_Length并且令布置FEF的间隔为FEF_Interval，则延迟时间D从下面的公式(2)获得。 
D＝(Frame_IndexmodFEF_Interval)×FEF_Length+offset    ...(2) 
应当注意，在上面的公式(2)中，FEF_Length的单位是T[μs]并且FEF_Interval是布置在第n个FEF和第n+1个FEF之间的T2帧的数目。如上所述，这些FEF_Length和FEF_Interval是作为延迟时间计算信息从解调单元21提供来的。 
此外，在上面的公式(2)中，Frame_index(F_idx)除以FEF_Interval得到的余数在(Frame_index mod FEF_Interval)中获得。从所获得的余数中，共同PLP和数据PLP的组合被检测到的定时被获得。 
例如，在图13A至13C所示示例中，Frame_index＝2并且FEF_Interval＝3，所以如果FEF_Length＝30μs，则这些值被代入公式(2)以获得D＝2/3×300＝200μs作为延迟时间。即，读控制块34可以在写开始之后的200μs时开始读取。 
更具体而言，如图13C所示，读控制块34控制对存储在缓冲器31中的共同PLP和数据PLP的读取，并且在检测到读取定时被同步的共同PLP和数据PLP的组合之后，在例如通过上面的公式(2)获得的200μs以后开始读取，从而重构并输出TS。 
如上所述，如果T2帧和FEF被复用，则可以将读取开始定时延迟通过利用诸如FED长度之类的FEF信息从上面的公式(2)获得的预定延迟时间，以防止TS无输出时段出现，从而使得译码器14能够稳妥地执行译码。 
将描述第三TS无输出时段防止方法。 
与第一防止方法相似，将参考图12A和12B所示的时序图来描述第三防止方法。更具体而言，对于第三防止方法，与第一防止方法相似，为了防止TS无输出时段出现，在与写控制块32的写开始时间相同的时间处开始的读控制块34的读开始时间被延迟；然而，与第一防止方法不同，在第三防止方法中该延迟时间是利用TTO值获得的。 
即，如上所述，被附加到PLP的TTO是指示从执行对TS分组的处理的T2帧中所布置的P1符号的开始起到该TS分组的输出为止的时间的信息。该时间未被完全包含在对象T2帧的时段中，而是延伸跨越到下一T2帧(TTO＞T2_frame_Length)。因此，利用该TTO，可从下面的公式(3)获得延迟时间D。 
D＝TTO-(T2_frame_Length/N_TI)+offset    ...(3) 
应当注意，在上面的公式(3)中，T2_frame_Length表示T2帧的长度(单位为T[μs])。N_TI表示一个T2帧中的时间间隔的数目。取决于N_TI的值，T2帧处理的单位被划分。 
因此，例如如果N_TI＝1，则处理基于T2帧执行，以使得通过计算TTO-T2_frame_Length来获得延迟时间D。另外，TTO包含由先前处理 块产生的延迟。该延迟可由T2_frame_Length/N_TI来指定。 
此外，如上所述，该N_TI是作为延迟时间计算信息从解调单元21提供来的。 
更具体而言，如图12B所示，读控制块34控制存储在缓冲器31中的共同PLP和数据PLP的读取，以便在检测到读取定时被同步的共同PLP和数据PLP的组合之后经过了从上面的公式(3)获得的延迟时间之后再开始读取，从而重构并输出TS。 
如上所述，通过将读开始定时延迟通过利用被附加到每个TS分组的ISSY中所包含的TTO从上面的公式(3)获得的预定延迟时间，可以防止出现TS无输出时段，从而使得译码器14能够稳妥地执行译码。 
于是，通过利用第一防止方法至第三防止方法中的任一种，读控制块34通过将读开始定时延迟预定延迟时间来开始读取，并且根据从读速率计算块33提供来的TS速率将重构出的TS输出给后续译码器14。 
如上所述，在本实施例中，例如在读取存储在缓冲器31中的PLP的初始阶段，在诸如差的输出速率精确度、非恒定的帧间隔、存在FEF、出现延伸到多个帧的大DNP之类的情况中，读开始定时被延迟，以防止由于在从读取开始之后的一帧起的预定时间段(例如由两个或更多个T2帧以及FEF构成的一个超帧时段)中出现间隙(gap)的可能性而导致的影响。 
[解调处理的描述] 
下面参考图14所示的流程图描述解调处理。 
天线11接收从发送装置2发送来的OFDM信号(RF信号)，并将接收到的OFDM信号提供给获取部件12。获取部件12将由天线11接收到的OFDM信号频率转换为IF信号，并将IF信号提供给解调单元21。 
在步骤S11，解调单元21对从获取部件12提供来的OFDM信号执行OFDM解调处理并且将所希望的数据PLP和一个共同PLP作为经解调的信号输出给纠错单元22。另外，解调单元21获取通过解调处理获得的延迟时间计算信息，将所获得的信息提供给输出I/F 23。 
在步骤S12，纠错单元22对作为从解调单元21获得的经解调的信号的PLP执行预定纠错处理，并将得到的PLP输出给输出I/F 23。 
在步骤S13，读速率计算块33基于从纠错单元22提供来的PLP计算TS速率，并将所获得的TS速率提供给读控制块34。 
在步骤S14，基于从纠错单元22提供来的PLP和从解调单元21提供来的延迟时间计算信息，读控制块34获取从检测到读定时被同步的共同PLP和数据PLP的组合起到读取开始为止的预定延迟时间。该延迟时间例如可以通过上述第一防止方法至第三防止方法中的任一种来获得。 
在步骤S15，基于从纠错单元22提供来的PLP，写控制块32对缓冲器31执行写地址控制，以将PLP存储在缓冲器31中。 
在步骤S16，读控制块34判断从检测到读定时被同步的共同PLP和数据PLP的组合起是否经过了在步骤S14获得的延迟时间。 
如果在步骤S16中发现尚未经过该延迟时间，则过程返回步骤S15，在步骤S15中，写控制块32将PLP写入缓冲器31直到经过了延迟时间为止。因此，一定量的PLP被存储在缓冲器31中。 
另一方面，如果在步骤S16中发现已经过了延迟时间，则读控制块34在步骤S17中开始读取存储在缓冲器31中的PLP。在步骤S18，读控制块34根据从读速率计算块33提供来的TS速率来将通过读取存储在缓冲器31中的PLP而重构出的TS输出给译码器14。 
在步骤S19，输出I/F 23判断是否结束图14所示的解调处理。如果在步骤S19发现不结束解调处理，则过程返回步骤S15以从其开始重复上述处理。 
更具体而言，由于已经经过了延迟时间(步骤S16中总为是)，因此重复步骤S15、S17和S18的处理操作，其中，写控制块32依次将PLP写入缓冲器31，并且同时，读控制块34与写入异步地依次读取存储在缓冲器31中的PLP。因此，重构出的TS以TS速率被依次输出给译码器14。如果写入不再被执行，则存储在缓冲器31中的所有PLP被读取。读控制块34继续PLP读取，直到所有PLP被读取并被输出为重构出的TS为止。 
在步骤S20，如果发现处理结束，则图14所示的解调处理终止。 
如上所述，在接收装置1中，即使读定时被同步的共同PLP和数据PLP的组合被检测到，也不立即执行读取，由此将读开始定时延迟预定延迟时间。 
因此，如果读定时被同步的共同PLP和数据PLP的组合已被检测到并且在检测到该组合之后立即开始PLP读取，则由于上面所述的各种原因在下一帧到来之前重构出的TS都将被输出，从而可能导致TS无输出时段。相比之下，在本实施例中，读取在经过了预定延迟时间之后开始，所以可以防止出现TS无输出时段，从而防止到译码器14的TS输出的中断。 
应当注意，在本实施例中，读控制块34通过第一防止方法至第三防止方法中的任一种来获得延迟时间，并且在经过了所获得的延迟时间后开始读取；然而，读控制块34通过另外的防止方法获得延迟时间也是可行的。通过另外的防止方法获得延迟时间要求读控制块34获取用于获得延迟时间的信息；例如，如果该信息可由解调单元21获得，则解调单元21可以读取该信息作为延迟时间计算信息，并且将该延迟时间计算信息提供给读控制块34。 
即，诸如FEF信息和N_TI信息之类的延迟时间计算信息是在上述非专利文献1中所记述的信息；如果信息不是上述延迟时间计算信息并且该信息是获得延迟时间所需的，则读控制块34能够利用上述延迟时间计算信息以外的信息来获得延迟时间。 
[接收系统的配置示例] 
下面参考图15至图17描述接收系统的配置示例。 
图15示出了被实施为本发明第一实施例的接收系统的配置示例。 
如图15所示，接收系统例如由获取部件201、传输路径译码处理部件202和信息源译码处理部件203构成。 
获取部件201经由诸如地面数字广播、卫星数字广播、CATV(有线电视)网络、因特网和其它网络之类的传输路径(未示出)来获取信号，并且将所接收的信号提供给传输路径译码处理部件202。 
如果信号例如是通过地面波、卫星波或CATV(有线电视)从广播站广播的，则获取部件201由调谐器、STB(机顶盒)等构成，如图12A和12B所示的获取部件12那样。如果信号是以如IPTV(因特网协议电视)之类的多播方式从Web服务器发送的，则获取部件201例如由诸如NIC(网络接口卡)之类的网络接口构成。 
如果信号例如是通过地面波、卫星波或CATV从广播站广播的，则从两个或更多个发送装置经由两个或更多个传输路径发送来的信号由一个获取部件201接收作为一个得到的合成信号。 
传输路径译码处理部件202针对被获取部件201经由传输路径获取的信号来估计信道，以对所获取的信号执行至少包括解调处理的传输路径译码处理，并且将得到的信号提供给信息源译码处理部件203。 
即，由获取部件201经由传输路径获得的信号是因传输路径特性而失真的信号，因而传输路径译码处理部件202执行例如传输路径估计、信道估计和相位估计之类的解调处理。 
另外，传输路径译码处理例如可以包括校正出现在传输路径上的错误的处理。纠错编码例如包括LDPC编码和里德-索罗门编码。 
信息源译码处理部件203对已被执行了传输路径译码处理的信号执行至少包括信息解压缩处理的信息源译码处理。 
更具体而言，由获取部件201经由传输路径获得的信号例如可能是经压缩的信息以便减少作为信息的诸如图像和音频之类的数据的量。在此情况中，信息源译码处理部件203对已被执行了传输路径译码处理的信号执行诸如信息解压缩处理之类的信息源译码处理。 
应当注意，如果获取部件201经由传输路径获得的信号未被压缩，则信息源译码处理部件203不对这种未经压缩的信号执行解压缩处理。 
解压缩处理例如包括MPEG译码。传输路径译码处理除了可以包括解压缩处理之外，例如还可以包括解扰。 
在如上所述那样配置的接收系统中，获取部件201对图像和音频数据执行诸如MPEG编码之类的压缩处理，并且经由传输路径获取被提供给传输路径译码处理部件202的经过纠错的信号。此时，每个信号以因传输路 径特性而失真的状态被获取。 
传输路径译码处理部件202对从获取部件201提供来的每个信号执行与图2所示的传输路径译码处理部件13所执行的处理相同的处理来作为传输路径译码处理，并将得到的信号提供给信息源译码处理部件203。 
信息源译码处理部件203对从传输路径译码处理部件202提供来的信号执行与图2所示的译码器14执行的处理相同的处理来作为信息源译码处理，并输出得到的图像或音频数据。 
如图15所示这样配置的接收系统例如可应用于电视调谐器，以便例如接收作为数字广播的电视广播。 
应当注意，获取部件201、传输路径译码处理部件202和信息源译码处理部件203可以各自被配置在一个独立装置(或硬件单元，例如IC(集成电路))或软件模块中。 
此外，获取部件201、传输路径译码处理部件202和信息源译码处理部件203可以被配置为作为一个独立装置的获取部件201和传输路径译码处理部件202的组、传输路径译码处理部件202和信息源译码处理部件203的组，或者获取部件201、传输路径译码处理部件202和信息源译码处理部件203的组。 
图16示出了被实施作为本发明第二实施例的接收装置的配置示例。 
参考图16，与先前参考图15描述的组件类型的组件用相同的标号表示，并且适当地省略对其的描述。 
图16所示的接收系统与图15所示的接收系统的相同之处在于具有获取部件201、传输路径译码处理部件202和信息源译码处理部件203，而不同之处在于还具有输出部件211。 
输出部件211例如是用于显示图像的显示装置或用于输出声音的扬声器，并且输出作为从信息源译码处理部件203输出的信号的图像或声音。 
如上所述那样配置的接收系统例如可应用于用来接收作为数字广播的电视广播的电视接收机以及用来接收无线电广播的无线电接收机。 
应当注意，如果获取部件201获取的信号未被压缩，则从传输路径译码处理部件202输出的信号被提供给输出部件221。 
图17示出了被实施为本发明第三实施例的接收系统的配置示例。 
参考图17，与先前参考图16描述的组件类似的组件用相同的标号表示，并且适当地省略对其的描述。 
图17所示的接收系统与图15所示的接收系统的相同之处在于具有获取部件201和传输路径译码处理部件202。 
然而，图17所示的接收系统与图15所示的接收系统的不同之处在于未布置信息源译码处理部件203而布置了记录部件221。 
记录块221例如将从传输路径译码处理部件202输出的信号(例如MPEG TS的TS分组)记录(或存储)到诸如光盘、硬盘(或磁盘)和闪存之类的记录(或存储)介质。 
如上所述那样配置的接收系统例如可应用于用来记录电视广播的记录器。 
应当注意，在图17中，可以通过布置信息源译码处理部件203来配置接收系统，其中，信息源译码处理部件203将已被执行了信息源译码处理的信号，即通过译码获得的图像和音频数据，记录到记录块221。 
上述处理操作序列可由软件和硬件来执行。当上述处理操作序列由软件执行时，构成软件的程序被安装在内置于专用硬件装备中的计算机中，或者例如被安装到可以安装各种程序以执行各种功能的通用个人计算机中。 
图18示出了被配置来通过软件执行上述处理操作序列的计算机的硬件配置示例。 
在图18所示的计算机中，CPU(中央处理单元)401、ROM(只读存储器)402和RAM(随机存取存储器)经由总线404互连。 
总线404还与输入/输出接口405相连。输入/输出接口405与输入部件406、输出部件407、存储部件408、通信部件409和驱动器410相连。 
输入部件406例如由键盘、鼠标和麦克风构成。输出部件407例如由显示监视器和扬声器构成。存储部件408例如由硬盘驱动器或非易失性存储器构成。通信部件409例如由网络接口构成。驱动器410例如被配置为驱动可移除介质411，例如磁盘、光盘、磁光盘或半导体存储器。 
在如上所述那样配置的计算机中，CPU 401经由输入/输出接口405和总线404将程序从存储部件408载入RAM 403以执行所载入的程序，从而执行上述处理操作序列。 
将由计算机执行的程序例如可被提供为被记录到作为封装介质的可移除介质411中。替代地，例如可以通过诸如局域网、因特网或数字广播之类的有线或无线传输介质来提供程序。 
在上述计算机中，可以通过将可移除介质411载入到驱动器410上来通过输入/输出接口405将程序安装到存储部件408中。替代地，程序可经由有线或无线传输介质在通信部件409处被接收并被安装在存储部件408中。替代地，程序可被预先存储在ROM 402或存储部件408中。 
这里应当注意，用于描述记录在记录介质中的每个程序的步骤不仅包括以依赖于时间的方式顺序执行的处理操作，而且包括并发地或离散地执行的处理操作。 
还应当注意，这里使用的术语“系统”表示由多个组成单元构成的整个装置。 
本申请包含与2009年8月14日向日本专利局提交的日本优先专利申请JP 2009-187946中公开的主题有关的主题，该申请的全部内容通过引用结合于此。 
本领域的技术人员应当明白，可以根据设计要求和其它因素进行各种修改、组合、子组合和变更，只要它们在所附权利要求或其等同物的范围之内。 

Claims (9)

1.一种接收装置，包括：
缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组；
读控制装置，用于在所述第一分组序列的分组与所述第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在所述缓冲器中的所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出装置，用于输出重构出的输送流。
2.根据权利要求1所述的接收装置，其中，所述第一分组序列和所述第二分组序列是通过地面数字视频广播2中的多物理层管道从多个输送流生成的共同物理层管道和数据物理层管道。
3.根据权利要求1所述的接收装置，其中，在经过了从与未来扩展帧相关联的信息获得的延迟时间之后，所述读控制装置开始从所述缓冲器读取分组，从而重构所述输送流，所述未来扩展帧具有与作为数据基于地面数字视频广播2被发送的单位的T2帧不同的结构。
4.根据权利要求1所述的接收装置，其中，在经过了从输出的时间获得的延迟时间之后，所述读控制装置开始从所述缓冲器读取分组，从而重构所述输送流，所述输出的时间指示从布置在作为数据基于地面数字视频广播2被发送的单位的T2帧中的P1符号的开始起到预定分组的输出为止的时间。
5.一种用于接收装置的接收方法，所述接收装置具有用于存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组的缓冲器，所述接收方法包括以下步骤：
在分组之间同步之后经过了预定延迟时间后，从所述缓冲器读取所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出重构出的输送流。
6.一种接收系统，包括：
获取装置，用于经由传输路径获取信号；以及
传输路径译码处理部件，被配置为对经由所述传输路径获得的信号执行至少包括解调处理的传输路径译码处理，
所述传输路径译码处理部件具有
缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组；
读控制装置，用于在所述第一分组序列的分组与所述第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在所述缓冲器中的所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出装置，用于输出重构出的输送流。
7.一种接收系统，包括：
传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及
信息源译码处理部件，被配置为对已被执行了所述传输路径译码处理的信号执行信息源译码处理，所述信息源译码处理至少包括对经压缩信息进行解压缩的处理，
所述传输路径译码处理部件具有
缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组；
读控制装置，用于在所述第一分组序列的分组与所述第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在所述缓冲器中的所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出装置，用于输出重构出的输送流。
8.一种接收系统，包括：
传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及
输出部件，被配置为基于被执行了所述传输路径译码处理的信号，输出图像数据和音频数据中的至少一者，
所述传输路径译码处理部件具有
缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组；
读控制装置，用于在所述第一分组序列的分组与所述第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在所述缓冲器中的所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出装置，用于输出重构出的输送流。
9.一种接收系统，包括：
传输路径译码处理部件，被配置为对经由传输路径获得的信号执行至少包括解调处理的传输路径译码处理；以及
记录块，被配置为记录被执行了所述传输路径译码处理的信号，
所述传输路径译码处理部件具有
缓冲器，被配置为存储由从一个输送流提取出的与另一输送流的分组共同的分组组成的第一分组序列的分组以及由提取出了共同分组的输送流组成的第二分组序列的分组；
读控制装置，用于在所述第一分组序列的分组与所述第二分组序列的分组之间建立同步之后经过了预定时间后读取存储在所述缓冲器中的所述第一分组序列和所述第二分组序列的分组，由此从所述第一分组序列和所述第二分组序列来重构一个输送流；以及
输出装置，用于输出重构出的输送流。
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