CH539988A - Schaltungsanordnung zur Herstellung des Gleichlaufs von Sende- und Empfangseinrichtungen bei der Übertragung von Datenblöcken - Google Patents

Schaltungsanordnung zur Herstellung des Gleichlaufs von Sende- und Empfangseinrichtungen bei der Übertragung von Datenblöcken

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CH539988A
CH539988A CH282872A CH282872A CH539988A CH 539988 A CH539988 A CH 539988A CH 282872 A CH282872 A CH 282872A CH 282872 A CH282872 A CH 282872A CH 539988 A CH539988 A CH 539988A
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CH
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transmitting
synchronization
establishing
data blocks
circuit arrangement
Prior art date
Application number
CH282872A
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German (de)
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Inventor
Markwitz Wernhard
Original Assignee
Siemens Ag
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    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00—Arrangements for synchronising receiver with transmitter
    • H04L7/04—Speed or phase control by synchronisation signals
    • H04L7/048—Speed or phase control by synchronisation signals using the properties of error detecting or error correcting codes, e.g. parity as synchronisation signal

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CH282872A 1971-03-18 1972-02-29 Schaltungsanordnung zur Herstellung des Gleichlaufs von Sende- und Empfangseinrichtungen bei der Übertragung von Datenblöcken CH539988A (de)

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DE19722203414 DE2203414C3 (de) 1971-03-18 1972-01-25 Verfahren und Schaltungsanordnung zum Herstellen des Gleichlaufs von Sende- und Empfangseinrichtungen bei der Übertragung von Datenblöcken

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CH282872A CH539988A (de) 1971-03-18 1972-02-29 Schaltungsanordnung zur Herstellung des Gleichlaufs von Sende- und Empfangseinrichtungen bei der Übertragung von Datenblöcken

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