WO2024257556A1 - スパッタリング装置及びスパッタリング方法 - Google Patents

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    • H01J2237/33Processing objects by plasma generation characterised by the type of processing
    • H01J2237/332Coating

Definitions

  • One embodiment of the present invention relates to a sputtering apparatus and a sputtering method.
  • one embodiment of the present invention relates to a sputtering apparatus and a sputtering method in which a rotary target is used.
  • OLED organic light-emitting diode
  • micro LED display devices or mini LED display devices in which tiny LED chips are mounted within the pixels of a circuit board, have been developed as next-generation display devices.
  • LEDs are self-emitting elements similar to OLEDs.
  • LEDs are composed of stable inorganic compounds containing gallium (Ga) or indium (In). Therefore, compared to OLED display devices, micro LED display devices are more likely to ensure high reliability.
  • LED chips have high luminous efficiency and can achieve high brightness. Therefore, micro LED display devices or mini LED display devices are expected to be next-generation display devices with high reliability, high brightness, and high contrast.
  • gallium nitride films used in micro LEDs and the like are generally formed on sapphire substrates at high temperatures of 800°C to 1000°C using MOCVD (Metal Organic Chemical Vapor Deposition) or HVPE (Hydride Vapor Phase Epitaxy).
  • MOCVD Metal Organic Chemical Vapor Deposition
  • HVPE HydroVPE
  • a method for forming gallium nitride films by sputtering has been developed that allows film formation at relatively low temperatures (see, for example, Patent Document 1).
  • micro-LEDs are formed by stacking multiple films with different compositions. With conventional sputtering equipment, it was necessary to prepare a target and chamber for each film with a different composition.
  • one embodiment of the present invention aims to provide a new sputtering device and sputtering method.
  • a sputtering apparatus has a substrate holding part for holding a substrate, a first target arranged to face the substrate holding part, a second target arranged alongside the first target to face the substrate holding part, and a partition wall arranged between the first target and the second target.
  • a first normal at an arbitrary position of the first target and a second normal at an arbitrary position of the second target is connected to an arbitrary point on the substrate.
  • a sputtering apparatus has a substrate holding part for holding a substrate, a first target arranged to face the substrate holding part and having a first target member attached thereto, and a second target arranged alongside the first target to face the substrate holding part and having a second target member different from the first target member attached thereto.
  • the first target member contains gallium.
  • a substrate is held on a substrate holder facing a first target and a second target, and in a first step, a first material of the first target is deposited on the substrate by relatively moving the first target and the substrate holder while generating plasma for the first target, and in a second step, a second material of the second target is deposited on the substrate by relatively moving the second target and the substrate holder while generating plasma for the second target, thereby forming a layered structure including the first material and the second material.
  • FIG. 1 is a diagram showing an overview of a sputtering apparatus according to an embodiment of the present invention.
  • FIG. 2 is a flow chart illustrating a sputtering method according to an embodiment of the present invention.
  • 1A to 1C are diagrams illustrating a sputtering method according to an embodiment of the present invention.
  • 1A to 1C are diagrams illustrating a sputtering method according to an embodiment of the present invention.
  • 1 is a cross-sectional view showing a semiconductor device manufactured using a sputtering method according to an embodiment of the present invention.
  • FIG. 11 is a flow chart showing a modified example of a sputtering method according to an embodiment of the present invention.
  • 11A to 11C are diagrams illustrating a modified example of a sputtering method according to an embodiment of the present invention.
  • 11A to 11C are diagrams illustrating a modified example of a sputtering method according to an embodiment of the present invention.
  • FIG. 13 is a diagram showing an overview of a modified example of a sputtering apparatus according to an embodiment of the present invention.
  • 1A to 1C are diagrams illustrating a sputtering method according to an embodiment of the present invention.
  • 1A to 1C are diagrams illustrating a sputtering method according to an embodiment of the present invention.
  • 11A to 11C are diagrams illustrating a modified example of a sputtering method according to an embodiment of the present invention.
  • FIG. 13 is a diagram showing an overview of a modified example of a sputtering apparatus according to an embodiment of the present invention.
  • 1 is a diagram illustrating an overview of a sputtering apparatus and a sputtering method according to an embodiment of the present invention.
  • 1 is a diagram illustrating an overview of a sputtering apparatus and a sputtering method according to an embodiment of the present invention.
  • 1 is a diagram illustrating an overview of a sputtering apparatus and a sputtering method according to an embodiment of the present invention.
  • 1 is a diagram illustrating an overview of a sputtering apparatus and a sputtering method according to an embodiment of the present invention.
  • 1 is a cross-sectional view showing a semiconductor device manufactured by using a sputtering method according to an embodiment of the present invention.
  • 1 is a diagram showing an overview of a sputtering apparatus according to an embodiment of the present invention.
  • 1 is a cross-sectional view showing a light emitting device manufactured using a sputtering method according to an embodiment of the present invention.
  • the direction from the first member to the second member is referred to as up or upward. Conversely, the direction from the second member to the first member is referred to as down or downward.
  • up or downward are used in the explanation, but for example, the first member and the second member may be arranged so that their vertical relationship is reversed from that shown in the figure.
  • the expression "second member on the first member” merely describes the vertical relationship between the first member and the second member as described above, and other members may be arranged between the first member and the second member.
  • steps S501 and S502 are the same as steps S201 and S202 in FIG. 2, so the description will be omitted.
  • the position of the magnets (central magnet 213 and peripheral magnet 214) of the rotary target RT1 is controlled to a film-forming position (step S503; the magnets of the first RT are controlled to a film-forming position), and the position of the magnets (central magnet 223 and peripheral magnet 224) of the rotary target RT2 is controlled to a non-film-forming position (step S503; the magnets of the second RT are controlled to a non-film-forming position).
  • power is supplied to the rotary targets RT1 and RT2, and plasma is generated for both of them (step S504; plasma ON for the first RT, plasma ON for the second RT).
  • plasma is generated for both rotary targets RT1 and RT2 as shown in FIG. 6A, but only the target material sputtered from target 216 is deposited on substrate 310.
  • the target material sputtered from target 226 is directed in the opposite direction to substrate 310 and is blocked by shielding plate 227, so the target material is not deposited on substrate 310.
  • plasma is generated at the position where slit 218 is provided by controlling the magnet included in rotary target RT1, and plasma is generated at the position where slit 228 is not provided by controlling the magnet included in rotary target RT2.
  • substrate holder 300 holding substrate 310 moves in the direction of the arrow (step S505; substrate movement).
  • step S505 only the material of target 216 attached to rotary target RT1 is deposited on substrate 310.
  • the substrate holding part 300 moves in the direction of the arrow in FIG. 6A, and when deposition is completed up to the end of the deposition area of the substrate 310, the substrate holding part 300 moves in the opposite direction to the arrow. During the reverse movement, the deposition may be continued, or the plasma may be stopped to avoid deposition.
  • step S506 plasma OFF for the first RT, plasma OFF for the second RT
  • step S507 the magnets of the first RT are controlled to the film formation positions
  • step S508 plasma ON for the first RT, plasma ON for the second RT
  • FIG. 7 is a diagram showing an overview of a modified example of a sputtering apparatus according to an embodiment of the present invention.
  • the sputtering apparatus 10 shown in Fig. 7 is similar to the sputtering apparatus 10 shown in Fig. 1, but the configuration of the shielding plate is different from that of the sputtering apparatus 10 in Fig. 1.
  • Other configurations in Fig. 7 are the same as those in Fig. 1, so description thereof will be omitted.
  • the shielding plate 240 has a partition wall 241, a first shielding plate 242, and a second shielding plate 243.
  • the first shielding plate 242 has a slit 244 at the same position as the slit 218 in FIG. 1.
  • the second shielding plate 243 has a slit 245 at the same position as the slit 228 in FIG. 1.
  • the partition 241 is provided between the rotary targets RT1 and RT2.
  • the partition 241 is provided so as to shield the space between the rotary targets RT1 and RT2.
  • the partition 241 prevents the target material sputtered from the rotary target RT1 from accumulating on the rotary target RT2, and prevents the target material sputtered from the rotary target RT2 from accumulating on the rotary target RT1.
  • the first shielding plate 242 is provided between the rotary target RT1 and the substrate holding part 300.
  • the first shielding plate 242 prevents the target material sputtered from the rotary target RT1 from passing through areas other than the slit 244 and depositing on the substrate 310.
  • the second shielding plate 243 is provided between the rotary target RT2 and the substrate holding part 300. The second shielding plate 243 prevents the target material sputtered from the rotary target RT2 from passing through areas other than the slit 245 and depositing on the substrate 310.
  • FIG. 7 a configuration is illustrated in which the partition wall 241, the first shielding plate 242, and the second shielding plate 243 are each provided as separate members, but this configuration is not limited thereto.
  • at least two or more members among the partition wall 241, the first shielding plate 242, and the second shielding plate 243 may be integrally configured.
  • first shielding plate 242 and the second shielding plate 243 may be omitted.
  • the partition wall 241 may be omitted.
  • FIGS. 8A to 8B A sputtering method using a sputtering apparatus 10A according to one embodiment of the present invention will be described with reference to FIGS. 8A to 8B.
  • the configuration of the sputtering apparatus 10A used in this embodiment is the same as that of the sputtering apparatus 10 shown in FIG. 1, so a description thereof will be omitted.
  • MQW multi-quantum well
  • GaN layer gallium nitride layer
  • InGaN layer indium gallium nitride layer
  • FIGS. 8A and 8B are diagrams illustrating a sputtering method according to an embodiment of the present invention.
  • gallium nitride is used as the target 216A
  • indium nitride is used as the target 226A.
  • a GaN layer is formed in a first step
  • an InGaN layer is formed in a second step. The first and second steps are alternately repeated to form an MQW structure in which GaN layers and InGaN layers are alternately stacked.
  • an MQW structure is formed in which InGaN layers and GaN layers are repeatedly stacked on the substrate 310A.
  • the substrate holding part 300A moves in one direction in both the first step and the second step to form each layer, but this method is not limited to this method.
  • the substrate holding part 300A may move back and forth one or more times in each of the first step and the second step.
  • Such a stacked structure can be formed in the same chamber by using the above-mentioned sputtering apparatus 10A and film formation process.
  • the above-mentioned sputtering method can prevent dust and contaminants from adhering between the InGaN layer and the GaN layer. As a result, the interface between the GaN layer and the InGaN layer can be kept clean, thereby realizing a semiconductor device with high mobility and high reliability.
  • Fig. 8C is a diagram for explaining a modified example of the sputtering method according to one embodiment of the present invention. A modified example of the sputtering method according to the present embodiment will be explained using Fig. 8C.
  • Fig. 8C is a diagram showing a step that is an alternative to the second step in Fig. 8B. In the modified example, the first step is the same as the first step described above, and therefore the description will be omitted.
  • FIG. 9 a sputtering method using a sputtering apparatus 10B according to one embodiment of the present invention will be described.
  • the configuration of the sputtering apparatus 10B used in this embodiment is similar to that of the sputtering apparatus 10 shown in FIG. 1, but differs from the sputtering apparatus 10 in that a linear plasma source is provided between the rotary targets RT1 and RT2.
  • the description of the configuration of the sputtering apparatus 10B that is the same as that of the sputtering apparatus 10 of the first embodiment will be omitted, and the configuration that differs from that of the sputtering apparatus 10 will be mainly described.
  • FIGS. 1 to 7 when describing the configuration that is the same as that of the first embodiment, reference will be made to FIGS. 1 to 7, and the alphabet "B" will be added after the reference numerals shown in FIGS. 1 to 7.
  • the sputtering apparatus 10B includes a plasma unit 400B that generates a linear plasma between the rotary targets RT1 and RT2.
  • the plasma unit 400B includes an electrode 410B, a housing 420B, a matching box 430B, and an RF power supply 440B.
  • the electrode 410B is provided inside the housing 420B.
  • the matching box 430B is provided between the RF power supply 440B and the electrode 410B, and functions as a matcher for efficiently sending an RF signal transmitted from the RF power supply 440B to the electrode 410B.
  • a linear plasma region 411B is generated by transmitting the RF signal transmitted from the RF power supply 440B to the electrode 410B.
  • the plasma region 411B extends from the electrode 410B toward the substrate 310B. Particularly, in this embodiment, the plasma region 411B extends toward the position where the trajectory (dotted line) of the target material sputtered from each of the rotary targets RT1, RT2 reaches the substrate 310B.
  • gallium nitride is used as target 216B of rotary target RT1, and indium nitride is used as target 226B.
  • the plasma generated in plasma region 411B is nitrogen plasma.
  • the ratio of nitrogen to gallium in gallium nitride used as target 216B is smaller than the ratio of nitrogen to gallium in the GaN layer to be deposited.
  • the ratio of nitrogen to indium in InN used as target 226B is smaller than the ratio of nitrogen to indium in the InN layer to be deposited.
  • the sputtered target material is nitrided by nitrogen plasma on the surface of substrate 310B, so that GaN and InGaN layers having the desired ratios can be formed.
  • the electrical resistance of the target itself can be reduced.
  • the target functions as a cathode. Therefore, by making the electrical resistance of the target itself small, the film formation rate by sputtering can be increased.
  • Metal targets of gallium and indium may be used as targets 216B and 226B, instead of gallium nitride and indium nitride.
  • a sputtering apparatus 10B may be configured by a rotary target RT1 and a plasma unit 400B.
  • gallium or gallium nitride is used as the target 216B.
  • gallium nitride is used as the target 216B, the ratio of nitrogen to gallium in gallium nitride is smaller than the ratio of nitrogen to gallium in the GaN layer to be formed. This configuration can improve the film formation rate by sputtering the GaN layer.
  • a sputtering method using a sputtering apparatus 10C according to an embodiment of the present invention and a semiconductor device 50C formed by the sputtering method will be described with reference to Figures 11A to 12.
  • the configuration of the sputtering apparatus 10C used in this embodiment is similar to that of the sputtering apparatus 10 shown in Figure 1, but differs from the sputtering apparatus 10 in that a rotary target RT3 is provided in addition to the rotary targets RT1 and RT2.
  • the sputtering apparatus 10C has a rotary target RT3 in addition to the rotary targets RT1 and RT2.
  • the rotary target RT3 includes a support member 230C, a fixing member 231C, a yoke 232C, a central magnet 233C, a peripheral magnet 234C, a backing tube 235C, and a target 236C, similar to the rotary targets RT1 and RT2.
  • the rotary target RT3 is surrounded by a shielding plate 237C.
  • Each of the above members constituting the rotary target RT3 has a shape extending in the Z direction.
  • the rotary target RT3 is disposed apart from the rotary targets RT1 and RT2 in the X direction.
  • the configurations of the rotary target RT3 are similar to those of the rotary targets RT1 and RT2, so detailed description will be omitted.
  • Slit 218C is provided on the rotary target RT2 side of the line perpendicular to the surface of substrate holding part 300C or substrate 310C that passes through the rotation axis of rotary target RT1.
  • Slit 238C is provided on the rotary target RT2 side of the line perpendicular to the surface that passes through the rotation axis of rotary target RT3.
  • Slits 228C and 229C are provided in shielding plate 227C.
  • Slit 228C is provided on the rotary target RT1 side of the line perpendicular to the surface that passes through the rotation axis of rotary target RT2.
  • Slit 229C is provided on the rotary target RT3 side of the line perpendicular to the surface that passes through the rotation axis of rotary target RT2.
  • the positions of the magnets (central magnet 223C and peripheral magnet 224C) of rotary target RT2 are controllable. As shown in Figures 11A and 11B, the position of the magnets when the sputtered target material passes through slit 228C and is deposited on substrate 310C may be referred to as the "first deposition position.” As shown in Figure 11C, the position of the magnets when the sputtered target material passes through slit 229C and is deposited on substrate 310C may be referred to as the "second deposition position.”
  • Sputtering method using sputtering apparatus 10C] 11A to 11C are diagrams for explaining a sputtering method according to an embodiment of the present invention.
  • aluminum nitride (AlN) is used as the target 216C
  • gallium nitride is used as the target 226C
  • magnesium-doped gallium nitride is used as the target 236C. Since magnesium-doped gallium nitride functions as a P-type semiconductor, the gallium nitride layer may be called a "p-GaN layer".
  • a GaN layer is formed in the first step, an AlGaN layer is formed in the second step, and a p-GaN layer is formed in the third step.
  • a HEMT High Electron Mobility Transistor
  • the dopant concentration contained in the material of the target 236C is 1 to 20 times the dopant concentration contained in the thin film formed on the substrate 310C.
  • FIG. 11A illustrates a configuration in which the magnet of the rotary target RT2 is positioned at the first film-forming position, but the magnet may be positioned at the second film-forming position.
  • a p-GaN layer/AlGaN layer/GaN layer are formed by the first to third steps shown in Figures 11A to 11C.
  • the sputtering device 10C according to this embodiment can prevent dust and contaminants from adhering to the interface of a layered structure such as a p-GaN layer/AlGaN layer/GaN layer.
  • the transfer chamber 600D a transfer robot that transfers the substrate 310D is disposed.
  • Gate shutters are disposed between the transfer chamber 600D and each chamber. When the gate shutter is open, the space between adjacent chambers is continuous. When the gate shutter is closed, the space between adjacent chambers is cut off, and the atmosphere of each chamber can be controlled individually.
  • the load lock chamber 660D is a chamber that transfers the substrate 310D in and out between the sputtering apparatus 10D and the outside.
  • the substrate 701D may be, for example, a glass substrate or a quartz substrate.
  • the barrier layer 702D may be, for example, a silicon nitride layer.
  • the buffer layer 703D may be, for example, an aluminum nitride layer.
  • the N-type semiconductor layer 704D may be, for example, a gallium nitride layer doped with silicon.
  • the light-emitting layer 705D may be a laminate in which indium gallium nitride layers and gallium nitride layers are alternately stacked.
  • the P-type semiconductor layer 706D may be, for example, a gallium nitride layer doped with magnesium.
  • the N-type electrode 707D may be a metal such as indium.
  • the P-type electrode 708D may be a metal such as palladium or gold.
  • the barrier layer 702D may be omitted.
  • the light emitting element 70D is manufactured as follows. First, a silicon nitride layer and an aluminum nitride layer are formed in that order on a substrate 701D to form a barrier layer 702D and a buffer layer 703D. Next, a silicon-doped gallium nitride layer is formed on the buffer layer 703D, and then an indium gallium nitride layer and a gallium nitride layer are alternately formed on that, and then a magnesium-doped gallium nitride layer is formed on that to form an N-type semiconductor layer 704D, a light emitting layer 705D, and a P-type semiconductor layer 706D.
  • a photolithography process is used to etch the P-type semiconductor layer 706D, the light-emitting layer 705D, and a portion of the N-type semiconductor layer 704D so that a portion of the N-type semiconductor layer 704D is exposed.
  • a photolithography process is used to form an N-type electrode 707D on the N-type semiconductor layer 704D exposed at the surface.
  • a P-type electrode 708D is formed on the P-type semiconductor layer 706D.
  • a configuration in which the target provided in the sputtering device is a rotary target is exemplified, but a flat target may be used instead of a rotary target.

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Abstract

スパッタリング装置は、基板を保持する基板保持部と、前記基板保持部と対向するように配置された第1ターゲットと、前記基板保持部と対向するように前記第1ターゲットと並んで配置された第2ターゲットと、前記第1ターゲットと前記第2ターゲットとの間に配置された隔壁と、を有する。前記第1ターゲットの任意の位置における第1法線及び前記第2ターゲットの任意の位置における第2法線の各々は、前記基板上の任意の点に接続される。

Description

スパッタリング装置及びスパッタリング方法
 本発明の一実施形態は、スパッタリング装置及びスパッタリング方法に関する。特に、本発明の一実施形態は、ロータリターゲットが用いられたスパッタリング装置及びスパッタリング方法に関する。
 スマートフォン等の中小型表示装置においては、液晶又はOLED(Organic Light Emitting Diode)を用いた表示装置が既に製品化されている。これらのなかでも、自発光型素子であるOLEDを用いたOLED表示装置は、液晶表示装置と比べて、高コントラストでバックライトが不要という利点を有する。しかしながら、OLEDは有機化合物で構成されるため、有機化合物の劣化に起因してOLED表示装置の高信頼性を確保することが難しい。
 近年、次世代表示装置として、回路基板の画素内に微小なLEDチップが実装された、いわゆるマイクロLED表示装置又はミニLED表示装置の開発が進められている。LEDは、OLEDと同様の自発光型素子である。ただし、LEDは、OLEDと異なり、ガリウム(Ga)又はインジウム(In)などを含む安定した無機化合物で構成される。したがって、OLED表示装置と比較すると、マイクロLED表示装置は高信頼性を確保しやすい。さらに、LEDチップは、発光効率が高く、高輝度を実現することができる。したがって、マイクロLED表示装置又はミニLED表示装置は、高信頼性、高輝度、及び高コントラストの次世代表示装置として期待されている。
 ところで、マイクロLEDなどで用いられる窒化ガリウム膜は、一般的には、サファイア基板上に、MOCVD(Metal Organic Chemical Vapor Deposition)又はHVPE(Hydride Vapor Phase Epitaxy)を用いて800℃~1000℃という高温で成膜されている。しかしながら、近年、比較的低温で成膜することができるスパッタリングによる窒化ガリウム膜の成膜方法が開発されている(例えば、特許文献1参照)。
特開2012-119569号公報
 窒化ガリウム膜のマイクロLEDを構成する膜を低温で成膜することができれば、ガラス基板上に直接マイクロLEDを形成することが可能である。マイクロLEDは、組成の異なる複数の膜を積層することで形成される。従来のスパッタリング装置では、組成の異なる膜ごとにターゲット及びチャンバを準備する必要があった。
 本発明の一実施形態は、上記問題に鑑み、新たなスパッタリング装置及びスパッタリング方法を提供することを目的の一つとする。
 本発明の一実施形態に係るスパッタリング装置は、基板を保持する基板保持部と、前記基板保持部と対向するように配置された第1ターゲットと、前記基板保持部と対向するように前記第1ターゲットと並んで配置された第2ターゲットと、前記第1ターゲットと前記第2ターゲットとの間に配置された隔壁と、を有する。前記第1ターゲットの任意の位置における第1法線及び前記第2ターゲットの任意の位置における第2法線の各々は、前記基板上の任意の点に接続される。
 本発明の一実施形態に係るスパッタリング装置は、基板を保持する基板保持部と、前記基板保持部と対向するように配置され、第1ターゲット部材が取り付けられた第1ターゲットと、前記基板保持部と対向するように前記第1ターゲットと並んで配置され、前記第1ターゲット部材とは異なる第2ターゲット部材が取り付けられた第2ターゲットと、を有する。前記第1ターゲット部材は、ガリウムを含む。
 本発明の一実施形態に係るスパッタリング方法は、第1ターゲット及び第2ターゲットに対向する基板保持部に基板を保持し、第1ステップにおいて、前記第1ターゲットに対するプラズマを発生しながら、前記第1ターゲットと前記基板保持部とを相対的に移動させることで、前記基板に前記第1ターゲットの第1材料を成膜し、第2ステップにおいて、前記第2ターゲットに対するプラズマを発生しながら、前記第2ターゲットと前記基板保持部とを相対的に移動させることで、前記基板に前記第2ターゲットの第2材料を成膜することで、前記第1材料と前記第2材料とを含む積層構造体を形成する。
本発明の一実施形態に係るスパッタリング装置の概要を示す図である。 本発明の一実施形態に係るスパッタリング方法を示すフローチャート図である。 本発明の一実施形態に係るスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング方法を用いて製造した半導体装置を示す断面図である。 本発明の一実施形態に係るスパッタリング方法の変形例を示すフローチャート図である。 本発明の一実施形態に係るスパッタリング方法の変形例を説明する図である。 本発明の一実施形態に係るスパッタリング方法の変形例を説明する図である。 本発明の一実施形態に係るスパッタリング装置の変形例の概要を示す図である。 本発明の一実施形態に係るスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング方法の変形例を説明する図である。 本発明の一実施形態に係るスパッタリング装置の概要を示す図である。 本発明の一実施形態に係るスパッタリング装置の変形例の概要を示す図である。 本発明の一実施形態に係るスパッタリング装置の概要及びスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング装置の概要及びスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング装置の概要及びスパッタリング方法を説明する図である。 本発明の一実施形態に係るスパッタリング方法を用いて製造した半導体装置を示す断面図である。 本発明の一実施形態に係るスパッタリング装置の概要を示す図である。 本発明の一実施形態に係るスパッタリング方法を用いて製造した発光素子を示す断面図である。
 以下に、本発明の各実施形態について、図面を参照しつつ説明する。以下の開示はあくまで一例にすぎない。当業者が、発明の主旨を保ちつつ、実施形態の構成を適宜変更することによって容易に想到し得る構成は、当然に本発明の範囲に含有される。図面は説明をより明確にするため、実際の態様に比べ、各部の幅、厚さ、形状等にが模式的に表される場合がある。しかし、図示された形状はあくまで一例であって、本発明の解釈を限定しない。本明細書と各図において、既出の図に関して前述したものと同様の要素には、同一の符号を付して、詳細な説明を適宜省略することがある。
 本発明の各実施の形態において、第1部材から第2部材に向かう方向を上又は上方という。逆に、第2部材から第1部材に向かう方向を下又は下方という。このように、説明の便宜上、上方又は下方という語句を用いて説明するが、例えば、第1部材と第2部材との上下関係が図示と逆になるように配置されてもよい。以下の説明で、例えば第1部材上の第2部材という表現は、上記のように第1部材と第2部材との上下関係を説明しているに過ぎず、第1部材と第2部材との間に他の部材が配置されていてもよい。上方又は下方は、複数の層が積層された構造における積層順を意味するものであり、第1部材の上方の第2部材と表現する場合、平面視において、第1部材と第2部材とが重ならない位置関係であってもよい。一方、第1部材の鉛直上方の第2部材と表現する場合は、平面視において、第1部材と第2部材とが重なる位置関係を意味する。
 本明細書において、「膜」という用語と、「層」という用語とは、場合により、互いに入れ替えることができる。
 本明細書において「αはA、B又はCを含む」、「αはA、B及びCのいずれかを含む」、「αはA、B及びCからなる群から選択される一つを含む」、といった表現は、特に明示が無い限り、αがA~Cの複数の組み合わせを含む場合を排除しない。さらに、これらの表現は、αが他の要素を含む場合も排除しない。
 なお、以下の各実施形態は、技術的な矛盾を生じない限り、互いに組み合わせることができる。
[1.第1実施形態]
 図1~図4を参照して、本発明の一実施形態に係るスパッタリング装置10、スパッタリング装置10を用いたスパッタリング方法、及び当該スパッタリング方法によって形成された半導体装置20について説明する。
[1-1.スパッタリング装置10の構成]
 図1は、本発明の一実施形態に係るスパッタリング装置の概要を示す図である。図1は、スパッタリング装置10を上方から見た図である。図1に示すように、スパッタリング装置10は、チャンバ100、ターゲット部200、及び基板保持部300を有する。図1では、チャンバ100の一部が示されている。チャンバ100は閉空間を構成する。図示しないが、チャンバ100には排気口及びプロセスガス供給口が設けられている。排気口を介してチャンバ100内を減圧することができる。プロセスガス供給口を介してチャンバ100内にスパッタリングに必要なアルゴンや窒素などのガスを供給することができる。基板保持部300に被成膜対象である基板310が保持される。図1の例では、基板310は、基板310の主面がX軸方向及びZ軸方向に拡がるように基板保持部300に保持される。換言すると、基板310は縦置きの状態で基板保持部300に保持される。
 ターゲット部200は、基板保持部300と対向するように並んで配置されたロータリターゲットRT1、RT2を含む。ロータリターゲットRT1、RT2は、それぞれ支持部材210、220、固定部材211、221、ヨーク212、222、中央磁石213、223、周辺磁石214、224、バッキングチューブ215、225、及びターゲット216、226を含む。ロータリターゲットRT1、RT2は、遮蔽板217、227によって囲まれている。ロータリターゲットRT1、RT2を構成する上記の各部材はZ方向に延びる形状を有している。ロータリターゲットRT1、RT2はX方向に離隔して配置されている。ロータリターゲットRT1を「第1ターゲット」という場合がある。ロータリターゲットRT2を「第2ターゲット」という場合がある。
 支持部材210、220は、チャンバ100に対して回動可能に固定されている。固定部材211、221は、支持部材210、220に接続され、支持部材210、220からバッキングチューブ215、225に向かって延びている。固定部材211、221の端部にヨーク212、222が固定されている。中央磁石213、223及び周辺磁石214、224は、ヨーク212、222に固定されており、ヨーク212、222からバッキングチューブ215、225に向かって延びている。中央磁石213、223及び周辺磁石214、224のバッキングチューブ215、225側の端部は、バッキングチューブ215、225の内壁に沿って湾曲した形状を有している。
 中央磁石213、223及び周辺磁石214、224は、Z方向に延びた直線形状を有している。中央磁石213、223及び周辺磁石214、224は、支持部材210、220を中心としてバッキングチューブ215、225の内壁に沿って回動する。支持部材210、220は、固定部材211、221に固定され、中央磁石213、223及び周辺磁石214、224とともに回動する。ただし、支持部材210、220がチャンバ100に対して回動せずに固定されていてもよい。この場合、固定部材211、221は支持部材210、220に対して回動可能に接続される。
 ターゲット216、226はバッキングチューブ215、225に固定されている。バッキングチューブ215、225及びターゲット216、226は、Z方向に延びる軸を中心とした円筒形状を有しており、支持部材210、220を中心として回動する。ターゲット216、226は、中央磁石213、223及び周辺磁石214、224とは独立して回動する。以下の説明において、中央磁石213及び周辺磁石214を特に区別しない場合、かつ中央磁石223及び周辺磁石224を特に区別しない場合、これらを単に「磁石」という場合がある。
 図1に示すように、基板310に対して成膜可能な磁石の位置を「成膜位置」という場合がある。つまり、磁石の位置が成膜位置である場合、ロータリターゲットRT1、RT2に対して発生するプラズマ領域PLSは、後述するスリット218、228を介して遮蔽板217、227の外に拡がっている。一方、基板310に対して成膜不可能な磁石の位置を「非成膜位置」という場合がある。つまり、磁石の位置が非成膜位置である場合、ロータリターゲットRT1、RT2に対して発生するプラズマ領域PLSは、遮蔽板217、227によって遮蔽され、その外に拡がらない。
 ターゲット216、226として、ガリウム、窒化ガリウム、アルミニウム、窒化アルミニウム、インジウム、窒化インジウム、シリコン、及び窒化シリコンが用いられる。ターゲット216、226として、上記の材料に対して不純物(ドーパント)が導入された材料が用いられてもよい。例えば、窒化ガリウムに対してマグネシウム又はシリコンがドーパントとして導入された材料が用いられてもよい。ドーパントとしてマグネシウムを含む窒化ガリウムはP型半導体として機能する。ドーパントとしてシリコンを含む窒化ガリウムはN型半導体として機能する。
 ターゲット216とターゲット226とは異なる材料である。例えば、ターゲット216として窒化ガリウムが用いられ、ターゲット226として窒化アルミニウムが用いられる。又は、ターゲット216として窒化ガリウムが用いられ、ターゲット226として窒化インジウムが用いられる。又は、ターゲット216として真性の窒化ガリウムが用いられ、ターゲット226としてドーパントが導入された窒化ガリウムが用いられる。真性とは、意図的にドーパントが導入されていないことを意味する。
 中央磁石213、223は周辺磁石214、224と異なる極性を有する。つまり、これらの磁石によって中央磁石213、223から周辺磁石214、224に向かう(又はその逆に向かう)磁場が形成される。この磁場によってプラズマ中の電子が閉じ込められるため、中央磁石213、223と周辺磁石214、224との間に対応する領域に高濃度のプラズマ領域PLSが形成される。プラズマ領域PLSでは、プロセスガスとして導入されたアルゴンがイオン化される。イオン化したアルゴンは、プラズマ領域PLSとターゲット216との間、及びプラズマ領域PLSとターゲット226との間に形成されたシース領域において、ターゲット216、226に向かって加速される。このように加速されたアルゴンがターゲット216、226に衝突することで、ターゲット材料がスパッタリングされる。
 上記のように、スパッタリングされたターゲット材料は、ターゲット216、226の表面からプラズマ領域PLSに向かって飛来する。図1において、ターゲット216、226の表面からプラズマ領域PLSを通過して基板310に達する点線は、スパッタリングされるターゲット材料の軌跡である。上記のスパッタリングによって、当該点線が基板310に達する位置を中心として、基板310にターゲット材料が堆積する。支持部材210、220のそれぞれの中心は、当該点線の延長線上に位置している。つまり、当該点線は、ターゲット216、226の任意の表面における法線である。ターゲット216から基板310に向かって延びる点線を「第1法線」という場合がある。ターゲット226から基板310に向かって延びる点線を「第2法線」という場合がある。第1法線及び第2法線の各々は、基板310上の任意の点に接続されている。換言すると、ターゲット216、226は、これらからスパッタリングされたターゲット材料が基板310の同じ点に成膜されるように配置されている。
 遮蔽板217、227にはスリット218、228が設けられている。遮蔽板217、227は、スリット218、228が設けられた領域を除きターゲット216、226の周囲を連続して囲んでいる。スリット218は、基板保持部300又は基板310の表面に対する垂線のうちロータリターゲットRT1の回転軸を通る線よりロータリターゲットRT2側に設けられている。スリット228は、基板保持部300又は基板310の表面に対する垂線のうちロータリターゲットRT2の回転軸を通る線よりロータリターゲットRT1側に設けられている。
 遮蔽板217、227のうち、ロータリターゲットRT1とRT2との間に挟まれた部分は、ロータリターゲットRT1からスパッタリングされたターゲット材料がロータリターゲットRT2に堆積することを抑制する隔壁として機能し、ロータリターゲットRT2からスパッタリングされたターゲット材料がロータリターゲットRT1に堆積することを抑制する隔壁として機能する。隔壁として機能する部分は、ロータリターゲットRT1とRT2とによって挟まれる空間を遮蔽するように設けられる。
 遮蔽板217のうち、ロータリターゲットRT1と基板保持部300(又は、基板310)との間に位置する部分は、ロータリターゲットRT1からスパッタリングされたターゲット材料がスリット218以外の領域を通過して基板310に堆積することを抑制する。当該部分を「第1遮蔽板」という場合がある。遮蔽板227のうち、ロータリターゲットRT2と基板保持部300(又は、基板310)との間に位置する部分は、ロータリターゲットRT2からスパッタリングされたターゲット材料がスリット228以外の領域を通過して基板310に堆積することを抑制する。当該部分を「第2遮蔽板」という場合がある。
 上記のように表現する場合、第1遮蔽板は、遮蔽板217のうち、基板保持部300の表面と平行に延びる部分に相当する。第2遮蔽板は、遮蔽板227のうち、基板保持部300の表面と平行に延びる部分に相当する。隔壁は、遮蔽板217、227のうち、ロータリターゲットRT1とRT2との間で、基板保持部300又は基板310の表面に対する垂線と同じ方向に延びる部分の両方又は一方に相当する。この場合、第1遮蔽板及び第2遮蔽板は、隔壁に接続されているということができる。
 基板保持部300は、移動機構320によって矢印の方向に移動する。移動機構320として、例えば、基板保持部300に接するローラが設けられる。ただし、移動機構320は基板310を保持した状態の基板保持部300を矢印の方向に移動することができればよく、図1の構成に限定されない。本実施形態では、基板保持部300がターゲット部200に対して移動する構成を例示したが、この構成に限定されない。例えば、基板保持部300の位置が固定され、ターゲット部200が基板保持部300に対して移動してもよい。つまり、基板保持部300がターゲット部200に対して相対的に移動することができる。
[1-2.スパッタリング装置10を用いたスパッタリング方法]
 図2は、本発明の一実施形態に係るスパッタリング方法を示すフローチャート図である。図3A及び図3Bは、本発明の一実施形態に係るスパッタリング方法を説明する図である。これらの図面を用いて、スパッタリング装置10を用いたスパッタリング方法について説明する。図3A及び図3Bでは、チャンバ100が省略されている。
 まず、基板310がチャンバ内に誘導され、基板保持部300に保持される(ステップS301;基板支持部における基板の保持)。続いて、真空ポンプなどを用いた真空引きによってチャンバ内が減圧され、チャンバ内にプロセスガスが導入される(ステップS302;プロセスガスの導入)。プロセスガスの導入後に、ロータリターゲットRT1に電力が供給され、図3Aに示すようにロータリターゲットRT1に対してプラズマが発生する(ステップS303;第1RTへのプラズマON)。このとき、ロータリターゲットRT2には電力が供給されないため、ロータリターゲットRT2に対するプラズマは発生しない(ステップS303;第2RTへのプラズマOFF)。この状態で、図3Aに示すように、基板310を保持した基板保持部300を矢印の方向に移動する(ステップS304;基板移動)。ステップS304によって、基板310にはロータリターゲットRT1に装着されたターゲット216の材料(第1材料)が成膜される。
 基板保持部300が図3Aの矢印の方向に移動し、基板310の成膜領域の端部まで成膜が完了すると、基板保持部300は矢印の逆方向に移動する。逆方向への移動の際に上記の成膜を継続してもよく、プラズマを停止して成膜を行わなくてもよい。
 上記の逆方向への移動が完了すると、ロータリターゲットRT1、RT2の両方に電力が供給され、図3Bに示すようにロータリターゲットRT1、RT2に対してプラズマが発生する(ステップS305;第1RTへのプラズマON、第2RTへのプラズマON)。この状態で、基板310を保持した基板保持部300を矢印の方向に移動する(ステップS306;基板移動)。ステップS305、S306によって、基板310にはロータリターゲットRT1、RT2に装着されたターゲット216の材料及びターゲット226の材料(第2材料)が成膜される。その結果、基板310にはターゲット216、226の材料によって構成される化合物が成膜される。
 ロータリターゲットRT1、RT2への電力供給を停止し、これらに対して発生していたプラズマを停止し(ステップS307;第1RTへのプラズマOFF、第2RTへのプラズマOFF)、プロセスガスの供給を停止することで、上記の成膜プロセスは終了する。
 上記のスパッタリング方法では、ステップS305でロータリターゲットRT1、RT2の両方に対してプラズマを発生させ、基板310にターゲット216、226の各々の材料を成膜する構成を例示したが、この構成に限定されない。例えば、ロータリターゲットRT1に対するプラズマを発生させず、ロータリターゲットRT2に対するプラズマのみを発生させることで、ターゲット226の材料のみを基板310に成膜してもよい。
[1-3.半導体装置の製造方法]
 図4は、本発明の一実施形態に係るスパッタリング方法を用いて製造した半導体装置を示す断面図である。ターゲット216として窒化ガリウムが用いられ、ターゲット226として窒化アルミニウムが用いられた場合に、上記の成膜プロセスを行うことで、図4に示すような半導体装置20を製造することができる。
 上記の構成で、図2のステップS303、S304、及び図3Aに示す成膜を行うと、基板310には窒化ガリウム層(GaN層)が成膜される。続いて、図2のステップS305、S306、及び図3Bに示す成膜を行うと、基板310にはドーパントとしてアルミニウムが導入された窒化ガリウム層(窒化アルミニウムガリウム層;AlGaN層)が成膜される。上記の成膜によって、基板310の上には、AlGaN層/GaN層の積層が形成される。つまり、同一のチャンバ内で窒化ガリウム層の成膜及び窒化アルミニウムガリウム層の成膜を連続して行うことができる。
 上記の成膜プロセスを用いて形成された半導体装置の一例が、図4の半導体装置20である。図4に示すように、半導体装置20は、基板310の上に形成されている。半導体装置20は、第1窒化ガリウム層330、第2窒化ガリウム層340、ゲート絶縁層350、ゲート電極360、ソース電極370、及びドレイン電極380を有する。
 第1窒化ガリウム層330として、真性のGaN層が形成される。第2窒化ガリウム層340としてAlGaN層が形成される。第1窒化ガリウム層330は半導体装置20のチャネルとして機能する。ゲート絶縁層350として、酸化アルミニウムが形成される。ゲート電極360、ソース電極370、及びドレイン電極380として、例えばアルミニウム、チタン、モリブデンなどの一般的な金属材料が形成される。
 上記のスパッタリング装置10及び成膜プロセスを用いることで、異なる組成の層を同一のチャンバ内で成膜し、積層構造体を形成することができる。例えば、第2窒化ガリウム層340/第1窒化ガリウム層330として、AlGaN層/GaN層を同一チャンバ100で連続して成膜することができる。したがって、第1窒化ガリウム層330と第2窒化ガリウム層340との界面(AlGaN層/GaN層の界面)にゴミや汚染物質が付着することを抑制することができる。その結果、AlGaN層/GaN層の界面を清浄に保つことができるため、高い移動度かつ高い信頼性を備えた半導体装置20を実現することができる。
[1-4.スパッタリング方法の変形例1]
 図5は、本発明の一実施形態に係るスパッタリング方法の変形例を示すフローチャート図である。図6A及び図6Bは、本発明の一実施形態に係るスパッタリング方法の変形例を説明する図である。これらの図面を用いて、スパッタリング装置10を用いたスパッタリング方法の変形例について説明する。図6A及び図6Bでは、チャンバ100が省略されている。
 図5において、ステップS501、S502は、図2のステップS201、S202と同じなので、説明を省略する。ステップS502におけるプロセスガスの導入後に、図6Aに示すように、ロータリターゲットRT1の磁石(中央磁石213及び周辺磁石214)の位置を成膜位置に制御し(ステップS503;第1RTの磁石を成膜位置に制御)、ロータリターゲットRT2の磁石(中央磁石223及び周辺磁石224)の位置を非成膜位置に制御する(ステップS503;第2RTの磁石を非成膜位置に制御)。この状態で、ロータリターゲットRT1、RT2に電力が供給され、両者に対してプラズマが発生する(ステップS504;第1RTへのプラズマON、第2RTへのプラズマON)。
 上記のステップによって、図6Aに示すようにロータリターゲットRT1、RT2の両方に対してプラズマが発生するが、ターゲット216からスパッタリングされたターゲット材料のみが基板310に成膜される。ターゲット226からスパッタリングされたターゲット材料は、基板310とは逆の方向に向かい、かつ遮蔽板227によって遮蔽されるため、当該ターゲット材料は基板310に成膜されない。換言すると、ロータリターゲットRT1に含まれる磁石を制御することによってスリット218が設けられた位置にプラズマが発生し、ロータリターゲットRT2に含まれる磁石を制御することによってスリット228が設けられていない位置にプラズマが発生する。この状態で、基板310を保持した基板保持部300が矢印の方向に移動する(ステップS505;基板移動)。ステップS505によって、基板310にはロータリターゲットRT1に装着されたターゲット216の材料のみが成膜される。
 基板保持部300が図6Aの矢印の方向に移動し、基板310の成膜領域の端部まで成膜が完了すると、基板保持部300は矢印の逆方向に移動する。逆方向への移動の際に上記の成膜を継続してもよく、プラズマを停止して成膜を行わなくてもよい。
 逆方向への移動が完了すると、逆方向への移動の際に成膜を行っていた場合はロータリターゲットRT1、RT2への電力供給を停止し(ステップS506;第1RTへのプラズマOFF、第2RTへのプラズマOFF)、図6Bに示すように、ロータリターゲットRT1、RT2の両方の磁石の位置を成膜位置に制御する(ステップS507;第1RTの磁石を成膜位置に制御、第2RTの磁石を成膜位置に制御)。この状態で、ロータリターゲットRT1、RT2に電力が供給され、両者に対してプラズマが発生する(ステップS508;第1RTへのプラズマON、第2RTへのプラズマON)。換言すると、ロータリターゲットRT1、RT2に含まれる磁石を制御することによってスリット218、228が設けられた位置にプラズマが発生する。この状態で、基板310を保持した基板保持部300を矢印の方向に移動する(ステップS509;基板移動)。ステップS508、S509によって、基板310にはロータリターゲットRT1、RT2に装着されたターゲット216、226の材料が成膜される。その結果、基板310にはターゲット216、226の材料によって構成される化合物が成膜される。
 ロータリターゲットRT1、RT2への電力供給を停止し、これらに対して発生していたプラズマを停止し(ステップS510;第1RTへのプラズマOFF、第2RTへのプラズマOFF)、プロセスガスの供給を停止することで、上記の成膜プロセスは終了する。
 上記の変形例に係るスパッタリング方法であっても、第1実施形態に係るスパッタリング方法と同様に、同一のチャンバ100内で組成の異なる層を連続して成膜することができる。
[1-5.スパッタリング方法の変形例2]
 上記のスパッタリング装置10及び成膜プロセスを用いることで、成膜される膜中に含まれるドーパント濃度を調整する方法について説明する。上記のように、ターゲット216として窒化ガリウムが用いられ、ターゲット226として窒化アルミニウムが用いられた場合、ロータリターゲットRT1、RT2に供給される電力を調整することで、AlGaN層におけるドーパント濃度(アルミニウム濃度)を調整することができる。具体的には、ロータリターゲットRT1に供給される電力に対してロータリターゲットRT2に供給される電力を相対的に小さくすることによって、AlGaN層におけるアルミニウム濃度を低くすることができる。逆に、ロータリターゲットRT1に供給される電力に対してロータリターゲットRT2に供給される電力を相対的に大きくすることによって、AlGaN層におけるアルミニウム濃度を高くすることができる。
 上記の構成を換言すると、ターゲット226として用いられる材料は、ターゲット216として用いられる材料よりも多くのドーパントを含む。ロータリターゲットRT1に対してプラズマを発生させる電力とロータリターゲットRT2に対してプラズマを発生させる電力との比率を調整することで、基板310に形成される薄膜に含まれるドーパントの濃度を調整する。ターゲット226としてマグネシウム又はシリコンが導入された窒化ガリウムが用いられてもよい。例えば、ターゲット226の材料に含まれるドーパント濃度は、基板310に成膜される薄膜に含まれるドーパント濃度の1倍以上20倍以下であってもよい。
[1-6.スパッタリング装置の変形例]
 図7は、本発明の一実施形態に係るスパッタリング装置の変形例の概要を示す図である。図7に示すスパッタリング装置10は、図1に示すスパッタリング装置10と類似しているが、遮蔽板の構成が図1のスパッタリング装置10とは異なる。それ以外の図7の構成は、図1と同じなので、説明を省略する。
 図7に示すように、遮蔽板240は、隔壁241、第1遮蔽板242、及び第2遮蔽板243を有する。第1遮蔽板242には、図1のスリット218と同じ位置にスリット244が設けられている。第2遮蔽板243には、図1のスリット228と同じ位置にスリット245が設けられている。
 隔壁241は、ロータリターゲットRT1とRT2との間に設けられている。隔壁241は、ロータリターゲットRT1とRT2とによって挟まれる空間を遮蔽するように設けられている。隔壁241は、ロータリターゲットRT1からスパッタリングされたターゲット材料がロータリターゲットRT2に堆積することを抑制し、ロータリターゲットRT2からスパッタリングされたターゲット材料がロータリターゲットRT1に堆積することを抑制する。
 第1遮蔽板242は、ロータリターゲットRT1と基板保持部300との間に設けられている。第1遮蔽板242は、ロータリターゲットRT1からスパッタリングされたターゲット材料がスリット244以外の領域を通過して基板310に堆積することを抑制する。第2遮蔽板243は、ロータリターゲットRT2と基板保持部300との間に設けられている。第2遮蔽板243は、ロータリターゲットRT2からスパッタリングされたターゲット材料がスリット245以外の領域を通過して基板310に堆積することを抑制する。
 図7では、隔壁241、第1遮蔽板242、及び第2遮蔽板243がそれぞれ個別の部材として設けられた構成が例示されているが、この構成に限定されない。例えば、隔壁241、第1遮蔽板242、及び第2遮蔽板243のうち、少なくとも2以上の部材が一体で構成されていてもよい。
 上記の変形例に係るスパッタリング装置であっても、第1実施形態に係るスパッタリング装置と同様に、同一のチャンバ100内で組成の異なる層を連続して成膜することができる。なお、第1遮蔽板242及び第2遮蔽板243は省略されてもよい。又は、隔壁241が省略されていてもよい。
[2.第2実施形態]
 図8A~図8Bを参照して、本発明の一実施形態に係るスパッタリング装置10Aを用いたスパッタリング方法について説明する。本実施形態で用いられるスパッタリング装置10Aの構成は、図1に示すスパッタリング装置10と同じなので、説明を省略する。本実施形態では、スパッタリング装置10Aを用いて、窒化ガリウム層(GaN層)及び窒化インジウムガリウム層(InGaN層)の多重量子井戸(MQW:multi quantum well)構造を形成する実施形態について説明する。以下の説明において、スパッタリング装置10Aの構成のうち第1実施形態のスパッタリング装置10と同様の構成の説明を省略し、主にスパッタリング装置10と相違する構成について説明する。以下の説明において、第1実施形態と同様の構成について説明をする場合、図1~7を参照し、図1~7に示された符号の後にアルファベット“A”を付して説明する。
[2-1.スパッタリング装置10Aを用いたスパッタリング方法]
 図8A~図8Bは、本発明の一実施形態に係るスパッタリング方法を説明する図である。本実施形態では、ターゲット216Aとして窒化ガリウムが用いられ、ターゲット226Aとして窒化インジウムが用いられる。以下のスパッタリング方法では、第1ステップにおいてGaN層が形成され、第2ステップにおいてInGaN層が形成される。第1ステップと第2ステップとが交互に繰り返されることによって、GaN層とInGaN層とが交互に積層されたMQW構造が形成される。
 図8Aに示すように、ロータリターゲットRT1、RT2の両方に対して電力を供給することで、これらに対するプラズマが発生する。ロータリターゲットRT1からは窒化ガリウムがスパッタリングされ、ロータリターゲットRT2からはInNがスパッタリングされる。その結果、基板310AにはInGaN層が成膜される。この状態で、基板保持部300Aが矢印の方向に移動することによって、基板310Aの全体に対してInGaN層が成膜される。InGaN層を成膜する膜厚に応じて、ロータリターゲットRT1、RT2に供給される電力及び基板保持部300Aの移動速度が調整される。上記の動作を「第1ステップ」という場合がある。
 図8Aの動作で所望の膜厚のInGaN層を成膜した後に、図8Bに示すように、ロータリターゲットRT1に対して電力を供給した状態でロータリターゲットRT2に対する電力の供給を停止することで、ロータリターゲットRT1のみにプラズマが発生する。ロータリターゲットRT2からInNはスパッタリングされず、ロータリターゲットRT1のみから窒化ガリウムがスパッタリングされる。その結果、基板310AにはGaN層が成膜される。この状態で、基板保持部300Aが矢印の方向に移動することによって、基板310Aの全体に対してGaN層が成膜される。GaN層を成膜する膜厚に応じて、ロータリターゲットRT1に供給される電力及び基板保持部300Aの移動速度が調整される。上記の動作を「第2ステップ」という場合がある。
 上記の第1ステップと第2ステップとを繰り返すことによって、基板310Aの上にInGaN層とGaN層とが繰り返し積層されたMQW構造が形成される。
 本実施形態では、第1ステップ及び第2ステップはともに基板保持部300Aが一方向に移動することで各層を成膜する方法を例示したが、この方法に限定されない。例えば、一方向への移動だけでは所望の膜厚を得ることができない場合、第1ステップ及び第2ステップのそれぞれにおいて基板保持部300Aが一往復以上移動してもよい。
 複数の異なる層を繰り返し積層する必要がある場合であっても、上記のスパッタリング装置10A及び成膜プロセスを用いることで、そのような積層構造を同一のチャンバ内で成膜することができる。上記のスパッタリング方法によって、InGaN層とGaN層との間にゴミや汚染物質が付着することを抑制することができる。その結果、GaN層/InGaN層の界面を清浄に保つことができるため、高い移動度かつ高い信頼性を備えた半導体装置を実現することができる。
[2-2.スパッタリング方法の変形例]
 図8Cは、本発明の一実施形態に係るスパッタリング方法の変形例を説明する図である。図8Cを用いて、本実施形態に係るスパッタリング方法の変形例について説明する。図8Cは、図8Bの第2ステップの代替となるステップを示す図である。変形例において、第1ステップは上記の第1ステップと同じなので、説明を省略する。
 変形例では、図8Cに示すように、ロータリターゲットRT2の磁石(中央磁石223A及び周辺磁石224A)の位置を非成膜位置に制御した状態で、ロータリターゲットRT1、RT2の両方に対して電力を供給する。この場合、ロータリターゲットRT2からスパッタリングされたInNは遮蔽板227Aによって遮蔽されるため、InNは基板310Aに成膜されない。その結果、基板310AにはGaN層のみが成膜される。
[3.第3実施形態]
 図9を参照して、本発明の一実施形態に係るスパッタリング装置10Bを用いたスパッタリング方法について説明する。本実施形態で用いられるスパッタリング装置10Bの構成は、図1に示すスパッタリング装置10と類似しているが、ロータリターゲットRT1とRT2との間にライン状プラズマソースが設けられている点においてスパッタリング装置10と相違する。以下の説明において、スパッタリング装置10Bの構成のうち第1実施形態のスパッタリング装置10と同様の構成の説明を省略し、主にスパッタリング装置10と相違する構成について説明する。以下の説明において、第1実施形態と同様の構成について説明をする場合、図1~7を参照し、図1~7に示された符号の後にアルファベット“B”を付して説明する。
[3-1.スパッタリング装置10Bの構成]
 図9に示すように、スパッタリング装置10Bは、ロータリターゲットRT1とRT2との間にライン状プラズマを生成するプラズマユニット400Bを備えている。プラズマユニット400Bは、電極410B、筐体420B、マッチングボックス430B、及びRF電源440Bを有する。電極410Bは筐体420Bの内部に設けられている。マッチングボックス430BはRF電源440Bと電極410Bとの間に設けられており、RF電源440Bから送信されたRF信号を効率よく電極410Bに送るための整合器として機能する。RF電源440Bから送信されたRF信号が電極410Bに伝達されることによって、線状のプラズマ領域411Bが生成される。プラズマ領域411Bは、電極410Bから基板310Bに向かって延びている。特に、本実施形態では、プラズマ領域411Bは、ロータリターゲットRT1、RT2の各々からスパッタリングされるターゲット材料の軌跡(点線)が基板310Bに達する位置に向かって延びている。
 図9の場合、例えば、ロータリターゲットRT1のターゲット216Bとして窒化ガリウムが用いられ、ターゲット226Bとして窒化インジウムが用いられる。さらに、プラズマ領域411Bに生成されるプラズマは窒素プラズマである。この場合、ターゲット216Bとして用いられる窒化ガリウムのガリウムに対する窒素の比率は、成膜されるGaN層におけるガリウムに対する窒素の比率よりも小さい。同様に、ターゲット226Bとして用いられるInNのインジウムに対する窒素の比率は、成膜されるInN層におけるインジウムに対する窒素の比率より小さい。このような組成のターゲットを用いた場合であっても、スパッタリングされたターゲット材料は基板310Bの表面で窒素プラズマによって窒化されるため、所望の比率を有するGaN層及びInGaN層を形成することができる。
 上記のように、ターゲット216B、226Bにおいて、ガリウム、インジウムに対する窒素の比率を相対的に小さくすることで、ターゲット自体の電気抵抗を小さくすることができる。スパッタリング装置では、ターゲットは陰極として機能する。したがって、ターゲット自体の電気抵抗を小さくすることで、スパッタリングによる成膜レートを上げることができる。ターゲット216B、226Bとして、窒化ガリウム、窒化インジウムではなく、ガリウム、インジウムの金属ターゲットを用いてもよい。
 上記の構成によって、図8A~図8Bと同様のスパッタリング方法を実行することができる。したがって、本実施形態によって、第2実施形態と同様の効果を得ることができる。
[3-2.スパッタリング装置の変形例]
 図10は、本発明の一実施形態に係るスパッタリング装置の変形例の概要を示す図である。図10に示すように、ロータリターゲットRT1及びプラズマユニット400Bによってスパッタリング装置10Bが構成されていてもよい。例えば、ターゲット216Bとして、ガリウム又は窒化ガリウムが用いられる。ターゲット216Bとして窒化ガリウムが用いられる場合、窒化ガリウムのガリウムに対する窒素の比率は、成膜されるGaN層におけるガリウムに対する窒素の比率より小さい。この構成によって、GaN層のスパッタリングによる成膜レートを向上させることができる。
[4.第4実施形態]
 図11A~図12を参照して、本発明の一実施形態に係るスパッタリング装置10Cを用いたスパッタリング方法、及び当該スパッタリング方法によって形成された半導体装置50Cについて説明する。本実施形態で用いられるスパッタリング装置10Cの構成は、図1に示すスパッタリング装置10と類似しているが、ロータリターゲットRT1、RT2に加えてロータリターゲットRT3が設けられている点においてスパッタリング装置10と相違する。以下の説明において、スパッタリング装置10Cの構成のうち第1実施形態のスパッタリング装置10と同様の構成の説明を省略し、主にスパッタリング装置10と相違する構成について説明する。以下の説明において、第1実施形態と同様の構成について説明をする場合、図1~7を参照し、図1~7に示された符号の後にアルファベット“C”を付して説明する。
[4-1.スパッタリング装置10Cの構成]
 図11Aに示すように、スパッタリング装置10Cは、ロータリターゲットRT1、RT2に加えてロータリターゲットRT3を有している。ロータリターゲットRT3は、ロータリターゲットRT1、RT2と同様に、支持部材230C、固定部材231C、ヨーク232C、中央磁石233C、周辺磁石234C、バッキングチューブ235C、及びターゲット236Cを含む。ロータリターゲットRT3は、遮蔽板237Cによって囲まれている。ロータリターゲットRT3を構成する上記の各部材はZ方向に延びる形状を有している。ロータリターゲットRT3は、ロータリターゲットRT1、RT2からX方向に離隔して配置されている。ロータリターゲットRT3の各構成はロータリターゲットRT1、RT2の各構成と同様なので詳細な説明は省略する。
 スリット218Cは、基板保持部300C又は基板310Cの表面に対する垂線のうちロータリターゲットRT1の回転軸を通る線よりロータリターゲットRT2側に設けられている。スリット238Cは、当該表面に対する垂線のうちロータリターゲットRT3の回転軸を通る線よりロータリターゲットRT2側に設けられている。遮蔽板227Cには、スリット228C、229Cが設けられている。スリット228Cは、当該表面に対する垂線のうちロータリターゲットRT2の回転軸を通る線よりロータリターゲットRT1側に設けられている。スリット229Cは、当該表面に対する垂線のうちロータリターゲットRT2の回転軸を通る線よりロータリターゲットRT3側に設けられている。
 ロータリターゲットRT2の磁石(中央磁石223C及び周辺磁石224C)の位置は制御可能である。図11A及び図11Bに示すように、スパッタリングされたターゲット材料がスリット228Cを通過して基板310Cに成膜される場合の当該磁石の位置を「第1成膜位置」という場合がある。図11Cに示すように、スパッタリングされたターゲット材料がスリット229Cを通過して基板310Cに成膜される場合の当該磁石の位置を「第2成膜位置」という場合がある。
[4-2.スパッタリング装置10Cを用いたスパッタリング方法]
 図11A~図11Cは、本発明の一実施形態に係るスパッタリング方法を説明する図である。本実施形態では、ターゲット216Cとして窒化アルミニウム(AlN)が用いられ、ターゲット226Cとして窒化ガリウムが用いられ、ターゲット236Cとしてマグネシウムがドーピングされた窒化ガリウムが用いられる。マグネシウムがドーピングされた窒化ガリウムはP型の半導体として機能するため、当該窒化ガリウム層を「p-GaN層」という場合がある。以下のスパッタリング方法では、第1ステップにおいてGaN層が形成され、第2ステップにおいてAlGaN層が形成され、第3ステップにおいてp-GaN層が形成される。第1ステップ~第3ステップが実行されることによって、後述する図12に示すHEMT(High Electron Mobility Transistor)を形成することができる。ターゲット236Cの材料に含まれるドーパント濃度は、基板310Cに成膜される薄膜に含まれるドーパント濃度の1倍以上20倍以下である。
 図11Aに示すように、ロータリターゲットRT2に対して電力が供給されてプラズマが発生する。ロータリターゲットRT2からは窒化ガリウムがスパッタリングされる。その結果、基板310AにはGaN層が成膜される。この状態で、基板保持部300Cが矢印の方向に移動することによって、基板310Cの全体に対してGaN層が成膜される。GaN層を成膜する膜厚に応じて、ロータリターゲットRT2に供給される電力及び基板保持部300Cの移動速度が調整される。上記の動作を「第1ステップ」という場合がある。図11Aでは、ロータリターゲットRT2の磁石の位置が第1成膜位置である構成を例示したが、当該磁石の位置は第2成膜位置であってもよい。
 図11Aの動作で所望の膜厚のGaN層を成膜した後に、図11Bに示すように、ロータリターゲットRT1、RT2の両方に対して電力を供給することで、これらに対するプラズマが発生する。この場合において、ロータリターゲットRT2の磁石の位置は第1成膜位置である。ロータリターゲットRT1からは窒化アルミニウムがスパッタリングされ、ロータリターゲットRT2からは窒化ガリウムがスパッタリングされる。その結果、基板310CにはAlGaN層が成膜される。この状態で、基板保持部300Cが矢印の方向に移動することによって、基板310Cの全体に対してAlGaN層が成膜される。AlGaN層を成膜する膜厚に応じて、ロータリターゲットRT1、RT2に供給される電力及び基板保持部300Cの移動速度が調整される。上記の動作を「第2ステップ」という場合がある。
 図11Bの動作で所望の膜厚のAlGaN層を成膜した後に、図11Cに示すように、ロータリターゲットRT2の磁石の位置を第2成膜位置に切り替え、ロータリターゲットRT2、RT3の両方に対して電力を供給することで、これらに対するプラズマが発生する。ロータリターゲットRT2からは窒化ガリウムがスパッタリングされ、ロータリターゲットRT3からはマグネシウム含有窒化ガリウムがスパッタリングされる。その結果、基板310Cには、p-GaN層が成膜される。上記の動作を「第3ステップ」という場合がある。
 第3ステップにおいて、ロータリターゲットRT2に対してプラズマを発生させる電力とロータリターゲットRT3に対してプラズマを発生させる電力との比率を調整することで、基板310Cに形成される薄膜に含まれるドーパントの濃度を調整することができる。
 上記のように図11A~図11Cに示す第1ステップ~第3ステップによって、p-GaN層/AlGaN層/GaN層が形成される。つまり、本実施形態に係るスパッタリング装置10Cによると、例えば、p-GaN層/AlGaN層/GaN層のような積層構造において、これらの界面にゴミや汚染物質が付着することを抑制することができる。
 ターゲット216Cとしてアルミニウム(Al)が用いられてもよい。ターゲット226Cとしてガリウム(Ga)が用いられてもよい。ターゲット236Cとして用いられるマグネシウム含有窒化ガリウムのドーパント濃度は、基板310Cに形成されるp-GaN層のドーパント濃度と同じであってもよく、基板310Cに形成されるp-GaN層のドーパント濃度より高くてもよい。その場合、ターゲット236Cとして用いられるマグネシウム含有窒化ガリウムのドーパント濃度は、基板310Cに形成されるp-GaN層のドーパント濃度の1倍以上20倍以下であってもよい。
[4-3.スパッタリング装置10Cを用いて作製した半導体装置50C]
 図12は、本発明の一実施形態に係るスパッタリング方法を用いて製造した半導体装置を示す断面図である。
 図12に示すように、半導体装置50Cは、基板501C、バリア層502C、バッファ層503C、GaN層504C、第1AlGaN層505C、第2AlGaN層506C、第3AlGaN層507C、ソース電極508C、ドレイン電極509C、ゲート電極510C、第1絶縁層511C、第2絶縁層512C、及びシールド電極513Cを有する。半導体装置50Cは、いわゆるHEMTであるが、これに限られない。
 基板501Cとして、例えば、ガラス基板又は石英基板などを用いることができる。バリア層502Cとして、例えば、窒化シリコン膜などを用いることができる。バッファ層503Cとして、例えば、窒化アルミニウム膜などを用いることができる。GaN層504Cとして、真性の窒化ガリウム層を用いることができる。第1AlGaN層505Cとして、真性の窒化アルミニウムガリウム層を用いることができる。第2AlGaN層506Cとして、例えば、マグネシウムがドーピングされた窒化アルミニウムガリウム層を用いることができる。第3AlGaN層507Cとして、真性の窒化アルミニウムガリウム層を用いることができる。
 ソース電極508C及びドレイン電極509Cとして、例えば、チタン又はアルミニウムなどの金属を用いることができる。ゲート電極510Cとして、例えば、ニッケル又は金などの金属を用いることができる。第1絶縁層511Cとして、例えば、窒化シリコン層を用いることができる。第2絶縁層512Cとして、例えば、酸化シリコン層を用いることができる。シールド電極513Cとして、例えば、アルミニウム/チタン(Al/Ti)などの積層金属を用いることができる。バリア層502Cは省略されてもよい。
 半導体装置50Cの製造方法は次のとおりである。まず、基板501C上に、窒化シリコン層及び窒化アルミニウム層を順に成膜することで、バリア層502C及びバッファ層503Cを形成する。次に、バッファ層503Cの上に、窒化ガリウム層、窒化アルミニウムガリウム層、マグネシウム含有窒化アルミニウムガリウム層、及び窒化アルミニウムガリウム層を成膜することで、GaN層504C、第1AlGaN層505C、第2AlGaN層506C、及び第3AlGaN層507Cを形成する。
 続いて、フォトリソグラフィ工程によって、第2AlGaN層506Cの一部が露出するように第3AlGaN層507Cをエッチングする。表面に露出した第2AlGaN層506Cの上に、ソース電極508C及びドレイン電極509Cを形成する。第3AlGaN層507Cの上に、ゲート電極510Cを形成する。ソース電極508C、ドレイン電極509C、及びゲート電極510Cを覆うように、窒化シリコン膜及び酸化シリコン膜を順に成膜し、第1絶縁層511C及び第2絶縁層512Cを形成する。第2絶縁層512Cの上に、シールド電極513Cを形成することで、半導体装置50Cを形成することができる。
 本実施形態では、スパッタリング装置10Cを利用して、GaN層504C、第1AlGaN層505C、第2AlGaN層506C、及び第3AlGaN層507Cを同一のチャンバ100C内で成膜することができる。したがって、これらの界面にゴミや汚染物質が付着することを抑制することができる。
 さらに、本実施形態に係る半導体装置50Cは、スパッタリング装置10Cを利用して窒化ガリウム膜を成膜することができるため、耐熱性の低い、例えばガラス基板を用いて作製することができる。
[5.第5実施形態]
 図13及び図14を参照して、本発明の一実施形態に係るスパッタリング装置10D及び当該スパッタリング装置10Dを用いて形成された発光素子70Dについて説明する。以下の説明において、スパッタリング装置10Dの構成のうち第1実施形態のスパッタリング装置10と同様の構成の説明を省略し、主にスパッタリング装置10と相違する構成について説明する。以下の説明において、第1実施形態と同様の構成について説明をする場合、図1~7を参照し、図1~7に示された符号の後にアルファベット“D”を付して説明する。
[5-1.スパッタリング装置10Dの構成]
 図13は、本発明の一実施形態に係るスパッタリング装置の概要を示す図である。図13に示すように、スパッタリング装置10Dは、搬送チャンバ600D、第1成膜チャンバ610D、第2成膜チャンバ620D、第3成膜チャンバ630D、第4成膜チャンバ640D、第5成膜チャンバ650D、及びロードロック室660Dを備える。
 搬送チャンバ600Dには、基板310Dを搬送する搬送ロボットが配置されている。搬送チャンバ600Dと各チャンバとの間にはゲートシャッタが配置されている。ゲートシャッタが開いているときは、隣接するチャンバの空間は連続する。ゲートシャッタが閉じているときは、隣接するチャンバの空間は遮断され、各々のチャンバの雰囲気は個別に制御可能である。ロードロック室660Dは、スパッタリング装置10Dと外部との間で基板310Dの搬出又は搬入を実行するチャンバである。
 第1成膜チャンバ610Dには、窒化シリコンのターゲットが配置されている。第2成膜チャンバ620Dには、窒化アルミニウムのターゲットが配置されている。第3成膜チャンバ630Dには、窒化アルミニウムのターゲット、窒化ガリウムのターゲット、及びシリコンがドーピングされた窒化ガリウム(N型の半導体)のターゲットが配置されている。つまり、第3成膜チャンバ630Dは、図11A等に示すように、第4実施形態に係るスパッタリング装置10Cと同じ構成を有する。第4成膜チャンバ640Dには、窒化ガリウムのターゲット及び窒化インジウムのターゲットが配置されている。つまり、第4成膜チャンバ640Dは、図8A等に示すように、第2実施形態に係るスパッタリング装置10Aと同じ構成を有する。第5成膜チャンバ650Dには、窒化アルミニウムのターゲット、窒化ガリウムのターゲット、及びマグネシウムがドーピングされた窒化ガリウム(P型の半導体)のターゲットが配置されている。つまり、第5成膜チャンバ650Dは、図11A等に示すように、第4実施形態に係るスパッタリング装置10Cと同じ構成を有する。
[5-2.スパッタリング装置10Dを用いて作製した発光素子70D]
 図14は、本発明の一実施形態に係るスパッタリング方法を用いて製造した発光素子を示す断面図である。
 図14に示すように、発光素子70Dは、基板701D、バリア層702D、バッファ層703D、N型半導体層704D、発光層705D、P型半導体層706D、N型電極707D、及びP型電極708Dを有する。発光素子70Dは、いわゆるLED(Light Emitting Diode)であるが、これに限られない。
 基板701Dとして、例えば、ガラス基板又は石英基板などを用いることができる。バリア層702Dとして、例えば、窒化シリコン層などを用いることができる。バッファ層703Dとして、例えば、窒化アルミニウム層などを用いることができる。N型半導体層704Dとして、シリコンがドーピングされた窒化ガリウム層などを用いることができる。発光層705Dとして、窒化インジウムガリウム層と窒化ガリウム層とが交互に積層された積層体を用いることができる。P型半導体層706Dとして、マグネシウムがドーピングされた窒化ガリウム層などを用いることができる。N型電極707Dとして、インジウムなどの金属を用いることができる。P型電極708Dとして、パラジウム又は金などの金属を用いることができる。バリア層702Dは省略されてもよい。
 発光素子70Dの製造方法は次のとおりである。まず、基板701D上に、窒化シリコン層及び窒化アルミニウム層を順に成膜することで、バリア層702D及びバッファ層703Dを形成する。次に、バッファ層703Dの上に、シリコンがドーピングされた窒化ガリウム層を成膜し、その上に窒化インジウムガリウム層と窒化ガリウム層とを交互に成膜し、その上にマグネシウムがドーピングされた窒化ガリウム層を成膜することで、N型半導体層704D、発光層705D、及びP型半導体層706Dを形成する。
 続いて、フォトリソグラフィ工程によって、N型半導体層704Dの一部が露出するようにP型半導体層706D、発光層705D、及びN型半導体層704Dの一部をエッチングする。フォトリソグラフィ工程によって、表面に露出したN型半導体層704Dの上に、N型電極707Dを形成する。同様に、P型半導体層706Dの上に、P型電極708Dを形成する。
 本実施形態では、スパッタリング装置10Dを利用して、N型半導体層704D、発光層705D、及びP型半導体層706Dを同一のチャンバ内で成膜することができる。したがって、これらの界面にゴミや汚染物質が付着することを抑制することができる。
 上記の実施形態では、スパッタリング装置に設けられたターゲットがロータリターゲットである構成を例示したが、ロータリターゲットに代えて平板型ターゲットが用いられてもよい。
 本発明の実施形態として上述した各実施形態は、相互に矛盾しない限りにおいて、適宜組み合わせて実施することができる。また、各実施形態を基にして、当業者が適宜構成要素の追加、削除、もしくは設計変更を行ったもの、又は工程の追加、省略、もしくは条件変更を行ったものも、本発明の要旨を備えている限り、本発明の範囲に含まれる。
 上述した各実施形態の態様によりもたらされる作用効果とは異なる他の作用効果であっても、本明細書の記載から明らかなもの、又は当業者において容易に予測し得るものについては、当然に本発明によりもたらされるものと解される。
10:スパッタリング装置、 20:半導体装置、 50C:半導体装置、 70D:発光素子、 100:チャンバ、 200:ターゲット部、 210、220、230C:支持部材、 211、221、231C:固定部材、 212、222、232C:ヨーク、 213、223、233C:中央磁石、 214、224、234C:周辺磁石、 215、225、235C:バッキングチューブ、 216、226、236C:ターゲット、 217、227、237C:遮蔽板、 218、228、229C、238C:スリット、 240:遮蔽板、 241:隔壁、 242:第1遮蔽板、 243:第2遮蔽板、 244、245:スリット、 300:基板保持部、 310:基板、 320:移動機構、 330:第1窒化ガリウム層、 340:第2窒化ガリウム層、 350:ゲート絶縁層、 360:ゲート電極、 370:ソース電極、 380:ドレイン電極、 400B:プラズマユニット、 410B:電極、 411B:プラズマ領域、 420B:筐体、 430B:マッチングボックス、 440B:RF電源、 501C:基板、 502C:バリア層、 503C:バッファ層、 504C:窒化ガリウム層(GaN層)、 505C:第1窒化アルミニウムガリウム層(第1AlGaN層)、 506C:第2窒化アルミニウムガリウム層(第2AlGaN層)、 507C:第3窒化アルミニウムガリウム層(第3AlGaN層)、 508C:ソース電極、 509C:ドレイン電極、 510C:ゲート電極、 511C:第1絶縁層、 512C:第2絶縁層、 513C:シールド電極、 600D:搬送チャンバ、 610D:第1成膜チャンバ、 620D:第2成膜チャンバ、 630D:第3成膜チャンバ、 640D:第4成膜チャンバ、 650D:第5成膜チャンバ、 660D:ロードロック室、 701D:基板、 702D:バリア層、 703D:バッファ層、 704D:N型半導体層、 705D:発光層、 706D:P型半導体層、 707D:N型電極、 708D:P型電極、 PLS:プラズマ領域、 RT1、RT2、RT3:ロータリターゲット

Claims (17)

  1.  基板を保持する基板保持部と、
     前記基板保持部と対向するように配置された第1ターゲットと、
     前記基板保持部と対向するように前記第1ターゲットと並んで配置された第2ターゲットと、
     前記第1ターゲットと前記第2ターゲットとの間に配置された隔壁と、を有し、
     前記第1ターゲットの任意の位置における第1法線及び前記第2ターゲットの任意の位置における第2法線の各々は、前記基板上の任意の点に接続されるスパッタリング装置。
  2.  前記隔壁は、前記第1ターゲットと前記第2ターゲットとによって挟まれる空間を遮蔽するように設けられる、請求項1に記載のスパッタリング装置。
  3.  前記基板保持部と前記第1ターゲットとの間に配置された、第1スリットが設けられた第1遮蔽板と、
     前記基板保持部と前記第2ターゲットとの間に配置された、第2スリットが設けられた第2遮蔽板と、をさらに有する、請求項1に記載のスパッタリング装置。
  4.  前記第1遮蔽板及び前記第2遮蔽板は、前記隔壁に接続されている、請求項3に記載のスパッタリング装置。
  5.  前記第1遮蔽板は、前記第1スリットが設けられた領域を除き前記第1ターゲットの周囲を連続して囲み、
     前記第2遮蔽板は、前記第2スリットが設けられた領域を除き前記第2ターゲットの周囲を連続して囲む、請求項3に記載のスパッタリング装置。
  6.  前記第1スリットは、前記基板保持部又は前記基板に対する垂線のうち前記第1ターゲットの回転軸を通る線より前記第2ターゲット側に設けられ、
     前記第2スリットは、前記基板保持部又は前記基板に対する垂線のうち前記第2ターゲットの回転軸を通る線より前記第1ターゲット側に設けられる、請求項3に記載のスパッタリング装置。
  7.  基板を保持する基板保持部と、
     前記基板保持部と対向するように配置され、第1ターゲット部材が取り付けられた第1ターゲットと、
     前記基板保持部と対向するように前記第1ターゲットと並んで配置され、前記第1ターゲット部材とは異なる第2ターゲット部材が取り付けられた第2ターゲットと、を有し、
     前記第1ターゲット部材は、ガリウムを含む、スパッタリング装置。
  8.  前記第1ターゲットと前記第2ターゲットとの間に配置された隔壁をさらに有する、請求項7に記載のスパッタリング装置。
  9.  前記隔壁は、前記第1ターゲットと前記第2ターゲットとによって挟まれる空間を遮蔽するように設けられる、請求項8に記載のスパッタリング装置。
  10.  前記基板保持部と前記第1ターゲットとの間に配置された、第1スリットが設けられた第1遮蔽板と、
     前記基板保持部と前記第2ターゲットとの間に配置された、第2スリットが設けられた第2遮蔽板と、をさらに有する、請求項7に記載のスパッタリング装置。
  11.  前記第1遮蔽板及び前記第2遮蔽板は、前記隔壁に接続されている、請求項10に記載のスパッタリング装置。
  12.  前記第1遮蔽板は、前記第1スリットが設けられた領域を除き前記第1ターゲットの周囲を連続して囲み、
     前記第2遮蔽板は、前記第2スリットが設けられた領域を除き前記第2ターゲットの周囲を連続して囲む、請求項10に記載のスパッタリング装置。
  13.  前記第1スリットは、前記基板保持部又は前記基板に対する垂線のうち前記第1ターゲットの回転軸を通る線より前記第2ターゲット側に設けられ、
     前記第2スリットは、前記基板保持部又は前記基板に対する垂線のうち前記第2ターゲットの回転軸を通る線より前記第1ターゲット側に設けられる、請求項10に記載のスパッタリング装置。
  14.  第1ターゲット及び第2ターゲットに対向する基板保持部に基板を保持し、
     第1ステップにおいて、前記第1ターゲットに対するプラズマを発生しながら、前記第1ターゲットと前記基板保持部とを相対的に移動させることで、前記基板に前記第1ターゲットの第1材料を成膜し、
     第2ステップにおいて、前記第2ターゲットに対するプラズマを発生しながら、前記第2ターゲットと前記基板保持部とを相対的に移動させることで、前記基板に前記第2ターゲットの第2材料を成膜することで、
     前記第1材料と前記第2材料とを含む積層構造体を形成するスパッタリング方法。
  15.  前記第1ステップにおいて、前記第1材料を前記基板に成膜する際に、前記第2ターゲットに対するプラズマを停止し、
     前記第2ステップにおいて、前記第1ターゲットに対するプラズマ及び前記第2ターゲットに対するプラズマを発生させることで、前記基板に前記第1材料及び前記第2材料を成膜する、請求項14に記載のスパッタリング方法。
  16.  前記第1材料を前記基板に成膜する際に、
      前記第1ターゲットに含まれる第1磁石を制御して、第1スリットが設けられた位置にプラズマを発生させ、
     前記第2材料を前記基板に成膜する際に、
      前記第2ターゲットに含まれる第2磁石を制御して、第2スリットが設けられた位置にプラズマを発生させる、請求項14に記載のスパッタリング方法。
  17.  前記第2材料は、前記第1材料よりも多くのドーパントを含み、
     前記第2ターゲットに対してプラズマを発生させる電力を調整することで、前記基板に形成される薄膜に含まれる前記ドーパントの濃度を調整する、請求項14に記載のスパッタリング方法。
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