WO2021186936A1 - ショットキーバリアダイオード - Google Patents

ショットキーバリアダイオード Download PDF

Info

Publication number
WO2021186936A1
WO2021186936A1 PCT/JP2021/004060 JP2021004060W WO2021186936A1 WO 2021186936 A1 WO2021186936 A1 WO 2021186936A1 JP 2021004060 W JP2021004060 W JP 2021004060W WO 2021186936 A1 WO2021186936 A1 WO 2021186936A1
Authority
WO
WIPO (PCT)
Prior art keywords
trench
outer peripheral
schottky barrier
barrier diode
drift layer
Prior art date
Application number
PCT/JP2021/004060
Other languages
English (en)
French (fr)
Inventor
潤 有馬
藤田 実
潤 平林
Original Assignee
Tdk株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tdk株式会社 filed Critical Tdk株式会社
Priority to US17/802,438 priority Critical patent/US11908955B2/en
Publication of WO2021186936A1 publication Critical patent/WO2021186936A1/ja

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/86Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
    • H01L29/861Diodes
    • H01L29/872Schottky diodes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/86Types of semiconductor device ; Multistep manufacturing processes therefor controllable only by variation of the electric current supplied, or only the electric potential applied, to one or more of the electrodes carrying the current to be rectified, amplified, oscillated or switched
    • H01L29/861Diodes
    • H01L29/872Schottky diodes
    • H01L29/8725Schottky diodes of the trench MOS barrier type [TMBS]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0603Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions
    • H01L29/0607Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration
    • H01L29/0611Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by particular constructional design considerations, e.g. for preventing surface leakage, for controlling electric field concentration or for internal isolations regions for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse biased devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/06Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
    • H01L29/0657Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
    • H01L29/0661Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body specially adapted for altering the breakdown voltage by removing semiconductor material at, or in the neighbourhood of, a reverse biased junction, e.g. by bevelling, moat etching, depletion etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/16Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System
    • H01L29/167Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only elements of Group IV of the Periodic System further characterised by the doping material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/02Semiconductor bodies ; Multistep manufacturing processes therefor
    • H01L29/12Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/24Semiconductor bodies ; Multistep manufacturing processes therefor characterised by the materials of which they are formed including, apart from doping materials or other impurities, only semiconductor materials not provided for in groups H01L29/16, H01L29/18, H01L29/20, H01L29/22

Abstract

【課題】酸化ガリウムを用いたショットキーバリアダイオードにおいて、電界の集中による絶縁破壊を防止する。 【解決手段】ショットキーバリアダイオード1は、酸化ガリウムからなる半導体基板20及びドリフト層30と、ドリフト層30の上面31とショットキー接触するアノード電極40と、半導体基板20の下面22とオーミック接触するカソード電極50とを備える。 ドリフト層30の上面31にはリング状の外周トレンチ11が設けられ、アノード電極40の一部が外周トレンチ11の内部に埋め込まれる。半導体基板20の下面22には、底部がドリフト層30に達するリング状の裏面トレンチ12が設けられている。これにより、電流経路が裏面トレンチで囲まれた領域に制限されることから、外周トレンチ11の底部近傍における電界集中が緩和される。

Description

ショットキーバリアダイオード
 本発明はショットキーバリアダイオードに関し、特に、酸化ガリウムを用いたショットキーバリアダイオードに関する。
 ショットキーバリアダイオードは、金属と半導体の接合によって生じるショットキー障壁を利用した整流素子であり、PN接合を有する通常のダイオードに比べて順方向電圧が低く、且つ、スイッチング速度が速いという特徴を有している。このため、ショットキーバリアダイオードはパワーデバイス用のスイッチング素子として利用されることがある。
 ショットキーバリアダイオードをパワーデバイス用のスイッチング素子として用いる場合、十分な逆方向耐圧を確保する必要があることから、シリコン(Si)の代わりに、よりバンドギャップの大きい炭化シリコン(SiC)、窒化ガリウム(GaN)、酸化ガリウム(Ga)などが用いられることがある。中でも、酸化ガリウムは、バンドギャップが4.8~4.9eVと非常に大きく、絶縁破壊電界も約8MV/cmと大きいことから、酸化ガリウムを用いたショットキーバリアダイオードは、パワーデバイス用のスイッチング素子として非常に有望である。酸化ガリウムを用いたショットキーバリアダイオードの例は、特許文献1及び2に記載されている。
特開2017-45969号公報 特開2017-199869号公報
 しかしながら、特許文献1及び2に記載されたショットキーバリアダイオードは、アノード電極の外周端近傍に電界が集中し、この部分において絶縁破壊が生じるおそれがあった。
 したがって、本発明は、酸化ガリウムを用いたショットキーバリアダイオードにおいて、電界の集中による絶縁破壊を防止することを目的とする。
 本発明によるショットキーバリアダイオードは、酸化ガリウムからなる半導体基板と、酸化ガリウムからなり、半導体基板の上面と接する下面及び下面の反対側に位置する上面を有し、上面にリング状の外周トレンチが設けられたドリフト層と、外周トレンチで囲まれたドリフト層の上面とショットキー接触するとともに、外周トレンチの内部に絶縁膜を介して埋め込まれたアノード電極と、半導体基板の上面とは反対側の下面とオーミック接触するカソード電極とを備え、半導体基板の下面には、底部がドリフト層に達するリング状の裏面トレンチが設けられており、カソード電極は、半導体基板の下面のうち、裏面トレンチで囲まれた領域の外側に設けられることなく、裏面トレンチで囲まれた領域に設けられており、ドリフト層のうち外周トレンチに囲まれた領域は、平面視で裏面トレンチに囲まれた領域と重なりを有していることを特徴とする。
 本発明によれば、底部がドリフト層に達するリング状の裏面トレンチが半導体基板に設けられていることから、電流経路が裏面トレンチで囲まれた領域に制限される。これにより、外周トレンチの底部近傍における電界集中が緩和されることから、絶縁破壊を防止することが可能となる。
 本発明において、裏面トレンチの内周壁は、平面視で外周トレンチの外周壁の内側に位置しても構わない。これによれば、外周トレンチの外側エッジ近傍における電界集中が大幅に緩和されることから、絶縁破壊をより効果的に防止することが可能となる。
 本発明において、裏面トレンチの内周壁は、平面視で外周トレンチの内周壁と外周壁の間に位置しても構わない。これによれば、絶縁破壊を防止しつつ、電流経路として機能するドリフト層の断面積を十分に確保することが可能となる。
 本発明によるショットキーバリアダイオードは、外周トレンチを囲むよう、ドリフト層の上面をリング状に覆うフィールド絶縁膜をさらに備え、アノード電極の外周端は、フィールド絶縁膜上に位置しても構わない。これによれば、アノード電極の外周端近傍における電界集中が緩和されることから、絶縁破壊をより効果的に防止することが可能となる。
 本発明において、裏面トレンチは絶縁材料で埋め込まれていても構わない。これによれば、全体の機械的強度を高めることが可能となる。
 本発明において、ドリフト層の上面には、外周トレンチに囲まれた領域に形成された複数の中心トレンチが設けられており、アノード電極は、中心トレンチの内部に絶縁膜を介して埋め込まれていても構わない。これによれば、アノード電極とカソード電極との間に逆方向電圧が印加されると、中心トレンチによって区画されるメサ領域が空乏層となるため、ドリフト層のチャネル領域がピンチオフされる。これにより、逆方向電圧が印加された場合のリーク電流を大幅に抑制することが可能となる。
 このように、本発明によれば、酸化ガリウムを用いたショットキーバリアダイオードにおいて、電界の集中による絶縁破壊を防止することが可能となる。
図1は、本発明の第1の実施形態によるショットキーバリアダイオード1の構成を示す模式的な平面図である。 図2は、図1に示すA-A線に沿った略断面図である。 図3は、第1の実施形態の第1の変形例によるショットキーバリアダイオード1Aの構成を示す模式的な平面図である。 図4は、第1の実施形態の第2の変形例によるショットキーバリアダイオード1Bの構成を示す模式的な平面図である。 図5は、第1の実施形態の第3の変形例によるショットキーバリアダイオード1Cの構成を示す模式的な平面図である。 図6は、第1の実施形態の第4の変形例によるショットキーバリアダイオード1Dの構成を示す模式的な平面図である。 図7は、第1の実施形態の第5の変形例によるショットキーバリアダイオード1Eの構成を示す模式的な断面図である。 図8は、第1の実施形態の第6の変形例によるショットキーバリアダイオード1Fの構成を示す模式的な断面図である。 図9は、第1の実施形態の第7の変形例によるショットキーバリアダイオード1Gの構成を示す模式的な断面図である。 図10は、本発明の第2の実施形態によるショットキーバリアダイオード2の構成を示す模式的な断面図である。 図11は、本発明の第3の実施形態によるショットキーバリアダイオード3の構成を示す模式的な断面図である。 図12は、第3の実施形態の変形例によるショットキーバリアダイオード3Aの構成を示す模式的な断面図である。 図13は、本発明の第4の実施形態によるショットキーバリアダイオード4の構成を示す模式的な断面図である。 図14は、第4の実施形態の第1の変形例によるショットキーバリアダイオード4Aの構成を示す模式的な断面図である。 図15は、第4の実施形態の第2の変形例によるショットキーバリアダイオード4Bの構成を示す模式的な断面図である。 図16は、第4の実施形態の第3の変形例によるショットキーバリアダイオード4Cの構成を示す模式的な断面図である。 図17は、実施例3のシミュレーションモデルを示す模式的な断面図である。 図18は、実施例3の結果を示す表である。
 以下、添付図面を参照しながら、本発明の好ましい実施形態について詳細に説明する。
<第1の実施形態>
 図1は、本発明の第1の実施形態によるショットキーバリアダイオード1の構成を示す模式的な平面図である。また、図2は、図1に示すA-A線に沿った略断面図である。
 図1及び図2に示すように、本実施形態によるショットキーバリアダイオード1は、いずれも酸化ガリウム(β-Ga)からなる半導体基板20及びドリフト層30を備える。半導体基板20及びドリフト層30には、n型ドーパントとしてシリコン(Si)又はスズ(Sn)が導入されている。ドーパントの濃度は、ドリフト層30よりも半導体基板20の方が高く、これにより半導体基板20はn層、ドリフト層30はn層として機能する。
 半導体基板20は、融液成長法などを用いて形成されたバルク結晶を切断加工したものであり、その厚みは250μm程度である。半導体基板20の平面サイズについては特に限定されないが、一般的に素子に流す電流量に応じて選択することになり、順方向の最大電流量が20A程度であれば、平面視で2.4mm×2.4mm程度とすればよい。
 半導体基板20は、実装時において上面側に位置する上面21と、上面21の反対側であって、実装時において基板側に位置する下面22を有する。半導体基板20の上面21にはドリフト層30が形成されている。ドリフト層30は、半導体基板20の上面21に反応性スパッタリング、PLD法、MBE法、MOCVD法、HVPE法などを用いて酸化ガリウムをエピタキシャル成長させた薄膜である。ドリフト層30は、半導体基板20の上面21と接する下面32と、下面32の反対側であって、実装時において上面側に位置する上面31を有する。ドリフト層30の膜厚については特に限定されないが、一般的に素子の逆方向耐電圧に応じて選択することになり、600V程度の耐圧を確保するためには、例えば7μm程度とすればよい。
 ドリフト層30の上面31には、リング状に形成された外周トレンチ11が設けられている。外周トレンチ11の内壁は、HfOなどからなる絶縁膜61で覆われている。絶縁膜61の材料としては、HfO以外にAlなどの絶縁材料を用いても構わない。
 ドリフト層30の上面31のうち、外周トレンチ11で囲まれた領域には、ドリフト層30とショットキー接触するアノード電極40が形成されている。アノード電極40は、絶縁膜61を介して外周トレンチ11の内部にも埋め込まれている。アノード電極40は、例えば白金(Pt)、パラジウム(Pd)、金(Au)、ニッケル(Ni)、モリブデン(Mo)、銅(Cu)等の金属からなる。アノード電極40は、異なる金属膜を積層した多層構造、例えば、Pt/Au、Pt/Al、Pd/Au、Pd/Al、Pt/Ti/AuまたはPd/Ti/Auであっても構わない。外周トレンチ11の内部に埋め込まれている金属材料は、アノード電極40と同じ金属材料であっても構わないし、異なる金属材料であっても構わない。
 半導体基板20の下面22には、半導体基板20を貫通し底部がドリフト層30に達するリング状の裏面トレンチ12が設けられている。そして、半導体基板の下面22のうち、裏面トレンチ12で囲まれた領域には、半導体基板20とオーミック接触するカソード電極50が設けられる。カソード電極50は、例えばチタン(Ti)等の金属からなる。カソード電極50は、異なる金属膜を積層した多層構造、例えば、Ti/AuまたはTi/Alであっても構わない。
 ここで、外周トレンチ11の外周壁及び内周壁をそれぞれE1,E2とし、裏面トレンチ12の外周壁及び内周壁をそれぞれE3,E4とした場合、内周壁E2は平面視で内周壁E4の内側に位置し、内周壁E4は平面視で外周壁E1の内側に位置し、外周壁E1は平面視で外周壁E3の内側に位置する。これにより、ドリフト層30のうち外周トレンチ11に囲まれた領域は、平面視で裏面トレンチ12に囲まれた領域と重なりを有する。
 カソード電極50は、半導体基板の下面22のうち、裏面トレンチ12で囲まれた領域の外側に設けられておらず、裏面トレンチ12で囲まれた領域に選択的に設けられている。このため、アノード電極40とカソード電極50の間に逆方向電圧を印加すると、逆方向電流が流れる領域は、裏面トレンチ12で囲まれた領域に制限される。このため、電界が集中しやすい外周トレンチ11の外側エッジ近傍における電界集中が緩和される。特に、本実施形態においては、裏面トレンチの内周壁E4が、平面視で外周トレンチ11の外周壁E1の内側に位置することから、外周トレンチ11の外側エッジ近傍における電界集中が大幅に緩和される。しかも、裏面トレンチ12の内周壁E4は、平面視で外周トレンチ11の内周壁E2と外周壁E1の間に位置することから、ドリフト層30のうち電流経路として機能する部分が細くなりすぎず、十分な断面積が確保されることから、十分なオン電流を確保することが可能となる。
 但し、本発明において、外周トレンチ11と裏面トレンチ12の位置関係がこれに限定されるものではない。例えば、図3に示す第1の変形例によるショットキーバリアダイオード1Aのように、裏面トレンチ12の外周壁E3が平面視で外周トレンチ11の外周壁E1と内周壁E2の間に位置し、裏面トレンチ12の内周壁E4が平面視で外周トレンチ11の内周壁E2よりも内側に位置しても構わない。また、図4に示す第2の変形例によるショットキーバリアダイオード1Bのように、裏面トレンチ12の外周壁E3が平面視で外周トレンチ11の内周壁E2よりも内側に位置しても構わない。さらに、図5に示す第3の変形例によるショットキーバリアダイオード1Cのように、外周トレンチ11の外周壁E1及び内周壁E2が平面視で裏面トレンチ12の外周壁E3と内周壁E4の間に位置しても構わない。さらに、図6に示す第4の変形例によるショットキーバリアダイオード1Dのように、外周トレンチ11の平面形状と裏面トレンチ12の平面形状が異なっていても構わない。
 また、図7に示す第5の変形例によるショットキーバリアダイオード1Eのように、裏面トレンチ12の内周壁E4に露出する半導体基板20の一部がカソード電極50で覆われていても構わない。さらに、図8に示す第6の変形例によるショットキーバリアダイオード1Fのように、裏面トレンチ12のトレンチ幅が深さ方向に縮小するようなテーパー形状であっても構わない。この場合、裏面トレンチ12の外周壁E3及び内周壁E4は、底部における平面位置によって定義すれば良い。外周トレンチ11がテーパー形状である場合も同様である。
 また、図9に示す第7の変形例によるショットキーバリアダイオード1Gのように、半導体基板20及びドリフト層30のうち、裏面トレンチ12の外周に位置する部分が除去されていても構わない。つまり、裏面トレンチ12は、内周壁E4が存在すれば足り、外周壁E3が存在しなくても構わない。
<第2の実施形態>
 図10は、本発明の第2の実施形態によるショットキーバリアダイオード2の構成を示す模式的な断面図である。
 図10に示すように、第2の実施形態によるショットキーバリアダイオード2は、外周トレンチ11の外周領域にアノード電極40が存在しており、アノード電極40とドリフト層30の上面31の間にリング状のフィールド絶縁膜70が介在している点において、第1の実施形態によるショットキーバリアダイオード1と相違している。したがって、アノード電極40の外周端は、フィールド絶縁膜70上に位置する。その他の基本的な構成は第1の実施形態によるショットキーバリアダイオード1と同一であることから、同一の要素には同一の符号を付し、重複する説明は省略する。
 本実施形態によれば、外周トレンチ11の外周領域に位置するアノード電極40とドリフト層30の間にフィールド絶縁膜70が介在していることから、アノード電極40の外周端近傍における電界の集中を緩和することができる。フィールド絶縁膜70の材料としては、SiOなどを用いることができる。
<第3の実施形態>
 図11は、本発明の第3の実施形態によるショットキーバリアダイオード3の構成を示す模式的な断面図である。
 図11に示すように、第3の実施形態によるショットキーバリアダイオード3は、裏面トレンチ12が絶縁材料80で埋め込まれている点において、第1の実施形態によるショットキーバリアダイオード1と相違している。絶縁材料80は、半導体基板20の下面22のうち、裏面トレンチ12の外周に位置する部分にも設けられている。その他の基本的な構成は第1の実施形態によるショットキーバリアダイオード1と同一であることから、同一の要素には同一の符号を付し、重複する説明は省略する。
 本実施形態によれば、裏面トレンチ12が絶縁材料80で埋め込まれることから、全体の機械的強度が高められる。絶縁材料80としては、SiO、SiN、Al、AlN、BNなどを用いることができる。また、絶縁材料80としてより熱伝導性の高い材料を用いれば、放熱性を高めることも可能である。例えば、絶縁材料80として酸化ガリウムの熱伝導率0.1~0.3W/cm・Kより高い材料を用いれば、放熱性を高められる。
 図12は、変形例によるショットキーバリアダイオード3Aの構成を示す模式的な断面図である。変形例によるショットキーバリアダイオード3Aは、第2の実施形態によるショットキーバリアダイオード2と同様、フィールド絶縁膜70が設けられている点において、第3の実施形態によるショットキーバリアダイオード3と相違している。このように、裏面トレンチ12を絶縁材料80で埋め込むとともに、フィールド絶縁膜70を設けても構わない。
<第4の実施形態>
 図13は、本発明の第4の実施形態によるショットキーバリアダイオード4の構成を示す模式的な断面図である。
 図13に示すように、第4の実施形態によるショットキーバリアダイオード4は、ドリフト層30の上面31に複数の中心トレンチ13が設けられている点において、第1の実施形態によるショットキーバリアダイオード1と相違している。その他の基本的な構成は第1の実施形態によるショットキーバリアダイオード1と同一であることから、同一の要素には同一の符号を付し、重複する説明は省略する。
 中心トレンチ13は、外周トレンチ11に囲まれた領域に形成されており、いずれも平面視でアノード電極40と重なる位置に設けられている。そして、アノード電極40は、絶縁膜63を介して中心トレンチ13に埋め込まれている。本例では、中心トレンチ13の内壁を絶縁膜63で覆うとともに、中心トレンチ13の内部をアノード電極40と同じ材料で埋め込んでいるが、絶縁膜63を用いることなく、逆導電型の半導体材料で中心トレンチ13を埋め込んでも構わない。ここで、中心トレンチ13と外周トレンチ11が完全に分離されている必要はなく、外周トレンチ11と中心トレンチ13がつながっていても構わない。
 ドリフト層30のうちトレンチ11,13によって区画される部分はメサ領域Mを構成する。メサ領域Mは、アノード電極40とカソード電極50との間に逆方向電圧が印加されると空乏層となるため、ドリフト層30のチャネル領域がピンチオフされる。これにより、逆方向電圧が印加された場合のリーク電流が大幅に抑制される。
 図14は、第1の変形例によるショットキーバリアダイオード4Aの構成を示す模式的な断面図である。変形例によるショットキーバリアダイオード4Aは、第2の実施形態によるショットキーバリアダイオード2と同様、フィールド絶縁膜70が設けられている点において、第4の実施形態によるショットキーバリアダイオード4と相違している。このように、複数の中心トレンチ13を設けるとともに、フィールド絶縁膜70を設けても構わない。
 図15は、第2の変形例によるショットキーバリアダイオード4Bの構成を示す模式的な断面図である。変形例によるショットキーバリアダイオード4Bは、第3の実施形態によるショットキーバリアダイオード3と同様、裏面トレンチ12が絶縁材料80で埋め込まれている点において、第4の実施形態によるショットキーバリアダイオード4と相違している。このように、複数の中心トレンチ13を設けるとともに、裏面トレンチ12を絶縁材料80で埋め込んでも構わない。
 図16は、第3の変形例によるショットキーバリアダイオード4Cの構成を示す模式的な断面図である。変形例によるショットキーバリアダイオード4Cは、第2の変形例によるショットキーバリアダイオード4Bの構成に加え、フィールド絶縁膜70が設けられた構成を有している。
 以上、本発明の好ましい実施形態について説明したが、本発明は、上記の実施形態に限定されることなく、本発明の主旨を逸脱しない範囲で種々の変更が可能であり、それらも本発明の範囲内に包含されるものであることはいうまでもない。
<実施例1>
 図1及び図2に示したショットキーバリアダイオード1と同じ構造を有する実施例1のシミュレーションモデルを想定し、アノード電極40とカソード電極50の間に1000Vの逆方向電圧を印加した場合の電界強度をシミュレーションした。半導体基板20のドーパント濃度については1×1018cm-3とし、ドリフト層30のドーパント濃度としては3×1016cm-3とした。ドリフト層30の厚みは7μmとした。また、外周トレンチ11の幅は10μm、深さは3μmとした。裏面トレンチ12の幅は10μm、深さはドリフト層30の下面32から2μmとした。外周トレンチ11の内壁を覆う絶縁膜61は厚さ50nmのHfOとした。アノード電極40の材料は銅(Cu)とし、カソード電極50はTi/Auの積層膜とした。
 その結果、ドリフト層30に加わる最大電界は7.1MV/cmであり、酸化ガリウムの絶縁破壊電界強度である8MV/cmを十分に下回っていた。
<実施例2>
 図13に示したショットキーバリアダイオード4と同じ構造を有する実施例2のシミュレーションモデルを想定し、アノード電極40とカソード電極50の間に800Vの逆方向電圧を印加した場合の電界強度をシミュレーションした。中心トレンチ13の幅は2μm、深さは3μmとした。また、アノード電極40と接する部分におけるドリフト層30の幅、つまりメサ領域Mの幅は2μmとした。絶縁膜63は厚さ50nmのHfO膜とした。その他のパラメータは、実施例1のシミュレーションモデルと同じである。
 その結果、ドリフト層30に加わる最大電界は6.6MV/cmであり、実施例1のシミュレーションモデルよりも最大電界が低かった。
<実施例3>
 図1及び図2に示したショットキーバリアダイオード1と同じ構造を有する実施例3のシミュレーションモデルを想定し、図17に示すように、外周トレンチ11の底面に沿った水平方向の仮想線をx軸とし、外周トレンチ11の内周壁E2に沿った垂直方向の仮想線をy軸とした場合に、裏面トレンチ12の内周エッジ(裏面トレンチ12の内周壁E4と底面がぶつかる点)の座標Aと、ドリフト層30に加わる最大電界の関係をシミュレーションした。外周トレンチ11の幅は10μmとし、外周トレンチ11の外周壁E1とドリフト層30の側壁までの距離は30μmとした。その他のパラメータは、実施例1のシミュレーションモデルと同じである。
 結果を図18に示す。図18において網掛け表示しているのは、酸化ガリウムの絶縁破壊電界強度である8MV/cmに達していることを示す。図18に示すように、座標Aのx方向成分が小さいほどドリフト層30に加わる最大電界が小さく、座標Aのy方向成分が小さいほどドリフト層30に加わる最大電界が小さかった。特に、x方向成分が10μmである場合、つまり、外周トレンチ11の外周壁E1と裏面トレンチ12の内周壁E4が平面視で一致する場合、y方向成分を2μm以下とする必要があるのに対し、x方向成分が9.3μm以下である場合は、y方向成分が3.5μmであっても、最大電界は7.1MV/cm程度であった。
1~4,1A~1G,3A,4A~4C  ショットキーバリアダイオード
11  外周トレンチ
12  裏面トレンチ
13  中心トレンチ
20  半導体基板
21  半導体基板の上面
22  半導体基板の下面
30  ドリフト層
31  ドリフト層の上面
32  ドリフト層の下面
40  アノード電極
50  カソード電極
61,63  絶縁膜
70  フィールド絶縁膜
80  絶縁材料
E1,E3  外周壁
E2,E4  内周壁
M  メサ領域

Claims (6)

  1.  酸化ガリウムからなる半導体基板と、
     酸化ガリウムからなり、前記半導体基板の上面と接する下面及び前記下面の反対側に位置する上面を有し、前記上面にリング状の外周トレンチが設けられたドリフト層と、
     前記外周トレンチで囲まれた前記ドリフト層の上面とショットキー接触するとともに、前記外周トレンチの内部に絶縁膜を介して埋め込まれたアノード電極と、
     前記半導体基板の前記上面とは反対側の下面とオーミック接触するカソード電極と、を備え、
     前記半導体基板の前記下面には、底部が前記ドリフト層に達するリング状の裏面トレンチが設けられており、
     前記カソード電極は、前記半導体基板の前記下面のうち、前記裏面トレンチで囲まれた領域の外側に設けられることなく、前記裏面トレンチで囲まれた領域に設けられており、
     前記ドリフト層のうち前記外周トレンチに囲まれた領域は、平面視で前記裏面トレンチに囲まれた領域と重なりを有していることを特徴とするショットキーバリアダイオード。
  2.  前記裏面トレンチの内周壁は、平面視で前記外周トレンチの外周壁の内側に位置することを特徴とする請求項1に記載のショットキーバリアダイオード。
  3.  前記裏面トレンチの内周壁は、平面視で前記外周トレンチの内周壁と外周壁の間に位置することを特徴とする請求項2に記載のショットキーバリアダイオード。
  4.  前記外周トレンチを囲むよう、前記ドリフト層の前記上面をリング状に覆うフィールド絶縁膜をさらに備え、
     前記アノード電極の外周端は、前記フィールド絶縁膜上に位置することを特徴とする請求項1乃至3のいずれか一項に記載のショットキーバリアダイオード。
  5.  前記裏面トレンチが絶縁材料で埋め込まれていることを特徴とする請求項1乃至4のいずれか一項に記載のショットキーバリアダイオード。
  6.  前記ドリフト層の前記上面には、前記外周トレンチに囲まれた領域に形成された複数の中心トレンチが設けられており、
     前記アノード電極は、前記中心トレンチの内部に絶縁膜を介して埋め込まれていることを特徴とする請求項1乃至5のいずれか一項に記載のショットキーバリアダイオード。
PCT/JP2021/004060 2020-03-19 2021-02-04 ショットキーバリアダイオード WO2021186936A1 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
US17/802,438 US11908955B2 (en) 2020-03-19 2021-02-04 Schottky barrier diode

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2020-049789 2020-03-19
JP2020049789A JP7456220B2 (ja) 2020-03-19 2020-03-19 ショットキーバリアダイオード

Publications (1)

Publication Number Publication Date
WO2021186936A1 true WO2021186936A1 (ja) 2021-09-23

Family

ID=77771817

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2021/004060 WO2021186936A1 (ja) 2020-03-19 2021-02-04 ショットキーバリアダイオード

Country Status (3)

Country Link
US (1) US11908955B2 (ja)
JP (1) JP7456220B2 (ja)
WO (1) WO2021186936A1 (ja)

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5264281A (en) * 1975-11-21 1977-05-27 Hitachi Ltd Mesa type high dielectric strength diode or transistor
JPS5582442A (en) * 1978-12-15 1980-06-21 Westinghouse Electric Corp Semiconductor device and method of fabricating same
JPS5748240A (en) * 1980-07-10 1982-03-19 Westinghouse Electric Corp Semiconductor element and method of producing same
JP2000294740A (ja) * 1999-04-09 2000-10-20 Sansha Electric Mfg Co Ltd 半導体抵抗
WO2019082580A1 (ja) * 2017-10-26 2019-05-02 Tdk株式会社 ショットキーバリアダイオード

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5995435B2 (ja) 2011-08-02 2016-09-21 ローム株式会社 半導体装置およびその製造方法
JP6112600B2 (ja) * 2012-12-10 2017-04-12 ローム株式会社 半導体装置および半導体装置の製造方法
WO2015060441A1 (ja) * 2013-10-24 2015-04-30 ローム株式会社 半導体装置および半導体パッケージ
JP2017045969A (ja) 2015-08-28 2017-03-02 株式会社タムラ製作所 ショットキーバリアダイオード
JP6845397B2 (ja) 2016-04-28 2021-03-17 株式会社タムラ製作所 トレンチmos型ショットキーダイオード
US11380765B2 (en) * 2018-03-02 2022-07-05 Sciocs Company Limited Structure and intermediate structure

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5264281A (en) * 1975-11-21 1977-05-27 Hitachi Ltd Mesa type high dielectric strength diode or transistor
JPS5582442A (en) * 1978-12-15 1980-06-21 Westinghouse Electric Corp Semiconductor device and method of fabricating same
JPS5748240A (en) * 1980-07-10 1982-03-19 Westinghouse Electric Corp Semiconductor element and method of producing same
JP2000294740A (ja) * 1999-04-09 2000-10-20 Sansha Electric Mfg Co Ltd 半導体抵抗
WO2019082580A1 (ja) * 2017-10-26 2019-05-02 Tdk株式会社 ショットキーバリアダイオード

Also Published As

Publication number Publication date
TW202201804A (zh) 2022-01-01
US20230113129A1 (en) 2023-04-13
US11908955B2 (en) 2024-02-20
JP2021150519A (ja) 2021-09-27
JP7456220B2 (ja) 2024-03-27

Similar Documents

Publication Publication Date Title
TWI798402B (zh) 肖特基能障二極體
US11626522B2 (en) Schottky barrier diode
US11621357B2 (en) Schottky barrier diode
CN111095570B (zh) 肖特基势垒二极管
US11557681B2 (en) Schottky barrier diode
WO2021186936A1 (ja) ショットキーバリアダイオード
WO2023095395A1 (ja) ショットキーバリアダイオード
WO2023095396A1 (ja) ジャンクションバリアショットキーダイオード
US20240055536A1 (en) Schottky barrier diode
WO2023181587A1 (ja) ジャンクションバリアショットキーダイオード
JP2023141101A (ja) ジャンクションバリアショットキーダイオード

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 21772239

Country of ref document: EP

Kind code of ref document: A1

NENP Non-entry into the national phase

Ref country code: DE

122 Ep: pct application non-entry in european phase

Ref document number: 21772239

Country of ref document: EP

Kind code of ref document: A1