WO2016115797A1 - 触控电路、触控面板及显示装置 - Google Patents

触控电路、触控面板及显示装置 Download PDF

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乔赟
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李付强
孙建
李成
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京东方科技集团股份有限公司
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Abstract

提供了一种触控电路、触控面板及显示装置；所述触控电路包括输入模块(01)用于拉高第一节点(P1)的电位；复位模块(02)用于拉低第一节点(P1)的电位；上拉模块(03)用于拉高控制信号输出端(OUT)的电位；下拉模块(04)用于拉低第一节点(P1)和控制信号输出端(OUT)的电位；触控信号输出控制模块(05)用于控制触控信号输出端(TX)选择输出高频信号(TH)或公共电压信号(VCOM )，以实现触控电路输出触控信号的功能。

Description

触控电路、触控面板及显示装置 技术领域
本公开涉及显示技术领域，尤其涉及一种触控电路、触控面板及显示装置。
背景技术
目前，随着移动显示设备的不断发展，人机互动方式已由原来的机械按键模式发展到触控感知的模式，因此，显示设备中的触控电路起到至关重要的作用。
已知的一种触控面板采用如图1所示的触控电路来实现触控扫描功能，其电路结构包括多个传输门A、非门B、三态门C等门电路，以及开关晶体管T，而传输门A和非门B电路均需要两个薄膜晶体管组合实现其相应的功能，三态门C电路则需要四个薄膜晶体管实现其功能，因此，触控电路整体上需要至少32个薄膜晶体管来实现，其结构比较复杂，所需要的薄膜晶体管数量较多，因而其功耗较大。
因此，如何简化触控电路的结构，降低触控电路的功耗，是本领域技术人员亟待解决的问题。
发明内容
本公开实施例提供了一种触控电路、触控面板及显示装置，可以解决已知的触控电路结构较复杂，功耗较大的问题。
本公开实施例提供了一种触控电路，包括：输入模块、复位模块、上拉模块、下拉模块、触控信号输出控制模块，其中：
所述输入模块的控制端与信号输入端相连，输入端与高电平信号端相连，输出端与第一节点相连，所述输入模块用于在所述信号输入端的控制下拉高所述第一节点的电位；
所述复位模块的控制端与复位信号端相连，输入端与所述第一节点相连，输出端与低电平信号端相连，所述复位模块用于在所述复位信号端的控制下拉低所述第一节点的电位；
所述上拉模块的控制端与所述第一节点相连，输入端与第一时钟信号端 相连，输出端与控制信号输出端相连，所述上拉模块用于在所述第一节点和所述第一时钟信号端的控制下，拉高所述控制信号输出端的电位；
所述下拉模块连接于所述高电平信号端、所述低电平信号端、第二时钟信号端、第三时钟信号端、所述控制信号输出端以及所述第一节点之间，所述下拉模块用于在所述第二时钟信号端和第三时钟信号端的控制下，拉低所述第一节点和所述控制信号输出端的电位；
所述触控信号输出控制模块连接于所述高电平信号端、所述低电平信号端、所述控制信号输出端、低频信号端、高频信号端、公共电压信号端、截止信号端以及触控信号输出端之间，所述触控信号输出控制模块用于在所述控制信号输出端的控制下，控制所述触控信号输出端选择输出高频信号或公共电压信号。
可选地，本公开实施例提供的上述触控电路中，所述下拉模块，具体包括：第一下拉单元、第二下拉单元，第一下拉控制单元以及第二下拉控制单元；
所述第一下拉控制单元连接于所述第二时钟信号端、所述第三时钟信号端、所述高电平信号端、所述低电平信号端、所述第一节点以及第二节点之间，所述第一下拉控制单元用于在所述第二时钟信号端和所述第三时钟信号端的控制下，拉高所述第二节点的电位；
所述第二下拉控制单元的控制端与所述第一节点相连，输入端与所述第二节点相连，输出端与所述低电平信号端相连，所述第二下拉控制单元用于在所述第一节点的电位被拉高时，拉低所述第二节点的电位；
所述第一下拉单元的控制端与所述第二节点相连，输入端与所述控制信号输出端相连，输出端与所述低电平信号端相连，所述第一下拉单元用于在所述第二节点的电位被拉高时，拉低所述控制信号输出端的电位；
所述第二下拉单元的控制端与所述第二节点相连，输入端与所述第一节点相连，输出端与所述低电平信号端相连，所述第二下拉单元用于在所述第二节点的电位被拉高时，拉低所述第一节点的电位。
可选地，本公开实施例提供的上述触控电路中，所述第一下拉单元，具体包括：第一开关晶体管和第一电容；
所述第一开关晶体管的栅极与所述第二节点相连，源极与所述控制信号输出端相连，漏极与所述低电平信号端相连；
所述第一电容连接于所述第二节点和所述低电平信号端之间。
可选地，本公开实施例提供的上述触控电路中，所述第二下拉单元，具体包括：第二开关晶体管；
所述第二开关晶体管的栅极与所述第二节点相连，源极与所述第一节点相连，漏极与所述低电平信号端相连。
可选地，本公开实施例提供的上述触控电路中，所述第一下拉控制单元，具体包括：第三开关晶体管、第四开关晶体管和第五开关晶体管；
所述第三开关晶体管的栅极与所述第二时钟信号端相连，源极与所述高电平信号端相连，漏极分别与所述第四开关晶体管的源极和所述第五开关晶体管的栅极相连；
所述第四开关晶体管的栅极与所述第三时钟信号端相连，漏极与所述低电平信号端相连；
所述第五开关晶体管的源极与所述高电平信号端相连，漏极与所述第二节点相连。
可选地，本公开实施例提供的上述触控电路中，所述第二下拉控制单元，具体包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述第一节点相连，源极与所述第二节点相连，漏极与所述低电平信号端相连。
可选地，本公开实施例提供的上述触控电路中，所述触控信号输出控制模块，具体包括：高频信号输出控制单元、公共电压信号输出控制单元、第三节点上拉单元以及第三节点下拉单元；
所述第三节点上拉单元的控制端与所述控制信号输出端相连，输入端与所述低频信号端相连，输出端与所述第三节点相连，所述第三节点上拉单元用于在所述控制信号输出端的电位被拉高时，拉高所述第三节点的电位；
所述第三节点下拉单元的控制端与所述截止信号端相连，输入端与所述第三节点相连，输出端与所述低电平信号端相连，所述第三节点下拉单元用于在所述截止信号端的控制下，拉低所述第三节点的电位；
所述高频信号输出控制单元的控制端与所述第三节点相连，输入端与所述高频信号端相连，输出端与所述触控信号输出端相连，所述高频信号输出控制单元用于在所述第三节点的电位被拉高时，控制所述触控信号输出端输出高频信号；
所述公共电压信号输出控制单元连接于所述第三节点、所述低电平信号端、所述高电平信号端、所述公共电压信号端，以及所述触控信号输出端之间，所述公共电压信号输出控制单元用于在所述第三节点的电位被拉低时，控制所述触控信号输出端输出公共电压信号。
可选地，本公开实施例提供的上述触控电路中，所述第三节点上拉单元，具体包括：第七开关晶体管；
所述第七开关晶体管的栅极与所述控制信号输出端相连，源极与所述低频信号端相连，漏极与所述第三节点相连。
可选地，本公开实施例提供的上述触控电路中，所述第三节点下拉单元，具体包括：第八开关晶体管；
所述第八开关晶体管的栅极与所述截止信号端相连，源极与所述第三节点相连，漏极与所述低电平信号端相连。
可选地，本公开实施例提供的上述触控电路中，所述高频信号输出控制单元，具体包括：第九开关晶体管和第二电容；
所述第九开关晶体管的栅极与所述第三节点相连，源极与所述高频信号端相连，漏极与所述触控信号输出端相连；
所述第二电容连接于所述第三节点和所述触控信号输出端之间。
可选地，本公开实施例提供的上述触控电路中，所述公共电压信号输出控制单元，具体包括：第十开关晶体管、第十一开关晶体管和第三电容；
所述第十开关晶体管的栅极与所述第三节点相连，源极分别与所述高电平信号端和所述第十一开关晶体管的栅极相连，漏极与所述低电平信号端相连；
所述第十一开关晶体管的源极与所述公共电压信号端相连，漏极与所述触控信号输出端相连；
所述第三电容连接于所述高电平信号端和所述低电平信号端之间。
可选地，本公开实施例提供的上述触控电路中，所述公共电压信号输出控制单元，还包括：第十二开关晶体管；
所述第十二开关晶体管的的栅极和源极与所述高电平信号端相连，漏极分别与所述第十开关晶体管的源极和所述第十一开关晶体管的栅极相连。
可选地，本公开实施例提供的上述触控电路中，所述输入模块，具体包括：第十三开关晶体管；
所述第十三开关晶体管的栅极与所述信号输入端相连，源极与所述高电平信号端相连，漏极与所述第一节点相连。
可选地，本公开实施例提供的上述触控电路中，所述复位模块，具体包括：第十四开关晶体管；
所述第十四开关晶体管的栅极与所述复位信号端相连，源极与所述第一节点相连，漏极与所述低电平信号端相连。
可选地，本公开实施例提供的上述触控电路中，所述上拉模块，具体包括：第十五开关晶体管和第四电容；
所述第十五开关晶体管的栅极与所述第一节点相连，源极与所述第一时钟信号端相连，漏极与所述控制信号输出端相连；
所述第四电容连接于所述第一节点和所述控制信号输出端之间。
本公开实施例提供了一种触控面板，包括级联的多个本公开实施例提供的上述触控电路，除首级触控电路和末级触控电路之外，其它各触控电路的控制信号输出端均向与其相邻的下一级触控电路的信号输入端相连，并与其相邻的上一级触控电路的复位信号端相连；首级触控电路的控制信号输出端与第二级触控电路的信号输入端相连；末级触控电路的控制信号输出端与上一级触控电路的复位信号端相连。
本公开实施例提供了一种显示装置，包括本公开实施例提供的上述触控面板。
本公开实施例提供了一种触控电路、触控面板及显示装置，该触控电路包括输入模块、复位模块、上拉模块、下拉模块、触控信号输出控制模块，其中，输入模块用于在信号输入端的控制下拉高第一节点的电位；复位模块用于在复位信号端的控制下拉低第一节点的电位；上拉模块用于在第一节点和第一时钟信号端的控制下，拉高控制信号输出端的电位；下拉模块用于在第二时钟信号端和第三时钟信号端的控制下，拉低第一节点和控制信号输出端的电位；触控信号输出控制模块用于在控制信号输出端的控制下，控制触控信号输出端选择输出高频信号或公共电压信号，这样实现了触控电路输出触控信号的功能，相对于已知的需要采用较多的薄膜晶体管搭建传输门、反相器以及三态门电路进而构成的触控电路，本公开实施例提供的触控电路结构简单，功耗较低。
附图说明
图1为一种已知的触控电路的结构示意图；
图2为本公开实施例提供的触控电路的结构示意图之一；
图3为本公开实施例提供的触控电路中下拉模块的结构示意图；
图4为本公开实施例提供的触控电路中下拉模块的具体结构示意图；
图5为本公开实施例提供的触控电路中触控信号输出控制模块的结构示意图；
图6为本公开实施例提供的触控电路中触控信号输出控制模块的具体结构示意图；
图7为本公开实施例提供的触控电路的具体结构示意图；
图8为本公开实施例提供的触控电路的工作时序示意图；
图9为本公开实施例提供的级联的触控电路依次输出触控信号的工作时序示意图。
具体实施方式
下面结合附图，对本公开实施例提供的触控电路、触控面板及显示装置的具体实施方式进行详细地说明。
本公开实施例提供了一种触控电路，如图2所示，可以包括：输入模块01、复位模块02、上拉模块03、下拉模块04、触控信号输出控制模块05，其中：
输入模块01的控制端与信号输入端Input相连，输入端与高电平信号端VGH相连，输出端与第一节点P1相连，输入模块01用于在信号输入端Input的控制下拉高第一节点P1的电位；
复位模块02的控制端与复位信号端Reset相连，输入端与第一节点P1相连，输出端与低电平信号端VGL相连，复位模块02用于在复位信号端Reset的控制下拉低第一节点P1的电位；
上拉模块03的控制端与第一节点P1相连，输入端与第一时钟信号端CLK1相连，输出端与控制信号输出端OUT相连，上拉模块03用于在第一节点P1和第一时钟信号端CLK1的控制下，拉高控制信号输出端OUT的电位；
下拉模块04连接于高电平信号端VGH、低电平信号端VGL、第二时钟 信号端CLK2、第三时钟信号端CLK3、控制信号输出端OUT以及第一节点P1之间，下拉模块04用于在第二时钟信号端CLK2和第三时钟信号端CLK3的控制下，拉低第一节点P1和控制信号输出端OUT的电位；
触控信号输出控制模块05连接于高电平信号端VGH、低电平信号端VGL、控制信号输出端OUT、低频信号端TL、高频信号端TH、公共电压信号端VCOM、截止信号端END以及触控信号输出端TX之间，触控信号输出控制模块05用于在控制信号输出端OUT的控制下，控制触控信号输出端TX选择输出高频信号或公共电压信号。
本公开实施例提供的上述触控电路中，包括输入模块01、复位模块02、上拉模块03、下拉模块04、触控信号输出控制模块05，其中，输入模块01用于在信号输入端Input的控制下拉高第一节点P1的电位；复位模块02用于在复位信号端Reset的控制下拉低第一节点P1的电位；上拉模块03用于在第一节点P1和第一时钟信号端CLK1的控制下，拉高控制信号输出端OUT的电位；下拉模块04用于在第二时钟信号端CLK2和第三时钟信号端CLK3的控制下，拉低第一节点P1和控制信号输出端OUT的电位；触控信号输出控制模块05用于在控制信号输出端OUT的控制下，控制触控信号输出端TX选择输出高频信号或公共电压信号，这样实现了触控电路输出触控信号的功能，相对于现有技术中需要采用较多的薄膜晶体管搭建传输门、反相器以及三态门电路进而构成的触控电路，本公开实施例提供的触控电路结构简单，功耗较低。
在具体实施时，本公开实施例提供的上述触控电路中，如图3所示，下拉模块04，可以具体包括：第一下拉单元041、第二下拉单元042，第一下拉控制单元043以及第二下拉控制单元044；
第一下拉控制单元043连接于第二时钟信号端CLK2、第三时钟信号端CLK3、高电平信号端VGH、低电平信号端VGL、第一节点P1以及第二节点P2之间，第一下拉控制单元043用于在第二时钟信号端CLK2和第三时钟信号端CLK3的控制下，拉高第二节点P2的电位；
第二下拉控制单元044的控制端与第一节点P1相连，输入端与第二节点P2相连，输出端与低电平信号端VGL相连，第二下拉控制单元044用于在第一节点P1的电位被拉高时，拉低第二节点P2的电位；
第一下拉单元041的控制端与第二节点P2相连，输入端与控制信号输出 端OUT相连，输出端与低电平信号端VGL相连，第一下拉单元041用于在第二节点P2的电位被拉高时，拉低控制信号输出端OUT的电位；
第二下拉单元042的控制端与第二节点P2相连，输入端与第一节点P1相连，输出端与低电平信号端VGL相连，第二下拉单元042用于在第二节点P2的电位被拉高时，拉低第一节点P1的电位。
具体地，本公开实施例提供的上述触控电路中，第一下拉控制单元043在第二时钟信号端CLK2和第三时钟信号端CLK3的控制下将第二节点P2的电位拉高，第一下拉单元041则在第二节点P2的电位被拉高时，拉低控制信号输出端OUT的电位；第二下拉单元042则在第二节点P2的电位被拉高时，拉低第一节点P1的电位，由此下拉模块04实现了在第二时钟信号端CLK2和第三时钟信号端CLK3的控制下，拉低第一节点P1和控制信号输出端OUT的电位的功能。
在具体实施时，本公开实施例提供的上述触控电路中，如图4所示，第一下拉单元041，可以具体包括：第一开关晶体管T1和第一电容C1；
第一开关晶体管T1的栅极与第二节点P2相连，源极与控制信号输出端OUT相连，漏极与低电平信号端VGL相连；
第一电容C1连接于第二节点P2和低电平信号端VGL之间。
具体地，本公开实施例提供的上述触控电路中，第二节点P2的电位被拉高时，第一开关晶体管T1处于导通状态，导通的第一开关晶体管T1将低电平信号端VGL与控制信号输出端OUT导通，进而拉低控制信号输出端OUT的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图4所示，第二下拉单元042，可以具体包括：第二开关晶体管T2；
第二开关晶体管T2的栅极与第二节点P2相连，源极与第一节点P1相连，漏极与低电平信号端VGL相连。
具体地，本公开实施例提供的上述触控电路中，第二节点P2的电位被拉高时，第二开关晶体管T2处于导通状态，导通的第二开关晶体管T2将低电平信号端VGL与第一节点P1导通，进而拉低第一节点P1的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图4所示，第一下拉控制单元043，可以具体包括：第三开关晶体管T3、第四开关晶体管T4和第五开关晶体管T5；
第三开关晶体管T3的栅极与第二时钟信号端CLK2相连，源极与高电平信号端VGH相连，漏极分别与第四开关晶体管T4的源极和第五开关晶体管T5的栅极相连；
第四开关晶体管T4的栅极与第三时钟信号端CLK3相连，漏极与低电平信号端VGL相连；
第五开关晶体管T5的源极与高电平信号端VGH相连，漏极与第二节点P2相连。
具体地，本公开实施例提供的上述触控电路中，在第二时钟信号端CLK2输入高电平信号且第三时钟信号端CLK3输入低电平信号时，第三开关晶体管T3处于导通状态，第四开关晶体管T4处于截止状态，导通的第三开关晶体管T3将高电平信号端VGH与第五开关晶体管T5的栅极导通，控制第五开关晶体管T5导通，导通的第五开关晶体管T5将高电平信号端VGH与第二节点P2导通，拉高第二节点P2的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图4所示，第二下拉控制单元044，可以具体包括：第六开关晶体管T6；
第六开关晶体管T6的栅极与第一节点P1相连，源极与第二节点P2相连，漏极与低电平信号端VGL相连。
具体地，本公开实施例提供的上述触控电路中，第一节点P1的电位被拉高时，第六开关晶体管T6处于导通状态，导通的第六开关晶体管T6将低电平信号端VGL与第二节点P2导通，进而拉低第二节点P2的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图5所示，触控信号输出控制模块05，可以具体包括：高频信号输出控制单元051、公共电压信号输出控制单元052、第三节点上拉单元053以及第三节点下拉单元054；
第三节点上拉单元053的控制端与控制信号输出端OUT相连，输入端与低频信号端TL相连，输出端与第三节点P3相连，第三节点上拉单元053用于在控制信号输出端OUT的电位被拉高时，拉高第三节点P3的电位；
第三节点下拉单元054的控制端与截止信号端END相连，输入端与第三节点P3相连，输出端与低电平信号端VGL相连，第三节点下拉单元054用于在截止信号端END的控制下，拉低第三节点P3的电位；
高频信号输出控制单元051的控制端与第三节点P3相连，输入端与高频 信号端TH相连，输出端与触控信号输出端TX相连，高频信号输出控制单元051用于在第三节点P3的电位被拉高时，控制触控信号输出端TX输出高频信号；
公共电压信号输出控制单元052连接于第三节点P3、低电平信号端VGL、高电平信号端VGH、公共电压信号端VCOM，以及触控信号输出端TX之间，公共电压信号输出控制单元052用于在第三节点P3的电位被拉低时，控制触控信号输出端TX输出公共电压信号。
具体地，本公开实施例提供的上述触控电路中，第三节点上拉单元053在控制信号输出端OUT的电位被拉高时，拉高第三节点P3的电位，第三节点下拉单元054在截止信号端END输入高电平信号时，拉低第三节点P3的电位；高频信号输出控制单元051在第三节点P3的电位被拉高时，控制触控信号输出端TX输出高频信号；公共电压信号输出控制单元052在第三节点P3的电位被拉低时，控制触控信号输出端TX输出公共电压信号，由此实现触控信号输出控制模块05在控制信号输出端OUT的控制下，选择输出高频信号或公共电压信号的功能。
在具体实施时，本公开实施例提供的上述触控电路中，如图6所示，第三节点上拉单元053，可以具体包括：第七开关晶体管T7；
第七开关晶体管T7的栅极与控制信号输出端OUT相连，源极与低频信号端TL相连，漏极与第三节点P3相连。
具体地，本公开实施例提供的上述触控电路中，控制信号输出端OUT的电位被拉高时，第七开关晶体管T7处于导通状态，导通的第七开关晶体管T7将低频信号端TL与第三节点P3导通，进而拉高第三节点P3的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图6所示，第三节点下拉单元054，可以具体包括：第八开关晶体管T8；
第八开关晶体管T8的栅极与截止信号端END相连，源极与第三节点P3相连，漏极与低电平信号端VGL相连。
具体地，本公开实施例提供的上述触控电路中，截止信号端END输入高电平信号时，第八开关晶体管T8处于导通状态，导通的第八开关晶体管T8将低电平信号端VGL与第三节点P3导通，进而拉低第三节点P3的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图6所示，高频信号输出控制单元051，可以具体包括：第九开关晶体管T9和第二电容 C2；
第九开关晶体管T9的栅极与第三节点P3相连，源极与高频信号端TH相连，漏极与触控信号输出端TX相连；
第二电容C2连接于第三节点P3和触控信号输出端TX之间。
具体地，本公开实施例提供的上述触控电路中，第三节点P3的电位被拉高时，第九开关晶体管T9处于导通状态，导通的第九开关晶体管T9将高频信号端TH与触控信号输出端TX导通，进而使触控信号输出端TX输出高频信号。
在具体实施时，本公开实施例提供的上述触控电路中，如图6所示，公共电压信号输出控制单元052，可以具体包括：第十开关晶体管T10、第十一开关晶体管T11和第三电容C3；
第十开关晶体管T10的栅极与第三节点P3相连，源极分别与高电平信号端VGH和第十一开关晶体管T11的栅极相连，漏极与低电平信号端VGL相连；
第十一开关晶体管T11的源极与公共电压信号端VCOM相连，漏极与触控信号输出端相连TX；
第三电容C3连接于高电平信号端VGH和低电平信号端VGL之间。
具体地，本公开实施例提供的上述触控电路中，第三节点P3的电位被拉高时，第十开关晶体管T10处于导通状态，导通的第十开关晶体管T10将第十一开关晶体管T11的栅极与低电平信号端VGL导通，使第十一开关晶体管T11截止，且第十开关晶体管T10的尺寸较大，这样可以增大其分压的作用，可以很好地拉低第十一开关晶体管T11的栅极电压，保证第十一开关晶体管T11处于完全截止状态；第三节点P3的电位被拉低时，第十开关晶体管T10处于截止状态，由于第十一开关晶体管T11的栅极与高电平信号端VGH相连，因此第十一开关晶体管T11处于导通状态，导通的第十一开关晶体管T11将公共电压信号端VCOM与触控信号输出端TX导通，进而使触控信号输出端TX输出公共电压信号。
在具体实施时，本公开实施例提供的上述触控电路中，如图7所示，公共电压信号输出控制单元，还可以包括：第十二开关晶体管T12；
第十二开关晶体管T12的的栅极和源极与高电平信号端VGH相连，漏极分别与第十开关晶体管T10的源极和第十一开关晶体管T11的栅极相连。
具体地，本公开实施例提供的上述触控电路中，第十二开关晶体管T12以二极管的的连接方式将高电平信号端VGH与第十开关晶体管T10的源极和第十一开关晶体管T11的栅极连接，一直处于常开状态，在第十开关晶体管T10处于截止状态时，将高电平信号端VGH输入的高电平信号传递给第十一开关晶体管T11的栅极，使第十一开关晶体管T11处于导通状态，导通的第十一开关晶体管T11将公共电压信号端VCOM与触控信号输出端TX导通，进而使触控信号输出端TX输出公共电压信号。
在具体实施时，本公开实施例提供的上述触控电路中，如图7所示，输入模块01，可以具体包括：第十三开关晶体管T13；
第十三开关晶体管T13的栅极与信号输入端Input相连，源极与高电平信号端VGH相连，漏极与第一节点P1相连。
具体地，本公开实施例提供的上述触控电路中，信号输入端Input输入高电平信号时，第十三开关晶体管T13处于导通状态，导通的第十三开关晶体管T13将高电平信号端VGH与第一节点P1导通，拉高第一节点P1的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图7所示，复位模块02，可以具体包括：第十四开关晶体管T14；
第十四开关晶体管T14的栅极与复位信号端Reset相连，源极与第一节点P1相连，漏极与低电平信号端VGL相连。
具体地，本公开实施例提供的上述触控电路中，复位信号端Reset输入高电平信号时，第十四开关晶体管T14处于导通状态，导通的第十四开关晶体管T14将低电平信号端VGL与第一节点P1导通，拉低第一节点P1的电位。
在具体实施时，本公开实施例提供的上述触控电路中，如图7所示，上拉模块03，可以具体包括：第十五开关晶体管T15和第四电容C4；
第十五开关晶体管T15的栅极与第一节点P1相连，源极与第一时钟信号端CLK1相连，漏极与控制信号输出端OUT相连；
第四电容C4连接于第一节点P1和控制信号输出端OUT之间。
具体地，本公开实施例提供的上述触控电路中，第一节点P1的电位被拉高时，第十五开关晶体管T15处于导通状态，导通的第十五开关晶体管T15将第一时钟信号端CLK1与控制信号输出端OUT导通，将第一时钟信号端CLK1的信号传递给控制信号输出端OUT。
基于同一发明构思，本公开实施例提供了一种触控面板，包括级联的多个本公开实施例提供的上述触控电路，除首级触控电路和末级触控电路之外，其它各触控电路的控制信号输出端均向与其相邻的下一级触控电路的信号输入端相连，并与其相邻的上一级触控电路的复位信号端相连；首级触控电路的控制信号输出端与第二级触控电路的信号输入端相连；末级触控电路的控制信号输出端与上一级触控电路的复位信号端相连。
需要说明的是本公开上述实施例中提到的开关晶体管可以为N型薄膜晶体管(TFT，Thin Film Transistor)。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。实际上，由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，为区分晶体管除栅极之外的两极，将其中一极称为源极，另一极称为漏极。若选取源极作为信号输入端、则漏极作为信号输出端，反之亦然。本公开实施例提供的触控电路中各模块可以全部采用N型薄膜晶体管构成，即总共需要十五个NMOS晶体管和四个电容构成触控电路，与显示面板中用于驱动显示面板实现显示功能的N型薄膜晶体管驱动电路有更好的匹配性，相对于已知的需要采用较多的薄膜晶体管搭建传输门、反相器以及三态门电路进而构成的触控电路，本公开实施例提供的触控电路采用的N型薄膜晶体管数量较少，因此本公开实施例提供的触控电路结构简单，功耗较低。
另外，本公开实施例提供的触控面板的级联的触控电路中，每一级触控电路均有三个时钟信号端，从首级触控电路开始，以相邻的级联的四个触控电路为一组，每组中第一个触控电路到第四个触控电路的第一时钟信号端CLK1输入的时钟信号依次为时钟信号CK1、CK2、CK3、CK4，每组中第一个触控电路到第四个触控电路的第二时钟信号端CLK2输入的时钟信号依次为时钟信号CK2、CK3、CK4、CK1，每组中第一个触控电路到第四个触控电路的第三时钟信号端CLK3输入的时钟信号依次为时钟信号CK4、CK1、CK2、CK3。
此外，本公开实施例提供的上述触控电路中，低频信号端TL输入的低频信号的脉冲宽度至少为高频信号端TH输入的高频信号的脉冲宽度的两倍，在触控信号输出端TX输出高频信号时，在低频信号端TL输入的低频信号的脉冲宽度内对触控信号输出端TX输出高频信号进行采样选择，决定了触控信号输出端TX每一次输出高频信号时，输出的高频信号有几个，例如，低 频信号的脉冲宽度为高频信号的脉冲宽度的两倍，则触控信号输出端TX每次输出高频信号时，输出两个高频信号。
下面结合本公开实施例提供的触控电路和工作时序对本公开实施例提供的触控电路的工作过程进行详细描述。以如图7所示的触控电路以及图8所示的输入输出时序图，对本公开实施例提供的触控电路的工作过程作以描述。具体地，选取如图8所示的输入输出时序图中的t1～t2两个阶段。下述描述中以1表示高电平信号，0表示低电平信号。
在t1阶段，Input＝1，TL＝1，TH＝1，CK1＝1，CK2＝0，CK3＝0，CK4＝0，Reset＝0，END＝0。由于Input＝1，因此第十三开关晶体管T13导通，导通的第十三开关晶体管T13将高电平信号端VGH与第一节点P1导通，因此第一节点P1的电位被拉高为高电平，因此第六开关晶体管T6和第十五开关晶体管T15导通，导通的第六开关晶体管T6将低电平信号端VGL与第二节点P2导通，因此第二节点P2的电位被拉低，第一开关晶体管T1和第二开关晶体管T2截止；导通的第十五开关晶体管T15将第一时钟信号端CLK1与控制信号输出端OUT导通，由于CK1＝1，因此控制信号输出端OUT的电位被拉高，由此第七开关晶体管T7处于导通状态，导通的第七开关晶体管T7将低频信号端TL与第三节点P3导通，由于TL＝1，因此第三节点P3的电位被拉高，由此第九开关晶体管T9和第十开关晶体管T10处于导通状态，导通的第十开关晶体管T10将低电平信号端VGL与第十一开关晶体管的栅极和第十二开关晶体管的漏极导通，因此第十一开关晶体管T11截止，而导通的第九开关晶体管T9将高频信号端TH与触控信号输出端TX导通，使触控信号输出端TX根据低频信号端TL输入的低频信号的脉冲宽度输出高频信号。t1阶段为触控信号输出端TX输出高频信号的阶段。
在t2阶段，Input＝0，TL＝1，TH＝1，CK1＝0，CK2＝1，CK3＝0，CK4＝0，Reset＝1，END＝0。由于Reset＝1，因此第十四开关晶体管T14导通，导通的第十四开关晶体管T14将低电平信号端VGL与第一节点P1导通，因此第一节点P1的电位被拉低为低电平。由于CK2＝1，因此第三开关晶体管T3导通，导通的第三开关晶体管T3将高电平信号端VGH与第五开关晶体管T5的栅极导通，因此第五开关晶体管T5导通，导通的第五开关晶体管T5将高电平信号端VGH与第二节点P2导通，因此第二节点P2的电位被拉高为高电平，因此第一开关晶体管T1和第二开关晶体管T2导通，导通的第一开关晶体管 T1将控制信号输出端OUT与低电平信号端VGL导通，因此，控制信号输出端OUT的电位被拉低为低电平，因此第七开关晶体管T7截止，导致第九开关晶体管T9和第十开关晶体管T10截止，而导通的第二开关晶体管T2将低电平信号端VGL与第一节点P1导通，进一步拉低第一节点P1的电位。由于第十二开关晶体管T12处于常开状态，且此时第十开关晶体管T10处于截止状态，因此第十一开关晶体管T11的栅极通过第十二开关晶体管T12与高电平信号端VGH导通，因此第十一开关晶体管T11导通，导通的第十一开关晶体管T11将公共电压信号端VCOM与触控信号输出端TX导通，使触控信号输出端TX输出公共电压信号。t2阶段为触控信号输出端TX输出公共电压信号的阶段。
在后续时间段，触控信号输出端将一直输出公共电压信号，直到某个时间段信号输入端Input再次输入高电平为止。
上述过程为一个触控电路分别输出高频信号和公共电压信号的工作过程，在触控面板整个级联的触控电路中，在各个信号控制端的控制下，每级触控电路按照上述工作过程分别输出高频信号或公共电压信号，如图9所示，最终实现了触控电路逐级输出高频信号的功能，即实现了触控面板逐行触控扫描的过程。
基于同一发明构思，本公开实施例提供了一种显示装置，包括本公开实施例提供的上述触控面板。该显示装置可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示装置解决问题的原理与触控电路相似，因此该显示装置的实施可以参见上述触控电路的实施，重复之处不再赘述。
本公开实施例提供了一种触控电路、触控面板及显示装置，该触控电路包括输入模块、复位模块、上拉模块、下拉模块、触控信号输出控制模块，其中，输入模块用于在信号输入端的控制下拉高第一节点的电位；复位模块用于在复位信号端的控制下拉低第一节点的电位；上拉模块用于在第一节点和第一时钟信号端的控制下，拉高控制信号输出端的电位；下拉模块用于在第二时钟信号端和第三时钟信号端的控制下，拉低第一节点和控制信号输出端的电位；触控信号输出控制模块用于在控制信号输出端的控制下，控制触控信号输出端选择输出高频信号或公共电压信号，这样实现了触控电路输出触控信号的功能，相对于已知的需要采用较多的薄膜晶体管搭建传输门、反 相器以及三态门电路进而构成的触控电路，本公开实施例提供的触控电路结构简单，功耗较低。
显然，本领域的技术人员可以对本公开进行各种改动和变型而不脱离本公开的精神和范围。这样，倘若本公开的这些修改和变型属于本公开权利要求及其等同技术的范围之内，则本公开也意图包含这些改动和变型在内。
本申请要求于2015年1月21日递交的中国专利申请第201510030501.9号的优先权，在此全文引用上述中国专利申请公开的内容以作为本申请的一部分。

Claims (17)

  1. 一种触控电路，包括：输入模块、复位模块、上拉模块、下拉模块、触控信号输出控制模块，其中：
    所述输入模块的控制端与信号输入端相连，输入端与高电平信号端相连，输出端与第一节点相连，所述输入模块用于在所述信号输入端的控制下拉高所述第一节点的电位；
    所述复位模块的控制端与复位信号端相连，输入端与所述第一节点相连，输出端与低电平信号端相连，所述复位模块用于在所述复位信号端的控制下拉低所述第一节点的电位；
    所述上拉模块的控制端与所述第一节点相连，输入端与第一时钟信号端相连，输出端与控制信号输出端相连，所述上拉模块用于在所述第一节点和所述第一时钟信号端的控制下，拉高所述控制信号输出端的电位；
    所述下拉模块连接于所述高电平信号端、所述低电平信号端、第二时钟信号端、第三时钟信号端、所述控制信号输出端以及所述第一节点之间，所述下拉模块用于在所述第二时钟信号端和第三时钟信号端的控制下，拉低所述第一节点和所述控制信号输出端的电位；
    所述触控信号输出控制模块连接于所述高电平信号端、所述低电平信号端、所述控制信号输出端、低频信号端、高频信号端、公共电压信号端、截止信号端以及触控信号输出端之间，所述触控信号输出控制模块用于在所述控制信号输出端的控制下，控制所述触控信号输出端选择输出高频信号或公共电压信号。
  2. 如权利要求1所述的触控电路，其中，所述下拉模块包括：第一下拉单元、第二下拉单元，第一下拉控制单元以及第二下拉控制单元；
    所述第一下拉控制单元连接于所述第二时钟信号端、所述第三时钟信号端、所述高电平信号端、所述低电平信号端、所述第一节点以及第二节点之间，所述第一下拉控制单元用于在所述第二时钟信号端和所述第三时钟信号端的控制下，拉高所述第二节点的电位；
    所述第二下拉控制单元的控制端与所述第一节点相连，输入端与所述第二节点相连，输出端与所述低电平信号端相连，所述第二下拉控制单元用于 在所述第一节点的电位被拉高时，拉低所述第二节点的电位；
    所述第一下拉单元的控制端与所述第二节点相连，输入端与所述控制信号输出端相连，输出端与所述低电平信号端相连，所述第一下拉单元用于在所述第二节点的电位被拉高时，拉低所述控制信号输出端的电位；
    所述第二下拉单元的控制端与所述第二节点相连，输入端与所述第一节点相连，输出端与所述低电平信号端相连，所述第二下拉单元用于在所述第二节点的电位被拉高时，拉低所述第一节点的电位。
  3. 如权利要求2所述的触控电路，其中，所述第一下拉单元，包括：第一开关晶体管和第一电容；
    所述第一开关晶体管的栅极与所述第二节点相连，源极与所述控制信号输出端相连，漏极与所述低电平信号端相连；
    所述第一电容连接于所述第二节点和所述低电平信号端之间。
  4. 如权利要求2或3所述的触控电路，其中，所述第二下拉单元，包括：第二开关晶体管；
    所述第二开关晶体管的栅极与所述第二节点相连，源极与所述第一节点相连，漏极与所述低电平信号端相连。
  5. 如权利要求2-4任一项所述的触控电路，其中，所述第一下拉控制单元，包括：第三开关晶体管、第四开关晶体管和第五开关晶体管；
    所述第三开关晶体管的栅极与所述第二时钟信号端相连，源极与所述高电平信号端相连，漏极分别与所述第四开关晶体管的源极和所述第五开关晶体管的栅极相连；
    所述第四开关晶体管的栅极与所述第三时钟信号端相连，漏极与所述低电平信号端相连；
    所述第五开关晶体管的源极与所述高电平信号端相连，漏极与所述第二节点相连。
  6. 如权利要求2-5任一项所述的触控电路，其中，所述第二下拉控制单元，包括：第六开关晶体管；
    所述第六开关晶体管的栅极与所述第一节点相连，源极与所述第二节点相连，漏极与所述低电平信号端相连。
  7. 如权利要求1-6任一项所述的触控电路，其中，所述触控信号输出控制模块，包括：高频信号输出控制单元、公共电压信号输出控制单元、第三 节点上拉单元以及第三节点下拉单元；
    所述第三节点上拉单元的控制端与所述控制信号输出端相连，输入端与所述低频信号端相连，输出端与所述第三节点相连，所述第三节点上拉单元用于在所述控制信号输出端的电位被拉高时，拉高所述第三节点的电位；
    所述第三节点下拉单元的控制端与所述截止信号端相连，输入端与所述第三节点相连，输出端与所述低电平信号端相连，所述第三节点下拉单元用于在所述截止信号端的控制下，拉低所述第三节点的电位；
    所述高频信号输出控制单元的控制端与所述第三节点相连，输入端与所述高频信号端相连，输出端与所述触控信号输出端相连，所述高频信号输出控制单元用于在所述第三节点的电位被拉高时，控制所述触控信号输出端输出高频信号；
    所述公共电压信号输出控制单元连接于所述第三节点、所述低电平信号端、所述高电平信号端、所述公共电压信号端，以及所述触控信号输出端之间，所述公共电压信号输出控制单元用于在所述第三节点的电位被拉低时，控制所述触控信号输出端输出公共电压信号。
  8. 如权利要求7所述的触控电路，其中，所述第三节点上拉单元，包括：第七开关晶体管；
    所述第七开关晶体管的栅极与所述控制信号输出端相连，源极与所述低频信号端相连，漏极与所述第三节点相连。
  9. 如权利要求7或8所述的触控电路，其中，所述第三节点下拉单元，包括：第八开关晶体管；
    所述第八开关晶体管的栅极与所述截止信号端相连，源极与所述第三节点相连，漏极与所述低电平信号端相连。
  10. 如权利要求7-9任一项所述的触控电路，其中，所述高频信号输出控制单元，包括：第九开关晶体管和第二电容；
    所述第九开关晶体管的栅极与所述第三节点相连，源极与所述高频信号端相连，漏极与所述触控信号输出端相连；
    所述第二电容连接于所述第三节点和所述触控信号输出端之间。
  11. 如权利要求7-10任一项所述的触控电路，其中，所述公共电压信号输出控制单元，包括：第十开关晶体管、第十一开关晶体管和第三电容；
    所述第十开关晶体管的栅极与所述第三节点相连，源极分别与所述高电 平信号端和所述第十一开关晶体管的栅极相连，漏极与所述低电平信号端相连；
    所述第十一开关晶体管的源极与所述公共电压信号端相连，漏极与所述触控信号输出端相连；
    所述第三电容连接于所述高电平信号端和所述低电平信号端之间。
  12. 如权利要求11所述的触控电路，其中，所述公共电压信号输出控制单元，还包括：第十二开关晶体管；
    所述第十二开关晶体管的的栅极和源极与所述高电平信号端相连，漏极分别与所述第十开关晶体管的源极和所述第十一开关晶体管的栅极相连。
  13. 如权利要求1-12任一项所述的触控电路，其中，所述输入模块，包括：第十三开关晶体管；
    所述第十三开关晶体管的栅极与所述信号输入端相连，源极与所述高电平信号端相连，漏极与所述第一节点相连。
  14. 如权利要求1-13任一项所述的触控电路，其中，所述复位模块，包括：第十四开关晶体管；
    所述第十四开关晶体管的栅极与所述复位信号端相连，源极与所述第一节点相连，漏极与所述低电平信号端相连。
  15. 如权利要求1-14任一项所述的触控电路，其中，所述上拉模块，包括：第十五开关晶体管和第四电容；
    所述第十五开关晶体管的栅极与所述第一节点相连，源极与所述第一时钟信号端相连，漏极与所述控制信号输出端相连；
    所述第四电容连接于所述第一节点和所述控制信号输出端之间。
  16. 一种触控面板，包括级联的多个如权利要求1-15任一项所述的触控电路，除首级触控电路和末级触控电路之外，其它各触控电路的控制信号输出端均与其相邻的下一级触控电路的信号输入端相连，并与其相邻的上一级触控电路的复位信号端相连；首级触控电路的控制信号输出端与第二级触控电路的信号输入端相连；末级触控电路的控制信号输出端与上一级触控电路的复位信号端相连。
  17. 一种显示装置，包括如权利要求16所述的触控面板。
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