WO2008062622A1 - Dispositif d'égalisation de forme d'onde - Google Patents

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Yousuke Kimura
Haruka Takano
Hiroshi Azakami
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Panasonic Corporation
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Definitions

  • the present invention relates to a waveform equalizer that removes multipath interference in a receiver for digital broadcasting or digital wireless communication.
  • a receiver for digital broadcasting and digital wireless communication is equipped with a waveform equalizer for removing multipath interference.
  • Multipath interference means that multiple transmitted waves with different paths arrive at the receiver, and the original received! / Interference wave (ghost) that interferes with the main wave is observed.
  • the waveform equalizer restores the main wave that has received such interference.
  • the previous ghost is a transmitted wave that reaches the receiver earlier in time than the main wave.
  • the post-ghost is a transmission wave that reaches the receiver later in time than the main wave.
  • a waveform equalizer is used to compare the FIR (finite impulse response) and IIR (infinite impulse response).
  • FIR finite impulse response
  • IIR infinite impulse response
  • Patent Document 1 JP 2005-39687 A
  • the FIR tap coefficient may misconverge depending on the ghost included in the input signal.
  • the tap coefficient of the FIR filter misconverges due to the influence of the ghost after suppression by the IIR filter, which deteriorates the waveform equalization performance.
  • a waveform equalization apparatus is a waveform equalization apparatus that performs waveform equalization on an input signal and outputs the result as an output signal, between the input signal and a plurality of tap coefficients.
  • a FIR (finite impulse response) filter that performs a convolution operation at, an IIR (infinite impulse response) filter that performs a convolution operation between the output signal and a plurality of tap coefficients, an operation result of the FIR filter, and the IIR filter
  • An addition unit that adds the calculation result and outputs the result as the output signal, an error detection unit that detects and outputs an error of the output signal, and tap coefficients of the FIR filter and the IIR filter
  • a tap coefficient updating unit for updating based on.
  • the tap coefficient updating unit updates the tap coefficient of the IIR filter with a step size for updating the tap coefficient of the FIR filter from when the operation of the waveform equalizer starts until a predetermined condition is satisfied. Make it smaller than the step size required.
  • the step size for updating the tap coefficient of the FIR filter is set to update the tap coefficient of the IIR filter until the predetermined condition is satisfied from the start of the operation of the waveform equalizer. Since it is smaller than the step size, the tap coefficient of the IIR filter can converge faster than the tap coefficient of the FIR filter. Therefore, it is possible to prevent the tap coefficients of the FIR filter from converging incorrectly due to the ghost effect suppressed by the IIR filter.
  • the step size is appropriately controlled when updating the tap coefficients of the FIR filter and the IIR filter, it is possible to prevent the tap coefficients of the FIR filter from converging to an incorrect value. it can. Since a relatively simple circuit is used, the waveform equalization performance of the waveform equalization apparatus can be improved without significantly increasing the circuit area.
  • FIG. 1 is a block diagram showing a configuration of a waveform equalizing apparatus according to an embodiment of the present invention.
  • FIG. 2 is a block diagram illustrating a configuration example of the FIR filter of FIG.
  • FIG. 3 is a block diagram showing a configuration example of the IIR filter of FIG.
  • FIG. 4 is a block diagram showing a configuration example of a tap coefficient updating unit in FIG.
  • FIG. 5 is a block diagram showing a configuration example of a step size control unit in FIG.
  • FIG. 6 is a block diagram showing a configuration of a modification of the step size control unit in FIG.
  • FIG. 7 is a block diagram showing a configuration of another modification of the step size control unit in FIG.
  • FIG. 1 is a block diagram showing a configuration of a waveform equalizer according to an embodiment of the present invention.
  • the waveform equalization apparatus 1 includes an FIR filter 10, an IIR filter 20, an adder 32, an error detection unit 34, and a tap coefficient update unit 40.
  • This waveform equalizer is used, for example, in an ATSC (Advanced 1 elevision Systems Committee) VSB ⁇ vestigial-sideband receiver.
  • the waveform equalization apparatus in FIG. 1 receives an input signal IS including a main wave and an interference wave (ghost). This waveform equalizer restores the main wave from the input signal IS and outputs the obtained result as the output signal ES.
  • the FIR filter 10 delays the input signal IS and obtains a plurality of tap values that have received different delays by a predetermined time.
  • the FIR filter 10 performs a convolution operation between the input signal IS and a plurality of tap coefficients respectively corresponding to these tap values using the plurality of tap values, and the result is used as an adder 32 as a signal FO. Output to.
  • the IIR filters 20 delay the output signal ES of the waveform equalizer in FIG. A plurality of tap values having different delays for each time are obtained.
  • the IIR filter 20 performs a convolution operation between the output signal ES and a plurality of tap coefficients respectively corresponding to these tap values using the plurality of tap values, and the result is used as an adder 3 as a signal IO. Output to 2.
  • the adder 32 adds the signal FO and the signal IO, and outputs the result as an output signal ES.
  • the error detector 34 detects an error ER between the output signal ES and a desired signal and outputs the error ER to the tap coefficient update unit 40.
  • the tap coefficient updating unit 40 updates the tap coefficients of the FIR filter 10 and the IIR filter 20 according to the error ER.
  • Delay devices 12B to 12N the outputs of 12N are tap values FTP2, FTP 3,..., FTPn, respectively.
  • Tap values FTP;! To FTPn correspond to tap coefficients FC1, FC2, ..., FCn, respectively.
  • the delay T is equal to the symbol period of the input signal IS.
  • FIG. 3 is a block diagram illustrating a configuration example of the IIR filter 20 of FIG.
  • the IIR filter 20 includes m ⁇ l delay units 22B, 22C,..., 221,..., 22M and m multipliers 24 A, 24B,. ..., 24M and Calorie calculator 26.
  • IIR Finale 20 also taps
  • the configuration is almost the same as the FIR filter 10 in FIG. 1 except that the number and tap coefficients are different.
  • the outputs of the delay devices 22B to 22M are tap values ITP2, ITP3, ..., ITPm, respectively.
  • Tap values ITP;! To ITPm are associated with tap coefficients IC1, IC1,..., ICm, respectively.
  • tap coefficients FC;! To FCn are set to FC
  • tap values FTP;! To FTPn are set to FTP
  • tap coefficients IC;! To ICm are set to IC
  • tap values ITP;! To ITPm are set.
  • FIG. 4 is a block diagram illustrating a configuration example of the tap coefficient updating unit 40 in FIG.
  • the tap coefficient updating unit 40 includes multipliers 51, 52, 53, 54, integrators 55, 56, and a step size control unit 58.
  • multipliers 51, 52, 53, 54, integrators 55, 56, and a step size control unit 58 are multipliers 51, 52, 53, 54, integrators 55, 56, and a step size control unit 58.
  • LMS Least Mean Square
  • the step size control unit 58 outputs the FIR step size SSF for updating the filter coefficient of the FIR filter 10 and the IIR step size SSI for updating the filter coefficient of the IIR filter 20.
  • FIG. 5 is a block diagram illustrating a configuration example of the step size control unit 58 of FIG.
  • the step size control unit 58 in FIG. 5 has a comparator 62 and a counter 64.
  • the tap coefficient of the IIR filter 20 is made larger than the tap coefficient of the FIR filter 10. It can be converged quickly. Therefore, it is possible to prevent the tap coefficients of the FIR filter 10 from misconvergence due to the ghost effect suppressed by the IIR filter 20. As a result, the waveform equalization performance of the waveform equalizer can be improved.
  • FIG. 6 is a block diagram showing a configuration of a modification of the step size control unit 58 of FIG.
  • the step size control unit 258 in FIG. 6 has a comparator 262 and a differentiator 66.
  • the differentiator 66 receives the tap coefficients IC ;! to ICm from the IIR filter 20, obtains the absolute values of the differential values for each of these tap coefficients, and further calculates the sum ADI of these absolute values. And output to the comparator 262.
  • the comparator 262 compares the total ADI with the switching threshold value, and outputs the FIR step size SSF according to the result.
  • Comparator 262 outputs 1/32 as FIR step size SSF and 1/8 as IIR step size SSI when total ADI is 0.05 or more. In addition, the comparator 262 If is smaller than 0.05, 1/8 is output as FIR step size SSF and IIR step size SSI.
  • the tap coefficient of the IIR filter 20 converges faster than the tap coefficient of the FIR filter 10.
  • the tap coefficient of the FIR filter 10 can be prevented from erroneously converging due to the influence of the ghost suppressed by the IIR filter 20.
  • the convergence time of the tap coefficient of the FIR filter 10 can be shortened.
  • FIG. 7 is a block diagram showing a configuration of another modification of the step size control unit 58 of FIG.
  • the step size control unit 358 in FIG. 7 includes a comparator 362, a counter 64, and a differentiator 66.
  • the counter 64 and the differentiator 66 are the same as those described with reference to FIGS. 5 and 6, respectively. That is, the counter 64 starts a count operation at the start of the operation of the waveform equalizer in FIG. 1, and measures an elapsed time from the start of the operation of the waveform equalizer.
  • the differentiator 66 receives the tap coefficients IC;! To ICm from the II R filter 20, obtains the absolute value of the differential value for each of these tap coefficients, and further obtains the sum ADI of these absolute values to obtain the comparator 36. Output to 2.
  • Comparator 362 increases the switching threshold when total ADI is equal to or greater than a predetermined value, and decreases the switching threshold when total ADI is smaller than the predetermined value.
  • the other points are the same as the comparator 62.
  • the tap coefficient of the IIR filter 20 converges faster than the tap coefficient of the FIR filter 10. It is possible to prevent the tap coefficients of the FIR filter 10 from misconvergence.
  • FIR step size SSF IIR step size SSI, and each switching threshold shown in the above embodiment are merely examples, and may be other values.
  • the FIR step size SSF may be 0! / ⁇ .
  • the present invention can prevent the tap coefficient of the FIR filter from converging to an incorrect value, and thus is useful for a waveform equalizer and the like.

Description

明 細 書
波形等化装置
技術分野
[0001] 本発明は、デジタル放送やデジタル無線通信のための受信機においてマルチパス による妨害を除去する波形等化装置に関する。
背景技術
[0002] デジタル放送やデジタル無線通信のための受信機には、マルチパス妨害を除去す るための波形等化装置が搭載されている。マルチパス妨害とは、経路の違う複数の 送信波が受信機に到達し、本来受信した!/、主波に干渉する干渉波（ゴースト）が観測 されることをいう。波形等化装置は、このような妨害を受けた主波の復元を行う。
[0003] マルチパス妨害の干渉波としては、前ゴーストと後ゴーストとが生じ得る。前ゴースト は、主波よりも時間的に早く受信機に到達した送信波である。これに対し、後ゴースト は、主波よりも時間的に遅く受信機に到達した送信波である。
[0004] 前ゴースト及び後ゴーストが含まれている受信波を等化するためには、 FIR (finite i mpulse responseノフイノレタと IIR (infinite impulse response)フイノレグと ¾r す >、波形等 化装置が用いられる。このような波形等化装置の例が、特許文献 1に開示されている 。この波形等化装置は、算出された演算精度制御値に応じて畳み込み演算の精度 を変更することにより、低消費電力化、及び回路面積の縮小を図っている。
特許文献 1 :特開 2005— 39687号公報
発明の開示
発明が解決しょうとする課題
[0005] しかし、このような波形等化装置は、入力信号に含まれるゴーストによっては、 FIR タップ係数が誤収束することがある。すなわち、 IIRフィルタが抑圧する後ゴーストの 影響により、 FIRフィルタのタップ係数が誤収束してしまい、波形等化性能を劣化させ てしまうという問題があった。
[0006] 本発明は、 FIRフィルタと IIRフィルタとを有する波形等化装置にお!/、て、 FIRフィル タのタップ係数が誤った値に収束することを防止することを目的とする。 課題を解決するための手段
[0007] 本発明に係る波形等化装置は、入力信号に波形等化を行い、その結果を出力信 号として出力する波形等化装置であって、前記入力信号と複数のタップ係数との間 で畳み込み演算を行う FIR (finite impulse response)フィルタと、前記出力信号と複数 のタップ係数との間で畳み込み演算を行う IIR (infinite impulse response)フィルタと、 前記 FIRフィルタの演算結果と前記 IIRフィルタの演算結果とを加算し、その結果を 前記出力信号として出力する加算部と、前記出力信号の誤差を検出して出力する誤 差検出部と、前記 FIRフィルタ及び前記 IIRフィルタのタップ係数を前記誤差に基づ いて更新するタップ係数更新部とを有する。前記タップ係数更新部は、前記波形等 化装置の動作開始時から所定の条件が満たされるまでの間は、前記 FIRフィルタの タップ係数を更新するためのステップサイズを前記 IIRフィルタのタップ係数を更新す るためのステップサイズより小さくする。
[0008] これによると、波形等化装置の動作開始時から所定の条件が満たされるまでの間 は、 FIRフィルタのタップ係数を更新するためのステップサイズを IIRフィルタのタップ 係数を更新するためのステップサイズより小さくするので、 IIRフィルタのタップ係数を FIRフィルタのタップ係数より早く収束させることができる。したがって、 IIRフィルタが 抑圧するゴーストの影響により、 FIRフィルタのタップ係数が誤収束することを防ぐこと ができる。
発明の効果
[0009] 本発明によれば、 FIRフィルタ及び IIRフィルタのタップ係数を更新する際にステツ プサイズを適切に制御するので、 FIRフィルタのタップ係数が誤った値に収束するこ とを防止すること力できる。比較的簡単な回路を用いるので、回路面積をあまり増加さ せずに波形等化装置の波形等化性能を向上させることができる。
図面の簡単な説明
[0010] [図 1]図 1は、本発明の実施形態に係る波形等化装置の構成を示すブロック図である
[図 2]図 2は、図 1の FIRフィルタの構成例を示すブロック図である。
[図 3]図 3は、図 1の IIRフィルタの構成例を示すブロック図である。 [図 4]図 4は、図 1のタップ係数更新部の構成例を示すブロック図である。
[図 5]図 5は、図 4のステップサイズ制御部の構成例を示すブロック図である。
[図 6]図 6は、図 5のステップサイズ制御部の変形例の構成を示すブロック図である。
[図 7]図 7は、図 5のステップサイズ制御部の他の変形例の構成を示すブロック図であ 符号の説明
[0011] 10 FIRフィルタ
20 IIRフィルタ
32 加算器
34 誤差検出部
40 タップ係数更新部
62, 262, 362 比較器
64 カウンタ
66 微分器
発明を実施するための最良の形態
[0012] 以下、本発明の実施の形態について、図面を参照しながら説明する。
[0013] 図 1は、本発明の実施形態に係る波形等化装置の構成を示すブロック図である。図
1の波形等化装置は、 FIRフィルタ 10と、 IIRフィルタ 20と、加算器 32と、誤差検出部 34と、タップ係数更新部 40とを有している。この波形等化装置は、例えば、 ATSC ( Advanced 1 elevision Systems Committeeノ VSB ^vestigial— sideband)受 1 機 ίこおレヽ て用いられる。図 1の波形等化装置には、主波と干渉波 (ゴースト）とを含む入力信号 ISが入力されている。この波形等化装置は、入力信号 ISから主波を復元して、得ら れた結果を出力信号 ESとして出力する。
[0014] FIRフィルタ 10は、入力信号 ISを遅延させて、互いに所定の時間ずつ異なる遅延 を受けた複数のタップ値を求める。 FIRフィルタ 10は、これらの複数のタップ値を用い て、入力信号 ISと、これらのタップ値にそれぞれ対応する複数のタップ係数との間で 畳み込み演算を行い、その結果を信号 FOとして加算器 32に出力する。
[0015] IIRフィルタ 20は、図 1の波形等化装置の出力信号 ESを遅延させて、互いに所定 の時間ずつ異なる遅延を受けた複数のタップ値を求める。 IIRフィルタ 20は、これら の複数のタップ値を用いて、出力信号 ESと、これらのタップ値にそれぞれ対応する 複数のタップ係数との間で畳み込み演算を行い、その結果を信号 IOとして加算器 3 2に出力する。
[0016] 加算器 32は、信号 FOと信号 IOとを加算し、その結果を出力信号 ESとして出力す る。誤差検出部 34は、出力信号 ESと所望の信号との間の誤差 ERを検出し、タップ 係数更新部 40に出力する。タップ係数更新部 40は、誤差 ERに従って FIRフィルタ 1 0及び IIRフィルタ 20のタップ係数を更新する。
[0017] 図 2は、図 1の FIRフィルタ 10の構成例を示すブロック図である。 FIRフィルタ 10は 、 n—l個（nは自然数）の遅延器 12B, 12C, ···, 121, ···, 12Nと、 n個の乗算器 14 A, 14B, ···, 141, ···, 14Nと、カロ算器 16とを有している。
[0018] 遅延器 12B〜； 12Nは、直列に接続されており、各遅延器の出力が、次段の遅延器 の入力に接続されている。遅延器 12B〜； 12Nは、それぞれに入力された信号を遅延
Tだけ遅延させて出力する。遅延器 12Bの入力（入力信号 IS)をタップ値 FTP1とし s
、遅延器 12B〜； 12Nの出力をそれぞれタップ値 FTP2, FTP 3, ···, FTPnとする。タ ップ値 FTP；!〜 FTPnには、タップ係数 FC1, FC2, ···, FCnがそれぞれ対応してい る。遅延 Tは、入力信号 ISのシンボル周期に等しい。
S
[0019] 乗算器 14Aは、タップ値 FTP1と、これに対応するタップ係数 FC1との間で乗算を 行い、乗算結果 FR1を加算器 16に出力する。同様に、乗算器 14B〜； 14Nはそれぞ れ、タップ値 FTP2〜FTPnのうちの対応するものと、タップ係数 FC2〜FCnのうちの 対応するものとの間で乗算を行い、乗算結果 FR2〜FRnを加算器 16に出力する。 加算器 16は、乗算器 14A〜； 14Nで求められた乗算結果を全て加算して、得られた 結果を出力する。このような動作を繰り返し、 FIRフィルタ 10は、入力信号 ISとタップ 係数 FC；!〜 FCnとの間で畳み込み演算を行い、その結果を信号 FOとして加算器 3 2に出力する。
[0020] 図 3は、図 1の IIRフィルタ 20の構成例を示すブロック図である。 IIRフィルタ 20は、 m—l個（mは自然数）の遅延器 22B, 22C, ···, 221, ···, 22Mと、 m個の乗算器 24 A, 24B, ···, 241, ···, 24Mと、カロ算器 26とを有している。 IIRフイノレタ 20も、タップ 数やタップ係数が異なる他は、図 1の FIRフィルタ 10とほぼ同様に構成されている。
[0021] 遅延器 22B〜22Mは、直列に接続されており、各遅延器の出力が、次段の遅延器 の入力に接続されている。遅延器 22B〜22Mは、それぞれに入力された信号を遅 延 Tだけ遅延させて出力する。遅延器 22Bの入力（出力信号 ES)をタップ値 ITP1と s
し、遅延器 22B〜22Mの出力をそれぞれタップ値 ITP2, ITP3, · · · , ITPmとする。 タップ値 ITP；!〜 ITPmには、タップ係数 IC1 , IC1 , · · · , ICmがそれぞれ対応してい
[0022] 乗算器 24A〜24Mはそれぞれ、タップ値 ITP；!〜 ITPmのうちの対応するものと、 タップ係数 IC；!〜 ICmのうちの対応するものとの間で乗算を行い、乗算結果 IR1〜I Rmを加算器 26に出力する。加算器 26は、乗算器 24A〜24Mで求められた乗算結 果を全て加算して、得られた結果を出力する。このような動作を繰り返し、 IIRフィルタ 20は、出力信号 ESとタップ係数 IC；!〜 ICmとの間で畳み込み演算を行い、その結 果を信号 IOとして加算器 32に出力する。
[0023] 図 1等においては、タップ係数 FC；!〜 FCnを FCとして、タップ値 FTP；!〜 FTPnを FTPとして、タップ係数 IC；!〜 ICmを ICとして、タップ値 ITP；!〜 ITPmを ITPとして、 総称している。
[0024] 図 4は、図 1のタップ係数更新部 40の構成例を示すブロック図である。タップ係数更 新部 40は、乗算器 51 , 52, 53, 54と、積分器 55, 56と、ステップサイズ制御部 58と を有している。ここでは、例として、 LMS (Least Mean Square)アルゴリズムを用いてタ ップ係数を更新する場合について説明する。
[0025] ステップサイズ制御部 58は、 FIRフィルタ 10のフィルタ係数更新のための FIRステ ップサイズ SSFと、 IIRフィルタ 20のフィルタ係数更新のための IIRステップサイズ SSI とを出力している。
[0026] 例として、タップ係数 FCi及び ICiの更新について説明する。乗算器 51は、誤差 ER とタップ値 FTPiとの乗算を行い、その乗算結果 FTiを出力する。乗算器 52は、乗算 結果 FTiと FIRステップサイズ SSFとの乗算を行い、その乗算結果 FMiを積分器 55 に出力する。積分器 55は、乗算結果 FMiを累積し、その結果を新たなタップ係数 F Ciとして FIRフィルタ 10に出力する。乗算器 51 , 52及び積分器 55は、このような処 理を FIRフィルタ 10の全てのタップ係数 FC；!〜 FCnについて行う。
[0027] 乗算器 53は、誤差 ERとタップ値 ITPiとの乗算を行!/、、その乗算結果 ITiを出力す る。乗算器 54は、乗算結果 ITiと IIRステップサイズ SSIとの乗算を行い、その乗算結 果 IMiを積分器 56に出力する。積分器 56は、乗算結果 IMiを累積し、その結果を新 たなタップ係数 ICiとして IIRフィルタ 20に出力する。乗算器 53, 54及び積分器 56は 、このような処理を IIRフィルタ 20の全てのタップ係数 IC；!〜 ICmについて行う。
[0028] 図 5は、図 4のステップサイズ制御部 58の構成例を示すブロック図である。図 5のス テツプサイズ制御部 58は、比較器 62と、カウンタ 64とを有している。
[0029] カウンタ 64は、図 1の波形等化装置の動作開始時にカウント動作を開始し、波形等 化装置の動作開始時からの経過時間を測定する。比較器 62は、カウンタ 64で測定 された経過時間が切り替え閾値 100msに達するまでは、 FIRステップサイズ SSFとし て 1/32を出力し、 IIRステップサイズ SSIとして 1/8を出力する。また、比較器 62は 、カウンタ 64で測定された時間が切り替え閾値 100msを越えた後には、 FIRステップ サイズ SSF及び IIRステップサイズ SSIとして 1/8を出力する。
[0030] このように、動作開始時から所定の期間が経過するまでは、 FIRステップサイズ SS Fを IIRステップサイズ SSIより小さくするので、 IIRフィルタ 20のタップ係数を FIRフィ ルタ 10のタップ係数より早く収束させることができる。したがって、 IIRフィルタ 20が抑 圧するゴーストの影響により、 FIRフィルタ 10のタップ係数が誤収束することを防ぐこ とができる。その結果、波形等化装置の波形等化性能を向上させることができる。
[0031] 図 6は、図 5のステップサイズ制御部 58の変形例の構成を示すブロック図である。
図 6のステップサイズ制御部 258は、比較器 262と、微分器 66とを有している。
[0032] 微分器 66は、 IIRフィルタ 20からタップ係数 IC；!〜 ICmを受け取り、これらのタップ 係数のそれぞれにっレ、て微分値の絶対値を求め、更にこれらの絶対値の総和 ADI を求めて比較器 262に出力する。比較器 262は、総和 ADIと切り替え閾値とを比較 し、その結果に応じて FIRステップサイズ SSFを出力する。
[0033] 比較器 262には、切り替え閾値として 0. 05が設定されているとする。比較器 262は 、総和 ADIが 0. 05以上である場合には、 FIRステップサイズ SSFとして 1/32を出 力し、 IIRステップサイズ SSIとして 1/8を出力する。また、比較器 262は、総和 ADI が 0. 05よりも小さくなつた場合には、 FIRステップサイズ SSF及び IIRステップサイズ SSIとして 1/8を出力する。
[0034] このように、図 5のステップサイズ制御部 58に代えて図 6のステップサイズ制御部 25 8を用いた場合にも、 IIRフィルタ 20のタップ係数を FIRフィルタ 10のタップ係数より 早く収束させることができ、 IIRフィルタ 20が抑圧するゴーストの影響により、 FIRフィ ルタ 10のタップ係数が誤収束することを防ぐことができる。また、 IIRフィルタが 20が 抑圧すべき後ゴーストが存在しない場合には、 FIRフィルタ 10のタップ係数の収束時 間を短縮すること力できる。
[0035] 図 7は、図 5のステップサイズ制御部 58の他の変形例の構成を示すブロック図であ る。図 7のステップサイズ制御部 358は、比較器 362と、カウンタ 64と、微分器 66とを 有している。
[0036] カウンタ 64及び微分器 66は、ぞれぞれ図 5及び図 6を参照して説明したものと同じ である。すなわち、カウンタ 64は、図 1の波形等化装置の動作開始時にカウント動作 を開始し、波形等化装置の動作開始時からの経過時間を測定する。微分器 66は、 II Rフィルタ 20からタップ係数 IC；!〜 ICmを受け取り、これらのタップ係数のそれぞれに ついて微分値の絶対値を求め、更にこれらの絶対値の総和 ADIを求めて比較器 36 2に出力する。
[0037] 比較器 362には、切り替え閾値として例えば 100msが設定されている。比較器 36 2は、総和 ADIが所定値以上である場合には、切り替え閾値を大きくし、総和 ADIが 所定値よりも小さい場合には、切り替え閾値を小さくする。その他の点は、比較器 62 と同様である。
[0038] このように、図 5のステップサイズ制御部 58に代えて図 7のステップサイズ制御部 35 8を用いた場合にも、 IIRフィルタ 20のタップ係数を FIRフィルタ 10のタップ係数より 早く収束させることができ、 FIRフィルタ 10のタップ係数が誤収束することを防ぐことが できる。
[0039] なお、以上の実施形態で示した FIRステップサイズ SSF、 IIRステップサイズ SSI、 及び各切り替え閾値は一例であって、他の値であってもよい。また、 FIRステップサイ ズ SSFは 0であってもよ!/ヽ。 産業上の利用可能性
以上説明したように、本発明は、 FIRフィルタのタップ係数が誤った値に収束するこ とを防止することができるので、波形等化装置等について有用である。

Claims

請求の範囲
[1] 入力信号に波形等化を行い、その結果を出力信号として出力する波形等化装置で あってゝ
前記入力信号と複数のタップ係数との間で畳み込み演算を行う FIR (finite impulse responseノフィノレ夕と、
前記出力信号と複数のタップ係数との間で畳み込み演算を行う IIR (infinite impuls e response)フィノレタと、
前記 FIRフィルタの演算結果と前記 IIRフィルタの演算結果とを加算し、その結果を 前記出力信号として出力する加算部と、
前記出力信号の誤差を検出して出力する誤差検出部と、
前記 FIRフィルタ及び前記 IIRフィルタのタップ係数を前記誤差に基づいて更新す るタップ係数更新部とを備え、
前記タップ係数更新部は、
前記波形等化装置の動作開始時から所定の条件が満たされるまでの間は、前記 F IRフィルタのタップ係数を更新するためのステップサイズを前記 IIRフィルタのタップ 係数を更新するためのステップサイズより小さくする
ことを特徴とする波形等化装置。
[2] 請求項 1に記載の波形等化装置にお!/、て、
前記所定の条件は、前記波形等化装置の動作開始時からの経過時間が所定の時 間を越えることである
ことを特徴とする波形等化装置。
[3] 請求項 2に記載の波形等化装置において、
前記経過時間を測定するカウンタと、
前記カウンタで測定された前記経過時間が前記所定の時間を越えているか否かを 判定する比較器とを更に備える
ことを特徴とする波形等化装置。
[4] 請求項 3に記載の波形等化装置において、
前記 IIRフィルタの複数のタップ係数のそれぞれについての微分値の絶対値の総 和を求める微分器を更に備え、
前記比較器は、
前記総和が所定値以上である場合には、前記所定の時間を大きくし、前記総和が 前記所定値よりも小さい場合には、前記所定の時間を小さくする
ことを特徴とする波形等化装置。
請求項 1に記載の波形等化装置にお!/、て、
前記所定の条件は、
前記 IIRフィルタの複数のタップ係数のそれぞれについての微分値の絶対値の総 和が、所定値よりも小さいことである
ことを特徴とする波形等化装置。
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