UA140686U - Формувач періодичної послідовності двоімпульсних кодових серій з налаштованими часовими параметрами - Google Patents

Abstract

Формувач містить: реверсивний двійковий лічильник, налаштований на режим віднімання, який має вхід подачі тактових імпульсів С, вхід налаштування на режим підсумовування/віднімання U, вхід дозволу синхронного паралельного завантаження L і входи подачі даних при завантаженні, вхід дозволу режиму лічби Ε, вхід асинхронної установки у нульовий стан R, вихід переповнення Р4; перший і другий RS-тригери, JK-тригер зі входом асинхронної установки нуля; чотирирозрядний цифровий компаратор, який має першу групу входів, другу групу входів і перший, другий, третій керуючі входи І; перший, другий, третій і четвертий двовходові елементи І; двовходовий елемент АБО; чотиривходовий елемент АБО; перший і другий інвертори; перший, другий, третій і четвертий резистори; кнопки Start и Stop, що працюють на замикання; конденсатор.

Description

Корисна модель належить до імпульсної техніки і призначена для формування періодичної послідовності двоїмпульсних кодових серій з налаштованою тривалістю імпульсів, періоду проходження і затримки початку формування відносно стартового імпульсу, кратними періоду безперервної періодичної послідовності імпульсів, що подаються на його вхід з виходу зовнішнього кварцового генератора.

Відомі формувачі, які містять задаючий кварцовий генератор, що працює в безперервному режимі, пристрій синхронізації і вихідний пристрій, що забезпечує формування необхідних серій імпульсів, часові параметри яких визначаються часовими параметрами імпульсів, що подаються на вхід |Тактовий генератор. А.С. СРСР Мо 307502. - Б.В. Мо 20, 1971; Тактовий генератор. А.С. СРСР Мо 354544. - Б.В. Мо 30, 19721.

Недолік відомих пристроїв - обмежені функціональні можливості, обумовлені налаштуванням на фіксований режим часових параметрів вихідної послідовності імпульсів.

Відомі формувачі періодичної послідовності імпульсів з програмованою тривалістю і фіксованою шпаруватістю (патенти України на корисну модель 93714, 93715, 93716, 937118, 93734, 93735, 937381.

Недолік цих пристроїв - складність їх виготовлення і, як наслідок, висока споживча потужність, висока вартість, які обумовлені необхідністю використання двох реверсивних лічильників.

Як найближчий аналог вибрано формувач періодичної послідовності двоїмпульсних кодових серій з налаштованими часовими параметрами |патент на корисну модель України Мо 93714, бюл. Мо 19, 2014), який містить: спільне джерело живлення (ЖЕ); реверсивний двійковий лічильник, налаштований на режим віднімання, зі входом дозволу синхронного паралельного завантаження і входами подачі змінних, що завантажуються (забезпечують налаштування формувача на задані часові параметри вихідних імпульсів), входом дозволу режиму лічби і входом асинхронної установки у нульовий стан, виходом переповнення; /К-тригер зі входом асинхронної установки у нульовий стан; перший і другий елементи І!; двовходовий і чотиривходовий елементи АБО; два інвертора; ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до спільного джерела живлення, загальна точка яких з'єднана з першими входами першого і другого елементів І; вихід другого елемента з'єднаний зі входом асинхронної установки лічильника у нульовий стан; виходи другого, третього і четвертого розрядів лічильника з'єднано зі входами чотиривходового елемента АБО; вхід першого інвертора з'єднано з виходом переповнення лічильника; тактовий вхід лічильника утворює вхід формувача, на який надходить безперервна періодична послідовність імпульсів з виходу зовнішнього кварцового генератора,

Недолік відомого пристрою - обмежені функціональні можливості.

В основу корисної моделі поставлена задача розширення функціональних можливостей формувача періодичної послідовності двоїмпульсних кодових серій з налаштованими часовими параметрами.

Поставлена задача вирішується тим, що в формувач періодичної послідовності двоїмпульсних кодових серій з налаштованими часовими параметрами, який містить: спільне джерело живлення (ЗЕ); реверсивний двійковий лічильник, налаштований на режим віднімання, зі входом дозволу синхронного паралельного завантаження і входами подачі змінних, що завантажуються (забезпечують налаштування формувача на задані часові параметри вихідних імпульсів), входом дозволу режиму лічби і входом асинхронної установки у нульовий стан, виходом переповнення; УК-тригер зі входом асинхронної установки у нульовий стан; перший і другий елементи І; двовходовий і чотиривходовий елементи АБО; два інвертора; ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до спільного джерела живлення, загальна точка яких з'єднана з першими входами першого і другого елементів І; вихід другого елемента І з'єднаний зі входом асинхронної установки лічильника у нульовий стан; виходи другого, третього і четвертого розрядів лічильника з'єднано зі входами чотиривходового елемента АБО; вхід першого інвертора з'єднано з виходом переповнення лічильника; тактовий вхід лічильника утворює вхід формувача, на який надходить безперервна періодична послідовність імпульсів з виходу зовнішнього кварцового генератора, відповідно до корисної моделі введено: перший і другий НК5-тригери, цифровий компаратор; третій і четвертий елементи Іх перша і друга кнопки, що працюють на замикання: другий, третій і четвертий резистори, перші виводи яких з'єднані з плюсом джерела живлення; другий вивід другого резистора утворює вивід рівня логічної одиниці; другий вивід третього резистора з'єднано зі входом 5 першого В5-тригера і першим контактом першої кнопки; вхід Я першого НВ5о-тригера з'єднано з виходом першого елемента І; вихід першого В5-тригера з'єднано з першим входом 60 двовходового елемента АБО, другий вхід якого з'єднано з виходом компаратора і першим входом четвертого елемента І; другий вивід четвертого резистора з'єднана з другим входом першого елемента І і першим контактом другої кнопки; другі контакти кнопок з'єднані із загальною точкою (мінусом) джерела живлення; вихід першого інвертора з'єднано зі входом дозволу режиму лічби лічильника; вхід другого інвертора з'єднано з виходом першого (молодшого) розряду лічильника, а його вихід з'єднано з першим входом чотиривходового елемента АБО; вихід чотиривходового елемента АБО з'єднано зі входами ./ і К УК-тригера, з першим входом третього елемента І і входом установки в одиничний стан другого Но-тригера; тактовий вхід УК-тригера з'єднано зі входом формувача; другий вхід третього елемента з'єднано з виходом переповнення лічильника; прямий вихід другого Но-тригера з'єднано з другим входом четвертого елемента І, вихід якого утворює вихід формувача; перша група входів компаратора з'єднана з виходами відповідних розрядів лічильника; входи асинхронної установки у нульовий стан УК і Вб тригерів з'єднано з виходом другого елемента І; при налаштуванні формувача на формування періодичної послідовності двоїмпульсних кодових серій, тривалість перших (непарних) імпульсів у якій дорівнює семи періодам тактових імпульсів, тривалість паузи між першими і другими імпульсами дорівнює двом періодам тактових імпульсів, тривалість других (парних) імпульсів дорівнює шести періодам тактових імпульсів, тривалість паузи між другими і першими імпульсами дорівнює шести періодам тактових імпульсів, тобто період проходження двоімпульсних серій дорівнює двадцяти одному періоду тактових імпульсів, затримка початку формування відносно стартового сигналу дорівнює дванадцяти періодам, перший вхід паралельного завантаження лічильника з'єднаний з прямим виходом УК-тригера, другий вхід з'єднано з інверсним виходом УК-тригера; третій вхід з'єднано з рівнем логічної одиниці, четвертий вхід з'єднано з рівнем логічного нуля, перший і четвертий входи другої групи входів компаратора з'єднано з рівнем логічного нуля, другий вхід з'єднано з рівнем логічної одиниці, третій вхід з'єднано з інверсним виходом УК-тригера, перший і третій керуючі входи компаратора з'єднано з рівнем логічного нуля, другий керуючий вхід з'єднано з рівнем логічної одиниці.

Суть корисної моделі пояснюють креслення, де на фіг. 1 представлена схема формувача.

Формувач містить: реверсивний двійковий лічильник (1), який має вхід подачі тактових імпульсів С, вхід налаштування на режим підсумовування/віднімання Ш, вхід дозволу

Ко) синхронного паралельного завантаження І і входи подачі даних при завантаженні бо, О:, ЮО2, Оз, вхід дозволу режиму лічби Е, вхід асинхронної установки у нульовий стан В, вихід переповнення Ра; перший (2) і другий (3) асинхронні Аб-тригери УК-тригер (4) зі входом асинхронної установки нуля АВ; чотирирозрядний цифровий компаратор (5), який має першу групу входів Ао, Ан, Аг, Аз, другу групу входів Во, Ві, Ве2, Вз, перший, другий і третій керуючі входи

І; перший (6), другий (7), третій (8) і четвертий (9) двовходові елементи І; двовходовий елемент

АБО (10); чотиривходовий елемент АБО (11); перший (12) і другий (13) інвертори; перший В1 (14), другий В2 (15), третій ВЗ (16) і четвертий НА (17) резистори; кнопки 5іап (18) и 5іор (19), що працюють на замикання; конденсатор С1 (20).

Загальна точка ланцюжка, що складається з послідовно з'єднаних резистора 14 і конденсатора 20, підключена до спільного джерела живлення (Е), з'єднана з першими входами першого (б) і другого (7) елементів І. Вихід елемента 6 з'єднано зі входом В тригера 2. Вихід елемента 7 з'єднано зі входом асинхронної установки лічильника (1 і тригерів (3, 4) у нульовий стан.

Виходи другого (Сх), третього (О2) і четвертого (Оз) розрядів лічильника з'єднано зі входами чотиривходового елемента АБО (11). Вхід інвертора 12 з'єднано з виходом переповнення (Ра) лічильника, а його вихід з'єднано зі входом дозволу режиму лічби (Е). Тактовий вхід лічильника утворює вхід формувача (С), на який надходить безперервна періодична послідовність імпульсів з виходу зовнішнього кварцового генератора. Другий вивід резистора 15 утворює вивід рівня логічної одиниці "1". Другий вивід резистора 16 з'єднано зі входом 5 тригера 2 і першим контактом кнопки бай. Другий вивід резистора 17 з'єднана зі входом елемента 6 і першим контактом кнопки 5іор. Другі контакти кнопок з'єднані із загальною точкою джерела живлення (-Е). Вхід інвертора 13 з'єднано з виходом першого (О0) розряду лічильника, а його вихід з'єднано з першим входом елемента 11. Вихід елемента 11 з'єднано зі входом елемента 8, входами У і К тригера 4 і входом 5 тригера 3. Другий вхід елемента 8 з'єднано з виходом переповнення лічильника. Прямий вихід тригера З з'єднано з першим входом елемента 9, другий вхід якого з'єднано з виходом А»В компаратора і з другим входом елемента 10, вихід елемента 9 утворює вихід формувача Р.

Вхід бо лічильника з'єднано з прямим виходом (03) тригера 4. Вхід 0; лічильника з'єднано з рівнем логічного нуля "0" (з мінусом джерела живлення). Вхід О»2 з'єднано з інверсним виходом 60 (93) тригера 4. Вхід Оз з'єднано з рівнем логічної одиниці "1". Перша група входів (Ао, Ан, А»,

Аз) компаратора (5) з'єднана з виходами відповідних розрядів (Со, С, Сг, С)з) лічильника.

Перший (Во) вхід другої групи входів компаратора з'єднано з рівнем логічного нуля, другий (Ві) вхід з'єднано з рівнем логічної одиниці, третій (Вг2) - з інверсним виходом (93) тригера 4, четвертий (Вз) - з рівнем логічного нуля "0". Перший і третій керуючі входи (1) компаратора з'єднано з рівнем логічного нуля "0, другий керуючий вхід з'єднано з рівнем логічної одиниці "1" (з другим виводом резистора 13).

Працює формувач в наступній послідовності.

Наявність ланцюжка, що складається із сполучених послідовно резистора 14 і конденсатора 20, підключеного до шини живлячої напруги «Е, при включенні джерела живлення протягом певного проміжку часу (визначеного сталою часу ланцюга Н:іС:) формує рівень логічного нуля на входах елементів б, 7, забезпечуючи формування рівня логічного нуля на їх виходах, приєднаних до входу асинхронної установки у нульовий стан тригерів і лічильника. Після закінчення перехідного процесу, пов'язаного з включенням джерела живлення, тригери і лічильник переходять у нульовий стан, формуючи рівень логічного нуля відповідно: на виході

А» компаратора, на виході переповнення лічильника, що веде до формування рівня логічного нуля на вході елемента 8 (забезпечує нульове значення на вході Ї лічильника) на виході елементів 10, 7 (на входах В лічильника забезпечує його нульовий стан і по закінченню перехідного процесу, пов'язаного з зарядом конденсатора 20, коли напруга на ньому перевищить рівень логічного нуля). Оскільки сигнал на вході АВ має пріоритет по відношенню до усіх других управляючих сигналів на входах лічильника, то до тих пір, поки на входах елементів 10, 7 (а отже і на їх виходах) буде зберігатися рівень логічного нуля, то при надходженні тактових імпульсів нульовий стан лічильника, тригерів і нульове значення сигналу на виході формувача буде залишатися незмінним.

При натисненні кнопки 5іагі на вході 5 тригера 2 формується рівень логічного нуля, що веде до його переходу в одиничний стан (01-1), формуючи рівень логічної одиниці на виході елемента 10, а отже на вході і виході елемента 7 (на вході В лічильника), знімає блокування нульового стану, і тоді нульове значення на вході дозволу синхронного паралельного завантаження лічильника підготовлює його до прийому інформації з його входів синхронного паралельного завантаження (О3020100-1100). І тоді при надходженні першого (після закінчення

Зо перехідного процесу, пов'язаного з запуском) тактового імпульсу С по його фронту відбувається паралельне завантаження. Лічильник переходить у стан Оз020:100-1100. В результаті цього переходу на виході переповнення лічильника і виході елемента 8 формується одиничне, а на виході інвертора 12 (на вході Е лічильника) - нульове значення, що веде до заборони паралельного завантаження і дозволу режиму лічби лічильника. Нульовий стан тригера З залишається незмінним, що забезпечує нульове значення сигналу на виході незалежно від співвідношення значення на входах першої і другої групи компаратора. При надходженні наступних тактових імпульсів вміст лічильника зменшується. При цьому, до тих пір, поки вміст лічильника буде перевищувати одиничне значення, одиничне значення на виходи елемента 11 залишається незмінним, що забезпечує незмінність нульового значення на прямому виході тригера З і на виході формувача. Як тільки вміст лічильника стає рівним 0001 на виході елемента 11 формується рівень логічного нуля, що веде до формування рівня логічного нуля на вході елемента 8 (на вході дозволу завантаження лічильника) і на вході 5 тригера 3, що веде до його переходу в одиничний стан. І тоді при надходженні наступного тактового імпульсу лічильник переходить в стан Оз0201000-1001, обумовлений значенням сигналів, сформованих на його входах паралельного завантаження (О30201О00-1001). На виході компаратора А»В (а також на виході Е формувача) починається формування одиничного значення, оскільки значення сигналів на виходах лічильника 03020100 перевищує значення сигналів на входах другої групи сигналів ВзВ2ВіВо-0010 компаратора. При надходженні наступних тактових імпульсів вміст лічильника зменшується. При цьому до тих пір, поки його вміст буде перевищувати значення, встановлене на входах другої групи компаратора (ВзВ2ВіВо-0010), значення сигналу на виході формувача буде залишатися рівним 1. Як тільки вміст лічильника стане рівним 0010, значення сигналу на виході компаратора стане рівним О, що веде до формування нульового значення сигналу на виході формувача. При надходженні наступних тактових імпульсів вміст лічильника продовжує зменшуватися, а значення сигналу на виході залишається рівним 0. Як тільки вміст лічильника стане рівним 0001, значення сигналу на виході елемента 11 стане рівним 0, що веде до дозволу завантаження лічильника і дозволу переходу УК-тригера у наступний (нульовий) стан. При надходженні наступного тактового імпульсу лічильник переходить у стан 1100, а тригер 4 - у нульовий, що веде до формування на входах другої групи компаратора значення ВзВ2ВіВо-0110 і одиничного значення на виході бо формувача. При надходженні наступних тактових імпульсів вміст лічильника зменшується. При цьому до тих пір, поки його вміст буде перевищувати значення, встановлене на входах другої групи компаратора (ВзВ2В1Во-0110), значення сигналу на виході формувача буде залишатися рівним 1. Як тільки вміст лічильника стане рівним 0110, значення сигналу на виході компаратора стане рівним 0. При надходженні наступних тактових імпульсів вміст лічильника продовжує зменшуватися, а значення сигналу на виході залишається рівним О до тих пір, поки вміст лічильника не стане рівним 0001. Як тільки вміст лічильника стане рівним 0001, значення сигналу на виході елемента 11 стане рівним 0, що веде до дозволу завантаження лічильника і дозволу переходу УК-тригера у наступний (одиничний) стан. При надходженні наступного тактового імпульсу лічильник знову переходить у стан 1001, а тригер 4 - в одиничний, що веде до формування на входах другої групи компаратора значення ВзВ2ВіВо-0101 ії одиничного значення на виході формувача, починаючи новий цикл формування двоімпульсної кодової серії.

При надходженні наступних тактових імпульсів процеси повторюються.

Таким чином, після закінчення перехідного процесу, пов'язаного з запуском, під час вступу на вхід формувача періодичної послідовності імпульсів (з періодом, рівним Т) на виході формувача генерується періодична послідовність двоїмпульсних кодових серій, тривалість перших (непарних) імпульсів у якій дорівнює чотирьом періодам тактових імпульсів (їм1-7Т), тривалість паузи між першими і другими імпульсами дорівнює двом періодам (ї-21), тривалість других (парних) імпульсів дорівнює шести періодам (2-61), тривалість паузи між другим і наступним першим імпульсами дорівнює шести періодам (іп2-61), тобто період проходження двоіїмпульсних серій дорівнює двадцяти одному періоду тактових імпульсів (Те-217Т), затримка початку формування відносно стартового сигналу дорівнює дванадцяти періодам (із3-121).

Зупинка режиму формування вихідної послідовності здійснюється натисненням кнопки бор, що формує рівень логічного нуля на вході і виході елемента 6, а також на вході В тригера 2, що призводить до переходу його в нульовий стан (01-0). Момент натиснення асинхронний по відношенню до імпульсів тактового генератора і до стану лічильника і тригерів.

Якщо в момент натиснення кнопки 5іор вміст лічильника менше значення сигналів на входах другої групи сигналів ВзВ2гВ:Во (значення сигналу на виходи компаратора А»В дорівнює 0), то при переході тригера 2 в нульовий стан на входах елемента 10 і на його виході буде

Зо сформований рівень логічного нуля, обумовлюючи рівень нуля на вході і на виході елемента 7 (на вході А лічильника), що призведе до переходу лічильника в нульовий стан, а отже до припинення режиму генерації.

Якщо в момент натиснення кнопки 5іор вміст лічильника більше значення сигналів на входах другої групи сигналів ВзВ2ВіВо, то при переході тригера 2 в нульовий стан одиничне значення на виході елемента 10 залишиться незмінним, оскільки на виході компаратора А»В рівень логічної одиниці. Звідси випливає, що в цьому випадку в момент натиснення кнопки припинення генерації не відбудеться, обумовлюючи тим самим запобігання спотворенню останнього імпульсу в сформованій вихідний послідовності.

При надходженнях кожного чергового імпульсу на вхід формувача С буде відбуватися перехід лічильника, відповідно до алгоритму до тих пір, поки його вміст не стане рівним значенню сигналів на входах другої групи сигналів ВзВ2В:Во, обумовлюючи рівень нуля на вході і виході і виходах елементів 10,7, що призведе до переходу лічильника в нульовий стан, а отже до припинення режиму генерації. При наступному черговому натисненні кнопки аг, всі процеси повторюються.

На фіг. 2 приведений граф переходів формувача, що складається з чотирьох кілець: верхнє (перше) кільце - значення сигналу на прямому виході другого тригера, друге кільце - граф переходів лічильника, третє кільце - значення сигналу на прямому виході УК-тригера, четверте кільце - значення сигналу на виході формувача.

Оскільки натиснення кнопки 5іор асинхронно по відношенню до тактових імпульсів, то тривалість затримки початку формування знаходиться у діапазоні: 12Т« із «13Т.

На відміну від відомого пристрою заявлений формувач має новий склад елементів і нову організацію зв'язку між ними, які забезпечують нові технічні властивості.

Технічний результат - розширення його функціональних можливостей формувач і його області використання за рахунок забезпечення затримки початку формування щодо стартового сигналу.

Claims (1)

1. ФОРМУЛА КОРИСНОЇ МОДЕЛІ Формувач періодичної послідовності двоїмпульсних кодових серій з налаштованими часовими бо параметрами, який містить: спільне джерело живлення (ЯЕ); реверсивний двійковий лічильник,

   налаштований на режим віднімання, зі входом дозволу синхронного паралельного завантаження і входами подачі змінних, що завантажуються (забезпечують налаштування формувача на задані часові параметри вихідних імпульсів), входом дозволу режиму лічби і входом асинхронної установки у нульовий стан, виходом переповнення; /К-тригер зі входом асинхронної установки у нульовий стан; перший і другий елементи !; двовходовий і чотиривходовий елементи АБО; два інвертори; ланцюжок, що складається з послідовно з'єднаних резистора і конденсатора, підключеного до спільного джерела живлення, загальна точка яких з'єднана з першими входами першого і другого елементів І; вихід другого елемента з'єднаний зі входом асинхронної установки лічильника у нульовий стан; виходи другого, третього і четвертого розрядів лічильника з'єднано зі входами чотиривходового елемента АБО; вхід першого інвертора з'єднано з виходом переповнення лічильника; тактовий вхід лічильника утворює вхід формувача, на який надходить безперервна періодична послідовність імпульсів з виходу зовнішнього кварцового генератора, який відрізняється тим, що перший і другий В5- тригери, цифровий компаратор; третій і четвертий елементи І; перша і друга кнопки, що працюють на замикання: другий, третій і четвертий резистори, перші виводи яких з'єднані Кк плюсом джерела живлення; другий вивід другого резистора утворює вивід рівня логічної одиниці; другий вивід третього резистора з'єднано зі входом 5 першого Но-тригера і першим контактом першої кнопки; вхід В першого В5-тригера з'єднано з виходом першого елемента |; вихід першого Н5-тригера з'єднано з першим входом двовходового елемента АБО, другий вхід якого з'єднано з виходом компаратора і першим входом четвертого елемента І!; другий вивід четвертого резистора з'єднана з другим входом першого елемента І і першим контактом другої кнопки; другі контакти кнопок з'єднані із загальною точкою (мінусом) джерела живлення; вихід першого інвертора з'єднано зі входом дозволу режиму лічби лічильника; вхід другого інвертора з'єднано з виходом першого (молодшого) розряду лічильника, а його вихід з'єднано з першим входом четиривходового елемента АБО; вихід чотиривходового елемента АБО з'єднано зі входами ./ і К УК-тригера, з першим входом третього елемента І і входом установки в одиничний стан другого Но-тригера; тактовий вхід ОК-тригера з'єднано зі входом формувача; другий вхід третього елемента І з'єднано з виходом переповнення лічильника; прямий вихід другого Н5- тригера з'єднано з другим входом четвертого елемента І, вихід якого утворює вихід формувача; Зо перша група входів компаратора з'єднана з виходами відповідних розрядів лічильника; входи асинхронної установки у нульовий стан УК- і В5-тригерів з'єднано з виходом другого елемента І; при налаштуванні формувача на формування періодичної послідовності двоїмпульсних кодових серій, тривалість перших (непарних) імпульсів у якій дорівнює семи періодам тактових імпульсів, тривалість паузи між першими і другими імпульсами дорівнює двом періодам тактових імпульсів, тривалість других (парних) імпульсів дорівнює шести періодам тактових імпульсів, тривалість паузи між другими і першими імпульсами дорівнює шести періодам тактових імпульсів, тобто період проходження двоімпульсних серій дорівнює двадцяти одному періоду тактових імпульсів, затримка початку формування відносно стартового сигналу дорівнює дванадцяти періодам, перший вхід паралельного завантаження лічильника з'єднані з прямим виходом УК-тригера, другий вхід з'єднано з інверсним виходом УК-тригера; третій вхід з'єднано з рівнем логічної одиниці, четвертий вхід з'єднано з рівнем логічного нуля, перший і четвертий входи другої групи входів компаратора з'єднано з рівнем логічного нуля, другий вхід з'єднано з рівнем логічної одиниці, третій вхід з'єднано з інверсним виходом УК-тригера, перший і третій керуючі входи компаратора з'єднано з рівнем логічного нуля, другий керуючий вхід з'єднано з рівнем логічної одиниці.

   ШЕ ДЕ номвнинвнивнн о Ор х і о. В ЩЕ уко юю фон 3 З З х фев дес З у х КЕ ЕКО ще ши Я щи В ха ую Я У 5 М 5. З х ї ; 7 НВ ІК. коро 3; Не х ; і МЕ ЗЕ ви 1 ЖЕ МН В: ; сх В б ї ї і і ой Я ооо З ен Х 5 Е Е ЯК: у с В В гі т Ж: З у Х ше Х ХЕ Я я К ЖК я у : ; ; х нм ЩЕ: ЗЕ ТВ ЕЕ: у | ; З я ше. ХВ ее ЩЕ хі Її є і З ОН З дер ШЕ їз Я ШЕ З ШЕ ШЕ ж ЕЕ НИ : : ШЕ Ж с думою З ЗБ ЕЕ ЗЕ: 5 Вів в. ШЕ ! | ї Її З ре ше 1 ЩІ ід» ше ца . Я з код у Е С: зу, : Б с х й Е: ї х : «І з х

   Фіг. 1 с. тк, о с ж хи ох г т а ск СУ йо йо Й Й Й Й 7 - й пд». й й й й й С Ще " че в : КЗ з ОК, У КК КМ я ОХ. Хе М 7 в о ее и ве и ви НВ ОКО нн нн ск жи хх їй. ж я о Й у М вих, СКК КАКАО КК КК КК А КА КА в КА АК АК АК КК А КК ї" ї ДУ КК КК КК КК КК КТ КТК КАК Ки они нан вав нн М М м а а є а А А а м а м а м нн Її Й ООН КК КАК АК КАК КК КАК КА КК КО КК КАК КК КАК КК КАК КК КК КА АК КК КА КК АК КАК АМ ЖАКА К КАК КА АК ККАЛ КК КАК ААА МК АЛК КК КААКККЮВА СИ и т, Ту о во т дж, км ху Я с - Ух Кг - сук ко Ще ххх, Я я су ох ЗУ КВ Я кни у у Сг ІК ме и В фу з Он чер чиєтвква юному оз й ДК КК у я о тт ; хх г ее С му У о ЩЕ я ; ; а щи о ми х су Е: М я У їх Я З Кі З СУ т 5 з. я сЗ З с ЗИ З , мшнш м н кс а Я с Я х кавова ан оо а о и а о оре) де см джм льдя с ко ж и М и и у М І; сій Кох овен в о в в У Х в ки кх ШЕ же Ту жк хм ци й с нм о Ех си КД х нео о о о ВО а

   Фіг. 2

   «Ж ; ве ї г : й Слова лов ОВ ЛОВ о ла в В п. л. В О п В І В І І В НЕ М НИ НЕ ЕЕ З М З У и и ЗП є З З ЕЕ Й манна нини нина яки НАША ЛИ ЖИ МИ ЖЕ АЕН МЖК Ж А ЖК В и Ли и и Ж нн емсх х ; ; у я хм ни: нене не пок ві мій місій зі Зм: зай ін за и вк о нс а вн ви екв нни нан и ин й ЗД и п ЗЕ НН І НН І п п п п п п п о з з п З п о М п м с п по п о о п м ОН . г унів нні вва нин ними ними они на ваними мамсьми : у ша пишне ВЕН Е НКИ МЕНЕ КЕ Ева ВВ ЕННЕ ЕЕ ФЕНИ НКИ НЕОН ФЮ КО НЕ НЕ ЖК НК: КИ ЯКА й нини ннникни няння нижня ЩА УМЕЕЕЯ КВ ЛЕ ЖЕ В ІИ И КК: ВЕК ЕК КИ ОКА КИ А КА НАЕК КИ КК ВЕС МЕН МЕНА АК и ен п вв ВК КН п п п Ко п п п п п в МОН ВТК шлам, ши АНА НА ИН НН А НН о ДН А КИ НН нах НИ За знкаеві пе о очв ов НУК ВКя ЩЕ паовевоов КК Т волів'в щі ши нн ИЙ й й ЩЕ 5. г їй а во : Мей ї ї Кох її ї ів ЕЕ й Ї і і Канн м : НЕ НЕ щ ем МВ ; о пи з МЕ З в В В М М В В В З В З З ПН М і п ЕД п в ЗМ В ЕНН ЕЕ Кудінов де кін кофе нки дк ідею ренні цех уні пр втра Кк ким нах дк не у реве нд едмпт рмом чив олоим о у Р ОО .: ЗД НЕ Ви МЕ В НН ЗЕ ВЕ З І По п З а п з З п ЗМ М УМ а а ЗД п о КВ ПН и Я ОКО НК А КН НК А А КА А НН ПИ АК НИ ДИ НК НИ ЧИ АКНЕ ІНН КВ и и вав МВ МНС неви НН кино на вв гом зе ни и НИ ЕЕ А ИН и по о п п п п п п п Мп є с п п УП С ЗП М ДМШ МЕ ни І нн НЕ м З и п п в и и си м пи В В ВК ОМ

   Фіг. З