TWI847365B - 半導體裝置及其布局方法 - Google Patents
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Abstract
一種半導體裝置及其布局方法。半導體裝置包含基板、二第一電壓至電流轉換器及二第二電壓至電流轉換器。基板包含四布局區域,排列為具有多行及多列的陣列,陣列相對於第一軸與第二軸為線對稱,第一軸垂直相交第二軸於陣列的陣列中心點。二第一電壓至電流轉換器分別設置於四布局區域的其中二者中,在基板的布局相對於陣列中心點為點對稱。二第二電壓至電流轉換器分別設置於四布局區域的另外二者中,在基板的布局相對於陣列中心點為點對稱。
Description
本揭示文件是關於一種半導體裝置及其布局方法,特別是關於一種具有點對稱結構之電壓至電流轉換器的半導體裝置及其布局方法。
電流鏡(Current Mirror)電路為一種具有複製輸入端電流的功能的電路。透過電流鏡電路,除了可以輸出與輸入端電流大小相同的電流,也能透過調整以輸出輸入端電流大小之數倍的電流。此外,由於電流鏡電路具有較高的輸出阻抗,可以保持穩定的輸出電流,因此經常使用於半導體裝置中。
由於電流鏡電路中的每個電晶體分別具有氧化物擴散(Oxide Diffusion,OD)區域,在一般的製程中,為了提高半導體裝置的面積利用率,通常會將電流鏡電路中用於產生同一輸出電流之電壓至電流轉換器的所有電晶體排為一列且位於同一氧化物擴散區域上,使得相鄰的電晶體之間可以共用氧化物擴散區域,以降低總布局面積。
然而,由於製程中的效能梯度效應(例如,製造時光源的角度差異、蝕刻的差異等)的影響,不同列上的不同電壓至電流轉換器會有不同的電路特性,使得不同電壓至電流轉換器的輸出能力不同,進而影響半導體裝置的運作。因此,如何降低由於電流鏡電路的布局所導致的輸出能力變異問題,為本領域的課題之一。
本揭示文件提供一種半導體裝置,包含基板、兩個第一電壓至電流轉換器以及兩個第二電壓至電流轉換器。基板包含四個布局區域,四個布局區域排列為具有多行及多列的陣列,陣列相對於第一軸為線對稱,且相對於第二軸為線對稱,其中第一軸垂直相交於第二軸於陣列的陣列中心點。兩個第一電壓至電流轉換器分別設置於四個布局區域的其中二者中,且兩個第一電壓至電流轉換器在基板上的布局相對於陣列中心點為點對稱。兩個第二電壓至電流轉換器分別設置於四個布局區域的另外二者中,且兩個第二電壓至電流轉換器在基板上的布局相對於陣列中心點為點對稱。
本揭示文件提供一種布局方法,用於製造一半導體裝置,包含:提供一基板,其中此基板包含四個布局區域,四個布局區域排列為具有多行及多列的陣列,陣列相對於第一軸為線對稱,且相對於第二軸為線對稱,其中第一軸垂直相交於第二軸於陣列的陣列中心點;將兩個第一電壓至電流轉換器設置在四個布局區域的其中二者中,且在基板上的布局相對於陣列中心點為點對稱;以及將兩個第二電壓至電流轉換器設置在四個布局區域的另外二者中,且在基板上的布局相對於該陣列中心點為點對稱。
透過本揭示文件的半導體裝置及其布局方法,可以在維持半導體裝置的面積利用率的情況下,改善不同的電流鏡電路之間輸出能力變異的狀況,以提高半導體裝置的表現能力。
於本揭示文件中,雖然使用「第一」、「第二」、…等用語描述不同元件,該用語僅是用以區別以相同技術用語描述的元件或操作。除非上下文清楚指明,否則該用語並非特別指稱或暗示次序或順位,亦非用以限定本揭示文件。
以下將配合相關圖式來說明本揭示文件的實施例。在圖式中,相同的標號表示相同或類似的元件或方法流程。
第1圖為根據一些實施例的半導體裝置100的部分電路示意圖。在一些實施例中,半導體裝置100包含基板SB(繪示於第3圖)、電流至電壓轉換器CS、第一電壓至電流轉換器AA1~AA2以及第二電壓至電流轉換器AB1~AB2。電流至電壓轉換器CS、第一電壓至電流轉換器AA1~AA2以及第二電壓至電流轉換器AB1~AB2設置於半導體裝置100的基板SB上。第一電壓至電流轉換器AA1~AA2互相並聯且耦接至電流至電壓轉換器CS,用以共同將電流至電壓轉換器CS提供的操作電壓轉換為輸出電流IA。第二電壓至電流轉換器AB1~AB2互相並聯且耦接至電流至電壓轉換器CS,用以共同將電流至電壓轉換器CS提供的操作電壓轉換為輸出電流IB。在一些實施例中,電流至電壓轉換器CS與第一電壓至電流轉換器AA1~AA2組合形成一電流鏡電路,且電流至電壓轉換器CS與第二電壓至電流轉換器AB1~AB2組合形成另一電流鏡電路。
在一些實施例中,電流至電壓轉換器CS包含一個電流源RS,用以提供參考電流IS。在操作上,電流至電壓轉換器CS會先將參考電流IS轉換為操作電壓,再將操作電壓提供至第一電壓至電流轉換器AA1~AA2及第二電壓至電流轉換器AB1~AB2。因此,第一電壓至電流轉換器AA1~AA2及第二電壓至電流轉換器AB1~AB2輸出的輸出電流IA及IB與電流源RS提供的參考電流IS相關聯,以實現電流鏡的功能。
第2A圖為根據一些實施例的第一電壓至電流轉換器AA1的電路示意圖。在一些實施例中,第一電壓至電流轉換器AA1包含互相並聯的至少一個子轉換器A1、互相並聯的多個子轉換器A2以及互相並聯的多個子轉換器A3,其中子轉換器A2的數量為子轉換器A1的數量的兩倍,且子轉換器A3的數量為子轉換器A2的數量的兩倍。以第1圖以及第2A圖的實施例為例,第一電壓至電流轉換器AA1包含一個子轉換器A1、兩個子轉換器A2以及四個子轉換器A3。第一電壓至電流轉換器AA1中互相並聯的子轉換器(例如,所有子轉換器A1或所有子轉換器A2)會同時致能。子轉換器A1產生之電流為參考電流IS之i倍;子轉換器A2產生之電流為參考電流IS之2i倍;且子轉換器A3產生之電流為參考電流IS之4i倍,其中i為正數,藉此第一電壓至電流轉換器AA1可以輸出參考電流IS的不同倍數的輸出電流IA。
在一些實施例中,子轉換器A1~A3分別包含串聯耦接的第一電晶體T1、第二電晶體T2以及分別耦接至第一電晶體T1的閘極端以及第二電晶體T2的閘極端的兩個開關SW。當子轉換器「致能」時,開關SW會導通,使得子轉換器中的第一電晶體T1以及第二電晶體T2之閘極端被導通至電流至電壓轉換器CS以接收操作電壓。當子轉換器「禁能」時,開關SW會斷開,使得子轉換器中的第一電晶體T1以及第二電晶體T2之閘極端與電流至電壓轉換器CS相互絕緣。第一電壓至電流轉換器AA1~AA2彼此具有相似的元件、連接關係與運作,為簡潔起見,第一電壓至電流轉換器AA2的詳細結構未繪示於第2A圖中。值得一提的是,互相並聯的第一電壓至電流轉換器AA1~AA2中對應於相同放大倍率的子轉換器會同時致能或同時禁能,例如對應於放大倍率i的所有子轉換器A1會同時致能或同時禁能,對應於放大倍率2i的所有子轉換器A2會同時致能或同時禁能。
另一方面,請參照第2B圖,第2B圖為根據一些實施例的第二電壓至電流轉換器AB1的電路示意圖。第二電壓至電流轉換器AB1包含互相並聯的至少一個子轉換器B1、互相並聯的多個子轉換器B2以及互相並聯的多個子轉換器B3,其中子轉換器B2的數量為子轉換器B1的數量的兩倍,且子轉換器B3的數量為子轉換器B2的數量的兩倍。以第1圖以及第2B圖的實施例為例,第二電壓至電流轉換器AB1包含一個子轉換器B1、兩個子轉換器B2以及四個子轉換器B3。因此,子轉換器B1產生之電流為參考電流IS之i倍;子轉換器B2產生之電流為參考電流IS之2i倍;且子轉換器B3產生之電流為參考電流IS之4i倍。子轉換器B1~B3分別包含串聯耦接的第一電晶體T1以及第二電晶體T2。第二電壓至電流轉換器AB1~AB2彼此具有相似的元件、連接關係與運作,為簡潔起見,第二電壓至電流轉換器AB2的詳細結構未繪示於第2B圖中。第二電壓至電流轉換器AB1~AB2的運作相似於第一電壓至電流轉換器AA1~AA2,為了簡潔起見,在此不重複贅述。
為了清楚說明第一電壓至電流轉換器AA1~AA2及第二電壓至電流轉換器AB1~AB2在半導體裝置100的布局,請一併參照第3圖。第3圖為根據一些實施例的第一電壓至電流轉換器AA1~AA2及第二電壓至電流轉換器AB1~AB2的布局示意圖。
在一些實施例中,半導體裝置100的基板SB包含布局區域AR1~AR4。布局區域AR1~AR4在半導體裝置100中被配置為每個行(column)與每個列(row)皆包含兩個布局區域的陣列,此陣列相對於平行於基板SB的第一軸X為線對稱,且相對於平行於基板SB的第二軸Y亦為線對稱,其中第一軸X垂直相交第二軸Y於陣列中心點Cen。
在一些實施例中,第一電壓至電流轉換器AA1及AA2分別設置於布局區域AR1及AR4,而第二電壓至電流轉換器AB1及AB2則分別設置於布局區域AR2及AR3。兩個第一電壓至電流轉換器AA1及AA2在基板SB上的布局相對於陣列中心點Cen為點對稱,兩個第二電壓至電流轉換器AB1及AB2在基板SB上的布局相對於陣列中心點Cen亦為點對稱。
如第3圖所示,第一電壓至電流轉換器AA1與AA2中同步致能的子轉換器相對於陣列中心點Cen為點對稱。例如,第一電壓至電流轉換器AA1與AA2的多個子轉換器A1,相對於陣列中心點Cen為點對稱。又例如,第一電壓至電流轉換器AA1與AA2的多個子轉換器A2,相對於陣列中心點Cen亦為點對稱。第二電壓至電流轉換器AB1與AB2中同步致能的子轉換器相對於陣列中心點Cen亦為點對稱。例如,第二電壓至電流轉換器AB1與AB2的多個子轉換器B1,相對於陣列中心點Cen為點對稱。
換句話說,根據前述的子轉換器A1~A3的數量關係可以得知,第一電壓至電流轉換器AA1與AA2中的N個子轉換器(即子轉換器A1)會同步致能且相對於陣列中心點Cen為點對稱,另外2N個子轉換器(即子轉換器A2)會同步致能且相對於陣列中心點Cen為點對稱,又另外4N個子轉換器(即子轉換器A3)會同步致能且相對於陣列中心點Cen為點對稱,其中N為正整數。
同樣地,根據前述的子轉換器B1~B3的數量關係可以得知,第二電壓至電流轉換器AB1與AB2中的N個子轉換器(即子轉換器B1)會同步致能且相對於陣列中心點Cen為點對稱,另外2N個子轉換器(即子轉換器B2)會同步致能且相對於陣列中心點Cen為點對稱,又另外4N個子轉換器(即子轉換器B3)會同步致能且相對於陣列中心點Cen為點對稱。
透過上述點對稱的布局方式,不僅可以將半導體裝置100中互相並聯之電壓至電流轉換器(例如,第一電壓至電流轉換器AA1與AA2)在製程中所受到的效能梯度效應幾乎相同,未互相並聯之電壓至電流轉換器(例如,第一電壓至電流轉換器AA1及AA2與第二電壓至電流轉換器AB1及AB2)所受到的效能梯度效應也會幾乎相同。換句話說,半導體裝置100中的所有電壓至電流轉換器所受到的效能梯度效應都幾乎相同,因此輸出能力變異的問題可以得到改善,輸出電流IA與IB得以具有相同的大小(相同的參考電流IS的放大倍率),具體說明如下。
第4圖為根據一些實施例的子轉換器A1、A2、B1以及B2的示意圖。相對於陣列中心點Cen為點對稱的兩個子轉換器A1,其各自包含的第一電晶體T1彼此之間亦為點對稱,其各自包含的第二電晶體T2彼此之間亦為點對稱。另外,相對於陣列中心點Cen為點對稱的兩個子轉換器B1,其各自包含的第一電晶體T1彼此之間亦為點對稱,其各自包含的第二電晶體T2彼此之間亦為點對稱。總而言之,子轉換器A1、A2、B1以及B2中同步致能者,不僅在布局位置上相對於陣列中心點Cen為點對稱,其內部之電晶體電路結構也相對於陣列中心點Cen為點對稱。
第4圖中以虛線箭號之長度表示不同布局位置在製程當中所受到的效能梯度效應之強度。如第4圖所示,所有電壓至電流轉換器中對應於相同放大倍率的子轉換器皆會受到相似大小的效能梯度效應,而具有相似的特性變異。例如,第一電壓至電流轉換器AA1~AA2中對應於放大倍率i的兩個子轉換器A1與第二電壓至電流轉換器AB1~AB2中對應於放大倍率i的兩個子轉換器B1,會受到相同大小的效能梯度效應。
總而言之,由於第一電壓至電流轉換器AA1~AA2受到的總效能梯度效應,近似於第二電壓至電流轉換器AB1~AB2受到的總效能梯度效應,使輸出電流IA與IB得以具有相同的大小。
第5圖為根據一些實施例的半導體裝置100的布局示意圖。請同時參考第3圖和第5圖,在一些實施例中,半導體裝置100更包含設置於基板SB上且平行於第一軸X的多個氧化物擴散區域OD。多個氧化物擴散區域OD的其中兩者重疊於布局區域AR1和AR2,且多個氧化物擴散區域OD的另外兩者重疊於布局區域AR3和AR4。多個第一電晶體T1的一部分和多個第二電晶體T2的一部份在同一個氧化物擴散區域OD上交替排列,形成一部份之子轉換器A1~A3與一部份之子轉換器B1~B3。
在一些實施例中,半導體裝置100更包含多個虛設電晶體DMY,這些虛設電晶體DMY被設置於氧化物擴散區域OD上,且環繞於布局區域AR1~AR4,用於減輕第一電壓至電流轉換器AA1~AA2與第二電壓至電流轉換器AB1~AB2之漏電流。
請再一併參照第2A~2B圖與第5圖。在一些實施例中,當半導體裝置100中的第一電晶體T1以及第二電晶體T2為N型電晶體時,第一電晶體T1的源極S會耦接至地線GND,第一電流轉換器陣列AA1~AA2的第二電晶體T2的汲極D會耦接至電流導線LA以傳送輸出電流IA,而第二電流轉換器陣列AB1~AB2的第二電晶體T2的汲極D會耦接至電流導線LB以傳送輸出電流IB。
在另一些未繪示的實施例中,當半導體裝置100中的第一電晶體T1以及第二電晶體T2為P型電晶體時,第一電晶體T1的源極S會耦接至一電源線以接收參考電壓,第一電流轉換器陣列AA1~AA2的第二電晶體T2的汲極D會耦接至電流導線LA以傳送輸出電流IA,而第二電流轉換器陣列AB1~AB2的第二電晶體T2的汲極D會耦接至電流導線LB以傳送輸出電流IB。
第6圖為根據第5圖的區域RG的半導體裝置100的部分示意圖。依據連接方式不同,氧化物擴散區域OD可以做為電晶體的汲極D或源極S。在一些實施例中,當第一電晶體T1耦接於位於相同的氧化物擴散區域OD的第二電晶體T2時,第一電晶體T1的汲極D會耦接於第二電晶體T2的源極S。
以第6圖的實施例為例,在區域RG中,子轉換器B1、A1及A2的第一電晶體T1以及第二電晶體T2被設置於同一個氧化物擴散區域OD上。如第6圖所示,由於子轉換器B1的第一電晶體T1相鄰於子轉換器B1的第二電晶體T2,因此子轉換器B1的第一電晶體T1的汲極D會耦接於子轉換器B1的第二電晶體T2的源極S。由於子轉換器A1的第一電晶體T1相鄰於子轉換器A1的第二電晶體T2,因此子轉換器A1的第一電晶體T1的汲極D會耦接於子轉換器A1的第二電晶體T2的源極S。由於子轉換器A2的第一電晶體T1相鄰於子轉換器A2的第二電晶體T2,因此子轉換器A2的第一電晶體T1的汲極D會耦接於子轉換器A2的第二電晶體T2的源極S。
另一方面,當第一電晶體T1耦接於位於相同的氧化物擴散區域OD的另一個第一電晶體T1時,兩個第一電晶體T1的源極S會彼此耦接。請再參照第6圖,由於子轉換器A1的第一電晶體T1相鄰於子轉換器B1的第一電晶體T1,因此子轉換器A1與B1各自的第一電晶體T1的源極S會彼此耦接,並且耦接至地線GND(圖未繪示)。
再者,當第二電晶體T2耦接於位於相同的氧化物擴散區域OD的另一個第二電晶體T2時,兩個第二電晶體T2的汲極D會彼此耦接。請再參照第6圖,由於子轉換器A1的第二電晶體T2相鄰於子轉換器A2的第二電晶體T2,因此子轉換器A1與A2各自的第二電晶體T2的汲極D會彼此耦接。
在一些實施例中,第一電晶體T1的閘極G具有閘極長度L1,第二電晶體T2的閘極G具有閘極長度L2,且閘極長度L1大於或等於閘極長度L2。
在一些實施例中,第一電晶體T1的閘極G以及第二電晶體T2的閘極G具有相同的有效閘極寬度W。
請再參照第5圖。在一些實施例中,當虛設電晶體DMY耦接於位於相同的氧化物擴散區域OD的第一電晶體T1時,此虛設電晶體DMY的源極會耦接於此第一電晶體T1的源極S,且此虛設電晶體DMY的閘極會具有與此第一電晶體T1的閘極G相同的閘極長度L1與有效閘極寬度W。另一方面,當虛設電晶體DMY耦接於位於相同的氧化物擴散區域OD的第二電晶體T2時,此虛設電晶體DMY的汲極會耦接於此第二電晶體T2的汲極D,且此虛設電晶體DMY的閘極會具有與此第二電晶體T2的閘極G相同的閘極長度L2與有效閘極寬度W。
本揭示文件提供一種布局方法,用於製造半導體裝置100,此布局方法包含:提供一基板SB;將第一電壓至電流轉換器AA1及AA2設置在基板SB的布局區域AR1~AR4的其中二者中;以及將第二電壓至電流轉換器AB1及AB2設置在基板SB的布局區域AR1~AR4的另外二者中。其中布局區域AR1~AR4排列為具有多行及多列的陣列,此陣列相對於一第一軸X與一第二軸Y為線對稱,第一軸X垂直相交於第二軸Y於陣列的一陣列中心點Cen。第一電壓至電流轉換器AA1及AA2在基板SB上的布局相對於陣列中心點Cen為點對稱。第二電壓至電流轉換器AB1及AB2在基板SB上的布局相對於陣列中心點Cen為點對稱。
透過本揭示文件提供的半導體裝置100以及其布局方法,可以在有效利用半導體裝置100的氧化物擴散區域OD面積的情況下,降低效能梯度效應所導致的輸出能力變異問題,以增進半導體裝置100的可靠度。
以上僅為本揭示文件的較佳實施例,在不脫離本揭示文件的範圍或精神的情況下,本揭示文件的結構可以進行各種修飾和均等變化。綜上所述,凡在以下請求項的範圍內對於本揭示文件所做的修飾以及均等變化,皆為本揭示文件所涵蓋的範圍。
100:半導體裝置
AA1,AA2:第一電壓至電流轉換器
AB1,AB2:第二電壓至電流轉換器
CS:電流至電壓轉換器
RS:電流源
IS:參考電流
IA,IB:輸出電流
SB:基板
A1~A3,B1~B3:子轉換器
AR1~AR4:布局區域
Cen:陣列中心點
T1:第一電晶體
T2:第二電晶體
SW:開關
S:源極
D:汲極
G:閘極
OD:氧化物擴散區域
W:有效閘極寬度
L1,L2:閘極長度
GND:地線
LA,LB:電流導線
DMY:虛設電晶體
RG:區域
X:第一軸
Y:第二軸
為使本揭露之上述和其他目的、特徵、優點與實施例能更明顯易懂,所附圖式之說明如下:
第1圖為根據一些實施例的半導體裝置的部分電路示意圖;
第2A圖為根據一些實施例的電壓至電流轉換器的電路示意圖;
第2B圖為根據一些實施例的電壓至電流轉換器的電路示意圖;
第3圖為根據一些實施例的多個電壓至電流轉換器的布局示意圖;
第4圖為根據一些實施例的多個子轉換器的示意圖;
第5圖為根據一些實施例的多個電壓至電流轉換器的布局示意圖;以及
第6圖為根據第5圖的區域RG的半導體裝置的部分示意圖。
國內寄存資訊(請依寄存機構、日期、號碼順序註記)
無
國外寄存資訊(請依寄存國家、機構、日期、號碼順序註記)
無
100:半導體裝置
AA1,AA2:第一電壓至電流轉換器
AB1,AB2:第二電壓至電流轉換器
CS:電流至電壓轉換器
RS:電流源
IS:參考電流
IA,IB:輸出電流
Claims (10)
- 一種半導體裝置,包含:一基板,包含四布局區域,其中該四布局區域排列為具有多行及多列的一陣列,該陣列相對於一第一軸為線對稱,且相對於一第二軸為線對稱,其中該第一軸垂直相交於該第二軸於該陣列的一陣列中心點;二第一電壓至電流轉換器,分別設置於該四布局區域的其中二者中,且該二第一電壓至電流轉換器在該基板上的布局相對於該陣列中心點為點對稱;以及二第二電壓至電流轉換器,分別設置於該四布局區域的另外二者中,且該二第二電壓至電流轉換器在該基板上的布局相對於該陣列中心點為點對稱,其中該二第一電壓至電流轉換器包含多個第一子轉換器,該多個第一子轉換器中的N者同步致能且相對於該陣列中心點為點對稱,該多個第一子轉換器中的另2N者同步致能且相對於該陣列中心點為點對稱,其中N為正整數。
- 如請求項1所述之半導體裝置,其中,該二第二電壓至電流轉換器包含多個第二子轉換器,該二第一電壓至電流轉換器的其中一者的多個第一子轉換器之布局與該二第一電壓至電流轉換器的另一者的多個第一子轉換器之布局相對於該陣列中心點為點對稱,且該二第二電壓至電流轉換器的其中一者的多個第二子轉換器之布局與該二第二電壓至電流轉換器的另一者的多個 第二子轉換器之布局相對於該陣列中心點為點對稱。
- 如請求項2所述之半導體裝置,其中,該多個第二子轉換器中同步致能者相對於該陣列中心點為點對稱。
- 如請求項2所述之半導體裝置,其中,該多個第一子轉換器與該多個第二子轉換器各自包含一第一電晶體以及一第二電晶體,該多個第一子轉換器與該多個第二子轉換器的多個第一電晶體具有相同的一第一閘極長度,該多個第一子轉換器與該多個第二子轉換器的多個第二電晶體具有相同的一第二閘極長度,其中該第一閘極長度大於或等於該第二閘極長度,且該多個第一電晶體以及該多個第二電晶體具有相同的一有效閘極寬度。
- 如請求項4所述之半導體裝置,更包含:多個氧化物擴散區域,設置於該基板上且平行該第一軸排列,其中該多個氧化物擴散區域中的二者重疊於該四布局區域中的二者,該多個氧化物擴散區域中的另外二者重疊於該四布局區域中的另外二者,其中該多個第一電晶體的一部分和該多個第二電晶體的一部份在同一個氧化物擴散區域上交替排列,形成該多個 第一子轉換器的一部份與該多個第二子轉換器的一部份。
- 如請求項5所述之半導體裝置,其中,該多個第一電晶體以及該多個第二電晶體各自包含一源極以及一汲極,該多個第一電晶體的每一者的該汲極耦接於位於相同氧化物擴散區域的一相鄰的第二電晶體的該源極,該多個第一電晶體的該每一者的該源極耦接於位於相同氧化物擴散區域的一相鄰的第一電晶體的該源極,且位於相同氧化物擴散區域的相鄰的二第二電晶體的該汲極互相耦接。
- 如請求項6所述之半導體裝置,更包含:多個虛設電晶體,設置於該基板上且環繞於該四布局區域,該多個虛設電晶體各自包含一虛設源極以及一虛設汲極,當該多個虛設電晶體的其中一者相鄰於位於相同氧化物擴散區域的該多個第一電晶體的其中一者時,該多個虛設電晶體的該其中一者的該虛設源極耦接於該多個第一電晶體的該其中一者的該源極,且當該多個虛設電晶體的該其中一者相鄰於位於相同氧化物擴散區域的該多個第二電晶體的其中一者時,該多個虛設電晶體的該其中一者的該虛設汲極耦接於該多個第二電晶體的該其中一者的該汲極。
- 如請求項7所述之半導體裝置,其中,當該多個虛設電晶體的該其中一者相鄰於位於相同氧化物擴散區域的該多個第一電晶體的該其中一者時,該多個虛設電晶體的該其中一者與該多個第一電晶體的該其中一者具有相同的該有效閘極寬度與該第一閘極長度,且當該多個虛設電晶體的該其中一者相鄰於位於相同氧化物擴散區域的該多個第二電晶體的其中一者時,該多個虛設電晶體的該其中一者與該多個第二電晶體的該其中一者具有相同的該有效閘極寬度與該第二閘極長度。
- 如請求項2至8任一者所述之半導體裝置,其中,該多個第一子轉換器中的又4N者同步致能且相對於該陣列中心點為點對稱,該多個第二子轉換器中的N者同步致能且相對於該陣列中心點為點對稱,該多個第二子轉換器中的另2N者同步致能且相對於該陣列中心點為點對稱,且該多個第二子轉換器中的又4N者同步致能且相對於該陣列中心點為點對稱。
- 一種布局方法,用於製造一半導體裝置,包含: 提供一基板,其中該基板包含四布局區域,該四布局區域排列為具有多行及多列的一陣列,該陣列相對於一第一軸為線對稱,且相對於一第二軸為線對稱,其中該第一軸垂直相交於該第二軸於該陣列的一陣列中心點;將二第一電壓至電流轉換器設置在該四布局區域的其中二者中,且該二第一電壓至電流轉換器在該基板上的布局相對於該陣列中心點為點對稱;以及將二第二電壓至電流轉換器設置在該四布局區域的另外二者中,且該二第二電壓至電流轉換器在該基板上的布局相對於該陣列中心點為點對稱,其中該二第一電壓至電流轉換器包含多個第一子轉換器,該多個第一子轉換器中的N者同步致能且相對於該陣列中心點為點對稱,該多個第一子轉換器中的另2N者同步致能且相對於該陣列中心點為點對稱,其中N為正整數。
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WO2001061842A1 (en) | 2000-02-15 | 2001-08-23 | Broadcom Corporation | Variable transconductance variable gain amplifier utilizing a degenerated differential pair |
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