TWI724383B - 供使用於形成適應層的裝置、形成適應層的方法及在第一基板上形成層的方法 - Google Patents

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TWI724383B
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Abstract

一種裝置可以包括邏輯元件，其被配置為至少部分地基於與第一基板卡盤和第二基板卡盤相關聯的平坦度分佈的差異來產生與要在當前基板上形成的適應層相對應的資訊。在另一個態樣中，一種方法可以包括使用先前基板獲得該第一和第二基板卡盤的厚度分佈的差異，以及在當前基板之先前所形成的圖案化層之上並且在形成對準於該先前所形成的圖案化層的圖案化抗蝕劑層之前形成適應層。在一個實施例中，該適應層的該厚度分佈為該基板卡盤的該平坦度分佈的差異的倒數的函數。該適應層可以幫助減少與基板卡盤的不同的平坦度分佈相關的重疊誤差。

Description

供使用於形成適應層的裝置、形成適應層的方法及在第一基板上形成層的方法
本發明關於裝置，更具體地係關於用於形成適應層的裝置。
微影裝置和製程對於在電子器件的製造中，於半導體基板上形成奈米級圖案係有幫助的。這樣的裝置和製程可以包括使用用於沉積可成型材料的流體分配系統，使用諸如流體液滴分配的技術將可成型材料(例如，可聚合材料，諸如樹脂或抗蝕劑)沉積到基板上。使分配的材料與具有所需圖案特徵的壓印模板(或模具)接觸，然後固化，在基板上形成圖案化層。模板特徵填充率和相關缺陷部分地取決於模板圖案特徵密度和取向以及液滴圖案佈置，包括流體液滴間距。
當在當前的階段形成圖案化的抗蝕劑層時，圖案化的抗蝕劑層相對於先前的圖案化層需要適當地重疊。可以使用光微影、壓印微影或其他圖案化技術形成先前的圖案化層。層與層之間的任何偏差稱為重疊誤差。即使是微影裝置上的任何部分的非常微小的偏差也會導致顯著的重疊誤差，因為在當前和先前的圖案化階段處形成的特徵的尺寸是非常微小的。
在一個態樣中，一種裝置包括邏輯元件，其被配置為至少部分地基於與第一基板卡盤和第二基板卡盤相關聯的平坦度分佈的差異來產生與要在當前基板上形成的適應層相對應的資訊。
在一個實施例中，該平坦度分佈的差異是至少部分地基於在先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用該第一基板卡盤來圖案化，並且該第二圖案化層係使用該第二基板卡盤來圖案化。
在一個特定的實施例中，該邏輯元件更被配置為移除對應於該第一和第二圖案化層之間的未對準的對準貢獻。
在另一個特定的實施例中，該邏輯元件還被配置為移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一 和第二壓印模板相關聯的壓印失真的壓印失真貢獻。
在又一個特定的實施例中，該邏輯元件更被配置為移除平均場特性。
在又一個特定的實施例中，該邏輯元件還被配置為移除與該第一和第二基板卡盤相關聯的平坦度引起的失真貢獻。
在另一個特定的實施例中，該邏輯元件還被配置為：測量先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用該第一基板卡盤來圖案化，並且該第二圖案化層係使用該第二基板卡盤來圖案化；移除對應於該第一和第二圖案化層之間的未對準的對準貢獻；移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的壓印失真的壓印失真貢獻；以及移除與該第二基板卡盤相關的平坦度引起的失真貢獻。
在一個特定的實施例中，該邏輯元件還被配置為：移除平均場特性。
在又一個實施例中，對應於適應層的該資訊包括與該適應層相關聯的流體液滴圖案。
在另一個態樣中，一種方法包括確定與第一基板卡盤和第二基板卡盤相關的平坦度分佈的差異；在當前基板上形成適應層，其中該適應層具有厚度分佈，該厚度分佈為該平坦度分佈的差異的倒數的函數。
在一個實施例中，確定該平坦度分佈的差異包括測量先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用該第一基板卡盤來圖案化，並且該第二圖案化層係使用該第二基板卡盤來圖案化。
在一個特定的實施例中，確定該平坦度分佈的差異還包括移除對應於該第一和第二圖案化層之間的未對準的對準貢獻。
在另一個特定的實施例中，確定平坦度分佈的差異還包括移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的壓印失真的壓印失真貢獻。
在又一個特定的實施例中，確定該平坦度分佈的差異還包括移除平均場特性。
在一個更具體的實施例中，確定該平坦度分佈的差異還包括確定與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的平均場特性。
在另一個特定的實施例中，確定該平坦度分佈的差異還包括移除與該第一和第二基板卡盤相關聯的平坦度引起的失真貢獻。
在一個更具體的實施例中，該方法還包括估計由於該第一和第二基板卡盤的平坦度分佈的差異引起的 失真，其中該估計的失真對應於該平坦度引起的失真貢獻。
在另一實施例中，確定該平坦度分佈的差異包括：測量先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用該第一基板卡盤來圖案化，並且該第二圖案化層係使用該第二基板卡盤來圖案化；移除對應於該第一和第二圖案化層之間的未對準的對準貢獻；移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的壓印失真的壓印失真貢獻；以及估計由於該第一和第二基板卡盤的平坦度分佈的差異引起的失真。
在一個特定的實施例中，確定該平坦度分佈的差異還包括移除平均場特性。
在又一個實施例中，該方法更包括在該適應層和該當前基板上形成可成型材料；使該可成型材料與壓印模板接觸；以及固化該可成型層以形成圖案化抗蝕劑層。
302、322、324、326、328、342、1302、1322、1342、1344、1346:方塊
1002、1004、1006、1008、1012、1014、1016、1018、1022、1024、1026、1028、1032、1034、1036、1038:繪圖
1102、1104、1106、1108、1112、1114、1116、1118、1122、1124、1126、1128、1132、1134、1136、1138:模型
10、1600:裝置
12、1602:基板
14、1604:基板卡盤
16:平台
18:模板
20:模具
22:壓印表面
24:凹部
26、50:突起部
28:卡盤
30:頭部
32:流體分配系統
34:可成型材料
38:能量源
40:直接能量
42:路徑
44:表面
46:圖案化層
48:殘餘層
52:凹陷部
54:邏輯元件
56:記憶體
510、706:重疊計量標記
506:壓印場
700:場平均特性繪圖
702:縱坐標
704:橫坐標
1606:適應層
1608:抗蝕劑層
1610:光罩
1612:位置
實施例係經由範例的方式示出，並且不限於附隨的圖式。
圖1包括示例性裝置的側視圖的例示。
圖2包括圖1中所示之在形成圖案化層之後的 基板的橫截面視圖的例示。
圖3包括當從使用不同基板卡盤形成的兩個圖案化層之間的原始重疊誤差開始時，確定適應層的厚度分佈的流程圖。
圖4包括表示先前基板上的兩個不同圖案化層之間的原始重疊誤差的繪圖的例示。
圖5包括在移除對準和失真對原始重疊誤差的貢獻後之圖4的繪圖的例示。
圖6包括場平均特性的繪圖的例示。
圖7包括在移除場平均特性的貢獻後之圖5的繪圖的例示。
圖8包括由於圖7的繪圖中之平坦度分佈差異所導致的估計失真的例示。
圖9和10包括平坦度分佈之示例性差異和由平坦度分佈引起的相應的平面內失真的例示。
圖11包括用於在當前基板上形成適應層和圖案化抗蝕劑層的流程圖。
圖12包括基板卡盤、當前基板、適應層、圖案化抗蝕劑層和模板的部分的橫截面圖的例示。
技術人員將理解，圖中的元件是為了簡單和清楚而繪示出的，並且不一定按比例繪製。例如，圖中的一些元件的尺寸可能相對於其他元件被誇大，以幫助改進對本發明實施例的理解。
提供以下結合圖的描述以幫助理解本文所公開的教示。以下討論將集中於本教示的具體實現和實施方式。提供這樣的焦點是為了幫助描述教示，並且不應該被解釋為對教示的範圍或適用性的限制。
除非另外定義，否則本文使用的所有技術和科學術語具有與本發明所屬領域的普通技術人員通常理解的含義相同的含義。材料、方法和範例僅是說明性的而非用於限制的。在本文未描述的範圍內，關於特定材料和處理行為的許多細節係常規的，並且可以在壓印和微影技術中的教科書和其他來源中找到。
如本文所述的實施例可用於減少不同基板卡盤之間的平坦度分佈差異相對於重疊誤差的影響。關於兩個基板卡盤的平坦度分佈的差異的資料可用於確定適應層的厚度分佈。在一個實施例中，先前基板可以具有兩個不同的圖案化層，其中一個圖案化層與另一個圖案化層對準，並且圖案化層在不同的基板卡盤上處理。可以確定原始重疊誤差，並且可以移除對原始重疊誤差的各種貢獻者，直到確定平坦度分佈的差異。在形成圖案化層之後並且在形成將與下層的圖案化層對準的圖案化抗蝕劑層之前，可以在當前基板上形成適應層。適應層可以具有厚度分佈，該厚度分佈是基板卡盤的平坦度分佈的差異的倒數的函數。適應層可以幫助抵消由於基板卡盤的平坦度分佈的差異而產生的影響。因此，能夠形成圖案化的抗蝕劑層 並將其與之前形成的圖案化層以具有較小的重疊誤差對準。
在結合圖來閱讀本說明書之後，可以更好地理解關於裝置和方法的細節。以下描述旨在說明實施例而不是限制本發明的範圍，本發明的範圍由所附申請專利範圍界定。
參考圖1，根據本文所描述的實施例的裝置10，其可用於在基板12上形成凸紋圖案。基板12可以連接到基板卡盤14。如圖所示，基板卡盤14是真空吸盤；然而，在其他實施例中，基板卡盤14可以是任何卡盤，包括真空、銷型、凹槽型、靜電、電磁等等。基板12和基板卡盤14可以進一步由平台16支撐。平台16可以沿X、Y或Z方向提供平移或旋轉運動。平台16、基板12和基板卡盤14也可以定位在基座(未示出)上。
與基板12間隔開的是模板18。模板18可包括具有第一側和第二側的主體，其一側具有從其朝向基板12延伸的模具20。模具20有時被稱為台面。在一個實施例中，模板18可以在沒有模具20的情況下形成。
模板18、模具20或兩者可由這樣的材料形成：包括熔融矽石、石英、矽、有機聚合物、矽氧烷聚合物、硼矽酸鹽玻璃、氟碳化物高分子、金屬、硬化藍寶石、其他類似材料或其任何組合。模板18和模具20可包括單件結構。或者，模板18和模具20可包括耦合在一起的單獨部件。如圖所示，模具20的壓印表面22包括由間隔開的 凹部24和突起部26來界定的特徵。壓印表面22可以界定任何原始圖案，其形成要在基板12上形成的圖案的基礎。在另一個實施例中，壓印表面22可以是坯料，也就是說，壓印表面22不具有任何凹部或突起。
模板18可以連接到卡盤28。卡盤28可以配置為真空、銷型、凹槽型、靜電、電磁或其他類似的卡盤類型。在一個實施例中，卡盤28可以耦合到頭部30，使得卡盤28或頭部30可以促進模板18的移動。
裝置10還可包括用於在基板12上沉積可成型材料34的流體分配系統32。例如，可成型材料34可包括可聚合材料，例如樹脂。可成型材料34可使用諸如液滴分配、旋轉塗布、浸漬塗布、化學氣相沉積(CVD)、物理氣相沉積(PVD)、薄膜沉積、厚膜沉積或其組合等技術以一層或多層定位在基板12上。依據設計考量，在模具20和基板12之間界定所需的容積之前或之後，可成型材料34可以分配在基板12上。例如，可成型材料34可包括可使用紫外線、熱等固化的單體混合物。
裝置10還可以包括沿著路徑42耦合到直接能量40的能量源38。頭部30和平台16可以配置成將模板18和基板12定位成與路徑42重疊。裝置10可以是由與平台16、頭部30、流體分配系統32或源38通訊的邏輯元件54調節，並且可以在電腦可讀程式上操作，可選地係儲存在記憶體56中。邏輯元件54可以是處理器(例如，微處理器或微控制器的中央處理單元)、現場可程式閘陣列(FPGA)、特定 應用積體電路(ASIC)等。處理器、FPGA或ASIC可以位於裝置內。在另一個實施例(未示出)中，邏輯元件可以是裝置10的外部的電腦，並且雙向耦合到裝置10。
在一個特定態樣中，邏輯元件54可以被配置為執行或提供用於裝置10的另一組件的指令，以執行本文所描述的方法的一個或多個操作。例如，邏輯元件54可以被配置為執行一個或多個邏輯操作，以至少部分地基於與第一基板卡盤及第二基板卡盤相關聯的平坦度分佈的差異來產生與要在當前基板上形成的適應層相對應的資訊。平坦度分佈的差異可以至少部分地基於在先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用第一基板卡盤來圖案化，並且該第二圖案化層係使用第二基板卡盤來圖案化。
邏輯元件54可以被配置為執行一個或多個邏輯操作以測量在先前基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用第一基板卡盤來圖案化，並且該第二圖案化層係使用第二基板卡盤來圖案化。可以使用任何合適的微影圖案化技術形成第一圖案化層，例如光微影或壓印微影。或者，這樣的重疊誤差資訊可以由計量工具提供。
在另一個態樣中，邏輯元件54可以被配置為執行一個或多個邏輯操作以移除對應於第一和第二圖案化層之間的未對準的對準貢獻。此外，邏輯元件54還可以被配置為執行一個或多個邏輯操作以移除對應於與用於形成 第一圖案化層的第一壓印模板、用於形成第二圖案化層的第二壓印模板或第一和第二壓印模板相關聯的壓印失真的壓印失真貢獻。在又一態樣中，邏輯元件54還可以被配置為執行一個或多個邏輯操作以移除平均場特性並估計由於基板卡盤的平坦度分佈的差異而導致的失真。
關於產生資訊以形成具有適當厚度的適應層的方法的更多細節將在本說明書中稍後描述。接下來的幾段中的描述涉及裝置10及其在使用壓印微影技術形成圖案化層中的用途。
參考圖1和圖2，在一個實施例中，頭部30、平台16或頭部30和平台16兩者改變模具20和基板12之間的距離，以在它們之間界定由可成型材料34來填充之所需的容積。例如，頭部30可以向模板18施加力，使得模具20接觸基板12上的可成型材料34。在用可成型材料34填充所需之容積之後，源38可以產生能量40，例如紫外線輻射，使可成型材料34固化或交聯以在基板12上界定圖案化層46。圖案化層46具有符合基板12的表面44的形狀的下表面，以及符合壓印表面22的形狀的上表面。如圖2所示，圖案化層46可包括圖式示例為突起部50和凹陷部52的特徵，其中突起部50具有厚度t1，以及凹陷部52對應於具有厚度為t2的殘餘層48，t2為殘餘層厚度(RLT)。
當使用液滴分配方法於可成型材料34時，壓印操作通常包括(1)將基板12和流體分配系統32的流體分配端口相對於彼此移動，(2)照著流體液滴圖案於基板12 的表面上分配(或沉積)可成型材料34的流體液滴，(3)使模板18的壓印表面22與流體液滴接觸，使得流體擴散並填充壓印表面22的表面形貌，(4)固化(例如，光固化或熱固化)可成型材料34，以及(5)將模板18從基板12分離，將可成型材料34的圖案化層46留在基板表面上，其中圖案化層46具有壓印圖案22的凸紋圖像。
雖然圖案化層46的形成在概念基礎上相對簡單，但是圖案化層46非常難以形成，特別是考慮到小尺寸，避免模板18和基板12之間的直接接觸，並且期望裝置10的高產能。當需要與先前形成的圖案化層對準時，圖案化層46的形成會變得甚加困難。理論上，基板卡盤應該是完全地平坦的。實際上，可能會出現小的偏差並導致重疊誤差。例如，由於凹陷或在拋光或蝕刻該基板卡盤的期間的其他影響，與更密集封裝或相對地較寬的特徵(例如連接盤)相比，基板卡盤之隔離的或相對地窄的特徵(例如針腳)可位於稍低的高度。此外，沒有兩個基板卡盤是完全相同的，因此不同基板卡盤之間的平坦度分佈的一些差異是會發生的。可以形成適應層以抵消不同基板卡盤之間的平坦度分佈的差異。
即使製造技術可能相同，但在兩個基板卡盤之間也會存在差異。例如，連接盤的上表面和結構可以用不同的拋光墊拋光。即使當使用的拋光墊為相同時，與第一基板卡盤相比，拋光第二基板卡盤時拋光墊可能磨損得更嚴重。拋光工具和基板卡盤之間的拋光漿料、下壓力、 旋轉運動、軌道運動或其任何組合是非常地相似但不完全相同。這些差異可能導致重疊錯誤。如下面將討論的，可以確定基板卡盤之間的平坦度分佈的差異，並且可以形成適應層以抵消該差異。
通常，特定基板的重疊誤差可能受許多變數的影響。第一基板卡盤可用於印刷層0圖案，第二基板卡盤可用於印刷層1圖案。總的來說，基板12，裝置10和製程可以對在先前基板上的兩個圖案化層之間的重疊誤差造成貢獻。在非限制性的實施例中，該圖案化層可以是場隔離層與閘極層、閘極層與接觸層或層間的另一個組合。在一個實施例中，閘極層可以與場隔離層對準，並且接觸層可以與閘極層或場隔離層對準。可以確定原始重疊誤差資料，並且此後，可以從原始重疊誤差資料中去除對原始重疊誤差資料造成貢獻的已知貢獻者，從而僅保留基板卡盤的平坦度分佈的差異。
當前基板可以具有使用光學或壓印微影形成的該圖案化層之一者，並且圖案化抗蝕劑層將形成在圖案化層之上。在形成抗蝕劑層之前，已形成適應層。適應層具有厚度分佈，該厚度分佈是平坦度分佈的差異的倒數的函數。在適應層上形成抗蝕劑層。
在介紹關於使用從確定不同基板卡盤之間的平坦度分佈的差異所獲得的資訊產生的適應層之製造物品的細節之前，描述了關於用於確定不同基板卡盤之間的平坦度分佈的差異的方法的更多細節。
圖3包括用於獲得可在半導體基板上形成奈米級圖案的期間使用的基板卡盤的平坦度分佈的差異的方法的製造流程。使用關於圖3所描述的方法產生的資訊，可以從兩個不同的層獲得，該兩個不同的層使用兩個不同的基板卡盤壓印在同一基板上。從方塊302開始，該方法可以包括測量先前基板上的圖案化層之間的原始重疊誤差資料。在特定態樣中，原始重疊誤差資料可包括基板的各種印刷區域內的平面內誤差量。原始重疊誤差資料還可以包括對準貢獻、失真貢獻、場平均特性貢獻、平坦度引起的失真貢獻、對原始重疊誤差的其他貢獻或其組合。
圖4描繪了繪圖500的例示，繪圖500表示在先前基板上的兩個不同圖案化層之間的原始重疊誤差資料。圖4中所例示出的繪圖500包括縱坐標502和橫坐標504以及相對於縱坐標502和橫坐標504所繪製的個別場506。繪圖500中的每個場506表示先前基板上的場並且包括基板的個別場內的平面內誤差量。圖4包括四個場。基板可以具有更多個場，例如接近或超過100個場。在閱讀本說明書之後，技術人員可以將本文之教示用於一整個基板。在一個特定的態樣中，每個場內的平面內誤差量可以被繪製為在重疊計量標記510處測量的誤差。重疊計量標記的一個非限制性範例可以包括KLA阿切標記。
回到圖3，在方塊322處，該方法可包括從原始重疊誤差中移除對應於第一和第二圖案化層之間的未對準的對準貢獻。針對重疊誤差資料的對準貢獻可以基於兩 個圖案化層(例如，第一圖案化層和第二圖案化層((即，層0和層1))之間的對準失真資料。在一個特定實施例中，第二圖案化層將與第一圖案化層對準。此外，在方塊324處，該方法可以包括從原始重疊誤差中去除失真貢獻。失真很大程度上是由於製程的物理本質。圖5包括圖4中所介紹的繪圖500的例式，但去除了對準和失真貢獻。
返回到方法的描述，在方塊326處，該方法可以包括從原始重疊誤差資料中移除平均場特性。在一個特定的態樣中，該方法的該操作可以是選擇性的。場平均特性對應於在所有場上平均的重複誤差。圖6包括場平均特性繪圖700的例式。場平均特性繪圖700包括縱坐標702和橫坐標704。場平均特性繪圖700包括多個重疊計量標記706，其表示在基板的所有的場中重複的誤差。
圖7包括圖4中所介紹並在圖5中更新的繪圖500的另一個例式，但除了先前移除的對準和失真貢獻(如圖5中所示)之外，從繪圖500的每個壓印場506中移除了場平均特性。
在圖3的方塊328處，該方法可以包括從原始重疊誤差資料中估計由於晶圓卡盤中的平坦度分佈的差異引起的失真。圖8是在圖4中介紹的並且在圖5及圖7中更新的繪圖500的另一個例式，其示出了由於晶圓卡盤之間的平坦度分佈的差異而引起的估計的失真。因此，圖8包括與基板卡盤之間的平坦度分佈的差異相對應的資訊。
在圖3的方塊342處，該方法可以包括至少部 分地基於基板卡盤之間的平坦度分佈的差異來產生對應於適應層的資訊。圖9包括具有各種示例性表面圖案的十六個示例性平面內誤差繪圖1002、1004、1006、1008、1012、1014、1016、1018、1022、1024、1026、1028、1032、1034、1036和1038。這16個示例性重疊計量標記繪圖1002、1004、1006、1008、1012、1014、1016、1018、1022、1024、1026、1028、1032、1034、1036和1038是預先確定的並且用於模型化潛在的表面的表面形貌，其可以存在於特定的基板卡盤上。
圖10包括對應於在圖9中的示例性失真繪圖1002、1004、1006、1008、1012、1014、1016、1018、1022、1024、1026、1028、1032、1034、1036和1038的圖案的十六個三維(3-D)模型1102、1104、1106、1108、1112、1114、1116、1118、1122、1124、1126、1128、1132、1134、1136和1138。圖10所示例的3-D模型1102、1104、1106、1108、1112、1114、1116、1118、1122、1124、1126、1128、1132、1134、1136和1138中，可以用數學函數描述或以其他方式模型化不同基板卡盤的表面的平坦度分佈的差異。連接平面內失真和板彎曲形狀的基本板方程式如下所示：
Figure 108107450-A0305-02-0019-1
 其中，△x=由於板彎曲引起的X方向的失真
△y=由於板彎曲引起的Y方向的失真
z=z(x，y)由於彎曲導致的板形狀的改變
t=板的有效厚度
上面的方程式是針對具有小變形的薄板而導出的，該小變形良好地適合於這種情況。
可以根據平面內失真資料對基板卡盤的平坦度的估計差異進行如上所述的模型化。藉由對卡盤平坦度及其相反進行模型化，微影裝置，例如上面結合圖1所描述的裝置10，可以使用該資料來產生用於基板的適應層。
以上資訊是從先前基板所獲得的。該資訊可用於處理當前基板，包括形成適應層以解決基板卡盤之間的平坦度分佈的差異。在一個實施例中，當前基板將用相同的基板卡盤處理。可以使用用於先前基板或不同層的相同層。例如，先前基板在基板卡盤0上的層0處理並在基板卡盤1上的層1處理。因此，當前基板在基板卡盤0上的層0處理並在基板卡盤1上的層1處理。在另一個實施例中，當前基板在基板卡盤0上的層1處理並且在基板卡盤1上的層2處理。層1可以與層0對準，並且層2可以與層1對準。
現在參考圖11，在方塊1302處，該方法可以包括在當前基板上方形成圖案化層。可以在形成適應層之前形成圖案化層。參考上面的範例，當前基板的圖案化層可以為經使用基板卡盤0進行處理的層0。在方塊1322，該方法可以包括在圖案化層上形成適應層。如本文所述，適應層的厚度可以是基板卡盤的平坦度差異的倒數的函數。 回到該範例，適應層將具有厚度分佈，該厚度分佈是基板卡盤0和1之間的平坦度分佈差異的倒數的函數。
此時，可以繼續處理以在適應層和當前基板上形成層1，其中將使用基板卡盤1執行壓印。在方塊1342處，該方法可以包括在適應層上形成可成型層。此後，在方塊1344處，該方法可包括使可成型材料與壓印模板接觸。適應層補償基板卡盤0和1的平坦度分佈的差異，並減小它們對重疊誤差的相應的貢獻。最後，在方塊1346處，該方法可以包括固化可成型材料以形成圖案化抗蝕劑層。在該範例中，圖案化抗蝕劑層為層1。
圖12包括在壓印操作期間裝置1600上的一部分的橫截面圖。如圖所示例的，基板1602係由裝置1600的基板卡盤1604所支撐。基板1602包括圖案化層，儘管於圖12中未單獨地示例出該層。在這個範例中，基板1602上的圖案化層是層0。可以在基板1602的圖案化層上形成或以其他方式設置適應層1606。之後，在適應層1606上形成可成型材料。光罩1610用於壓印可固化的可成型材料以形成抗蝕劑層1608。以這種方式，光罩在適應層1606頂上形成層1。用於形成層1的基板卡盤1604在位置1612處具有局部平坦度誤差，引起層0的局部平面內失真，這導致層0和1之間的重疊誤差。適應層1606的形狀(其為卡盤平坦度分佈的反函數)衰減了重疊誤差。
如本文所述的實施例可用於減少不同基板卡盤之間的平坦度分佈差異對重疊誤差的影響。適應層可以 幫助抵消由於平坦度分佈的差異而產生的影響。因此，可以形成圖案化抗蝕劑層並且以較小的重疊誤差將其與先前形成的圖案化層對準。
注意，以上在一般描述或範例中所描述的所有活動並非絕對需要(特定活動的一部分可能不需要)，並且除了所描述的那些活動之外還可以執行一個或多個其他的活動。此外，列出活動的順序不一定是它們的執行順序。上面已經針對特定實施例描述了益處、其他優點和問題的解決方案。然而，益處、優點、問題的解決方案以及可能導致任何利益、優勢或解決方案發生或變得更加顯著的任何特徵不應被解釋為任何的或所有的申請專利範圍的關鍵、必需或不可或缺的特徵。
本文所描述的說明書和實施例的例示旨在提供對各種實施例的結構的一般理解。說明書和例示不意旨在用作對使用本文所描述的結構或方法的裝置和系統的所有元件和特徵的詳盡和全面的描述。也可以在單個實施例中結合地提供單獨的實施例，並且相反地，為了簡潔起見，在單個實施例的上下文中所描述的各種特徵也可以單獨地提供或以任何子組合提供。此外，對於範圍所提及的數值的引用包括該範圍內的每個及所有的值。只有在閱讀本說明書之後，許多其他實施例對於技術人員才是顯而易見的。可以使用其他實施例並從本發明之揭露中推導出其他實施例，使得可以在不脫離本發明的揭露的範圍的情況下進行結構替換、邏輯替換或其他改變。因此，本發明之 揭露應被視為說明性的而非限制性的。
1600:裝置
1602:基板
1604:基板卡盤
1606:適應層
1608:抗蝕劑層
1610:光罩

Claims (15)

  1. 一種供使用於形成適應層的裝置，該裝置包括：邏輯元件，其中該邏輯元件：獲得第一基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用第一基板卡盤來圖案化，並且該第二圖案化層係使用第二基板卡盤來圖案化；確定與該第一基板卡盤和該第二基板卡盤相關的平坦度分佈的差異，其中該平坦度分佈的差異是至少部分地基於該第一圖案化層和該第二圖案化層之間的該原始重疊誤差；回應於與該第一基板卡盤和該第二基板卡盤相關聯的該平坦度分佈的差異來產生與要在第二基板上形成的該適應層相對應的資訊；以及移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板的該平坦度分佈的差異相關聯的壓印失真的壓印失真貢獻。
  2. 如申請專利範圍第1項之裝置，其中該邏輯元件更被配置為移除對應於該第一和第二圖案化層之間的未對準的對準貢獻。
  3. 如申請專利範圍第1項之裝置，其中該邏輯元件還被配置為移除與該第一和第二基板卡盤相關聯的平坦度引起的失真貢獻。
  4. 如申請專利範圍第1項之裝置，其中對應於該適應層的該資訊包括與該適應層相關聯的流體液滴圖案。
  5. 一種供使用於形成適應層的裝置，該裝置包括：邏輯元件，其中該邏輯元件：獲得第一基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用第一基板卡盤來圖案化，並且該第二圖案化層係使用第二基板卡盤來圖案化；移除平均場特性，其中該平均場特性對應於在所有場上平均的重複誤差；確定與該第一基板卡盤和該第二基板卡盤相關的平坦度分佈的差異，其中該平坦度分佈的差異是至少部分地基於該第一圖案化層和該第二圖案化層之間的該原始重疊誤差；以及回應於與該第一基板卡盤和該第二基板卡盤相關聯的該平坦度分佈的差異來產生與要在第二基板上形成的該適應層相對應的資訊。
  6. 一種供使用於形成適應層的裝置，該裝置包括邏輯元 件，該邏輯元件被配置為：獲得第一基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用第一基板卡盤來圖案化，並且該第二圖案化層係使用第二基板卡盤來圖案化；至少部分地基於與該第一基板卡盤和該第二基板卡盤相關聯的平坦度分佈的差異來產生與要在第二基板上形成的該適應層相對應的資訊；移除對應於該第一和第二圖案化層之間的未對準的對準貢獻；移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板的該平坦度分佈的差異相關聯的壓印失真的壓印失真貢獻；以及移除與該第二基板卡盤相關聯的平坦度引起的失真貢獻。
  7. 如申請專利範圍第6項之裝置，其中該邏輯元件更被配置為：移除平均場特性，其中該平均場特性對應於在所有場上平均的重複誤差。
  8. 一種形成適應層的方法，該方法包括：確定與第一基板卡盤和第二基板卡盤相關的平坦度分 佈的差異；以及在第一基板上形成該適應層，其中該適應層具有厚度分佈，該厚度分佈為該平坦度分佈的差異的倒數的函數，並且其中，確定該平坦度分佈的差異包括：測量第二基板上的第一圖案化層和第二圖案化層之間的原始重疊誤差，其中該第一圖案化層係使用該第一基板卡盤來圖案化，並且該第二圖案化層係使用該第二基板卡盤來圖案化；移除對應於該第一和第二圖案化層之間的未對準的對準貢獻；移除對應於與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的壓印失真的壓印失真貢獻；估計由於該第一和第二基板卡盤的平坦度分佈的差異引起的失真。
  9. 如申請專利範圍第8項之方法，其中確定該平坦度分佈的差異還包括移除平均場特性，其中該平均場特性對應於在所有場上平均的重複誤差。
  10. 如申請專利範圍第9項之方法，其中確定該平坦度分佈的差異還包括確定與用於形成該第一圖案化層的第一壓印模板、用於形成該第二圖案化層的第二壓印模板或該第一和第二壓印模板相關聯的平均場特性。
  11. 如申請專利範圍第8項之方法，其中確定該平坦度分佈的差異還包括移除與該第一和第二基板卡盤相關聯的平坦度引起的失真貢獻。
  12. 如申請專利範圍第11項之方法，其中該估計的失真對應於該平坦度引起的失真貢獻。
  13. 如申請專利範圍第12項之方法，其中確定該平坦度分佈的差異還包括移除平均場特性，其中該平均場特性對應於在所有場上平均的重複誤差。
  14. 如申請專利範圍第8項之方法，更包括：在該適應層和該第一基板上形成可成型材料；使該可成型材料與壓印模板接觸；以及固化該可成型層以形成圖案化抗蝕劑層。
  15. 一種在第一基板上形成層的方法，該方法包括：確定與第一基板卡盤和第二基板卡盤相關的平坦度分佈的差異；由該第一基板卡盤在該第一基板上形成第一圖案化層；在該第一圖案化層上形成適應層，其中該適應層具有厚度分佈，該厚度分佈係基於該平坦度分佈的差異；以及 由該第二基板卡盤在該第一基板上形成第二圖案化層，其中該第二圖案化層係在該第一圖案化層及該適應層之上；以及其中該適應層減少該第一圖案化層和該第二圖案化層之間的重疊誤差。
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Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11567401B2 (en) 2019-12-20 2023-01-31 Canon Kabushiki Kaisha Nanofabrication method with correction of distortion within an imprint system
US11262652B2 (en) * 2020-06-25 2022-03-01 Canon Kabushiki Kaisha Nanofabrication method with correction of distortion within an imprint system
JP7507802B2 (ja) 2022-01-20 2024-06-28 キヤノン株式会社 シミュレーション方法、シミュレーション装置、膜形成装置、物品の製造方法、およびプログラム

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8394282B2 (en) * 2008-06-09 2013-03-12 Board Of Regents, The University Of Texas System Adaptive nanotopography sculpting
US8850980B2 (en) * 2006-04-03 2014-10-07 Canon Nanotechnologies, Inc. Tessellated patterns in imprint lithography
US8956789B2 (en) * 2013-03-15 2015-02-17 GlobalFoundries, Inc. Methods for fabricating integrated circuits including multi-patterning of masks for extreme ultraviolet lithography
TW201635159A (zh) * 2015-02-25 2016-10-01 高通公司 通用串列匯流排的協定適應層資料流控制

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3251362B2 (ja) * 1993-01-11 2002-01-28 三菱電機株式会社 露光装置及び露光方法
US6890795B1 (en) * 2003-12-30 2005-05-10 Agency For Science, Technology And Research Wafer level super stretch solder
US8175831B2 (en) * 2007-04-23 2012-05-08 Kla-Tencor Corp. Methods and systems for creating or performing a dynamic sampling scheme for a process during which measurements are performed on wafers
SG10201608512QA (en) * 2012-04-19 2016-12-29 Intevac Inc Dual-mask arrangement for solar cell fabrication
KR102292465B1 (ko) 2013-08-19 2021-08-20 보드 오브 레젼츠, 더 유니버시티 오브 텍사스 시스템 나노미터 스케일 정확도를 갖는 사용자 정의 프로파일의 프로그램 가능한 박막 적층 방법
US10509329B2 (en) * 2014-09-03 2019-12-17 Kla-Tencor Corporation Breakdown analysis of geometry induced overlay and utilization of breakdown analysis for improved overlay control
WO2017140532A1 (en) * 2016-02-18 2017-08-24 Asml Netherlands B.V. Lithographic apparatus, device manufacturing method and associated data processing apparatus and computer program product
US9993962B2 (en) * 2016-05-23 2018-06-12 Canon Kabushiki Kaisha Method of imprinting to correct for a distortion within an imprint system

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8850980B2 (en) * 2006-04-03 2014-10-07 Canon Nanotechnologies, Inc. Tessellated patterns in imprint lithography
US8394282B2 (en) * 2008-06-09 2013-03-12 Board Of Regents, The University Of Texas System Adaptive nanotopography sculpting
US8956789B2 (en) * 2013-03-15 2015-02-17 GlobalFoundries, Inc. Methods for fabricating integrated circuits including multi-patterning of masks for extreme ultraviolet lithography
TW201635159A (zh) * 2015-02-25 2016-10-01 高通公司 通用串列匯流排的協定適應層資料流控制

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