TWI550586B - 顯示裝置 - Google Patents

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TWI550586B
TWI550586B TW103110164A TW103110164A TWI550586B TW I550586 B TWI550586 B TW I550586B TW 103110164 A TW103110164 A TW 103110164A TW 103110164 A TW103110164 A TW 103110164A TW I550586 B TWI550586 B TW I550586B
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宮武正樹
齋藤玲彥
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日本顯示器股份有限公司
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Description

顯示裝置 [相關申請之對照參考]
本申請案係基於且主張2013年3月22日申請之先前之日本專利申請案第2013-060816號之優先權的權益，該申請案之全文以引用之方式併入本文中。
此處所說明之實施例大體上係關於一種顯示裝置。
以液晶顯示裝置為代表之顯示裝置由於薄型、輕量且低耗電，而被用作各種機器之顯示器。其中，主動矩陣型顯示裝置作為筆記型電腦或個人數位助理之顯示器正不斷普及。
且說，於液晶顯示裝置中，若沿同一方向對液晶持續施加電壓，則會產生顯示不良，故而採用以一定週期切換液晶層之電壓施加極性的極性反轉驅動。於進行極性反轉驅動之情形時，必須使電源線之電壓之極性週期性地變化，因此預先準備有複數個基準電源。
然而，於電源接通時，不確定電源線連接於哪個基準電源。其結果，存在如下問題：液晶層之施加電壓產生變化，而視認到顯示不良，如視認閃爍等。因此，提出有以於電源接通時未視認到顯示不良之方式完成之顯示裝置。
然而，於所提出之發明中，於電源啟動時對所有像素同時切換電源電壓。因此，於今後將該發明應用於解像度高於FHD(Full High Definition，全-高畫質)等先前之顯示裝置的顯示裝置之情形時，伴隨著電源電壓之切換的瞬時電流會增大，由此施加至驅動電路之負載增大而亦可能導致顯示裝置發生故障。又，亦有如下之虞：因電流增大而導致成為判斷未達到對顯示裝置所要求之規格之事態。
1‧‧‧像素TFT
2‧‧‧像素電極
3‧‧‧對向電極
4‧‧‧掃描線驅動電路
4o‧‧‧掃描線驅動電路
4e‧‧‧掃描線驅動電路
5‧‧‧源極驅動器
7‧‧‧外部驅動電路
13‧‧‧緩衝電路
15‧‧‧記憶電路
20‧‧‧玻璃基板
21‧‧‧信號線電壓控制電路
22‧‧‧NAND電路
23‧‧‧反相器
24‧‧‧反相器
25‧‧‧延遲電路
27‧‧‧電源控制電路
41‧‧‧邏輯電路
101‧‧‧有機EL面板
102‧‧‧控制器
103‧‧‧顯示區域
104a‧‧‧掃描線驅動電路
104b‧‧‧掃描線驅動電路
105‧‧‧源極驅動器
106‧‧‧像素電路
111‧‧‧驅動電晶體
112‧‧‧像素開關
113‧‧‧輸出開關
114‧‧‧保持電容
115‧‧‧有機EL元件
116‧‧‧重設開關
121‧‧‧信號線電壓控制電路
ASW1~3‧‧‧信號
BG‧‧‧控制信號
C1‧‧‧輔助電容
C2‧‧‧液晶電容
CKV‧‧‧時脈信號
CS1~CSn‧‧‧輔助電容電源線
FDON‧‧‧控制信號
G1~Gn‧‧‧掃描線
Ga‧‧‧第1掃描線
Gate1~4‧‧‧閘極信號
Gb‧‧‧第2掃描線
Gc‧‧‧第3掃描線
IN1‧‧‧輸入端子
IN2‧‧‧輸入端子
OUT1‧‧‧輸出端子
PX‧‧‧像素
RG‧‧‧控制信號
RST(1~n)‧‧‧重設電源線
S1~Sm‧‧‧信號線
SG‧‧‧控制信號
Sig(1~m)‧‧‧影像信號配線
SR1~4‧‧‧輸出信號
STV‧‧‧起始信號
T0‧‧‧時點
T1‧‧‧時點
T2‧‧‧時點
T3‧‧‧時點
T4‧‧‧時點
UD‧‧‧信號
Vcom‧‧‧對向電壓
Vdd‧‧‧高電位電源線
VGH‧‧‧高電壓
VGL‧‧‧低電壓
VINI‧‧‧初始化電壓
VRST‧‧‧重設電壓
Vsig‧‧‧像素電壓
Vss‧‧‧低電位電源線
現參照圖式對實施本發明之各種特徵之整體結構進行說明。所提供之圖式及相關描述用以說明本發明之實施例而並不限制本發明之範疇。
圖1係表示在第1實施形態之顯示裝置之前研究之顯示裝置之構成的一例示性方塊圖。
圖2係用以說明與在第1實施形態之顯示裝置之前研究之顯示裝置之控制信號相關之動作的一例示性圖。
圖3係在第1實施形態之顯示裝置之前研究之顯示裝置之電源接通時的一例示性時序圖。
圖4係用以說明在第1實施形態之顯示裝置之前研究之顯示裝置之電源接通時之問題的一例示性時序圖。
圖5A係用以說明第1實施形態之顯示裝置之掃描線驅動電路之一例示性圖。
圖5B係用以說明第1實施形態之顯示裝置之掃描線驅動電路之一例示性圖。
圖6係用以說明第1實施形態之顯示裝置之掃描線驅動電路之動作的一例示性時序圖。
圖7係用以說明第1實施形態之顯示裝置之電源接通時之動作的一例示性時序圖。
圖8係用以說明與第2實施形態之顯示裝置之控制信號相關之動 作的一例示性圖。
圖9係表示第3實施形態之顯示裝置之構成之一例示性方塊圖。
圖10係表示第3實施形態之顯示裝置之顯示像素之等效電路的一例示性圖。
以下，參照隨附圖式對各種實施例進行說明。
一般而言，根據一實施例，顯示裝置包括：信號線及掃描線，其等排列設置於絕緣基板上之第1及第2方向；像素開關元件，其形成於信號線及掃描線之各交點附近；信號線驅動電路，其驅動信號線；掃描線驅動電路，其驅動掃描線；以及顯示像素及輔助電容，其等包含連接於上述像素開關元件之像素電極、及與該像素電極對向之對向電極；且上述信號線驅動電路於自上述絕緣基板之外部供給之控制信號為第1邏輯位準時對所有信號線賦予與上述對向電極相同之電壓，上述掃描線驅動電路於上述控制信號為上述第1邏輯位準時使所有上述像素開關元件導通，於上述控制信號為第2邏輯位準時以時間差而將上述像素開關元件設為非導通。
[第1實施形態]
圖1係表示在第1實施形態之顯示裝置之前研究之顯示裝置之構成的方塊圖。此處，以主動矩陣型之液晶顯示裝置為例進行說明。
圖1之液晶顯示裝置包括沿著玻璃基板上之第1方向延伸之信號線S1~Sm、及沿著第2方向延伸之掃描線G1~Gn。於信號線及掃描線之各交點附近形成有像素TFT1(Thin Film Transistor，薄膜電晶體)。像素TFT1之汲極端子與輔助電容C1及像素電極2連接。像素電極2於與隔著液晶層而對向配置之對向電極3之間形成液晶電容C2。
掃描線驅動電路4驅動掃描線G1~Gn。源極驅動器5驅動信號線S1~Sm。於在掃描線方向(第2方向)上並列之輔助電容C1之一端共通 地連接輔助電容電源線CS1~CSn。輔助電容電源線CS1~CSn係與第1方向之像素數相應地設置，且被賦予與對向電極相同之電壓。
外部驅動電路7係設置於玻璃基板20之外側，或安裝於玻璃基板20上。玻璃基板20與外部驅動電路7藉由FPC(Flexible Print Circuit，可撓性印製電路)等而連接。源極驅動器5係安裝於玻璃基板20上。外部驅動電路7於與源極驅動器5之間收發像素資料、控制信號等。
又，於玻璃基板20上設置有掃描線驅動電路4與信號線電壓控制電路(FDON電路)21。而且，自外部驅動電路7對掃描線驅動電路4與信號線電壓控制電路21供給控制信號FDON。藉由該控制信號FDON進行抑制電源接通時之顯示不良(顯示斑紋)之控制。再者，自外部驅動電路7對掃描線驅動電路4供給高電壓VGH與低電壓VGL。
圖2係用以說明與在第1實施形態之顯示裝置之前研究之顯示裝置之控制信號FDON相關之動作的圖。再者，為了方便說明，而簡化為僅記載所需之信號，掃描線驅動電路4係僅記載一部分電路。又，信號線電壓控制電路21係記載於上段。
於掃描線驅動電路4內，設置有構成移位暫存器之邏輯電路41與緩衝電路13作為產生掃描信號之產生電路。如圖所示，於每一條掃描線設置有NAND(Not-AND，與非)電路22、及串聯連接於NAND電路22之輸出端子之2段反相器23、24。NAND電路22對作為自邏輯電路41之輸出信號之掃描線驅動用時序信號與控制信號FDON之反轉邏輯積進行運算。
於控制信號FDON為低位準(第1邏輯位準)之情形時，NAND電路22之輸出變為高位準，掃描線亦變為高位準。因此，連接於該掃描線之所有像素TFT1導通。另一方面，控制信號FDON被供給至掃描線驅動電路4內之所有NAND電路22。因此，於控制信號FDON為低位準之情形時，顯示區域內之所有像素TFT1導通。
信號線電壓控制電路21包含分別連接於各條信號線之複數個PMOS(P-channel metal oxide semiconductor，P通道型金氧半導體)電晶體。對該等PMOS電晶體之閘極供給控制信號FDON。又，對該等PMOS電晶體之汲極施加有與對向電極相同之電壓(以下稱為Vcom)。
若控制信號FDON變為低位準，則信號線電壓控制電路21內之所有PMOS電晶體導通，對所有信號線供給Vcom。因此，對像素電極2與對向電極3均賦予Vcom。因此，液晶電容C2之兩端電壓成為大致相同，而視認不到顯示斑紋。
圖3係在第1實施形態之顯示裝置之前研究之顯示裝置之電源接通時之時序圖。
圖3所示之信號如下所述。Vsig表示自源極驅動器5供給之像素電壓。ASW1~3係選擇構成1像素之各個紅(R)、綠(G)、藍(B)之子像素之信號。自源極驅動器5對與所選擇之子像素對應之信號線供給Vsig。STV係對於掃描線驅動電路4之起始信號。CKV係用以驅動移位暫存器之時脈信號。UD係指定於顯示裝置顯示影像之方向(上→下、下→上)之信號。FDON係用以抑制電源啟動時之顯示斑紋之控制信號。高電壓VGH、低電壓VGL及對向電壓Vcom係於顯示裝置之電源控制電路27中產生且供給至各部之電源電壓。
繼而，一面參照圖3一面對電源接通時之顯示斑紋抑制動作進行說明。
於接通電源之時點T1以前，各個信號之狀態不穩定。若於時點T1接通電源，則信號ASW1~3、STV、CKV、UD、FDON分別被設定為低位準。又，電源電壓VGH及VGL分別變為特定之電壓。另一方面，Vcom變為不穩定之狀態。該狀態於3圖框期間維持。此處，3圖框係用以暖機(warming-up)之期間，可針對每台顯示裝置設定適當之圖框數。
於時點T2，輸入信號STV、CKV、UD。雖於圖3中未記載詳細之信號，但信號STV、CKV為與通常之顯示動作時之信號相同之信號。然而，於該期間，未對Vsig賦予信號，且ASW1~3亦未進行動作。因此，僅掃描線驅動電路4執行動作。藉此，執行清除掃描線驅動電路內之殘留電荷之重設動作。
於時點T3，開始Vcom之升壓。於該狀態下，控制信號FDON為低位準。因此，信號線電壓控制電路21內之所有PMOS電晶體導通，對信號線供給Vcom。再者，於控制信號FDON為低位準時，如上所述，NAND電路22之輸出變為高位準，掃描線亦變為高位準。因此，像素TFT1導通，對像素電極2與對向電極3均賦予Vcom。因此，例如，於常黑(normally black)之液晶模式下，於整個畫面顯示黑位準，故而顯示斑紋被消除。
於時點T4，解除FDON。即，將控制信號FDON設為高位準(第2邏輯位準)，故而信號線電壓控制電路21內之所有PMOS電晶體斷開，而不再對信號線供給Vcom。另一方面，於時點T4，對Vsig賦予影像信號，ASW1~3開始動作。因此，對信號線S供給Vsig而開始本顯示動作。
圖4係用以說明在第1實施形態之顯示裝置之前研究之顯示裝置之電源接通時之問題的時序圖。
圖4所示之信號如下所述。Gate1~4係用以驅動輸出至掃描線G1~G4之像素TFT1之閘極信號。VGH電流、VGL電流係分別藉由供給高電壓VGH、低電壓VGL之電源控制電路27而測定之電流。再者，該等以外之信號由於已進行說明，故省略重複之說明。
繼而，一面參照圖4一面對電源接通時之問題進行說明。
於控制信號FDON為低位準期間，如上所述般對閘極信號Gate1~4輸出使所有像素TFT1導通之高位準之信號(VGH電壓)。若控制信 號FDON變為高位準，則閘極信號Gate1~4之位準自高位準(VGH電壓)切換為低位準(VGL電壓)。其後，閘極信號Gate1~4依序成為被驅動之掃描脈衝信號而執行顯示動作。
且說，於圖4中記載有4個閘極信號，但例如於FHD(全-高畫質)之顯示裝置中設置有1920條閘極線。因此，於解除FDON時，1920個信號同時自使用VGH電壓切換為使用VGL電壓。其結果，流通瞬時較大之VGL電流。
如此，由於每當電源啟動時流通較大之瞬時電流，故而顯示裝置之電路元件之負載增大。因此，此種狀態繼續重複會促進電路元件之劣化，且亦可能導致故障發生。
繼而，對解決上述問題之方法進行說明。
圖5A、圖5B係用以說明第1實施形態之顯示裝置之掃描線驅動電路之圖。圖5A表示上述研究所使用之掃描線驅動電路之概略構成，圖5B表示第1實施形態之顯示裝置之掃描線驅動電路之概略構成。
如圖5B所示，於緩衝電路13新設置有記憶電路15。而且，構成移位暫存器之邏輯電路41之輸出信號被供給至向記憶電路15輸入之輸入端子IN1，控制信號FDON被供給至記憶電路15之輸入端子IN2。而且，記憶電路15之輸出端子OUT1連接於NAND電路22之一輸入端子。對NAND電路22之另一輸入端子輸入邏輯電路41之輸出信號。此後之電路之構成與上述緩衝電路13之構成相同。
此處，記憶電路15包含順序電路，即便於控制信號FDON自低位準變為高位準之情形時，在自邏輯電路41輸出作為移位暫存器輸出之脈衝信號之前輸出端子OUT1之位準亦不產生變化。
圖6係用以說明第1實施形態之顯示裝置之掃描線驅動電路之動作的時序圖。於該時序圖中，對控制信號FDON、邏輯電路41之輸出信號SR、輸出至掃描線之閘極信號Gate進行記載。
於時點T0，控制信號FDON自低位準變為高位準。然而，藉由上述記憶電路15，使閘極信號Gate維持高位準。而且，若輸出信號SR1、...、4被輸出，則於各者之時點閘極信號Gate1、...、4分別變為低位準。於閘極信號Gate變為低位準以後，輸入至掃描線之閘極信號依序成為用以驅動之掃描脈衝信號而執行顯示動作。
圖7係用以說明第1實施形態之顯示裝置之電源接通時之動作的時序圖。
於控制信號FDON變為低位準時，閘極信號Gate1、...、4同時變為高位準。其次，雖然控制信號FDON變為高位準，但如上所述般藉由記憶電路15之作用使閘極信號Gate1、...、4維持高位準。繼而，於自構成移位暫存器之邏輯電路41輸出有輸出信號(未圖示)之時點，閘極信號Gate1、...、4依序變為低位準。
如此，即便解除控制信號FDON，閘極信號亦不會同時變為低位準，而於1圖框期間依序變為低位準。因此，可避免流通瞬時較大之VGL電流。
再者，於使閘極信號依序變為低位準之1圖框期間，對信號線S賦予之電壓並無特別規定，但較理想為在不使ASW1~3進行動作之情況下不自源極驅動器5對信號線S供給Vsig。另一方面，亦可使ASW1~3進行動作，且自源極驅動器5對信號線S輸出Vcom作為Vsig信號。
[第2實施形態]
於第2實施形態中，掃描線驅動電路之構成與第1實施形態不同。對與第1實施形態相同之部位標註相同之符號，並省略其詳細說明。
圖8係用以說明與第2實施形態之顯示裝置之控制信號FDON相關之動作之圖。再者，為了方便說明，而簡化為僅記載所需之信號。 又，信號線電壓控制電路21係記載於上段。
於第2實施形態中，掃描線驅動電路包括驅動奇數列之掃描線之掃描線驅動電路4o、及驅動偶數列之掃描線之掃描線驅動電路4e。控制信號FDON被直接供給至掃描線驅動電路4o與信號線電壓控制電路21。又，控制信號FDON係經由延遲電路25而被供給至掃描線驅動電路4e。再者，於第2實施形態中未採用第1實施形態中所說明之記憶電路。
根據該構成，可藉由掃描線驅動電路4o與掃描線驅動電路4e使控制信號FDON自低位準變為高位準之時序不同。而且，於第2實施形態中，由於亦可並非如第1實施形態般設置記憶電路，故而能以簡化之構成抑制瞬時較大之VGL電流流通。
再者，於第2實施形態中，在顯示區域之兩側設置有掃描線驅動電路4o、4e，但並不限定於該形態，亦可於一側設置掃描線驅動電路4o、4e。
又，於第1實施形態中，亦可將掃描線驅動電路4分離為2個掃描線驅動電路4o與掃描線驅動電路4e之2個。
再者，於上述實施形態中，亦可將源極驅動器5與信號線電壓控制電路21構成為一體。
進而，亦可將信號線電壓控制電路21中所使用之電晶體之極性由P型變更為N型。此時，只要以電晶體進行動作之位準(高位準、低位準)與上述實施形態相反之方式構成裝置即可
[第3實施形態]
於第3實施形態中，於將第1及第2實施形態之構成應用於有機EL(Electroluminescence，電致發光)顯示裝置之方面，與第1及第2實施形態不同。對與第1實施形態相同之部位標註相同之符號，並省略其詳細說明。
圖9係概略地表示第3實施形態之顯示裝置之俯視圖。如圖9所示，顯示裝置包括有機EL面板101及控制該有機EL面板101之動作之控制器102。
有機EL面板101包括顯示區域103、掃描線驅動電路104a、掃描線驅動電路104b、及源極驅動器105。
顯示區域103具備於玻璃板等具有透光性之絕緣基板上呈矩陣狀排列之n×m個顯示像素PX。而且，沿著顯示像素PX排列之列配置第1掃描線Ga(1~n)、第2掃描線Gb(1~n)、及重設電源線RST(1~n)，且連接於各顯示像素。又，沿著顯示像素PX排列之行配置m條影像信號配線Sig(1~m)，且連接於每行之各顯示像素。進而，高電位之電源線Vdd與低電位之電源線Vss連接於各顯示像素。再者，於顯示區域103之各列中，交替地並列設置有R(紅)顯示用、G(綠)顯示用、B(藍)顯示用之3個顯示像素PX。
掃描線驅動電路104a以顯示像素PX之列為單位依序驅動第1掃描線Ga(1~n)、第2掃描線Gb(1~n)。掃描線驅動電路104b對重設電源線RST(1~n)輸出重設電壓VRST。源極驅動器105驅動複數條影像信號配線Sig(1~m)。掃描線驅動電路104a、104b、及源極驅動器105係於顯示區域103之外側一體地形成於絕緣基板上，且與控制器102一併構成控制部。
又，於絕緣基板上設置有信號線電壓控制電路(FDON電路)121。 而且，自控制器102對掃描線驅動電路104a與信號線電壓控制電路121供給控制信號FDON。藉由該控制信號FDON，進行抑制電源接通時之顯示不良(顯示斑紋)之控制。於該信號線電壓控制電路(FDON電路)121包含分別連接於各條信號線之複數個NMOS(N-channel metal oxide semiconductor，N型金氧半導體)電晶體。對該等NMOS電晶體之閘極供給控制信號FDON。又，對該等NMOS電晶體之源極供給初 始化電壓VINI。
圖10係表示第3實施形態之顯示裝置之顯示像素之等效電路的圖。作為像素部發揮功能之各顯示像素PX包含作為自發光元件之有機EL元件115、及對該有機EL元件115供給驅動電流之像素電路106。
圖10所示之顯示像素PX之像素電路106係根據包含電壓信號之影像信號控制有機EL元件115之發光之電壓信號方式之像素電路。像素電路106包括驅動電晶體111、像素開關112、輸出開關113、及作為電容器之保持電容114。進而，像素電路106連接於自設置於掃描線驅動電路104b內之重設開關116輸出重設電壓VRST之重設電源線RST。
於第3實施形態之顯示裝置中，驅動電晶體111、像素開關112、及輸出開關113於此處由同一導電型、例如N通道型之TFT(薄膜電晶體)構成。又，分別構成驅動電晶體111及各開關之薄膜電晶體全部以同一步驟、同一層構造形成，例如，為於半導體層中使用有IGZO、a-Si、或多晶矽之頂閘極構造之薄膜電晶體。再者，各開關並不限於N通道型，只要作為開關發揮功能，則亦可設為P通道型。
驅動電晶體111、像素開關112、輸出開關113、重設開關116之各者具有第1端子、第2端子、及控制端子。於以下之記載中，存在將該等第1端子、第2端子、及控制端子分別表現為源極、汲極、閘極之情況。
於顯示像素PX之像素電路106中，例如於綠(G)顯示用之顯示像素PX中，驅動電晶體111、及輸出開關113在高電位之電源線Vdd與低電位之電源線Vss之間與有機EL元件115串聯連接。電源線Vdd係設定為例如10V之電位，電源線Vss係設定為例如-4V之電位。
於輸出開關113中，其第2端子、此處為汲極連接於電源線Vdd，第1端子、此處為源極連接於重設電源線RST及驅動電晶體111之第2端子、此處為汲極，控制端子、此處為閘極連接於第2掃描線Gb。藉 此，輸出開關113由來自第2掃描線Gb之控制信號BG控制接通(導通狀態)、斷開(非導通狀態)，從而控制有機EL元件115之發光時間。
於驅動電晶體111中，其第1端子、此處為汲極連接於輸出開關113之源極及重設電源線RST，其第2端子、此處為源極連接於有機EL元件115之一端子、此處為陽極。有機EL元件115之陰極連接於電源線Vss。驅動電晶體111對有機EL元件115輸出與影像信號對應之電流量之驅動電流。
關於像素開關112，其第2端子、此處為汲極連接於影像信號配線Sig，第1端子、此處為源極連接於驅動電晶體111之閘極。像素開關112之閘極連接於作為信號寫入控制用閘極配線發揮功能之第1掃描線Ga，由自第1掃描線Ga供給之控制信號SG控制接通、斷開。而且，像素開關112響應控制信號SG，而控制像素電路106與影像信號配線Sig之連接、非連接，從而自對應之影像信號配線Sig將影像電壓信號取入至像素電路106。
保持電容114具有對向之2個端子，且連接於驅動電晶體111之閘極與源極之間，保持由影像信號決定之驅動電晶體111之閘極控制電位。
設置於掃描線驅動電路104b之重設開關116於每1列連接於驅動電晶體111之汲極與重設電源線RST之間。重設開關116之閘極連接於作為重設控制用閘極配線發揮功能之第3掃描線Gc。重設開關116根據來自第3掃描線Gc之控制信號RG控制接通(導通狀態)、斷開(非導通狀態)，使驅動電晶體111之源極電位初始化。
另一方面，圖9所示之控制器102係形成於配置在有機EL面板101之外部之印刷電路基板上，控制掃描線驅動電路104a、104b及源極驅動器105。控制器102接收自外部供給之數位影像信號及同步信號，且基於同步信號產生控制垂直掃描時序之垂直掃描控制信號、及控制水 平掃描時序之水平掃描控制信號。
而且，控制器102將該等垂直掃描控制信號及水平掃描控制信號分別供給至掃描線驅動電路104a、104b及源極驅動器105，並且與水平及垂直掃描時序同步地將數位影像信號及初始化信號供給至源極驅動器105。
源極驅動器105將藉由水平掃描控制信號之控制而於各水平掃描期間依序獲得之影像信號轉換為類比形式，且將與影像信號對應之包含紅用影像電壓信號、綠用影像電壓信號、藍用影像電壓信號之複數灰階之灰階電壓信號Vsig並聯地供給至複數條影像信號配線Sig(1~m)。又，源極驅動器105以1水平週期為單位將初始化電壓信號並聯地供給至複數條影像信號配線Sig(1~m)。
掃描線驅動電路104a包含移位暫存器、輸出緩衝器等，將自外部供給之垂直掃描起始脈衝依序傳輸至下段，如圖9及圖10所示，經由輸出緩衝器對各列顯示像素PX供給2種控制信號、即SG(1~n)、BG(1~n)。藉此，第1掃描線Ga(1~n)、第2掃描線Gb(1~n)分別藉由控制信號SG(1~n)、BG(1~n)而被驅動。
掃描線驅動電路104b包含重設開關116、移位暫存器、輸出緩衝器等，藉由將自外部供給之垂直掃描起始脈衝依序傳輸至下段所產生之控制信號RG(1~n)控制重設開關116，通過重設電源線RST(1~n)將重設電壓VRST供給至各列顯示像素PX。
其次，對如上所示般構成之顯示裝置之電源接通時之動作進行說明。
於電源接通時，自掃描線驅動電路104a輸出將輸出開關113設為斷開狀態之位準(斷開電位)、此處為低位準之控制信號BG、以及將像素開關112設為接通狀態之位準(接通電位)、此處為高位準之控制信號SG。又，於掃描線驅動電路104b之內部，控制信號RG成為將重設 開關116設為接通狀態之位準，此處成為高位準。
藉此，輸出開關113斷開(非導通狀態)，像素開關112、重設開關116接通(導通狀態)，自重設電源線RST對驅動電晶體111供給重設電壓VRST，而開始重設動作。即，將驅動電晶體111之源極、汲極之電位重設為與重設電壓VRST對應之電位、例如-3V，使電源接通前之電位狀態初始化。
又，於電源接通時，若FDON信號變為高位準，則信號線電壓控制電路21內之所有NMOS電晶體導通，對所有信號線供給初始化電壓信號VINI。經由影像信號配線Sig(1~m)輸出之初始化電壓信號VINI係經由像素開關112被施加至驅動電晶體111之閘極。藉此，驅動電晶體111之閘極電位被重設為與初始化電壓信號VINI對應之電位，而自電源接通前之狀態初始化。初始化電壓信號VINI例如被設定為1V。
如上所述，於第3實施形態之顯示裝置中，亦可與第1及第2實施形態之顯示裝置同樣地將顯示裝置設定為初始狀態，故而可藉由具備與第1及第2實施形態之顯示裝置相同之構成(圖5~圖8)而抑制伴隨著電源電壓之切換之瞬時電流之增大。再者，第3實施形態之顯示裝置中之抑制伴隨著電源電壓之切換之瞬時電流之增大的態樣由於與第1及第2實施形態之顯示裝置相同，故省略其詳細說明。
如以上所說明般，本案發明並不限定於液晶顯示裝置、有機EL顯示裝置、無機EL顯示裝置等特定之顯示裝置，而可廣泛地普遍應用於顯示裝置。
根據以上所說明之各實施形態，於解像度高於FHD(全-高畫質)等先前之顯示裝置之顯示裝置中亦可抑制伴隨著電源電壓之切換之瞬時電流之增大，因此可避免施加至驅動電路之負載增大而導致顯示裝置發生故障之情況。又，可防止電流增大而導致未達到對顯示裝置所要求之與瞬時電流相關之規格之情況。
雖對特定之實施例進行了說明，但該等實施例僅以例示之方法而揭示，並非用於限制本發明的範圍。事實上，此處說明之新穎之方法及系統能夠以各種其他形式實施；此外，於不脫離本發明之精神之前提下，可對此處所說明之方法及系統之形式進行各種省略、替換及變更。隨附之申請專利範圍及其等效形式意在包含本發明之範圍及精神內之形式與變化。
又，可藉由上述實施形態中所揭示之複數個構成要素之適當組合而形成各種發明。例如，亦可自實施形態所示之所有構成要素中刪除若干個構成要素。進而，亦可適當組合不同實施形態中之構成要素。
FDON‧‧‧控制信號
Gate1~4‧‧‧閘極信號
STV‧‧‧起始信號
VGH‧‧‧高電壓
VGL‧‧‧低電壓

Claims (4)

  1. 一種顯示裝置，其包括：信號線及掃描線，其等排列設置於絕緣基板上之第1及第2方向；像素開關元件，其形成於信號線及掃描線之各交點附近；信號線驅動電路，其驅動信號線；掃描線驅動電路，其驅動掃描線；及顯示像素及輔助電容，其等包含連接於上述像素開關元件之像素電極、及與該像素電極對向之對向電極；且上述信號線驅動電路於自上述絕緣基板之外部供給之控制信號為第1邏輯位準時，對所有信號線賦予與上述對向電極相同之電壓；上述掃描線驅動電路包括：移位暫存器，其使起始信號移位；第1輸出電路，其係由從上述絕緣基板之外部供給之控制信號及上述移位暫存器之輸出信號來產生第1輸出信號；及第2輸出電路，其係由上述第1輸出信號及上述移位暫存器之輸出信號，來對各個上述掃描線輸出控制上述像素開關元件之導通/非導通的掃描信號；且上述掃描線驅動電路於上述控制信號為上述第1邏輯位準時使所有上述像素開關元件導通，於上述控制信號為第2邏輯位準時係於來自上述移位暫存器之移位信號經輸入至上述第1輸出電路時將上述像素開關元件設為非導通。
  2. 如請求項1之顯示裝置，其中上述掃描線驅動電路於上述控制信號為第2邏輯位準時，依序 選擇上述掃描線而將上述像素開關元件設為非導通。
  3. 一種顯示裝置，其包括：信號線及掃描線，其等排列設置於絕緣基板上之第1及第2方向；像素開關元件，其形成於信號線及掃描線之各交點附近；信號線驅動電路，其驅動信號線；掃描線驅動電路，其驅動掃描線；及像素電路，其對應於上述像素開關元件之各者而設置且控制顯示之灰階度；且上述信號線驅動電路於自上述絕緣基板之外部供給之控制信號為第1邏輯位準時，經由上述像素開關元件對所有信號線賦予將上述像素電路初始化之信號；上述掃描線驅動電路包括：移位暫存器，其使起始信號移位；第1輸出電路，其係由從上述絕緣基板之外部供給之控制信號及上述移位暫存器之輸出信號來產生第1輸出信號；及第2輸出電路，其係由上述第1輸出信號及上述移位暫存器之輸出信號，來對各個上述掃描線輸出控制上述像素開關元件之導通/非導通的掃描信號；且上述掃描線驅動電路於上述控制信號為上述第1邏輯位準時使所有上述像素開關元件導通，於上述控制信號為第2邏輯位準時係於來自上述移位暫存器之移位信號經輸入於上述第1輸出電路時將上述像素開關元件設為非導通。
  4. 如請求項3之顯示裝置，其中上述掃描線驅動電路於上述控制信號為第2邏輯位準時，依序選擇上述掃描線而將上述像素開關元件設為非導通。
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