TWI479501B - 記憶體供電電路 - Google Patents

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TWI479501B TW100119784A TW100119784A TWI479501B TW I479501 B TWI479501 B TW I479501B TW 100119784 A TW100119784 A TW 100119784A TW 100119784 A TW100119784 A TW 100119784A TW I479501 B TWI479501 B TW I479501B
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Description

記憶體供電電路
本發明涉及一種記憶體供電電路。
開關電源具有一特性：負載越輕(即負載的工作功率之和在開關電源的最大輸出功率中所佔的比例越小)，電源轉換效率越低；負載越重，電源轉換效率越高，因此為了提高電源轉換效率，設計者一般會選擇最大輸出功率等於或略大於複數負載的工作功率之和的開關電源，使得開關電源在較重的負載下工作。但是當開關電源給記憶體供電時，用戶若不需要太大的記憶體空間，會拔除其中幾個不需要的記憶體，此時未被拔除的記憶體的工作功率之和在開關電源的最大輸出功率中所佔的比例降低了，開關電源的電源轉換效率也降低了。
有鑒於此，有必要提供一種在主板上的某些記憶體被拔掉時，電源轉換效率被提高的記憶體供電電路。
一種記憶體供電電路，用於為插設在一主板上的記憶體供電。所述主板上設置至少兩個選擇性地插入記憶體的第一插槽及一接地點。每個第一插槽內設置第一接地孔。當所述第一插槽內未插入所述記憶體時，所述第一接地孔與所述接地點不連通。當所述第一插槽內插入所述記憶體時，所述第一接地孔與所述接地點導通。所述記憶體供電電路包括邏輯電路及開關電源。所述邏輯電路包括均與一直流電源電連接的第一、第二輸入端及第一訊號端。所述第一、第二輸入端還分別與一對應的第一接地孔電連接。所述開關電源包括第一電源端、第二電源端及與所述第一訊號端電連接的第二訊號端。所述第一、第二電源端給所述至少兩個第一插槽内插設的記憶體供電。當所述至少兩個第一插槽内均插入記憶體時，所述開關電源開啟所述第一、第二電源端，否則，所述開關電源開啟所述第一電源端或所述第二電源端，關閉所述第二電源端或所述第一電源端。
相較於先前技術，本發明的記憶體供電電路，通過所述邏輯電路判斷所述主板的第一插槽內是否插入記憶體，以調整所述開關電源的第一、第二電源端打開或關閉，從而使得當某些記憶體被拔掉時，未被拔除的記憶體的工作功率之和在所述開關電源的最大輸出功率中所佔的比例被提高，電源轉換效率被提高。
下面將結合附圖，對本發明作進一步的詳細說明。
請參閱圖1及圖2，為本發明實施方式提供的一種記憶體供電電路100，用於根據負載量的輕重，給設置在一主板200上的四個記憶體300提供合適的電能。所述主板200上設置有兩個記憶體通道210及一接地點260，每個記憶體通道210均包括一第一插槽211及一第二插槽212。兩個第一插槽211內可選擇性的插入一記憶體300，也就是說，每個第一插槽211內可以插入一記憶體300，也可以不插入一記憶體300。而每個第二插槽212內必須插入一記憶體300。
每個第一插槽211均包括一第一接地孔211a及一第二接地孔211b。所述第一接地孔211a與所述主板200上的接地點260不連通，所述第二接地孔211b與所述主板200上的接地點260電連接。每個記憶體300包括兩個電連接的接地引腳310，用於分別插設在所述第一接地孔211a及所述第二接地孔211b內。當所述記憶體300插入一第一插槽211內時，所述接地引腳310將所述第一接地孔211a與所述第二接地孔211b電連接，使得所述第一接地孔211a與所述主板200上的接地點260電連接。
當然，所述記憶體300及所述記憶體通道210的數量並不局限於本實施方式。所述第二接地孔211b的數量也並不局限於本實施方式。
所述記憶體供電電路100包括一邏輯電路20、兩個上拉電阻30、一開關電源60。
所述邏輯電路20包括一第一輸入端21、一第二輸入端22及一第一訊號端23。所述第一輸入端21與其中一第一插槽211的第一接地孔211a電連接。所述第二輸入端22與另一第一插槽211的第一接地孔211a電連接。所述第一輸入端21還通過一所述上拉電阻30與一直流電源Vcc電連接，所述第二輸入端22還通過一所述上拉電阻30與所述直流電源Vcc電連接。所述第一訊號端23與所述開關電源60電連接。在本實施方式中，所述邏輯電路20為反或閘晶片。
所述開關電源60包括一第一電源端61、一第二電源端62及一第二訊號端63。所述第一電源端61及所述第二電源端62均與所述兩個第一插槽211及所述兩個第二插槽212的電源介面電連接，以給插設在所述主板200上的記憶體300供電。所述第一電源端61與所述第二電源端62能夠輸出的最大功率相等，均等於三個所述記憶體300的工作功率之和。所述第二訊號端63與所述邏輯電路20的第一訊號端23電連接，用於根據所述第一訊號端23的輸出訊號輸出不同功率的電能。具體的，當所述第二訊號端63從所述邏輯電路20的第一訊號端23接收到一低電平訊號“0”時，所述開關電源60打開所述第一電源端61，關閉所述第二電源端62，以使所述第一電源端61能夠輸出電能，所述第二電源端62不能輸出電能。當所述第二訊號端63從所述邏輯電路20的第一訊號端23接收到一高電平訊號“1”時，所述開關電源60同時打開所述第一電源端61及所述第二電源端62，使所述第一電源端61、第二電源端62均輸出電能。
所述記憶體供電電路100的工作過程如下：
(1)當所述兩個第一插槽211內均插入所述記憶體300時，所述兩個第一接地孔211a通過所述記憶體300的兩個接地引腳310與所述第二接地孔211b電連接，由於所述第二接地孔211b與所述主板200上的接地點260電連接，因此所述兩個第一接地孔211a也與所述主板200上的接地點260電連接，進而接地，使得所述第一輸入端21及所述第二輸入端22均為低電平“0”，則所述第一訊號端23輸出一高電平訊號“1”給所述第二訊號端63，所述開關電源60同時打開所述第一電源端61及所述第二電源端62，以給插設在兩個第一插槽211內的兩個記憶體300及插設在兩個第二插槽212內的兩個記憶體300供電。
(2)當所述兩個第一插槽211內均不插入所述記憶體300時，所述兩個第一接地孔211a均懸空，不接地，所述兩個上拉電阻30分別將所述第一輸入端21及所述第二輸入端22均拉成高電平“1”，則所述第一訊號端23輸出一低電平訊號“0”給所述第二訊號端63，所述開關電源60打開所述第一電源端61，關閉所述第二電源端62，僅讓所述第一電源端61輸出電能，以給兩個插設在第二插槽212內的記憶體300供電。
(3)當所述第一輸入端21所對應的第一插槽211內插入所述記憶體300，所述第二輸入端22所對應的第一插槽211內不插所述記憶體300時，則所述第一輸入端21通過對應的第一接地孔211a接地，所述第二輸入端22不接地，則所述第一輸入端21輸入低電平“0”，所述第二輸入端22輸入高電平“1”，則所述第一訊號端23輸出一低電平訊號“0”給所述的第二訊號端63，所述開關電源60打開所述第一電源端61，關閉所述第二電源端62，僅讓所述第一電源端61輸出電能，以給一個插設在第一插槽211內的記憶體300及兩個插設在第二插槽212內的記憶體300供電。
(4)當所述第一輸入端21所對應的第一插槽211內不插所述記憶體300，所述第二輸入端22所對應的第一插槽211內插入所述記憶體300時，與(3)的原理相同，所述第一訊號端23輸出一低電平訊號“0”給所述開關電源60的第二訊號端63，所述開關電源60打開所述第一電源端61，關閉所述第二電源端62，僅讓所述第一電源端61輸出電能，以給一個插設在第一插槽211內的記憶體300及兩個插設在第二插槽212內的記憶體300供電。
當然，在其他實施方式中，在出現上述(2)~(4)的情況時，所述開關電源60也可打開所述第二電源端62，關閉所述第一電源端61。
當然，所述邏輯電路20並不局限於本實施方式的反或閘晶片，在其他實施方式中，比如所述邏輯電路20也可為或閘晶片，此時所述開關電源60的控制方式也需要相應的進行調整，即當所述開關電源60接收到一高電平訊號“1”時，開啟所述第一電源端61，關閉所述第二電源端62；當所述開關電源60接收到一低電平訊號“0”時，同時開啟所述第一電源端61及所述第二電源端62。
相較於先前技術，本發明的記憶體供電電路，通過所述邏輯電路判斷所述主板的第一插槽內是否插入記憶體，以調整所述開關電源的第一、第二電源端打開或關閉，從而使得當某些記憶體被拔掉時，未被拔除的記憶體的工作功率之和在所述開關電源的最大輸出功率中所佔的比例被提高，電源轉換效率被提高。
綜上所述，本發明確已符合發明專利之要件，遂依法提出專利申請。惟，以上所述者僅為本發明之較佳實施方式，自不能以此限制本案之申請專利範圍。舉凡熟悉本案技藝之人士援依本發明之精神所作之等效修飾或變化，皆應涵蓋於以下申請專利範圍內。
100．．．記憶體供電電路
20．．．邏輯電路
21．．．第一輸入端
22．．．第二輸入端
23．．．第一訊號端
30．．．上拉電阻
60．．．開關電源
61．．．第一電源端
62．．．第二電源端
63．．．第二訊號端
Vcc．．．直流電源
200．．．主板
210．．．記憶體通道
211．．．第一插槽
211a．．．第一接地孔
211b．．．第二接地孔
212．．．第二插槽
260．．．接地點
300．．．記憶體
310．．．接地引腳
圖1係本發明較佳實施方式的記憶體供電電路的電路圖。
圖2係一記憶體的示意圖。
100．．．記憶體供電電路
20．．．邏輯電路
21．．．第一輸入端
22．．．第二輸入端
23．．．第一訊號端
30．．．上拉電阻
60．．．開關電源
61．．．第一電源端
62．．．第二電源端
63．．．第二訊號端
Vcc．．．直流電源
200．．．主板
210．．．記憶體通道
211．．．第一插槽
211a．．．第一接地孔
211b．．．第二接地孔
212．．．第二插槽
260．．．接地點

Claims (5)

  1. 一種記憶體供電電路，用於為插設在一主板上的記憶體供電；所述主板上設置至少兩個第一插槽及一接地點；每個第一插槽內設置第一接地孔；當所述第一插槽內未插入所述記憶體時，所述第一接地孔與所述接地點不連通；當所述第一插槽內插入所述記憶體時，所述第一接地孔與所述接地點導通；所述記憶體供電電路包括邏輯電路及開關電源，所述邏輯電路包括均與一直流電源電連接的第一、第二輸入端及第一訊號端；所述第一、第二輸入端還分別與對應的第一接地孔電連接；所述開關電源包括第一電源端、第二電源端及與所述第一訊號端電連接的第二訊號端；所述第一電源端及所述第二電源端給所述至少兩個第一插槽内插設的記憶體供電；當所述至少兩個第一插槽內均插入記憶體時，所述開關電源開啟所述第一、第二電源端，否則，所述開關電源開啟所述第一電源端或所述第二電源端，關閉所述第二電源端或所述第一電源端。
  2. 如申請專利範圍第1項所述的記憶體供電電路，其中，所述邏輯電路為反或閘晶片，當所述第二訊號端接收到一低電平訊號時，所述開關電源開啟所述第一電源端，關閉所述第二電源端；當所述第二訊號端接收到一高電平訊號時，所述開關電源同時開啟所述第一電源端及所述第二電源端。
  3. 如申請專利範圍第1項所述的記憶體供電電路，其中，所述第一輸入端通過一上拉電阻與所述直流電源電連接，所述第二輸入端通過一上拉電阻與所述直流電源電連接。
  4. 如申請專利範圍第1項所述的記憶體供電電路，其中，所述第一插槽內還設置至少一第二接地孔，所述至少一第二接地孔與所述主板上的接地點電連接，所述記憶體包括複數電連接的接地引腳，用於分別插設在所述第一接地孔及所述複數第二接地孔內，使得當所述記憶體插入所述第一插槽內時，所述第一接地孔通過所述記憶體的接地引腳與所述第二接地孔電連接，進而與所述主板上的接地點電連接。
  5. 如申請專利範圍第1項所述的記憶體供電電路，其中，所述主板上還設置至少兩個與所述至少兩個第一插槽相對應的第二插槽，所述至少兩個第二插槽內必須插入記憶體，每個第一插槽及其對應的第二插槽形成一個記憶體通道，所述第一、第二電源端還給插設在所述至少兩個第二插槽內的記憶體供電。
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