TWI421836B - 顯示裝置及其顯示方法以及電流驅動元件的驅動電路 - Google Patents

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Description

顯示裝置及其顯示方法以及電流驅動元件的驅動電路
本發明是有關於有顯示技術領域，且特別是有關於顯示裝置及其顯示方法，以及適用於驅動電流驅動元件之驅動電路。
有機電激發光二極體(Organic Light Emitting Diode,OLED)顯示器之畫素一般係以電晶體搭配儲存電容來儲存電荷，以控制有機電激發光二極體的亮度表現；其中有機電激發光二極體係一種電流驅動元件，其根據流經的電流大小不同而產生不同程度的亮光。請參閱圖1A，其繪示為傳統畫素之結構示意圖。畫素10包括驅動電路12以及有機電激發光二極體16；驅動電路12用以控制有機電激發光二極體16之亮度表現，且為二電晶體一電容(2T1C)架構。具體地，驅動電路12包括電晶體M1、電晶體M2以及電容C1，在此，電晶體M1與M2分別為N型及P型；電晶體M1的汲極電性耦接至資料線DL，電晶體M1的閘極接受控制訊號SCAN之控制以決定是否使資料線DL上的資料訊號傳遞至電晶體M1的源極；電晶體M2的閘極電性耦接至電晶體M1的源極，電晶體M2的源極電性耦接至電源電位OVDD，電晶體M2的汲極電性耦接至有機電激發光二極體16的正極，有機電激發光二極體16的負極電性耦接至另一電源電位OVSS；電容C1的兩端跨接於電晶體M2的閘極與源極之間。
請參閱圖1B，電晶體M2會有遲滯效應，當在後寫入畫素10的資料訊號所形成的電晶體M2之閘-源極電壓VG 相對於在先寫入的資料訊號所形成的電晶體M2之閘-源極電壓VB 為高時，流過畫素10之有機電激發光二極體16的電流(對應電晶體M2的汲-源極電流Ids)將由IB (對應顯示黑畫面時的灰階值例如灰階0)改變為IG1 ，亦即沿著「S」型虛線所表示的電壓-電流特性曲線(I-V curve)變化，而當在後寫入畫素10的資料訊號所形成的電晶體M2之閘-源極電壓VG 相對於在先寫入的資料訊號所形成的電晶體M2之閘-源極電壓VW 為低時，流過畫素10之有機電激發光二極體16的電流將由IW (對應顯示白畫面時的灰階值例如灰階255)改變為IG2 ，亦即沿著「S」型實線所表示的電壓-電流特性曲線(I-V curve)變化；換言之，當在後寫入畫素10的資料訊號相同時，其所產生的電流會因為在後寫入畫素10的資料訊號與在先寫入的資料訊號之相對大小不同而相異，進而顯示不同的灰階。因此，對於上述之傳統畫素，由於電晶體存在遲滯效應，導致當面板從高灰階畫面切換到低灰階畫面時有影像殘留(image retention)的現象產生，進而影響顯示品質。
本發明的目的是提供一種顯示裝置，以抑制先前技術中存在的影像殘留問題，提升顯示品質。
本發明的再一目的是提供一種顯示方法，以抑制先前技術中存在的影像殘留問題，提升顯示品質。
本發明的又一目的是提供一種電流驅動元件的驅動電路，以避免開關元件例如電晶體之遲滯效應。
本發明實施例提出的一種顯示裝置包括多個畫素，每一畫素包括發光二極體以及驅動電路。其中，發光二極體具有第一端與第二端，發光二極體的第一端電性耦接至第一預設電位；驅動電路包括第一開關、第二開關以及電容。第一開關的第一通路端接收資料訊號，第一開關的控制端接收掃描訊號以決定是否允許資料訊號從第一開關的第一通路端傳遞至第一開關的第二通路端；第二開關的第一通路端電性耦接至發光二極體的第二端，第二開關的第二通路端電性耦接至第二預設電位，且第二開關的控制端電性耦接至第一開關的第二通路端以接收資料訊號；電容電性耦接於週期性變化的重置訊號與第二開關的控制端之間。再者，第二開關的控制端之電位於第一開關處於截止期間被重置訊號重置。
在本發明的一實施例中，上述之多個畫素係於頻率週期內依序被掃描訊號致能而分別寫入資料訊號，且於每相鄰兩個畫素中，在後被致能的畫素的第二開關的控制端之電位於在先被致能的畫素寫入資料訊號之期間被重置。進一步地，上述之頻率週期包括資料寫入時間段與遮沒(blanking)時間段，每一畫素係於資料寫入時間段內被掃描訊號致能，且每一畫素的第二開關的控制端之電位於遮沒時間段內被重置。
在本發明的一實施例中，上述之每相鄰兩個畫素中之在後被致能的畫素的第二開關的控制端之電位於在先被致能的畫素寫入資料訊號之期間被重置至第一電位，每一畫素的第二開關的控制端之電位於遮沒時間段內被重置至第二電位，第一電位與第二電位相同或者相異例如第一電位高於第二電位，又或者第一電位低於第二電位。
在本發明的一實施例中，上述之多個畫素係於頻率週期內依序被掃描訊號致能而分別寫入資料訊號，頻率週期包括資料寫入時間段與遮沒時間段，每一畫素係於資料寫入時間段內被掃描訊號致能，且每一畫素的第二開關的控制端之電位於遮沒時間段內被重置。進一步地，每相鄰兩個頻率週期內，每一畫素的第二開關的控制端之電位於相鄰兩個頻率週期中之第一頻率週期的遮沒時間段內被重置至第一電位，且每一畫素的第二開關的控制端之電位於相鄰兩個頻率週期中之第二頻率週期的遮沒時間段內被重置至第二電位，第一電位與第二電位相異；又或者，每一畫素的第二開關的控制端之電位於遮沒時間段內被重置多次。
在本發明的一實施例中，上述之第一開關與第二開關皆為電晶體，且電晶體的導電類型相同或相異。
本發明實施例提出的一種顯示方法，適於執行於顯示裝置。在此，顯示裝置包括多個畫素，每一畫素包括發光二極體、開關模組與電容；發光二極體的第一端電性耦接至第一預設電位，開關模組電性耦接於資料訊號、發光二極體的第二端以及第二預設電位，開關模組用以決定是否使電流流過發光二極體並根據資料訊號設定流過發光二極體之電流大小，電容的一端與開關模組電性耦接而形成電連接點。具體地，本實施例之顯示方法包括步驟：於顯示裝置的頻率週期內依序掃描上述之多個畫素以致能每一畫素的開關模組而寫入資料訊號至畫素；以及於每一畫素的開關模組未被致能期間，將週期性變化的重置訊號透過畫素的電容耦合至畫素的開關模組內以重置畫素的電連接點之電位。
在本發明的一實施例中，於上述顯示方法之每相鄰兩個畫素中，在後寫入資料訊號的畫素的電連接點之電位於在先被寫入資料訊號的畫素寫入資料訊號之期間被重置。進一步地，上述之頻率週期包括資料寫入時間段與遮沒時間段，每一畫素的開關模組係在資料寫入時間段內被致能，且每一畫素的電連接點之電位於遮沒時間段內被重置。
在本發明的一實施例中，於上述之顯示方法中，每相鄰兩個畫素中之在後被寫入資料訊號的畫素的電連接點之電位於在先被寫入資料訊號的畫素寫入資料訊號之期間被重置至第一電位，每一畫素的電連接點之電位於遮沒時間段內被重置至第二電位，第一電位與第二電位相同或者相異，例如第一電位低於第二電位，又或者第一電位高於第二電位。
在本發明的一實施例中，於上述之顯示方法中，頻率週期包括資料寫入時間段與遮沒時間段，每一畫素的開關模組係在資料寫入時間段內被致能，且每一畫素的電連接點之電位於遮沒時間段內被重置。進一步地，每相鄰兩個頻率週期內，每一畫素的電連接點之電位於相鄰兩個頻率週期中之第一頻率週期的遮沒時間段內被重置至第一電位，且每一畫素的電連接點之電位於相鄰兩個頻率週期中之第二頻率週期的遮沒時間段內被重置至第二電位，第一電位與第二電位相異；又或者，每一畫素的電連接點之電位於遮沒時間段內被重置多次。
本發明實施例提出的一種驅動電路，適於驅動電流驅動元件。其中，電流驅動元件具有第一端與第二端，且電流驅動元件的第一端電性耦接至第一預設電位。驅動電路包括開關模組以及電容；開關模組電性耦接於資料訊號、電流驅動元件的第二端以及第二預設電位，開關模組用以決定是否使電流流過電流驅動元件並根據資料訊號設定流過電流驅動元件之電流大小；電容電性耦接於週期性變化的重置訊號與開關模組之間，以將重置訊號耦合至開關模組內以重置電容與開關模組的電連接處之電位。
在本發明的一實施例中，上述之開關模組具有多個開關、且每一開關具有控制端、第一通路端與第二通路端。開關模組包括第一開關以及第二開關；第一開關的第一通路端電性耦接至資料訊號，第一開關的控制端接收掃描訊號以決定是否允許資料訊號從第一開關的第一通路端傳遞至第一開關的第二通路端；第二開關的第一通路端電性耦接至電流驅動元件的第二端，第二開關的第二通路端電性耦接至第二預設電位，且第二開關的控制端電性耦接至第一開關的第二通路端以接收資料訊號。再者，電容係電性耦接於重置訊號與第二開關的控制端。
在本發明的一實施例中，上述之驅動電路的第一開關與第二開關中每一者係選自N型電晶體與P型電晶體中之一者。
在本發明的一實施例中，上述之電流驅動元件係有機電激發光二極體。
本發明實施例藉由提供週期性變化的重置訊號並於第一開關處於截止期間透過電容耦合至驅動電路來做重置動作，以進行插黑或插白動作；因此驅動電路中之與電流驅動元件(例如，有機電激發光二極體)電性相接的第二開關例如電晶體寫入各種不同的資料訊號時其電流只會順著單一電流-電壓特性曲線上升或下降，可避免掉電晶體本身的遲滯效應。再者，當此種驅動電路應用於顯示裝置的畫素中時，可有效抑制先前技術中存在的影像殘留問題，提升顯示品質。
為讓本發明之上述和其他目的、特徵和優點能更明顯易懂，下文特舉較佳實施例，並配合所附圖式，作詳細說明如下。
參見圖2，其繪示為相關於本發明實施例之一種顯示裝置的局部結構示意圖。如圖2所示，顯示裝置20包括多個畫素P(1)~P(N)，各個畫素P(1)~P(N)在顯示裝置20的頻率週期例如畫框週期(frame period)內依序被掃描訊號SCAN(1)~SCAN(N)致能而分別從資料線DL接收並寫入資料訊號Vdata(1)~Vdata(N)；再者，各個畫素P(1)~P(N)分別接收週期性變化的重置訊號COMP(1)~COMP(N)；其中N為大於1的正整數。在此需要說明的是，圖2中僅繪示一行畫素作為舉例說明，但本發明並不以此為限。其中，每一畫素P(1)~P(N)包括驅動電路22以及電流驅動元件例如有機電激發光二極體26。具體地，驅動電路22為二電晶體一電容(2T1C)架構，其包括電晶體M1、M2以及電容Cst；電晶體M1為N型電晶體，電晶體M2為P型電晶體。於本實施例中，電晶體M1及M2皆作為開關使用，每一電晶體M1及M2的閘極、汲極與源極分別為開關的控制端、第一通路端與第二通路端；並且電晶體M1及M2構成用以決定是否使電流流過有機電激發光二極體26的開關模組。
更具體地，電晶體M1的汲極電性耦接至資料線DL以接收資料訊號Vdata(1)~Vdata(N)中之相應者，電晶體M1的閘極接收掃描訊號SCAN(1)~SCAN(N)中之相應者以決定是否允許資料訊號從電晶體M1的汲極傳遞至電晶體M1的源極；電晶體M2的汲極電性耦接至有機電激發光二極體26的正極，有機電激發光二極體26的負極電性耦接至預設電位例如電源電位OVSS，電晶體M2的源極電性耦接至另一預設電位例如電源電位OVDD，電晶體M2的閘極電性耦接至電晶體M1的源極。電容Cst的一端電性耦接至電晶體M2的閘極，電容Cst的另一端接收重置訊號COMP(1)~COMP(N)中之相應者以將重置訊號耦合至驅動電路22內進而重置電晶體M2的閘極之電位，亦係電容Cst與開關模組之間的電連接點之電位。
下面將結合圖2與圖3詳細描述驅動電路22中的電晶體M2的閘極之電位的重置動作，圖3繪示為相關於圖2所示各個畫素P(1)~P(N)中的驅動電路22之重置訊號COMP(1)~COMP(N)與掃描訊號SCAN(1)~SCAN(N)的時序圖。
如圖3所示，顯示裝置20的單個畫框週期包括資料寫入時間段與遮沒(blanking)時間段。於資料寫入時間段內，各個畫素P(1)~P(N)在掃描訊號SCAN(1)~SCAN(N)依序為高位準時被致能，相應地各個畫素P(1)~P(N)中的電晶體M1依序導通而將資料訊號Vdata(1)~Vdata(N)傳遞至電晶體M2的閘極以進行資料寫入動作；其中，當掃描訊號SCAN(1)~SCAN(N)依序跳變為低位準時，各個畫素P(1)~P(N)的電晶體M1依序截止，其表示相應畫素的當前資料訊號寫入完畢，之後則可由電晶體M2根據寫入的資料訊號驅動有機電激發光二極體26產生對應灰階的亮光。於遮沒時間段內，掃描訊號SCAN(1)~SCAN(N)皆為低位準，各個畫素P(1)~P(N)中的電晶體M1皆處於截止狀態而有機電激發光二極體26處於發光階段。
從圖3還可以得知：於每相鄰兩個畫素中，以畫素P(N-1)與P(N)為例進行說明，在後被致能的畫素P(N)的電晶體M2的閘極之電位於在先被致能的畫素P(N-1)寫入資料訊號Vdata(N-1)之期間被重置訊號COMP(N)所重置。具體地，於在先被致能的畫素P(N-1)寫入資料訊號Vdata(N-1)之期間，畫素P(N)的電晶體M1處於截止狀態，重置訊號COMP(N)跳變為高位準而透過電容Cst耦合至畫素P(N)之電晶體M2的閘極，以將電晶體M2的閘極之電位重置為高位準，使得電晶體M2截止，亦即進行插黑動作，使得各個畫素P(1)~P(N)在截止寫入資料訊號之期間被重置至極端黑顯示狀態例如灰階0。
另外，根據圖3所示的重置訊號COMP(1)~COMP(N)與掃描訊號SCAN(1)~SCAN(N)的波形關係可知，可將同一行中的前一個畫素例如P(N-1)的掃描訊號SCAN(N-1)作為後一個畫素例如P(N)的重置訊號COMP(N)，具體電路連接關係可參閱圖3A所示。
另外需要說明的是，本發明實施例之各個畫素P(1)~P(N)的電晶體M2的閘極之電位的重置動作並不限於圖3所示之每相鄰兩個畫素中在後被致能的畫素的電晶體M2的閘極之電位於在先被致能的畫素寫入資料訊號之期間被重置的情形，其還可採用其他例如圖4至圖9所列舉之情形。
請一併參閱圖2及圖4，於每相鄰兩個畫素例如P(N-1)與P(N)中，在後被致能的畫素P(N)的電晶體M2的閘極之電位於在先被致能的畫素P(N-1)寫入資料訊號Vdata(N-1)之期間被重置至高位準；而於畫框週期的遮沒時間段內，每一畫素P(1)~P(N)於重置訊號COMP(1)~COMP(N)再次跳變為高位準時被重置至高位準。換言之，如圖4所示，每一畫素P(1)~P(N)的電晶體M2的閘極之電位的兩次重置皆係拉至高位準，使得電晶體M2截止，亦即進行雙插黑動作。
請一併參閱圖2及圖5，於每相鄰兩個畫素例如P(N-1)與P(N)中，在後被致能的畫素P(N)的電晶體M2的閘極之電位於在先被致能的畫素P(N-1)寫入資料訊號Vdata(N-1)之期間被重置至低位準；而於畫框週期的遮沒時間段內，每一畫素P(1)~P(N)於重置訊號COMP(1)~COMP(N)跳變為高位準時被重置至高位準。換言之，於圖5中，每一畫素P(1)~P(N)的電晶體M2的閘極之電位於第一次重置時被拉至低位準且於第二次重置時被拉至高位準，亦即進行前插白後插黑動作，使得各個畫素P(1)~P(N)在截止寫入資料訊號之期間先被重置至極端白顯示狀態例如灰階255再被重置至極端黑顯示狀態例如灰階0。
請一併參閱圖2及圖6，於每相鄰兩個畫素例如P(N-1)與P(N)中，在後被致能的畫素P(N)的電晶體M2的閘極之電位於在先被致能的畫素P(N-1)寫入資料訊號Vdata(N-1)之期間被重置至高位準；而於畫框週期的遮沒時間段內，每一畫素P(1)~P(N)於重置訊號COMP(1)~COMP(N)跳變為低位準時被重置至低位準。換言之，於圖6中，每一畫素P(1)~P(N)的電晶體M2的閘極之電位於第一次重置時被拉至高位準且於第二次重置時被拉至低位準，亦即進行前插黑後插白動作，使得各個畫素P(1)~P(N)在截止寫入資料訊號之期間先被重置至極端黑顯示狀態例如灰階0再被重置至極端白顯示狀態例如灰階255。
請一併參閱圖2及圖7，每一畫素P(1)~P(N)僅於畫框週期的遮沒時間段內當重置訊號COMP(1)~COMP(N)跳變為高位準時被重置。具體地，於圖7中，各個畫素P(1)~P(N)的重置訊號COMP(1)~COMP(N)具有相同的波形，因此可設計為將各個畫素P(1)~P(N)的電容Cst之不與電晶體M2的閘極電性耦接的一端連接在一起，具體電路連接關係可參閱圖7A所示；另外，每一畫素P(1)~P(N)的電晶體M2的閘極之電位於畫框週期的遮沒時間段內被重置至高位準，使得P型電晶體M2截止，亦即進行插黑動作。
請一併參閱圖2及圖8，於相鄰兩個畫框週期內，每一畫素P(1)~P(N)於前一畫框週期內的遮沒時間段內當重置訊號COMP(1)~COMP(N)跳變為高位準時被重置，而於後一畫框週期內的遮沒時間段內當重置訊號COMP(1)~COMP(N)跳變為低位準時被重置。換言之，於圖8中，每一畫素P(1)~P(N)的電晶體M2的閘極之電位於相鄰兩個畫框週期的遮沒時間段內被分別重置為高位準及低位準，亦即進行畫框插黑畫框插白動作，使得各個畫素P(1)~P(N)於前一畫框的截止寫入資料訊號之期間被重置至極端黑顯示狀態例如灰階0而於後一畫框的截止寫入資料訊號之期間被重置至極端白顯示狀態例如灰階255。此外，於圖8中，各個畫素P(1)~P(N)的重置訊號COMP(1)~COMP(N)具有相同的波形，因此可設計為將各個畫素P(1)~P(N)的電容Cst之不與電晶體M2的閘極電性耦接的一端連接在一起，具體電路連接關係可參閱圖7A所示。
請一併參閱圖2及圖9，每一畫素P(1)~P(N)於畫框週期的遮沒時間段內被重置多次。具體地，於圖9中，各個畫素P(1)~P(N)的重置訊號COMP(1)~COMP(N)具有相同的波形，因此可設計為將各個畫素P(1)~P(N)的電容Cst之不與電晶體M2的閘極電性耦接的一端連接在一起，具體電路連接關係可參閱圖7A；另外，每一畫素P(1)~P(N)的電晶體M2的閘極之電位因重置訊號COMP(1)~COMP(N)交替跳變為低位準與高位準而被重置多次，達成插黑或插白動作。
於本發明上述各個實施例中，透過在各個畫素P(1)~P(N)的截止寫入資料訊號之期間，對各個畫素P(1)~P(N)進行一次或多次重置動作例如插黑及/或插白動作，使各個畫素P(1)~P(N)在截止寫入資料訊號的期間被重置至極端顯示狀態(例如極端黑或極端白)，因此在各個畫素P(1)~P(N)寫入資料訊號時，其所產生之流過有機電激發光二極體的電流(對應電晶體M2的汲-源極電流)僅會沿著單一電流-電壓特性曲線例如圖1B中「S」型虛線或「S」型實線所表示的電流-電壓特性曲線進行改變，因此可有效抑制電晶體M2的遲滯效應所造成的影響。
此外，本領域熟習此技藝者可理解的是，本發明實施例之電晶體M1與M2並不限於分別為N型與P型之組合，其還可為其他各種不同的組合，例如圖10至圖12所示之組合。
具體地，於圖10所示實施例中，電晶體M1為P型電晶體，且電晶體M2為N型電晶體；在此，電晶體M1與M2的導電類型相異。於圖11所示實施例中，電晶體M1與M2皆為N型電晶體，亦即電晶體M1與M2的導電類型相同。於圖12所示實施例中，電晶體M1與M2皆為P型電晶體，亦即電晶體M1與M2的導電類型相同。
綜上所述，本發明實施例藉由提供週期性變化的重置訊號並於電晶體M1處於截止期間(亦即畫素的截止寫入資料訊號之期間)透過電容耦合至驅動電路來做重置動作，以進行插黑及/或插白動作；因此驅動電路中之與電流驅動元件(例如，有機電激發光二極體)電性相接的開關例如電晶體M2在寫入各種不同的資料訊號時其電流只會順著單一電流-電壓特性曲線(I-V Curve)上升或下降，可避免掉電晶體本身的遲滯效應。再者，當此種驅動電路應用於顯示裝置的畫素中時，可有效抑制先前技術中存在的影像殘留問題，提升顯示品質。
此外，任何熟習此技藝者還可對本發明上述實施例提出的顯示裝置以及驅動電路作適當變更例如將各個電晶體的源極與汲極之電連接關係互換、採用其他發光二極體作為電流驅動元件，及/或適當變更重置訊號的時序等等。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
10．．．畫素
12．．．驅動電路
16．．．有機電激發光二極體
M1、M2．．．電晶體
C1．．．儲存電容
SCAN．．．掃描訊號
DL．．．資料線
OVDD、OVSS．．．電源電位
Vgs．．．電晶體M2的閘-源極電壓
VB 、VG 、VW ．．．電晶體M2的閘-源極電壓取值
Ids．．．電晶體M2的汲-源極電流
IB 、IG 、IW ．．．電晶體M2的汲-源極電流取值
20．．．顯示裝置
22．．．驅動電路
26．．．有機電激發光二極體
Cst．．．電容
P(1)~P(N)．．．畫素
SCAN(1)~SCAN(N)．．．掃描訊號
Vdata(1)~Vdata(N)．．．資料訊號
COMP(1)~COMP(N)．．．重置訊號
圖1A繪示為傳統畫素之結構示意圖。
圖1B繪示為先前技術中存在遲滯效應的電晶體之電流-電壓特性曲線。
圖2繪示為相關於本發明實施例之一種顯示裝置的局部結構示意圖。
圖3繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第一實施型態。
圖3A繪示為與圖3所示實施型態相關之一種顯示裝置的局部結構示意圖。
圖4繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第二實施型態。
圖5繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第三實施型態。
圖6繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第四實施型態。
圖7繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第五實施型態。
圖7A繪示為與圖7所示實施型態相關之一種顯示裝置的局部結構示意圖。
圖8繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第六實施型態。
圖9繪示為相關於圖2所示各個畫素中的驅動電路之重置訊號與掃描訊號的時序圖之第七實施型態。
圖10繪示為相關於本發明實施例之一種畫素的再一實施型態。
圖11繪示為相關於本發明實施例之一種畫素的又一實施型態。
圖12繪示為相關於本發明實施例之一種畫素的另一實施型態。
20．．．顯示裝置
22．．．驅動電路
26．．．有機電激發光二極體
M1、M2．．．電晶體
Cst．．．電容
DL．．．資料線
OVDD、OVSS．．．電源電位
P(1)~P(N)．．．畫素
SCAN(1)~SCAN(N)．．．掃描訊號
Vdata(1)~Vdata(N)．．．資料訊號
COMP(1)~COMP(N)．．．重置訊號

Claims (26)

  1. 一種顯示裝置，包括多個畫素，每一該些畫素包括：一發光二極體，具有一第一端與一第二端，該發光二極體的該第一端電性耦接至一第一預設電位；以及一驅動電路，該驅動電路包括：一第一開關，該第一開關的一第一通路端接收一資料訊號，該第一開關的一控制端接收一掃描訊號以決定是否允許該資料訊號從該第一開關的該第一通路端傳遞至該第一開關的一第二通路端；一第二開關，該第二開關的一第一通路端電性耦接至該發光二極體的該第二端，該第二開關的一第二通路端電性耦接至一第二預設電位，且該第二開關的一控制端電性耦接至該第一開關的該第二通路端以接收該資料訊號；以及一電容，電性耦接於一週期性變化的重置訊號與該第二開關的該控制端之間；其中，該第二開關的該控制端之電位於該第一開關處於截止期間且該資料訊號從該第一開關的該第一通路端傳遞至該第一開關的該第二通路端之前被該重置訊號重置，藉此使在該重置訊號重置該第二開關的該控制端之電位後，該發光二極體為極端黑或極端白之發光狀態。
  2. 如申請專利範圍第1項所述之顯示裝置，其中該些畫素係於一頻率週期內依序被該些掃描訊號致能而分別寫入該些資料訊號，且於每相鄰兩個該些畫素中，在後被致能的該畫素的該第二開關的該控制端之電位於在先被致能的該畫素寫入該資料訊號之期間被重置。
  3. 如申請專利範圍第2項所述之顯示裝置，其中該頻率週期包括一資料寫入時間段與一遮沒(blanking)時間段，每一該些畫素 係於該資料寫入時間段內被該掃描訊號致能，且每一該些畫素的該第二開關的該控制端之電位於該遮沒時間段內被重置。
  4. 如申請專利範圍第3項所述之顯示裝置，其中每相鄰兩個該些畫素中之在後被致能的該畫素的該第二開關的該控制端之電位於在先被致能的該畫素寫入該資料訊號之期間被重置至一第一電位，每一該些畫素的該第二開關的該控制端之電位於該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相同。
  5. 如申請專利範圍第3項所述之顯示裝置，其中每相鄰兩個該些畫素中之在後被致能的該畫素的該第二開關的該控制端之電位於在先被致能的該畫素寫入該資料訊號之期間被重置至一第一電位，每一該些畫素的該第二開關的該控制端之電位於該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相異。
  6. 如申請專利範圍第5項所述之顯示裝置，其中該第一電位低於該第二電位。
  7. 如申請專利範圍第5項所述之顯示裝置，其中該第一電位高於該第二電位。
  8. 如申請專利範圍第1項所述之顯示裝置，其中該些畫素係於一頻率週期內依序被該些掃描訊號致能而分別寫入該些資料訊號，該頻率週期包括一資料寫入時間段與一遮沒時間段，每一該些畫素係於該資料寫入時間段內被該掃描訊號致能，且每一該些畫素的該第二開關的該控制端之電位於該遮沒時間段內被重置。
  9. 如申請專利範圍第8項所述之顯示裝置，其中每相鄰兩個該頻率週期內，每一該些畫素的該第二開關的該控制端之電位於該相鄰兩個頻率週期中之一第一該頻率週期的該遮沒時間段內被重置至一第一電位，且每一該些畫素的該第二開關的該控制端之電位於該相鄰兩個頻率週期中之一第二該頻率週期的該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相異。
  10. 如申請專利範圍第8項所述之顯示裝置，其中每一該些畫素的該第二開關的該控制端之電位於該遮沒時間段內被重置多次。
  11. 如申請專利範圍第1項所述之顯示裝置，其中該第一開關與該第二開關皆為電晶體，且該些電晶體的導電類型相異。
  12. 如申請專利範圍第1項所述之顯示裝置，其中該第一開關與該二開關皆為電晶體，且該些電晶體的導電類型相同。
  13. 一種顯示方法，執行於一顯示裝置，該顯示裝置包括多個畫素，每一該些畫素包括一發光二極體、一開關模組以及一電容，該發光二極體的一第一端電性耦接至一第一預設電位，該開關模組電性耦接於一資料訊號、該發光二極體的一第二端以及一第二預設電位，該開關模組用以決定是否使電流流過該發光二極體並根據該資料訊號設定流過該發光二極體之電流大小，該電容的一端與該開關模組電性耦接而形成一電連接點；該顯示方法包括步驟：於該顯示裝置的一頻率週期內依序掃描該些畫素以致能每一該些畫素的該開關模組而寫入該資料訊號至該畫素；以及於每一該些畫素的該開關模組未被致能期間且該資料訊號被寫入至該畫素之前，將一週期性變化的重置訊號透過該畫素的該電容耦合至該畫素的該開關模組內以重置該畫素的該電連接點之電位，藉此使在該週期性變化的重置訊號重置該畫素的該電連接點後，該發光二極體為極端黑或極端白之發光狀態。
  14. 如申請專利範圍第13項所述的顯示方法，其中於每相鄰兩個該些畫素中，在後被寫入該資料訊號的該畫素的該電連接點之電位於在先被寫入該資料訊號的該畫素寫入該資料訊號之期間被重置。
  15. 如申請專利範圍第14所述之顯示方法，其中該頻率週期 包括一資料寫入時間段與一遮沒時間段，每一該些畫素的該開關模組係在該資料寫入時間段內被致能，且每一該些畫素的該電連接點之電位於該遮沒時間段內被重置。
  16. 如申請專利範圍第15項所述之顯示方法，其中每相鄰兩個該些畫素中之在後被寫入該資料訊號的該畫素的該電連接點之電位於在先被寫入該資料訊號的該畫素寫入該資料訊號之期間被重置至一第一電位，每一該些畫素的該電連接點之電位於該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相同。
  17. 如申請專利範圍第15項所述之顯示方法，其中每相鄰兩個該些畫素中之在後被寫入該資料訊號的該畫素的該電連接點之電位於在先被寫入該資料訊號的該畫素寫入該資料訊號之期間被重置至一第一電位，每一該些畫素的該電連接點之電位於該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相異。
  18. 如申請專利範圍第17項所述之顯示方法，其中該第一電位低於該第二電位。
  19. 如申請專利範圍第17項所述之顯示方法，其中該第一電位高於該第二電位。
  20. 如申請專利範圍第13項所述之顯示方法，其中該頻率週期包括一資料寫入時間段與一遮沒時間段，每一該些畫素的該開關模組係在該資料寫入時間段內被致能，且每一該些畫素的該電連接點之電位於該遮沒時間段內被重置。
  21. 如申請專利範圍第20項所述之顯示方法，其中每相鄰兩個該頻率週期內，每一該些畫素的該電連接點之電位於該相鄰兩個頻率週期中之一第一該頻率週期的該遮沒時間段內被重置至一第一電位，且每一該些畫素的該電連接點之電位於該相鄰兩個頻率週期中之一第二該頻率週期的該遮沒時間段內被重置至一第二電位，該第一電位與該第二電位相異。
  22. 如申請專利範圍第20項所述之顯示方法，其中每一該些畫素的該電連接點之電位於該遮沒時間段內被重置多次。
  23. 一種驅動電路，適於驅動一電流驅動元件，該電流驅動元件具有一第一端與一第二端，且該電流驅動元件的該第一端電性耦接至一第一預設電位，該驅動電路包括：一開關模組，電性耦接於一資料訊號、該電流驅動元件的該第二端及一第二預設電位，該開關模組用以決定是否使電流流過該電流驅動元件並根據該資料訊號設定流過該電流驅動元件之電流大小；以及一電容，電性耦接於一週期性變化的重置訊號與該開關模組之間，以在該資料訊號被經過該開關模組而被寫入至該電容與該開關模組的電連接處之前，將該重置訊號耦合至該開關模組內以重置該電容與該開關模組的電連接處之電位，藉此使在該週期性變化的重置訊號重置該電容與該開關模組的電連接處後，流過該電流驅動元件之電流被固定在最大值與最小值二者之一。
  24. 如申請專利範圍第23項所述之驅動電路，該開關模組具有多個開關，且每一該些開關具有一控制端、一第一通路端與一第二通路端，該開關模組包括：一第一開關，該第一開關的該第一通路端電性耦接至該資料訊號，該第一開關的該控制端接收一掃描訊號以決定是否允許該資料訊號從該第一開關的該第一通路端傳遞至該第一開關的該第二通路端；以及一第二開關，該第二開關的該第一通路端電性耦接至該電流驅動元件的該第二端，該第二開關的該第二通路端電性耦接至該第二預設電位，且該第二開關的該控制端電性耦接至該第一開關的該第二通路端以接收該資料訊號；其中，該電容係電性耦接於該重置訊號與該第二開關的該控 制端。
  25. 如申請專利範圍第24項所述之驅動電路，其中每一該第一開關與該第二開關係選自N型電晶體與P型電晶體中之一者。
  26. 如申請專利範圍第23項所述之驅動電路，其中該電流驅動元件係有機電激發光二極體。
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