TWI396967B - 信號過濾方法及應用其之電子裝置與可讀取記錄媒體 - Google Patents

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Description

信號過濾方法及應用其之電子裝置與可讀取記錄媒體
本發明是有關於一種信號處理方法及應用其之電子裝置，且特別是有關於一種信號過濾方法及應用其之電子裝置與可讀取記錄媒體。
近年來，行動技術之發展，已為電子裝置帶來龐大的市場。舉例來說，電子裝置，諸如個人數位助理(Personal digital assistants,PDA)、智慧型手機(smart phone)及觸碰式手機(touch phone)，e逐漸成為人們生活的必需品。
為了達到操作電子裝置的目的，傳統之電子裝置係裝配機械式之按鍵，以供使用者操作。除此之外，市面上亦有裝配感測元件之電子裝置。感測元件包括多個電容式感測器。當使用者將手指放置於感測元件而施加壓力於其上時，對應的電容式感測器會感測到變化，並藉以得知手指的觸碰位置。再者，藉由連續感測的方式，還能得知手指於感測元件上滑動的方向，例如是順時針或是逆時針。因此，當使用者在操作此種電子裝置時，只要透過手指於感測元件上施壓或滑動的行為，即可移動游標、調整音量、或是點選歌曲等等，而能達到操作電子裝置的目的。
然而，當使用此種感測元件時，卻會使得電子裝置具有操作不穩定的問題，茲將其原因簡要如下。由於電子裝置具有複雜電路，因此電路間訊號進行傳遞時，將會產生 干擾感應轉盤之訊號。還有，電子裝置常以高功率進行通訊，故此時會產生強烈的干擾訊號，使得感測元件感測到大量的雜訊。另一方面、電子裝置還會受到溫度與溼度所影響、或因為使用者之操作不當而使得感測元件感測到非使用者所預期之訊號，並造成裝置之不穩定。因此，如何增加裝配感測元件之電子裝置之操作穩定性，以俾利使用者之操作實用性，乃業界所致力之方向之一。
本發明係有關於一種信號過濾方法及應用其之電子裝置與可讀取記錄媒體，能過濾電子裝置所取得之多筆信號，可增加電子裝置之操作穩定性，提高使用者之操作實用性。
根據本發明之第一方面，提出一種信號過濾方法，用以過濾一電子裝置於多個時間點所取得之多筆信號。此多筆信號於上述多個時間點之一第i時間點係對應一第i數值，且第i數值及一第i＋1數值係定義為一第i有序數列，其中i為正整數。第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。此方法包括下列步驟。判斷一第i＋2有序數列是否符合一第二嚴格單調性，若是，則執行以下之步驟。判斷一第i＋3有序數列是否符合第二嚴格單調性，若否，刪除於一第i＋3時間點所取得之一信號。
根據本發明之第二方面，提出一種電子裝置，包括一擷取單元、一判斷單元及一過濾單元。擷取單元用以於多 個等間隔之時間點取得多筆信號。多筆信號於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。判斷單元用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。過濾單元用以過濾擷取單元所取得之些信號，若判斷單元判定第i＋2有序數列符合第二嚴格單調性，且判斷單元判定第i＋3有序數列不符合第二嚴格單調性，則過濾單元刪除於一第i＋3時間點所取得之一信號。
根據本發明之第三方面，提出一種內儲數位資料之可讀取記錄媒體，當一電子裝置載入數位資料並執行後，可使電子裝置執行一信號過濾方法，此方法用以過濾電子裝置於多個時間點所取得之多筆信號。多筆信號於上述多個時間點之一第i時間點係對應一第i數值，且第i數值及一第i＋1數值係定義為一第i有序數列，其中i為正整數。第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。此方法包括下列步驟。判斷一第i＋2有序數列是否符合一第二嚴格單調性，若是，則執行以下之步驟。判斷一第i＋3有序數列是否符合第二嚴格單調性，若否，刪除於一第i＋3時間點所取得之一信號。
根據本發明之第四方面，提出一種內儲數位資料之應用程式，當一電子裝置載入數位資料並執行後，可使電子裝置執行一信號過濾方法。此方法用以過濾電子裝置於多個時間點所取得之多筆信號。多筆信號於上述多個時間點 之一第i時間點係對應一第i數值，且第i數值及一第i＋1數值係定義為一第i有序數列，其中i為正整數。第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。此方法包括下列步驟。判斷一第i＋2有序數列是否符合一第二嚴格單調性，若是，則執行以下之步驟。判斷一第i＋3有序數列是否符合第二嚴格單調性，若否，刪除於一第i＋3時間點所取得之一信號。
根據本發明之第五方面，提出一種電子裝置，包括一感測模組及一處理器。感測模組包括一擷取單元、一記憶體及一微處理器。擷取單元用以於多個等間隔之時間點取得多筆信號。多筆信號於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。記憶體用以儲存一程式碼。微處理器用以於讀取程式碼及執行後，過濾此些信號。微處理器用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。若判定第i＋2有序數列符合第二嚴格單調性，且判定第i＋3有序數列不符合第二嚴格單調性，則微處理器刪除於一第i＋3時間點所取得之一信號。處理器用以接收感測模組過濾後之此些信號。
根據本發明之第六方面，提出一種電子裝置，包括一感測模組及一處理模組。感測模組用以於多個等間隔之時間點取得之多筆信號，多筆信號於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序 數列及一第i＋1有序數列係符合一第一嚴格單調性。處理模組包括一記憶體及一處理器。記憶體用以儲存一作業系統(operating system)之程式碼。處理器用以於讀取作業系統之程式碼並執行後，接收並過濾感測模組所取得之此些信號。處理器用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。若判定第i＋2有序數列符合第二嚴格單調性，且判定第i＋3有序數列不符合第二嚴格單調性，則處理器刪除於一第i＋3時間點所取得之一信號。
根據本發明之第七方面，提出一種電子裝置，用以執行一應用程式，以過濾於多個等間隔之時間點取得之多筆信號，多筆信號於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性，電子裝置包括一記憶體及一處理器。記憶體用以儲存一作業系統(operating system)之程式碼。處理器用以於讀取作業系統之程式碼並執行後，執行應用程式，以過濾此些信號。處理器用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性，若判定第i＋2有序數列符合第二嚴格單調性，且判定第i＋3有序數列不符合第二嚴格單調性，則處理器刪除於一第i＋3時間點所取得之一信號。
為讓本發明之上述內容能更明顯易懂，下文特舉一些 較佳實施例，並配合所附圖式，作詳細說明如下。
 第一實施例
於本發明之第一實施例所提出之信號過濾方法中，此方法用以過濾一電子裝置於多個時間點所取得之多筆信號。多筆信號於上述多個時間點之一第i時間點係對應一第i數值，且第i數值及一第i＋1數值係定義為一第i有序數列，其中i為正整數。第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。請參照第1圖，其繪示依照本發明之第一實施例之應用於電子裝置之信號過濾方法之詳細流程圖。此方法包括如下所述之步驟。
於步驟S110中，判斷一第i＋2有序數列是否符合一第二嚴格單調性，若否，則執行步驟S120，輸出於第i＋1時間點、第i＋2時間點及第i＋3時間點所取得之信號；若是，則執行步驟S130。
於步驟S130中，判斷第i＋3有序數列是否符合第二嚴格單調性，若是，執行步驟S140，輸出於第i＋1時間點、第i＋2時間點及第i＋3時間點所取得之信號；若否，執行步驟S150，刪除於第i＋3時間點所取得之信號。
較佳地，於上述之步驟S110前，此方法還包括下列步驟。判斷第i＋2有序數列之二數值是否相等，若是，執刪除於第i＋3時間點所取得之信號；若否，執行步驟S110。再者，於步驟S130前，此方法還包括下列步驟。判斷第 i＋3有序數列之二數值是否相等，若是，刪除於第i＋4時間點所取得之信號；若否，執行步驟S130。
茲以於下說明應用本發明之信號過濾方法之電子裝置。請參照第2圖，其繪示依照本發明之第一實施例之應用信號過濾方法之電子裝置之示意圖。電子裝置200包括一擷取單元210、一判斷單元220及一過濾單元230、一控制單元240、以及一顯示單元250。各單元之功能及其間的運作方式係詳述如下。
擷取單元210用以於多個等間隔之時間點取得多筆信號P1~Pm，此些信號P1~Pm於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。判斷單元220用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。過濾單元230用以過濾擷取單元210所取得之信號P1~Pm。若判斷單元220判定第i＋2有序數列符合第二嚴格單調性，且判斷單元220判定第i＋3有序數列不符合第二嚴格單調性，則過濾單元230刪除於一第i＋3時間點所取得之一信號。
當判斷單元220判定第i＋2有序數列不符合第二嚴格單調性，過濾單元230輸出於第i＋1時間點、第i＋2時間點及第i＋3時間點所取得之信號。當判斷單元220判定第i＋3有序數列不符合第二嚴格單調性，過濾單元230輸出於第i＋2時間點、第i＋3時間點及第i＋4時間點所取得之 信號。顯示單元250用以顯示一畫面。控制單元240用以依據過濾單元230所輸出之該些信號決定一控制模式，以控制顯示單元250所顯示之畫面。
茲於下說明顯示單元250、控制單元240與擷取單元210之間之運作方式，其中，顯示單元250例如包括一顯示螢幕、而擷取單元210例如包括一感應轉盤。請參照第3A圖，其繪示為依照本發明之第一實施例之電子裝置之一例之示意圖。於此例中，電子裝置300具有一機體302、一感應轉盤304、一顯示螢幕306及一控制單元(未繪示於第3A圖中)。感應轉盤304係用以取得多筆信號，每筆信號係對應至一數值。位於機體302內之控制單元係依據一控制模式來控制顯示螢幕306所顯示之畫面Im。畫面Im例如為一維度畫面或二維度畫面。畫面Im具有一游標，而控制模式係為一方向模式。此方向模式係用以控制游標於畫面Im之移動方向。
請參照第3B圖，其繪示為依照本發明之第一實施例之電子裝置所顯示之畫面之一例之示意圖。於此例中，畫面Ima係為一維度畫面，方向模式用以控制游標Cr於一維畫面中前進或退後。舉例來說，畫面Ima例如具有排成一列之多個選項A~D。游標Cr指示於目前之選項，如選項B。此時，若感應轉盤304所取得之信號在經過過濾之後，被控制單元決定為控制游標Cr於畫面Ima中前進，則游標Cr例如將會指示於選項C，反之，若為後退，則游標Cr將會指示於選項A。因此，感應轉盤304所取得之 信號可用來決定方向模式，以控制游標Cr於畫面Ima前進或後退。
請參照第3C圖，其繪示為依照本發明之第一實施例之電子裝置之顯示單元所顯示之畫面之另一例之示意圖。於此例中，畫面Imb係為二維度畫面，方向模式用以控制游標Cr於二維畫面中之座標。舉例來說，畫面Imb例如為視窗(Window)畫面，若感應轉盤304所取得之信號經過過濾之後，被控制單元決定為控制游標Cr於畫面Imb中右移，則游標Cr將會於視窗畫面中向右移動，同理，感應轉盤304所取得之信號可使游標Cr上移或下移，而能控制游標Cr於畫面Imb中之座標。
上述之感應轉盤例如為一電容感應轉盤，然亦不限於此。感應轉盤例如包括多個圍繞成環狀之感測器，各感測器係較佳地對應於一數值、或對應於由其位置座標所轉換而成之數值。當感應轉盤感測到信號時，例如是使用者之手指於感應轉盤上滑動時，被施加外力而觸發之感測器會傳送所對應之數值。
舉例來說，假設使用者之手指於轉應轉盤上以一第一方向(如順時針方向)滑動時，感應轉盤所感測之信號係對應至具有一第一嚴格單調性之多筆數值，若使用者之手指於感應轉盤上以一第二方向(如逆時針方向)滑動時，感應轉盤所感測之信號係對應至具有一第二嚴格單調性之多筆數值。然而，當感應轉盤未被施加以外力，而係受到雜訊之干擾時，例如受到高頻信號干擾時，感應轉盤亦會感 測到信號。故知，感應轉盤所取得之信號，係可能同時包括著使用者操作之信號、以及受雜訊干擾之信號。
茲以多個例子說明本發明之第一實施例之電子裝置應用信號過濾方法之實際操作如下。在一第一例子中，感應轉盤於多個等間隔之時間點t1~t5取得多筆信號，且對應至之數值為{d1,d2,d3,d4,d5}，其中d1<d2<d3>d4<d5。於此例中，第一嚴格單調性係為嚴格單調遞增性。第1有序數列{d1,d2}(d1<d2)符合嚴格單調遞增性，第2有序數列{d2,d3}(d2<d3)亦符合嚴格單調遞增性。
接著判斷單元判斷第3有序數列{d3,d4}是否符合一第二嚴格單調性，於此例中，第二嚴格單調性係為嚴格單調遞減性。由於第3有序數列{d3,d4}(d3>d4)符合嚴格單調遞減性，故判斷單元會再判斷第4有序數列{d4,d5}是否符合嚴格單調遞減性。由於第4有序數列(d4<d5)並不符合嚴格單調遞減性，故過濾單元會移除於第4時間點t4所取得之信號，即移除{d4}。過濾後之信號所對應之數值為{d1,d2,d3,d5}(d1<d2<d3<d5)。
在一第二例子中，感應轉盤於多個等間隔之時間點t1~t5取得多筆信號，且對應至之數值為{d1,d2,d3,d4,d5}，其中d1<d2<d3＝d4<d5。與第一例子不同的是，判斷單元會判斷第3有序數列{d3,d4}中之二數值是否相同。於此例中，由於第3有序數列{d3,d4}(d3＝d4)之二數值相同，故過濾單元會移除於第4時間點t4所取得之信號，即移除{d4}。過濾後之信號所對應之數值為{d1,d2, d3,d5}(d1<d2<d3<d5)。
在一第三例子中，感應轉盤於多個等間隔之時間點t1~t5取得多筆信號，且對應至之數值為{d1,d2,d3,d4,d5}，其中d1<d2<d3<d4＝d5。與第一例子不同的是，判斷單元會判斷第4有序數列{d4,d5}中之二數值是否相同。於此例中，由於第4有序數列{d4,d5}(d4＝d5)之二數值相同，故過濾單元會移除於第5時間點t5所取得之信號，即移除{d5}。過濾後之信號所對應之數值為{d1,d2,d3,d4}(d1<d2<d3<d4)。
在一第四例子中，感應轉盤於多個等間隔之時間點t1~t5取得多筆信號，且對應至之數值為{d1,d2,d3,d4,d5}，其中d1<d2<d3>d4>d5。與第一例子不同的是，第4有序數列(d4>d5)符合嚴格單調遞減性，故不會刪除信號。因此，過濾後之信號所對應之數值為{d1,d2,d3,d4,d5}(d1<d2<d3>d4>d5)。
在上述之四個例子中，假設若信號所對應之數值符合嚴格單調遞增性，則控制單元將控制游標Cr於第4B圖之畫面Ima中前進，而嚴格單調遞增性則為後退。於第一個例子中，過濾後之信號所對應之數值為{d1,d2,d3,d5}(d1<d2<d3<d5)符合嚴格單調遞增性，故控制單元將會控制游標Cr於畫面Ima中持續前進。於第二及第三例子中，過濾後之信號所對應之數值分別為{d1,d2,d3,d5}(d1<d2<d3<d5)及{d1,d2,d3}(d1<d2<d3)，且皆符合嚴格單調遞增性，故控制單元亦會控制游標Cr於畫面Ima 中前進。
相對地，於第四例子中，過濾後之信號所對應之數值為{d1,d2,d3,d4,d5}(d1<d2<d3>d4>d5)，由於前三項數值{d1,d2,d3}(d1<d2<d3)符合嚴格單調遞增性，故控制單元將會控制游標Cr於畫面Ima中前進，相反地，由於後三項數值{d3,d4,d5}(d3>d4>d5)具有嚴格單調遞減性，故控制單元將會控制游標Cr於畫面Ima中後退。因此，於此例中，游標Cr將會先前進、再後退。
需知者為，於上述之多個例子中，若不過濾感應轉盤所取得此些信號，電子裝置將會執行不必要的動作，而使裝置具有操作不穩定的問題。舉例來說，於第一個例子中，若不移除第4時間點所取得之信號{d4}，則第3有序數列{d3,d4}(d3>d4)之嚴格單調遞減性將會使得游標於畫面中後退，而使得游標於原本持續前進的狀態下，出現後退的情形，然後再回到原本前進的狀態，造成畫面不穩定。本實施例所揭露之信號過濾方法可移除不必要之信號，確保裝置能穩定地操作，而能解決傳統所遇到之雜訊干擾、或過慮因操作不當而出現之不必要的信號，能加增加系統之穩定性。
此外，本發明更提出一種可用以執行一信號過濾方法之電子裝置。信號過濾方法係包括第一實施例中所詳述之步驟，故於此不再重述。請參照第4圖，其繪示為應用本發明之信號過濾方法之電子裝置之方塊圖。電子裝置400 包括一輸入層410、一驅動層420及一應用層430。輸入層410用以於多個時間點取得多筆信號P1~Pm。驅動層420用以接收此些信號P1~Pm，並執行一作業系統(operating system)。應用層430用以於驅動層420之控制下，執行一應用程式。本發明之信號過濾方法係可實作於輸入層410、驅動層420及應用層430之其中之一。茲以多個實施例將信號過濾方法係如何實作於電子裝置說明如下。
第二實施例
請參照第4圖，於本實施例中，信號過濾方法係實作於第4圖之輸入層410中。輸入層410係為一感測模組，感測模組具有一擷取單元、一微處理器及一記憶體，感測模組係藉由微處理器執行本發明之信號過濾方法，而驅動層920包括一處理器。
請參照第5圖，其繪示為依照本發明之第二實施例之電子裝置之示意圖。電子裝置500包括一感測模組510及一處理器520。感測模組510包括一擷取單元513、一記憶體511及一微處理器512。擷取單元513用以於多個等間隔之時間點取得多筆信號P1~Pm。多筆信號P1~Pm於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數，其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。記憶體511用以儲存一程式碼。微處理器512用以於讀取程式碼及執行後，過濾此些信號P1~Pm，微處理器512用以判斷一第i＋2有序數列是否符 合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。若微處理器512判定第i＋2有序數列符合第二嚴格單調性，且判定第i＋3有序數列不符合第二嚴格單調性，則微處理器512刪除於一第i＋3時間點所取得之一信號。處理器520用以接收感測模組510過濾後之信號。其中，處理器520係為高階之微控制器(microprocessor)，微處理器512係為低階之微控制器。
於本實施例中，信號過濾方法係實作於用以取得外部信號之感測模組內。由於感測模組於取得信號之後，即可過濾此些信號，不需將此些信號傳送至其它單元，例如是驅動層420，因此，本實施例對於信號具有較佳之處理效率，並且，對本實施例對於即時處理(real time)之實務極有助益。再者，由於信號在未被過濾之前，係不會被傳送至驅動層420，故能夠避免傳送可能為雜訊而需要移除之信號，而能夠達到精確控制的功效。
第三實施例
請參照第4圖，於本實施例中，信號過濾方法係實作於第4圖之驅動層420中。輸入層410係為一感測模組，而驅動層420係為一處理模組，處理模組用以執行作業系統，以執行本發明之信號過濾方法。
請參照第6圖，其繪示為依照本發明之第三實施例之電子裝置之示意圖。電子裝置600包括一感測模組610及一處理模組620。感測模組610用以執行一應用程式，以 過濾用以於多個等間隔之時間點取得之多筆信號P1~Pm。此多筆信號P1~Pm於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數。其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。處理模組620包括一記憶體621及一處理器622。記憶體621用以儲存作業系統之程式碼。處理器622用以於讀取作業系統之程式碼並執行後，接收並過濾感測模組610所取得之多筆信號P1~Pm。處理器622用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。若判定第i＋2有序數列符合第二嚴格單調性，且判定第i＋3有序數列不符合該第二嚴格單調性，則處理器622刪除於一第i＋3時間點所取得之一信號。
於本實施例中，與第三實施例不同的是，輸入層410中並不使用處理器，因此，能夠減小電子裝置所需之元件，降低成本。
第四實施例
請參照第4圖，於本實施例中，信號過濾方法係實作於第4圖之應用層430中。驅動層420包括一處理器及一記憶體，應用層430係為一應用程式，當處理器執行此應用程式時，係可執行本發明之信號過濾方法。
請參照第7圖，其繪示為依照本發明之第四實施例之電子裝置之示意圖。電子裝置700用以執行一應用程式， 以過濾於多個等間隔之時間點取得之多筆信號P1~Pm。此多筆信號P1~Pm於上述多個時間點之一第i時間點係對應至一第i數值，i為正整數。其中第i有序數列及一第i＋1有序數列係符合一第一嚴格單調性。電子裝置700包括一記憶體710及一處理器720。記憶體710用以儲存一作業系統之程式碼。處理器720用以於讀取作業系統之程式碼並執行後，執行應用程式，以過濾此些信號P1~Pm。微處理器720用以判斷一第i＋2有序數列是否符合一第二嚴格單調性，及用以判斷一第i＋3有序數列是否符合第二嚴格單調性。若判定第i＋2有序數列符合該第二嚴格單調性，且判定第i＋3有序數列不符合第二嚴格單調性，則處理器720刪除於一第i＋3時間點所取得之一信號。
於本實施例中，由於當處理器執行一特定之應用程式時，才會執行本發明之信號過濾方法。故知，與第二及第三實施例不同的是，本實施例之電子裝置能依照各種不同的應用程式之需求，來決定是否需要執行信號過濾的方法，故對於設計者而言，本實施例之電子裝置係具有較佳的設計彈性。
本發明之實施例所揭露之信號過濾方法係可以程式語言寫作，並儲存於可讀取記錄媒體中，例如光碟片、磁帶、硬碟機或快閃記憶體，較佳地，係儲存於電子裝置內部之記憶體中，以使電子裝置能執行此信號過濾方法。再者，本發明之實施例所揭露之信號過濾方法係可以應用於 內儲數位資料之應用程式，以使一電子裝置載入數位資料並執行後，可使電子裝置執行本發明之信號過濾方法。上述之電子裝置係可應用於一智慧型手機(smart phone)、一觸碰式手機(touch phone)、一個人數位助理(Personal Digital Assistant,PDA)、或一PDA手機。
本發明上述實施例所揭露之信號過濾方法及應用其之電子裝置，能移除由電路干擾訊號、高功率訊號、或是環境之影響下使得輸入單元所取得之多餘數值，而能避免裝置執行不必要的動作，除了能達到省電的效果之外，還能增加電子裝置之操作穩定性。再者，本發明上述實施例所揭露之信號過濾方法及應用其之電子裝置，還可過濾由於使用者操作不當而造成輸入單元感測到非使用者預期之信號，以進一步增加系統之穩定性，並能俾利使用者於操作上之實用性。
綜上所述，雖然本發明已以一較佳實施例揭露如上，然其並非用以限定本發明。本發明所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾。因此，本發明之保護範圍當視後附之申請專利範圍所界定者為準。
S110~S150‧‧‧步驟流程
200、300、400、500、600、700‧‧‧電子裝置
210‧‧‧擷取單元
220‧‧‧判斷單元
230‧‧‧過濾單元
240‧‧‧控制單元
250‧‧‧顯示單元
302‧‧‧機體
304‧‧‧感應轉盤
306‧‧‧顯示螢幕
410‧‧‧輸入層
420‧‧‧驅動層
430‧‧‧應用層
510、610‧‧‧感測模組
511、621、720‧‧‧記憶體
513‧‧‧擷取單元
512‧‧‧微處理器
520、622、710‧‧‧處理器
620‧‧‧處理模組
Im、Ima、Imb‧‧‧畫面
Cr‧‧‧控制游標
P1~Pm‧‧‧信號
第1圖繪示依照本發明之第一實施例之應用於電子裝置之信號過濾方法之流程圖。
第2圖繪示依照本發明之第一實施例之應用信號過濾方法之電子裝置之示意圖。
第3A圖繪示為依照本發明之第一實施例之電子裝置之一例之示意圖。
第3B及3C圖分別繪示為依照本發明之第一實施例之電子裝置所顯示之畫面之一例之示意圖
第4圖繪示為應用本發明之信號過濾方法之電子裝置之方塊圖。
第5圖繪示為依照本發明之第二實施例之電子裝置之示意圖。
第6圖繪示為依照本發明之第三實施例之電子裝置之示意圖。
第7圖繪示為依照本發明之第四實施例之電子裝置之示意圖。
S110~S150‧‧‧步驟流程

Claims (30)

  1. 一種信號過濾方法，用以過濾一電子裝置於複數個時間點所取得之複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性，該方法包括：(a)判斷一第i+2有序數列是否符合一第二嚴格單調性，若是，則執行步驟(b)；以及(b)判斷一第i+3有序數列是否符合該第二嚴格單調性，若否，則刪除於一第i+3時間點所取得之一信號。
  2. 如申請專利範圍第1項所述之方法，其中該步驟(a)前包括：(a0)判斷該第i+2有序數列之二數值是否相等，若是，則刪除於該第i+3時間點所取得之該信號。
  3. 如申請專利範圍第1項所述之方法，其中該步驟(b)前包括：(b0)判斷該第i+3有序數列之二數值是否相等，若是，則刪除於一第i+4時間點所取得之一信號。
  4. 如申請專利範圍第1項所述之方法，其中該步驟(a)包括：若判斷該第i+2有序數列不符合該第二嚴格單調性，則輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  5. 如申請專利範圍第1項所述之方法，其中該步驟(b)包括：若判斷該第i+3有序數列符合該第二嚴格單調性，則輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  6. 如申請專利範圍第1項所述之方法，其中該第一嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之其一，該第二嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之另一。
  7. 一種電子裝置，包括：一擷取單元，用以於複數個等間隔之時間點取得複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應至一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性；一判斷單元，用以判斷一第i+2有序數列是否符合一第二嚴格單調性，及用以判斷一第i+3有序數列是否符合該第二嚴格單調性；以及一過濾單元，用以過濾該擷取單元所取得之該些信號，若該判斷單元判定該第i+2有序數列符合該第二嚴格單調性，且該判斷單元判定該第i+3有序數列不符合該第二嚴格單調性，則該過濾單元刪除於一第i+3時間點所取得之一信號。
  8. 如申請專利範圍第7項所述之裝置，其中該判斷單元更用以判斷該第i+2有序數列之二數值是否相等，若是，則該過濾單元刪除於該第i+3時間點所取得之該信號。
  9. 如申請專利範圍第7項所述之裝置，其中該判斷單元更用以判斷該第i+3有序數列之二數值是否相等，若是，則該過濾單元刪除於一第i+4時間點所取得之一信號。
  10. 如申請專利範圍第7項所述之裝置，其中若該判斷單元判斷該第i+2有序數列不符合該第二嚴格單調性，則該過濾單元輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  11. 如申請專利範圍第7項所述之裝置，其中若該判斷單元判斷該第i+3有序數列符合該第二嚴格單調性，則該過濾單元輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  12. 如申請專利範圍第7項所述之裝置，其中該第一嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之其一，該第二嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之另一。
  13. 如申請專利範圍第7項所述之裝置，更包括：一顯示單元，用以顯示一畫面；以及一控制單元，用以依據該過濾單元所輸出之該些信號決定一控制模式，以控制該顯示單元所顯示之該畫面。
  14. 如申請專利範圍第13項所述之裝置，其中該畫面具有 一游標，該控制模式係為一方向模式，用以控制該游標於該畫面之移動方向。
  15. 如申請專利範圍第14項所述之裝置，其中該畫面係為一一維度畫面，該方向模式係用以控制該游標於該一維畫面中前進或後退。
  16. 如申請專利範圍第14項所述之裝置，其中該畫面係為一二維度畫面，該方向模式係用以控制該游標於該二維畫面中之座標。
  17. 如申請專利範圍第7項所述之裝置，其中該擷取單元包括一感應轉盤(wheel)，用以藉由感應(sensing)的方式擷取該些信號。
  18. 如申請專利範圍第17項所述之裝置，其中該感應轉盤係為一電容感應轉盤。
  19. 如申請專利範圍第7項所述之裝置，係應用於一智慧型手機(smart phone)、一觸碰式手機(touch phone)、一個人數位助理(personal digital assistant,PDA)、或一PDA手機。
  20. 一種內儲數位資料之可讀取記錄媒體，當一電子裝置載入該數位資料並執行後，可使該電子裝置執行一信號過濾方法，該方法用以過濾該電子裝置於複數個等間隔之時間點所取得之複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應至一第i數值，且該第i數值及一第i+1時間點係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係 符合一第一嚴格單調性，該方法包括：(a)判斷一第i+2有序數列之後二數值所定義之子數列是否符合一第二嚴格單調性，若是，則執行步驟(b)；以及(b)判斷一第i+3有序數列是否符合該第二嚴格單調性，若否，該刪除於一第i+3時間點所取得之一信號。
  21. 如申請專利範圍第20項所述之可讀取記錄媒體，其中該步驟(a)前包括：(a0)判斷該第i+2有序數列之二數值是否相等，若是，則刪除於該第i+3時間點所取得之該信號。
  22. 如申請專利範圍第20項所述之可讀取記錄媒體，其中該步驟(b)前包括：(b0)判斷該第i+3有序數列之二數值是否相等，若是，則刪除於一第i+4時間點所取得之一信號。
  23. 如申請專利範圍第20項所述之可讀取記錄媒體，其中該步驟(a)包括：若判斷該第i+2有序數列不符合該第二嚴格單調性，則輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  24. 如申請專利範圍第20項所述之可讀取記錄媒體，其中該步驟(b)包括：若判斷該第i+3有序數列符合該第二嚴格單調性，則輸出於該第i+1時間點、該第i+2時間點及該第i+3時間點所取得之該些信號。
  25. 如申請專利範圍第20項所述之可讀取記錄媒體，其中該第一嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之其一，該第二嚴格單調性係為嚴格單調遞增性及嚴格單調遞減性之另一。
  26. 一種內儲數位資料之應用程式，當一電子裝置載入該數位資料並執行後，可使該電子裝置執行一信號過濾方法，該方法用以過濾該電子裝置於複數個時間點所取得之複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性，該方法包括：(a)判斷一第i+2有序數列是否符合一第二嚴格單調性，若是，則執行步驟(b)；以及(b)判斷一第i+3有序數列是否符合該第二嚴格單調性，若否，則刪除於一第i+3時間點所取得之一信號。
  27. 一種電子裝置，包括：一感測模組，包括：一擷取單元，用以於複數個等間隔之時間點取得複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應至一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性； 一記憶體，用以儲存一程式碼；及一微處理器，用以於讀取該程式碼及執行後，過濾該些信號，該微處理器用以判斷一第i+2有序數列是否符合一第二嚴格單調性，及用以判斷一第i+3有序數列是否符合該第二嚴格單調性，若判定該第i+2有序數列符合該第二嚴格單調性，且判定該第i+3有序數列不符合該第二嚴格單調性，則該微處理器刪除於一第i+3時間點所取得之一信號；以及一處理器，用以接收該感測模組過濾後之該些信號。
  28. 如申請專利範圍第27項所述之裝置，其中該處理器係為高階之微控制器(microprocessor)，該微處理器係為低階之微控制器。
  29. 一種電子裝置，包括：一感測模組，用以於複數個等間隔之時間點取得之複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應至一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性；以及一處理模組，包括：一記憶體，用以儲存一作業系統(operating system)之程式碼；及一處理器，用以於讀取該作業系統之程式碼並執行 後，接收並過濾該感測模組所取得之該些信號，該處理器用以判斷一第i+2有序數列是否符合一第二嚴格單調性，及用以判斷一第i+3有序數列是否符合該第二嚴格單調性，若判定該第i+2有序數列符合該第二嚴格單調性，且判定該第i+3有序數列不符合該第二嚴格單調性，則該處理器刪除於一第i+3時間點所取得之一信號。
  30. 一種電子裝置，用以執行一應用程式，以過濾於複數個等間隔之時間點取得之複數筆信號，該複數筆信號於上述複數個時間點之一第i時間點係對應至一第i數值，且該第i數值及一第i+1數值係定義為一第i有序數列，i為正整數，其中該第i有序數列及一第i+1有序數列係符合一第一嚴格單調性，該電子裝置包括：一記憶體，用以儲存一作業系統(operating system)之程式碼；以及一處理器，用以於讀取該作業系統之程式碼並執行後，執行該應用程式，以過濾該些信號，該處理器用以判斷一第i+2有序數列是否符合一第二嚴格單調性，及用以判斷一第i+3有序數列是否符合該第二嚴格單調性，若判定該第i+2有序數列符合該第二嚴格單調性，且判定該第i+3有序數列不符合該第二嚴格單調性，則該處理器刪除於一第i+3時間點所取得之一信號。
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